JPS58173934A - エラ−訂正符号化方法 - Google Patents
エラ−訂正符号化方法Info
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- JPS58173934A JPS58173934A JP5566082A JP5566082A JPS58173934A JP S58173934 A JPS58173934 A JP S58173934A JP 5566082 A JP5566082 A JP 5566082A JP 5566082 A JP5566082 A JP 5566082A JP S58173934 A JPS58173934 A JP S58173934A
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- memory
- correction
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-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/18—Error detection or correction; Testing, e.g. of drop-outs
- G11B20/1806—Pulse code modulation systems for audio signals
- G11B20/1809—Pulse code modulation systems for audio signals by interleaving
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- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Error Detection And Correction (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は、例えばオーディオＰＣＭ信号の記録再生に
対して適用されるエラー訂正符号化方法に関する。
対して適用されるエラー訂正符号化方法に関する。
この発明は、ディジタルデータの／フレームを複数個の
ブロックに分割し、このブロック単位でエラー訂正用の
第１の冗長コードを付加し、／フレームのディジタルデ
ータ及び第７の冗長コードに対してエラー訂正用の第２
の冗長コード及びエラー検出用の第３の冗長コードを付
加するものである。この発明は、バーストエラー及びラ
ンダムエラーの何れに対しても高いエラー訂正能力を有
するエラー訂正符号化方法の実現を目的とするものであ
る。
ブロックに分割し、このブロック単位でエラー訂正用の
第１の冗長コードを付加し、／フレームのディジタルデ
ータ及び第７の冗長コードに対してエラー訂正用の第２
の冗長コード及びエラー検出用の第３の冗長コードを付
加するものである。この発明は、バーストエラー及びラ
ンダムエラーの何れに対しても高いエラー訂正能力を有
するエラー訂正符号化方法の実現を目的とするものであ
る。
以下、この発明の一実施例について説明すると、まず、
その符号構成を説明する。
その符号構成を説明する。
この例は、オーディオＰＣＭ信号を回転ヘッド形テープ
レコーダによって記録再生する場合に対してこの発明を
適用したもので、／サンプル／乙ビットをその上位及び
下位の各ｇビットに分けておシ、このｇビットを／ワー
ドとしている。そして、／フレームに１０左０ワードの
ＰＯＭデータが含まれ、これが第１図に示すようにＣ３
０ｘ２／＞のマトリクス状に配される。
レコーダによって記録再生する場合に対してこの発明を
適用したもので、／サンプル／乙ビットをその上位及び
下位の各ｇビットに分けておシ、このｇビットを／ワー
ドとしている。そして、／フレームに１０左０ワードの
ＰＯＭデータが含まれ、これが第１図に示すようにＣ３
０ｘ２／＞のマトリクス状に配される。
とのＰＯＭデータからガるマトリクスの縦方向ａに対し
てエラー訂正用のコード例えば隣接（ｂ−ａｄｊａｃｅ
ｎｔ ）符号の２つのパリティｐ、Ｑが付加される。こ
の場合、ＰＯＭデータが７０ワードを／ブロックとして
各列毎に５ブロツクに分割され、各ブロック毎にパリテ
ィＰ、Ｑが付加される。また、ＰＯＭデータ及びパリテ
ィＰ、Ｑの（乙０×、２／＝／２１，０ワード）に対し
て、その斜めの方向すに位置する２／ワード毎に隣接符
号のλつのパリティＲ，Ｅが付加される。更に、ＰＯＭ
データ（又はパリティｐ、Ｑ）とパリティＲ，Ｓとに対
して横力向Ｃにエラー検出用のＯＲＯコードが付加され
る。ここで、アドレス信号ＡＤが配されており、このア
ドレス信号ＡＤもＯＲ，Ｏコーげによるエラー検出の対
象とされている。
てエラー訂正用のコード例えば隣接（ｂ−ａｄｊａｃｅ
ｎｔ ）符号の２つのパリティｐ、Ｑが付加される。こ
の場合、ＰＯＭデータが７０ワードを／ブロックとして
各列毎に５ブロツクに分割され、各ブロック毎にパリテ
ィＰ、Ｑが付加される。また、ＰＯＭデータ及びパリテ
ィＰ、Ｑの（乙０×、２／＝／２１，０ワード）に対し
て、その斜めの方向すに位置する２／ワード毎に隣接符
号のλつのパリティＲ，Ｅが付加される。更に、ＰＯＭ
データ（又はパリティｐ、Ｑ）とパリティＲ，Ｓとに対
して横力向Ｃにエラー検出用のＯＲＯコードが付加され
る。ここで、アドレス信号ＡＤが配されており、このア
ドレス信号ＡＤもＯＲ，Ｏコーげによるエラー検出の対
象とされている。
第２図に、上述のこの発明の一実施例における符号構成
がより詳細に示されている。
がより詳細に示されている。
／フレームのＰＣＭデータＷ。、 Ｗｔ 、 ｗ、 、
・・・・・・・・・・・・Ｗ１Ｏ５０は、ＳＯワードづ
つ縦方向に配されてマトリクスが構成されている。この
ＳＯワードのＳワード毎に位置する計／θワードが／ブ
ロックとされる。例えば最初の列には （Ｗｏ ｔ Ｗｓ ＋ ・・・・・・・・・・・・・
・・・・・・・・・・・ Ｗ４Ｏｒ Ｗ４５ ）（”
！ ＋ ｗ、 ｌ ・・・・・・・・・・・・・・・
・・・・・・・・・Ｗ４１ ｒ Ｗ４６ ）（Ｗ２．
Ｗ、 、 ・・・・・・・・・・・・・・・・・・・
・・・・・Ｗ４２ ｒ Ｗ４７ ）（”３ ｖ ｗａ
ｌ ・・・・・・・・・・・・・・・・・・・・・
・・・Ｗ４３ ｔ Ｗ２Ｂ ）（”４ ｗ ｗ、ｌ
・・・・・・°・・・・・・・・・−・・・・・・・
Ｗ４４ ｔ Ｗ４９ ）の３ブロツクが存在し、各ブ
ロック毎にコつのパリティ（Ｐｏ、Ｑｏ）（Ｐｔ−Ｑ＋
）（Ｐ２．Ｑ、２）（Ｐｓ。
・・・・・・・・・・・・Ｗ１Ｏ５０は、ＳＯワードづ
つ縦方向に配されてマトリクスが構成されている。この
ＳＯワードのＳワード毎に位置する計／θワードが／ブ
ロックとされる。例えば最初の列には （Ｗｏ ｔ Ｗｓ ＋ ・・・・・・・・・・・・・
・・・・・・・・・・・ Ｗ４Ｏｒ Ｗ４５ ）（”
！ ＋ ｗ、 ｌ ・・・・・・・・・・・・・・・
・・・・・・・・・Ｗ４１ ｒ Ｗ４６ ）（Ｗ２．
Ｗ、 、 ・・・・・・・・・・・・・・・・・・・
・・・・・Ｗ４２ ｒ Ｗ４７ ）（”３ ｖ ｗａ
ｌ ・・・・・・・・・・・・・・・・・・・・・
・・・Ｗ４３ ｔ Ｗ２Ｂ ）（”４ ｗ ｗ、ｌ
・・・・・・°・・・・・・・・・−・・・・・・・
Ｗ４４ ｔ Ｗ４９ ）の３ブロツクが存在し、各ブ
ロック毎にコつのパリティ（Ｐｏ、Ｑｏ）（Ｐｔ−Ｑ＋
）（Ｐ２．Ｑ、２）（Ｐｓ。
Ｑ３ ）（Ｐ４ ＋ Ｑ＜ ）が形成される。例えばパ
リティＰ０は、次式の（ｍｏａ、 ２ ）の演算で表わ
される偶数パリティである。
リティＰ０は、次式の（ｍｏａ、 ２ ）の演算で表わ
される偶数パリティである。
Ｐｏ＝Ｗ、■Ｗ５（９・・・・・・・・・・・−・・・
（ＥＩ Ｗ４５また、他のパリティＱｏは、次式のよう
な演算によって発生される。
（ＥＩ Ｗ４５また、他のパリティＱｏは、次式のよう
な演算によって発生される。
Ｑｏ ＝ Ｔ ” Ｗｏ ８９Ｔ９Ｗｓ■Ｔ８ ｗｔｏ
■・・・・・・・−・・・・・・・・・・・・・・・・
・・−・・・・−・・・・■Ｔ２Ｗ４ｏ■ＴＷ４５上式
でＴは、／ワードをｇビットとしているので、（ｇｘｇ
）のマトリクスで、Ｔ、Ｔ２．・・・・・・・・・Ｔ８
゜Ｔ９．ＴＩＯの各々が全て異なるものである。かかる
隣接符号によって、／ブロック内のコワードエラーまで
訂正することができる。
■・・・・・・・−・・・・・・・・・・・・・・・・
・・−・・・・−・・・・■Ｔ２Ｗ４ｏ■ＴＷ４５上式
でＴは、／ワードをｇビットとしているので、（ｇｘｇ
）のマトリクスで、Ｔ、Ｔ２．・・・・・・・・・Ｔ８
゜Ｔ９．ＴＩＯの各々が全て異なるものである。かかる
隣接符号によって、／ブロック内のコワードエラーまで
訂正することができる。
３−
また、このパリティＰ、Ｑも含めて（乙Ｏ×、２ ／＝
／ ２乙Ｏワード）に対して斜め方向にａつのパリティ
Ｒ，８が付加される。このパリティＲ１Ｓは、上式と同
様の演算によって形成されるものである。例えば（Ｗｏ
・ｗｉｔ・Ｗｌ（Ｈ・Ｗ１１１３・Ｗ２Ｏ４・Ｗ２６５
・・・・・・・・・・・・・・・Ｌｏｚｏ ）の２７ワ
ードがパリティＲ２１及び８２１を生成する系列とされ
る。このように。
／ ２乙Ｏワード）に対して斜め方向にａつのパリティ
Ｒ，８が付加される。このパリティＲ１Ｓは、上式と同
様の演算によって形成されるものである。例えば（Ｗｏ
・ｗｉｔ・Ｗｌ（Ｈ・Ｗ１１１３・Ｗ２Ｏ４・Ｗ２６５
・・・・・・・・・・・・・・・Ｌｏｚｏ ）の２７ワ
ードがパリティＲ２１及び８２１を生成する系列とされ
る。このように。
斜め方向の２／ワードが順次取り出されてパリティＲ，
ｆ３が生成されるので、（Ｒ０〜Ｒ５１＃ ８６〜５５
９）の乙Ｏワードのパリティが存在する。
ｆ３が生成されるので、（Ｒ０〜Ｒ５１＃ ８６〜５５
９）の乙Ｏワードのパリティが存在する。
そして、第７図及び第２図における横方向の２／ソーｒ
のＰＯＭデータ（Ｖｌ’ｏ ｒ Ｗｓｏ ｖ ｗｔｏｏ
１ ”””’：’””” Ｗ９０Ｇ ｍ Ｗ１００ｆ
＋ ）とコワードのパリティ（Ｒｏ。
のＰＯＭデータ（Ｖｌ’ｏ ｒ Ｗｓｏ ｖ ｗｔｏｏ
１ ”””’：’””” Ｗ９０Ｇ ｍ Ｗ１００ｆ
＋ ）とコワードのパリティ（Ｒｏ。
Ｓｏ ） と６ビツトのアドレス信号ＡＤとに対して
例えば／乙ピットのＯＲＯコーＰが付加される。同様に
、第２行以降のディジタルデータ及びアドレス信号ＡＤ
毎にＯＲＯコードが付加される。
例えば／乙ピットのＯＲＯコーＰが付加される。同様に
、第２行以降のディジタルデータ及びアドレス信号ＡＤ
毎にＯＲＯコードが付加される。
磁気テープに記録される場合には、第３図に示すように
、３ビツトの同期信号（８ＹＮＣ）が付加され、第１行
のものから順番に記録される。
、３ビツトの同期信号（８ＹＮＣ）が付加され、第１行
のものから順番に記録される。
４−
第７図は、この発明の一実施例におけるエンコ・−ダ及
びデコーダの基本的な構成を示している。
びデコーダの基本的な構成を示している。
第９図において、１で示す入力端子からオーディオ信号
が供給され、Ａ ／ Ｄコンバータ２によシデイジタル
化されてデータバス３に供給される。
が供給され、Ａ ／ Ｄコンバータ２によシデイジタル
化されてデータバス３に供給される。
そして、とのＰＯＭデータの／フレーム（ｉｏｓ。
ワード）がＲＡＭなどのメモリー４に書込まれる。
このメモリー４から読出した各ブロックのＩＯワードが
エラー訂正コード発生回路５に供給され、２つのパリテ
ィｐ、 Ｑが形成され、このパリティＰ、Ｑもメモリー
４に書込まれる。再び、メモリー４からＰＯＭデータ及
びパリティＰ、Ｑの所定の２１ワードが読出され、エラ
ー訂正コード発生回路６に供給され、２つのパリティＲ
，Ｓが形成され、これがメモリー４に書込まれる。
エラー訂正コード発生回路５に供給され、２つのパリテ
ィｐ、 Ｑが形成され、このパリティＰ、Ｑもメモリー
４に書込まれる。再び、メモリー４からＰＯＭデータ及
びパリティＰ、Ｑの所定の２１ワードが読出され、エラ
ー訂正コード発生回路６に供給され、２つのパリティＲ
，Ｓが形成され、これがメモリー４に書込まれる。
オーディオＰＯＭデータは、連続しているので、上述の
ようなエラー訂正コーｒをメモリー４の一方のメモリー
パンクを用いて生成している間に現れるＰＯＭデータは
、メモリー４の他方のメモリーパンクに書込まれる。
ようなエラー訂正コーｒをメモリー４の一方のメモリー
パンクを用いて生成している間に現れるＰＯＭデータは
、メモリー４の他方のメモリーパンクに書込まれる。
そして、エラー訂正コード化がなされたデータがメモリ
ー４から読出され、データバス３を介してＣＲＣコード
発生回路７に供給され、ＯＲＯコーＰが付加され、更に
、変調回路８を介して出力端子９に取り出される。この
出力端子９には、記録アンプ、回転トランスを介して回
転ヘッドが接続され、磁気テープに対して上述のディジ
タルデータが記録される。
ー４から読出され、データバス３を介してＣＲＣコード
発生回路７に供給され、ＯＲＯコーＰが付加され、更に
、変調回路８を介して出力端子９に取り出される。この
出力端子９には、記録アンプ、回転トランスを介して回
転ヘッドが接続され、磁気テープに対して上述のディジ
タルデータが記録される。
また、磁気テープから再生され、回転トランス。
再生アンプ、波形整形回路、クロック再生回路などを介
された再生ディジタルデータが端子１０から復調回路１
１に供給される。
された再生ディジタルデータが端子１０から復調回路１
１に供給される。
この復調回路１１の出力が０Ｒ（３チエツカ１２に供給
され、工２−の有無が検出される。エラー検出の結果の
例えば／ビットのエラーポインタと再生データとがデー
タバス３に供給され、メモリー４に書込まれる。
され、工２−の有無が検出される。エラー検出の結果の
例えば／ビットのエラーポインタと再生データとがデー
タバス３に供給され、メモリー４に書込まれる。
記録時の場合と同様に、再生時にメモリー４のひとつの
メモリーバンクに再生データが書込まれている間に、他
のメモリーバンクに既に書込まれている再生データが読
出され一エラー訂正及び補間回路１３に供給される。エ
ラーポインタを用いて、パリティＲ，８によるエラー訂
正がなされる。
メモリーバンクに再生データが書込まれている間に、他
のメモリーバンクに既に書込まれている再生データが読
出され一エラー訂正及び補間回路１３に供給される。エ
ラーポインタを用いて、パリティＲ，８によるエラー訂
正がなされる。
このエラー訂正後のＰＯＭデータ及びパリティＰ。
Ｑが再びメモリー４に書込まれ、各ブロック毎に読出さ
れてエラー訂正及び補間回路１３に供給され、各ブロッ
ク毎にパリティＰ＋Ｑを用いたエラー訂正がなされる。
れてエラー訂正及び補間回路１３に供給され、各ブロッ
ク毎にパリティＰ＋Ｑを用いたエラー訂正がなされる。
エラー訂正できないデータは。
前後の正しいデータの平均値で補間される。このエラー
訂正及び補間回路１３の出力がＤ ／ Ａコンバータ１
４に供給され、出力端子１５に再生オーディオ信号が取
シ出される。
訂正及び補間回路１３の出力がＤ ／ Ａコンバータ１
４に供給され、出力端子１５に再生オーディオ信号が取
シ出される。
第Ｓ図に示すように、縦方向にパリティＰ、 Ｑを付加
する場合、（％〜Ｗｅ ） （Ｗｔｏ−Ｗ１９） （Ｗ
２０〜Ｗ２９ ） （Ｗｓｏ 〜Ｗ３９ ） （Ｗ２Ｏ
〜Ｗ４９ ）のように、連続する１０ワードず２をブロ
ックＢ１１ Ｂ２ ｖ Ｂ３ ｒＢ４ ＋ ＢＳ とす
るようはしても良い。
する場合、（％〜Ｗｅ ） （Ｗｔｏ−Ｗ１９） （Ｗ
２０〜Ｗ２９ ） （Ｗｓｏ 〜Ｗ３９ ） （Ｗ２Ｏ
〜Ｗ４９ ）のように、連続する１０ワードず２をブロ
ックＢ１１ Ｂ２ ｖ Ｂ３ ｒＢ４ ＋ ＢＳ とす
るようはしても良い。
また、パリティＰＩＱとパリティＲ，ＳとＯＲＯコード
とは、互いに異なる方向で取シ出されたデータに対して
付加すれば良く、横方向のデータからパリティＰＴＱを
形成し、斜め方向に位置するデータに対してＣ３Ｒ（３
コードを付加することもできる。
とは、互いに異なる方向で取シ出されたデータに対して
付加すれば良く、横方向のデータからパリティＰＴＱを
形成し、斜め方向に位置するデータに対してＣ３Ｒ（３
コードを付加することもできる。
上述の一実施例の説明から理解されるように、この発明
に依れば、／フレームのディジタルデータを複数ブロッ
クに分割し、各ブロック毎にエラー訂正用の第１の冗長
コードを生成すると共に、ディジタルデータ及び第１の
冗長コードから第コの冗長コード及びエラー検出コード
を生成しているので、エラー訂正能力を高くすることが
できる。
に依れば、／フレームのディジタルデータを複数ブロッ
クに分割し、各ブロック毎にエラー訂正用の第１の冗長
コードを生成すると共に、ディジタルデータ及び第１の
冗長コードから第コの冗長コード及びエラー検出コード
を生成しているので、エラー訂正能力を高くすることが
できる。
なお、エラー訂正用の冗長コードとしては、単純パリテ
ィ、リードソ四モン符号、 ＢＯＨ符号などを用いるこ
とが可能である。
ィ、リードソ四モン符号、 ＢＯＨ符号などを用いるこ
とが可能である。
第１図、第２図及び第３図はこの発明の一実施例の符号
構成の説明に用いる路線図、第ダ図はこの発明の一実施
例のエンコーダ及びデコーダの構成の説明に用いるブロ
ック図、第Ｓ図はこの発明の他の実施例の符号構成の説
明に用いる路線図である。 ２・・・・・・・・・・・・Ａ ／ Ｄコンバータ、５
．６・・・・・・・・・・・・エラー訂正コード発生回
路、Ｔ・・・・・・・・・・・・ＯＲＯコ゛−ド発生回
路、１２・・・・・・・・・・・・ＯＲＯチェッカ、１
３・・・・・・・・・・・・エラー訂正及び補間回路、
１４−・・・・・・・・・・・Ｄ ／ ｈコンバータ。 代理人 杉 浦 正 知
構成の説明に用いる路線図、第ダ図はこの発明の一実施
例のエンコーダ及びデコーダの構成の説明に用いるブロ
ック図、第Ｓ図はこの発明の他の実施例の符号構成の説
明に用いる路線図である。 ２・・・・・・・・・・・・Ａ ／ Ｄコンバータ、５
．６・・・・・・・・・・・・エラー訂正コード発生回
路、Ｔ・・・・・・・・・・・・ＯＲＯコ゛−ド発生回
路、１２・・・・・・・・・・・・ＯＲＯチェッカ、１
３・・・・・・・・・・・・エラー訂正及び補間回路、
１４−・・・・・・・・・・・Ｄ ／ ｈコンバータ。 代理人 杉 浦 正 知
Claims (1)
- マトリクス状の配列の／フレームのディジタルデータを
、その第１の方向で複数個のブロックに分割し、この第
１の方向で各プルツク毎に独立したエラー訂正用の第１
の冗長コードを付加し、上記／フレームのデータ及び第
１の冗長コードに対して、上記マ） ＩＪクスの第ユの
方向でエラー訂正用の第２の冗長コードを付加し、上記
／フレームのデータ、第１の冗長コード及び第ユの冗長
コードに対して、上記マトリクスの第３の方向でエラー
検出用の第３の冗長コードを付加することを特徴とする
エラー訂正符号化方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5566082A JPS58173934A (ja) | 1982-04-03 | 1982-04-03 | エラ−訂正符号化方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5566082A JPS58173934A (ja) | 1982-04-03 | 1982-04-03 | エラ−訂正符号化方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58173934A true JPS58173934A (ja) | 1983-10-12 |
Family
ID=13004992
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5566082A Pending JPS58173934A (ja) | 1982-04-03 | 1982-04-03 | エラ−訂正符号化方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58173934A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60154370A (ja) * | 1984-01-24 | 1985-08-14 | Trio Kenwood Corp | 磁気記録再生装置 |
| WO1986003911A1 (en) * | 1984-12-26 | 1986-07-03 | Mitsubishi Denki Kabushiki Kaisha | Two-step encoding method |
| US4903148A (en) * | 1986-04-02 | 1990-02-20 | Matsushita Electric Industrial Co., Ltd. | Digital signal editing apparatus |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5526715A (en) * | 1978-08-16 | 1980-02-26 | Kokusai Denshin Denwa Co Ltd <Kdd> | Data string rearrangement unit |
| JPS55114056A (en) * | 1979-02-26 | 1980-09-03 | Sony Corp | Error correcting device |
-
1982
- 1982-04-03 JP JP5566082A patent/JPS58173934A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5526715A (en) * | 1978-08-16 | 1980-02-26 | Kokusai Denshin Denwa Co Ltd <Kdd> | Data string rearrangement unit |
| JPS55114056A (en) * | 1979-02-26 | 1980-09-03 | Sony Corp | Error correcting device |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60154370A (ja) * | 1984-01-24 | 1985-08-14 | Trio Kenwood Corp | 磁気記録再生装置 |
| WO1986003911A1 (en) * | 1984-12-26 | 1986-07-03 | Mitsubishi Denki Kabushiki Kaisha | Two-step encoding method |
| GB2180966A (en) * | 1984-12-26 | 1987-04-08 | Mitsubishi Electric Corp | Two-step encoding method |
| DE3590661C2 (ja) * | 1984-12-26 | 1989-09-14 | Mitsubishi Denki K.K., Tokio/Tokyo, Jp | |
| US4903148A (en) * | 1986-04-02 | 1990-02-20 | Matsushita Electric Industrial Co., Ltd. | Digital signal editing apparatus |
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