JPS58171164A - デジタルｂｄｔ演算方式 - Google Patents
デジタルｂｄｔ演算方式Info
- Publication number
- JPS58171164A JPS58171164A JP5425282A JP5425282A JPS58171164A JP S58171164 A JPS58171164 A JP S58171164A JP 5425282 A JP5425282 A JP 5425282A JP 5425282 A JP5425282 A JP 5425282A JP S58171164 A JPS58171164 A JP S58171164A
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- bdt
- signal
- selector
- audio signal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04M—TELEPHONIC COMMUNICATION
- H04M3/00—Automatic or semi-automatic exchanges
- H04M3/42—Systems providing special services or facilities to subscribers
- H04M3/56—Arrangements for connecting several subscribers to a common circuit, i.e. affording conference facilities
- H04M3/561—Arrangements for connecting several subscribers to a common circuit, i.e. affording conference facilities by multiplexing
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、デジタル交換機の時分割ネットワークに接続
され、２加入者とオペレータの接続を行なうＢＤＴ演算
方式に関する。
され、２加入者とオペレータの接続を行なうＢＤＴ演算
方式に関する。
従来、この種のＢＤＴ演算方式においては、第２図に示
すように、演算結果２７を選択すべく、ＰＣＭ符号加算
回路２１の入力信号の選択のため、トーン信号１５．音
声信号囚１６及び音声信号の）１７を入力とする３−１
セレクタ１９と、音声信号（Ａ）１６及び音声信号ｃ）
１８を入力とする２−１セレク７２０とを設けている。
すように、演算結果２７を選択すべく、ＰＣＭ符号加算
回路２１の入力信号の選択のため、トーン信号１５．音
声信号囚１６及び音声信号の）１７を入力とする３−１
セレクタ１９と、音声信号（Ａ）１６及び音声信号ｃ）
１８を入力とする２−１セレク７２０とを設けている。
父、ＢＤＴ演算回路の出力選択のために、トーン信号１
５．無音信号１４゜音声信号（Ｂ）１７．音声信号０１
８及び３ｄＢ減衰回路２２の出力信号の５信号を入力と
する５−１セレクタ２３と、トーン信号１５．無音信号
１４゜音声信号囚１６．音声信号０１８及び３ｄＢ減衰
回路２２の出力信号の５信号を入力とする５−１セレク
タ２４と、トーン信号１５．無音信号１４゜音響信号（
Ａ）１６ 、音声信号＠）１７及び３ｄＢ減衰回路２２
の出力信号の５信号を入力とする５−１セレクタ２５と
、上記３組の５−１セレクタ２３，２４゜２５の出力か
らＢＤＴ演算回路の出力を決定する３−１セレクタ２６
とを設けている。更に、ＢＤＴ演算回路に対する状態制
御オーダ３０とＢＤＴ演算回路の出力を指定するチャネ
ル番号２９とＫより、上記各セレクタ１９ 、２０ 、
２３ 、２４ 、２５及び２６の制御を行なう制御回路
２８を設けている。
５．無音信号１４゜音声信号（Ｂ）１７．音声信号０１
８及び３ｄＢ減衰回路２２の出力信号の５信号を入力と
する５−１セレクタ２３と、トーン信号１５．無音信号
１４゜音声信号囚１６．音声信号０１８及び３ｄＢ減衰
回路２２の出力信号の５信号を入力とする５−１セレク
タ２４と、トーン信号１５．無音信号１４゜音響信号（
Ａ）１６ 、音声信号＠）１７及び３ｄＢ減衰回路２２
の出力信号の５信号を入力とする５−１セレクタ２５と
、上記３組の５−１セレクタ２３，２４゜２５の出力か
らＢＤＴ演算回路の出力を決定する３−１セレクタ２６
とを設けている。更に、ＢＤＴ演算回路に対する状態制
御オーダ３０とＢＤＴ演算回路の出力を指定するチャネ
ル番号２９とＫより、上記各セレクタ１９ 、２０ 、
２３ 、２４ 、２５及び２６の制御を行なう制御回路
２８を設けている。
しかし、この従来の方式は、多数の信号選択用セレクタ
を必要とし、しかもそれらの制御回路のためのハードウ
ェア量が多くなり、それに伴なって、消費電力及び発熱
量が増大するという欠点がある。父、セレクタ用ＩＣを
多段接続するため、演算回路の遅延時間が長くなるとい
う欠点がある。
を必要とし、しかもそれらの制御回路のためのハードウ
ェア量が多くなり、それに伴なって、消費電力及び発熱
量が増大するという欠点がある。父、セレクタ用ＩＣを
多段接続するため、演算回路の遅延時間が長くなるとい
う欠点がある。
本発明は、斯かる欠点に鑑みてなされたもので、ＰＣＭ
符号加算回路の入力に接続されるセレクタの入力として
無音信号を追加し、且つ、ＰＣＭ符号加算回路の出力に
接続される３ｄＢ減衰回路に挿入／スルーの制御を行な
って、３ｄＢ減衰回路の出力側に接続される３組の５−
１セレクタ及び３−１セレクタを除くことにより、ＢＤ
Ｔ演算回路を高速化すると共に、ハードウェア量を減少
させてＢＤＴモジュールを小型化し得るＢＤＴ演算回路
を提供することを目的とする。
符号加算回路の入力に接続されるセレクタの入力として
無音信号を追加し、且つ、ＰＣＭ符号加算回路の出力に
接続される３ｄＢ減衰回路に挿入／スルーの制御を行な
って、３ｄＢ減衰回路の出力側に接続される３組の５−
１セレクタ及び３−１セレクタを除くことにより、ＢＤ
Ｔ演算回路を高速化すると共に、ハードウェア量を減少
させてＢＤＴモジュールを小型化し得るＢＤＴ演算回路
を提供することを目的とする。
即ち、本発明は、三つの音声信号Ａ、Ｂ、Ｃと、トーン
信号と、無音信号とを入力とするデジタルＢＤＴ演算方
式であって、無音信号、音声信号Ａ。
信号と、無音信号とを入力とするデジタルＢＤＴ演算方
式であって、無音信号、音声信号Ａ。
音声信号Ｂ及びトーン信号から−の信号を選択する４−
１セレクタと、無音信号、音声信号Ａ、音声信号Ｂ及び
音声信号Ｃから−の信号を選択する４−１セレクタと、
上記二つの４−１セレクタに接続されるＰＣＭ符号加算
回路と、該回路に接続される３ｄＢ減衰回路とを有し、
且つ、デジタルＢＤＴ演算回路に対する状態制御オーダ
及びデジタルＢＤＴ演算回路の出力を指定するチャネル
番号により、上記４−１セレクタの制御と上記３ｄＢ減
衰回路の挿入／スルーの制御とを行なう制御回路を有す
ることを特徴とするものである。
１セレクタと、無音信号、音声信号Ａ、音声信号Ｂ及び
音声信号Ｃから−の信号を選択する４−１セレクタと、
上記二つの４−１セレクタに接続されるＰＣＭ符号加算
回路と、該回路に接続される３ｄＢ減衰回路とを有し、
且つ、デジタルＢＤＴ演算回路に対する状態制御オーダ
及びデジタルＢＤＴ演算回路の出力を指定するチャネル
番号により、上記４−１セレクタの制御と上記３ｄＢ減
衰回路の挿入／スルーの制御とを行なう制御回路を有す
ることを特徴とするものである。
以下、本発明を図面に示す実施例に基づいて説明する。
第１図は本発明ＢＤＴ演算方式の一実施例を示すブロッ
ク図である。図において本発明演算方式％式％ びトーン信号４に接続され九４−１セレクタ６と、無音
信号１．音声信号（Ａ）２．音声信号＠）３及び音声信
号ｃ）５に接続された４−１セレクタ７と、これら二つ
の４−１セレクタ６．７に接続されたＰＣＭ符号加算回
路８と、この加算回路８に接続され九３ ｄＢ ｍ衰回
路９と、チャネル番号１１及びオーダ１２により４−１
セレクタ６．７及び３ｄＢ減衰回路９を制御する制御回
路１０とを含み構成される。
ク図である。図において本発明演算方式％式％ びトーン信号４に接続され九４−１セレクタ６と、無音
信号１．音声信号（Ａ）２．音声信号＠）３及び音声信
号ｃ）５に接続された４−１セレクタ７と、これら二つ
の４−１セレクタ６．７に接続されたＰＣＭ符号加算回
路８と、この加算回路８に接続され九３ ｄＢ ｍ衰回
路９と、チャネル番号１１及びオーダ１２により４−１
セレクタ６．７及び３ｄＢ減衰回路９を制御する制御回
路１０とを含み構成される。
上記制御回路１０では、ＢＤＴ制御オーダ１２とチャネ
ル番号１１とを指定することによりＢＤＴ演算回路の出
力１３が決定される。ここで、ＢＤＴ演算結果１３とし
て無音信号１．音声信号（４）２、音声信号＠３．トー
ン信号４ｔ−必要とする場合には、制御回路１０によ＃
）４−１セレクタ６にてそれぞれ無音信号１．音声信号
２．音声信号３゜トーン信号４を選択し、ついで、４−
１セレクタ７にて無音信号１を選択し、３ｄＢ減衰回路
９を制御回路１０によりスルーとして、目的の演算結果
１３を得る。
ル番号１１とを指定することによりＢＤＴ演算回路の出
力１３が決定される。ここで、ＢＤＴ演算結果１３とし
て無音信号１．音声信号（４）２、音声信号＠３．トー
ン信号４ｔ−必要とする場合には、制御回路１０によ＃
）４−１セレクタ６にてそれぞれ無音信号１．音声信号
２．音声信号３゜トーン信号４を選択し、ついで、４−
１セレクタ７にて無音信号１を選択し、３ｄＢ減衰回路
９を制御回路１０によりスルーとして、目的の演算結果
１３を得る。
次に、演算結果１３として、■音声信号２と音声信号３
の和、■音声信号３と音声信号５の和又は■音声信号２
と音声信号５の和を、それぞれ３ｄＢ減衰させた信号を
必要とする場合には、■４−１ セレクタ６にて音声信
号２を選択すると共に４−１セレクタ７にて音声信号３
を選択し、■４−１セレクタ６にて音声信号３を選択す
ると共に４−１セレクタ７にて音声信号５を選択し、又
は■４−１セレクタ６にて音声信号２を選択すると共に
４−１セレクタ７にて音声信号５を選択し、それぞれ加
算回路８によシ演算後、制御回路１０にょシ３ｄＢ減衰
回路９を挿入して演算結果１３を得る。
の和、■音声信号３と音声信号５の和又は■音声信号２
と音声信号５の和を、それぞれ３ｄＢ減衰させた信号を
必要とする場合には、■４−１ セレクタ６にて音声信
号２を選択すると共に４−１セレクタ７にて音声信号３
を選択し、■４−１セレクタ６にて音声信号３を選択す
ると共に４−１セレクタ７にて音声信号５を選択し、又
は■４−１セレクタ６にて音声信号２を選択すると共に
４−１セレクタ７にて音声信号５を選択し、それぞれ加
算回路８によシ演算後、制御回路１０にょシ３ｄＢ減衰
回路９を挿入して演算結果１３を得る。
以上説明したように、本発明は、ＰＣＭ符号加算回路の
入力に接続されるセレクタの入力として無音信号を追加
し、且つ、ＰＣＭ符号加算回路の出力に接続される３ｄ
Ｂ減衰回路に挿入／スルーの制御を行う構成としたこと
により、３ｄＢ減衰回路の出力側に接続される３組の５
−１セレクタ及び３−１セレクタを除くと共にその制御
回路を簡単化できて、ＢＤＴ演算回路を高速化すると共
に１ハードウェアｆ＃、を減少させてＢＤＴモジュール
を小型化できる効果がある。
入力に接続されるセレクタの入力として無音信号を追加
し、且つ、ＰＣＭ符号加算回路の出力に接続される３ｄ
Ｂ減衰回路に挿入／スルーの制御を行う構成としたこと
により、３ｄＢ減衰回路の出力側に接続される３組の５
−１セレクタ及び３−１セレクタを除くと共にその制御
回路を簡単化できて、ＢＤＴ演算回路を高速化すると共
に１ハードウェアｆ＃、を減少させてＢＤＴモジュール
を小型化できる効果がある。
＠１図は本発明のデジタルＢＤＴ演算方式の一実施例を
示すブロック図、第２図は従来のデジタルＢＤＴ演算回
路を示すブロック図である。 １．１４・・・無音信号 ２，３，５，１６，１７．１
８・・・音声信号Ａ、Ｂ、Ｃ４，１５・・・トーン信号
６，７・・・４−１セレクタ８．２１・・・Ｐ
ＣＭ符号加算回路 ９，２２・・・３ｄＢ減衰回路１
０．２８・・・制御回路 １１．２９・・・チ
ャネル番号１２．３０・・・ＢＤＴ制御オーダ １３
，２７・・・ＢＤＴ演算結果１９．２６・・・３−１セ
レクタ 加・・・２−１セレクタＺ３．２４．２
５・・・５−１セレクタ出願人 日本電気株式会社
示すブロック図、第２図は従来のデジタルＢＤＴ演算回
路を示すブロック図である。 １．１４・・・無音信号 ２，３，５，１６，１７．１
８・・・音声信号Ａ、Ｂ、Ｃ４，１５・・・トーン信号
６，７・・・４−１セレクタ８．２１・・・Ｐ
ＣＭ符号加算回路 ９，２２・・・３ｄＢ減衰回路１
０．２８・・・制御回路 １１．２９・・・チ
ャネル番号１２．３０・・・ＢＤＴ制御オーダ １３
，２７・・・ＢＤＴ演算結果１９．２６・・・３−１セ
レクタ 加・・・２−１セレクタＺ３．２４．２
５・・・５−１セレクタ出願人 日本電気株式会社
Claims (1)
- 【特許請求の範囲】 三つの音声信号Ａ、Ｂ、Ｃと、トーン信号と、無音信号
とを入力とするデジタルＢＤＴ演算方式無音信号、音声
信号人、音声信号Ｂ及びトーン信号から−の信号を選択
する４−１セレクタと、無音信号、音声信号Ａ、音音信
信号及び音声信号Ｃから−の信号を選択する４−１セレ
クタと、上記二つの４−１セレクタに接続されるＰＣＭ
符号加算回路と、該回路に接続される３ｄＢ 減衰回路
とを有し、 且つ、デジタルＢＤＴ演算回路に対する状態制御オーダ
及びデジタルＢＤＴ演算回路の出力を指定するチャネル
番号により、上記４−１セレクタの制御と上記３ｄＢ減
衰回路の挿入／スルーの制御とを行なう制御回路を有す
ることを特徴とするデジタルＢＤＴ演算方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5425282A JPS58171164A (ja) | 1982-04-01 | 1982-04-01 | デジタルｂｄｔ演算方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5425282A JPS58171164A (ja) | 1982-04-01 | 1982-04-01 | デジタルｂｄｔ演算方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58171164A true JPS58171164A (ja) | 1983-10-07 |
Family
ID=12965356
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5425282A Pending JPS58171164A (ja) | 1982-04-01 | 1982-04-01 | デジタルｂｄｔ演算方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58171164A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS53107207A (en) * | 1977-03-01 | 1978-09-19 | Fujitsu Ltd | Simultaneous connection system |
-
1982
- 1982-04-01 JP JP5425282A patent/JPS58171164A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS53107207A (en) * | 1977-03-01 | 1978-09-19 | Fujitsu Ltd | Simultaneous connection system |
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