JPS58117764A - 回線接続装置 - Google Patents
回線接続装置Info
- Publication number
- JPS58117764A JPS58117764A JP48782A JP48782A JPS58117764A JP S58117764 A JPS58117764 A JP S58117764A JP 48782 A JP48782 A JP 48782A JP 48782 A JP48782 A JP 48782A JP S58117764 A JPS58117764 A JP S58117764A
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- JP
- Japan
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- analog
- digital
- lines
- line
- att
- Prior art date
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- Pending
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04Q—SELECTING
- H04Q11/00—Selecting arrangements for multiplex systems
- H04Q11/04—Selecting arrangements for multiplex systems for time-division multiplexing
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Monitoring And Testing Of Exchanges (AREA)
- Data Exchanges In Wide-Area Networks (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はアナログ回線とデジタル回線を収容シ、且つ中
継台を有する交換装置において、交換装置がシステムダ
ウンしたとき交換装置本体に収容される回線相互を中継
台を介し交換接続する装置に関する。
継台を有する交換装置において、交換装置がシステムダ
ウンしたとき交換装置本体に収容される回線相互を中継
台を介し交換接続する装置に関する。
本発明はアナログ回線とデジタル回線を収容し、中継台
を有する交換装置において、交換装置がシステムダウン
したとき、交換装置本体に収容されるアナログ回線相互
、デジタル回線相互、およびアナログ回線とデジタル回
線とを中継台を介して交換接続できる装置を提供するも
のである。
を有する交換装置において、交換装置がシステムダウン
したとき、交換装置本体に収容されるアナログ回線相互
、デジタル回線相互、およびアナログ回線とデジタル回
線とを中継台を介して交換接続できる装置を提供するも
のである。
本発明による回線接続装置は、アナログおよびディジタ
ル信号回線を収容すると共に、中継台に接続される交換
装置の障害発生時、前記アナログおよびディジタル信号
回線をトランクに引込み発着信回線間を前記中継台を介
して選択接続することを特徴とする。
ル信号回線を収容すると共に、中継台に接続される交換
装置の障害発生時、前記アナログおよびディジタル信号
回線をトランクに引込み発着信回線間を前記中継台を介
して選択接続することを特徴とする。
以下、本発明の実施例について図面を参照して説明する
。
。
図は本発明による回線接続装置の一実施例を示す構成図
である。同図においてＥＸは交換装置本体、ＡＴＴは中
継台、ＣＡＴはデジタル回線用トランク、ＴＤＳＷは時
分割通話路、Ｃ／Ｄはアナログ信号をデジタル信号にま
たデジタル信号をアナログ信号に変換する符号変換回路
、ＴＲＫはアナログ回線用のトランク、ＣＰＵはＣＡＴ
、ＴＤＳＷ、ＴＲＫを制御する制御回路、Ｔ／ＲはＣＰ
ＵよりＡＴＴに対しアナログ、デジタル両回線の状態及
び制御情報を転送する信号送受信回路、１は交換装置本
体に収容されるデジタル回線、２は交換装置本体に収容
されるアナログ回線、３はＣ８ＴとＣＰＵ間の信号線、
４ ａ ＴＲＫ トＣＰＵ 間ｆ）８号１１Ａ、５ｑＴ
Ｄ８Ｗ とＣＰＵ間の信号線、６はＴＡとＣＰＵ間の信
号線、７はＴ／ＲとＡＴＴとの間の信号線、８は’Ｉ’
Ｄ８ＷとＣ／Ｄとの信号線、９はＣ／ＤとＡＴＴとの信
号線、１ｏはＡＴＴとＴＲＫ間の信号線、Ｓは交換装置
がシステムダウンした場合ＴＲＫにアナログ回線を、且
つＣ３ＴＫデジタル回線をそれぞれ収容するための切換
えスイッチを各々示す。
である。同図においてＥＸは交換装置本体、ＡＴＴは中
継台、ＣＡＴはデジタル回線用トランク、ＴＤＳＷは時
分割通話路、Ｃ／Ｄはアナログ信号をデジタル信号にま
たデジタル信号をアナログ信号に変換する符号変換回路
、ＴＲＫはアナログ回線用のトランク、ＣＰＵはＣＡＴ
、ＴＤＳＷ、ＴＲＫを制御する制御回路、Ｔ／ＲはＣＰ
ＵよりＡＴＴに対しアナログ、デジタル両回線の状態及
び制御情報を転送する信号送受信回路、１は交換装置本
体に収容されるデジタル回線、２は交換装置本体に収容
されるアナログ回線、３はＣ８ＴとＣＰＵ間の信号線、
４ ａ ＴＲＫ トＣＰＵ 間ｆ）８号１１Ａ、５ｑＴ
Ｄ８Ｗ とＣＰＵ間の信号線、６はＴＡとＣＰＵ間の信
号線、７はＴ／ＲとＡＴＴとの間の信号線、８は’Ｉ’
Ｄ８ＷとＣ／Ｄとの信号線、９はＣ／ＤとＡＴＴとの信
号線、１ｏはＡＴＴとＴＲＫ間の信号線、Ｓは交換装置
がシステムダウンした場合ＴＲＫにアナログ回線を、且
つＣ３ＴＫデジタル回線をそれぞれ収容するための切換
えスイッチを各々示す。
このような構成において、交換装置がシステムダウンし
た場合、Ｓが動作してデジタル回線１及びアナログ回線
２を本発明の装置に収容する。例えば、収容されたデジ
タル回１ｓＫ接続される端末が発呼したとすると、発呼
情報が回ｇｊ１を通じてＣＡＴＫ送られてくる。Ｃ８Ｔ
に送られた発呼情報はＣＰＵＫ信号線３を通じて転送さ
れる。ＣＰＵは転送された情報に従い信号線５を通じて
ＴＤＳＷを選択制御し、該当回線１をＣ／ＤＫ接続する
。また、ＣＰＵは同時に信号線６を通じてＴ／Ｒに情報
を転送する。Ｔ／Ｒは転送された情報によシ信号線７を
通じてＡＴＴに着信表示を行なう。ＡＴＴは着信表示を
確認するとＣ／Ｄを介してアナログ化された情報によシ
、被呼側端末を確認し、この被呼１１端末を収容する回
線に発呼側回線を接続する。いま、被呼側端末回線がア
ナログの場合、ＡＴＴを介して信号線１０へ接続される
。ＣＰＵはＴＲＫより信号線４を通じて信号線９と同１
０が接続されたことを確認し、ＴＲＫを通じて被呼側端
末を呼び出す。被呼側燗末が応答した場合、回線２ｔ−
通じＴＲＫを介し信号線１０．ＡＴＴ、信号線９ 、Ｔ
ＤＳＷ、Ｃ８Ｔ及び回線１を通じパスを形成して交換接
続を行なう。
た場合、Ｓが動作してデジタル回線１及びアナログ回線
２を本発明の装置に収容する。例えば、収容されたデジ
タル回１ｓＫ接続される端末が発呼したとすると、発呼
情報が回ｇｊ１を通じてＣＡＴＫ送られてくる。Ｃ８Ｔ
に送られた発呼情報はＣＰＵＫ信号線３を通じて転送さ
れる。ＣＰＵは転送された情報に従い信号線５を通じて
ＴＤＳＷを選択制御し、該当回線１をＣ／ＤＫ接続する
。また、ＣＰＵは同時に信号線６を通じてＴ／Ｒに情報
を転送する。Ｔ／Ｒは転送された情報によシ信号線７を
通じてＡＴＴに着信表示を行なう。ＡＴＴは着信表示を
確認するとＣ／Ｄを介してアナログ化された情報によシ
、被呼側端末を確認し、この被呼１１端末を収容する回
線に発呼側回線を接続する。いま、被呼側端末回線がア
ナログの場合、ＡＴＴを介して信号線１０へ接続される
。ＣＰＵはＴＲＫより信号線４を通じて信号線９と同１
０が接続されたことを確認し、ＴＲＫを通じて被呼側端
末を呼び出す。被呼側燗末が応答した場合、回線２ｔ−
通じＴＲＫを介し信号線１０．ＡＴＴ、信号線９ 、Ｔ
ＤＳＷ、Ｃ８Ｔ及び回線１を通じパスを形成して交換接
続を行なう。
なお、アナログ回線相互、またデジタル回線相互につい
ても同様にＡＴＴを介して接続できる。
ても同様にＡＴＴを介して接続できる。
本発明は以上説明した様に１交換装置に収容されるアナ
ログ回線とデジタル回線を収容し、交換装置がシステム
ダウン時、収容しているアナログ回線とデジタル回線の
状態を監視し及び制御を行うことＫよシ、収容している
アナログ回線およびデジタル回線の各相互ｔ＊続する様
に構成するととＫより、交換装置システムダウン時に対
する抗たん性を交換装置に与えることができる。
ログ回線とデジタル回線を収容し、交換装置がシステム
ダウン時、収容しているアナログ回線とデジタル回線の
状態を監視し及び制御を行うことＫよシ、収容している
アナログ回線およびデジタル回線の各相互ｔ＊続する様
に構成するととＫより、交換装置システムダウン時に対
する抗たん性を交換装置に与えることができる。
図は本発明の一実施例の構成図である。
ＥＸ・・・・・・交換装置、Ｓ・・・・・・切換スイッ
チ、Ｃ８Ｔ・・・・・・ディジタル回線用トランク、Ｔ
ＲＫ・・・・・・アナログ回線用トランク、ＴＤＳＷ・
・・・・・時分割通話路、ＣＰＵ・・・・・・制御回路
、Ｔ／Ｒ・・・・・・信号送受信回路、Ｃ／Ｄ・・・・
・・符号変換回路、Ａ Ｔ Ｔ・・・・・・中継台、１
・・・・°°デジタル回線、２・・・・・・アナログ回
線。
チ、Ｃ８Ｔ・・・・・・ディジタル回線用トランク、Ｔ
ＲＫ・・・・・・アナログ回線用トランク、ＴＤＳＷ・
・・・・・時分割通話路、ＣＰＵ・・・・・・制御回路
、Ｔ／Ｒ・・・・・・信号送受信回路、Ｃ／Ｄ・・・・
・・符号変換回路、Ａ Ｔ Ｔ・・・・・・中継台、１
・・・・°°デジタル回線、２・・・・・・アナログ回
線。
Claims (1)
- アナログおよびディジタル信号回線を収容すると共に、
中継台に接続される交換装置の障害発生時、前記アナロ
グおよびディジタル信号回線をトランクに引込み発着信
回線間を前記中継台を介して選択接続することを特徴と
する回線接続装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP48782A JPS58117764A (ja) | 1982-01-05 | 1982-01-05 | 回線接続装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP48782A JPS58117764A (ja) | 1982-01-05 | 1982-01-05 | 回線接続装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58117764A true JPS58117764A (ja) | 1983-07-13 |
Family
ID=11475122
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP48782A Pending JPS58117764A (ja) | 1982-01-05 | 1982-01-05 | 回線接続装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58117764A (ja) |
-
1982
- 1982-01-05 JP JP48782A patent/JPS58117764A/ja active Pending
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