JPS58110268A - 静電記録装置の制御装置 - Google Patents
静電記録装置の制御装置Info
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- JPS58110268A JPS58110268A JP56210355A JP21035581A JPS58110268A JP S58110268 A JPS58110268 A JP S58110268A JP 56210355 A JP56210355 A JP 56210355A JP 21035581 A JP21035581 A JP 21035581A JP S58110268 A JPS58110268 A JP S58110268A
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- circuit
- signal
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- G03G15/00—Apparatus for electrographic processes using a charge pattern
- G03G15/22—Apparatus for electrographic processes using a charge pattern involving the combination of more than one step according to groups G03G13/02 - G03G13/20
- G03G15/32—Apparatus for electrographic processes using a charge pattern involving the combination of more than one step according to groups G03G13/02 - G03G13/20 in which the charge pattern is formed dotwise, e.g. by a thermal head
- G03G15/326—Apparatus for electrographic processes using a charge pattern involving the combination of more than one step according to groups G03G13/02 - G03G13/20 in which the charge pattern is formed dotwise, e.g. by a thermal head by application of light, e.g. using a LED array
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- B41J2/00—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed
- B41J2/435—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of radiation to a printing material or impression-transfer material
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- G03G15/04—Apparatus for electrographic processes using a charge pattern for exposing, i.e. imagewise exposure by optically projecting the original image on a photoconductive recording material
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、コンピュータアウトプットやファクシミリ信
号のような電気的画像信号を受けて記録画像を形成する
静電記録装置に関し、さらに詳しくはこの種の記録装置
におけるライン状の記録ヘッドの駆動回路に関するもの
である。
号のような電気的画像信号を受けて記録画像を形成する
静電記録装置に関し、さらに詳しくはこの種の記録装置
におけるライン状の記録ヘッドの駆動回路に関するもの
である。
電子写真プロセスを利用して画像記録を行う記録装置の
光書き込み手段としては、レーザビームを用いたものが
提供されているが、これはレーザ発振及びスキャンのた
めの装置が複雑かつ高価であり、記録装置自体大型かつ
高価なものとなる欠点を有している。
光書き込み手段としては、レーザビームを用いたものが
提供されているが、これはレーザ発振及びスキャンのた
めの装置が複雑かつ高価であり、記録装置自体大型かつ
高価なものとなる欠点を有している。
これに対して、微小書き込みセグメントを一列に並べ、
これによって静電記録紙や感光体面に電気や光の情報を
書き込むものは装置が小型化できる利点を有している。
これによって静電記録紙や感光体面に電気や光の情報を
書き込むものは装置が小型化できる利点を有している。
然るに、プリント幅に対応した幅の記録ヘッドを作成す
るためには、きわめて多数の電極や発光素子の配列を要
し、その個々のセグメントの制御回路や配線はきわめて
複雑となる。
るためには、きわめて多数の電極や発光素子の配列を要
し、その個々のセグメントの制御回路や配線はきわめて
複雑となる。
本発明はこのような点に着目してなされたもので、記録
ヘッドの駆動回路や配線等が簡単な制御装置を提供する
ことを目的とし、特に、書き込み用のセグメントと駆動
回路としてのＩＣチップを同一基板上に配置して構成を
簡略化し、かつこのときのＩｃチップの構成及び書き込
み用セグメントの制御を工夫して、効率の良い制御を達
成し得る制御装置を提供することを目的とするものであ
る。
ヘッドの駆動回路や配線等が簡単な制御装置を提供する
ことを目的とし、特に、書き込み用のセグメントと駆動
回路としてのＩＣチップを同一基板上に配置して構成を
簡略化し、かつこのときのＩｃチップの構成及び書き込
み用セグメントの制御を工夫して、効率の良い制御を達
成し得る制御装置を提供することを目的とするものであ
る。
以下、一実施例により本発明の詳細な説明する。
第１図は本発明の一実施例を適用した静電記録装置を示
す概略図である。１は螢光発生管、２は螢光発生管１の
発光セグメントを画像信号に対応して点滅制御する駆動
回路としてのＩＣｌ３は駆動用ＩＣ２が画像信号を入力
するのを制御するクロックインターフェイス回路、４は
コネクタ、５は画像信号発生回路へ接続されるケーブル
、６は支持板である。７は螢光発生管１のフェイスガラ
スに対向して設けられ、螢光発生管１の発光を感光体ド
ラム８の表面に集束させる結像光学系としての集束性光
伝送体アレイである。感光体ドラム８の周りには、感光
体ドラム８を帯電させる帯電チャージャ９、現像装置１
０、感光体ドラム上の像を記録用紙１１に転写する転写
チャージャ１２、記録用紙１１を感光体ドラム８から分
離する分離チャージャ１３、感光体ドラム８の残留トナ
ーを除去するクリーナ１４が設置されている。１４は記
録用紙収納部、１５は定着装置であり、矢印は感光体ド
ラム８の回転方向を表わす。
す概略図である。１は螢光発生管、２は螢光発生管１の
発光セグメントを画像信号に対応して点滅制御する駆動
回路としてのＩＣｌ３は駆動用ＩＣ２が画像信号を入力
するのを制御するクロックインターフェイス回路、４は
コネクタ、５は画像信号発生回路へ接続されるケーブル
、６は支持板である。７は螢光発生管１のフェイスガラ
スに対向して設けられ、螢光発生管１の発光を感光体ド
ラム８の表面に集束させる結像光学系としての集束性光
伝送体アレイである。感光体ドラム８の周りには、感光
体ドラム８を帯電させる帯電チャージャ９、現像装置１
０、感光体ドラム上の像を記録用紙１１に転写する転写
チャージャ１２、記録用紙１１を感光体ドラム８から分
離する分離チャージャ１３、感光体ドラム８の残留トナ
ーを除去するクリーナ１４が設置されている。１４は記
録用紙収納部、１５は定着装置であり、矢印は感光体ド
ラム８の回転方向を表わす。
本実施例における螢光発生管１の近傍を第２図の横断面
図に示す。螢光発生管１は、ガラス基板１６とフェイス
ガラス１７とで形成された真空容器内に、ガラス基板１
６」二に真空蒸着法により形成されたアノードセグメン
ト１８とリード線１９とを有し、アノードセグメント１
８と対向してカソードフィラメント２０を備え、アノー
ドセグメント１８とカソードフィラメント２０との間に
グリッド２１を有している。アノードセグメント１８の
表面には酸化亜鉛（ＺｎＯ）を主成分とする螢光体が塗
布されて発光セグメント（以下、アノードセグメントと
発光セグメントを同じ記号１８で表わす。）を構成して
いる。発光セグメントは螢光発生管１の長手方向に一列
に配列されている。また、リード線１９はフェイスガラ
ス１７の外側まで延在し、゛螢光発生管１が形成されて
いる基板１６上に配置された駆動用ＩＣ２とワイヤボン
ディング２２されている。駆動用ＩＣ２は、螢光発生管
１の長手方向に沿って螢光発生管１の両側に配置され、
リード端子２３を介してクロックインターフェイス回路
３に接続される。さらに、フェイスガラス１７には多層
膜干渉フィルターが形成されている。
図に示す。螢光発生管１は、ガラス基板１６とフェイス
ガラス１７とで形成された真空容器内に、ガラス基板１
６」二に真空蒸着法により形成されたアノードセグメン
ト１８とリード線１９とを有し、アノードセグメント１
８と対向してカソードフィラメント２０を備え、アノー
ドセグメント１８とカソードフィラメント２０との間に
グリッド２１を有している。アノードセグメント１８の
表面には酸化亜鉛（ＺｎＯ）を主成分とする螢光体が塗
布されて発光セグメント（以下、アノードセグメントと
発光セグメントを同じ記号１８で表わす。）を構成して
いる。発光セグメントは螢光発生管１の長手方向に一列
に配列されている。また、リード線１９はフェイスガラ
ス１７の外側まで延在し、゛螢光発生管１が形成されて
いる基板１６上に配置された駆動用ＩＣ２とワイヤボン
ディング２２されている。駆動用ＩＣ２は、螢光発生管
１の長手方向に沿って螢光発生管１の両側に配置され、
リード端子２３を介してクロックインターフェイス回路
３に接続される。さらに、フェイスガラス１７には多層
膜干渉フィルターが形成されている。
本静電記録装置の動作を説明すると、螢光発生管１中の
カソードフィラメントに規定電圧を印加してその表向か
ら熱電子が放射される状態に加熱し、グリッド２１にカ
ソードフィラメントに対し正電圧を与えておく。この状
態で外部の画像信号発生回路からケーブル５を経て画像
信号が入力され、クロックインターフェイス回路３を経
て制御されて駆動用ＩＣ２に入力される。駆動用ＩＣ２
は画像信号を１ライン分ずつ制御して、所定位置の発光
セグメント１８にカソードフィラメントに対して正電圧
を印加する。カソードフィラメント２０で発生した熱電
子がグリッド２１に引かれて加速され、正電圧が印加さ
れている発光セグメント１８に衝突し、その発光セグメ
ント１８から螢光が発光すると共にカソードフィラメン
ト２０へ電流が流れる。本実施例における螢光発生管１
の発光輝度は、グリッド２１とアノードセグメント１８
との間の電圧制御により２０００ｆＩ−程度の高輝度に
することができる。
カソードフィラメントに規定電圧を印加してその表向か
ら熱電子が放射される状態に加熱し、グリッド２１にカ
ソードフィラメントに対し正電圧を与えておく。この状
態で外部の画像信号発生回路からケーブル５を経て画像
信号が入力され、クロックインターフェイス回路３を経
て制御されて駆動用ＩＣ２に入力される。駆動用ＩＣ２
は画像信号を１ライン分ずつ制御して、所定位置の発光
セグメント１８にカソードフィラメントに対して正電圧
を印加する。カソードフィラメント２０で発生した熱電
子がグリッド２１に引かれて加速され、正電圧が印加さ
れている発光セグメント１８に衝突し、その発光セグメ
ント１８から螢光が発光すると共にカソードフィラメン
ト２０へ電流が流れる。本実施例における螢光発生管１
の発光輝度は、グリッド２１とアノードセグメント１８
との間の電圧制御により２０００ｆＩ−程度の高輝度に
することができる。
この発光セグメント１８からの光２４はフェイスガラス
１７を透過して光伝送体アレイ７に入射し、感光体ドラ
ム８の表面に集束する。この発光セグメント１８で発光
した光２４は単色性が悪いため、フェイスガラス１７に
形成された多層膜干渉フィルターにより波長域が狭くさ
れて透過し、光伝送体アレイ７による色収差を防いでい
る。
１７を透過して光伝送体アレイ７に入射し、感光体ドラ
ム８の表面に集束する。この発光セグメント１８で発光
した光２４は単色性が悪いため、フェイスガラス１７に
形成された多層膜干渉フィルターにより波長域が狭くさ
れて透過し、光伝送体アレイ７による色収差を防いでい
る。
一方、矢印方向に回転する感光体ドラム８は、帯電チャ
ージャ９により順次帯電され、発光セグメント１８から
の光２４により１ライン分ずつ照射されて感光体ドラム
８の表面上に静電潜像を形成し、現像装置１０により現
像されてトナー像を形成する。その後、記録用紙収納部
１４から送られてきた記録用紙１１にトナー像が重ねら
れ、転写チャージャ１２において記録用紙１１の裏側か
ら電荷を与えることによってトナー像を感光体ドラム８
表面から記録用紙１１表面へと転写する。
ージャ９により順次帯電され、発光セグメント１８から
の光２４により１ライン分ずつ照射されて感光体ドラム
８の表面上に静電潜像を形成し、現像装置１０により現
像されてトナー像を形成する。その後、記録用紙収納部
１４から送られてきた記録用紙１１にトナー像が重ねら
れ、転写チャージャ１２において記録用紙１１の裏側か
ら電荷を与えることによってトナー像を感光体ドラム８
表面から記録用紙１１表面へと転写する。
その後、分離チャージャ１３で除電し、記録用紙１１を
感光体ドラム８から剥離して定着装置１５へ送って定着
させ、感光体ドラム８の表面はクリーナ１４で残留トナ
ーが除去されて次の記録に備える。
感光体ドラム８から剥離して定着装置１５へ送って定着
させ、感光体ドラム８の表面はクリーナ１４で残留トナ
ーが除去されて次の記録に備える。
第３図は本実施例における螢光発生管ｌと駆動用ＩＣ２
の概略斜視図である。ガラス基板１６とフェイスガラス
１７とで形成される真空容器内に、縦方向に沿って発光
セグメント１８が配列され、その真空容器の外側の両側
に縦方向に沿って駆動用ＩＣ２がガラス基板１６上に配
列されている。
の概略斜視図である。ガラス基板１６とフェイスガラス
１７とで形成される真空容器内に、縦方向に沿って発光
セグメント１８が配列され、その真空容器の外側の両側
に縦方向に沿って駆動用ＩＣ２がガラス基板１６上に配
列されている。
図には表わされていないが、真空容器内には第２図に示
されるように、カソードフィラメントとグリッドが設け
られている。
されるように、カソードフィラメントとグリッドが設け
られている。
螢光発生管１と駆動用ＩＣ２の回路図を第４図に示す。
螢光発生管１の長手方向に沿って配列された発光セグメ
ント１８からのリード線１９は、奇数番目が図の上方向
に取り出され、偶数番目が図の下方向に取り出されてい
る。駆動用ＩＣ２（１個のＩＣは図中の一点鎖線で示さ
れている）はそれぞれシフトレジスタ、ラッチ回路、ド
ライバー回路、及び安定化抵抗２５を有し、奇数番目の
駆動用ＩＣ（図の上側に示したもの）は奇数番目の発光
セグメント１８を複数個ずつ制御するように、奇数番目
の複数本のリード線１９と接続され、偶数番目の駆動用
ＩＣ（図の下側に示したもの）も同様にして偶数番目の
複数本のリード線１９と接続されている。カソードフィ
ラメント２ｏは２ＱＫＨｚ程度の交流電源で通電加熱さ
れている。
ント１８からのリード線１９は、奇数番目が図の上方向
に取り出され、偶数番目が図の下方向に取り出されてい
る。駆動用ＩＣ２（１個のＩＣは図中の一点鎖線で示さ
れている）はそれぞれシフトレジスタ、ラッチ回路、ド
ライバー回路、及び安定化抵抗２５を有し、奇数番目の
駆動用ＩＣ（図の上側に示したもの）は奇数番目の発光
セグメント１８を複数個ずつ制御するように、奇数番目
の複数本のリード線１９と接続され、偶数番目の駆動用
ＩＣ（図の下側に示したもの）も同様にして偶数番目の
複数本のリード線１９と接続されている。カソードフィ
ラメント２ｏは２ＱＫＨｚ程度の交流電源で通電加熱さ
れている。
クリッド２１には＋５■の直流電圧が印加されている。
クロックインターフェイスを介して伝達される奇数デー
タ及び偶数データは、クロックインターフェイスにより
発生する奇数クロック信号のタイミングにより奇数デー
タが奇数番目の駆動用ＩＣ２内のシフトレジスタ（１）
→（３）→・・・→（２ｎ−１）に伝達され、また偶数
データが偶数クロック信号のタイミングにより偶数番目
の駆動用ＩＣ２内のシフトレジスタ（２）→（４）→・
・・→（２ｎ）に伝達される。
タ及び偶数データは、クロックインターフェイスにより
発生する奇数クロック信号のタイミングにより奇数デー
タが奇数番目の駆動用ＩＣ２内のシフトレジスタ（１）
→（３）→・・・→（２ｎ−１）に伝達され、また偶数
データが偶数クロック信号のタイミングにより偶数番目
の駆動用ＩＣ２内のシフトレジスタ（２）→（４）→・
・・→（２ｎ）に伝達される。
シフトレジスタにデータが入力されると、クロックイン
ターフェイスからのラッチ信号によりシフトレジスタの
内容をラッチ回路に取り込み、この取り込んだデータに
よりドライバー回路が作動し、データが入力されたドラ
イバー回路は安定化抵抗２５により該当する発光セグメ
ント１８をカソードフィラメント２０より正電圧に引き
上げることにより、その発光セグメント１８が発光する
。先端点灯用発光セグメント２６及び後端点灯用発光セ
グメント２７は、発光セグメント１８の配列の両端に設
けられ、１個の発光セグメント１８より長くて、外部の
駆動回路により独立に駆動される。
ターフェイスからのラッチ信号によりシフトレジスタの
内容をラッチ回路に取り込み、この取り込んだデータに
よりドライバー回路が作動し、データが入力されたドラ
イバー回路は安定化抵抗２５により該当する発光セグメ
ント１８をカソードフィラメント２０より正電圧に引き
上げることにより、その発光セグメント１８が発光する
。先端点灯用発光セグメント２６及び後端点灯用発光セ
グメント２７は、発光セグメント１８の配列の両端に設
けられ、１個の発光セグメント１８より長くて、外部の
駆動回路により独立に駆動される。
先、後端点灯用発光セグメン）２６．２７は記録用紙の
両サイドの非記録領域の電荷を除去するためのものであ
り、常時点灯される。
両サイドの非記録領域の電荷を除去するためのものであ
り、常時点灯される。
ここで、発光セグメント１８，２６．２７の具体的な寸
法の一例を第５図に示す。発光セグメント１８は幅Ｗ１
が７０１１ｍ、、高さｈが８０ μｍ 、先、後端点灯
用発光セグメント２６及び２７は幅Ｗ□が１０１ｒｎ１
高さｈが８０μｍ１発光セグメント間の間隔をすべて３
０μ肌とする。この発光セグメントによりＡ４サイズ（
２０４，８＋ｍｎ）の印字幅を得るためには、発光セグ
メント１８を２０４８個必要とする。
法の一例を第５図に示す。発光セグメント１８は幅Ｗ１
が７０１１ｍ、、高さｈが８０ μｍ 、先、後端点灯
用発光セグメント２６及び２７は幅Ｗ□が１０１ｒｎ１
高さｈが８０μｍ１発光セグメント間の間隔をすべて３
０μ肌とする。この発光セグメントによりＡ４サイズ（
２０４，８＋ｍｎ）の印字幅を得るためには、発光セグ
メント１８を２０４８個必要とする。
リード線は図示の如く交互に反対方向に取り出され、奇
数番目のリード線と偶数番目のリード線をそれぞれ１６
本単位で１個ずつの駆動用ＩＣに接続する。
数番目のリード線と偶数番目のリード線をそれぞれ１６
本単位で１個ずつの駆動用ＩＣに接続する。
このようにしてＩＣ２を螢光発生管１の長手方向の両側
の基板１６上に配列した状態とリード端子の配列状態を
第６図に示す。図で、Ｋ１、Ｋ２、・・・は奇数番目の
リード線に接続される駆動用ＩＣ２を表わし、Ｋ１は奇
数番目のリード線の１〜１６番目を、Ｒ２は同１７〜３
２番目というように接続されている。偶数番目のリード
線に接続される駆動用ＩＣ２、Ｇ１、Ｇ２、・・・につ
いても同様である。そして奇数側、偶数側にそれぞれ６
４個ずつの駆動用ＩＣ２が配列され、それぞれの側で１
０２４個ずつの発光セグメントを制御し、両側のＩＣ２
全てで２０４８個の発光セグメントを制御することにな
る。
の基板１６上に配列した状態とリード端子の配列状態を
第６図に示す。図で、Ｋ１、Ｋ２、・・・は奇数番目の
リード線に接続される駆動用ＩＣ２を表わし、Ｋ１は奇
数番目のリード線の１〜１６番目を、Ｒ２は同１７〜３
２番目というように接続されている。偶数番目のリード
線に接続される駆動用ＩＣ２、Ｇ１、Ｇ２、・・・につ
いても同様である。そして奇数側、偶数側にそれぞれ６
４個ずつの駆動用ＩＣ２が配列され、それぞれの側で１
０２４個ずつの発光セグメントを制御し、両側のＩＣ２
全てで２０４８個の発光セグメントを制御することにな
る。
リード端子の信号入力は第４図と比較すれば一層明確と
なろう。ここで、駆動用ＩＣ２駆動電源（＋５Ｖ）用リ
ード端子とグランド用リード端子（ＧＮＤ）は、２個の
ＩＣ２でそれぞれ１個ずつを共用している。すなわち、
例えば第７図に示すように、奇数側ＩＣ，に１とに２と
で＋５■用リード端子及びグランド用リード端子を共用
し、Ｒ３とに４とで同様にリード端子を共用している。
なろう。ここで、駆動用ＩＣ２駆動電源（＋５Ｖ）用リ
ード端子とグランド用リード端子（ＧＮＤ）は、２個の
ＩＣ２でそれぞれ１個ずつを共用している。すなわち、
例えば第７図に示すように、奇数側ＩＣ，に１とに２と
で＋５■用リード端子及びグランド用リード端子を共用
し、Ｒ３とに４とで同様にリード端子を共用している。
１個の奇数側駆動用ＩＣ２の詳細を第８図に示す。シフ
トレジスタ５ＲＩ−８Ｒ１ｅ、、ラッチ回路１− Ｒ１
〜Ｌ Ｒ１６、及びドライバー用トランジスタＴｒ１〜
Ｔｒ１６をそれぞれ１６個ずつ図のように接続している
。
トレジスタ５ＲＩ−８Ｒ１ｅ、、ラッチ回路１− Ｒ１
〜Ｌ Ｒ１６、及びドライバー用トランジスタＴｒ１〜
Ｔｒ１６をそれぞれ１６個ずつ図のように接続している
。
データ入力端子からの奇数データ信号は、奇数クロック
信号のタイミングで各シフトレジスタをＳＲ１→Ｓ Ｒ
２→・・・→Ｓ’Ｒ１６の順でシフトされ、１７個目の
奇数クロック信号で次の奇数側ＩＣのシフトレジスタに
シフトされる。シフトレジスタに信号が伝達された後、
あるタイミングでラッチ信号が入力され、シフトレジス
タＳＲ１、〜Ｓ Ｒ１６ｔｌ） 内容がそれぞれラッチ
回路ＬＲ１、〜ＬＲ１６に取り込まれる。このラッチ回
路ＬＲ１、〜Ｌ Ｒ１６の内容によってドライバー用ト
ランジスタＴｒ１、〜Ｔｒ１６を動作させるかどうかが
きまる。第８図では、ドライバー用トランジスタＴｒ１
、〜Ｔｒ１６はラッチ回路ＬＲ１゜〜ＬＩＬ１３の出力
が低レベルになり、トランジスタＴｒ１、〜Ｔｙ１６の
ベース電圧が低くなった時にトランジスタＴｒ１、〜Ｔ
ｒ１６がオン状態となり、発光セグメントが発光する。
信号のタイミングで各シフトレジスタをＳＲ１→Ｓ Ｒ
２→・・・→Ｓ’Ｒ１６の順でシフトされ、１７個目の
奇数クロック信号で次の奇数側ＩＣのシフトレジスタに
シフトされる。シフトレジスタに信号が伝達された後、
あるタイミングでラッチ信号が入力され、シフトレジス
タＳＲ１、〜Ｓ Ｒ１６ｔｌ） 内容がそれぞれラッチ
回路ＬＲ１、〜ＬＲ１６に取り込まれる。このラッチ回
路ＬＲ１、〜Ｌ Ｒ１６の内容によってドライバー用ト
ランジスタＴｒ１、〜Ｔｒ１６を動作させるかどうかが
きまる。第８図では、ドライバー用トランジスタＴｒ１
、〜Ｔｒ１６はラッチ回路ＬＲ１゜〜ＬＩＬ１３の出力
が低レベルになり、トランジスタＴｒ１、〜Ｔｙ１６の
ベース電圧が低くなった時にトランジスタＴｒ１、〜Ｔ
ｒ１６がオン状態となり、発光セグメントが発光する。
なお、○電源は−２５〜−４５Ｖ程度が適当である。
偶数側駆動用ＩＣについても全く同様である。
第９図は駆動用ＩＣ２のピン配置を示す。
同図（１）は奇数側ＩＣ１（２）は偶数側ＩＣである。
信号入力側のピンは、奇数側、偶数側共に、左からｅ電
源、ラッチ信号、奇数（又は偶数）データ入力、ＧＮＤ
、＋５ｖ、奇数（又は偶数）クロック信号、奇数（又は
偶数）データ出力の順に配置され、また出力側のピンは
左からＰｌ、Ｐ２、・・・Ｐｌ６の順に配置されている
。すなわち、奇数側ＩＣと偶数側ＩＣとはそのピン配置
が対称的な関係になっている。
源、ラッチ信号、奇数（又は偶数）データ入力、ＧＮＤ
、＋５ｖ、奇数（又は偶数）クロック信号、奇数（又は
偶数）データ出力の順に配置され、また出力側のピンは
左からＰｌ、Ｐ２、・・・Ｐｌ６の順に配置されている
。すなわち、奇数側ＩＣと偶数側ＩＣとはそのピン配置
が対称的な関係になっている。
第１０図に駆動用ＩＣ２、クロックインターフェイス回
路３、及び外部の画像信号発生回路２８の間の信号授受
を示す。クロックインターフェイス回路３から画像信号
発生回路２８へ、ラインスタート信号を発生すると、ク
ロック信号のタイミングで画像信号発生回路２８からク
ロックインターフェイス回路３ヘデータが送られる。ク
ロックインターフェイス回路３からは奇数クロック信号
のタイミングで奇数データ（奇数番号のデータ）が奇数
側駆動用ＩＣのシフトレジスタへ送られ、偶数クロック
信号のタイミングで偶数データ（偶数番号のデータ）が
偶数側駆動用ＩＣのシフトレジスタへ送られ、さらにシ
フトレジスタからの信号をラッチ回路へ取り込むための
ラッチ信号が奇数側、偶数側の両部動用ＩＣのラッチ回
路へ送られる。
路３、及び外部の画像信号発生回路２８の間の信号授受
を示す。クロックインターフェイス回路３から画像信号
発生回路２８へ、ラインスタート信号を発生すると、ク
ロック信号のタイミングで画像信号発生回路２８からク
ロックインターフェイス回路３ヘデータが送られる。ク
ロックインターフェイス回路３からは奇数クロック信号
のタイミングで奇数データ（奇数番号のデータ）が奇数
側駆動用ＩＣのシフトレジスタへ送られ、偶数クロック
信号のタイミングで偶数データ（偶数番号のデータ）が
偶数側駆動用ＩＣのシフトレジスタへ送られ、さらにシ
フトレジスタからの信号をラッチ回路へ取り込むための
ラッチ信号が奇数側、偶数側の両部動用ＩＣのラッチ回
路へ送られる。
第１１図にクロックインターフェイス回路３の具体的な
一例を示す。１３個のフリップフロップ３０−１、〜３
０−１３を前段のセット出力が次段の入力となるように
直列に接続し、最前段のフリップフロップ３０−１の入
力端子に矩形波発振回路又は交流電源２９を接続し、最
後段のフリップフロップ３０−１２のセット出力ｑ１２
にワンショットマルチバイブレータ３１を接続する。こ
のワンショットマルチバイブレーク３１の出力ＴＡと第
３段目のフリップフロップ３０−３のセット出力Ｑ２と
を入力とするナントゲートの出力側に、インバータ３３
を介してワンショットマルチパイブレー９３４を接続し
、このワンショットマルチバイブレータ３４の出力ＴＢ
をインバータ３５を介してフリップフロップ３０−１、
〜３０−１３のクロック端子に接続し、またワンショッ
トマルチバイブレーク３４の出力ＴＢをインバータ３６
を介して出力して、反転された状態のラッチ信号及び反
転された状態のラインスタート信号とする。ワンショッ
トマルチバイブレータ３１の出力ＴＡのインバータ３６
による反転信号と第２段目のフリップフロップ３０−２
のセット出力Ｑ１とを入力とするようにナントゲート３
７を接続して、このナントゲート３７の出力を反転され
たクロック信号とする。また、ナントゲート３７の出力
のインバータ３８による反転信号と第１段目のフリップ
フロップ３〇−１のセット出力Ｑｏとを入力とするよう
にナントゲート３９を接続し、このナントゲート３９の
出力のインバータ４０による反転信号と第３段目のフリ
ップフロップ３０−３のリセット出力ｑ２とを入力とす
るようにナントゲート４１を接続して、このナントゲー
ト４１の出力を反転された奇数クロック信号とし、さら
にナントゲート３９の出力のインバータ４０による反転
信号と第３段目のフリップフロップ３０−３のセット出
力Ｑ２とを入力とするようにナントゲート４２を接続し
て、このナントゲート４２の出力を反転された偶数クロ
ック信号とする。
一例を示す。１３個のフリップフロップ３０−１、〜３
０−１３を前段のセット出力が次段の入力となるように
直列に接続し、最前段のフリップフロップ３０−１の入
力端子に矩形波発振回路又は交流電源２９を接続し、最
後段のフリップフロップ３０−１２のセット出力ｑ１２
にワンショットマルチバイブレータ３１を接続する。こ
のワンショットマルチバイブレーク３１の出力ＴＡと第
３段目のフリップフロップ３０−３のセット出力Ｑ２と
を入力とするナントゲートの出力側に、インバータ３３
を介してワンショットマルチパイブレー９３４を接続し
、このワンショットマルチバイブレータ３４の出力ＴＢ
をインバータ３５を介してフリップフロップ３０−１、
〜３０−１３のクロック端子に接続し、またワンショッ
トマルチバイブレーク３４の出力ＴＢをインバータ３６
を介して出力して、反転された状態のラッチ信号及び反
転された状態のラインスタート信号とする。ワンショッ
トマルチバイブレータ３１の出力ＴＡのインバータ３６
による反転信号と第２段目のフリップフロップ３０−２
のセット出力Ｑ１とを入力とするようにナントゲート３
７を接続して、このナントゲート３７の出力を反転され
たクロック信号とする。また、ナントゲート３７の出力
のインバータ３８による反転信号と第１段目のフリップ
フロップ３〇−１のセット出力Ｑｏとを入力とするよう
にナントゲート３９を接続し、このナントゲート３９の
出力のインバータ４０による反転信号と第３段目のフリ
ップフロップ３０−３のリセット出力ｑ２とを入力とす
るようにナントゲート４１を接続して、このナントゲー
ト４１の出力を反転された奇数クロック信号とし、さら
にナントゲート３９の出力のインバータ４０による反転
信号と第３段目のフリップフロップ３０−３のセット出
力Ｑ２とを入力とするようにナントゲート４２を接続し
て、このナントゲート４２の出力を反転された偶数クロ
ック信号とする。
データは２段のインバータ４３及び４４を経て奇数デー
タ及び偶数データとして出力される。
タ及び偶数データとして出力される。
第１１図のクロックインターフェイス回路３により第１
０図の信号の授受を第１２図及び第１３図の波形図によ
り説明する。第５図に示した寸法の発光フラグメント１
８を有する螢光発生管を用いて、Ａ４サイズの記録用紙
に２０４Ｊ３朋Ｘ ２９４．８ｍｍの記録領域に印字す
る場合を例とする。
０図の信号の授受を第１２図及び第１３図の波形図によ
り説明する。第５図に示した寸法の発光フラグメント１
８を有する螢光発生管を用いて、Ａ４サイズの記録用紙
に２０４Ｊ３朋Ｘ ２９４．８ｍｍの記録領域に印字す
る場合を例とする。
第１２図において、クロックインターフェイス回路３か
ら画像信号発生回路２８へ送られるラインスタート信号
が低レベルになると、クロック信号が発生し、このクロ
ック信号のタイミングでデータが送られる。１枚のＡ４
記録用紙の記録を終了するには、２９４８個のラインス
タート信号を必要とし、１個のラインスタート信号あた
り２０４８個のクロック信号を必要とする。いま、記録
用紙の送給速度を５０＋＋＋＋ｎ／ｓｅｃとすると、ク
ロック信号の周期は約０．９μＳｅＣとなる。
ら画像信号発生回路２８へ送られるラインスタート信号
が低レベルになると、クロック信号が発生し、このクロ
ック信号のタイミングでデータが送られる。１枚のＡ４
記録用紙の記録を終了するには、２９４８個のラインス
タート信号を必要とし、１個のラインスタート信号あた
り２０４８個のクロック信号を必要とする。いま、記録
用紙の送給速度を５０＋＋＋＋ｎ／ｓｅｃとすると、ク
ロック信号の周期は約０．９μＳｅＣとなる。
第１３図においてさらに詳細に説明する。ＱＯｌＱｌ、
〜Ｑ１２はそれぞれフリップ７０ツブ３０−１．３０−
２、〜３０−１３のセット出力信号、ＴＡ及びＴＢはそ
れぞれワンショットマルチバイブレータ３１及び３４の
出力信号で、信号ＴＢがラインスタート信号及びラッチ
信号になる。ラインスタート信号（ＴＢ）が低レベルに
なると、クロック信号の立上りのタイミングでデータが
画像信号発生回路からクロックインターフェイス回路に
伝達される。クロックインターフェイス回路は、このデ
ータをクロック信号の立下りのタイミングで取り込み、
奇数データと偶数データとに分離する。クロックインタ
ーフェイス回路はこの奇数データと偶数データを駆動用
ＩＣのシフトレジスタに出力し、奇数側のシフトレジス
タは奇数クロック信号のタイミングにより奇数データを
人力し、偶数側のシフトレジスタは偶数クロック信号の
タイミングで偶数データを入力する。クロック信号が２
０４８個発生し、ワンショットマルチバイブレーク３１
．３４の出力ＴＡ ＴＢがともに高レベルになり、次に
信号ＴＢが低レベルになった時シフトレジスタに入力さ
れたデータがラッチ回路に取り込まれ、発光セグメント
がデータの内容によって発光する。また、信号ＴＢが低
レベルになったことにより、次の行のデータが画像信号
発生回路からクロックインターフェイス回路に伝達され
る。この動作がＡ４サイズの記録については２９４８回
繰り返される。
〜Ｑ１２はそれぞれフリップ７０ツブ３０−１．３０−
２、〜３０−１３のセット出力信号、ＴＡ及びＴＢはそ
れぞれワンショットマルチバイブレータ３１及び３４の
出力信号で、信号ＴＢがラインスタート信号及びラッチ
信号になる。ラインスタート信号（ＴＢ）が低レベルに
なると、クロック信号の立上りのタイミングでデータが
画像信号発生回路からクロックインターフェイス回路に
伝達される。クロックインターフェイス回路は、このデ
ータをクロック信号の立下りのタイミングで取り込み、
奇数データと偶数データとに分離する。クロックインタ
ーフェイス回路はこの奇数データと偶数データを駆動用
ＩＣのシフトレジスタに出力し、奇数側のシフトレジス
タは奇数クロック信号のタイミングにより奇数データを
人力し、偶数側のシフトレジスタは偶数クロック信号の
タイミングで偶数データを入力する。クロック信号が２
０４８個発生し、ワンショットマルチバイブレーク３１
．３４の出力ＴＡ ＴＢがともに高レベルになり、次に
信号ＴＢが低レベルになった時シフトレジスタに入力さ
れたデータがラッチ回路に取り込まれ、発光セグメント
がデータの内容によって発光する。また、信号ＴＢが低
レベルになったことにより、次の行のデータが画像信号
発生回路からクロックインターフェイス回路に伝達され
る。この動作がＡ４サイズの記録については２９４８回
繰り返される。
本実施例では、微小発光セグメントを一列に配置した螢
光発生管を駆動して感光体表面に静電像を形成するよう
に構成したので、レーザーや発光ダイオードアレイを用
いた静電記録装置に比べて、安価で小型の静電記録装置
を達成することができる。
光発生管を駆動して感光体表面に静電像を形成するよう
に構成したので、レーザーや発光ダイオードアレイを用
いた静電記録装置に比べて、安価で小型の静電記録装置
を達成することができる。
さらに、本実施例では、駆動用ＩＣが発光セグメントと
同一の基板りに設けられて一体化しているので、保守及
び組立てが容易となり、また記録ヘッドが小型化する効
果がある。さらにまた、す−ド線が発光セグメントと同
一の基板上に形成されているので、同時加工することが
でき、したがってワイヤ接続点数が減少して製造歩留り
が向上する効果をも有する。
同一の基板りに設けられて一体化しているので、保守及
び組立てが容易となり、また記録ヘッドが小型化する効
果がある。さらにまた、す−ド線が発光セグメントと同
一の基板上に形成されているので、同時加工することが
でき、したがってワイヤ接続点数が減少して製造歩留り
が向上する効果をも有する。
以上に述べたように、本発明は、セグメントからのリー
ド線の奇数番目と偶数番目とをセグメント列の反対方向
に引き出し、それぞれを群に区分して別々に制御して駆
動するように構成したので、それぞれのセグメント群の
駆動回路をセグメント列に対して対称な構成とすること
ができ、制御が容易になる効果を有する。
ド線の奇数番目と偶数番目とをセグメント列の反対方向
に引き出し、それぞれを群に区分して別々に制御して駆
動するように構成したので、それぞれのセグメント群の
駆動回路をセグメント列に対して対称な構成とすること
ができ、制御が容易になる効果を有する。
第１図は本発明の一実施例が適用される静電記録装置を
示す概略断面図、第２図は螢光発生管の近傍を示す横断
面図、第３図は本発明における螢光発生管と駆動用ＩＣ
を示す概略斜視図、第４図は同螢光発生管と駆動用ＩＣ
を示すブロック回路図、第５図は発光セグメントの寸法
の一例を示す概略平面図、第６図は駆動用ＩＣとリード
端子の配列状態を示す概略平面図、第７図は駆動用ＩＣ
に接続される駆動電源用リード端子とグランド用リード
端子の接続状態を示すブロック回路図、第８図は１個の
駆動用ＩＣを示すブロック回路図、第９図は駆動用ＩＣ
のピン配置状態を示す平面図、第１０図は駆動用ＩＣ１
クロツクインターフエイス回路及び画像信号発生回路間
の信号の授受を示す図、第１１図はクロックインターフ
ェイス回路を示すブロック回路図、第１２図はクロック
インターフェイス回路と画像信号発生回路との間の信号
を示す波形図、第１３図は第１０図に示される信号を示
す波形図である。 １・・・螢光発生管、２・・・駆動用ＩＣｌ３・・・ク
ロックインターフェイス回路、７・・・光伝送体アレイ
、８・・・感光体ドラム、９・・・帯電チャージャ、１
０・・・現像装置、１１・・・記録用紙、１２・・・転
写チャージャ、１３・・・分離チャージャ、１４・・・
クリーナ、１５・・・定着装置、１６・・・基板、１７
・・・フェイスガラス、１８・・・発光セグメント、１
９・・・リード線、２０・・・カソードフィラメント、
２１・・・グリッド、２２・・・ワイヤボンディング。 第１図 “イ、。 Ｌ７二４シニ６二９．ヨＱ”３ 第３図 第５図 第６図 郭ひｊ判ａ鴫 とミ猛ミ第７図 第１０図 第１２図
示す概略断面図、第２図は螢光発生管の近傍を示す横断
面図、第３図は本発明における螢光発生管と駆動用ＩＣ
を示す概略斜視図、第４図は同螢光発生管と駆動用ＩＣ
を示すブロック回路図、第５図は発光セグメントの寸法
の一例を示す概略平面図、第６図は駆動用ＩＣとリード
端子の配列状態を示す概略平面図、第７図は駆動用ＩＣ
に接続される駆動電源用リード端子とグランド用リード
端子の接続状態を示すブロック回路図、第８図は１個の
駆動用ＩＣを示すブロック回路図、第９図は駆動用ＩＣ
のピン配置状態を示す平面図、第１０図は駆動用ＩＣ１
クロツクインターフエイス回路及び画像信号発生回路間
の信号の授受を示す図、第１１図はクロックインターフ
ェイス回路を示すブロック回路図、第１２図はクロック
インターフェイス回路と画像信号発生回路との間の信号
を示す波形図、第１３図は第１０図に示される信号を示
す波形図である。 １・・・螢光発生管、２・・・駆動用ＩＣｌ３・・・ク
ロックインターフェイス回路、７・・・光伝送体アレイ
、８・・・感光体ドラム、９・・・帯電チャージャ、１
０・・・現像装置、１１・・・記録用紙、１２・・・転
写チャージャ、１３・・・分離チャージャ、１４・・・
クリーナ、１５・・・定着装置、１６・・・基板、１７
・・・フェイスガラス、１８・・・発光セグメント、１
９・・・リード線、２０・・・カソードフィラメント、
２１・・・グリッド、２２・・・ワイヤボンディング。 第１図 “イ、。 Ｌ７二４シニ６二９．ヨＱ”３ 第３図 第５図 第６図 郭ひｊ判ａ鴫 とミ猛ミ第７図 第１０図 第１２図
Claims (4)
- （１）−列に多数配列されたセグメントのオン−オフ制
御を行うために、奇数番目のセグメントと偶数番目のセ
グメントのリード線をセグメント列に対してそれぞれ反
対方向に引き出して、奇数番目のセグメント群と偶数番
目のセグメント群を別々に制御して駆動すると共に、そ
れぞれのセグメント群の駆動回路を上記セグメント列に
対して対称な構成としたことを特徴とする静電記録装置
の制御装置。 - （２）上記セグメントと上記駆動回路が同一基板上に設
けられている特許請求の範囲第１項に記載の静電記録装
置の制御装置。 - （３）上記駆動回路が複数個並列配置されている特許請
求の範囲第１項又は第２項に記載の静電記録装置の制御
装置。 - （４）上記リード線が上記セグメントと同一の基板上に
蒸着法によって形成されている特許請求の範囲第１項な
いし第３項に記載の静電記録装置の制御装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56210355A JPS58110268A (ja) | 1981-12-25 | 1981-12-25 | 静電記録装置の制御装置 |
| US06/451,712 US4478504A (en) | 1981-12-22 | 1982-12-20 | Electrostatic recording apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56210355A JPS58110268A (ja) | 1981-12-25 | 1981-12-25 | 静電記録装置の制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58110268A true JPS58110268A (ja) | 1983-06-30 |
Family
ID=16588012
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56210355A Pending JPS58110268A (ja) | 1981-12-22 | 1981-12-25 | 静電記録装置の制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58110268A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61948U (ja) * | 1984-06-11 | 1986-01-07 | 沖電気工業株式会社 | 光プリンタヘツド |
| JPS6186767A (ja) * | 1984-10-03 | 1986-05-02 | Fuji Xerox Co Ltd | 静電記録用発光装置 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5774166A (en) * | 1980-10-29 | 1982-05-10 | Oki Electric Ind Co Ltd | Array head of light emitting diode |
-
1981
- 1981-12-25 JP JP56210355A patent/JPS58110268A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5774166A (en) * | 1980-10-29 | 1982-05-10 | Oki Electric Ind Co Ltd | Array head of light emitting diode |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61948U (ja) * | 1984-06-11 | 1986-01-07 | 沖電気工業株式会社 | 光プリンタヘツド |
| JPS6186767A (ja) * | 1984-10-03 | 1986-05-02 | Fuji Xerox Co Ltd | 静電記録用発光装置 |
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