JPS58103885A - 回転体の制御方法 - Google Patents
回転体の制御方法Info
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- JPS58103885A JPS58103885A JP56203342A JP20334281A JPS58103885A JP S58103885 A JPS58103885 A JP S58103885A JP 56203342 A JP56203342 A JP 56203342A JP 20334281 A JP20334281 A JP 20334281A JP S58103885 A JPS58103885 A JP S58103885A
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- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02P—CONTROL OR REGULATION OF ELECTRIC MOTORS, ELECTRIC GENERATORS OR DYNAMO-ELECTRIC CONVERTERS; CONTROLLING TRANSFORMERS, REACTORS OR CHOKE COILS
- H02P23/00—Arrangements or methods for the control of AC motors characterised by a control method other than vector control
- H02P23/18—Controlling the angular speed together with angular position or phase
- H02P23/186—Controlling the angular speed together with angular position or phase of one shaft by controlling the prime mover
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- Y10S388/907—Specific control circuit element or device
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- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Control Of Electric Motors In General (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は回転体の制御方法に関し、特に回転体の起動直
後における回転体の制御方法の改良に関する。
後における回転体の制御方法の改良に関する。
以下、本発明を磁気録画再生装置を例に説明する。
第１図は磁気録画再生装置（以下ＶＴＲという）におい
て、回転体であるドラムの従来の制御装置の一例を示す
図である。ｌは磁気テース２は映像信号を記録再生する
磁気ヘッド、３は磁気ヘッド２を保有する回転ドラム、
４はドラム３を駆動するモータ、５はモータ４に組込ん
だ位相検出用マグネット（以下ＰＧマグネットという）
、６はＰＧマグネット５の位置を検出発生する周波数発
電器、８は映像信号が入力される端子、９は垂直同期信
号を映像信号から分離する垂直同期分離回路、１０は映
像信号の記録時に垂直同期分離回路９によって分離され
た垂直同期信号をコントロール信号として記録し映像信
号の再生時Ｋｍコントロール信号を再生するコントロー
ルヘッド、ｌｌ＃′ｉ該コントロール信号が記録される
コントロールトラック、１２゜１３は記録−再生切換ス
イッチ、１４は矩形波形成回路、１５ｄ台形波形成回路
、１６はパルス波発生回路賜１７は遅延回路、１８は充
放電回路、ｘｃｉ、ｚｏはサンプルホールド回路、２１
はサンプルホールド回路１９及び２０の出力を適度に合
成し増幅する制御増幅器である。
て、回転体であるドラムの従来の制御装置の一例を示す
図である。ｌは磁気テース２は映像信号を記録再生する
磁気ヘッド、３は磁気ヘッド２を保有する回転ドラム、
４はドラム３を駆動するモータ、５はモータ４に組込ん
だ位相検出用マグネット（以下ＰＧマグネットという）
、６はＰＧマグネット５の位置を検出発生する周波数発
電器、８は映像信号が入力される端子、９は垂直同期信
号を映像信号から分離する垂直同期分離回路、１０は映
像信号の記録時に垂直同期分離回路９によって分離され
た垂直同期信号をコントロール信号として記録し映像信
号の再生時Ｋｍコントロール信号を再生するコントロー
ルヘッド、ｌｌ＃′ｉ該コントロール信号が記録される
コントロールトラック、１２゜１３は記録−再生切換ス
イッチ、１４は矩形波形成回路、１５ｄ台形波形成回路
、１６はパルス波発生回路賜１７は遅延回路、１８は充
放電回路、ｘｃｉ、ｚｏはサンプルホールド回路、２１
はサンプルホールド回路１９及び２０の出力を適度に合
成し増幅する制御増幅器である。
第２図は第１図における（＆）〜（ｊ）各部の波形図で
ある。以下動作の説明をする。まず速度制御系は周波数
発電器７の出力（ａｌがパルス波発生回路１６に入力さ
れ、（ａ）に同期したパルス信号（ｂｌをパルス波発生
回路が出力する。パルス信号（ｂ）はサンプルホールド
回路２０にサンプリングパルスとして入力され、また遅
延回路１７に入力される。遅延回路１７の出力である遅
延パルス（Ｃ）は充放電回路に放電のトリガ（刺激信号
）パルスとして加えられる。充放電囲路１８は充電用の
電流源及びコンデンサとトリガパルス（Ｃ１の入力時に
放電される放電回路とで成っている。
ある。以下動作の説明をする。まず速度制御系は周波数
発電器７の出力（ａｌがパルス波発生回路１６に入力さ
れ、（ａ）に同期したパルス信号（ｂｌをパルス波発生
回路が出力する。パルス信号（ｂ）はサンプルホールド
回路２０にサンプリングパルスとして入力され、また遅
延回路１７に入力される。遅延回路１７の出力である遅
延パルス（Ｃ）は充放電回路に放電のトリガ（刺激信号
）パルスとして加えられる。充放電囲路１８は充電用の
電流源及びコンデンサとトリガパルス（Ｃ１の入力時に
放電される放電回路とで成っている。
次に充放電回路の出力（ｄ）はサンプルホールド回路２
０に加えられ上記のパルス信号（ｂｌによってサンプリ
ングされる０そしてサンプルホールド回路２０の出力＋
６）は誤差電圧として制御増幅器２１に入力される。
０に加えられ上記のパルス信号（ｂｌによってサンプリ
ングされる０そしてサンプルホールド回路２０の出力＋
６）は誤差電圧として制御増幅器２１に入力される。
次に位相制御系について説明する。ＰＧヘッド６はモー
タ４に同期したパルス信号（以下ＰＧパルスという）（
ｆ）を出力し矩形波形成回路１４に入力される。矩形波
形成回路１４はＰＧパル同期した台形［（ｈｌを出力し
、台形波はサンプルホールド回路１９に入力される。一
方映ｆＩ！信号から垂直同期分離回路声で分離した垂直
同期信号は、映鐵信号の配録時においてはコントロール
ヘッド１０を介して磁気テープｌ上のコントロールトラ
ンク１１にコントロール信号として記録されると共に、
サンプリングパルス（ｉｌとしてサンプルホールド回路
１９に入力される。また映像信号の再生時においてはコ
ントロールトラック１１より上記の如く配録されたコン
トロール信号を再生し、該再生されたコントロール信号
をサンプリングパルス（ｉｌとしてサンプルホールド回
路１９に入力する。サンプルホールド回路１９では台形
波＋ｈ）が前述のサンプリングパルス（ｉｔでサンプリ
ングされる。そしてサンプルホールド回路１９の出力は
制御増幅器２１に入力される。
タ４に同期したパルス信号（以下ＰＧパルスという）（
ｆ）を出力し矩形波形成回路１４に入力される。矩形波
形成回路１４はＰＧパル同期した台形［（ｈｌを出力し
、台形波はサンプルホールド回路１９に入力される。一
方映ｆＩ！信号から垂直同期分離回路声で分離した垂直
同期信号は、映鐵信号の配録時においてはコントロール
ヘッド１０を介して磁気テープｌ上のコントロールトラ
ンク１１にコントロール信号として記録されると共に、
サンプリングパルス（ｉｌとしてサンプルホールド回路
１９に入力される。また映像信号の再生時においてはコ
ントロールトラック１１より上記の如く配録されたコン
トロール信号を再生し、該再生されたコントロール信号
をサンプリングパルス（ｉｌとしてサンプルホールド回
路１９に入力する。サンプルホールド回路１９では台形
波＋ｈ）が前述のサンプリングパルス（ｉｔでサンプリ
ングされる。そしてサンプルホールド回路１９の出力は
制御増幅器２１に入力される。
第３図は第１図に示した制御装置の要部でおる制御増幅
器２１の一従来例を示す回路図である。第３図において
、Ａ４−Ａ３はオペアンプ、Ｒ２Ｒ３及び馬は抵抗、Ｑ
はトランジスタ、■、はオペアンプ人、の出力電圧、■
！はオペアンプＡ！の出力電圧である。〜はトランジス
タＱ及び抵抗んで構成されるエミッタフォロワを介して
モータ４に印加される出力電圧であシ、モータ４は第１
図に示したものと同一である。
器２１の一従来例を示す回路図である。第３図において
、Ａ４−Ａ３はオペアンプ、Ｒ２Ｒ３及び馬は抵抗、Ｑ
はトランジスタ、■、はオペアンプ人、の出力電圧、■
！はオペアンプＡ！の出力電圧である。〜はトランジス
タＱ及び抵抗んで構成されるエミッタフォロワを介して
モータ４に印加される出力電圧であシ、モータ４は第１
図に示したものと同一である。
（以下Ｖｓで示す）として、サンプルホールド。
回路１９の出力（ｊ）は位相制御電圧（以下Ｖｐで示す
）として、それぞれ端子２２．２３に入力される。端子
２５には定電圧Ｖｃｃが、端子２６にはこの定電圧Ｖｃ
ｃの半分の定電圧−Ｖｃｃが加えられている。第４図は
ドラム３の回転数（以下Ｎで示す）とＶｓの関係を示す
特性図である。ドラム３が所定の回転数（以下Ｎ０で示
す）で回転している時にはＶｓは１／２■弱 となる様
に設定しである。また第５図はドラム３の回転位相と基
準信号である前述の垂直同期信号また社再生されたコン
トロール信号との位相差（以下θで社）と■呻関係を示
す特性図である。第４図においてＣ０で示したのはｎｉ
ｊ記位相位相差定の位相差（以下θ。で示す）になって
いる時を示し、その時Ｖｐは１／２Ｖｃｃになるように
設定されている。更にモータ４は印加電圧がｌ／２ＶＣ
ｃであるときＮ、とまるように設定されている。ことで
ＶｌｉｊＶｉとＶｐによって次式で与えられる。
）として、それぞれ端子２２．２３に入力される。端子
２５には定電圧Ｖｃｃが、端子２６にはこの定電圧Ｖｃ
ｃの半分の定電圧−Ｖｃｃが加えられている。第４図は
ドラム３の回転数（以下Ｎで示す）とＶｓの関係を示す
特性図である。ドラム３が所定の回転数（以下Ｎ０で示
す）で回転している時にはＶｓは１／２■弱 となる様
に設定しである。また第５図はドラム３の回転位相と基
準信号である前述の垂直同期信号また社再生されたコン
トロール信号との位相差（以下θで社）と■呻関係を示
す特性図である。第４図においてＣ０で示したのはｎｉ
ｊ記位相位相差定の位相差（以下θ。で示す）になって
いる時を示し、その時Ｖｐは１／２Ｖｃｃになるように
設定されている。更にモータ４は印加電圧がｌ／２ＶＣ
ｃであるときＮ、とまるように設定されている。ことで
ＶｌｉｊＶｉとＶｐによって次式で与えられる。
１
ｖ、 ＝ 、Ｔ、 ｔ （Ｒ＋爬） ■Ｓ” （” ”
鳥） Ｖｐ−２・Ｖｃｃ （ｋｉｑ ＋ｋ ） ）・
・・・・・・・・（１） だけ速くなった場合、第４図においてＮ＝Ｎ、のΔＶｓ
− ときの７− ”であるとすれば式（１）よりａΔＮ ■・＝２”’ ＩＣ”十鴇）、 町旧・・（２）とな
り、即ちモータ４の印加電圧■ｏは下がり、その結果Ｎ
は遅くな’りＮｏＫ近づく。そして同様にＮが遅くなれ
けＮは遠くなルＮｏに近づく０次にもし、θが００から
Ｊ進んだ時、第５図においてθ＝θ。のときの％＝−ｂ
であるとすれば式（１） ％式％ （３） が遅れればθは進み０゜に近づく。以上述べた如く回転
速度及び回転位相が制御される。
鳥） Ｖｐ−２・Ｖｃｃ （ｋｉｑ ＋ｋ ） ）・
・・・・・・・・（１） だけ速くなった場合、第４図においてＮ＝Ｎ、のΔＶｓ
− ときの７− ”であるとすれば式（１）よりａΔＮ ■・＝２”’ ＩＣ”十鴇）、 町旧・・（２）とな
り、即ちモータ４の印加電圧■ｏは下がり、その結果Ｎ
は遅くな’りＮｏＫ近づく。そして同様にＮが遅くなれ
けＮは遠くなルＮｏに近づく０次にもし、θが００から
Ｊ進んだ時、第５図においてθ＝θ。のときの％＝−ｂ
であるとすれば式（１） ％式％ （３） が遅れればθは進み０゜に近づく。以上述べた如く回転
速度及び回転位相が制御される。
次に起動時の過渡特性について述べる。今、モータ４が
回転を停止している時点から起動し回転を開始したとす
る０モータ４の回転数が上昇するに従って、 Ｖｓは１
／２Ｖｃｃに近づく０そしてこの間Ｖｐにはモータ４の
瞬時角周波数とｓｇ２図に示したサンブリフグパルス（
ｉｌとの差の周波数を持った電圧の大さな変動が生じて
いる。ところが一般に抵抗鴇は抵抗島に比べて大きい、
即ち速度制御系の利得は位相制御系の利得よシ大きい。
回転を停止している時点から起動し回転を開始したとす
る０モータ４の回転数が上昇するに従って、 Ｖｓは１
／２Ｖｃｃに近づく０そしてこの間Ｖｐにはモータ４の
瞬時角周波数とｓｇ２図に示したサンブリフグパルス（
ｉｌとの差の周波数を持った電圧の大さな変動が生じて
いる。ところが一般に抵抗鴇は抵抗島に比べて大きい、
即ち速度制御系の利得は位相制御系の利得よシ大きい。
ゆえにドラム３が起動してからＮが塊になるまでは主に
速度制御系が働いていると考えてよい。
速度制御系が働いていると考えてよい。
Ｎが＃１はＮｏに達した時、θが００から角φだけ進ん
でいたとすると、それによってモータ４の印加電圧篤は
式（３）より ｂ乙− ■。＝Ｔ Ｖｃｃ ”ＴＴｒ（）ｊ＋ Ｒｔ） ＋
＋＋ ＋＋＋ ＋＋・（４）となれば問題はない。とこ
ろが式（４）のモータ４の印加電圧へか下がることによ
りＮは遅くなる。
でいたとすると、それによってモータ４の印加電圧篤は
式（３）より ｂ乙− ■。＝Ｔ Ｖｃｃ ”ＴＴｒ（）ｊ＋ Ｒｔ） ＋
＋＋ ＋＋＋ ＋＋・（４）となれば問題はない。とこ
ろが式（４）のモータ４の印加電圧へか下がることによ
りＮは遅くなる。
Ｎがもし伽だけ遅くなれば式（４）及び式（２）に↓リ
レ４ Ｖｅ＝ＨＶｃｃ−”ｆｆ（Ｒ＋Ｒ，） 十％（ｈ＋Ｈ１
）、・ （５１となる。即ちＶｐの変位分と異符号の■
＄の変位分が発生すること忙なり、モータ４の印加電圧
晃の変位は小さくなってしまう。結局ＮがＮｏに達して
からθが００に達するまでの時間がどうしても長くなっ
てしまうことに表る。またそこで０がθ。に達するまで
の時間を早めようと位相制御系の利得を大きくしたり、
速度制御系の利得を小さくしたりすると、今度はドラム
３の起動からＮがＮｏに達するまでの時間が長くなって
しまうことになる。また外乱に対しても制御発振を生じ
てしまうものである。
レ４ Ｖｅ＝ＨＶｃｃ−”ｆｆ（Ｒ＋Ｒ，） 十％（ｈ＋Ｈ１
）、・ （５１となる。即ちＶｐの変位分と異符号の■
＄の変位分が発生すること忙なり、モータ４の印加電圧
晃の変位は小さくなってしまう。結局ＮがＮｏに達して
からθが００に達するまでの時間がどうしても長くなっ
てしまうことに表る。またそこで０がθ。に達するまで
の時間を早めようと位相制御系の利得を大きくしたり、
速度制御系の利得を小さくしたりすると、今度はドラム
３の起動からＮがＮｏに達するまでの時間が長くなって
しまうことになる。また外乱に対しても制御発振を生じ
てしまうものである。
以上述べた如く回転体の回転速度及び回転位相の制御を
行なう場合、回転速度が一定になった後速やかに回転位
相を所定の位相にするのは困難であった。
行なう場合、回転速度が一定になった後速やかに回転位
相を所定の位相にするのは困難であった。
本発明は上記欠点に鑑みてなされたものである。即ち、
ドラム３が起動後回転位相が所定の位相差になるまでの
時間を短縮すると同時に外乱に対しても制御系が安定に
動作する回転体の制御方法を提供するものである。
ドラム３が起動後回転位相が所定の位相差になるまでの
時間を短縮すると同時に外乱に対しても制御系が安定に
動作する回転体の制御方法を提供するものである。
第６図は本発明による方法をＶＴＲのドラム制−に応用
した一実施例を示す回路図である。
した一実施例を示す回路図である。
第３図と同一の構成部分については同じ記号または番号
を付しである。Ｒ８−鴇は抵抗、Ｃ１及びＣ鵞はコンデ
ンサ、ＮＯＲは公知のノアゲート、ＳＷはノアグー）Ｎ
ＯＲの出力によって開閉するアナログスイッチである。
を付しである。Ｒ８−鴇は抵抗、Ｃ１及びＣ鵞はコンデ
ンサ、ＮＯＲは公知のノアゲート、ＳＷはノアグー）Ｎ
ＯＲの出力によって開閉するアナログスイッチである。
第７図は第６図（Ｍｌ〜（Ｃ）各部の波形を示す波形図
である。第７図においてｖｔｈはノアグー）ＮＯＲのス
レッショルド電圧である。ノアゲートＮＯＲは２つの入
力電圧の少なくともいずれか一方がスレッショルド電圧
ｖｔｈよシ大きくなれば出力が出ない。即ち出力１．が
ロー（以下りで示す）になるものである。ドラム３の起
動待端子２５には定電圧Ｖｃｃが加わる。すると第７図
において（ａＪで示す部分の電圧はＶｃｃとなり、（ｂ
）に示す部分の電圧は０となる。この場合（ａｌの部分
の電圧社スレッショルド電圧ｖｔｈよシ大きいのでノア
グー）ＮＯＨの出力はＬである。アナログスイッチＳＷ
はノアグー）ＮＯＲの出力がハイ（以下Ｈで示す）のと
き閉じられる如くしてあ〉、この場合アナログスイッチ
ｓｗＨ開かれてお多速度制御系の利得は第３図に示した
場合と変わりない。
である。第７図においてｖｔｈはノアグー）ＮＯＲのス
レッショルド電圧である。ノアゲートＮＯＲは２つの入
力電圧の少なくともいずれか一方がスレッショルド電圧
ｖｔｈよシ大きくなれば出力が出ない。即ち出力１．が
ロー（以下りで示す）になるものである。ドラム３の起
動待端子２５には定電圧Ｖｃｃが加わる。すると第７図
において（ａＪで示す部分の電圧はＶｃｃとなり、（ｂ
）に示す部分の電圧は０となる。この場合（ａｌの部分
の電圧社スレッショルド電圧ｖｔｈよシ大きいのでノア
グー）ＮＯＨの出力はＬである。アナログスイッチＳＷ
はノアグー）ＮＯＲの出力がハイ（以下Ｈで示す）のと
き閉じられる如くしてあ〉、この場合アナログスイッチ
ｓｗＨ開かれてお多速度制御系の利得は第３図に示した
場合と変わりない。
そしてコンデンサＣ８及び抵抗馬による時定数で決定さ
れる時間後（５１）の部分の電圧はスレッショルド電圧
ｖｔｈより小さくする０するとノアゲ−）ＮＯＲの出力
（Ｃ１はＨＫ転じ、アナログスイッチ８Ｗが閉じられる
。それによって抵抗属は３ 抵抗Ｒ１とへの並列抵抗に置きかえられたことになり、
結局速度制御系の利得が下がることになる０ さらにその後今度はコンデンサＣ１及び抵抗島による時
定数で決定される時間後（ｂ）の部分の電圧がスレッシ
ョルド電圧より大きくなり、再度アナログスイッチＳＷ
が開かれ速度制御系の利得は元に戻ることになる０ 上記のコンデンサＣ１及び抵抗島による時定数やコンデ
ンサＣ１及び抵抗Ｒ４による時定数を適当に選ぶことに
より、ＮがほぼＮ、になる時からθがは・はＣ０になる
時まで速度制御系の利得を下げることができる０このこ
とによって起動後ＮがほぼＮになると速度制御系の利得
が下がるため式（５）の第３項に示すＶｐの変位分と異
符号のｈの変位分が小さくなりｓＮがＮ・に達してから
−がらに達するまでの時間を短縮できる。さらにθが０
゜に達した後は速度制御系の利得は元に戻るので外乱に
対する制御発振も生じない。
れる時間後（５１）の部分の電圧はスレッショルド電圧
ｖｔｈより小さくする０するとノアゲ−）ＮＯＲの出力
（Ｃ１はＨＫ転じ、アナログスイッチ８Ｗが閉じられる
。それによって抵抗属は３ 抵抗Ｒ１とへの並列抵抗に置きかえられたことになり、
結局速度制御系の利得が下がることになる０ さらにその後今度はコンデンサＣ１及び抵抗島による時
定数で決定される時間後（ｂ）の部分の電圧がスレッシ
ョルド電圧より大きくなり、再度アナログスイッチＳＷ
が開かれ速度制御系の利得は元に戻ることになる０ 上記のコンデンサＣ１及び抵抗島による時定数やコンデ
ンサＣ１及び抵抗Ｒ４による時定数を適当に選ぶことに
より、ＮがほぼＮ、になる時からθがは・はＣ０になる
時まで速度制御系の利得を下げることができる０このこ
とによって起動後ＮがほぼＮになると速度制御系の利得
が下がるため式（５）の第３項に示すＶｐの変位分と異
符号のｈの変位分が小さくなりｓＮがＮ・に達してから
−がらに達するまでの時間を短縮できる。さらにθが０
゜に達した後は速度制御系の利得は元に戻るので外乱に
対する制御発振も生じない。
第８図は本発明の要部の他の実施例を示す回路図である
。第６図と同一の構成部分には同じ記号を付記する。Ｓ
鴨及び８Ｗｓは前述アナログスイッチＳＷと同じ構成の
アナログスイッチ、Ｒ，−は抵抗、ＮＯＴは公知の否定
回路−ＯＲ１は公知のオアゲートである。第９図は第８
図（Ｊｉ）〜（ｄ）各部の波形を示す波形図である。第
９図におい一’ｃ ｖｔｈ’ ハオアゲ−）ＯＲのスレ
ッショルド電圧である。ドラム３の起動後コンデンサＣ
１及び抵抗Ｒ８による時定数で決定される時間内は、オ
アゲートＯＲ１の出力（ｄｌはＨであシ当然否定回路Ｎ
ＯＴの出力（Ｃ）はＬである。その後オアゲートＯＲ，
の出力（ｄ）はＬに転じ、否定回路ＮＯＴの出力（Ｃ）
はＨに転する。このことによにアナログスイッチＳＷ、
は開かれ、逆にアナログスイッチＳＷ及びＳＷｓは閉じ
られる。すると抵抗Ｒ１は抵抗島とＲ，の並列抵抗に、
抵抗島は抵抗Ｒ３とＲ６の直列抵抗にそれぞれ置きかえ
られたことにより速度制御系の利得は下がり、位相制御
系の利得は上がる。さらにコンデンサＣ１及び抵抗島に
よる時定数で決定される時間後、アナログスイッチＳ鶴
は再度閉じられ、アナログスイッチＳＷ及びＳＷｓは開
かれる。これによって速度制御系及び位相制御系の利得
は再び元の利得に戻ることになる。この場合も第６図の
説明の時と同様にＮが＃１はＮ、になる時からθがほぼ
θ。になる時まで速度制御系の利得を下げている。そし
てかつ位相制御系の利得は上げており、ＮがＮ６に達し
てからθが００に達するまでの時間をよシ一層短縮でき
るものである。
。第６図と同一の構成部分には同じ記号を付記する。Ｓ
鴨及び８Ｗｓは前述アナログスイッチＳＷと同じ構成の
アナログスイッチ、Ｒ，−は抵抗、ＮＯＴは公知の否定
回路−ＯＲ１は公知のオアゲートである。第９図は第８
図（Ｊｉ）〜（ｄ）各部の波形を示す波形図である。第
９図におい一’ｃ ｖｔｈ’ ハオアゲ−）ＯＲのスレ
ッショルド電圧である。ドラム３の起動後コンデンサＣ
１及び抵抗Ｒ８による時定数で決定される時間内は、オ
アゲートＯＲ１の出力（ｄｌはＨであシ当然否定回路Ｎ
ＯＴの出力（Ｃ）はＬである。その後オアゲートＯＲ，
の出力（ｄ）はＬに転じ、否定回路ＮＯＴの出力（Ｃ）
はＨに転する。このことによにアナログスイッチＳＷ、
は開かれ、逆にアナログスイッチＳＷ及びＳＷｓは閉じ
られる。すると抵抗Ｒ１は抵抗島とＲ，の並列抵抗に、
抵抗島は抵抗Ｒ３とＲ６の直列抵抗にそれぞれ置きかえ
られたことにより速度制御系の利得は下がり、位相制御
系の利得は上がる。さらにコンデンサＣ１及び抵抗島に
よる時定数で決定される時間後、アナログスイッチＳ鶴
は再度閉じられ、アナログスイッチＳＷ及びＳＷｓは開
かれる。これによって速度制御系及び位相制御系の利得
は再び元の利得に戻ることになる。この場合も第６図の
説明の時と同様にＮが＃１はＮ、になる時からθがほぼ
θ。になる時まで速度制御系の利得を下げている。そし
てかつ位相制御系の利得は上げており、ＮがＮ６に達し
てからθが００に達するまでの時間をよシ一層短縮でき
るものである。
第１０図は本発明の要部の更に他の実施例を示す回路図
である。第８図と同一の構成部分には同じ記号を付記す
る。Ｒ，〜Ｒ１１は抵抗、ＯＲ１及びＯＲ６はオアゲー
ト、ＮＡＮＤは公知のナンドゲ−）、ＡＮＤは公知のア
ンドゲートであるＯ第１１図は第１Ｏ図（Ｃ）〜（ハ各
部の波形を示す波形図である。ドラム３が起動するとＶ
ｓは高い蝋から１ ／ ２Ｖｃｃに近づく。すると第１
０図（ｇ）の部分の電、圧は第１１図に示”す様にＶｓ
の変化と同様の変斗幻職；μす ＯＲ，のスレッショルド電圧■ｔｈ′ヲ２わずかに高く
設定する。それによってＮがははＮｏになる時を検出し
、それまではオアゲートＯＲ，の出力（ｄ）はＨである
。またＶｐはドラム３の起動直後は前述の様に電圧の大
きな変動を生じておｋｓＮがＮにほぼ達してからｌ／２
Ｖｃｃに近づく。第１θ図（ｅ）及び（ｆ）で示す部分
の電圧も昇と同様に起動直後には大きな変動を生じる（
第１１図（ｅ）及び（ｆｌの傾線部に示す）。そしてｔ
ｅｌの部分丁１チｈＷト町りにそ はＭ士刊す械Ｓに（ｆ）の部分は （ れぞれ近づく。そこでオアゲート０鳥及びナン）’ グ
ー） ＮＡＮＤのスレッショルド電圧ｖｔｈ’を抗Ｒ・
を抵抗Ｒ，や抵抗Ｒ１ｍに比して小さくとってやる。そ
うすると（ｅ）の部分の電圧が前配電圧ｖｔｈ“より高
くかつ（ｆ）の部分の電圧が前記電圧より低くなった時
）ははＩｆｆ １／２Ｖｃｃになったことになる。即ち
、θがほぼθｅになったことになる。
である。第８図と同一の構成部分には同じ記号を付記す
る。Ｒ，〜Ｒ１１は抵抗、ＯＲ１及びＯＲ６はオアゲー
ト、ＮＡＮＤは公知のナンドゲ−）、ＡＮＤは公知のア
ンドゲートであるＯ第１１図は第１Ｏ図（Ｃ）〜（ハ各
部の波形を示す波形図である。ドラム３が起動するとＶ
ｓは高い蝋から１ ／ ２Ｖｃｃに近づく。すると第１
０図（ｇ）の部分の電、圧は第１１図に示”す様にＶｓ
の変化と同様の変斗幻職；μす ＯＲ，のスレッショルド電圧■ｔｈ′ヲ２わずかに高く
設定する。それによってＮがははＮｏになる時を検出し
、それまではオアゲートＯＲ，の出力（ｄ）はＨである
。またＶｐはドラム３の起動直後は前述の様に電圧の大
きな変動を生じておｋｓＮがＮにほぼ達してからｌ／２
Ｖｃｃに近づく。第１θ図（ｅ）及び（ｆ）で示す部分
の電圧も昇と同様に起動直後には大きな変動を生じる（
第１１図（ｅ）及び（ｆｌの傾線部に示す）。そしてｔ
ｅｌの部分丁１チｈＷト町りにそ はＭ士刊す械Ｓに（ｆ）の部分は （ れぞれ近づく。そこでオアゲート０鳥及びナン）’ グ
ー） ＮＡＮＤのスレッショルド電圧ｖｔｈ’を抗Ｒ・
を抵抗Ｒ，や抵抗Ｒ１ｍに比して小さくとってやる。そ
うすると（ｅ）の部分の電圧が前配電圧ｖｔｈ“より高
くかつ（ｆ）の部分の電圧が前記電圧より低くなった時
）ははＩｆｆ １／２Ｖｃｃになったことになる。即ち
、θがほぼθｅになったことになる。
ＮがはぼＮ６になった時は（６１の部分の電圧及び（ｆ
ｌの部分の電圧はいずれも１１’ｌｌ記電圧ｖｔｈ’よ
り高いか、またいずれも前記電圧ｖｔｈ’より低いかで
ある。従ってアンドゲートＡＮＤの出力はＬである。そ
してθが＃丘はθ。になると（ｅ）の部分の電圧がｓｉ
Ｊ記電圧ｖｔｈ’を越えるか、または（ｆ）の部分の電
圧が前記電圧ｖｔｈ’を下まわることになる。従ってこ
の時アントゲ−）ＡＮＤの出力はＬからＨに転する。結
局オアゲートＯＲ１の出力（ｄ）はＮがほぼＮｏになる
までＨであり、その後りになシθがほぼθ。になつだ後
Ｈに表る。このことはＮが＃？！は凡に、またθがほぼ
θ０になったことをそれぞれ検出していることになる。
ｌの部分の電圧はいずれも１１’ｌｌ記電圧ｖｔｈ’よ
り高いか、またいずれも前記電圧ｖｔｈ’より低いかで
ある。従ってアンドゲートＡＮＤの出力はＬである。そ
してθが＃丘はθ。になると（ｅ）の部分の電圧がｓｉ
Ｊ記電圧ｖｔｈ’を越えるか、または（ｆ）の部分の電
圧が前記電圧ｖｔｈ’を下まわることになる。従ってこ
の時アントゲ−）ＡＮＤの出力はＬからＨに転する。結
局オアゲートＯＲ１の出力（ｄ）はＮがほぼＮｏになる
までＨであり、その後りになシθがほぼθ。になつだ後
Ｈに表る。このことはＮが＃？！は凡に、またθがほぼ
θ０になったことをそれぞれ検出していることになる。
これによシ速は第８図の説明で述べた通りである。
結局ｗ４６図、第８図及び＠１０図に示した如く、回転
体の回転速度が −”ｔ１！ぼ所定の回転速度
になった彼、回転速度制御系の利得を回転位相制御系の
利得に比して小さくしてやることにより回転位相が速や
かに所定の位相差になる。その後は外乱に対する応答を
考えて変化させた制御利得を元に戻してやるということ
である。
体の回転速度が −”ｔ１！ぼ所定の回転速度
になった彼、回転速度制御系の利得を回転位相制御系の
利得に比して小さくしてやることにより回転位相が速や
かに所定の位相差になる。その後は外乱に対する応答を
考えて変化させた制御利得を元に戻してやるということ
である。
以上説明した様に、本発明によれば速度ｆ！＋ｌＪ御系
の利得及び位相制御系の利得を適当な時期に切換えるこ
とによって回転体の起動製作時において制御の安定性を
そこなわずに、制御時間を大幅に短縮できるものである
。
の利得及び位相制御系の利得を適当な時期に切換えるこ
とによって回転体の起動製作時において制御の安定性を
そこなわずに、制御時間を大幅に短縮できるものである
。
第１図はＶＴｌ’Ｌにおいて回転体であるドラムの従来
の制御装置の一例を示す図、巣２図は＠１図各部の波形
図、第３−は第１図の要部を示す図、第４図は回転体で
あるドラムの回転数と速度制御電圧の関係を示す特性図
、第５図は回転体であるドラムの位相と位相制御電圧の
関係を示す特性図、第６図は本発明の要部の一実施例を
示す回路図、第７図社第６図各部の波形図、第８図は本
発明０１ｌＩ部の他の実施例を示す回路図、第９図は第
８各部部の波形図、第１θ図は本発明の要部の更に他の
実施例を示す回路図、第１１図は第１０各部部の波形図
である。 ４はモータ、 ２２は回転速度制御電圧が印加される端
子、 ２３は回転位相制御電圧が印加される端子である
。
の制御装置の一例を示す図、巣２図は＠１図各部の波形
図、第３−は第１図の要部を示す図、第４図は回転体で
あるドラムの回転数と速度制御電圧の関係を示す特性図
、第５図は回転体であるドラムの位相と位相制御電圧の
関係を示す特性図、第６図は本発明の要部の一実施例を
示す回路図、第７図社第６図各部の波形図、第８図は本
発明０１ｌＩ部の他の実施例を示す回路図、第９図は第
８各部部の波形図、第１θ図は本発明の要部の更に他の
実施例を示す回路図、第１１図は第１０各部部の波形図
である。 ４はモータ、 ２２は回転速度制御電圧が印加される端
子、 ２３は回転位相制御電圧が印加される端子である
。
Claims (1)
- （１）回転体の回転速度を制御する速度制御手段と、前
記回転位相を制御する位相制御手段とを備え、前記回転
体の起動直後の第一の時間帯と該第−の時間帯後の第二
の時間帯とで前記速度制御手段または前記位相制御手段
の制御利得を異ならしめ、更に前記第二の時間帯と咳第
二の時間帯後とで前記速度制御手段または前記位相制御
手段の制御利得を異ならしめたことを特徴とする回転体
の制御方法。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56203342A JPS58103885A (ja) | 1981-12-15 | 1981-12-15 | 回転体の制御方法 |
| US06/449,614 US4517501A (en) | 1981-12-15 | 1982-12-14 | Rotation control system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56203342A JPS58103885A (ja) | 1981-12-15 | 1981-12-15 | 回転体の制御方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58103885A true JPS58103885A (ja) | 1983-06-21 |
| JPH0444512B2 JPH0444512B2 (ja) | 1992-07-21 |
Family
ID=16472428
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56203342A Granted JPS58103885A (ja) | 1981-12-15 | 1981-12-15 | 回転体の制御方法 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US4517501A (ja) |
| JP (1) | JPS58103885A (ja) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5335189A (en) * | 1989-01-21 | 1994-08-02 | Canon Kabushiki Kaisha | Rotation phase control device |
| US5003628A (en) * | 1989-03-02 | 1991-03-26 | Lucerne Products, Inc. | Variable speed D.C. motor control |
| US5815742A (en) | 1996-06-11 | 1998-09-29 | Minolta Co., Ltd. | Apparatus having a driven member and a drive controller therefor |
| US6128437A (en) * | 1997-12-10 | 2000-10-03 | Delta Electronics, Inc. | Digital control for revolving speed of DC motor |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5534836A (en) * | 1978-08-31 | 1980-03-11 | Mitsubishi Electric Corp | Speed controller |
| JPS56148187A (en) * | 1980-04-17 | 1981-11-17 | Matsushita Electric Ind Co Ltd | Motor controller |
| JPS5764354A (en) * | 1980-09-20 | 1982-04-19 | Hitachi Denshi Ltd | Tape driving motor controlling circuit of video tape recorder |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4162457A (en) * | 1977-12-30 | 1979-07-24 | Grodinsky Robert M | Expansion circuit for improved stereo and apparent monaural image |
| JPS56134811A (en) * | 1980-03-24 | 1981-10-21 | Sony Corp | Gain control circuit |
-
1981
- 1981-12-15 JP JP56203342A patent/JPS58103885A/ja active Granted
-
1982
- 1982-12-14 US US06/449,614 patent/US4517501A/en not_active Expired - Lifetime
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5534836A (en) * | 1978-08-31 | 1980-03-11 | Mitsubishi Electric Corp | Speed controller |
| JPS56148187A (en) * | 1980-04-17 | 1981-11-17 | Matsushita Electric Ind Co Ltd | Motor controller |
| JPS5764354A (en) * | 1980-09-20 | 1982-04-19 | Hitachi Denshi Ltd | Tape driving motor controlling circuit of video tape recorder |
Also Published As
| Publication number | Publication date |
|---|---|
| US4517501A (en) | 1985-05-14 |
| JPH0444512B2 (ja) | 1992-07-21 |
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