JPH11224924A - 半導体装置及びその製造方法 - Google Patents
半導体装置及びその製造方法Info
- Publication number
- JPH11224924A JPH11224924A JP10025316A JP2531698A JPH11224924A JP H11224924 A JPH11224924 A JP H11224924A JP 10025316 A JP10025316 A JP 10025316A JP 2531698 A JP2531698 A JP 2531698A JP H11224924 A JPH11224924 A JP H11224924A
- Authority
- JP
- Japan
- Prior art keywords
- layer
- forming
- semiconductor device
- metal
- metal layer
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L24/00—Arrangements for connecting or disconnecting semiconductor or solid-state bodies; Methods or apparatus related thereto
- H01L24/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L24/10—Bump connectors ; Manufacturing methods related thereto
- H01L24/11—Manufacturing methods
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/10—Bump connectors; Manufacturing methods related thereto
- H01L2224/11—Manufacturing methods
Landscapes
- Engineering & Computer Science (AREA)
- Manufacturing & Machinery (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Cooling Or The Like Of Semiconductors Or Solid State Devices (AREA)
Abstract
工数とを削減する。 【解決手段】 半導体チップ10の表面に、電極11を
露出させた開口部を有する絶縁性樹脂層20と、電極1
1から絶縁性樹脂層20上へ延伸し各々Cuからなる金
属薄膜層と金属膜とから構成される金属配線30とを備
え、半導体チップ10の裏面に、金属薄膜層と同時に形
成された放熱層31Aとを備える。半導体チップ10の
裏面において、放熱フィンを接着することに代えて、金
属配線30を製造する工程において同時に形成された放
熱層31Aを介して熱を効率よく放出するので、半導体
装置の材料コストと工数とを削減し、かつ、放熱性を改
善できる。
Description
素子を有する半導体装置であって、特に放熱性に優れた
半導体装置に関するものである。
い、半導体装置に対して小型化、高密度化、及び高速化
が要求されるようになってきたので、半導体装置の発熱
量が大きくなる傾向にある。したがって、素子を保護す
る目的で、発生した熱を外部に逃がす必要があるので、
半導体チップの裏面に放熱フィンを設けたり熱伝導性の
よい樹脂を塗布したりする等の対策を行ってきた。
置について、図4を参照しながら説明する。図4は、従
来の半導体装置を示す断面図である。図4において、1
00は半導体素子を内蔵する半導体チップ、101は電
極、102は絶縁性樹脂層、103は金属配線、104
は樹脂膜、105は放熱フィンである。すなわち、図4
に示すように、従来の半導体装置は、半導体チップ10
0の裏面に熱伝導性のよい樹脂膜104を介して放熱フ
ィン105を設けることにより、発生した熱を放熱フィ
ン105から効率よく逃がすことができる構造を有して
いる。
4を参照しながら説明する。まず、半導体チップ100
の表面に、電極101をそれぞれ開口して絶縁性樹脂層
102を形成する。次に、半導体基板の表面の全面に、
スパッタによってCrとCuとからなる金属膜を順次形
成し、該形成された金属膜の上にメッキレジストを塗布
した後に、順次露光と現像とを行って所望のレジストパ
ターンを形成する。次に、電解Auメッキを行った後に
メッキレジストを溶融除去し、更にCrとCuとのみか
らなる層を選択的にエッチングすることによって、半導
体チップ100の表面において金属配線103を形成す
る。更に、半導体チップ100の裏面に対して、樹脂膜
104等を用いて放熱フィン105を接着する。
来の半導体装置によれば、半導体基板を分割して得られ
た個別の半導体チップ100に対して高価な放熱フィン
105をそれぞれ接着する必要があるので、コストが上
昇し、かつ量産性が悪いという問題があった。
ィンを設けることなく、安価であって放熱性と量産性と
に優れた半導体装置及びその製造方法を提供することを
目的とする。
めに、本発明では、請求項1〜6に記載された半導体装
置に関する手段と、請求項7〜12に記載された半導体
装置の製造方法に関する手段とを講じている。
記載されているように、第1の面及び第2の面を有する
半導体チップと、第1の面上に形成され少なくとも1種
類の金属からなる配線パターンと、第2の面上に形成さ
れ配線パターンを構成する少なくとも1種類の金属を含
む放熱層とを備えている。
れた放熱フィンを必要とせず、配線パターンと同時に第
2の面上に形成された放熱層を介して熱が放出されるの
で、材料コストと製造工数とが削減され、かつ放熱性が
改善される。
記載されているように、第1の面及び第2の面を有する
半導体チップと、第1の面上に形成され少なくとも1種
類の金属からなる配線パターンと、第2の面上に形成さ
れ凹凸を有する絶縁性樹脂層と、凹凸を有する絶縁性樹
脂層の上に形成され配線パターンを構成する少なくとも
1種類の金属を含む放熱層とを備えている。
れた放熱フィンを必要とせず、絶縁性樹脂層の凹凸上に
配線パターンと同時に形成された放熱層を介して熱が放
出されるので、材料コストと製造工数とが削減され、か
つ、大きな表面積を有する放熱層によっていっそう放熱
性が改善された半導体装置が得られる。
1又は2記載の半導体装置において、第1の面上に形成
された絶縁性樹脂層を更に備え、配線パターンの少なく
とも一部は絶縁性樹脂層の上に形成されたこととしても
よい。
して形成された配線パターンを有する半導体装置が得ら
れる。
1〜3のいずれか1つに記載の半導体装置において、放
熱層は少なくともCuからなる層を備えていることが好
ましい。
からなる放熱層が、半導体装置の熱を効率的に放出する
ので、放熱性のよい半導体装置が得られる。
記載されているように、配線パターンを持つ第1の面及
び凹凸を持つ第2の面を有する半導体チップと、第1の
面上に形成され少なくとも1種類の金属からなる配線パ
ターンと、凹凸を持つ第2の面上に形成され配線パター
ンを構成する少なくとも1種類の金属を含む放熱層とを
備えている。
れた放熱フィンを必要とせず、第2の面の凹凸上に配線
パターンと同時に形成された放熱層を介して熱が放出さ
れるので、材料コストと製造工数とが削減され、かつ、
第2の面上に直接形成され大きな表面積を有する放熱層
によって更にいっそう放熱性が改善された半導体装置が
得られる。
記載されているように、第1の面及び第2の面を有し、
該第1の面上に複数個のチップ領域を有するウェハ状の
半導体装置であって、各チップ領域に形成され少なくと
も1種類の金属からなる配線パターンと、第2の面のう
ち各チップ領域に対向する領域に形成され配線パターン
を構成する少なくとも1種類の金属を含む放熱層とを備
えている。
ハ状の半導体装置において、個々のチップが有する第2
の面に配線パターンと同時に放熱層が形成されるので、
半導体装置の製造工数を大幅に削減できる。
請求項7に記載されているように、第1の面及び第2の
面を有する半導体装置の製造方法であって、第1の面上
に第1の金属層を形成する工程と、第1の金属層をパタ
ーニングして配線パターンを形成する工程と、第1の金
属層を形成する工程の少なくとも一部と同時に第2の面
上に放熱層となる第2の金属層を形成する工程とを備え
ている。
第2の面上に放熱層を形成するので、放熱性が改善され
た半導体装置を、製造工数を削減して製造できる。
請求項8に記載されているように、第1の面及び第2の
面を有する半導体装置の製造方法であって、第1の面上
に第1の金属層を形成する工程と、第1の金属層をパタ
ーニングして配線パターンを形成する工程と、第2の面
上に絶縁性樹脂層を形成する工程と、絶縁性樹脂層の表
面に凹凸を形成する工程と、第1の金属層を形成する工
程の少なくとも一部と同時に凹凸が形成された絶縁性樹
脂層の上に放熱層となる第2の金属層を形成する工程と
を備えている。
絶縁性樹脂層の凹凸の上に放熱層を形成するので、放熱
性がいっそう改善された半導体装置を、製造工数を削減
して製造できる。
請求項9に記載されているように、第1の面及び第2の
面を有する半導体装置の製造方法であって、第2の面に
凹凸を形成する工程と、第1の面上に第1の金属層を形
成する工程と、第1の金属層をパターニングして配線パ
ターンを形成する工程と、第1の金属層を形成する工程
の少なくとも一部と同時に凹凸が形成された第2の面上
に放熱層となる第2の金属層を形成する工程とを備えて
いる。
第2の面の凹凸の上に放熱層を形成するので、放熱性が
更にいっそう改善された半導体装置を、製造工数を削減
して製造できる。
請求項10に記載されているように、第1の面及び第2
の面を有し、該第1の面上に複数個のチップ領域を有す
るウェハ状の半導体装置の製造方法であって、各チップ
領域の上に第1の金属層を形成する工程と、第1の金属
層をパターニングして配線パターンを形成する工程と、
第1の金属層を形成する工程の少なくとも一部と同時に
第2の面のうち各チップ領域に対向する領域の上に放熱
層となる第2の金属層を形成する工程とを備えている。
に別途放熱フィンを接着する工程に代えて、ウェハ状の
半導体装置が有する各チップに対して、配線パターン形
成と同時に第2の面上に放熱層を形成する。したがっ
て、放熱性が改善された半導体装置を、製造工数を大幅
に削減して製造できる。
請求項11に記載されているように、第1の面及び第2
の面を有し、該第1の面上に複数個のチップ領域を有す
るウェハ状の半導体装置の製造方法であって、各チップ
領域の上に第1の金属層を形成する工程と、第1の金属
層をパターニングして配線パターンを形成する工程と、
第2の面のうち各チップ領域に対向する領域の上に絶縁
性樹脂層を形成する工程と、絶縁性樹脂層の表面に凹凸
を形成する工程と、第1の金属層を形成する工程の少な
くとも一部と同時に凹凸が形成された絶縁性樹脂層の上
に放熱層となる第2の金属層を形成する工程とを備えて
いる。
に別途放熱フィンを接着する工程に代えて、ウェハ状の
半導体装置が有する各チップに対して、配線パターン形
成と同時に、第2の面上において絶縁性樹脂層の凹凸の
上に放熱層を形成する。したがって、放熱性がいっそう
改善された半導体装置を、製造工数を大幅に削減して製
造できる。
請求項12に記載されているように、第1の面及び第2
の面を有し、該第1の面上に複数個のチップ領域を有す
るウェハ状の半導体装置の製造方法であって、第2の面
に凹凸を形成する工程と、各チップ領域の上に第1の金
属層を形成する工程と、第1の金属層をパターニングし
て配線パターンを形成する工程と、第1の金属層を形成
する工程の少なくとも一部と同時に凹凸が形成された第
2の面のうち各チップ領域に対向する領域の上に放熱層
となる第2の金属層を形成する工程とを備えている。
に別途放熱フィンを接着する工程に代えて、ウェハ状の
半導体装置が有する各チップに対して、配線パターン形
成と同時に、第2の面の凹凸の上に放熱層を形成する。
したがって、放熱性が更にいっそう改善された半導体装
置を、製造工数を大幅に削減して製造できる。
の実施形態に係る半導体装置について、図1を参照しな
がら説明する。図1は、本実施形態に係る半導体装置を
示す断面図である。図1において、半導体チップ10
は、その表面に電極11を有し、かつトランジスタ等を
内蔵する半導体素子である。絶縁性樹脂層20は、半導
体チップ10の表面上において電極11を開口して設け
られ、金属配線30を安定して形成するための絶縁性物
質である。金属配線30は、半導体チップ10の表面と
絶縁性樹脂層20との上にわたって、Cu、Ni、及び
Auからなる層が順次積層されて設けられ、電極11と
外部装置(図示せず)とを電気的に接続するためのパタ
ーンである。金属配線30の一部は、外部装置(図示せ
ず)との間において信号を授受するための外部電極端子
を構成する。放熱層31Aは、半導体チップ10の裏面
に、金属配線30を構成する金属の少なくとも一部と同
じ材料で構成され、半導体チップ10が有するトランジ
スタ等が生成した熱を放出するための放熱手段である。
装置によれば、放熱フィンを接着することなく、半導体
チップ10の裏面に設けられた放熱層31Aが、トラン
ジスタ等が生成した熱を効率的に放出する。したがっ
て、半導体装置の材料コストを削減し、かつ、放熱性を
改善できる。
金属配線30の少なくとも一部と同じ材料で構成される
ことにより、金属配線30を形成する工程において放熱
層31Aを同時に形成できる。したがって、半導体装置
の製造工数を削減できる。
導体チップ10に対して金属配線30と放熱層31Aと
を同時に形成できるので、後述のように、ウェハが有す
る複数の半導体チップに対して放熱層31Aを一括して
形成できる。
法について、図1を参照しながら説明する。
と絶縁性とを有する樹脂を塗布して乾燥させた後に、露
光と現像とを順次行うことにより、電極11の部分が開
口した絶縁性樹脂層20を形成する。この場合におい
て、例えば露光で平行光ではなく散乱光を使用して、開
口部における絶縁性樹脂層20の断面形状を、電極11
に対して垂直ではなくテーパー状にして形成する。ま
た、樹脂の硬化収縮を利用することによって、絶縁性樹
脂層20の断面形状をテーパー状にすることもできる。
感光性と絶縁性とを有する樹脂としては、例えば感光性
を有するポリイミド、エポキシ等のような樹脂であれば
よい。
全面において、真空蒸着法、スパッタリング法、CVD
法又は無電解メッキ法によって金属薄膜層を形成した後
に、該金属薄膜層に対してパターニングを行う。本実施
形態においては、無電解Cuメッキを用いて金属薄膜層
を形成する。
ングは、以下のようにして行う。金属薄膜層の上に感光
性レジストを塗布して、露光によって所定のパターン部
以外のレジストを硬化させた後に、該パターン部のレジ
ストを除去する。電解メッキを使用して、前記パターン
部に例えばCuからなる大きい膜厚を有する金属膜を形
成する。そして、大きい膜厚を有する金属膜に対して無
電解Niメッキと無電解Auメッキとを順次行った後
に、レジストを溶融して除去する。その後にエッチング
液に浸漬して、金属薄膜層を溶かし、かつ大きい膜厚を
有する金属膜のみを残すことによって、半導体チップ1
0の表面において電極11に接続された所定の金属配線
30を形成する。
は、形成された金属薄膜層からなる放熱層31Aをその
まま全面に用いてもよく、表面の場合と同様に大きい膜
厚を有する金属膜を更に全面に形成してもよい。以上の
工程によって、本実施形態に係る半導体装置を得ること
ができる。
成を、以下のようにして行うこともできる。表面と裏面
との全面に金属膜を順次堆積させ、表面においてはその
上にレジストを塗布し、フォトリソグラフィー技術を使
用して所定のパターン部の上にエッチングマスク用レジ
ストを形成し、このレジストをマスクとして金属膜をエ
ッチングすることにより金属配線30を形成する。この
場合の裏面においては、堆積された金属膜をそのまま放
熱層31Aとして使用できる。以上の工程によっても、
本実施形態に係る半導体装置を得ることができる。
れば、半導体チップ10の表面に金属配線30を形成す
る工程の一部において、又は金属配線30を形成する工
程と同一の工程において、半導体チップ10の裏面に放
熱層31Aを形成する。したがって、金属配線30を形
成する工程において半導体チップ10の裏面に放熱層3
1Aを同時に形成でき、かつ放熱フィンを接着する必要
がないので、放熱性及び量産性が良好で材料コストと製
造工数とが削減された半導体装置を実現することができ
る。
層20を形成するために、感光性と絶縁性とを有する樹
脂を塗布したが、これに限らず、予めフィルム状に形成
された、感光性を有する絶縁材料を使用してもよい。こ
の場合には、フィルム状の絶縁材料を半導体チップ10
の表面上に貼り合わせた後に露光、現像して、半導体チ
ップ10の電極11を露出させる。
る。この場合には、レーザーやプラズマ等の機械的加
工、又はエッチング等の化学的加工によって、半導体チ
ップ10の電極11を露出させる。
態に係る半導体装置について、図2を参照しながら説明
する。図2は、本実施形態に係る半導体装置を示す断面
図である。第1の実施形態と同一の構成要素に対しては
図1における符号と同一の符号を付して、その説明を省
略する。
0の一部からなり、半導体チップ10と外部装置(図示
せず)との間で信号を授受するための外部電極端子であ
る。ソルダーレジスト40は、半導体チップ10の表面
において、少なくともランド32の部分を開口し、ラン
ド32以外の金属配線30の部分をすべて覆うように形
成された絶縁性物質である。金属ボール50は、ランド
32上に設けられた突起状電極である。つまり、本実施
形態においては、ランド32上に設けられた金属ボール
50を介して半導体チップ10と外部装置(図示せず)
とが接続され、かつ、金属配線30のランド32以外の
部分はソルダーレジスト40によって覆われている。
様に、金属配線30を形成する工程において半導体チッ
プ10の裏面に放熱層31Aを同時に形成でき、かつ放
熱フィンを接着する必要がないので、放熱性及び量産性
が良好で材料コストと製造工数とが削減された半導体装
置を実現することができる。
プ10と外部装置(図示せず)とをより確実に接続し、
かつ、ソルダーレジスト40によって後工程のハンダ付
等における金属配線30同士の短絡や断線等を防止する
ので、高い信頼性を有する半導体装置を実現することが
できる。
態に係る半導体装置について、図3を参照しながら説明
する。図3は、本実施形態に係る半導体装置を示す断面
図である。第1の実施形態と同一の構成要素に対しては
図1における符号と同一の符号を付して、その説明を省
略する。
体チップの裏面に設けられ、凹凸を有する絶縁性物質で
ある。放熱層31Bは、絶縁性樹脂層21上に設けら
れ、半導体チップ10が有するトランジスタ等が生成し
た熱を放出するための放熱手段である。つまり、凹凸を
有する絶縁性樹脂層21上に設けられた放熱層31B
は、平坦な樹脂層の上に設けられた場合と比較して大き
な表面積を有している。
法について図3を参照しながら説明する。
上に、感光性及び絶縁性を有する樹脂をそれぞれ塗布し
て乾燥させる。その後に、第1の実施形態と同様に、電
極11が形成された面、つまり表面の樹脂に対して露光
と現像とを順次行うことにより、電極11の部分が開口
した絶縁性樹脂層20を形成する。一方、裏面の樹脂に
対しては、表面の場合とは異なる条件によって、例えば
裏面において部分的に露光時間を異ならせて露光と現像
とを順次行うことにより、凹凸を有する絶縁性樹脂層2
1を形成する。感光性と絶縁性とを有する樹脂として
は、例えば感光性を有するポリイミド、エポキシ等のよ
うな樹脂であればよい。
ップ10の表面と裏面との全面において、真空蒸着法、
スパッタリング法、CVD法又は無電解メッキ法によっ
て例えばCuからなる金属薄膜層を形成した後に、該金
属薄膜層に対してパターニングを行う。このことによっ
て、半導体チップ10の表面においては金属配線30が
形成され、裏面においては凹凸を有する絶縁性樹脂層2
1上に放熱層31Bが形成される。以上の工程によっ
て、本実施形態に係る半導体装置を得ることができる。
と同様に、本実施形態によれば、半導体チップ10の表
面に金属配線30を形成する工程の一部において、又は
金属配線30を形成する工程と同一の工程において、半
導体チップ10の裏面上に放熱層31Bを形成する。し
たがって、金属配線30を形成する工程において半導体
チップ10の裏面に放熱層31Bを同時に形成でき、か
つ放熱フィンを接着する必要がないので、放熱性及び量
産性が良好で材料コストと製造工数とが削減された半導
体装置を実現することができる。
1上の放熱層31Bが大きな表面積を有することによ
り、トランジスタ等が生成した熱をいっそう効率よく放
出する半導体装置を実現することができる。
を有する絶縁性樹脂層21を、感光性と絶縁性とを有す
る樹脂に対して露光と現像とを順次行って形成した。こ
れに限らず、絶縁性を有する樹脂上にマスクを設けて、
エッチングやO2 プラズマ等による化学的加工、又はレ
ーザーやサンドブラスト等による物理的加工を使用して
凹凸を形成してもよい。
からなる基板自体の裏面にエッチング等によって凹凸を
形成し、その凹凸の上に放熱層を形成してもよい。この
場合においても、放熱フィンを接着する必要がないの
で、材料コストと製造工数とを削減できる。更に、半導
体チップの裏面に設けられた凹凸の上に形成された放熱
層によって、よりいっそう良好な放熱性を有する半導体
装置を実現できる。
代わりに、1枚の例えばSiからなる基板、つまりウェ
ハが有する複数の半導体チップに対して、表面に絶縁性
樹脂層20と金属配線30とをそれぞれ一括して順次形
成し、かつ、裏面に放熱層31Aを一括して形成するこ
ともできる。
チップに対して、表面に絶縁性樹脂層20と金属配線3
0とをそれぞれ一括して順次形成し、かつ、裏面に凹凸
を有する絶縁性樹脂層21と放熱層31Bとをそれぞれ
一括して順次形成することもできる。
けられた1枚のウェハが有する複数の半導体チップに対
して、表面に絶縁性樹脂層20と金属配線30とをそれ
ぞれ一括して順次形成し、かつ、裏面に放熱層を一括し
て形成することもできる。
形成し、更に所定の工程を行った後にウェハを各半導体
チップに分割して、第1〜第3の実施形態で説明した半
導体チップを得ることができる。このように、ウェハ状
態において複数の半導体チップに対して放熱層を一括し
て形成することにより、量産性を更に向上させてウェハ
状の半導体装置を実現でき、その後に半導体装置から複
数の半導体チップを製造することができる。
は、金属薄膜層としてCuを使用したが、これに代えて
Ti/Cu、Cr、W、Cu、Ni等を使用してもよ
い。
膜に無電解Niメッキと無電解Auメッキとを順次行っ
て形成したが、Cuからなる金属膜にNiとPdとを順
次メッキして形成し、又はCuからなる金属膜にNiと
PdとAuとを順次メッキして形成することもできる。
らなるウェハ自体の裏面に、以下のようにして放熱層を
形成してもよい。まず、表面と裏面とに、つまり両面に
金属薄膜層からなる全面パターンを同時に形成する。次
に、両面においてメッキレジストによるレジストパター
ンを形成する。次に、両面において大きい膜厚を有する
金属膜からなるパターンを同時に形成する。このことに
より、表面では金属配線を、裏面ではチェッカー状、フ
ィン状等の凹凸を有するパターンを同時に形成できる。
次に、両面においてレジストパターンを溶融除去する。
次に、表面のみをエッチングし、又は裏面の全面にエッ
チングレジストを形成した後に両面をエッチングして、
表面の金属薄膜層のみを除去する。以上の各工程によっ
て、表面には金属パターンが、裏面には金属薄膜層とそ
の上の部分的な金属膜からなる放熱層が形成される。し
たがって、半導体チップ10自体の裏面又はウェハ自体
の裏面に、凹凸を有し金属からなる放熱層が直接形成さ
れるので、より少ない製造工数でいっそう優れた放熱性
を有する半導体装置が実現される。
ップの第1の面上に形成された配線パターンを構成する
金属を含む放熱層が第2の面上に形成されることによ
り、半導体装置が実現される。したがって、放熱フィン
に代えて、配線パターンを形成する工程において同時に
形成された放熱層を介して熱が放出されるので、半導体
装置の材料コストと製造工数とを削減し、かつ放熱性を
改善できる。
法によって容易に実現できる。
体装置の第1の面上に形成された配線パターンを構成す
る金属を含む放熱層が第2の面上に形成されることによ
り、半導体装置が実現される。
熱フィンに代えて、ウェハ状態において配線パターンを
形成する工程において同時に形成された放熱層を介して
熱が放出されるので、半導体装置の材料コストを削減
し、製造工数を大幅に削減し、かつ放熱性を改善でき
る。
法によって容易に実現できる。
す断面図である。
す断面図である。
す断面図である。
Claims (12)
- 【請求項1】 第1の面及び第2の面を有する半導体チ
ップと、 前記第1の面上に形成され少なくとも1種類の金属から
なる配線パターンと、 前記第2の面上に形成され前記配線パターンを構成する
少なくとも1種類の金属を含む放熱層とを備えたことを
特徴とする半導体装置。 - 【請求項2】 第1の面及び第2の面を有する半導体チ
ップと、 前記第1の面上に形成され少なくとも1種類の金属から
なる配線パターンと、 前記第2の面上に形成され凹凸を有する絶縁性樹脂層
と、 前記凹凸を有する絶縁性樹脂層の上に形成され前記配線
パターンを構成する少なくとも1種類の金属を含む放熱
層とを備えたことを特徴とする半導体装置。 - 【請求項3】 請求項1又は2記載の半導体装置におい
て、 前記第1の面上に形成された絶縁性樹脂層を更に備え、 前記配線パターンの少なくとも一部は前記絶縁性樹脂層
の上に形成されたことを特徴とする半導体装置。 - 【請求項4】 請求項1〜3のいずれか1つに記載の半
導体装置において、 前記放熱層は少なくともCuからなる層を備えたことを
特徴とする半導体装置。 - 【請求項5】 配線パターンを持つ第1の面及び凹凸を
持つ第2の面を有する半導体チップと、 前記第1の面上に形成され少なくとも1種類の金属から
なる配線パターンと、 前記凹凸を持つ第2の面上に形成され前記配線パターン
を構成する少なくとも1種類の金属を含む放熱層とを備
えたことを特徴とする半導体装置。 - 【請求項6】 第1の面及び第2の面を有し、該第1の
面上に複数個のチップ領域を有するウェハ状の半導体装
置であって、 前記各チップ領域に形成され少なくとも1種類の金属か
らなる配線パターンと、 前記第2の面のうち各チップ領域に対向する領域に形成
され前記配線パターンを構成する少なくとも1種類の金
属を含む放熱層とを備えたことを特徴とする半導体装
置。 - 【請求項7】 第1の面及び第2の面を有する半導体装
置の製造方法であって、 前記第1の面上に第1の金属層を形成する工程と、 前記第1の金属層をパターニングして配線パターンを形
成する工程と、 前記第1の金属層を形成する工程の少なくとも一部と同
時に前記第2の面上に放熱層となる第2の金属層を形成
する工程とを備えたことを特徴とする半導体装置の製造
方法。 - 【請求項8】 第1の面及び第2の面を有する半導体装
置の製造方法であって、 前記第1の面上に第1の金属層を形成する工程と、 前記第1の金属層をパターニングして配線パターンを形
成する工程と、 前記第2の面上に絶縁性樹脂層を形成する工程と、 前記絶縁性樹脂層の表面に凹凸を形成する工程と、 前記第1の金属層を形成する工程の少なくとも一部と同
時に前記凹凸が形成された絶縁性樹脂層の上に放熱層と
なる第2の金属層を形成する工程とを備えたことを特徴
とする半導体装置の製造方法。 - 【請求項9】 第1の面及び第2の面を有する半導体装
置の製造方法であって、 前記第2の面に凹凸を形成する工程と、 前記第1の面上に第1の金属層を形成する工程と、 前記第1の金属層をパターニングして配線パターンを形
成する工程と、 前記第1の金属層を形成する工程の少なくとも一部と同
時に前記凹凸が形成された第2の面上に放熱層となる第
2の金属層を形成する工程とを備えたことを特徴とする
半導体装置の製造方法。 - 【請求項10】 第1の面及び第2の面を有し、該第1
の面上に複数個のチップ領域を有するウェハ状の半導体
装置の製造方法であって、 前記各チップ領域の上に第1の金属層を形成する工程
と、 前記第1の金属層をパターニングして配線パターンを形
成する工程と、 前記第1の金属層を形成する工程の少なくとも一部と同
時に前記第2の面のうち前記各チップ領域に対向する領
域の上に放熱層となる第2の金属層を形成する工程とを
備えたことを特徴とする半導体装置の製造方法。 - 【請求項11】 第1の面及び第2の面を有し、該第1
の面上に複数個のチップ領域を有するウェハ状の半導体
装置の製造方法であって、 前記各チップ領域の上に第1の金属層を形成する工程
と、 前記第1の金属層をパターニングして配線パターンを形
成する工程と、 前記第2の面のうち前記各チップ領域に対向する領域の
上に絶縁性樹脂層を形成する工程と、 前記絶縁性樹脂層の表面に凹凸を形成する工程と、 前記第1の金属層を形成する工程の少なくとも一部と同
時に前記凹凸が形成された絶縁性樹脂層の上に放熱層と
なる第2の金属層を形成する工程とを備えたことを特徴
とする半導体装置の製造方法。 - 【請求項12】 第1の面及び第2の面を有し、該第1
の面上に複数個のチップ領域を有するウェハ状の半導体
装置の製造方法であって、 前記第2の面に凹凸を形成する工程と、 前記各チップ領域の上に第1の金属層を形成する工程
と、 前記第1の金属層をパターニングして配線パターンを形
成する工程と、 前記第1の金属層を形成する工程の少なくとも一部と同
時に前記凹凸が形成された第2の面のうち前記各チップ
領域に対向する領域の上に放熱層となる第2の金属層を
形成する工程とを備えたことを特徴とする半導体装置の
製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP02531698A JP3410651B2 (ja) | 1998-02-06 | 1998-02-06 | 半導体装置及びその製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP02531698A JP3410651B2 (ja) | 1998-02-06 | 1998-02-06 | 半導体装置及びその製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH11224924A true JPH11224924A (ja) | 1999-08-17 |
JP3410651B2 JP3410651B2 (ja) | 2003-05-26 |
Family
ID=12162599
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP02531698A Expired - Fee Related JP3410651B2 (ja) | 1998-02-06 | 1998-02-06 | 半導体装置及びその製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3410651B2 (ja) |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008053693A (ja) * | 2006-07-28 | 2008-03-06 | Sanyo Electric Co Ltd | 半導体モジュール、携帯機器、および半導体モジュールの製造方法 |
WO2009034846A1 (ja) * | 2007-09-13 | 2009-03-19 | Omron Corporation | 発熱部を有する装置 |
JP2009224783A (ja) * | 2008-03-17 | 2009-10-01 | Robert Bosch Gmbh | 半導体構成素子を備える装置、および半導体構成素子を備える装置の製造方法 |
JP2013518443A (ja) * | 2010-01-26 | 2013-05-20 | クアルコム,インコーポレイテッド | 熱管理のための微細加工されたピラーフィン |
WO2020071074A1 (ja) * | 2018-10-04 | 2020-04-09 | 日立化成株式会社 | 装置及び放熱方法 |
-
1998
- 1998-02-06 JP JP02531698A patent/JP3410651B2/ja not_active Expired - Fee Related
Cited By (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008053693A (ja) * | 2006-07-28 | 2008-03-06 | Sanyo Electric Co Ltd | 半導体モジュール、携帯機器、および半導体モジュールの製造方法 |
WO2009034846A1 (ja) * | 2007-09-13 | 2009-03-19 | Omron Corporation | 発熱部を有する装置 |
JP2009071039A (ja) * | 2007-09-13 | 2009-04-02 | Omron Corp | 発熱部を有する装置 |
KR101102632B1 (ko) | 2007-09-13 | 2012-01-04 | 오므론 가부시키가이샤 | 발열부를 갖는 장치 |
US8581156B2 (en) | 2007-09-13 | 2013-11-12 | Omron Corporation | Apparatus with heating part |
JP2009224783A (ja) * | 2008-03-17 | 2009-10-01 | Robert Bosch Gmbh | 半導体構成素子を備える装置、および半導体構成素子を備える装置の製造方法 |
JP2013518443A (ja) * | 2010-01-26 | 2013-05-20 | クアルコム,インコーポレイテッド | 熱管理のための微細加工されたピラーフィン |
US8877563B2 (en) | 2010-01-26 | 2014-11-04 | Qualcomm Incorporated | Microfabricated pillar fins for thermal management |
WO2020071074A1 (ja) * | 2018-10-04 | 2020-04-09 | 日立化成株式会社 | 装置及び放熱方法 |
CN112888759A (zh) * | 2018-10-04 | 2021-06-01 | 昭和电工材料株式会社 | 装置及散热方法 |
Also Published As
Publication number | Publication date |
---|---|
JP3410651B2 (ja) | 2003-05-26 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP4895054B2 (ja) | 電子部品の実装方法 | |
JP3297879B2 (ja) | 連続して形成した集積回路パッケージ | |
US6406942B2 (en) | Flip chip type semiconductor device and method for manufacturing the same | |
JPH11163022A (ja) | 半導体装置、その製造方法及び電子機器 | |
JP2002184904A (ja) | 半導体装置の製造方法及び半導体装置 | |
US7222419B2 (en) | Method of fabricating a ceramic substrate with a thermal conductive plug of a multi-chip package | |
JP2003197856A (ja) | 半導体装置 | |
JP2004079716A (ja) | 半導体用csp型パッケージ及びその製造方法 | |
JP3524441B2 (ja) | 配線形成方法 | |
JP2001024089A (ja) | システム半導体装置及びシステム半導体装置の製造方法 | |
US6562656B1 (en) | Cavity down flip chip BGA | |
JPH11204678A (ja) | 半導体装置及びその製造方法 | |
JPH08111587A (ja) | 配線板構造及びその製造方法並びに半導体装置 | |
JP4513973B2 (ja) | 半導体装置の製造方法 | |
JP3158073B2 (ja) | 電子素子のパッケージ方法および電子素子パッケージ | |
JP2001250902A (ja) | 半導体パッケージ及びその製造方法 | |
JPH11224924A (ja) | 半導体装置及びその製造方法 | |
JPH11204560A (ja) | 半導体装置及びその製造方法 | |
JP3618044B2 (ja) | 多層薄膜配線基板 | |
JP3281591B2 (ja) | 半導体装置およびその製造方法 | |
JP3173488B2 (ja) | 半導体集積回路装置及びその製造方法 | |
JP2004207267A (ja) | 半導体装置及びその製造方法 | |
JPH11204519A (ja) | 半導体装置及びその製造方法 | |
JPH11307694A (ja) | 半導体装置およびその製造方法 | |
JP7192523B2 (ja) | 半導体パッケージ及び電子装置 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20030304 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080320 Year of fee payment: 5 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090320 Year of fee payment: 6 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100320 Year of fee payment: 7 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110320 Year of fee payment: 8 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110320 Year of fee payment: 8 |
|
LAPS | Cancellation because of no payment of annual fees |