JPH1079905A - ディジタルディスプレイ装置の画像サイズ調整方法及びその画像サイズ調整回路 - Google Patents
ディジタルディスプレイ装置の画像サイズ調整方法及びその画像サイズ調整回路Info
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- JPH1079905A JPH1079905A JP9176875A JP17687597A JPH1079905A JP H1079905 A JPH1079905 A JP H1079905A JP 9176875 A JP9176875 A JP 9176875A JP 17687597 A JP17687597 A JP 17687597A JP H1079905 A JPH1079905 A JP H1079905A
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- 238000005070 sampling Methods 0.000 claims description 19
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- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G1/00—Control arrangements or circuits, of interest only in connection with cathode-ray tube indicators; General aspects or details, e.g. selection emphasis on particular characters, dashed line or dotted line generation; Preprocessing of data
- G09G1/06—Control arrangements or circuits, of interest only in connection with cathode-ray tube indicators; General aspects or details, e.g. selection emphasis on particular characters, dashed line or dotted line generation; Preprocessing of data using single beam tubes, e.g. three-dimensional or perspective representation, rotation or translation of display pattern, hidden lines, shadows
- G09G1/08—Control arrangements or circuits, of interest only in connection with cathode-ray tube indicators; General aspects or details, e.g. selection emphasis on particular characters, dashed line or dotted line generation; Preprocessing of data using single beam tubes, e.g. three-dimensional or perspective representation, rotation or translation of display pattern, hidden lines, shadows the beam directly tracing characters, the information to be displayed controlling the deflection and the intensity as a function of time in two spatial co-ordinates, e.g. according to a cartesian co-ordinate system
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G5/00—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators
- G09G5/003—Details of a display terminal, the details relating to the control arrangement of the display terminal and to the interfaces thereto
- G09G5/005—Adapting incoming signals to the display format of the display terminal
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- G06—COMPUTING; CALCULATING OR COUNTING
- G06T—IMAGE DATA PROCESSING OR GENERATION, IN GENERAL
- G06T3/00—Geometric image transformations in the plane of the image
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- G09G2340/00—Aspects of display data processing
- G09G2340/04—Changes in size, position or resolution of an image
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- Controls And Circuits For Display Device (AREA)
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Liquid Crystal Display Device Control (AREA)
- Transforming Electric Information Into Light Information (AREA)
- Video Image Reproduction Devices For Color Tv Systems (AREA)
Abstract
(57)【要約】
【課題】 ディジタルディスプレイ装置に表示される画
像の大きさを容易に拡大縮小する方法及びその装置の提
供。 【解決手段】 水平方向での画像拡縮は、外部制御信号
の値を変更して水平同期信号を逓倍して得たサンプリン
グクロックの周波数を可変とし、且つ、該サンプリング
クロックをメモリの書き込みエネーブル信号とすること
で、水平同期信号の１周期でメモリへ書き込む１走査ラ
イン当たりのディジタル映像信号のデータ量を変更させ
て行なう。垂直方向の拡縮は、サンプリングクロック
（書き込みエネーブル信号）より周波数の高い他のクロ
ックを読出しエネーブル信号としてディジタル映像信号
を複数回読出し、複数の走査ライン上に表示する。
像の大きさを容易に拡大縮小する方法及びその装置の提
供。 【解決手段】 水平方向での画像拡縮は、外部制御信号
の値を変更して水平同期信号を逓倍して得たサンプリン
グクロックの周波数を可変とし、且つ、該サンプリング
クロックをメモリの書き込みエネーブル信号とすること
で、水平同期信号の１周期でメモリへ書き込む１走査ラ
イン当たりのディジタル映像信号のデータ量を変更させ
て行なう。垂直方向の拡縮は、サンプリングクロック
（書き込みエネーブル信号）より周波数の高い他のクロ
ックを読出しエネーブル信号としてディジタル映像信号
を複数回読出し、複数の走査ライン上に表示する。
Description
【０００１】
【発明の属する技術分野】本発明はＬＣＤ（Liquid Cry
stal Display）モニタその他のディジタルディスプレイ
装置に関し、特に水平及び垂直方向で画像（映像）サイ
ズを変更・調整する装置に関する。
stal Display）モニタその他のディジタルディスプレイ
装置に関し、特に水平及び垂直方向で画像（映像）サイ
ズを変更・調整する装置に関する。
【０００２】
【従来の技術】一般的に、ＣＲＴディスプレイ装置で水
平方向及び垂直方向に画像サイズを調整するには、水平
及び垂直偏向ヨークを流れる偏向電流の電流量を制御す
る方式が採られている。
平方向及び垂直方向に画像サイズを調整するには、水平
及び垂直偏向ヨークを流れる偏向電流の電流量を制御す
る方式が採られている。
【０００３】しかしながら、ディジタルビデオ信号によ
り駆動されるＬＣＤやＬＥＤ等のディジタルディスプレ
イ装置にあっては、構造上の相違から上記のような方式
で画像サイズを調整することは不可能であり、ディジタ
ルビデオ信号に特有の信号処理が必要とされる。
り駆動されるＬＣＤやＬＥＤ等のディジタルディスプレ
イ装置にあっては、構造上の相違から上記のような方式
で画像サイズを調整することは不可能であり、ディジタ
ルビデオ信号に特有の信号処理が必要とされる。
【０００４】
【発明が解決使用とする課題】そこで、本発明は、ディ
スプレイ装置の利用者がディジタルディスプレイ装置で
画像サイズを容易に変更・調整できるような技術の提供
を目的としている。
スプレイ装置の利用者がディジタルディスプレイ装置で
画像サイズを容易に変更・調整できるような技術の提供
を目的としている。
【０００５】
【課題を解決するための手段】この目的のために本発明
は、アナログ映像信号を所定のサンプリングクロックで
ディジタル映像信号に変換してメモリに書き込んだ後、
走査ライン毎に読み出して画像表示を行なうディジタル
ディスプレイ装置の画像サイズ調整方法について、外部
制御信号の値を変更して水平同期信号を逓倍して得たサ
ンプリングクロックの周波数を可変とし、且つ、該サン
プリングクロックをメモリの書き込みエネーブル信号と
することで、水平同期信号の１周期でメモリへ書き込む
１走査ライン当たりのディジタル映像信号のデータ量を
変更させることを特徴とする。
は、アナログ映像信号を所定のサンプリングクロックで
ディジタル映像信号に変換してメモリに書き込んだ後、
走査ライン毎に読み出して画像表示を行なうディジタル
ディスプレイ装置の画像サイズ調整方法について、外部
制御信号の値を変更して水平同期信号を逓倍して得たサ
ンプリングクロックの周波数を可変とし、且つ、該サン
プリングクロックをメモリの書き込みエネーブル信号と
することで、水平同期信号の１周期でメモリへ書き込む
１走査ライン当たりのディジタル映像信号のデータ量を
変更させることを特徴とする。
【０００６】また、上記調整方法は、ディジタル映像信
号に含まれる走査ライン毎のＲ，Ｇ，Ｂ信号を、水平同
期信号の１周期毎に、該Ｒ，Ｇ，Ｂ信号それぞれについ
て設けた複数のメモリへ順に書き込むようにすると好ま
しい。
号に含まれる走査ライン毎のＲ，Ｇ，Ｂ信号を、水平同
期信号の１周期毎に、該Ｒ，Ｇ，Ｂ信号それぞれについ
て設けた複数のメモリへ順に書き込むようにすると好ま
しい。
【０００７】さらに、以上の調整方法は、書き込みエネ
ーブル信号としたサンプリングクロック又は該サンプリ
ングクロックよりも周波数の高い他のクロックの何れか
を一方をメモリの読出しエネーブル信号として選択可能
として、該他のクロックによりメモリに書き込んだディ
ジタル映像信号を複数回読出し、複数の走査ライン上に
表示するようにすると好ましい。
ーブル信号としたサンプリングクロック又は該サンプリ
ングクロックよりも周波数の高い他のクロックの何れか
を一方をメモリの読出しエネーブル信号として選択可能
として、該他のクロックによりメモリに書き込んだディ
ジタル映像信号を複数回読出し、複数の走査ライン上に
表示するようにすると好ましい。
【０００８】そして、上記調整方法は、外部制御信号に
より水平同期信号の周波数を所定の倍率で逓倍した信号
か又は該逓倍した信号を分周した信号の何れかと選択的
に同期してメモリのディジタル映像信号を読み出すよう
にすると好ましい。
より水平同期信号の周波数を所定の倍率で逓倍した信号
か又は該逓倍した信号を分周した信号の何れかと選択的
に同期してメモリのディジタル映像信号を読み出すよう
にすると好ましい。
【０００９】また、本発明は以上の画像サイズの調整方
法を実施するハード的構成として次のような手段を提供
する。即ち、本発明は、アナログ映像信号を所定のサン
プリングクロックでディジタル変換するアナログ−ディ
ジタル変換器と、これにより得たディジタル映像信号を
記憶するメモリと、を備えるディジタルディスプレイ装
置の画像サイズ調整回路について、外部制御信号の値を
変更して該映像信号の水平同期信号の周波数を可変とし
てアナログ−デジタル変換器のサンプリング入力とメモ
リの書き込みエネーブル端子とにそれぞれ接続した周波
数逓倍回路と、水平同期信号と同期して所定のメモリへ
書き込むディジタル映像信号の書込み経路を開閉する入
力スイッチング回路と、を設け、水平同期信号の１周期
で書込み経路を閉じている間に、ディジタル映像信号の
１走査ライン分のデータ量を変更してメモリに書き込む
ことを特徴とする。これによれば、外部制御信号の値を
変更してサンプリング周波数を変更することで、水平同
期信号の１周期で得られる１入力走査ライン分のディジ
タル映像信号のデータ量を変更することが可能となり、
１出力走査ラインで使用する画素数を増減変更して画像
の拡大縮小が可能となる。
法を実施するハード的構成として次のような手段を提供
する。即ち、本発明は、アナログ映像信号を所定のサン
プリングクロックでディジタル変換するアナログ−ディ
ジタル変換器と、これにより得たディジタル映像信号を
記憶するメモリと、を備えるディジタルディスプレイ装
置の画像サイズ調整回路について、外部制御信号の値を
変更して該映像信号の水平同期信号の周波数を可変とし
てアナログ−デジタル変換器のサンプリング入力とメモ
リの書き込みエネーブル端子とにそれぞれ接続した周波
数逓倍回路と、水平同期信号と同期して所定のメモリへ
書き込むディジタル映像信号の書込み経路を開閉する入
力スイッチング回路と、を設け、水平同期信号の１周期
で書込み経路を閉じている間に、ディジタル映像信号の
１走査ライン分のデータ量を変更してメモリに書き込む
ことを特徴とする。これによれば、外部制御信号の値を
変更してサンプリング周波数を変更することで、水平同
期信号の１周期で得られる１入力走査ライン分のディジ
タル映像信号のデータ量を変更することが可能となり、
１出力走査ラインで使用する画素数を増減変更して画像
の拡大縮小が可能となる。
【００１０】上記周波数逓倍回路は、位相同期ループ
と、位相同期ループの出力を分周する分周回路と、外部
制御信号の値を変更して分周率を可変とし且つ前記分周
回路の出力を分周する他の分周回路と、を備えると好ま
しい。これによれば外部制御信号の値を、例えばマイコ
ン等により変更して１出力走査ラインで使用する画素数
を加減することが可能となる。
と、位相同期ループの出力を分周する分周回路と、外部
制御信号の値を変更して分周率を可変とし且つ前記分周
回路の出力を分周する他の分周回路と、を備えると好ま
しい。これによれば外部制御信号の値を、例えばマイコ
ン等により変更して１出力走査ラインで使用する画素数
を加減することが可能となる。
【００１１】また、上記調整装置は、位相同期ループの
出力か分周回路の出力かの何れかをメモリの読出しエネ
ーブル信号として選択するセレクタを備えるのが好まし
い。これによれば、位相同期ループの出力を選択した場
合には複数の出力走査ラインに対して１入力走査ライン
のディジタル映像信号を出力して画像の垂直方向での拡
大・縮小表示が可能である。
出力か分周回路の出力かの何れかをメモリの読出しエネ
ーブル信号として選択するセレクタを備えるのが好まし
い。これによれば、位相同期ループの出力を選択した場
合には複数の出力走査ラインに対して１入力走査ライン
のディジタル映像信号を出力して画像の垂直方向での拡
大・縮小表示が可能である。
【００１２】さらに、上記調整装置は、読出しエネーブ
ル信号と同期して所定のメモリに書き込んだディジタル
映像信号の読出し経路を開閉する出力スイッチング回路
を備えるとより好ましい。
ル信号と同期して所定のメモリに書き込んだディジタル
映像信号の読出し経路を開閉する出力スイッチング回路
を備えるとより好ましい。
【００１３】上記メモリには、ディジタル映像信号に含
まれるＲ，Ｇ，Ｂ信号をそれぞれ記憶するラインメモリ
群が複数設けられると共に、前記入力及び出力スイッチ
ング回路によりラインメモリ群を選択して書き込み及び
読出しを行なうとより好ましい。これによれば、１走査
ライン分のディジタル映像信号を２つ以上のラインメモ
リに分割して高速性に優れた効率的な書き込み読出し動
作が可能である。
まれるＲ，Ｇ，Ｂ信号をそれぞれ記憶するラインメモリ
群が複数設けられると共に、前記入力及び出力スイッチ
ング回路によりラインメモリ群を選択して書き込み及び
読出しを行なうとより好ましい。これによれば、１走査
ライン分のディジタル映像信号を２つ以上のラインメモ
リに分割して高速性に優れた効率的な書き込み読出し動
作が可能である。
【００１４】
【発明の実施の形態】以下、本発明の一実施形態につい
て説明する。図１は、本実施形態による画像サイズ調整
回路の構成を示し、プログラム可能な分周器１３０を備
える周波数逓倍回路１００と、チャンネル当たり２つず
つ割り当てられた６つのラインメモリ５１０，５２０，
５３０，５４０，５５０，５６０により構成されるメモ
リ部５００とを備える。
て説明する。図１は、本実施形態による画像サイズ調整
回路の構成を示し、プログラム可能な分周器１３０を備
える周波数逓倍回路１００と、チャンネル当たり２つず
つ割り当てられた６つのラインメモリ５１０，５２０，
５３０，５４０，５５０，５６０により構成されるメモ
リ部５００とを備える。
【００１５】周波数逓倍回路１００は、位相同期ループ
１１０と、このループの出力信号Ｄclk1の周波数を１／
２倍に分周して得られる周波数ｆout2の信号Ｄclk2を出
力する分周器１２０と、この分周器１２０の出力信号Ｄ
clk2をさらに１／ｎ倍に分周して得られる周波数ｆref
の信号ＣＬＫREF を出力するプログラム可能な分周器１
３０とで構成される。該分周器１３０の分周率（ｎの
値）は、外部から入力される画像の水平方向のサイズを
決めるｍビットのデータ信号Ｈsizeのデータ値に応じて
決定され、このデータ信号Ｈsizeはディジタルディスプ
レイを制御するマイコン或いはマイクロプロセッサ等の
システム制御系（図示略）から提供される。
１１０と、このループの出力信号Ｄclk1の周波数を１／
２倍に分周して得られる周波数ｆout2の信号Ｄclk2を出
力する分周器１２０と、この分周器１２０の出力信号Ｄ
clk2をさらに１／ｎ倍に分周して得られる周波数ｆref
の信号ＣＬＫREF を出力するプログラム可能な分周器１
３０とで構成される。該分周器１３０の分周率（ｎの
値）は、外部から入力される画像の水平方向のサイズを
決めるｍビットのデータ信号Ｈsizeのデータ値に応じて
決定され、このデータ信号Ｈsizeはディジタルディスプ
レイを制御するマイコン或いはマイクロプロセッサ等の
システム制御系（図示略）から提供される。
【００１６】位相同期ループ１１０は、図１で示すよう
に、位相検出器(Phase Detector ；ＰＤ）１１１と、低
域通過フィルタ（ＬＰＦ）１１２と、電圧制御発振器
（ＶＣＯ）１１３で構成される。周波数逓倍回路１００
の入力端子、即ち位相検出器１１１には映像信号の水平
同期信号Ｈsyncが入力される。同様に位相検出器１１１
の他入力端子には、分周器１３０の出力信号ＣＬＫREF
が入力されて、該位相同期ループ１１０は２つの分周器
１２０，１３０を通じるフィードバックループを構成し
ている。これにより位相同期ループ１１０は、捕捉範囲
（capture range）内で受信した水平同期信号Ｈsyncの
周波数と分周器１３０の出力信号ＣＬＫRE F の周波数ｆ
ref とを比較して、一定の周波数ｆin×２×Ｎ（Ｎはデ
ータ信号Ｈsizeのデータ値）となる周波数ｆout1をもつ
出力信号Ｄclk1を出力する。
に、位相検出器(Phase Detector ；ＰＤ）１１１と、低
域通過フィルタ（ＬＰＦ）１１２と、電圧制御発振器
（ＶＣＯ）１１３で構成される。周波数逓倍回路１００
の入力端子、即ち位相検出器１１１には映像信号の水平
同期信号Ｈsyncが入力される。同様に位相検出器１１１
の他入力端子には、分周器１３０の出力信号ＣＬＫREF
が入力されて、該位相同期ループ１１０は２つの分周器
１２０，１３０を通じるフィードバックループを構成し
ている。これにより位相同期ループ１１０は、捕捉範囲
（capture range）内で受信した水平同期信号Ｈsyncの
周波数と分周器１３０の出力信号ＣＬＫRE F の周波数ｆ
ref とを比較して、一定の周波数ｆin×２×Ｎ（Ｎはデ
ータ信号Ｈsizeのデータ値）となる周波数ｆout1をもつ
出力信号Ｄclk1を出力する。
【００１７】アナログ−ディジタル変換器（以下、ＡＤ
変換器）２００の入力ポートには、信号入力端子１１，
１２，１３を通じて、アナログビデオ信号、即ちアナロ
グカラー信号Ｒａ，Ｇａ，Ｂａが印加される。ＡＤ変換
器２００は、このアナログカラー信号Ｒａ，Ｇａ，Ｂａ
を前記１／２分周器１２０の出力信号Ｄclk2をサンプリ
ングクロックとしてそれぞれディジタルカラー信号Ｒ
ｄ，Ｇｄ，Ｂｄに変換した後、出力ポート１４，１５，
１６を通じて入力スイッチング回路６００の各入力ポー
ト１７，１８，１９へ出力する。
変換器）２００の入力ポートには、信号入力端子１１，
１２，１３を通じて、アナログビデオ信号、即ちアナロ
グカラー信号Ｒａ，Ｇａ，Ｂａが印加される。ＡＤ変換
器２００は、このアナログカラー信号Ｒａ，Ｇａ，Ｂａ
を前記１／２分周器１２０の出力信号Ｄclk2をサンプリ
ングクロックとしてそれぞれディジタルカラー信号Ｒ
ｄ，Ｇｄ，Ｂｄに変換した後、出力ポート１４，１５，
１６を通じて入力スイッチング回路６００の各入力ポー
ト１７，１８，１９へ出力する。
【００１８】この入力スイッチング回路６００は、各デ
ィジタルカラー信号Ｒｄ，Ｇｄ，Ｂｄが８ビットの信号
である場合、２４個の１：２デマルチプレクサで構成さ
れる。各デマルチプレクサの制御入力、即ちスイッチン
グ回路６００の制御入力２０には、水平同期信号Ｈsync
が印加され、またその各出力ポート２１〜２６には、そ
れぞれラインメモリ５１０，５２０，５３０，５４０，
５５０，５６０と接続される。
ィジタルカラー信号Ｒｄ，Ｇｄ，Ｂｄが８ビットの信号
である場合、２４個の１：２デマルチプレクサで構成さ
れる。各デマルチプレクサの制御入力、即ちスイッチン
グ回路６００の制御入力２０には、水平同期信号Ｈsync
が印加され、またその各出力ポート２１〜２６には、そ
れぞれラインメモリ５１０，５２０，５３０，５４０，
５５０，５６０と接続される。
【００１９】メモリ部５００を構成するラインメモリ５
１０，５２０，５３０，５４０，５５０，５６０の書き
込みエネーブル端子３３〜３８は、１／２分周器１２０
の出力端子と接続されている。従って、この書き込みエ
ネーブル端子３３〜３８に入力される書き込みエネーブ
ル信号は、スイッチング回路６００の入力端子１７，１
８，１９に入力されるディジタルカラー信号Ｒｄ，Ｇ
ｄ，Ｂｄとスイッチング回路６００への制御入力２０で
ある水平同期信号ｆinとの双方と同期がとれた状態とさ
れて書き込み動作を行なうようになっている。このと
き、制御入力２０による入力ポート２１〜２６の選択は
次のようにして行なわれる。即ち、水平同期信号Ｈsync
がハイレベルとなる期間は、スイッチング回路６００が
入力ポート２１，２３，２５を選択する。そして、ＡＤ
変換器２００からのディジタルカラー信号Ｒｄ，Ｇｄ，
Ｂｄをメモリ部５００の第１のメモリ領域，即ちライン
メモリ５１０，５３０，５５０に書き込む。また、水平
同期信号Ｈsyncがロウレベルとなる期間では、スイッチ
ング回路６００が入力ポート２２，２４，２６を選択し
て、ディジタルカラー信号Ｒｄ，Ｇｄ，Ｂｄをメモリ部
５００の第２のメモリ領域，即ちラインメモリ５２０，
５４０，５６０へ書き込む。このようにして水平同期信
号Ｈsyncの１周期の間にメモリ部５００へ１走査ライン
（走査線）分のディジタルカラー信号Ｒｄ，Ｇｄ，Ｂｄ
が書き込まれる。
１０，５２０，５３０，５４０，５５０，５６０の書き
込みエネーブル端子３３〜３８は、１／２分周器１２０
の出力端子と接続されている。従って、この書き込みエ
ネーブル端子３３〜３８に入力される書き込みエネーブ
ル信号は、スイッチング回路６００の入力端子１７，１
８，１９に入力されるディジタルカラー信号Ｒｄ，Ｇ
ｄ，Ｂｄとスイッチング回路６００への制御入力２０で
ある水平同期信号ｆinとの双方と同期がとれた状態とさ
れて書き込み動作を行なうようになっている。このと
き、制御入力２０による入力ポート２１〜２６の選択は
次のようにして行なわれる。即ち、水平同期信号Ｈsync
がハイレベルとなる期間は、スイッチング回路６００が
入力ポート２１，２３，２５を選択する。そして、ＡＤ
変換器２００からのディジタルカラー信号Ｒｄ，Ｇｄ，
Ｂｄをメモリ部５００の第１のメモリ領域，即ちライン
メモリ５１０，５３０，５５０に書き込む。また、水平
同期信号Ｈsyncがロウレベルとなる期間では、スイッチ
ング回路６００が入力ポート２２，２４，２６を選択し
て、ディジタルカラー信号Ｒｄ，Ｇｄ，Ｂｄをメモリ部
５００の第２のメモリ領域，即ちラインメモリ５２０，
５４０，５６０へ書き込む。このようにして水平同期信
号Ｈsyncの１周期の間にメモリ部５００へ１走査ライン
（走査線）分のディジタルカラー信号Ｒｄ，Ｇｄ，Ｂｄ
が書き込まれる。
【００２０】図２は、以上のような本例の画像サイズ調
整回路で書き込みを行なったときに、水平サイズ制御信
号Ｈsizeのデータ値が５である場合のサンプリング周波
数（分周器１２０の出力信号Ｄclk2の周波数）と画像表
示に使用するピクセル数との概略的な関係を示し、同様
に図３は、水平サイズ制御信号Ｈsizeのデータ値が１０
である場合の該サンプリング周波数と該ピクセル数との
概略的な関係を示す図である。これらにより水平同期信
号Ｈsyncの１周期の間に出力されるピクセル数を比較す
ると、水平サイズ制御信号Ｈsizeのデータ値が１０の場
合は、水平サイズ制御信号Ｈsizeのデータ値が５の場合
と比べると、画像を表示するために利用する１走査ライ
ン当たりで使用するピクセル数（水平方向の画像サイ
ズ）が２倍となっているのが分かる。このように、水平
サイズ制御信号Ｈsizeのデータ値を変更することによっ
て、水平方向での画像サイズを調整することが可能であ
る。
整回路で書き込みを行なったときに、水平サイズ制御信
号Ｈsizeのデータ値が５である場合のサンプリング周波
数（分周器１２０の出力信号Ｄclk2の周波数）と画像表
示に使用するピクセル数との概略的な関係を示し、同様
に図３は、水平サイズ制御信号Ｈsizeのデータ値が１０
である場合の該サンプリング周波数と該ピクセル数との
概略的な関係を示す図である。これらにより水平同期信
号Ｈsyncの１周期の間に出力されるピクセル数を比較す
ると、水平サイズ制御信号Ｈsizeのデータ値が１０の場
合は、水平サイズ制御信号Ｈsizeのデータ値が５の場合
と比べると、画像を表示するために利用する１走査ライ
ン当たりで使用するピクセル数（水平方向の画像サイ
ズ）が２倍となっているのが分かる。このように、水平
サイズ制御信号Ｈsizeのデータ値を変更することによっ
て、水平方向での画像サイズを調整することが可能であ
る。
【００２１】また、タイミング発生回路４００は、位相
同期ループ１１０から出力されるクロック信号Ｄclk1に
同期して、図示せぬマイコンその他のシステム制御系に
より提供される垂直サイズ制御信号Ｖsizeのデータ値に
対応する選択制御信号ＳＥＬを発生し、これを出力スイ
ッチング回路７００に出力する。
同期ループ１１０から出力されるクロック信号Ｄclk1に
同期して、図示せぬマイコンその他のシステム制御系に
より提供される垂直サイズ制御信号Ｖsizeのデータ値に
対応する選択制御信号ＳＥＬを発生し、これを出力スイ
ッチング回路７００に出力する。
【００２２】出力スイッチング回路７００は、各ディジ
タルカラー信号Ｒｄ，Ｇｄ，Ｂｄが８ビット信号である
場合、２４個の２：１マルチプレクサで構成される。こ
のスイッチング回路７００の制御入力、即ち各マルチプ
レクサの制御入力５７には、前記選択制御信号ＳＥＬが
印加され、また各読出しポート５１〜５６は、それぞれ
ラインメモリ５１０，５２０，５３０，５４０，５５
０，５６０と接続される。そして、スイッチング回路７
００の出力ポート５８〜６０は、画像サイズ調整回路の
信号出力ポート６１〜６３に接続される。ラインメモリ
５１０，５２０，５３０，５４０，５５０，５６０の読
出しに当たっては、セレクタ３００の出力端子と接続さ
れ、読出しエネーブル端子３９〜４４に入力される読出
しエネーブル信号の入力により、タイミング発生回路４
００の選択制御信号ＳＥＬと同期して読出しを行なうよ
うになっている。このとき、制御入力による読出しポー
ト５１〜５６の選択は、例えば選択制御信号ＳＥＬがハ
イレベルの期間には、スイッチング回路７００によって
読出しポート５１，５３，５５が選択され、第１のメモ
リ領域、即ちラインメモリ５１０，５３０，５５０から
のデータを信号出力ポート６１，６２，６３から読み出
す。また、選択制御信号ＳＥＬがロウレベルの期間で
は、読出しポート５２，５４，５６が選択されて、第２
のメモリ領域、即ちラインメモリ５２０，５４０，５６
０から信号出力ポート６１，６２，６３へデータの読出
しを行なう。
タルカラー信号Ｒｄ，Ｇｄ，Ｂｄが８ビット信号である
場合、２４個の２：１マルチプレクサで構成される。こ
のスイッチング回路７００の制御入力、即ち各マルチプ
レクサの制御入力５７には、前記選択制御信号ＳＥＬが
印加され、また各読出しポート５１〜５６は、それぞれ
ラインメモリ５１０，５２０，５３０，５４０，５５
０，５６０と接続される。そして、スイッチング回路７
００の出力ポート５８〜６０は、画像サイズ調整回路の
信号出力ポート６１〜６３に接続される。ラインメモリ
５１０，５２０，５３０，５４０，５５０，５６０の読
出しに当たっては、セレクタ３００の出力端子と接続さ
れ、読出しエネーブル端子３９〜４４に入力される読出
しエネーブル信号の入力により、タイミング発生回路４
００の選択制御信号ＳＥＬと同期して読出しを行なうよ
うになっている。このとき、制御入力による読出しポー
ト５１〜５６の選択は、例えば選択制御信号ＳＥＬがハ
イレベルの期間には、スイッチング回路７００によって
読出しポート５１，５３，５５が選択され、第１のメモ
リ領域、即ちラインメモリ５１０，５３０，５５０から
のデータを信号出力ポート６１，６２，６３から読み出
す。また、選択制御信号ＳＥＬがロウレベルの期間で
は、読出しポート５２，５４，５６が選択されて、第２
のメモリ領域、即ちラインメモリ５２０，５４０，５６
０から信号出力ポート６１，６２，６３へデータの読出
しを行なう。
【００２３】図４は、以上のような本例の画像サイズ調
整回路で読出しを行なったときに、画像の垂直方向での
サイズを変更しない場合、即ち垂直サイズ制御信号Ｖsi
zeのデータ値が０である場合のタイミングと入力走査ラ
イン数対出力走査ライン数との概略関係を示している。
垂直方向で画像サイズを変更しない場合、セレクタ３０
０は、分周器１２０の出力信号Ｄclk2を選択する。これ
により、図４に示すように、ラインメモリ５１０，５２
０，５３０，５４０，５５０，５６０の書き込みエネー
ブル信号の周波数と読出しエネーブル信号の周波数とが
同一になるので、読出した１走査ライン分のディジタル
カラー信号Ｒｄ，Ｇｄ，Ｂｄが複数の走査ラインに対し
重複して読み出されることはない。したがって、画像サ
イズは垂直方向で変更されないことになる。
整回路で読出しを行なったときに、画像の垂直方向での
サイズを変更しない場合、即ち垂直サイズ制御信号Ｖsi
zeのデータ値が０である場合のタイミングと入力走査ラ
イン数対出力走査ライン数との概略関係を示している。
垂直方向で画像サイズを変更しない場合、セレクタ３０
０は、分周器１２０の出力信号Ｄclk2を選択する。これ
により、図４に示すように、ラインメモリ５１０，５２
０，５３０，５４０，５５０，５６０の書き込みエネー
ブル信号の周波数と読出しエネーブル信号の周波数とが
同一になるので、読出した１走査ライン分のディジタル
カラー信号Ｒｄ，Ｇｄ，Ｂｄが複数の走査ラインに対し
重複して読み出されることはない。したがって、画像サ
イズは垂直方向で変更されないことになる。
【００２４】一方、図５は、以上のような本例の画像サ
イズ調整回路で読出しを行なったときに、画像の垂直方
向でのサイズを変更する場合、即ち垂直サイズ制御信号
Ｖsizeのデータ値が１である場合のタイミングと入力走
査ライン数対出力走査ライン数との概略関係を示してい
る。この場合、セレクタ３００は、位相同期ループ１１
０の出力信号Ｄclk1を読出しイネーブル信号として選択
する。この読出しイネーブル信号（Ｄclk1）のクロック
周期は、書き込みエネーブル信号（Ｄclk2）のクロック
周期よりも速いので、図５に示すように、第１番目の入
力ラインが２回読み出される。即ち、水平同期信号Ｈsy
ncの１周期の間に一つのメモリ領域に書き込まれたディ
ジタルカラー信号Ｒｄ，Ｇｄ，Ｂｄが複数の走査ライン
に対して読み出されることになる。この例では該第１番
目の入力ラインは、２本の出力走査ラインの各々につい
て同様に読み出されることになる。また同様にして、垂
直サイズ制御信号Ｖsizeのデータ値が２であるときに
は、第１番目と第２番目の入力ラインがそれぞれ２回ず
つ読み出され、さらにデータ値が３であるときには、第
１番目と第３番目の入力ラインがそれぞれ２回ずつ読み
出される。このように垂直サイズ制御信号Ｖsizeのデー
タ値を変化させれば、垂直方向で画像サイズを変更する
ことが可能である。
イズ調整回路で読出しを行なったときに、画像の垂直方
向でのサイズを変更する場合、即ち垂直サイズ制御信号
Ｖsizeのデータ値が１である場合のタイミングと入力走
査ライン数対出力走査ライン数との概略関係を示してい
る。この場合、セレクタ３００は、位相同期ループ１１
０の出力信号Ｄclk1を読出しイネーブル信号として選択
する。この読出しイネーブル信号（Ｄclk1）のクロック
周期は、書き込みエネーブル信号（Ｄclk2）のクロック
周期よりも速いので、図５に示すように、第１番目の入
力ラインが２回読み出される。即ち、水平同期信号Ｈsy
ncの１周期の間に一つのメモリ領域に書き込まれたディ
ジタルカラー信号Ｒｄ，Ｇｄ，Ｂｄが複数の走査ライン
に対して読み出されることになる。この例では該第１番
目の入力ラインは、２本の出力走査ラインの各々につい
て同様に読み出されることになる。また同様にして、垂
直サイズ制御信号Ｖsizeのデータ値が２であるときに
は、第１番目と第２番目の入力ラインがそれぞれ２回ず
つ読み出され、さらにデータ値が３であるときには、第
１番目と第３番目の入力ラインがそれぞれ２回ずつ読み
出される。このように垂直サイズ制御信号Ｖsizeのデー
タ値を変化させれば、垂直方向で画像サイズを変更する
ことが可能である。
【００２５】
【発明の効果】以上、本発明の画像サイズ調整回路によ
れば、一つの入力走査ラインをディジタルディスプレイ
装置の画面に出力する際の、水平方向の使用画素数及び
垂直方向での使用走査ライン数をそれぞれ、自在に変更
することができるので、画像の拡大・縮小を行なう多画
面表示や親子画面表示、またズーム表示その他の各種表
示効果を得るのに優れている。また、該使用画素数等の
設定も、マイコン等を利用して使用者が容易に行なうこ
とが可能であり操作性にも優れている。
れば、一つの入力走査ラインをディジタルディスプレイ
装置の画面に出力する際の、水平方向の使用画素数及び
垂直方向での使用走査ライン数をそれぞれ、自在に変更
することができるので、画像の拡大・縮小を行なう多画
面表示や親子画面表示、またズーム表示その他の各種表
示効果を得るのに優れている。また、該使用画素数等の
設定も、マイコン等を利用して使用者が容易に行なうこ
とが可能であり操作性にも優れている。
【図１】本発明の一実施形態による画像サイズ調整回路
のブロック構成図。
のブロック構成図。
【図２】図１の画像サイズ調整回路で水平サイズ制御信
号の値が５であるときのサンプリング周波数と使用ピク
セルとの概略関係を示す図。
号の値が５であるときのサンプリング周波数と使用ピク
セルとの概略関係を示す図。
【図３】図１の画像サイズ調整回路で水平サイズ制御信
号の値が１０であるときのサンプリング周波数と使用ピ
クセルとの概略関係を示す図。
号の値が１０であるときのサンプリング周波数と使用ピ
クセルとの概略関係を示す図。
【図４】図１の画像サイズ調整回路により垂直方向での
画像サイズの変更を行なわない場合のタイミングと、入
力ライン数対出力ライン数と、の関係を示す図。
画像サイズの変更を行なわない場合のタイミングと、入
力ライン数対出力ライン数と、の関係を示す図。
【図５】図１の画像サイズ調整回路により垂直方向での
画像サイズの変更を行なわない場合のタイミングと、入
力ライン数対出力ライン数と、の関係を示す図。
画像サイズの変更を行なわない場合のタイミングと、入
力ライン数対出力ライン数と、の関係を示す図。
１００ 周波数逓倍回路 １１０ 位相同期ループ １２０ （１／２）分周器 １３０ 分周器 ２００ アナログ−ディジタル変換器 ３００ セレクタ ４００ タイミング発生回路 ５００ メモリ部 ５１０，５２０，５３０，５４０，５５０，５６０ ラ
インメモリ ６００ 入力スイッチング回路 ７００ 出力スイッチング回路
インメモリ ６００ 入力スイッチング回路 ７００ 出力スイッチング回路
Claims (9)
- 【請求項１】 アナログ映像信号を所定のサンプリング
クロックでディジタル映像信号に変換してメモリに書き
込んだ後、走査ライン毎に読み出して画像表示を行なう
ディジタルディスプレイ装置の画像サイズ調整方法にお
いて、 外部制御信号の値を変更して水平同期信号を逓倍して得
たサンプリングクロックの周波数を可変とし、且つ、該
サンプリングクロックをメモリの書き込みエネーブル信
号とすることで、水平同期信号の１周期でメモリへ書き
込む１走査ライン当たりのディジタル映像信号のデータ
量を変更させることを特徴とする画像サイズ調整方法。 - 【請求項２】 ディジタル映像信号に含まれる走査ライ
ン毎のＲ，Ｇ，Ｂ信号を、水平同期信号の１周期毎に、
該Ｒ，Ｇ，Ｂ信号それぞれについて設けた複数のメモリ
へ順に書き込むようにした請求項１記載の調整方法。 - 【請求項３】 書き込みエネーブル信号としたサンプリ
ングクロック又は該サンプリングクロックよりも周波数
の高い他のクロックの何れかを一方をメモリの読出しエ
ネーブル信号として選択可能として、該他のクロックに
よりメモリに書き込んだディジタル映像信号を複数回読
出し、複数の走査ライン上に表示するようにした請求項
１又は２記載の画像サイズ調整方法。 - 【請求項４】 外部制御信号により水平同期信号の周波
数を所定の倍率で逓倍した信号か又は該逓倍した信号を
分周した信号の何れかと選択的に同期してメモリのディ
ジタル映像信号を読み出すようにした請求項３記載の調
整方法。 - 【請求項５】 アナログ映像信号を所定のサンプリング
クロックでディジタル変換するアナログ−ディジタル変
換器と、これにより得たディジタル映像信号を記憶する
メモリと、を備えるディジタルディスプレイ装置の画像
サイズ調整回路において、 外部制御信号の値を変更して該映像信号の水平同期信号
の周波数を可変としてアナログ−デジタル変換器のサン
プリング入力とメモリの書き込みエネーブル端子とにそ
れぞれ接続した周波数逓倍回路と、水平同期信号と同期
して所定のメモリへ書き込むディジタル映像信号の書込
み経路を開閉する入力スイッチング回路と、を設け、水
平同期信号の１周期で書込み経路を閉じている間に、デ
ィジタル映像信号の１走査ライン分のデータ量を変更し
てメモリに書き込むことを特徴とする画像サイズ調整回
路。 - 【請求項６】 周波数逓倍回路は、位相同期ループと、
位相同期ループの出力を分周する分周回路と、外部制御
信号の値を変更して分周率を可変とし且つ前記分周回路
の出力を分周する他の分周回路と、を備える請求項５記
載の画像サイズ調整回路。 - 【請求項７】 位相同期ループの出力か分周回路の出力
かの何れかをメモリの読出しエネーブル信号として選択
するセレクタを備える請求項６記載の画像サイズ調整回
路。 - 【請求項８】 読出しエネーブル信号と同期して所定の
メモリに書き込んだディジタル映像信号の読出し経路を
開閉する出力スイッチング回路を備える請求項７記載の
画像サイズ調整回路。 - 【請求項９】 メモリには、ディジタル映像信号に含ま
れるＲ，Ｇ，Ｂ信号をそれぞれ記憶するラインメモリ群
が複数設けられると共に、前記入力及び出力スイッチン
グ回路によりラインメモリ群を選択して書き込み及び読
出しを行なう請求項８記載の画像サイズ調整回路。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019960026718A KR0174152B1 (ko) | 1996-07-02 | 1996-07-02 | 디지털 디스플레이 모니터의 영상크기 조정장치 |
| KR1996P26718 | 1996-07-02 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH1079905A true JPH1079905A (ja) | 1998-03-24 |
| JP3786760B2 JP3786760B2 (ja) | 2006-06-14 |
Family
ID=19465324
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17687597A Expired - Fee Related JP3786760B2 (ja) | 1996-07-02 | 1997-07-02 | ディジタルディスプレイ装置の画像サイズ調整方法及びその画像サイズ調整回路 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US5818416A (ja) |
| JP (1) | JP3786760B2 (ja) |
| KR (1) | KR0174152B1 (ja) |
| GB (1) | GB2314993B (ja) |
| TW (1) | TW328197B (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008268701A (ja) * | 2007-04-24 | 2008-11-06 | Mitsubishi Electric Corp | 画像表示装置 |
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| US6034689A (en) * | 1996-06-03 | 2000-03-07 | Webtv Networks, Inc. | Web browser allowing navigation between hypertext objects using remote control |
| JP3268999B2 (ja) * | 1997-03-31 | 2002-03-25 | 三洋電機株式会社 | 映像信号処理回路 |
| JPH11133921A (ja) * | 1997-10-28 | 1999-05-21 | Sharp Corp | 表示制御回路及び表示制御方法 |
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| US6018332A (en) | 1997-11-21 | 2000-01-25 | Ark Interface Ii, Inc. | Overscan user interface |
| US6337717B1 (en) | 1997-11-21 | 2002-01-08 | Xsides Corporation | Alternate display content controller |
| JP3433086B2 (ja) * | 1998-01-22 | 2003-08-04 | 松下電器産業株式会社 | 画像変換方法および画像変換装置 |
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| US6590592B1 (en) | 1999-04-23 | 2003-07-08 | Xsides Corporation | Parallel interface |
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| WO2000072123A2 (en) | 1999-05-21 | 2000-11-30 | Xsides Corporation | Parallel graphical user interface |
| US6630943B1 (en) | 1999-09-21 | 2003-10-07 | Xsides Corporation | Method and system for controlling a complementary user interface on a display surface |
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| US6677964B1 (en) | 2000-02-18 | 2004-01-13 | Xsides Corporation | Method and system for controlling a complementary user interface on a display surface |
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| US10778236B2 (en) * | 2019-01-04 | 2020-09-15 | Credo Technology Group Limited | PLL with wide frequency coverage |
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1996
- 1996-07-02 KR KR1019960026718A patent/KR0174152B1/ko not_active IP Right Cessation
-
1997
- 1997-06-27 TW TW086109006A patent/TW328197B/zh not_active IP Right Cessation
- 1997-07-02 US US08/887,128 patent/US5818416A/en not_active Expired - Lifetime
- 1997-07-02 JP JP17687597A patent/JP3786760B2/ja not_active Expired - Fee Related
- 1997-07-02 GB GB9713920A patent/GB2314993B/en not_active Expired - Fee Related
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|---|---|
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| GB9713920D0 (en) | 1997-09-03 |
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| GB2314993B (en) | 2000-11-08 |
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