JPH10214059A - プラズマディスプレイ装置 - Google Patents

プラズマディスプレイ装置

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JPH10214059A
JPH10214059A JP9212316A JP21231697A JPH10214059A JP H10214059 A JPH10214059 A JP H10214059A JP 9212316 A JP9212316 A JP 9212316A JP 21231697 A JP21231697 A JP 21231697A JP H10214059 A JPH10214059 A JP H10214059A
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勝啓 石田
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    • G09G3/2927—Details of initialising

Abstract

(57)【要約】 【課題】 様々な周波数の外部入力信号に対して適応し
うるプラズマディスプレイ装置を得る。 【解決手段】 ＰＤＰとこのパネルを駆動する手段を備
えるプラズマディスプレイ装置において、この駆動手段
にさらに、外部入力の垂直同期信号から１フレーム長を
演算する手段と、１フレーム中に含まれるサスティンパ
ルス数を検出する手段と、検出されたサスティンパルス
数からパネルの１駆動期間長を演算する手段と、このよ
うにして得られた１フレーム長と１駆動期間長とを比較
する手段と、この比較結果に基づいてサスティンパルス
数を変更する手段とを設ける。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は、プラズマディスプ
レイ装置に関し、特にサブフレーム方式を採用した駆動
装置を備えるプラズマディスプレイ装置に関する。
【０００２】
【従来の技術】平面型表示装置の一種であるプラズマデ
ィスプレイパネル（以下「ＰＤＰ」と略す）は、パネル
の構造がきわめて単純で電極をはじめパネルの構造体の
すべてを厚膜印刷技術で容易に形成できるメリットか
ら、特に各種ＯＡ機器やテレビジョン受像機などさまざ
まな表示用途に利用されている。
【０００３】カラーＰＤＰの表示画素構造は３電極型、
すなわち放電空間を間にして対向する２枚のガラス基板
の一方にアドレス電極と蛍光体を設け、他方にＸ電極と
Ｙ電極を交差状に設けたものが一般的である。この３電
極型のＰＤＰに適用する駆動方式として、１フレームを
例えば８個のサブフレームに分割し、各サブフレームの
維持放電期間を１：２：４：８：１６：３２：６４：１
２８の比率（この例では等比となっているが、必ずしも
等比とは限らない）に設定すると共に、これらのサブフ
レームを組み合わせて多階調化を実現した、所謂「サブ
フレーム方式」が知られている。
【０００４】図１はサブフレーム方式のフレーム構造を
示す概念図であり、図示の例では１フレームを８個のサ
ブフレームＳＦ１〜ＳＦ８で構成している。各サブフレ
ームは３種類の期間、すなわち「リセット期間」、「ア
ドレス期間」および「維持放電期間」からなり、最初の
２個の期間の長さは各サブフレームにおいて固定である
が、維持放電期間ｔ１〜ｔ８は上述したように一定の比
率で異なっている。なお、Ｌ１、Ｌ２、…、ＬＮは水平
走査線であり、また各サブフレームのアドレス期間内の
太線は走査線Ｌ１、Ｌ２、…、ＬＮを線順次で選択して
いる様子を表している。
【０００５】次に図２の電圧波形図を用いて、図１のサ
ブフレーム方式での一般的な駆動方式について簡単に説
明する。図２（ａ）は１サブフレーム期間におけるアド
レス電極の、図２（ｂ）はＸ電極の、および図２（ｃ）
はＹ電極の波形タイミング図である。図２（ｄ）は、各
波形におけるリセット期間、アドレス期間、維持放電期
間を特定している。なお、以下の説明で使用する電圧値
は例示的な値であり、これに限定されない。リセット期
間では、まず、全てのＹ電極に０Ｖを与えながら、放電
に必要な十分な電位差を与えるために、アドレス電極に
＋１１０Ｖ程度の正パルスを与えた状態で、Ｘ電極に＋
３３０Ｖ程度の正パルス（全面書き込みパルスとも言
う）を与える。これによりそれまでの表示状態に係わら
ず、全てのセルで放電が生じる。次に、アドレス電極と
Ｘ電極に０Ｖを与えて再び全てのセルで放電を生じさせ
ると、この放電は、電極間の電位差がゼロのため、壁電
荷が形成されずに自己中和して終息し、いわゆる自己消
去放電が行われる。この自己消去放電によって、パネル
内の全セルの状態が、壁電荷のない均一な状態にリセッ
トされる。このリセット期間は、前のサブフレームの点
灯状態に係わらず全てのセルを同じ状態にして、次のア
ドレス期間においてアドレス（書き込み）放電を安定に
行うために設けられている。
【０００６】なおこのリセット期間において、Ｙ電極に
図示するように第１補助パルスＶass1および第２補助パ
ルスＶass2、さらに補助消去パルスＶaeを与えてＹ電極
上の壁電荷を消滅させるステップを設けてもよい。この
時、アドレス電極にはこれら各パルスに対応して＋１１
０Ｖ程度の正パルスを印加する。次のアドレス期間にお
いて、表示データに応じたセルのオン／オフを行うため
に、パネルを線順次で走査し、アドレス放電を行う。ま
ずＸ電極に＋５０Ｖ程度の正電圧を与えながら、Ｙ電極
に線順次で−１５０〜−１６０Ｖ程度の負のパルス（以
下「スキャンパルス」）を印加し、且つ、アドレス電極
の内、維持放電を起こすセル、すなわち、点灯させるセ
ルに対応するするアドレス電極に選択的に＋６０Ｖ程度
の正パルス（以下「アドレスパルス」）を印加する。な
お、スキャンパルスを印加しないＹ電極には−５０〜−
６０Ｖ程度の負電圧を印加しておく。この結果、アドレ
スパルスを印加したアドレス電極とスキャンパルスを印
加したＹ電極との間には、放電に必要な充分な電位差
（２１０〜２２０Ｖ程度）が生じるので、この両電極間
に放電（アドレス放電）が生じる。一方、Ｘ電極とＹ電
極の間のスキャンパルス部分の電位差は２００Ｖ〜２１
０Ｖ程度で、アドレス電極との間よりも１０Ｖ程度低
く、この電位差だけでは自主放電は生じないが、前記ア
ドレス放電を引き金（トリガ）にしてＸ電極とＹ電極間
で放電が生じ、その交点に位置する誘電体層に壁電荷が
形成される。
【０００７】最後の維持放電期間（サスティン期間とも
言う）では、Ｘ電極とＹ電極に＋１８０Ｖ程度の正パル
ス（サスティンパルス）を交互に印加し、前のアドレス
期間において形成された壁電荷を利用して、Ｘ、Ｙ電極
間に放電（維持放電）を発生させて、１サブフレームの
画像表示を行う。この時、アドレス電極と、Ｘ電極また
はＹ電極間での放電を避けるために、アドレス電極には
１１０Ｖ程度の電圧が印加されている。
【０００８】以上のような「アドレス／維持放電分離型
・書き込みアドレス方式」の駆動方式では、維持放電期
間の長短、つまり維持パルスの回数によって画面の表示
輝度が決定される。サスティンパルスの周期は全てのサ
ブフレームにおいて同じであり、したがって図１の例で
は、各サブフレームにおけるサスティンパルス数は、１
ｎ：２ｎ：４ｎ：８ｎ：１６ｎ：３２ｎ：６４ｎ：１２
８ｎとなる。そのため、表示階調に応じて点灯させるサ
ブフレームを選択し、組み合わせることにより、この場
合では０から２５６までの階調で輝度を制御することが
できる。なお「ｎ」はサスティンパルスの周波数（以下
「サスティン周波数」）によって決まる整数である。
【０００９】通常、サスティンパルス数の組み合わせは
ＲＯＭテーブルに用意され、画面の設定輝度に応じてこ
のＲＯＭテーブルから各サブフレームにおけるサスティ
ンパルス数の組み合わせを選択することが行われる。図
３はＲＯＭテーブルの概念図である。図示の例では簡単
化のためにサブフレームをＳＦ１〜ＳＦ４までの４個と
し、サスティンパルスの数の組み合わせをＳＵＳ０〜Ｓ
ＵＳ１２７までの１２８通りとしている。なおＳＵＳ０
〜ＳＵＳ１２７はＲＯＭアドレスを示す。したがって設
定輝度に応じて所定のＲＯＭアドレスを選択することに
よって、各サブフレームにおけるサスティンパルス数が
設定され、この設定輝度での画面表示が行われる。
【００１０】例えば図３において、ＲＯＭアドレスＳＵ
Ｓ０を選択した場合には、サブフレームＳＦ１のサステ
ィンパルス数は１個、以下ＳＦ２は２個、ＳＦ３は４
個、ＳＦ４は８個となり、１フレームの合計のサスティ
ンパルス数は１５個となる。一方、ＲＯＭアドレスＳＵ
Ｓ１２７を選択した場合は、ＳＦ１で１６個、ＳＦ２で
３２個、ＳＦ３で６４個、ＳＦ４で１２８個となり、１
フレームの合計のサスティンパルス数は２４０個とな
る。この結果、１５対２４０、すなわち１６倍の輝度差
が得られる。
【００１１】なお、各サブフレームにおいて維持放電期
間はそれぞれ異なった長さを持つ一方で、リセット期間
およびアドレス期間は全サブフレームで固定された長さ
を有する。また、図１に示すように各フレーム内には、
サブフレームＳＦ１〜ＳＦ８の後に、駆動波形を出力し
ない休止期間が設けられている。以上に示したサブフレ
ーム方式の駆動方法は、極めて原理的なものであって、
実際のプラズマディスプレイ装置を構成する場合には種
々変更がなされている。たとえば図１に示すサブフレー
ムでは、各サブフレーム毎にサスティンパルス数を一定
比率で変えることによって一定の表示階調を得ている
が、高次のサブフレーム、例えばＳＦ６、ＳＦ７、ＳＦ
８、のサスティンパルス数を同じ数にして、輝度を飽和
させることも行われる。いずれにしろサスティンパルス
数の選択は、一定の比率および各フレーム毎に異なる数
に限定されるものではない。
【００１２】
【発明が解決しようとする課題】以上のように通常のプ
ラズマディスプレイでは、維持放電期間に印加するサス
ティンパルス数を選択することによって、輝度の階調を
制御している。一方、プラズマディスプレイは、テレビ
ジョン受像機、ビデオテープデッキあるいはコンピュー
タ等の機器に接続され、送られてくる表示信号を表示す
る。この場合、機器からは表示信号と共に各種同期信号
が入力されるが、この同期信号の周波数は機器によって
相違しているのが普通である。表示画面のフレーム長は
入力される同期信号の周波数によって決まるため、プラ
ズマディスプレイが接続される機器によってフレーム長
が変化すると言う現象が起こる。
【００１３】フレーム長が変化することによって次のよ
うな不具合が生じる。例えばフレーム長がそのプラズマ
ディスプレイで予め想定されたフレーム長よりも短くな
った場合、サスティンパルスの数を最大（図３の例で
は、ＳＵＳ１２７）にすると表示信号の１フレーム期間
からＰＤＰの１駆動期間（リセット期間＋アドレス期間
＋維持放電期間、図１参照）がはみ出してしまうことが
あり、その結果正常な表示が行えない。
【００１４】ここに、リセット期間とアドレス期間の長
さは可能な限り短く設定された固定値である。一方、維
持放電期間はサスティンパルスの数およびサスティンパ
ルス周期によって決まる可変値であり、前記ＲＯＭテー
ブルを例にすると最大で、ＳＦ１＝１６Ｔμｓ、ＳＦ２
＝３２Ｔμｓ、ＳＦ３＝６４Ｔμｓ、ＳＦ４＝１２８Ｔ
μｓとなる（但し、Ｔはサスティンパルスの１周期の長
さ）。
【００１５】したがって、この場合の１駆動期間αは、
〔｛（リセット期間とアドレス期間を足した時間）×サ
ブフレーム数｝＋｛１６Ｔμｓ＋３２Ｔμｓ＋６４Ｔμ
ｓ＋１２８μｓ｝〕で与えられるから、正常に表示でき
る信号の１フレーム長は、α（正確にはα＋垂直帰線時
間）を上回っていなければならない。そのため前記のよ
うに１駆動期間が１フレーム期間を越えてしまうと、表
示が正常に行えなくなる。
【００１６】なお反対に、外部入力同期信号の周波数変
化に伴って１フレーム期間が１駆動期間よりも短くなっ
た場合は休止期間が不必要に長くなり、輝度が低下す
る。以上のようにサブフレーム方式を採用した従来のプ
ラズマディスプレイ装置は、外部入力同期信号の様々な
周波数変化に対して充分な適応性を持たず、多くの解決
すべき技術的課題を残している。
【００１７】本発明は、以上に示した従来技術の技術的
課題を解決すべく成されたものであり、様々な周波数の
外部入力同期信号に対して充分な適応性を有するプラズ
マディスプレイ装置の実現を目的とする。
【００１８】
【課題を解決するための手段】前記目的を達成するため
に、本発明のプラズマディスプレイ装置は、プラズマデ
ィスプレイパネルと、表示のための１フレームを複数の
サブフレームに分割し該各サブフレーム毎に予め決めら
れた数のサスティンパルスを前記プラズマディスプレイ
パネルに印加し維持放電させるサブフレーム方式の駆動
手段とを備えたプラズマディスプレイ装置において、前
記駆動手段はさらに、外部より入力される表示信号に付
随する垂直同期信号の１周期長から前記表示のための１
フレームの長さを演算するフレーム長演算手段と、前記
表示信号に含まれる輝度情報に基づいて１フレーム中の
合計サスティンパルス数を検出する手段と、前記検出さ
れたサスティンパルス数に基づいて１フレームを表示す
るに要する前記プラズマディスプレイパネルの１駆動期
間長を演算する駆動期間長演算手段と、前記フレーム長
演算手段と前記駆動期間長演算手段の演算結果を比較す
る手段と、前記比較手段の結果に基づいて１フレーム中
の合計のサスティンパルス数を変更する手段とを具備す
る、プラズマディスプレイ装置を構成する。
【００１９】本発明の他の態様では、前記比較手段の比
較結果において前記１フレーム長が前記１駆動期間長よ
りも小さい場合、前記サスティンパルス数の変更手段は
前記合計のサスティンパルス数を減少させる方向に変更
するものである、プラズマディスプレイ装置を構成す
る。本発明の更に他の態様では、前記比較手段の比較結
果において前記１フレーム長が前記１駆動期間長よりも
大きい場合、前記サスティンパルス数の変更手段は前記
合計のサスティンパルス数を増加させる方向に変更する
ものである、プラズマディスプレイ装置を構成する。
【００２０】本発明のさらに他の態様では、前記駆動手
段はさらに、前記比較手段の結果に変更が有った場合こ
の状態での一定時間の経過を検出する検出手段を備え、
前記サスティンパルス数の変更手段は前記検出手段によ
って一定時間の経過が検出された場合に、前記合計のサ
スティンパルス数を変更するものである、プラズマディ
スプレイ装置を構成する。
【００２１】本発明のさらに他の態様では、前記フレー
ム長演算手段、駆動期間長演算手段、および比較手段
は、マイクロプロセッサユニットと該マイクロプロセッ
サユニットを前記フレーム長演算手段、駆動期間長演算
手段、および比較手段として機能させるためのプログラ
ムを記録した媒体とで構成される、プラズマディスプレ
イ装置を構成する。
【００２２】本発明のさらに他の態様では、プラズマデ
ィスプレイパネルと、表示のための１フレームを複数の
サブフレームに分割し該各サブフレーム毎に予め決めら
れた数のサスティンパルスを前記プラズマディスプレイ
パネルに印加し維持放電させるサブフレーム方式の駆動
手段を備えたプラズマディスプレイ装置において、前記
駆動手段はさらに、複数のアドレスを有し該各アドレス
中に前記各サブフレーム中のサスティンパルス数の組み
合わせを書き込んだＲＯＭテーブルと、前記表示信号に
付随して入力される垂直同期信号の１周期長からこの入
力信号の１フレーム長を演算するフレーム長演算手段
と、前記入力信号によって設定された輝度に対応する前
記ＲＯＭテーブルアドレスからそのアドレスにおける全
サブフレーム中の合計のサスティンパルス数を演算する
手段と、前記演算された合計のサスティンパルス数から
前記プラズマディスプレイパネルの１駆動期間長を演算
する駆動期間長演算手段と、前記フレーム長演算手段と
前記駆動期間長演算手段の演算結果を比較する手段と、
前記比較手段の結果に基づいて前記ＲＯＭテーブルのア
ドレスを変更する手段とを具備する、プラズマディスプ
レイ装置を構成する。
【００２３】本発明のさらに他の態様では、前記比較手
段の比較結果において前記１フレーム長が前記１駆動期
間長よりも小さい場合、前記アドレス変更手段は前記Ｒ
ＯＭテーブルのアドレスを前記合計のサスティンパルス
数を減少させる方向に変更する、プラズマディスプレイ
装置を構成する。本発明のさらに他の態様では、前記比
較手段の比較結果において前記１フレーム長が前記１駆
動期間長よりも大きい場合、前記アドレス変更手段は前
記ＲＯＭテーブルのアドレスを前記合計のサスティンパ
ルス数を増加させる方向に変更する、プラズマディスプ
レイ装置を構成する。
【００２４】本発明のさらに他の態様では、前記駆動手
段はさらに、前記比較手段の結果に変更があった場合こ
の状態での一定時間の経過を検出する検出手段を備え、
前記アドレス変更手段は前記検出手段によって一定時間
の経過が検出された場合に、前記アドレスを変更するも
のである、プラズマディスプレイ装置を構成する。本発
明のさらに他の態様では、前記フレーム長演算手段、駆
動期間長演算手段、および比較手段は、マイクロプロセ
ッサユニットと該マイクロプロセッサユニットを前記フ
レーム長演算手段、駆動期間長演算手段、および比較手
段として機能させるためのプログラムを記録した媒体と
で構成される、プラズマディスプレイ装置を構成する。
【００２５】本発明のさらに他の態様では、複数の発光
セルをマトリックス状に配置したプラズマディスプレイ
パネルと、前記複数の発光セルを線順次で走査して駆動
すると共に表示のための１フレームを複数のサブフレー
ムに分割し該各サブフレーム毎に予め決められた数のサ
スティンパルスを前記複数の発光セルに印加するサブフ
レーム方式の駆動手段とを備えたプラズマディスプレイ
装置において、前記駆動手段はさらに、外部より入力さ
れる表示信号に付随する垂直同期信号の１周期長から前
記表示のための１フレームの長さを演算するフレーム長
演算手段と、前記表示信号に含まれる輝度情報に基づい
て１フレーム中の合計サスティンパルス数を検出する手
段と、前記検出されたサスティンパルス数に基づいて１
フレームを表示するに要する前記プラズマディスプレイ
パネルの１駆動期間長を演算する駆動期間長演算手段
と、前記フレーム長演算手段と前記駆動期間長演算手段
の演算結果を比較する手段と、前記比較手段の結果に基
づいて前記線順次で走査するライン数を変更する手段と
を具備する、プラズマディスプレイ装置を構成する。
【００２６】本発明のさらに他の態様では、前記比較手
段の比較結果において前記１フレーム長が前記１駆動期
間長よりも小さい場合、前記走査ライン数の変更手段
は、前記走査ライン数を減少させる方向に変更する、プ
ラズマディスプレイ装置を構成する。本発明のさらに他
の態様では、前記比較手段の比較結果において前記１フ
レーム長が前記１駆動期間長よりも大きい場合、前記走
査ライン数の変更手段は前記走査ライン数を増加させる
方向に変更する、プラズマディスプレイ装置を構成す
る。
【００２７】本発明のさらに他の態様では、前記駆動手
段はさらに、前記比較手段の結果に変更があった場合こ
の状態での一定時間の経過を検出する検出手段を備え、
前記走査ライン数の変更手段は前記検出手段によって一
定時間の経過が検出された場合に、前記走査ライン数を
変更するものである、プラズマディスプレイ装置を構成
する。
【００２８】本発明のさらに他の態様では、前記フレー
ム長演算手段、駆動期間長演算手段および比較手段は、
マイクロプロセッサユニットと該マイクロプロセッサユ
ニットを前記フレーム長演算手段、駆動期間長演算手
段、および比較手段として機能させるためのプログラム
を記録した媒体とで構成される、プラズマディスプレイ
装置を構成する。
【００２９】本発明のさらに他の態様では、プラズマデ
ィスプレイパネルと、表示のための１フレームを複数の
サブフレームに分割し該各サブフレーム毎に予め決めら
れた数のサスティンパルスを前記プラズマディスプレイ
パネルに印加し維持放電させるサブフレーム方式の駆動
手段とを備えたプラズマディスプレイ装置において、前
記駆動手段はさらに、外部より入力される表示信号に付
随する垂直同期信号の１周期長から前記表示のための１
フレームの長さを演算するフレーム長演算手段と、前記
演算された１フレーム長から表示可能な最大のサスティ
ンパルス数を演算するとともに該演算された最大のサス
ティンパルス数から表示可能な最大輝度を演算する手段
と、該演算された最大輝度と予め設定された基準輝度と
の一致を検出する手段と、該検出手段の結果が不一致の
場合前記基準輝度に相当するサスティンパルス数を演算
し該演算されたサスティンパルス数を最大サスティンパ
ルス数として設定する手段を具備する、プラズマディス
プレイ装置を構成する。
【００３０】
【発明の実施の形態】図４は、本発明のプラズマディス
プレイ装置において、外部入力信号のフレーム長の長短
に対応しうる機能を実現するための構成を示す原理図で
ある。図において１０は、外部より入力される同期信号
の内、垂直同期信号Ｖsyncの入力を受けてその１周期長
から１フレーム長Ｔｖを演算するフレーム長演算手段、
１１は外部入力信号に含まれる輝度情報をもとに１フレ
ーム内の合計のサスティンパルス数を検出する手段、１
２は検出された合計のサスティンパルス数を基に実際の
駆動期間長Ｔｇを演算する駆動期間長演算手段である。
駆動期間Ｔｇの計算は従来例の説明の項で述べたよう
に、〔｛（リセット期間とアドレス期間を足した時間）
×サブフレーム数｝＋｛合計サスティンパルス数×
Ｔ｝〕で求められる。なおＴはサスティンパルスのパル
ス幅である。ここで（リセット期間とアドレス期間を足
した時間）×サブフレーム数は固定値であり、またサス
ティンパルスのパルス幅も固定であるため、駆動期間Ｔ
ｇは実際はサスティンパルス数にのみ依存する。
【００３１】図において１４は比較手段であり、演算さ
れたフレーム長Ｔｖと駆動期間長Ｔｇ間の比較を行って
比較信号Ｓを出力する。１６は、サスティンパルス数、
または表示ライン数の変更手段である。本発明の後述す
る実施形態１では、変更手段１６は、比較手段１４にお
いてＴｖ＜Ｔｇであると判断された場合１フレーム中の
合計のサスティンパルス数を減少させて、１駆動期間長
Ｔｇが１フレーム内に納まるようにする。これによっ
て、若干の輝度低下を招くものの、ＰＤＰの異常表示が
回避される。反対にＴｖ＞Ｔｇの場合は、１フレーム中
の合計のサスティンパルス数を増加させて、輝度を上げ
る。
【００３２】本発明の他の実施形態では、変更手段１６
は、比較手段１４においてＴｖ＜Ｔｇであると判断され
た場合、表示ライン数を減少させて１駆動期間長Ｔｇが
１フレーム内に納まるようにする。反対にＴｖ＞Ｔｇの
場合は、表示ライン数を増加させる。ＰＤＰは、表示セ
ルをマトリックス状に配置し、各セルを線順次で走査し
て駆動するものであり、表示ライン数を減少することは
アドレス期間を短縮することを意味する。例えば画面上
下の何本かの表示ラインの駆動を停止して表示ライン数
を減少することにより、各サブフレームにおいてアドレ
ス期間が一様に短縮され、その結果１駆動期間長Ｔｇが
減少し、１フレーム内に納まるようになる。これによっ
てＰＤＰの異常表示が回避される。
【００３３】一方、比較手段１４においてＴｖ＞Ｔｇの
場合は、表示ライン数を増加させることによって、各サ
ブフレームのアドレス期間が一様に増加し、Ｔｖ＞Ｔｇ
の範囲内で表示ライン数を最大にすることができる。な
お、変更手段１６において、サスティンパルス数の増減
および表示ライン数の増減を共に行って、１フレーム長
Ｔｖと１駆動期間長Ｔｇの制御を行う事も可能である。
【００３４】図５は、本発明の各実施形態を実現する、
プラズマディスプレイ装置の概略構成を示すブロック
図、図６はその要部の詳細を示す図である。図におい
て、２０はＰＤＰ、２１はアドレスドライバ、２２はＹ
スキャンドライバ、２３はＹ共通ドライバ、２４はＸ共
通ドライバ、２５はこれら各ドライバの駆動を制御する
ための制御回路である。
【００３５】制御回路２５は、表示データ制御部２６と
パネル駆動制御部２７を含む。表示データ制御部２６
は、図６に示すように、外部から与えられる表示データ
（ＤＡＴＡ）を一時記憶するフレームメモリ２６ａと、
このフレームメモリ２６ａ内のデータに対して所定の信
号操作とタイミング処理を施してアドレスドライバ２１
に出力する、データコンバータ２６ｂを有している。パ
ネル駆動制御部２７は、スキャンドライバ制御部２８と
共通ドライバ制御部２９を含み、外部から与えられる垂
直同期信号（ＶSYNC）に基づいて各種タイミング信号を
発生し、表示データ制御部２６、Ｙスキャンドライバ２
２、Ｙ共通ドライバ２３およびＸ共通ドライバ２４に供
給する。
【００３６】アドレスドライバ２１は、表示選択用高電
圧電源Ｖａを用いてアドレスパルスを発生し、このアド
レスパルスをパネル２０のアドレス電極に選択的に印加
する。またＹスキャンドライバ２２は、表示維持用高電
圧電源Ｖｓを用いてスキャンパルスを発生し、このスキ
ャンパルスをパネル２０のＹ電極に線順次で印加する。
なおこれらのアドレスパルスおよびスキャンパルスは１
サブフレーム中のアドレス期間において発生する。
【００３７】Ｙ共通ドライバ２３は、表示維持用高電圧
電源Ｖｓを用いてサスティンパルスを発生し、１サブフ
レーム中の維持放電期間においてこのサスティンパルス
をパネル２０のすべてのＹ電極に同時に印加し、Ｘ共通
ドライバ２４は同じく表示維持用高電圧電源Ｖｓを用い
てサスティンパルスおよび全面書き込みパルスを発生
し、１サブフレーム中のリセット期間において、この全
面書き込みパルスをパネル２０のすべてのＸ電極に同時
に印加するとともに、１サブフレーム中の維持放電期間
において、このサスティンパルスを全Ｘ電極に同時に印
加する。
【００３８】図６は、図４に示した機能を実現する部分
を中心にして図５に示す装置の要部を示したブロック図
である。図示するように、共通ドライバ制御部２９は、
マイクロプロセッサユニット（以下「ＭＰＵ」と略す）
２９ａと、ゲートアレイ２９ｂおよびサスティンパルス
数の組み合わせを書き込んだＲＯＭテーブル２９ｃを含
んでいる。図７に、サブフレーム数が８の場合のＲＯＭ
テーブルの一例を示す。なお図６において、スキャンド
ライバ制御部２８は、スキャンコントローラ２８ａを含
んでいるものとする。
【００３９】以下に、図５および６に示す装置の動作
を、特に本発明の目的を実現する機能を中心に説明す
る。外部入力映像信号（表示信号、ＤＡＴＡ）が表示デ
ータ制御部２６のフレームメモリ２６ａに入力される
と、この信号中に含まれるサブフレーム（ＳＦ）数、輝
度に対応するサスティンパルス数等を示すデータが、デ
ータコンバータ２６ｂ、ゲートアレイ２９ｂを介してＭ
ＰＵ２９ａに入力される。ＭＰＵ２９ａでは、この入力
に基づいてパネル２０の１駆動期間長Ｔｇの演算が行わ
れる。ＭＰＵ２９ａには外部垂直同期信号ＶSYNCが入力
されており、この信号の１周期長に基づいて１フレーム
長Ｔｖが演算される。これらの演算結果は、ＭＰＵ２９
ａにおいて比較され、その比較結果に基づいてサスティ
ンパルス数の補正値、あるいは表示ライン数の補正値が
決定される。これらの補正値は、ゲートアレイ２９ｂを
介してスキャンコントローラ２８ａに入力され、スキャ
ンコントローラ２８ａはこの補正値に基づいて線順次走
査する表示ライン数を増減し、あるいはＲＯＭテーブル
２９ｃのアドレスを上下することによりサスティンパル
ス数を増減して、駆動期間長Ｔｇをコントロールする。
【００４０】以下に、図５および６に示す装置の種々の
実施形態を、フローチャートを参照しながら説明する。
なおこのフローチャートは、マイクロプロセッサユニッ
ト２９ａのプログラムの状態を示すものであり、したが
って本発明の装置では、マイクロプロセッサユニット２
９ａのプログラムを種々変更することによって、各種の
実施形態を実現することが可能である。
【００４１】また以下の各種の実施形態を説明するにあ
たって、図７に示すＲＯＭテーブルを参照するが、この
ＲＯＭテーブルは、サブフレーム方式でかつ電力消費制
限機能（ＡＰＣ機能）付きのＰＤＰにおいて使用され
る、輝度（サスティンパルス数）上限値を設定するため
のＲＯＭテーブルの一例を示している。ＰＤＰでは、例
えばＲＯＭテーブルのＳＵＳ１２７（図３参照）を選択
した場合には輝度が最大になると同時に消費電力も最大
（但し表示率１００％の場合）となる。通常の信号の表
示率はおよそ３０％程度であるから、仮にＳＵＳ１２７
を選択しても最大電力にはならないが、稀に表示率１０
０％もしくはそれに近い表示率になると、設計電力をオ
ーバするおそれがある。このため、ＡＰＣ機能では、設
計上の最大輝度（ＭＣＢＣと言う）を越えないようにＲ
ＯＭテーブルのアドレス選択を制限している。図７に示
すＲＯＭテーブルは、この最大輝度を示したものであ
る。しかしながら図７のＲＯＭテーブルはあくまでも一
例として示すもので、本発明がこのような特定の目的に
使用されるＲＯＭテーブルに限定されるものでないこと
は勿論である。
【００４２】（実施形態１）図８に示すフローチャート
は、入力信号のフレーム長が１駆動期間長よりも短い場
合の異常表示を、サスティンパルス数を減少させること
によって回避する処理プロセスを示したものである。ま
ずステップ１００において、垂直同期信号Ｖsyncの１周
期長を計測して、その１周期長を入力信号の１フレーム
長Ｔｖとする。次いで、ステップ１０１で固定長のリセ
ット期間とこれも固定長のアドレス期間とを足してサブ
フレーム数倍し、さらに現在の輝度に対応するＲＯＭテ
ーブルのアドレスからサスティンパルスの合計数を求め
る。今、表示信号の輝度が、例えば図７のアドレスＭＣ
ＢＣ１２６に対応するものであると、そのアドレスの合
計のサスティンパルス数として３７７が得られる。これ
を基に１フレーム中の維持放電期間を算出し、算出され
た維持放電期間と、固定長のリセット期間およびアドレ
ス期間から１駆動期間長Ｔｇを求める。次に、ステップ
１０２で、１フレーム長Ｔｖと１駆動期間長Ｔｇとを比
較し、Ｔｖ＜Ｔｇであれば、すなわち入力信号の１フレ
ーム長が１駆動期間長に満たない場合は、ステップ１０
３でＴｇ−Ｔｖの演算を行い、その差Ｔｒを求める。ス
テップ１０４では、この差Ｔｒを適宜設定した定数Ａで
割って、ＲＯＭテーブルのアドレスステップの引き下げ
幅を決定し、この値を現在のＲＯＭテーブルのアドレス
値ＭＣＢＣ１２６から差し引くことによって、補正され
たＲＯＭテーブルのアドレス値ＢＣｍａｘ、例えばアド
レスＭＣＢＣ１２４を求める。定数Ａは適当な定数であ
り、このＡの値を宜設定することによって、ＲＯＭテー
ブルのアドレス値が充分引き下げられ、その結果サステ
ィンパルス数が充分減少し、１駆動期間長Ｔｇの長さが
減少して１フレーム長Ｔｖ内に納まるようになり、信号
の異常表示を回避することができる。例えばアドレスＭ
ＣＢＣ１２６からアドレスＭＣＢＣ１２４へ引き下げら
れると、サスティンパルスの合計数は３７７から３６９
に減少し、サスティンパルス数の減少に伴って１駆動期
間長Ｔｇが減少し、１フレーム長無いに納まるようにな
る。なお、ステップ１０２でＴｖ＜Ｔｇでなければ、ア
ドレス値ＭＣＢＣをそのまま使用する。
【００４３】定数Ａの値が大きいと、場合によってはＲ
ＯＭテーブルのアドレス値の引き下げが充分でなく、１
駆動期間長Ｔｇを１フレーム長Ｔｖ内に収める事が出来
ない事がある。一方、定数Ａの値を小さくすればこのよ
うな不都合は回避できるが、今度はＲＯＭテーブルのア
ドレス値の飛び幅が大きくなって、輝度変化が目立ち過
ぎると言う好ましくない状態を招く。
【００４４】これを回避するためには、定数Ａの値を出
来るだけ大きくするとともに、図に点線で示すようにス
テップ１０４の出力を、リターン（ＲＥＴ）ではなく、
ステップ１０１の入力に繋げばよい。このようにするこ
とによって、ＲＯＭテーブルのアドレス値を小刻みに下
げながら、１駆動期間長Ｔｇの再計算とＴｖ＜Ｔｇの再
評価を繰り返し、急激な輝度変化を避けながら適正なＲ
ＯＭテーブルのアドレス値を検出することができる。
【００４５】（実施形態２）図９に示すフローチャート
は、入力信号のフレーム長に比べて１駆動期間長が短い
場合、サスティンパルス数を増加させて、輝度を上げる
処理プロセスを示すものである。なお以下の各実施形態
の説明において、同一あるいは類似の処理ステップには
同一の符号を付し、したがってその重複した説明は行わ
ない。
【００４６】ステップ１００において、垂直同期信号Ｖ
syncの１周期長を計測して、その１周期長を入力信号の
１フレーム長Ｔｖとする。次いで、ステップ１０１で輝
度に対応するＲＯＭテーブルのアドレス、例えばＭＣＢ
Ｃ１２４におけるサスティンパルスの合計数３６９から
１駆動期間長Ｔｇを求める。次に、ステップ２００で、
１フレーム長Ｔｖと１駆動期間長Ｔｇとを比較し、Ｔｖ
＞Ｔｇであれば、すなわち入力信号の１フレーム長が１
駆動期間長よりも長い場合は、ステップ２０１でＴｖ−
Ｔｇの演算を行い、その差Ｔｒを求める。ステップ２０
２では、この差Ｔｒを適宜設定した定数Ａで割って、Ｒ
ＯＭテーブルのアドレスステップの引き上げ幅を決定
し、この値を現在のＲＯＭテーブルのアドレス値ＭＣＢ
Ｃ１２４に加えることによって、補正されたＲＯＭテー
ブルのアドレス値ＢＣｍａｘ、例えばＭＣＢＣ１２６を
求める。この結果、サスティンパルスの合計数が、３６
９から３７７に増加した分、輝度が上昇する。なお実施
形態１の説明の項で述べたように、定数Ａを出来るだけ
大きく設定し、ステップ２０２の出力をステップ１０１
の入力に接続し、ステップ１０１からステップ２０２の
処理を繰り返し行うことによって、可能な限り大きいＢ
Ｃｍａｘを得ることができる。この結果、パネルの輝度
を正常表示が可能な範囲で最高に設定することができ
る。
【００４７】なお、実施形態１と実施形態２を組み合わ
せることによって次のような処理も可能である。すなわ
ち、図８に示すフローチャートでの処理の結果、ＲＯＭ
テーブルのアドレス値が、例えばアドレスＭＣＢＣ１２
６からアドレスＭＣＢＣ１２２まで引き下げられた結
果、１フレーム長Ｔｖが１駆動期間長Ｔｇより大きくな
った場合、今度は図９に示すステップ２００から２０２
を実行して、ＲＯＭテーブルのアドレス値を例えばＭＣ
ＢＣ１２５まで引き上げて輝度を上げる。これによっ
て、正常表示が可能な範囲で輝度を最高にすることがで
きる。
【００４８】（実施形態３）以上の実施形態では、外部
入力信号の１フレーム長が変化しない場合を想定してい
る。しかしながら、例えばビデオテープレコーダでは通
常再生モード（６０Hz）と早送り再生モード（６１．５
Hz）では周波数が異なり、さらにこれらのモードは繰り
返して使用されるのが一般的である。この場合、通常再
生モードから早送り再生モードに変わると入力信号のフ
レーム長Ｔｖが短くなるので、図８に示したフローチャ
ートに従ってサスティンパルス数を直ちに削減して正常
な表示を行う必要がある。ところが、前述したように早
送り再生モードと通常再生モードは繰り返して使用され
るものであり、早送り再生モードから通常再生モードに
一時的に復帰した場合にサスティンパルス数を元の数値
に戻して輝度を上げると、再び次の早送り再生モードで
輝度を下げねばならず、その結果、輝度の変化が非常に
激しくなる。したがってこの実施形態では、早送り再生
モードから通常再生モードへの一時的な復帰の際には輝
度を元に戻す処理を行わず、完全に通常再生モードに戻
ってから輝度を元に戻すことにより、急激な輝度変化を
回避しようとするものである。
【００４９】この目的を達成するために本実施形態で
は、図１０に示すように、図８のフローチャートに対し
てカウンタＣＴを０にリセットするステップ３００、Ｔ
ｖ＜Ｔｇの比較を行った後カウンタＣＴの値を所定値Ｆ
に設定するステップ３０１、ステップ１０４で輝度補正
を行った後カウンタＣＴの値が０であるか否かを判定す
るステップ３０２、カウンタＣＴの値を１だけ減らすス
テップ３０３、およびステップ３０２でカウンタＣＴの
値が０になった場合、ステップ１０４で補正された輝度
値ＢＣｍａｘをもとの値ＭＣＢＣに復帰させるステップ
３０４を設けている。
【００５０】したがって図１０のフローチャートに従え
ば、例えば通常再生モードから早送り再生モードへの変
化に伴って入力信号の１フレーム長が６０Hzから６１．
５Hzに変化すると、ステップ１００〜１０３でサスティ
ンパルス数を直ちに削減することにより、正常な表示が
行われる。次に、一時的に早送り再生モードから通常再
生モードに戻り、ステップ１０２でＴｖ≧Ｔｇと成った
場合でも、カウンタＣＴの値がＦから０に戻るまでこの
状態が連続しない限り、輝度の再修正を行わず、輝度を
早送り再生モード時の値ＢＣｍａｘに保つ。Ｔｖ≧Ｔｇ
のままで一定時間（Ｆによって決定される）が経過する
と、この状態はもはや早送り再生モードから通常再生モ
ードへの一時的な復帰とは見做されず、したがってステ
ップ３０４において輝度をＢＣｍａｘから通常再生モー
ドの輝度である元の輝度ＭＣＢＣに復帰させる。この結
果、通常再生モードと早送り再生モード間の繰り返しに
よる輝度の急激な変化が回避できる。
【００５１】以上に述べた各実施形態は、いずれもサス
ティンパルス数を変更することによって入力信号のフレ
ーム長の変化に対応するものである。しかしながら以下
に述べる実施形態は、パネルの走査ライン数を変更する
ことによってフレーム長の変化に対処しようとするもの
である。走査ライン数の変更は、例えば図１に示す各サ
ブフレームにおいてアドレス期間を一様に変更するもの
であり、したがって走査ライン数を削減することによ
り、１駆動期間長が減少し、反対に走査ライン数を増加
することによって、１駆動期間長が増加する。
【００５２】（実施形態４）図１１に示す実施形態で
は、サスティンパルス数を変更する実施形態１と同様に
してステップ１００、１０１でＴｖ演算、Ｔｇ演算を行
い、ステップ１０２でＴｖとＴｇの比較を行い、フレー
ム長Ｔｖが駆動期間長Ｔｇよりも短いと、ステップ１０
３でＴｖ、Ｔｇ間の差Ｔｒを検出し、次にステップ４０
０で、現在のライン数ＮＬからＴｒ／Ｔｇ１を引いて新
しいライン数ＮＬｍａｘを設定する演算を行う。Ｔｇ１
は、１ラインあたりの駆動期間を示している。この結
果、アドレス期間が短縮され、１駆動期間長Ｔｇが１フ
レーム長Ｔｖ内に納まるようになり、異常表示を回避す
ることができる。
【００５３】（実施形態５）図１２に示す実施形態で
は、ステップ２００で１フレーム長Ｔｖが１駆動期間長
Ｔｇよりも長い事が検出されると、ステップ２０１で、
Ｔｖ−Ｔｇの演算を行い、その差Ｔｒを得る。次にステ
ップ５００で、差Ｔｒを１ラインあたりの駆動期間Ｔｇ
１で割りその商を現在のライン数に加算する演算を行
い、補正後のライン数ＮＬｍａｘを得る。このようにし
て表示ライン数を、Ｔｖ＞Ｔｇの範囲内で最大にするこ
とができる。
【００５４】（実施形態６）図１３に示すフローチャー
トは、表示ライン数を減少して異常表示を回避しようと
する図１１に示す実施形態４に対して、入力信号の一時
的な周波数変動に対処しうる機能を付加したものであ
る。この機能は、実施形態３の項で説明したのと同じ必
要性に基づいているので、その説明は省略する。本実施
形態では、図１１の実施形態４に係るフローチャートに
おいて、カウンタＣＴを０にリセットするステップ６０
０、カウンタＣＴを所定値Ｆに設定するステップ６０
１、カウンタＣＴが０であるか否かを判定するステップ
６０２、カウンタＣＴを１だけ減らすステップ６０３お
よびステップ１００〜１０３および４００によって補正
されたライン数ＮＬｍａｘを元のライン数ＮＬに戻すス
テップ６０４を付加したものである。なおこの実施形態
６は、実施形態３においてサスティンパルス数の減少を
表示ライン数の減少に変更したのみで、その他のプロセ
スに変更は無いので、その詳細な説明は省略する。
【００５５】なお、実施形態４〜６は、既存のマルチス
キャン対策の補完技術としても有効である。例えば、サ
ブフレーム方式のＰＤＰには垂直同期信号（ＶSYNC）の
周期に合わせてサブフレームを間引くようにした、いわ
ゆる「マルチＶSYNC機能」を搭載したものがあるが、こ
のものは、最小のサブフレーム（上記例示ではＳＦ１）
単位でしか駆動期間の長さを調節できないため、大雑把
な調節にならざるを得ないと言う欠点がある。ところが
本実施形態の技術を適用すれば、きめ細かな調節が可能
となり、サブフレームの間引き効果と相まって、幅広い
周波数に対応した汎用性の高いＰＤＰを提供できる。
【００５６】（実施形態７）前記実施形態１または２で
は、ＰＤＰが接続された機器からの入力信号の周波数が
変化すると、表示される輝度が変化する。したがって本
来は同じ輝度であっても、接続される機器によっては異
なる輝度として表示される事態が発生する。図１４に示
すフローチャートは、このような事態に対処すべく構成
された本発明の第７の実施形態を示すものである。
【００５７】本実施形態では、まずステップ１００で入
力された表示信号の１周期長から１フレーム長Ｔｖを演
算する。次にステップ７００で、この１フレーム長Ｔｖ
に対する表示可能なサスティンパルス数〔Ｎｓｕｓ（Ｔ
ｖ）〕を演算し、このサスティンパルス数に１サスティ
ンパルスあたりの輝度Ｙｓｕｓを掛け合わせることによ
って、表示可能な最高輝度Ｙｍａｘを得る。一方、入力
周波数に依存することなく表示輝度を一定にするため
に、基準となる輝度（設定輝度Ｙｃ）を予め設定して置
く。ステップ７０１では、得られた最高輝度Ｙｍａｘと
この設定輝度Ｙｃとを比較し、両者が一致しない場合、
ステップ７０２に移って、サスティンパルス数を補正し
て設定輝度Ｙｃに一致させる処理を行う。すなわち最高
輝度Ｙｍａｘから所定輝度Ｙｃを引いてその差を１サス
ティンパルスあたりの輝度Ｙｓｕｓで割ることにより、
サスティンパルス数の補正値を得て、これを現在の１フ
レーム長Ｔｖにおける表示可能なサスティンパルス数Ｎ
ｓｕｓより引くことにより、設定輝度Ｙｃに対応したサ
スティンパルス数を得ることができる。
【００５８】以上の結果、様々なフレーム長の入力信号
に対して、表示輝度が一定となるようにサスティンパル
ス数を調節して表示品質を改善することができる。
【００５９】
【発明の効果】以上例を挙げて説明したように、本発明
のプラズマディスプレイ装置では、１フレーム長と１駆
動期間長との関係が適切になるように、サスティンパル
ス数あるいは走査ライン数を調節するので、様々な周波
数を有する外部機器へ接続された場合でも、正常な表示
が可能である。従って本発明は、汎用性の高いプラズマ
ディスプレイ装置を提供するものである。
【図面の簡単な説明】
【図１】ＰＤＰを駆動するためのサブフレーム方式の説
明に供する図である。
【図２】ＰＤＰの駆動波形の１例を示す図である。
【図３】輝度制御のためのＲＯＭデータの格納図であ
る。
【図４】本発明の原理図である。
【図５】本発明のＰＤＰの全体構成を示す図である。
【図６】図５の一部を詳細に示す図である。
【図７】本発明の実施形態の説明に供するＲＯＭデータ
の格納図である。
【図８】本発明の第１の実施形態にかかるフローチャー
トである。
【図９】本発明の第２の実施形態にかかるフローチャー
トである。
【図１０】本発明の第３の実施形態にかかるフローチャ
ートである。
【図１１】本発明の第４の実施形態にかかるフローチャ
ートである。
【図１２】本発明の第５の実施形態にかかるフローチャ
ートである。
【図１３】本発明の第６の実施形態にかかるフローチャ
ートである。
【図１４】本発明の第７の実施形態にかかるフローチャ
ートである。
【符号の説明】
１０…フレーム長演算手段 １１…サスティンパルス数検出手段 １２…駆動期間長演算手段 １４…比較手段 １６…サスティンパルス数および／または表示ライン数
の変更手段 ２０…ＰＤＰ ２１…アドレスドライバ ２２…Ｙスキャンドライバ ２３…Ｙ共通ドライバ ２４…Ｘ共通ドライバ ２５…制御回路 ２６…表示データ制御部 ２８…スキャンドライバ制御部 ２９…共通ドライバ制御部
───────────────────────────────────────────────────── フロントページの続き (72)発明者 栗山 博仁 神奈川県川崎市中原区上小田中４丁目１番 １号 富士通株式会社内 (72)発明者 石田 勝啓 神奈川県川崎市中原区上小田中４丁目１番 １号 富士通株式会社内 (72)発明者 山本 晃 神奈川県川崎市中原区上小田中４丁目１番 １号 富士通株式会社内

Claims (16)

    【特許請求の範囲】
  1. 【請求項１】 プラズマディスプレイパネルと、表示の
    ための１フレームを複数のサブフレームに分割し該各サ
    ブフレーム毎に予め決められた数のサスティンパルスを
    前記プラズマディスプレイパネルに印加し維持放電させ
    るサブフレーム方式の駆動手段とを備えたプラズマディ
    スプレイ装置において、前記駆動手段はさらに、外部よ
    り入力される表示信号に付随する垂直同期信号の１周期
    長から前記表示のための１フレームの長さを演算するフ
    レーム長演算手段と、前記表示信号に含まれる輝度情報
    に基づいて１フレーム中の合計サスティンパルス数を検
    出する手段と、前記検出されたサスティンパルス数に基
    づいて１フレームを表示するに要する前記プラズマディ
    スプレイパネルの１駆動期間長を演算する駆動期間長演
    算手段と、前記フレーム長演算手段と前記駆動期間長演
    算手段の演算結果を比較する手段と、前記比較手段の結
    果に基づいて１フレーム中の合計のサスティンパルス数
    を変更する手段とを具備する、プラズマディスプレイ装
    置。
  2. 【請求項２】 前記比較手段の比較結果において前記１
    フレーム長が前記１駆動期間長よりも小さい場合、前記
    サスティンパルス数の変更手段は前記合計のサスティン
    パルス数を減少させる方向に変更するものである、請求
    項１に記載のプラズマディスプレイ装置。
  3. 【請求項３】 前記比較手段の比較結果において前記１
    フレーム長が前記１駆動期間長よりも大きい場合、前記
    サスティンパルス数の変更手段は前記合計のサスティン
    パルス数を増加させる方向に変更するものである、請求
    項１に記載のプラズマディスプレイ装置。
  4. 【請求項４】 前記駆動手段はさらに、前記比較手段の
    結果に変更が有った場合この状態での一定時間の経過を
    検出する検出手段を備え、前記サスティンパルス数の変
    更手段は前記検出手段によって一定時間の経過が検出さ
    れた場合に、前記合計のサスティンパルス数を変更する
    ものである、請求項１に記載のプラズマディスプレイ装
    置。
  5. 【請求項５】 前記フレーム長演算手段、駆動期間長演
    算手段、および比較手段は、マイクロプロセッサユニッ
    トと該マイクロプロセッサユニットを前記フレーム長演
    算手段、駆動期間長演算手段、および比較手段として機
    能させるためのプログラムを記録した媒体とで構成され
    る、請求項１に記載のプラズマディスプレイ装置。
  6. 【請求項６】 プラズマディスプレイパネルと、表示の
    ための１フレームを複数のサブフレームに分割し該各サ
    ブフレーム毎に予め決められた数のサスティンパルスを
    前記プラズマディスプレイパネルに印加し維持放電させ
    るサブフレーム方式の駆動手段を備えたプラズマディス
    プレイ装置において、前記駆動手段はさらに、複数のア
    ドレスを有し該各アドレス中に前記各サブフレーム中の
    サスティンパルス数の組み合わせを書き込んだＲＯＭテ
    ーブルと、前記表示信号に付随して入力される垂直同期
    信号の１周期長からこの入力信号の１フレーム長を演算
    するフレーム長演算手段と、前記入力信号によって設定
    された輝度に対応する前記ＲＯＭテーブルアドレスから
    そのアドレスにおける全サブフレーム中の合計のサステ
    ィンパルス数を演算する手段と、前記演算された合計の
    サスティンパルス数から前記プラズマディスプレイパネ
    ルの１駆動期間長を演算する駆動期間長演算手段と、前
    記フレーム長演算手段と前記駆動期間長演算手段の演算
    結果を比較する手段と、前記比較手段の結果に基づいて
    前記ＲＯＭテーブルのアドレスを変更する手段とを具備
    する、プラズマディスプレイ装置。
  7. 【請求項７】 前記比較手段の比較結果において前記１
    フレーム長が前記１駆動期間長よりも小さい場合、前記
    アドレス変更手段は前記ＲＯＭテーブルのアドレスを前
    記合計のサスティンパルス数を減少させる方向に変更す
    る、請求項６に記載のプラズマディスプレイ装置。
  8. 【請求項８】 前記比較手段の比較結果において前記１
    フレーム長が前記１駆動期間長よりも大きい場合、前記
    アドレス変更手段は前記ＲＯＭテーブルのアドレスを前
    記合計のサスティンパルス数を増加させる方向に変更す
    る、請求項６に記載のプラズマディスプレイ装置。
  9. 【請求項９】 前記駆動手段はさらに、前記比較手段の
    結果に変更があった場合この状態での一定時間の経過を
    検出する検出手段を備え、前記アドレス変更手段は前記
    検出手段によって一定時間の経過が検出された場合に、
    前記アドレスを変更するものである、請求項６に記載の
    プラズマディスプレイ装置。
  10. 【請求項１０】 前記フレーム長演算手段、駆動期間長
    演算手段、および比較手段は、マイクロプロセッサユニ
    ットと該マイクロプロセッサユニットを前記フレーム長
    演算手段、駆動期間長演算手段、および比較手段として
    機能させるためのプログラムを記録した媒体とで構成さ
    れる、請求項６に記載のプラズマディスプレイ装置。
  11. 【請求項１１】 複数の発光セルをマトリックス状に配
    置したプラズマディスプレイパネルと、前記複数の発光
    セルを線順次で走査して駆動すると共に表示のための１
    フレームを複数のサブフレームに分割し該各サブフレー
    ム毎に予め決められた数のサスティンパルスを前記複数
    の発光セルに印加するサブフレーム方式の駆動手段とを
    備えたプラズマディスプレイ装置において、前記駆動手
    段はさらに、外部より入力される表示信号に付随する垂
    直同期信号の１周期長から前記表示のための１フレーム
    の長さを演算するフレーム長演算手段と、前記表示信号
    に含まれる輝度情報に基づいて１フレーム中の合計サス
    ティンパルス数を検出する手段と、前記検出されたサス
    ティンパルス数に基づいて１フレームを表示するに要す
    る前記プラズマディスプレイパネルの１駆動期間長を演
    算する駆動期間長演算手段と、前記フレーム長演算手段
    と前記駆動期間長演算手段の演算結果を比較する手段
    と、前記比較手段の結果に基づいて前記線順次で走査す
    るライン数を変更する手段とを具備する、プラズマディ
    スプレイ装置。
  12. 【請求項１２】 前記比較手段の比較結果において前記
    １フレーム長が前記１駆動期間長よりも小さい場合、前
    記走査ライン数の変更手段は、前記走査ライン数を減少
    させる方向に変更する、請求項１１に記載のプラズマデ
    ィスプレイ装置。
  13. 【請求項１３】 前記比較手段の比較結果において前記
    １フレーム長が前記１駆動期間長よりも大きい場合、前
    記走査ライン数の変更手段は前記走査ライン数を増加さ
    せる方向に変更する、請求項１１に記載のプラズマディ
    スプレイ装置。
  14. 【請求項１４】 前記駆動手段はさらに、前記比較手段
    の結果に変更があった場合この状態での一定時間の経過
    を検出する検出手段を備え、前記走査ライン数の変更手
    段は前記検出手段によって一定時間の経過が検出された
    場合に、前記走査ライン数を変更するものである、請求
    項１１に記載のプラズマディスプレイ装置。
  15. 【請求項１５】 前記フレーム長演算手段、駆動期間長
    演算手段および比較手段は、マイクロプロセッサユニッ
    トと該マイクロプロセッサユニットを前記フレーム長演
    算手段、駆動期間長演算手段、および比較手段として機
    能させるためのプログラムを記録した媒体とで構成され
    る、請求項１１に記載のプラズマディスプレイ装置。
  16. 【請求項１６】 プラズマディスプレイパネルと、表示
    のための１フレームを複数のサブフレームに分割し該各
    サブフレーム毎に予め決められた数のサスティンパルス
    を前記プラズマディスプレイパネルに印加し維持放電さ
    せるサブフレーム方式の駆動手段とを備えたプラズマデ
    ィスプレイ装置において、前記駆動手段はさらに、外部
    より入力される表示信号に付随する垂直同期信号の１周
    期長から前記表示のための１フレームの長さを演算する
    フレーム長演算手段と、前記演算された１フレーム長か
    ら表示可能な最大のサスティンパルス数を演算するとと
    もに該演算された最大のサスティンパルス数から表示可
    能な最大輝度を演算する手段と、該演算された最大輝度
    と予め設定された基準輝度との一致を検出する手段と、
    該検出手段の結果が不一致の場合前記基準輝度に相当す
    るサスティンパルス数を演算し該演算されたサスティン
    パルス数を最大サスティンパルス数として設定する手段
    を具備する、プラズマディスプレイ装置。
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