JPH098358A - 半導体発光素子 - Google Patents

半導体発光素子

Info

Publication number
JPH098358A
JPH098358A JP15469295A JP15469295A JPH098358A JP H098358 A JPH098358 A JP H098358A JP 15469295 A JP15469295 A JP 15469295A JP 15469295 A JP15469295 A JP 15469295A JP H098358 A JPH098358 A JP H098358A
Authority
JP
Japan
Prior art keywords
lead
semiconductor chip
light emitting
die
semiconductor
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP15469295A
Other languages
English (en)
Inventor
Yukio Matsumoto
幸生 松本
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Rohm Co Ltd
Original Assignee
Rohm Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Rohm Co Ltd filed Critical Rohm Co Ltd
Priority to JP15469295A priority Critical patent/JPH098358A/ja
Publication of JPH098358A publication Critical patent/JPH098358A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48245Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • H01L2224/48247Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item

Landscapes

  • Led Device Packages (AREA)
  • Led Devices (AREA)

Abstract

(57)【要約】 【目的】 半導体チップの面積が小型化されて背の高い
不安定なチップでもリードへのダイボンディングが容易
で、かつ、確実に行うことができる構造の半導体発光素
子を提供する。 【構成】 発光層を有する半導体チップ1の上下に電極
が設けられ、該半導体チップの下面がリード2にダイボ
ンディングされ、他方の電極が他のリード3と電気的接
続され、透明樹脂でモールドされてなる半導体発光素子
であって、前記リード2のダイボンディング部に前記半
導体チップの底部が収納されうる凹部2aが設けられて
いる。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明はリード上に半導体チップ
がダイボンディングされ透明樹脂でモールドされた半導
体発光素子に関する。さらに詳しくは、半導体チップを
リード上に組み立てる際に作業性がよく、歩留りが向上
しうる半導体発光素子に関する。
【0002】
【従来の技術】従来、半導体発光素子は、図2に示され
るように、たとえばn型GaAs基板上にn型クラッド
層と活性層とp型クラッド層とからなる発光層および電
流拡散層やコンタクト層などの半導体層が積層され、上
部電極および下部電極が設けられた半導体チップ1の裏
面側を一方のリード2にダイボンディングし、他方のリ
ード3と半導体チップ1の上部電極とが金線4で接続さ
れ、リード2部とリード3の先端部およびボンディング
された金線4の部分が、上部側に凸レンズ効果を有する
ように発光波長に対して透明な樹脂でモールドされて形
成される。リード2のダイボンディング部は図2に示さ
れるように、凹面状に形成され、半導体チップ1から横
方向や下方向に出た光も上方に反射させて有効に利用で
きる形状とされている。
【0003】半導体チップ1は、たとえば縦×横×高さ
が300〜350μm×300〜350μm×200〜
300μmの大きさに形成され、たとえば銀ペーストの
ような導電性のあるプリフォーム材などによりダイボン
ディングされる。リード2、3は0.5〜2mm程度の
厚さのリードフレームを金型による打抜きなどにより形
成され、ダイボンディング部は打抜き後スタンピングな
どにより凹面状に形成される。
【0004】
【発明が解決しようとする課題】従来の半導体発光素子
は、前述のように、立方体に近い半導体チップ1をリー
ド2上に載置してボンディングしなければならない。こ
のリード2のダイボンディング部は、前述のように発光
効率を向上させるため凹面状に形成されている。そのた
め、立方体形状の半導体チップ1をリード2のダイボン
ディング部に載置すると不安定で倒れ易く、倒れたまま
ボンディングしたり、逆さにボンディングしたりするこ
とがあり、これらは回収不能の不良となり歩留りを低下
させる。
【0005】さらに、最近コストダウンの目的から半導
体チップの小型化が要望され、縦×横の大きさが100
〜200μm角の物が増加しつつある。そうすると高さ
は前述のように、200〜300μmあるため、背の高
い半導体チップとなり、ますます不安定で倒れ易く組立
作業が煩雑になるとともに、歩留りも低下するという問
題がある。一方、半導体チップの高さを低くするため半
導体チップの裏面側を研磨して薄くすることも考えられ
るが、薄くすると研磨工数を要するためコストアップに
なるとともに、半導体チップの電流拡散層などがGaA
s基板などと格子整合がとれていないと、ウェハの状態
で反ったり割れが生じたりするという問題がある。
【0006】本発明はこのような問題を解決し、半導体
チップの面積が小型化されて背の高い不安定な半導体チ
ップでもリードへのダイボンディングを容易で、かつ、
確実に行うことができる構造の半導体発光素子を提供す
ることを目的とする。
【0007】
【課題を解決するための手段】本発明の半導体発光素子
は、発光層を有するチップの上下に電極が設けられ、該
半導体チップの下面がリードにダイボンディングされ、
他方の電極が他のリードと電気的接続され、透明樹脂で
モールドされてなる半導体発光素子であって、前記リー
ドのダイボンディング部に前記半導体チップの底部が収
納されうる凹部が設けられている。
【0008】前記リードのダイボンディングされる面が
わん曲面に形成されているばあいに、とくに組立時の作
業の安定性が向上し、作業能率の向上とともに歩留りの
向上が顕著となる。
【0009】
【作用】本発明によれば、発光素子用半導体チップがダ
イボンディングされるリードの先端に、半導体チップの
底部が収納しうる凹部が形成されているため、半導体チ
ップをリード上にダイボンディングする際に倒れたりす
ることがなく、リード先端の凹部内に半導体チップの底
部を挿入することにより確実に、しかも簡単にボンディ
ングすることができる。そのため、短時間で高歩留りの
ダイボンディングをすることができる。またリード先端
の凹部は金型などでリードのわん曲面を形成する際に同
時に形成することができ、特別の工数などを必要としな
い。
【0010】さらに、半導体チップの背が高くても凹部
にその底部を収納させてダイボンディングするため、半
導体チップの裏面を研磨して薄くする必要がなく、研磨
の工数を必要としないとともに、研磨することによる半
導体基板の反りや割れなどの問題も発生しない。
【0011】
【実施例】つぎに、図面を参照しながら本発明の半導体
発光素子について説明をする。
【0012】図1は本発明の半導体発光素子の一実施例
の半導体チップをダイボンディングした状態の断面説明
図およびその平面説明図である。
【0013】本発明の半導体発光素子は図1に示される
ように、半導体チップ1の底部が一方のリード2のダイ
ボンディング部に設けられた凹部2aに挿入されてダイ
ボンディングされていることに特徴がある。半導体チッ
プ1の一方の電極1aがリード3と金線4でワイヤボン
ディング(電気的に接続)されたり、ダイボンディング
された半導体チップ1の部分やリード3の先端部、金線
4部などが半導体チップ1の発光波長に対して透明な樹
脂でモールドされる(図示せず)ことなどは従来と同様
である。リード2のダイボンディング部はわん曲面に形
成されていることが横とか裏面側に放射された光を有効
に利用することができるため好ましいが、必ずしもわん
曲面に形成されている必要はない。しかし、半導体チッ
プ1の倒れを防止し、組立作業の容易化を達成するとい
う本発明の目的からはダイボンディング作業が行いにく
いわん曲面の形成されているリードの方が効果が大き
い。
【0014】わん曲面が形成されたリード2の先端部の
底部の高さAは1mm程度あり、凹部2aの深さBは5
0〜150μm程度あり、半導体チップ1の高さは20
0〜300μm(半導体基板より上の半導体層の厚さは
全部で10μm程度以下)であるため、半導体チップ1
の基板部分のみが凹部2aの中に入り、半導体チップ1
の高さの16〜75%程度が凹部2a内に入ることにな
り、非常に安定な状態でダイボンディングされる。
【0015】半導体チップ1は、たとえばGaAsなど
からなる半導体基板上にn型クラッド層とノンドープの
活性層とp型クラッド層とからなるダブルヘテロ接合構
造の発光層が形成されその上に電流拡散層が設けられ、
コンタクト層を介して一方の電極が部分的に設けられ、
半導体基板の裏面に他方の電極が設けられることにより
形成されている。
【0016】半導体チップ1はダブルへテロ接合構造の
ものに限らず、シングルヘテロ接合構造、ホモ接合構造
などすべての構造のものに適用でき、発光層を有する半
導体チップであればよい。
【0017】リード2は1〜2mm程度の厚さの鉄、ア
ルミニウムなどからなる板材をリード3および図示しな
い連結バーとともに金型などで打ち抜いたものや、単独
に形成したリード2およびリード3を薄い板材で接続し
ておき、組立後分離できるようにしたもの、または鋳型
などでリード3などと一体に形成したものなどに銀メッ
キなどをして用いる。板材などから打抜いたリードフレ
ームのばあい、リード2の半導体チップをボンディング
する面が金型によるプレスなどにより凹面形状に成形さ
れるが、本発明ではその際同時に半導体チップを収納さ
せうる凹部2aが形成される。すなわち、従来は半導体
チップ1が載置される部分は平らになるようにし、それ
より外周側が凹面形状(直径Cは2〜5mm程度)にな
るような金型でプレスして形成されていたが、本発明で
はプレスする金型の半導体チップ1の載置部分を突出さ
せておくことにより、周囲の凹面形状とともに半導体チ
ップ1を収納させうる凹部2aを同時に形成できる。凹
部2aの大きさは半導体発光素子の種類によって変るが
半導体チップの大きさである100〜350μm角に合
わせて形成される。そのため、凹部2aを形成する特別
の工程を必要とせず、従来の製造工程と同じ工程で凹部
2aを形成できる。鋳型などでリード2を一体成形する
ばあいも、鋳型の形状に凹部に対応する凸部を形成して
おくことにより特別の工程を必要とすることなく、簡単
に形成できる。
【0018】このリード2を用いて、従来と同様に半導
体チップ1をリード2の凹部2a内に収納させてプリフ
ォーム材によりダイボンディングし、半導体チップ1の
一方の電極1aをリード3と金線4によりワイヤボンデ
ィングして図示しないエポキシ樹脂などの発光波長に対
して透明な樹脂で半導体チップ1およびリード3の先端
部などをモールドすることにより本発明の半導体発光素
子が形成される。
【0019】
【発明の効果】本発明によれば、半導体チップをボンデ
ィングするステムに半導体チップを収納しうる凹部が形
成されているため、半導体チップをダイボンディングす
る際に倒れたりすることがなく、ダイボンディング作業
が容易で工数を削減できるとともに歩留りが向上する。
【0020】さらに、半導体チップの背が高くて不安定
な状態でも凹部内に挿入して倒れることがないため、半
導体チップの裏面側を研磨して薄くする必要がなく、半
導体チップの表面積が小型化されても厚いままで安定に
組み立てることができる。その結果、コストダウンを達
成できるとともに、半導体基板の裏面を研磨することに
より半導体基板の反りや割れなどが生じなく歩留りを向
上させることができる。
【図面の簡単な説明】
【図1】本発明の半導体発光素子の一実施例の断面説明
図および平面説明図である。
【図2】従来の半導体発光素子の断面説明図である。
【符号の説明】
1 半導体チップ 2 リード 2a 凹部 3 リード

Claims (2)

    【特許請求の範囲】
  1. 【請求項1】 発光層を有する半導体チップの上下に電
    極が設けられ、該半導体チップの下面がリードにダイボ
    ンディングされ、他方の電極が他のリードと電気的接続
    され、透明樹脂でモールドされてなる半導体発光素子で
    あって、前記リードのダイボンディング部に前記半導体
    チップの底部が収納されうる凹部が設けられてなる半導
    体発光素子。
  2. 【請求項2】 前記リードのダイボンディングされる面
    がわん曲面に形成されてなる請求項1記載の半導体発光
    素子。
JP15469295A 1995-06-21 1995-06-21 半導体発光素子 Pending JPH098358A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP15469295A JPH098358A (ja) 1995-06-21 1995-06-21 半導体発光素子

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP15469295A JPH098358A (ja) 1995-06-21 1995-06-21 半導体発光素子

Publications (1)

Publication Number Publication Date
JPH098358A true JPH098358A (ja) 1997-01-10

Family

ID=15589857

Family Applications (1)

Application Number Title Priority Date Filing Date
JP15469295A Pending JPH098358A (ja) 1995-06-21 1995-06-21 半導体発光素子

Country Status (1)

Country Link
JP (1) JPH098358A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6812579B2 (en) 2001-10-30 2004-11-02 Fuji Electric Co., Ltd. Semiconductor device
JP2006313896A (ja) * 2005-05-02 2006-11-16 Samsung Electro Mech Co Ltd 発光素子パッケージ

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6812579B2 (en) 2001-10-30 2004-11-02 Fuji Electric Co., Ltd. Semiconductor device
JP2006313896A (ja) * 2005-05-02 2006-11-16 Samsung Electro Mech Co Ltd 発光素子パッケージ

Similar Documents

Publication Publication Date Title
US10693050B2 (en) Light emitting diode package having frame with bottom surface having two surfaces different in height
US6921926B2 (en) LED package and the process making the same
JPH11168236A (ja) 光半導体チップおよび光半導体チップの製造方法
JP2001111119A (ja) 発光装置及びその製造方法
JP2000243887A (ja) 半導体装置とその製造方法
US7126163B2 (en) Light-emitting diode and its manufacturing method
JPH06338632A (ja) 窒化ガリウム系化合物半導体発光素子
US6657238B2 (en) Light emitting diode and illuminator using the same
KR100447413B1 (ko) 반도체 발광장치
JPH098358A (ja) 半導体発光素子
JP3571450B2 (ja) リードフレームの製法および発光素子の製法
JP3967314B2 (ja) 発光素子
CN113675311A (zh) 一种led芯片及其制备方法
JP2001094158A (ja) Ledランプ
JPH09293905A (ja) 半導体素子及びその製造方法
JP2718339B2 (ja) 発光ダイオードチップおよび発光ダイオード
KR102471801B1 (ko) 반도체 발광소자
JP3421520B2 (ja) 発光装置及びその製造方法
US6300674B1 (en) Flat package for semiconductor diodes
KR20010035153A (ko) GaN 발광 소자 및 그 패키지
JPH07297451A (ja) 半導体装置
KR100628884B1 (ko) 백색 발광다이오드 및 그 제조방법
US20020063257A1 (en) Flat package for semiconductor diodes
JP2000332305A (ja) 半導体発光素子
JP2543202Y2 (ja) 発光デバイス

Legal Events

Date Code Title Description
A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 20040323