JPH0965084A - 画像処理装置 - Google Patents
画像処理装置Info
- Publication number
- JPH0965084A JPH0965084A JP7234813A JP23481395A JPH0965084A JP H0965084 A JPH0965084 A JP H0965084A JP 7234813 A JP7234813 A JP 7234813A JP 23481395 A JP23481395 A JP 23481395A JP H0965084 A JPH0965084 A JP H0965084A
- Authority
- JP
- Japan
- Prior art keywords
- image processing
- memory
- data
- access
- image
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Facsimiles In General (AREA)
- Storing Facsimile Image Data (AREA)
- Telephonic Communication Services (AREA)
Abstract
(57)【要約】
【課題】 画像処理に使用するデータを管理し、ワンタ
ッチダイヤル等の情報をバックアップデータとして別途
管理するような画像処理装置において、１つのＲＡＭを
用いるだけでそれぞれの機能を実現できる装置を提供す
ることを目的とする。 【解決手段】 画像処理に使用するデータとダイヤル情
報等のデータをそれぞれアクセスするアドレスを切り替
えることにより、メモリの異なるエリアを使い分けるこ
とで、同一のメモリを使用して処理することを可能とす
る。
ッチダイヤル等の情報をバックアップデータとして別途
管理するような画像処理装置において、１つのＲＡＭを
用いるだけでそれぞれの機能を実現できる装置を提供す
ることを目的とする。 【解決手段】 画像処理に使用するデータとダイヤル情
報等のデータをそれぞれアクセスするアドレスを切り替
えることにより、メモリの異なるエリアを使い分けるこ
とで、同一のメモリを使用して処理することを可能とす
る。
Description
【０００１】
【発明の属する技術分野】本発明は、画像データをメモ
リに一時蓄積して画像処理を行う画像処理装置に関す
る。
リに一時蓄積して画像処理を行う画像処理装置に関す
る。
【０００２】
【従来の技術】電話機能や種々のアプリケーションが搭
載されたパーソナルファクシミリの低価格化が進み、オ
フィスでの個人ユーズや家庭向けに大きく普及し始めて
いる。また、最近では、この種のパーソナルファクシミ
リにおいても、疑似中間調処理を実現し、写真を混在し
た原稿をも忠実に再現するファクシミリ装置が開発され
ている。
載されたパーソナルファクシミリの低価格化が進み、オ
フィスでの個人ユーズや家庭向けに大きく普及し始めて
いる。また、最近では、この種のパーソナルファクシミ
リにおいても、疑似中間調処理を実現し、写真を混在し
た原稿をも忠実に再現するファクシミリ装置が開発され
ている。
【０００３】また、疑似中間調画像の処理方法として
は、ディザ法・誤差拡散法等が提案されており、これら
の画像処理にはバッファメモリを必要とする。さらに、
原稿の文字部分をより忠実に再現するためのエッジ強調
処理にもバッファメモリが必要となる。
は、ディザ法・誤差拡散法等が提案されており、これら
の画像処理にはバッファメモリを必要とする。さらに、
原稿の文字部分をより忠実に再現するためのエッジ強調
処理にもバッファメモリが必要となる。
【０００４】そこで、これら画像処理を実現するため、
一般的には、スタティックＲＡＭを用い、それぞれの用
途に従って画像データを時分割に書き込み・読み出しを
行っている。
一般的には、スタティックＲＡＭを用い、それぞれの用
途に従って画像データを時分割に書き込み・読み出しを
行っている。
【０００５】一方、ワンタッチダイヤルによるメモリダ
イヤル機能は、ファクシミリ装置では必須の機能となっ
ているが、これらの情報は一旦登録すると、停電時に対
しても記憶情報が保持されるように電池などでバックア
ップされていることが多い。そして、これらを記憶する
メモリも消費電力が少ないスタティックＲＡＭが使用さ
れることが多い。
イヤル機能は、ファクシミリ装置では必須の機能となっ
ているが、これらの情報は一旦登録すると、停電時に対
しても記憶情報が保持されるように電池などでバックア
ップされていることが多い。そして、これらを記憶する
メモリも消費電力が少ないスタティックＲＡＭが使用さ
れることが多い。
【０００６】
【発明が解決しようとする課題】しかしながら、上述の
ような機能を実現するためには、比較的コストの高いＳ
ＲＡＭを少なくても２つ使用する必要があり、低コスト
を要求されるパーソナルファクシミリにおいては、大き
なコストアップ要因となっていた。
ような機能を実現するためには、比較的コストの高いＳ
ＲＡＭを少なくても２つ使用する必要があり、低コスト
を要求されるパーソナルファクシミリにおいては、大き
なコストアップ要因となっていた。
【０００７】本発明は、上述のようなメモリを要する画
像処理を実現し、さらに短縮ダイヤル等の情報をバック
アップデータとして別途管理するような場合にも、１つ
のＲＡＭを用いるだけでそれぞれの機能を実現できる装
置を提供することを目的とする。
像処理を実現し、さらに短縮ダイヤル等の情報をバック
アップデータとして別途管理するような場合にも、１つ
のＲＡＭを用いるだけでそれぞれの機能を実現できる装
置を提供することを目的とする。
【０００８】
【課題を解決するための手段】本発明は、画像データを
メモリに一時蓄積して画像処理を行う画像処理手段と、
装置を管理する制御装置が扱うワークデータの中で、ダ
イヤル情報を含む所定データを別途管理する管理手段と
を有する画像処理装置において、上記画像処理用のデー
タとダイヤル情報を含む所定データとを、それぞれアク
セスするアドレスを切り替える手段により、異なるエリ
アを使い分けることで、同一のメモリを使用して処理す
ることを特徴とする。
メモリに一時蓄積して画像処理を行う画像処理手段と、
装置を管理する制御装置が扱うワークデータの中で、ダ
イヤル情報を含む所定データを別途管理する管理手段と
を有する画像処理装置において、上記画像処理用のデー
タとダイヤル情報を含む所定データとを、それぞれアク
セスするアドレスを切り替える手段により、異なるエリ
アを使い分けることで、同一のメモリを使用して処理す
ることを特徴とする。
【０００９】さらに、本発明は、画像データをメモリに
一時蓄積して画像処理を行う場合の１画素に対するメモ
リアクセスサイクル数に対して、少なくても１アクセス
サイクル追加することにより、上記制御装置がメモリを
アクセス可能とすることを特徴とする。
一時蓄積して画像処理を行う場合の１画素に対するメモ
リアクセスサイクル数に対して、少なくても１アクセス
サイクル追加することにより、上記制御装置がメモリを
アクセス可能とすることを特徴とする。
【００１０】
【発明の実施の形態および実施例】図１は、本発明の一
実施例を示すブロック図である。
実施例を示すブロック図である。
【００１１】制御部１−１は、マイクロプロセッサ・Ｒ
ＯＭ・ＲＡＭ・時計ＩＣ・Ｉ／Ｏ・タイマ等により構成
されるマイクロプロセッサ回路であり、マイクロプロセ
ッサのソフトウェア制御により、本装置全体の動作制御
・ワンタッチダイヤル情報・発信人名称等の各種データ
の管理を行う。また、画像データの圧縮コード符号化や
復号化処理も行う。
ＯＭ・ＲＡＭ・時計ＩＣ・Ｉ／Ｏ・タイマ等により構成
されるマイクロプロセッサ回路であり、マイクロプロセ
ッサのソフトウェア制御により、本装置全体の動作制御
・ワンタッチダイヤル情報・発信人名称等の各種データ
の管理を行う。また、画像データの圧縮コード符号化や
復号化処理も行う。
【００１２】操作部１−２は、各種キー・表示部等によ
り構成され、オペレータのキー入力の受付や、各種情報
の表示を行う。通信制御部１−３は、回線インターフェ
イス・電話回路等よりなり、画像データ・通信制御デー
タの送受信・電話の発着呼制御を行う。
り構成され、オペレータのキー入力の受付や、各種情報
の表示を行う。通信制御部１−３は、回線インターフェ
イス・電話回路等よりなり、画像データ・通信制御デー
タの送受信・電話の発着呼制御を行う。
【００１３】読み取り部１−５は、コンタクトセンサ、
Ａ／Ｄ変換回路・画像処理回路等により構成され、光学
的に読み取られたデータを光電変換し、光電変換された
データをＡＤ変換・画像補正・２値化処理等の画像処理
を行い、２値化された画像データを出力する。
Ａ／Ｄ変換回路・画像処理回路等により構成され、光学
的に読み取られたデータを光電変換し、光電変換された
データをＡＤ変換・画像補正・２値化処理等の画像処理
を行い、２値化された画像データを出力する。
【００１４】記録部１−６は、レーザビームプリンタ・
バブルジェットプリンタにより構成され、受信画像等の
出力を行うものである。メモリ１−４は、ダイナミック
ＲＡＭ（ＤＲＡＭ）等により構成される第２のメモリで
あり、ソフトウェアのワーキングエリアとして使用され
たり、読み取り部１−５で読み取った画像データを蓄積
したり、記録部１−６に出力する画像データを蓄積した
り、通信制御部１−３により送受信するコードデータを
格納する。
バブルジェットプリンタにより構成され、受信画像等の
出力を行うものである。メモリ１−４は、ダイナミック
ＲＡＭ（ＤＲＡＭ）等により構成される第２のメモリで
あり、ソフトウェアのワーキングエリアとして使用され
たり、読み取り部１−５で読み取った画像データを蓄積
したり、記録部１−６に出力する画像データを蓄積した
り、通信制御部１−３により送受信するコードデータを
格納する。
【００１５】選択制御部１−７は、読み取り部１−５か
ら出力されるアドレスと制御部１−１から出力されるア
ドレスとを選択出力し、メモリ１−８に対してライトア
クセスしたりリードアクセスを行う。また、リードアク
セス・ライトアクセスに対応して、メモリに対するデー
タの方向も制御する。
ら出力されるアドレスと制御部１−１から出力されるア
ドレスとを選択出力し、メモリ１−８に対してライトア
クセスしたりリードアクセスを行う。また、リードアク
セス・ライトアクセスに対応して、メモリに対するデー
タの方向も制御する。
【００１６】メモリ１−８は、スタティックＲＡＭ（Ｓ
ＲＡＭ）等により構成される第１のメモリであり、読み
取り部１−５で使用される画像データを一時格納した
り、制御部１−１に管理されるワンタッチダイヤル情報
等の管理データを格納する。図２は、このような第１の
メモリ１−８に蓄積されるデータの内容を示す説明図で
ある。
ＲＡＭ）等により構成される第１のメモリであり、読み
取り部１−５で使用される画像データを一時格納した
り、制御部１−１に管理されるワンタッチダイヤル情報
等の管理データを格納する。図２は、このような第１の
メモリ１−８に蓄積されるデータの内容を示す説明図で
ある。
【００１７】また、バッテリ１−９は、このメモリ１−
８をバックアップするために使用される。
８をバックアップするために使用される。
【００１８】次に、図３〜図５を用いて、メモリ１−８
を時分割にアクセスする動作について説明する。
を時分割にアクセスする動作について説明する。
【００１９】図３は、読み取り部１−５の構成を示すブ
ロック図である。
ロック図である。
【００２０】光学読み取り装置３−１は、コンタクトセ
ンサで構成されたり、ＬＥＤ・縮小光学系・ＣＣＤ等に
より構成され、光学的に読み取られたデータを光電変換
し、出力するものである。この光学読み取り装置３−１
で読み取られたデータは、Ａ／Ｄ変換部３−２で各種補
正され、ディジタルデータに変換される。このＡ／Ｄ変
換部３−２の補正には、上記メモリ１−８に蓄積したデ
ータを読み出して使用する。
ンサで構成されたり、ＬＥＤ・縮小光学系・ＣＣＤ等に
より構成され、光学的に読み取られたデータを光電変換
し、出力するものである。この光学読み取り装置３−１
で読み取られたデータは、Ａ／Ｄ変換部３−２で各種補
正され、ディジタルデータに変換される。このＡ／Ｄ変
換部３−２の補正には、上記メモリ１−８に蓄積したデ
ータを読み出して使用する。
【００２１】エッジ強調部３−３は、Ａ／Ｄ変換部３−
２より出力される多値のディジタルデータを２ラインあ
るいは３ラインの画像データよりプラシアンを通してエ
ッジ強調される。すなわち、このエッジ強調に２ライン
あるいは３ラインのデータが必要なことから、メモリ１
−８に対して画像データのリード・ライトを繰り返しな
がら処理する。
２より出力される多値のディジタルデータを２ラインあ
るいは３ラインの画像データよりプラシアンを通してエ
ッジ強調される。すなわち、このエッジ強調に２ライン
あるいは３ラインのデータが必要なことから、メモリ１
−８に対して画像データのリード・ライトを繰り返しな
がら処理する。
【００２２】誤差拡散部３−４では、入力される多値デ
ータを２値化する。この２値化においては近傍画素の２
値化による誤差をメモリ１−８より読み出して注目画素
の２値化を行い、また、２値化により生じた誤差をメモ
リ１−８に格納する。
ータを２値化する。この２値化においては近傍画素の２
値化による誤差をメモリ１−８より読み出して注目画素
の２値化を行い、また、２値化により生じた誤差をメモ
リ１−８に格納する。
【００２３】２値化部３−５は、文字原稿等を２値化す
る場合に、単にあるスライスレベルを基準に２値化を行
う処理が行われる。セレクタ３−６は、誤差拡散部３−
４の出力か２値化部３−５の出力を選択して出力する。
る場合に、単にあるスライスレベルを基準に２値化を行
う処理が行われる。セレクタ３−６は、誤差拡散部３−
４の出力か２値化部３−５の出力を選択して出力する。
【００２４】従来、このような画像処理のプロセスにお
いては、図４に示すように、メモリアクセスを時分割に
行うことにより実現してきたが（図４中の時分割例に示
すアクセスサイクル１〜５を読み取りで使用）、本実施
例においては、図５に示すように、時分割することによ
り、制御部１−１のメモリアクセスをも可能とするもの
である。
いては、図４に示すように、メモリアクセスを時分割に
行うことにより実現してきたが（図４中の時分割例に示
すアクセスサイクル１〜５を読み取りで使用）、本実施
例においては、図５に示すように、時分割することによ
り、制御部１−１のメモリアクセスをも可能とするもの
である。
【００２５】制御部１−１のライトアクセスあるいはリ
ードアクセスが発生した場合に、図５中の時分割例に示
すアクセスサイクル６まで待ってメモリをアクセスする
ことにより、制御部１−１のメモリアクセスが可能とな
る。
ードアクセスが発生した場合に、図５中の時分割例に示
すアクセスサイクル６まで待ってメモリをアクセスする
ことにより、制御部１−１のメモリアクセスが可能とな
る。
【００２６】例えば一般的なマイクロプロセッサの機能
として、ＲＤＹ制御がサポートされている。この機能
は、リードアクセスあるいはライトアクセスをＩ／Ｏの
応答速度に合わせて実行できるものであり、一般的に
は、Ｉ／ＯとのＲＤＹ信号のやりとりによりアクセスを
実行する。
として、ＲＤＹ制御がサポートされている。この機能
は、リードアクセスあるいはライトアクセスをＩ／Ｏの
応答速度に合わせて実行できるものであり、一般的に
は、Ｉ／ＯとのＲＤＹ信号のやりとりによりアクセスを
実行する。
【００２７】従って、図６に示すように、ＲＤＹ信号を
図５中の時分割例に示すアクセスサイクル６のタイミン
グで返送することにより、制御部１−１のメモリアクセ
スが可能となる。なお、図４および図５における基本ク
ロックは、マイクロプロセッサのクロックであり、画素
クロックは、読み取り部１−５が処理する１画素単位の
クロックである。
図５中の時分割例に示すアクセスサイクル６のタイミン
グで返送することにより、制御部１−１のメモリアクセ
スが可能となる。なお、図４および図５における基本ク
ロックは、マイクロプロセッサのクロックであり、画素
クロックは、読み取り部１−５が処理する１画素単位の
クロックである。
【００２８】選択制御部１−７は、上記基本クロックに
従って選択するアドレスデータの経路を順番に切り替え
るだけでＳＲＡＭの時分割アクセスが可能である。
従って選択するアドレスデータの経路を順番に切り替え
るだけでＳＲＡＭの時分割アクセスが可能である。
【００２９】
【発明の効果】以上説明したように、本発明によれば、
画像処理に使用するデータとダイヤル情報等のデータを
それぞれアクセスするアドレスを切り替えることによ
り、メモリの異なるエリアを使い分けることで、同一の
メモリを使用して処理することが可能となり、大幅なコ
ストダウンが可能となる。
画像処理に使用するデータとダイヤル情報等のデータを
それぞれアクセスするアドレスを切り替えることによ
り、メモリの異なるエリアを使い分けることで、同一の
メモリを使用して処理することが可能となり、大幅なコ
ストダウンが可能となる。
【００３０】さらに、画像データをメモリに一時蓄積し
て画像処理を行う場合の１画素に対するメモリアクセス
サイクル数に対して、少なくても１アクセスサイクル追
加することにより、装置を管理するマイクロプロセッサ
装置が、容易かつ簡単な回路構成でメモリをアクセスす
ることが可能となる。
て画像処理を行う場合の１画素に対するメモリアクセス
サイクル数に対して、少なくても１アクセスサイクル追
加することにより、装置を管理するマイクロプロセッサ
装置が、容易かつ簡単な回路構成でメモリをアクセスす
ることが可能となる。
【図１】本発明の一実施例を示すブロック図である。
【図２】上記実施例においてメモリに蓄積されるデータ
の内容を示す説明図である。
の内容を示す説明図である。
【図３】上記実施例における読み取り部の構成を示すブ
ロック図である。
ロック図である。
【図４】従来の画像処理プロセスにおける動作タイミン
グ例を示すタイミングチャートである。
グ例を示すタイミングチャートである。
【図５】上記実施例の画像処理プロセスにおける動作タ
イミングを示すタイミングチャートである。
イミングを示すタイミングチャートである。
【図６】上記実施例のメモリアクセスの動作タイミング
を示すタイミングチャートである。
を示すタイミングチャートである。
１−１…制御部、 １−２…操作部、 １−３…通信制御部、 １−４…第２のメモリ、 １−５…読み取り部、 １−６…記録部、 １−７…選択制御部、 １−８…第１のメモリ、 １−９…バッテリ。
Claims (2)
- 【請求項１】 画像データをメモリに一時蓄積して画像
処理を行う画像処理手段と、装置を管理する制御装置が
扱うワークデータの中で、ダイヤル情報を含む所定デー
タを別途管理する管理手段とを有する画像処理装置にお
いて、 上記画像処理用のデータとダイヤル情報を含む所定デー
タとを、それぞれアクセスするアドレスを切り替える手
段により、異なるエリアを使い分けることで、同一のメ
モリを使用して処理することを特徴とする画像処理装
置。 - 【請求項２】 請求項１において、 画像データをメモリに一時蓄積して画像処理を行う場合
の１画素に対するメモリアクセスサイクル数に対して、
少なくても１アクセスサイクル追加することにより、上
記制御装置がメモリをアクセス可能とすることを特徴と
する画像処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7234813A JPH0965084A (ja) | 1995-08-21 | 1995-08-21 | 画像処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7234813A JPH0965084A (ja) | 1995-08-21 | 1995-08-21 | 画像処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0965084A true JPH0965084A (ja) | 1997-03-07 |
Family
ID=16976798
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7234813A Pending JPH0965084A (ja) | 1995-08-21 | 1995-08-21 | 画像処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0965084A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2005269615A (ja) * | 2004-02-17 | 2005-09-29 | Matsushita Electric Ind Co Ltd | ファクシミリ装置 |
-
1995
- 1995-08-21 JP JP7234813A patent/JPH0965084A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2005269615A (ja) * | 2004-02-17 | 2005-09-29 | Matsushita Electric Ind Co Ltd | ファクシミリ装置 |
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