JPH0965010A - 通信装置 - Google Patents
通信装置Info
- Publication number
- JPH0965010A JPH0965010A JP7234814A JP23481495A JPH0965010A JP H0965010 A JPH0965010 A JP H0965010A JP 7234814 A JP7234814 A JP 7234814A JP 23481495 A JP23481495 A JP 23481495A JP H0965010 A JPH0965010 A JP H0965010A
- Authority
- JP
- Japan
- Prior art keywords
- central processing
- line
- control unit
- line control
- processing unit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Facsimiles In General (AREA)
- Facsimile Transmission Control (AREA)
- Telephonic Communication Services (AREA)
Abstract
(57)【要約】
【課題】 確実な復旧手順を行うことができる通信装置
を提供することを目的とする。 【解決手段】 中央処理部と回線制御部とを有する通信
装置において、上記回線制御部は、中央処理部の指示に
従って回線ドライバに信号を与えるとともに、この回線
ドライバに与えられた信号をイネーブルにするかディセ
ーブルにするかは、上記回線制御部を介さず、上記中央
処理部が直接切り換えるようにした。具体的には、送信
中に、中央処理部が回線制御部の異常を検知した場合、
回線制御部を再立ち上げするのと同時に、中央処理部で
回線用ドライバＩＣを数秒間ハイインピーダンス状態に
なるように制御してから、レディ状態とする。
を提供することを目的とする。 【解決手段】 中央処理部と回線制御部とを有する通信
装置において、上記回線制御部は、中央処理部の指示に
従って回線ドライバに信号を与えるとともに、この回線
ドライバに与えられた信号をイネーブルにするかディセ
ーブルにするかは、上記回線制御部を介さず、上記中央
処理部が直接切り換えるようにした。具体的には、送信
中に、中央処理部が回線制御部の異常を検知した場合、
回線制御部を再立ち上げするのと同時に、中央処理部で
回線用ドライバＩＣを数秒間ハイインピーダンス状態に
なるように制御してから、レディ状態とする。
Description
【０００１】
【発明の属する技術分野】本発明は、中央処理部と回線
制御部とを有する通信装置に関し、特に通信中の異常切
断に関するものである。
制御部とを有する通信装置に関し、特に通信中の異常切
断に関するものである。
【０００２】
【従来の技術】一般に、ＮＴＴ（日本電信電話株式会
社）のデジタル交換網サービスの中に、回線交換サービ
スがあり、データ通信やファクシミリ装置などに利用す
ることができる。
社）のデジタル交換網サービスの中に、回線交換サービ
スがあり、データ通信やファクシミリ装置などに利用す
ることができる。
【０００３】そして、この回線交換サービスに関するＩ
ＴＵ−Ｔ勧告Ｘ．２１／Ｖ．１１で規定されている網に
接続する端末は、１５ピンのケーブルで、呼接続、呼切
断手順はＸ．２１のインターフェース条件を満たすよう
にならなければならない。
ＴＵ−Ｔ勧告Ｘ．２１／Ｖ．１１で規定されている網に
接続する端末は、１５ピンのケーブルで、呼接続、呼切
断手順はＸ．２１のインターフェース条件を満たすよう
にならなければならない。
【０００４】したがって、図６に示すように、Ｘ．２１
の呼切断手順（以下、復旧手順とする）の際には、回路
Ｃ（Ｃｏｎｔｒｏｌ）をＯＦＦ、回路Ｔ（Ｔｒａｎｓｍ
ｉｔ）を約２秒０にしてから１にするような手順を行わ
なければならない。
の呼切断手順（以下、復旧手順とする）の際には、回路
Ｃ（Ｃｏｎｔｒｏｌ）をＯＦＦ、回路Ｔ（Ｔｒａｎｓｍ
ｉｔ）を約２秒０にしてから１にするような手順を行わ
なければならない。
【０００５】例えば、上記のような復旧手順を行う場
合、中央処理部からの命令に応じて、回路制御部が回路
Ｃ、回路Ｔの制御を行うようになっていた。
合、中央処理部からの命令に応じて、回路制御部が回路
Ｃ、回路Ｔの制御を行うようになっていた。
【０００６】
【発明が解決しようとする課題】しかしながら、上記従
来例では、送信中に、回線制御部がノイズ、静電気など
の要因のため、プログラムの暴走を起こした場合、中央
処理部が回線制御部の異常に気付いても、中央処理部か
らの復旧命令を回線制御部は実行することができない。
そして、適切な復旧手順が実行されないと、図７の実線
にて示すように、回線は切断されず、課金されてしまう
という欠点があった。
来例では、送信中に、回線制御部がノイズ、静電気など
の要因のため、プログラムの暴走を起こした場合、中央
処理部が回線制御部の異常に気付いても、中央処理部か
らの復旧命令を回線制御部は実行することができない。
そして、適切な復旧手順が実行されないと、図７の実線
にて示すように、回線は切断されず、課金されてしまう
という欠点があった。
【０００７】本発明は、確実な復旧手順を行うことがで
きる通信装置を提供することを目的とする。
きる通信装置を提供することを目的とする。
【０００８】
【課題を解決するための手段】本発明では、中央処理部
は、回線制御部の異常を検知する手段を具備し、送信中
に、中央処理部が回線制御部の異常を検知した場合、回
線制御部を再立ち上げするのと同時に、中央処理部で回
線用ドライバＩＣを数秒間ハイインピーダンス状態にな
るように制御してから、レディ状態にするようにしたも
のである。
は、回線制御部の異常を検知する手段を具備し、送信中
に、中央処理部が回線制御部の異常を検知した場合、回
線制御部を再立ち上げするのと同時に、中央処理部で回
線用ドライバＩＣを数秒間ハイインピーダンス状態にな
るように制御してから、レディ状態にするようにしたも
のである。
【０００９】上述のようなハイインピーダンス状態によ
り、図８に示すように、網側は、あたかも回線ケーブル
がはずれているように見えるため、正規の復旧手順を踏
まなくても、回線が切断されることになる。
り、図８に示すように、網側は、あたかも回線ケーブル
がはずれているように見えるため、正規の復旧手順を踏
まなくても、回線が切断されることになる。
【００１０】
【発明の実施の形態および実施例】図１は、本発明の一
実施例によるファクシミリ装置の構成を示すブロック図
である。
実施例によるファクシミリ装置の構成を示すブロック図
である。
【００１１】読取部１−１は、原稿を読み取るためのＣ
ＣＤラインセンサや原稿搬送機構を有するものである。
画像記憶部１−２は、原稿の画像データを記憶するため
のメモリである。符号化／復号化部１−３は、原稿を送
信する際に、読み取った画像データをＭＭＲやＭＲに符
号化したり、符号化された状態で受信した画像データを
復号化したりするものである。
ＣＤラインセンサや原稿搬送機構を有するものである。
画像記憶部１−２は、原稿の画像データを記憶するため
のメモリである。符号化／復号化部１−３は、原稿を送
信する際に、読み取った画像データをＭＭＲやＭＲに符
号化したり、符号化された状態で受信した画像データを
復号化したりするものである。
【００１２】記録部１−４は、符号化／復号化部１−３
によって復号化された画像データを紙に記録するための
プリンタである。操作部１−５は、操作者が原稿の送信
やデータの登録等の各種キー操作を行うものであり、ボ
タン、液晶ディスプレイ、スピーカからなる。
によって復号化された画像データを紙に記録するための
プリンタである。操作部１−５は、操作者が原稿の送信
やデータの登録等の各種キー操作を行うものであり、ボ
タン、液晶ディスプレイ、スピーカからなる。
【００１３】中央処理部１−６は、このファクシミリ装
置の全体の制御を行うものであり、ファクシミリが動作
するためのプログラムを実行するＣＰＵ１−６−１と、
ファクシミリが動作するためのプログラムが記憶されて
いるＲＯＭ１−６−２と、ＣＰＵ１−６−１が動作する
ときのワークエリアとして使用する半導体ＲＡＭ１−６
−３と、各種の計時等を行うためのタイマ／カレンダＩ
Ｃ１−６−４とを有する。なお、上記ＲＡＭ１−６−３
の一部は、宛先情報や登録情報を保持するためにバッテ
リーバックアップされている。
置の全体の制御を行うものであり、ファクシミリが動作
するためのプログラムを実行するＣＰＵ１−６−１と、
ファクシミリが動作するためのプログラムが記憶されて
いるＲＯＭ１−６−２と、ＣＰＵ１−６−１が動作する
ときのワークエリアとして使用する半導体ＲＡＭ１−６
−３と、各種の計時等を行うためのタイマ／カレンダＩ
Ｃ１−６−４とを有する。なお、上記ＲＡＭ１−６−３
の一部は、宛先情報や登録情報を保持するためにバッテ
リーバックアップされている。
【００１４】回線制御部１−７は、外部のファクシミリ
装置と回線１−８を介して通信を行うためのものであ
り、特に回線制御用のプログラムを実行するＣＰＵ１−
７−１と、回線制御用のプログラムが記憶されているＲ
ＯＭ１−７−２と、ＣＰＵ１−７−１が動作するときの
ワークエリアとして使用する半導体ＲＡＭ１−７−３
と、通信手順における計時を行うためのタイマＩＣ１−
７−４と、回線１ー８に直接接続され、回線規格に準拠
した電気的特性を具備するドライバＩＣ１−７−５とを
有する。
装置と回線１−８を介して通信を行うためのものであ
り、特に回線制御用のプログラムを実行するＣＰＵ１−
７−１と、回線制御用のプログラムが記憶されているＲ
ＯＭ１−７−２と、ＣＰＵ１−７−１が動作するときの
ワークエリアとして使用する半導体ＲＡＭ１−７−３
と、通信手順における計時を行うためのタイマＩＣ１−
７−４と、回線１ー８に直接接続され、回線規格に準拠
した電気的特性を具備するドライバＩＣ１−７−５とを
有する。
【００１５】なお、図９は、ドライバＩＣ１−７−５の
構成を示すブロック図であり、図１０は、ドライバＩＣ
１−７−５の真理値表である。
構成を示すブロック図であり、図１０は、ドライバＩＣ
１−７−５の真理値表である。
【００１６】ドライバＩＣ１−７−５のインヒビット端
子ＣまたはＤは、中央処理部１−６に直接接続され、中
央処理部１−６からドライバＩＣ１−７−５をイネーブ
ルにしたり、ディセーブルにするを制御できるようにな
っている。
子ＣまたはＤは、中央処理部１−６に直接接続され、中
央処理部１−６からドライバＩＣ１−７−５をイネーブ
ルにしたり、ディセーブルにするを制御できるようにな
っている。
【００１７】また、信号線１−９は、各ユニット間を接
続する配線ケーブルであり、共有ＲＡＭ１−１０は、Ｃ
ＰＵ１−６−１、ＣＰＵ１−７−１の両方でアクセスで
きるＲＡＭである。
続する配線ケーブルであり、共有ＲＡＭ１−１０は、Ｃ
ＰＵ１−６−１、ＣＰＵ１−７−１の両方でアクセスで
きるＲＡＭである。
【００１８】図２、図３は、本実施例における中央処理
部１−６側の動作を示すフローチャートである。以下、
図１および図２を参照して中央処理部１−６側の動作に
ついて説明する。
部１−６側の動作を示すフローチャートである。以下、
図１および図２を参照して中央処理部１−６側の動作に
ついて説明する。
【００１９】ＣＰＵ１−６−１は、プログラムの先頭か
ら実行開始する。まず、プログラムが実行するために必
要なワークエリア（ＲＡＭ１−６−３）の初期化を行う
（Ｓ２−１）。
ら実行開始する。まず、プログラムが実行するために必
要なワークエリア（ＲＡＭ１−６−３）の初期化を行う
（Ｓ２−１）。
【００２０】次に、回線制御部１−７をリセットし（Ｓ
２−２）、リセット終了後、回線用ドライバＩＣ１−７
−５をイネーブルにする（Ｓ２−３）。回線制御部１−
７は、イネーブルになるまでに、回路ＣをＯＦＦ、回路
Ｔを１にしておく。このＳ２−２、Ｓ２−３により、回
路はレディ状態になる。
２−２）、リセット終了後、回線用ドライバＩＣ１−７
−５をイネーブルにする（Ｓ２−３）。回線制御部１−
７は、イネーブルになるまでに、回路ＣをＯＦＦ、回路
Ｔを１にしておく。このＳ２−２、Ｓ２−３により、回
路はレディ状態になる。
【００２１】次に、共有ＲＡＭ１−１０にマッピングさ
れているステータスを１にし（Ｓ２−４）、ステータス
用タイマをスタートさせる（Ｓ２−５）。
れているステータスを１にし（Ｓ２−４）、ステータス
用タイマをスタートさせる（Ｓ２−５）。
【００２２】ここで、回線１−８、回線制御部１−７を
介して、他のファクシミリから受信があった場合には、
Ｓ２−６で判断し、受信処理（Ｓ２−７）を行う。ま
た、受信がない場合には、Ｓ２−６で判断し、そのま
ま、Ｓ２−８に進む。
介して、他のファクシミリから受信があった場合には、
Ｓ２−６で判断し、受信処理（Ｓ２−７）を行う。ま
た、受信がない場合には、Ｓ２−６で判断し、そのま
ま、Ｓ２−８に進む。
【００２３】Ｓ２−８において、読取部１−１に原稿が
セットされ、操作部１−５で送信操作が行われると、送
信処理が行われる（Ｓ２−９）。それ以外の場合には、
Ｓ２−６に戻り、Ｓ２−６からＳ２−９の処理を条件に
応じて繰り返す。
セットされ、操作部１−５で送信操作が行われると、送
信処理が行われる（Ｓ２−９）。それ以外の場合には、
Ｓ２−６に戻り、Ｓ２−６からＳ２−９の処理を条件に
応じて繰り返す。
【００２４】図４、図５は、本実施例における回線制御
部１−７側の動作を示すフローチャートである。以下、
図１および図４を参照して、回線制御部１−７側の動作
について説明する。
部１−７側の動作を示すフローチャートである。以下、
図１および図４を参照して、回線制御部１−７側の動作
について説明する。
【００２５】ＣＰＵ１−７−１は、プログラムの先頭か
ら実行開始する。まず、初期化処理では、プログラムが
実行するために必要なワークエリア（ＲＡＭ１−７−
３）の初期化が行われる（Ｓ４−１）。
ら実行開始する。まず、初期化処理では、プログラムが
実行するために必要なワークエリア（ＲＡＭ１−７−
３）の初期化が行われる（Ｓ４−１）。
【００２６】次に、回線用ドライバＩＣ１−７−５の回
路ＣをＯＦＦにし（Ｓ４−２）、回線用ドライバＩＣ１
−７−５の回路Ｔを１にする（Ｓ４−３）。このＳ４−
２、Ｓ４−３により、回路はレディ状態になる。
路ＣをＯＦＦにし（Ｓ４−２）、回線用ドライバＩＣ１
−７−５の回路Ｔを１にする（Ｓ４−３）。このＳ４−
２、Ｓ４−３により、回路はレディ状態になる。
【００２７】次に、共有ＲＡＭ１−１０にマッピングさ
れているステータスを０にし（Ｓ４−４）、ステータス
用タイマをスタートさせる（Ｓ４−５）。
れているステータスを０にし（Ｓ４−４）、ステータス
用タイマをスタートさせる（Ｓ４−５）。
【００２８】Ｓ４−６において、回線１−８を介して、
他ファクシミリから受信があった場合には、その旨を中
央処理部１−６に通知し、中央処理部１−６の命令に従
って受信処理を行う（Ｓ４−７）。また、受信がない場
合には、Ｓ４−８に進む。
他ファクシミリから受信があった場合には、その旨を中
央処理部１−６に通知し、中央処理部１−６の命令に従
って受信処理を行う（Ｓ４−７）。また、受信がない場
合には、Ｓ４−８に進む。
【００２９】Ｓ４−８において、中央処理部１−６から
送信の要求がある場合、送信処理が行われる（Ｓ４−
９）。それ以外の場合には、Ｓ４−６に戻り、Ｓ４−６
からＳ４−９の処理を条件に応じて繰り返す。
送信の要求がある場合、送信処理が行われる（Ｓ４−
９）。それ以外の場合には、Ｓ４−６に戻り、Ｓ４−６
からＳ４−９の処理を条件に応じて繰り返す。
【００３０】次に、図５は、回線制御部１−７のタイマ
処理を示すフローチャートであり、図４のＳ４−５でス
タートしたステータス用タイマのタイムアップにより起
動されるプログラムである。
処理を示すフローチャートであり、図４のＳ４−５でス
タートしたステータス用タイマのタイムアップにより起
動されるプログラムである。
【００３１】ステータス用タイマがタイムアップする
と、共有ＲＡＭ１−１０にマッピングされているステー
タスを１にする（Ｓ５−１）。そして、ステータス用タ
イマをスタートさせる（Ｓ５−２）。
と、共有ＲＡＭ１−１０にマッピングされているステー
タスを１にする（Ｓ５−１）。そして、ステータス用タ
イマをスタートさせる（Ｓ５−２）。
【００３２】このタイマ処理により、回線制御部１−７
は、一定周期で共有ＲＡＭ１−１０にマッピングされて
いるステータスを０にするようになる。なお、タイマ値
は、５０ｍｓｅｃとする。
は、一定周期で共有ＲＡＭ１−１０にマッピングされて
いるステータスを０にするようになる。なお、タイマ値
は、５０ｍｓｅｃとする。
【００３３】次に、図３は、中央処理部１−６のタイマ
処理を示すフローチャートであり、図２のＳ２−５でス
タートしたステータス用タイマのタイムアップにより起
動されるプログラムである。なお、中央処理部１−６側
のステータス用タイマ値は、５ｓｅｃとする。
処理を示すフローチャートであり、図２のＳ２−５でス
タートしたステータス用タイマのタイムアップにより起
動されるプログラムである。なお、中央処理部１−６側
のステータス用タイマ値は、５ｓｅｃとする。
【００３４】Ｓ３−１において、共有ＲＡＭ１−１０に
マッピングされているステータスが０のとき、Ｓ３−４
に進む。共有ＲＡＭ１−１０にマッピングされているス
テータスが０以外のとき、回線制御部１−７をリセット
し、回線用ドライバＩＣ１−７−５を中央制御部１−６
から約２秒間ディセーブルにする（Ｓ３−２）。これに
より、回路Ｔ、回路Ｃは、２秒間ハイインピーダンス状
態となる。
マッピングされているステータスが０のとき、Ｓ３−４
に進む。共有ＲＡＭ１−１０にマッピングされているス
テータスが０以外のとき、回線制御部１−７をリセット
し、回線用ドライバＩＣ１−７−５を中央制御部１−６
から約２秒間ディセーブルにする（Ｓ３−２）。これに
より、回路Ｔ、回路Ｃは、２秒間ハイインピーダンス状
態となる。
【００３５】次に、回線用ドライバＩＣ１−７−５を中
央処理部１−６からイネーブルにする（Ｓ３−３）。こ
こまでに、回線制御部１−７は、回路ＣをＯＦＦ、回路
Ｔを１にして、イネーブルになることで、各回路の状態
が回線１−８に現れる（レディ状態）。
央処理部１−６からイネーブルにする（Ｓ３−３）。こ
こまでに、回線制御部１−７は、回路ＣをＯＦＦ、回路
Ｔを１にして、イネーブルになることで、各回路の状態
が回線１−８に現れる（レディ状態）。
【００３６】次に、共有ＲＡＭ１−１０にマッピングさ
れているステータスを１にし（Ｓ３−４）、ステータス
用タイマをスタートさせる（Ｓ３−５）。
れているステータスを１にし（Ｓ３−４）、ステータス
用タイマをスタートさせる（Ｓ３−５）。
【００３７】上記タイマ処理により、中央処理部１−６
は、一定周期で共有ＲＡＭ１−１０にマッピングされて
いるステータスを比較する。中央処理部１−６側のタイ
マ値は、回線制御部１−７側のタイマ値に比べて、はる
かに大きな値であるから、もし、ステータスが０以外の
場合、回線制御部１−７は、正常に動作していないとみ
なすことができる。
は、一定周期で共有ＲＡＭ１−１０にマッピングされて
いるステータスを比較する。中央処理部１−６側のタイ
マ値は、回線制御部１−７側のタイマ値に比べて、はる
かに大きな値であるから、もし、ステータスが０以外の
場合、回線制御部１−７は、正常に動作していないとみ
なすことができる。
【００３８】例えば、送信中（回路Ｔはデータを流して
おり、回路ＣはＯＮ）に、中央処理部１−６が回線制御
部１−７の異常を検出した場合、中央処理部１−６は回
線制御部１−７をリセットする。それと同時に、中央処
理部１−６は、回線用ドライバＩＣ１−７−５を中央処
理部１−６から約２秒間ディセーブルにする（Ｓ３−
２）。これにより、回路Ｔ、回路Ｃは、２秒間ハイイン
ピーダンス状態となる。この状態は、回線側からみる
と、回線ケーブルがつながれていないことと同じに見え
るため、網は呼を復旧する。
おり、回路ＣはＯＮ）に、中央処理部１−６が回線制御
部１−７の異常を検出した場合、中央処理部１−６は回
線制御部１−７をリセットする。それと同時に、中央処
理部１−６は、回線用ドライバＩＣ１−７−５を中央処
理部１−６から約２秒間ディセーブルにする（Ｓ３−
２）。これにより、回路Ｔ、回路Ｃは、２秒間ハイイン
ピーダンス状態となる。この状態は、回線側からみる
と、回線ケーブルがつながれていないことと同じに見え
るため、網は呼を復旧する。
【００３９】したがって、上記の異常状態において、不
要な通信料金を課されることなく、呼を復旧することが
できる。
要な通信料金を課されることなく、呼を復旧することが
できる。
【００４０】
【発明の効果】以上説明したように、本発明によれば、
通信中、回線制御部の異常状態を中央処理部が自動的に
検知し、回線制御部を再立ち上げし、さらに、回線用ド
ライバＩＣを数秒間、ディセーブルにすることで、回線
に対して複雑な復旧手順から実行することなく、呼を復
旧することができ、不要に課金をされることを防止でき
る点で有効である。このような安全機能により、装置の
信頼性をさらに向上することができる。
通信中、回線制御部の異常状態を中央処理部が自動的に
検知し、回線制御部を再立ち上げし、さらに、回線用ド
ライバＩＣを数秒間、ディセーブルにすることで、回線
に対して複雑な復旧手順から実行することなく、呼を復
旧することができ、不要に課金をされることを防止でき
る点で有効である。このような安全機能により、装置の
信頼性をさらに向上することができる。
【図１】本発明の一実施例を示すブロック図である。
【図２】上記実施例における中央処理部の動作を示すフ
ローチャートである。
ローチャートである。
【図３】上記実施例における中央処理部の動作を示すフ
ローチャートである。
ローチャートである。
【図４】上記実施例における回線制御部の動作を示すフ
ローチャートである。
ローチャートである。
【図５】上記実施例における回線制御部の動作を示すフ
ローチャートである。
ローチャートである。
【図６】通常の復旧手順を示すタイミングフローチャー
トである。
トである。
【図７】異常発生時の復旧手順を示すタイミングフロー
チャートである。
チャートである。
【図８】上記実施例における復旧手順を示すタイミング
フローチャートである。
フローチャートである。
【図９】上記実施例における回線ドライバＩＣの構成を
示すブロック図である。
示すブロック図である。
【図１０】上記実施例における回線ドライバＩＣの真理
値表を示す説明図である。
値表を示す説明図である。
１−１…読取部、 １−２…画像記憶部、 １−３…符号化／復号化部、 １−４…記録部、 １−５…操作部、 １−６…中央処理部、 １−６−１、１−７−１…ＣＰＵ、 １−６−２、１−７−２…ＲＯＭ、 １−６−３、１−７−３…ＲＡＭ、 １−６−４…タイマ／カレンダＩＣ、 １−７…回線制御部、 １−７−４…タイマＩＣ、 １−７−５…ドライバＩＣ、 １−８…回線、 １−９…配線、 １−１０…共有ＲＡＭ。
Claims (3)
- 【請求項１】 中央処理部と回線制御部とを有する通信
装置において、 上記回線制御部は、中央処理部の指示に従って回線ドラ
イバに信号を与えるとともに、この回線ドライバに与え
られた信号をイネーブルにするかディセーブルにするか
は、上記回線制御部を介さず、上記中央処理部が直接切
り換えることを特徴とする通信装置。 - 【請求項２】 中央処理部と回線制御部とを有する通信
装置において、 上記中央処理部は、回線制御部の異常を検知する異常検
知手段を具備し、通信中に、中央処理部が回線制御部の
異常を検知した場合に、中央処理部は、回線制御部を介
さず、回線ドライバを直接ディセーブルにしてハイイン
ピーダンス状態にすることを特徴とする通信装置。 - 【請求項３】 請求項２において、 上記回線制御部は、３ステート回線ドライバを具備し、 上記中央処理部が上記異常検知手段を用いて回線制御部
を監視し、回線制御部の異常を検知した場合に、中央処
理部は、回線制御部を介さず、３ステート回線ドライバ
を直接ディセーブルにしてハイインピーダンス状態にす
ることを特徴とする通信装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7234814A JPH0965010A (ja) | 1995-08-21 | 1995-08-21 | 通信装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7234814A JPH0965010A (ja) | 1995-08-21 | 1995-08-21 | 通信装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0965010A true JPH0965010A (ja) | 1997-03-07 |
Family
ID=16976814
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7234814A Pending JPH0965010A (ja) | 1995-08-21 | 1995-08-21 | 通信装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0965010A (ja) |
-
1995
- 1995-08-21 JP JP7234814A patent/JPH0965010A/ja active Pending
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