JPH09223741A - 半導体デバイスの空洞を充填する方法 - Google Patents
半導体デバイスの空洞を充填する方法Info
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Abstract
する。 【解決手段】 低抵抗電気的接続を提供する多段階の工
程において、半導体デバイスに形成されるバイア及び接
点などの空洞が充填される。先ず、続いて堆積される充
填材料の「ウェッティング」を高めるよう比較的低パワ
ー及び堆積速度で、ライナーが空洞内に堆積される。充
填材料は、空洞の口を閉じるよう比較的大きなパワー及
び堆積速度で堆積され、その後、空洞を実質的に充填す
るよう充填材料が空洞に高圧で押しやられる。従来の処
理温度で熱的に不安定であった低誘電率材料を用いるこ
とができるよう、比較的低処理温度及び高圧が用いられ
る。
Description
し、更に詳細には半導体の隣接する表面間又は隣接する
レベル間の空洞充填に関連する。
は多くの障害がある。これらの障害には、デバイスの適
切な動作を保証する金属相互接続層の充填がある。金属
相互接続信号ラインは、集積回路の絶縁層に形成される
バイアを介してより低導電性の層との接点(コンタク
ト)を構築する。デバイスの最適な動作を保証するよう
に、相互接続層を形成するために用いられる金属を用い
てバイアを完全に充填することが望ましい。
と、集積回路の金属相互接続ライン製造のための金属の
現在の候補はアルミニウムである。相互接続ラインは、
典型的にスパッタリング工程によって形成されるが、そ
れは接点バイアの最適な充填よりは劣る。例えば、絶縁
層の上側表面に比較的大量のアルミニウムが蓄積するこ
とから問題が生じ得る。接点バイアの端部のアルミニウ
ムの蓄積は、バイアを完全に充填するために十分な量の
アルミニウムをデリバリーする前にバイアをブロックす
るか妨害することがあり、結果としてバイア内に隙間や
不均等な構造が形成される。集積回路はより小さなジオ
メトリーを用いて製造されるため、この問題は特に深刻
である。従来の0.5mmや次世代の更に微小化される
技術などのジオメトリーのより小さなデバイスにおいて
用いられる、より微細な寸法の接点は、ジオメトリーの
より大きなデバイスよりも大きな縦横比(高さと幅の関
係)を有する必要があり、それにより上述の様にバイア
充填の欠点を悪化させる。例えば過度に大きな隙間は、
設計よりかなり高い接点抵抗をもたらし得る。更に、バ
イア充填領域に隣接する薄いアルミニウム層は電子移動
(electromigration)し易く、結果として回路の開口や
デバイスの欠陥をもたらす。
点を保証するために多くの異なるアプローチが試みられ
ている。例えば、バイア全体の導電性を改善するため、
アルミニウム相互接続層と共に難溶性金属層が用いられ
ている。更に、バイア側壁は、バイアへの段階的金属デ
リバリーを改善するように傾斜されている。しかし、産
業がより小さなデバイスジオメトリーを取り入れてお
り、傾斜された側壁を用いることは望ましくないものに
なっている。0.5mmより大きなジオメトリーにおい
てさえ、前述した技術はバイア充填の問題点を完全には
克服していない。従来のバイア充填の問題は、バイア充
填に付随して(incident to )アルミニウムが処理され
る比較的低圧及び低温に少なくとも部分的に起因すると
考えられている。これらの温度は典型的に500℃より
低く、これがバイア充填にとって過度に大きなアルミニ
ウム粒径を形成する一因であると、いくつかの製造業で
は考えられている。
国特許番号第5,108,951号は、過度に大きなア
ルミニウム粒径のフローから起こる、前述のバイア充填
の問題を扱っている。チェンの特許において、集積回路
の温度はアルミニウム堆積の開始前に約400℃の温度
まで加熱される。ウエハーが約500℃の温度まで加熱
される間、約30−80ミクロン/sec の速度でアルミ
ニウムがバイアへ堆積される。この先行技術のシステム
は、特により小さなバイアジオメトリーにおける不十分
なバイア充填など、前述の先行技術と同様の欠点の多く
を有している。更に、バイア充填は約500℃付近の温
度で行なわれ、新しい世代の低誘電率の重合体材料はこ
のような高温では典型的に分解するため、これらの重合
体材料の多くを誘電体として利用することは事実上不可
能である。
低温、好ましくは約250℃−400℃若しくはそれよ
り低い温度で、信頼性のある充填を提供する接点および
バイアの集積回路充填工程を提供することが望ましい。
このような低温の接点及びバイア充填により、パリレ
ン、エーロゲル、 及びキセロゲルなどの誘電率のより低
い誘電材料を半導体製造に用いることが可能になる。こ
れらの低誘電率誘電体を用いることは、次世代の0.5
mm以下の技術の開発の重要な側面となると考えられて
いる。
の問題点の結果から、例えばパリレン、エーロゲル及び
キセロゲルの様な、従来技術の空洞充填工程では高温が
必要なためにこれまで利用を制限されていた次世代の低
誘電率ポリマーを用いることができる範囲の温度であ
る、約250℃−400℃又はそれ以下の比較的低温
で、作動可能な集積回路接点及びバイアの充填を提供す
ることが望ましい。
は、半導体デバイスの他の側面を損なわずに、アルミニ
ウム、アルミニウム合金、銅タンタル、銅、及び銅合金
で充填することができる点でも利点となる。接点、トレ
ンチ、及びバイア(「ホール」及び「開口」と共に総称
して「空洞」としている)は、充填される空洞が例えば
約0.4−1.9Ω/via の範囲のバイア抵抗を有する
方法で、本発明に従ってこれらの材料を用いて充填され
る。このバイア抵抗は、従来技術のバイア充填工程を経
たバイアで現在達成できるもの(〜2−〜5Ω/via )
よりずっと低い。
術において集積回路の誘電体に形成される接点、トレン
チ、及びバイアの高度な充填が可能な改良された充填工
程が提供される。空洞充填は、比較的薄いライナーの堆
積、それに続く空洞の口を閉じるためのより厚い空洞充
填層の堆積と、空洞充填を完了させるために空洞に更に
その充填層を押しやる高圧処理との2段階工程で行なわ
れることが好ましい。第1段階において、約50−10
0nmの比較的薄いライナーが空洞の内面に沿って堆積
される。堆積は、高度に均一化された(conformity)ラ
イナーを提供するよう、約1−2nm/secの比較的
遅い速度であることが望ましい。ライナーは、約250
℃−400℃の間の温度並びにPVD のためには3−5m
Torrの真空圧(vacuum pressure )での高密度プラ
ズマ・スパッタリング、化学蒸着、コリメートされたコ
ールド・スパッタリング、又は約250℃−400℃の
間の温度で、適切なコンフォーミティを備えた実質的に
均一な薄い金属層を堆積することのできる、別の適切な
工程によって提供され得る。
に、好ましくは完全に、閉じるのに十分な量のより厚い
導電性金属充填層がライナー上に提供される。この第2
のより厚い堆積は、空洞の口を閉じるために約250℃
−400℃の間の温度で約15−20nm/secの比
較的速い堆積速度で行なわれる。第2空洞充填は、スパ
ッタリング、化学蒸着(「CVD」)、又は約2−4m
Torrの真空圧の高密度プラズマ充填によって提供さ
れ、空洞の口を閉じる約500−550nmの厚さの層
になる。第2堆積層は、500−1200atm の範囲で
好ましくは不活性又は非反応性雰囲気で圧力を印加する
ことにより、空洞の中に入れられ、実質的に空洞の充填
が終了する。好ましい印加圧力の範囲は650−100
0atmである。前述の記載に従って提供された空洞ラ
イナー及び充填層の全体の厚さは約550−650nm
である。
l−Cu(〜0.5−〜4%)、(2)Al−Ge(〜
0.5−〜5%)−Cu(〜0−〜4%)、(3)WS
iX(2<x<2.4)、(4)TiSi2 、(5)A
l−Sc(〜0.1−〜0.3%)、(6)TiN、
(7)TiW、(8)タングステン、(9)Al(〜1
%)−Si(〜1%)−Cu、(10)Al(〜1%)
−Si(〜0.5%)−Sc、(11)チタン、(1
2)チタン(〜0−〜25%)−アルミニウム合金が含
まれ、個別に又は互いに組合されて用いられ、抵抗が約
90μΩcmより小さいことが好ましい。アルミニウム
溶解温度を下げるために、ライナー層として堆積される
アルミニウムと反応させるためゲルマニウム及び/又は
シリコンを個別ライナー層として加えることもできる。
溶解温度の低下は、第2アルミニウム合金を変形させて
そのアルミニウム合金を空洞に押しやる(extrude )の
に必要なフロー応力を下げることになり、処理温度も低
下させる。第2充填層は以下の材料から構成され得る。
(1)Al−Cu(〜0.5−〜4%)、(2)Al−
Ge(〜0.5−〜5%)−Cu(〜0−〜4%)、
(3)Al−Sc(〜0.1−〜0.3%)、(4)A
l(〜1%)−Si(〜1%)−Cu、(5)Al(〜
1%)−Si(〜0.5%)−Scであり、個別に又は
互いに組合せて用いられ、抵抗が約3.5μΩcmより
小さいことが好ましい。本発明に従う空洞充填は、ごく
わずかな気圧(比較できる真空レベルで典型的に約1−
4Torrのオーダー)、典型的に約500℃を超える
温度で、空洞充填及び押出しを行う従来技術のものと明
らかに異なる。本発明の工程は、前述の金属及び金属合
金に適用可能であり、それぞれの空洞に充填される材料
の様々な物理的及び化学的特性に応じて、上述の処理パ
ラメータが調整される。
とき、このような重合体絶縁体は典型的に約400℃以
上の温度で分解されるため、本発明の処理方法が特に有
効である。このような重合体絶縁体には、非制限的な例
として、ポリテトラフルオロエチレン(「PTFE」)
族化合物、約1.9の誘電率(κ)であるパリレン(κ
=〜2.2−2.6)、エーロゲル及びキセロゲル(κ
=〜1.1から1.8)が含まれ、これら全てが相互接
続の寄生静電容量を減少できる点で非常に魅力的であ
る。本発明に用いられるその他の導電材料は、アライド
・シグナル社製の1500シリーズ等の重合体族スピン
・オン・ガラス(「SOG」)材料、PTFE族化合
物、パリレン、ポリイミド、ハイドロジェン・シリセス
キオキサン(silisesquioxane )、エーロゲル及びフッ
化及びメチル化エーロゲル等の表面修正エーロゲルを含
み、これらは全て参照のため引用している後述の同時係
属中の特許出願のいずれかに詳細に説明されている。
(1)特許出願番号08/234,100、1994年4月
28日出願、発明の名称『低許容誘電体を用いる自己整合
バイア』、(2)特許出願番号08/286,761、
1994年8月5日出願、発明の名称『電子機器用パッシベ
ーション層を有する多孔性誘電体層』(3)特許出願番
号08/294,290、1994年8月23日出願、発明の
名称『有機含有誘電材料を用いた自己整合コンタク
ト』、(4)特許出願番号08/246,432、1994
年5月20日出願、発明の名称『集積された低密度の誘電
体を有する相互接続構造』、(5)特許出願番号08/
333,015、1994年11月1日出願、発明の名称『改
良されたダマスク法(damascene )導電体製造のための
柱体』。
誘電材料の組合せにより形成される空洞の完全な充填を
保証するために用いることもできる。本発明の処理技術
はダマスク族及びデュアル・ダマスク工程技術に適用で
き、酸化物又は他の誘電体に溝が機械的に削られるか
(abrade)エッチングされるか又はその他の方法で形成
され、その後、化学蒸着(「CVD」)などの適応する
堆積工程において金属(通常はタングステン又は銅)で
満たされ、その後、提供された金属が実施的に誘電体の
表面と同一平面になるように磨かれるか削られる。デュ
アル・ダマスク工程において、削られるかエッチングさ
れるか又は別の方法で誘電体に溝が形成されるだけでな
く、更にそれに、金属の上側レベルから誘電体を通って
金属の下側レベルまで伸びるようにバイアがパターニン
グされてエッチングされる。上述の全ての誘電体は、本
発明の記載に従うダマスク及びデュアル・ダマスク工程
において用いるのに適している。
製造の工程の完全な流れを形成するものとは限らないこ
とを理解されたい。本発明は、現在この分野で用いられ
ている半導体製造工程技術と共に実施されることがで
き、通常実施される工程の多くは本願発明の理解を与え
るに必要なものとしてここに含まれていない。本明細書
に含まれ、製造過程の集積回路の部分の断面をあらわす
図面は、一定の比例に拡大・縮小して描かれたのではな
く本発明に関連する特徴を説明するために図示されてい
る。
続/バイア充填のアルミニウム・リフローは以前に説明
されている。しかし、アルミニウム・リフロー工程は、
堆積に高温が必要であり、USLI回路の高縦横比の接
点及びバイアのグローバルな充填が困難であるため広く
受け入れられていない。実用可能な(viable)アルミニ
ウム・リフロー技術は、従来のタングステン・プラグ技
術と比べ同等またはより良いイールド及び信頼性を達成
し得る必要があるため、グローバル充填は0.5mm以
下のアプリケーションに特有な問題である。本発明の工
程は、400℃より低い温度での高度なアルミニウム充
填が0.5mm以下のアプリケーションで実用可能な工
程であることを示す。
べ、アルミニウム充填技術の利点は、低抵抗の接点/バ
イア、より少ない工程、改良された電子移動性能を提供
することを含む。従来のアルミニウム・リフロー工程の
主な欠点は、リフローが表面状態及びホールの形状(pr
ofile )に敏感であることであった。従来のホット・ス
パッタ蒸着及び/又はリフロー工程は、吸着原子の拡散
可動性に依存する。接点/バイアのより高い縦横比及び
ホールの入り口にスパッタされる障壁層の典型的な突出
は、リフロー特性に悪影響を及ぼす。結果として、グロ
ーバル充填を通常の再生可能なバイアで達成することは
困難であった。
同時係属中のテキサス・インスツルメンツのG.Dix
it及びR.Havemannの特許出願番号第08/
354,590、発明の名称「高圧低温半導体空洞充填
工程」、1994年12月12日出願、に記載されており、参照
のためここに引用する。このDixit−Havema
nn特許出願において、同一の(identical )Al−C
u合金を用いる空洞充填データが提供され、金属リード
及びバイアの電子移動の信頼性のあるデータも示され、
高圧で低温の工程の効果も示されている。
横比の0.5mm以下の開口部又はギャップを実質的に
完全に充填することのできるグローバルアルミニウム開
口/ギャップ充填技術を提供し、これにより、例えばパ
リレン、エーロゲル、及びキセロゲルのような新しい世
代の誘電体を用いることが可能となる。これらの材料
は、約2.5より小さい低誘電率(κ)を提供する利点
があるが、約400℃から500℃の範囲である従来の
充填処理温度では分解してしまう。結果として、これら
の材料を半導体設計にフルに利用することは不可能であ
った。
号は同様の部分を示す。特に図1を参照すると、数字2
0は、例えばカルフォルニア、サン・ホセのアプライド
・マテリアル・インコーポレーティッド及びイギリス、
ブリストルのエレクトロテックLtd.などによって製
造されたもののような、本発明の処理手段のいくつかを
実施するために用いることのできる、高圧処理システム
の例を示す。図示された高圧システム20は、一般的に
6角形の「ハブ・アンド・スポーク」形状であり、1つ
又はそれ以上の半導体ウエハ・カセット(図示せず)を
カセット・ロード・ゾーン24から圧力可変ロード・ド
ック26を介して運ぶ動作が可能なカセット・ハンドラ
ー22を有する。ロード・ドック26は異なる真空レベ
ル間で回転することが可能であり、以下に示すように、
カセットはハンドラー22によって異なるプロセス・チ
ャンバーへ転送され得る。
よってウエハーが処理されるにつれて、ウエハーをカセ
ットからプロセス・チャンバーに転送しカセットに戻す
動作が可能な、回転可能で伸長可能なアームで構成され
る。ハンドラー22によって転送されるウエハーのカセ
ットに必要とされ得る予備熱処理を実施するために加熱
ステーション28が提供される。ウエハーは、本発明に
従う空洞ライナー金属の堆積のため、ハンドラー22に
よって物理的蒸着(「PVD」)ステーション30に転
送され得る。あるいは、以下に示すように、本発明に従
う空洞充填金属の提供のため、カセットはハンドラー2
2によって1つ又はそれ以上の下記のステーション、即
ち化学蒸着(「CVD」)ステーション32、ハイパワ
ー/高速蒸着PVDステーション33、ソフト・スパッ
タ・エッチ・ステーション34、高密度プラズマ・スパ
ッタ・ステーション36、及び高圧処理ステーション3
8、に転送され得る。エッチ・チャンバー34は、エッ
チングの間のウエハーの熱処理を促進するための加熱ス
テーション(図示せず)を任意で含んでいても良い。モ
ニター40もデバイス20内でのウエハーの経過を表示
するために種々の制御装置に任意に接続され得る。
いたような従来のバイア及び同様の空洞充填工程は、典
型的に約450℃付近又はそれ以上の温度で作動する高
圧押出し(extrusion )工程でアルミニウム合金を用い
ている。しかし、新しく次世代に期待されている誘電率
材料は400℃より低い分解温度を有するため、このよ
うな高温処理を用いることはできない。例えば、誘電体
パリレンは約2.2−2.6の誘電率κである。他の誘
電体、例えばエーロゲル、キセロゲルは更に低い分解温
度(400℃より低い)を有し約1.1−1.9の低誘
電率κである。
MD)及びインターレベル−メタル誘電体(IMD)の
化学機械的平坦化を用いる、0.35mmCMOSダブ
ル−レベル−メタル(DLM)フロー(図示せず)を介
する工程など、従来の工程に従ったシリコンウエハーの
一部が示されている。接点、バイア及びトレンチは、図
に示すバイア42のように、プラズマ・エッチングが後
に続く位相シフトIライン・リソグラフィを用いるなど
の従来の方法で、誘電体層41にパターニングされ得
る。
処理方法の熱的余裕(budget)による影響を受ける。新
しい世代の低誘電率誘電体(即ち、κ<〜2.5の誘電
体を有する)をフルに利用するために、処理温度が40
0℃−500℃の範囲から約250℃−400℃の範囲
に下げられるとき、熱の低下と、これらの修正した条件
で材料を充填する実施例に有効な関連する力により、完
全なバイア充填を達成することがさらに困難になる。
填金属と接続する材料との間の「ウェッティング」又は
「可分散性(dispersibility)」によって影響を受け
る。材料の「ウェッティング」は、表面を覆うその材料
の能力に関連する。2つの材料間のウェッティングは、
材料表面の張力(tension) および界面エネルギーに関連
する。空洞充填におけるこれらのパラメータを図2A−
2Cに示す。図2Aにおいて、充填材料43および空洞
内壁44の間のプア・ウェッティングが示されている。
プア材料ウェッティングは、材料を空洞へ導くアプリケ
ーション・フォース(α)に対向する材料43および空
洞壁44の間の摩擦力(frictional force)(β)のた
め、材料43の空洞へのフローを妨げる。結果として、
材料は空洞壁44とのかみ合い(engagement)に抵抗す
るため、その充填材料のリード表面43aは凸型にな
る。尾の部分、即ち充填材料上側表面43bは、充填材
料に加えられるネット・フロー・フォース(F)の結
果、凹型になる。このように、フロー・フォース(即
ち、充填材料43を空洞42に導くほど強い力(F))
は、アプリケーション・フォース(α)および摩擦フォ
ース(β)の合計に関連している。
填材料の最適なウェッティングは、アプリケーション・
フォース(α)および摩擦フォース(β)の差に関連し
ている。充填材料のリード表面43aは、空洞壁とかみ
合う面が増加するため、凹型になる。そのため、最適な
ウェッティングおよび処理温度の低下を可能にするよう
に、低界面エネルギーを示す充填材料および空洞壁用材
料を選択することが望ましい。これは図2Cに図示して
おり、Eは「界面エネルギー」、δは「接点角度」(即
ち、例えば空洞壁44の様な隣接する壁と提供された材
料43との間の角度)、τa は固定(stationary)材料
(即ち、図2Aの空洞壁44)表面張力、更にτb は提
供された材料43の表面張力を表す。界面エネルギー
(E)、接点角度(δ)、および各表面張力(τa およ
びτb )は、下記の式で表される。
つれて、接点角度δもゼロに近づく。空洞充填材料の使
用に関連する界面エネルギーE(バイア、接点、トレン
チなどの充填に付随して起こり得るもの)は、本発明の
実施に従う2段2層工程の充填材料を用いることによっ
て低減できる。
を拡大して示しており、シリコン45の層上の誘電体層
に形成されるバイア42を示す。誘電体層は、好ましい
電子的及び処理特性を有する周知の種々の誘電体のいず
れから構成されていてもよく、本発明において特に利点
である、前述の新しい世代の低誘電率(κ)誘電体(即
ち、κ<〜2.5)の一つの形であってもよい。
材料は、後に提供される第2充填層46”のウェッティ
ングを促進するため空洞ライナー46’が提供される多
層構造の形であり、充填空洞を横切る電気的導電性を最
適化する。ライナー46’は、(1)Al−Cu(〜
0.5−〜4%)、(2)Al−Ge(〜0.5−〜5
%)−Cu(〜0−〜4%)、(3)WSiX (2<x
<2.4)、(4)TiSi2 、(5)Al−Sc(〜
0.1−〜0.3%)、(6)TiN、(7)TiW、
(8)タングステン、(9)Al(〜1%)−Si(〜
1%)−Cu、(10)Al(〜1%)−Si(〜0.
5%)−Sc、(11)チタン、(12)チタン(〜0
−〜25%)−アルミニウム合金などの金属又は金属合
金から構成され、前述の任意の材料(1)−(12)は
個別に又は互いに組合せて用いられ、以下により詳しく
説明するように、バイア42を充填する1つ又はそれ以
上の前述の金属合金から形成される合金第2層46”の
ウェッティングを促すような金属又は金属合金から構成
される。提供されるライナーは、約90μΩcmより小
さい抵抗であることが好ましい。
される場合、ライナーは実質的に均一な構成のライナー
を生成するように反応する金属層上に個別に提供され得
る。例えば、Ti−Alライナーはチタンの5−10n
mの厚い層をまず堆積し、その後、約100nmの厚さ
までアルミニウム層を堆積することによって形成され得
る。堆積されたライナー層は互いに反応して、Al:T
iの比率が約10−20:1であるような実質的に均一
なTi−Alライナーにする。チタン・ライナー層は、
約350℃までの温度で、約3−5mTorrの真空内
で提供され得る。アルミニウム・ライナー層は、約30
0℃までの温度で、約3−5mTorrの真空内で提供
され得る。ゲルマニウムおよび/又はシリコンは、ライ
ナー層として堆積されるアルミニウムと反応する個別ラ
イナー層として前述の方法で提供され、アルミニウム溶
解点を下げ、それにより空洞の表面にそった均一な堆積
を促進するように、そのフロー圧力を低下させる。
層と同様に、空洞内のより均一性の高い金属堆積を可能
にするため、約350℃より低い温度で約1−2nm/
secの堆積速度で堆積されることが好ましい。このよ
うな堆積は、高圧処理システム20(図1)の特定のス
テーション30−38で又は他の適応する装置で、空洞
の表面44に沿って約50−100nmの間の厚さの比
較的均一な導電性金属層46’にすることのできる、高
密度プラズマ・スパッタリング、化学蒸着、コリメート
されたコールド・スパッタリング、又は他の適応する低
温工程によって達成され得る。
エハー処理システム20から選択された処理ステーショ
ンに従って、スパッタリング、化学蒸着、又は高密度プ
ラズマ蒸着によって、ライナー46’の上に堆積され得
る。図3に示すように、提供された第2層46”は、そ
の後、流入に対する抵抗力βを超えるに十分な圧力αで
空洞42内に入れられる。第2層46”とライナー4
6’との間の最適なウェッティングは、第2の厚い(bu
lk)金属層46”が、第2層の下側の表面46”aの凹
型によって示されるように、層46”が空洞の壁44に
ボンドする(bond)より容易にライナー46’にボンド
するときに、2層充填の結果として得ることができる。
第2層46”は、約15−20nm/secの比較的速
い堆積速度で約350℃−400℃の温度で約2−4m
Torrの真空圧で提供され、空洞の閉口を保証するこ
とが好ましい。
nmの厚さで空洞充填金属全体が約500−600nm
であることが好ましい。ライナー46’は、第2空洞充
填層46”とライナー46’との間に小さな隙間がある
場合でも、バイアを横切る連続導電パスを提供する。空
洞充填は、約500−1200atm、好ましくは65
0−1000atmの範囲の圧力を、非反応性、好まし
くは不活性ガス環境内で印加することにより完了する。
好ましい不活性ガスにはヘリウムとアルゴンがある。ラ
イナー46’、第2空洞充填層46”材料、および同様
の各化合物のそれぞれに応じて、温度および圧力のパラ
メータを変えることができる。このような高圧処理は、
図1に関連して説明したタイプの高圧モジュール38の
真空下で達成され得る。図4でより詳しく説明するよう
に、このような圧力モジュール38は、ウエハー処理温
度の制御を提供できる2つの放射加熱器50aおよび5
0bを有する高圧チャンバー48を有し得る。第2空洞
充填層46”は、アルゴンなどの適切な非反応性又は不
活性ガスでチャンバー48に圧力を印加することによっ
て、半導体空洞44および関連するライナー46’内に
入れられ、インレット52を通って運ばれ、完全な空洞
充填を実質的に達成する。
は以下の合金のいずれか一つの合金から構成されること
が好ましい。(1)Al−Cu(〜0.5−〜4%)、
(2)Al−Ge(〜0.5−〜5%)−Cu(〜0−
〜4%)、(3)Al−Sc(〜0.1−〜0.3
%)、(4)Al(〜1%)−Si(〜1%)−Cu、
(5)Al(〜1%)−Si(〜0.5%)−Sc、又
は上述の種々の組合せであり、抵抗が約3.5μΩcm
より小さい充填材料であることが好ましい。本発明の好
ましい実施例において、第1および第2空洞充填層4
6’及び46”は、充填される空洞のウェッティングを
最適化し電気抵抗を最小化するため、同一又は実質的に
同一の金属合金から形成される。
バイアのSEM断面図を示す。どちらの場合も、バイア
はシリコン層上のBPSG−TEOS誘電体を通って伸
びる。図5Aの高圧空洞充填は「ウェッティング」を高
めたライナーがない場合であり、充填材料と空洞壁のウ
ェッティングが不完全で不規則であるため、不完全な空
洞充填になる。各バイアにあらわれている黒い不規則な
形の部分は、充填材料が流れていない空洞の隙間であ
る。図示したバイア充填は、ウエハーを約380℃の温
度で約4分間ベーキングし、約350℃の温度でAl−
Cu(〜0.5%)の堆積、及び約650atmの圧力
の高圧押出しによるバイア充填によって達成される。図
5Bにはこのような黒い部分はあらわれておらず、実質
的に均一なバイア充填が達成される本発明の高度なアル
ミニウム充填技術を示す。図5Bにおいて、空洞充填
は、約350℃の温度で約4分間ウエハーのベーキン
グ、及びその後のチタン及びTiNライナー層のスパッ
タ蒸着によって達成される。Al−Cu(〜0.5%)
合金は、約350℃の温度でスパッタリングによって堆
積され、その後、Al−Cuは約650atmの圧力で
アルゴン雰囲気中でバイアに押出される。
関して説明したが、添付の特許請求の範囲によって定め
られた本発明の範囲内で、本発明の種々の変形、代替、
及び変更が成され得ることは言うまでもない。
る。 (1) 半導体デバイスの空洞を充填する工程であっ
て、表面と、前記表面から少なくとも部分的に半導体基
板に伸びる少なくとも一つの空洞を有する半導体基板を
提供し、前記空洞は開口端を有し、空洞の壁によって定
められ、前記半導体基板を約250℃から約400℃の
間の温度まで加熱し、前記空洞壁に沿って金属ライナー
を堆積し、前記空洞へ前記空洞開口端を閉じるのに充分
な量の空洞充填金属を堆積し、前記空洞へ前記金属充填
を導くよう前記空洞充填に約500−1200atmの
間の圧力を印加する工程を含む半導体デバイスの空洞を
充填する工程。
記金属ライナーは約90μΩcmより小さい抵抗を有す
る工程。
記金属ライナーは、後述の化合物の内の1つ又はそれ以
上から実質的に構成される組合せから選択される工程。
(1)Al−Cu(〜0.5−〜4%)、(2)Al−
Ge(〜0.5−〜5%)−Cu(〜0−〜4%)、
(3)WSiX (2<x<2.4)、(4)TiS
i2、(5)Al−Sc(〜0.1−〜0.3%)、
(6)TiN、(7)TiW、(8)タングステン、
(9)Al(〜1%)−Si(〜1%)−Cu、(1
0)Al(〜1%)−Si(〜0.5%)−Sc、(1
1)チタン、(12)チタン(〜0−〜25%)−アル
ミニウム合金、であり個別に又は互いに組合せて用いら
れる。
記金属フィルは後述の化合物の内の1つ又はそれ以上か
ら実質的に構成される組合せから選択される工程。
(1)Al−Cu(〜0.5−〜4%)、(2)Al−
Ge(〜0.5−〜5%)−Cu(〜0−〜4%)、
(3)Al−Sc(〜0.1−〜0.3%)、(4)A
l(〜1%)−Si(〜1%)−Cu、(5)Al(〜
1%)−Si(〜0.5%)−Sc、であり、個別に又
は互いに組合せて用いられる。
記空洞は重合体絶縁体を通って伸びる工程。
記重合体絶縁体は約3.0より低い誘電率、約400℃
より低い分解温度を有する工程。
記重合体絶縁体は以下の化合物、ポリテトラフルオロエ
チレン族化合物、パリレン、キセロゲル、重合体族のス
ピン・オン・グラス材料、ポリイミド、ハイドロジェン
・シリセスキオキサン、エーロゲル及び表面修正エーロ
ゲルの内1つ又はそれ以上から実質的に構成される組合
せから選択される工程。
で充填される前記空洞は約1.9オームより小さい抵抗
を有する工程。
記金属ライナーは高密度プラズマ・スパッタリング、化
学蒸着又はコリメートされたコールド・スパッタリング
のいずれかによって提供される工程。
前記ライナーは約1−2nm/secの速度で堆積され
る工程。
前記空洞充填は約15−20nm/secの速度で堆積
される工程。
前記空洞はバイア又は接点の一つの形である工程。
る工程であって、非金属層の上に誘電体層を有する半導
体基板を提供し、前記半導体基板は、表面と、前記表面
から少なくとも部分的に前記誘電体層一部に伸びる少な
くとも一つの空洞とを有し、前記空洞は開口端を有し、
空洞の壁によって定められ、前記半導体基板を約250
℃から約400℃の間の温度まで加熱し、前記空洞壁に
沿って金属ライナーを堆積し、前記空洞へ前記空洞開口
端を閉じるのに充分な量の金属空洞充填を堆積し、約5
00−1200atmの間の圧力下で前記空洞充填を変
形する工程を含む半導体デバイスの空洞を充填する工
程。
前記ライナーが約1−2nm/secの速度で堆積され
る工程。
前記空洞充填は約15−20nm/secの速度で堆積
される工程。
前記空洞ライナー及び前記空洞充填は約250℃−40
0℃の温度で堆積される工程。
前記重合体絶縁体は以下の化合物、ポリテトラフルオロ
エチレン族化合物、パリレン、キセロゲル、重合体族の
スピン・オン・グラス材料、ポリイミド、ハイドロジェ
ン・シリセスキオキサン、エーロゲル及び表面修正エー
ロゲルの内1つ又はそれ以上から実質的に構成される組
合せから選択される工程。
前記金属ライナーは下記の化合物の内1つ又はそれ以上
から実質的に構成される組合せから選択される工程。
(1)Al−Cu(〜0.5−〜4%)、(2)Al−
Ge(〜0.5−〜5%)−Cu(〜0−〜4%)、
(3)WSiX (2<x<2.4)、(4)TiS
i2 、(5)Al−Sc(〜0.1−〜0.3%)、
(6)TiN、(7)TiW、(8)タングステン、
(9)Al(〜1%)−Si(〜1%)−Cu、(1
0)Al(〜1%)−Si(〜0.5%)−Sc、(1
1)チタン、(12)チタン(〜0−〜25%)−アル
ミニウム合金であり、個別に又は互いに組合せて用いら
れる。
前記金属充填は後述の化合物の内の1つ又はそれ以上か
ら実質的に構成される組合せから選択される工程。
(1)Al−Cu(〜0.5−〜4%)、(2)Al−
Ge(〜0.5−〜5%)−Cu(〜0−〜4%)、
(3)Al−Sc(〜0.1−〜0.3%)、(4)A
l(〜1%)−Si(〜1%)−Cu、(5)Al(〜
1%)−Si(〜0.5%)−Sc、が個別に又は互い
に組合せて用いられる。
前記空洞充填を機械的に削り、前記圧力印加工程が後に
続く工程を更に含む工程。
段階の工程において、半導体デバイスに形成されるバイ
ア及び接点などの空洞が充填される。先ず、続いて堆積
される充填材料の「ウェッティング」を高めるよう比較
的低パワー及び堆積速度で、ライナーが空洞内に堆積さ
れる。充填材料は、空洞の口を閉じるよう比較的大きな
パワー及び堆積速度で堆積され、その後、空洞を実質的
に充填するよう充填材料が空洞に高圧で押しやられる。
従来の処理温度で熱的に不安定であった低誘電率材料を
用いることができるよう、比較的低処理温度及び高圧が
用いられる。
ムを示す略図。
図。
イアのスキャン転送マイクログラフ(「STM」)。B
は本発明の処理特徴を含む高圧充填されたバイアのST
M。
Claims (1)
- 【請求項1】 半導体デバイスの空洞を充填する方法で
あって、 表面と、前記表面から少なくとも部分的に半導体基板に
伸びる少なくとも一つの空洞を有する半導体基板を提供
し、前記空洞は開口端を有し、空洞の壁によって定めら
れ、 前記半導体基板を約250℃から約400℃の間の温度
まで加熱し、前記空洞壁に沿って金属ライナーを堆積
し、 前記空洞へ前記空洞開口端を閉じるのに充分な量の空洞
充填金属を堆積し、 前記空洞へ前記金属充填を導くよう前記空洞充填に約5
00−1200atmの間の圧力を印加する工程を含む
半導体デバイスの空洞を充填する方法。
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