JPH0844535A - 復号化システム用適応的なビットストリームデマルチプレクシング装置 - Google Patents
復号化システム用適応的なビットストリームデマルチプレクシング装置Info
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- JPH0844535A JPH0844535A JP6338813A JP33881394A JPH0844535A JP H0844535 A JPH0844535 A JP H0844535A JP 6338813 A JP6338813 A JP 6338813A JP 33881394 A JP33881394 A JP 33881394A JP H0844535 A JPH0844535 A JP H0844535A
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- H04N21/40—Client devices specifically adapted for the reception of or interaction with content, e.g. set-top-box [STB]; Operations thereof
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- H04N21/434—Disassembling of a multiplex stream, e.g. demultiplexing audio and video streams, extraction of additional data from a video stream; Remultiplexing of multiplex streams; Extraction or processing of SI; Disassembling of packetised elementary stream
- H04N21/4341—Demultiplexing of audio and video streams
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- H04N21/43—Processing of content or additional data, e.g. demultiplexing additional data from a digital video stream; Elementary client operations, e.g. monitoring of home network or synchronising decoder's clock; Client middleware
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- H04N21/4392—Processing of audio elementary streams involving audio buffer management
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- Multimedia (AREA)
- Signal Processing (AREA)
- Compression Or Coding Systems Of Tv Signals (AREA)
- Compression, Expansion, Code Conversion, And Decoders (AREA)
Abstract
(57)【要約】
【目的】 本発明は、復号化システムで用いる適応的な
ビットストリームデマルチプレクシング装置を提供す
る。 【構成】 ビットストリームを一時格納する多数のバッ
ファを有するＦＩＦＯバッファモジュール２０，６０お
よび８０と、充満または空状態を表すバッファの数を検
知するフラッグ状態検知器１１０，１２０および１３０
と、このフラッグ状態検知器から検知されたバッファ数
に基づいて、前記バッファのオーバーフローまたはアン
ダーフローを適応的に制御するバッファモジュール制御
器３０とを含む。
ビットストリームデマルチプレクシング装置を提供す
る。 【構成】 ビットストリームを一時格納する多数のバッ
ファを有するＦＩＦＯバッファモジュール２０，６０お
よび８０と、充満または空状態を表すバッファの数を検
知するフラッグ状態検知器１１０，１２０および１３０
と、このフラッグ状態検知器から検知されたバッファ数
に基づいて、前記バッファのオーバーフローまたはアン
ダーフローを適応的に制御するバッファモジュール制御
器３０とを含む。
Description
【０００１】
【産業上の利用分野】本発明は復号化システムで用いる
デマルチプレクサに関するもので、とくに、入力ビット
ストリームを格納するバッファメモリの充満(full)また
は空(empty)レベルによって、該入力ビットストリーム
を適応的にデマルチプレクスする装置に関するものであ
る。
デマルチプレクサに関するもので、とくに、入力ビット
ストリームを格納するバッファメモリの充満(full)また
は空(empty)レベルによって、該入力ビットストリーム
を適応的にデマルチプレクスする装置に関するものであ
る。
【０００２】
【従来の技術】高精細度テレビ(HDTV)および映像電話シ
ステムのような種々な電気電子応用分野において、映像
信号はディジタル形態で伝送される必要がある。映像信
号がディジタル形態で表現されるばあい、相当量のディ
ジタルデータが発生することがある。しかし、通常の伝
送チャンネルの有用な周波数帯域は限定されているの
で、ディジタル映像信号を伝送するためには符号化装置
を用いて相当量のディジタルデータを圧縮することが必
至である。
ステムのような種々な電気電子応用分野において、映像
信号はディジタル形態で伝送される必要がある。映像信
号がディジタル形態で表現されるばあい、相当量のディ
ジタルデータが発生することがある。しかし、通常の伝
送チャンネルの有用な周波数帯域は限定されているの
で、ディジタル映像信号を伝送するためには符号化装置
を用いて相当量のディジタルデータを圧縮することが必
至である。
【０００３】したがって、ほとんどの従来映像信号の符
号化装置は、入力映像信号に内在する空間および／また
は時間的リダンダンシーを用いるかまたは縮小させると
いう思想に基づいた多様の圧縮技法（または、コーディ
ング技法）を用いて、マルチプレクスされたビデオおよ
びオーディオストリームを構成する符号化済みのデータ
ビットストリームを生成している。
号化装置は、入力映像信号に内在する空間および／また
は時間的リダンダンシーを用いるかまたは縮小させると
いう思想に基づいた多様の圧縮技法（または、コーディ
ング技法）を用いて、マルチプレクスされたビデオおよ
びオーディオストリームを構成する符号化済みのデータ
ビットストリームを生成している。
【０００４】このようにして、符号化済みのビットスト
リームは通常の伝送チャンネルを通じて符号化処理の逆
過程を行う復号化装置へ伝達され、復号化済み後、もと
の映像信号を再構成するようになる。復号化装置の一例
として、MPEG-I(Motion Picture Expert Group-I) は、
多重化されたビットストリームからビデオおよびオーデ
ィオストリームをそれぞれ再構成するのに要するデマル
チプレクサを有する、標準的な映像信号復号化装置のモ
デルを示している。
リームは通常の伝送チャンネルを通じて符号化処理の逆
過程を行う復号化装置へ伝達され、復号化済み後、もと
の映像信号を再構成するようになる。復号化装置の一例
として、MPEG-I(Motion Picture Expert Group-I) は、
多重化されたビットストリームからビデオおよびオーデ
ィオストリームをそれぞれ再構成するのに要するデマル
チプレクサを有する、標準的な映像信号復号化装置のモ
デルを示している。
【０００５】しかし、MPEGでは、復号化装置がMPEG標準
によってビットストリームを復号しなければならない色
々の要件を規定しているが、復号化装置の具体的な人造
雑像またはその具現方式を具体化しないでいる。
によってビットストリームを復号しなければならない色
々の要件を規定しているが、復号化装置の具体的な人造
雑像またはその具現方式を具体化しないでいる。
【０００６】
【発明が解決しようとする課題】したがって、本発明の
主な目的は、MPEG標準を満たせる復号化システムへの実
際具現メカニズムを提供することである。
主な目的は、MPEG標準を満たせる復号化システムへの実
際具現メカニズムを提供することである。
【０００７】また、本発明の他の目的は、このようなシ
ステムで用いる適応的なビットストリームデマルチプレ
クシング装置を提供することである。
ステムで用いる適応的なビットストリームデマルチプレ
クシング装置を提供することである。
【０００８】
【課題を解決するための手段】したがって、上記目的を
達成するために、本発明によれば、動画像へのビデオデ
ータビットストリームと、音声へのオーディオビットス
トリームとを表す入力ビットストリームを復号化して、
該動画像とそれに連関される音声とを生成する復号化器
を有する、復号化システムで用いる前記入力ビットスト
リームを適応的にデマルチプレクシングするためのビッ
トストリームデマルチプレクシング装置において、直列
に配設され、前記入力ビットストリームを一時格納する
多数の入力ＦＩＦＯバッファメモリを有するものであっ
て、前記各々の入力ＦＩＦＯバッファは充満状態または
空状態を各表す充満フラッグまたは空フラッグ信号を備
える格納状態信号を発生する入力ＦＩＦＯバッファモジ
ュールと、直列に配設され、前記ビデオデータビットス
トリームを一時格納する多数のビデオＦＩＦＯバッファ
メモリを有するものであって、前記各々のビデオＦＩＦ
Ｏバッファは充満状態または空状態を各々表す充満フラ
ッグまたは空フラッグ信号を備える格納状態信号を発生
するビデオＦＩＦＯバッファモジュールと、直列に配設
されて、前記オーディオデータビットストリームを一時
格納する多数のオーディオＦＩＦＯバッファメモリを有
するものであって、前記各々のオーディオＦＩＦＯバッ
ファは、充満状態または空状態を各々表す充満フラッグ
または空フラッグ信号を備える格納状態信号を発生する
オーディオＦＩＦＯバッファモジュールと、前記入力、
ビデオおよびオーディオＦＩＦＯバッファモジュールか
ら前記充満または空フラッグ信号を受信して、充満また
は空状態にある前記入力、ビデオおよびオーディオＦＩ
ＦＯバッファを検知して、モジュールにおける充満また
は空状態が存在するＦＩＦＯバッファの数を表すバッフ
ァ状態検知信号を発生するフラッグ状態検知手段と、前
記バッファ状態検知信号に応じて、充満状態を表す入力
ＦＩＦＯバッファから前記入力ビットストリームをフェ
ッチ（ｆｅｔｃｈ）して、そのフェッチ済みのビットス
トリームをデマルチプレクスし、ビデオおよびオーディ
オデータビットストリームを発生して、前記ビデオおよ
びオーディオデータビットストリームを前記空状態を表
す前記ビデオおよびオーディオＦＩＦＯバッファへ各々
提供するバッファモジュール制御器とを含む。
達成するために、本発明によれば、動画像へのビデオデ
ータビットストリームと、音声へのオーディオビットス
トリームとを表す入力ビットストリームを復号化して、
該動画像とそれに連関される音声とを生成する復号化器
を有する、復号化システムで用いる前記入力ビットスト
リームを適応的にデマルチプレクシングするためのビッ
トストリームデマルチプレクシング装置において、直列
に配設され、前記入力ビットストリームを一時格納する
多数の入力ＦＩＦＯバッファメモリを有するものであっ
て、前記各々の入力ＦＩＦＯバッファは充満状態または
空状態を各表す充満フラッグまたは空フラッグ信号を備
える格納状態信号を発生する入力ＦＩＦＯバッファモジ
ュールと、直列に配設され、前記ビデオデータビットス
トリームを一時格納する多数のビデオＦＩＦＯバッファ
メモリを有するものであって、前記各々のビデオＦＩＦ
Ｏバッファは充満状態または空状態を各々表す充満フラ
ッグまたは空フラッグ信号を備える格納状態信号を発生
するビデオＦＩＦＯバッファモジュールと、直列に配設
されて、前記オーディオデータビットストリームを一時
格納する多数のオーディオＦＩＦＯバッファメモリを有
するものであって、前記各々のオーディオＦＩＦＯバッ
ファは、充満状態または空状態を各々表す充満フラッグ
または空フラッグ信号を備える格納状態信号を発生する
オーディオＦＩＦＯバッファモジュールと、前記入力、
ビデオおよびオーディオＦＩＦＯバッファモジュールか
ら前記充満または空フラッグ信号を受信して、充満また
は空状態にある前記入力、ビデオおよびオーディオＦＩ
ＦＯバッファを検知して、モジュールにおける充満また
は空状態が存在するＦＩＦＯバッファの数を表すバッフ
ァ状態検知信号を発生するフラッグ状態検知手段と、前
記バッファ状態検知信号に応じて、充満状態を表す入力
ＦＩＦＯバッファから前記入力ビットストリームをフェ
ッチ（ｆｅｔｃｈ）して、そのフェッチ済みのビットス
トリームをデマルチプレクスし、ビデオおよびオーディ
オデータビットストリームを発生して、前記ビデオおよ
びオーディオデータビットストリームを前記空状態を表
す前記ビデオおよびオーディオＦＩＦＯバッファへ各々
提供するバッファモジュール制御器とを含む。
【０００９】
【実施例】以下、本発明の復号化システム用適応的なビ
ットストリームデマルチプレクシング装置について、図
面を添付しながらより詳しく説明する。
ットストリームデマルチプレクシング装置について、図
面を添付しながらより詳しく説明する。
【００１０】図１によると、本発明による映像信号およ
び音声信号を表す符号化済みのビットストリームを適応
的にデマルチプレクスするための、デマルチプレクシン
グ装置を有する復号化システムのブロック図が示され
る。
び音声信号を表す符号化済みのビットストリームを適応
的にデマルチプレクスするための、デマルチプレクシン
グ装置を有する復号化システムのブロック図が示され
る。
【００１１】符号化済みのビットストリームは、相応す
る通常の符号化システム（図示せず）から復号化システ
ムへ、とくに、ディジタル格納媒体(Digital Storage M
edia;DSM) １０へ提供される。この符号化済みのビット
ストリームは一列にされたパケットからなっている。か
かる一つのパケットは、一つ以上の多重化された符号化
表現のオーディオおよび／またはビデオビットストリー
ムと、該ビデオおよびオーディオを仕切りするに用いる
パケットヘッダーとを含む。このビットストリームはＤ
ＳＭ１０へパケット単位で順次的に格納される。また、
ＤＳＭ１０はビットストリームを受けて、一定速度で該
ビットストリームを入力ＦＩＦＯ(first-in-first-out:
先入先出）（以下、ＦＩＦＯ−Ｉと略称する）バッファ
モジュール２０へ提供される。
る通常の符号化システム（図示せず）から復号化システ
ムへ、とくに、ディジタル格納媒体(Digital Storage M
edia;DSM) １０へ提供される。この符号化済みのビット
ストリームは一列にされたパケットからなっている。か
かる一つのパケットは、一つ以上の多重化された符号化
表現のオーディオおよび／またはビデオビットストリー
ムと、該ビデオおよびオーディオを仕切りするに用いる
パケットヘッダーとを含む。このビットストリームはＤ
ＳＭ１０へパケット単位で順次的に格納される。また、
ＤＳＭ１０はビットストリームを受けて、一定速度で該
ビットストリームを入力ＦＩＦＯ(first-in-first-out:
先入先出）（以下、ＦＩＦＯ−Ｉと略称する）バッファ
モジュール２０へ提供される。
【００１２】ＦＩＦＯ−Ｉ２０内に格納されたビットス
トリームは、バッファモジュール制御器３０の制御下に
パケットヘッダーによって、デマルチプレクスされてビ
デオおよびオーディオデータビットストリームに生成さ
れる。デマルチプレクス済みのビデオおよびオーディオ
データビットストリームは、ビデオＦＩＦＯ（以下、Ｆ
ＩＦＯ−Ｖと略称する）バッファモジュール６０とオー
ディオＦＩＦＯ（以下、ＦＩＦＯ−Ａと略称する）バッ
ファモジュール８０とへ各々提供される。しかるのち、
ＦＩＦＯ−Ｖバッファモジュール６０およびＦＩＦＯ−
Ａバッファモジュール８０内におけるビデオおよびオー
ディオビットストリームは、ビデオ復号化器７０および
オーディオ復号化器９０へ伝送され、通常の復号化処理
を行うことによって、各々もとの映像信号および音声信
号に再構成される。ＦＩＦＯ−Ｉバッファモジュール２
０は、ＤＳＭ１０からの出力を順次的に受け入れる、一
列に連結されたＮ個（たとえば、３）のＦＩＦＯ−Ｉバ
ッファメモリ２２，２４および２６を含む。この各々Ｆ
ＩＦＯ−Ｉバッファメモリ２２，２４および２６はバッ
ファの充満を表す論理値「ロー」または、論理値「０」
の充満フラッグ信号「ＦＦ」のような、バッファ状態信
号を発生する。各々のＦＩＦＯ−Ｉバッファ２２，２４
および２６から発生するバッファ状態信号は、フラッグ
状態検知ブロック１００へ供給される。
トリームは、バッファモジュール制御器３０の制御下に
パケットヘッダーによって、デマルチプレクスされてビ
デオおよびオーディオデータビットストリームに生成さ
れる。デマルチプレクス済みのビデオおよびオーディオ
データビットストリームは、ビデオＦＩＦＯ（以下、Ｆ
ＩＦＯ−Ｖと略称する）バッファモジュール６０とオー
ディオＦＩＦＯ（以下、ＦＩＦＯ−Ａと略称する）バッ
ファモジュール８０とへ各々提供される。しかるのち、
ＦＩＦＯ−Ｖバッファモジュール６０およびＦＩＦＯ−
Ａバッファモジュール８０内におけるビデオおよびオー
ディオビットストリームは、ビデオ復号化器７０および
オーディオ復号化器９０へ伝送され、通常の復号化処理
を行うことによって、各々もとの映像信号および音声信
号に再構成される。ＦＩＦＯ−Ｉバッファモジュール２
０は、ＤＳＭ１０からの出力を順次的に受け入れる、一
列に連結されたＮ個（たとえば、３）のＦＩＦＯ−Ｉバ
ッファメモリ２２，２４および２６を含む。この各々Ｆ
ＩＦＯ−Ｉバッファメモリ２２，２４および２６はバッ
ファの充満を表す論理値「ロー」または、論理値「０」
の充満フラッグ信号「ＦＦ」のような、バッファ状態信
号を発生する。各々のＦＩＦＯ−Ｉバッファ２２，２４
および２６から発生するバッファ状態信号は、フラッグ
状態検知ブロック１００へ供給される。
【００１３】同様に、ＦＩＦＯ−ＶおよびＦＩＦＯ−Ａ
バッファモジュール６０，８０の各々は、ＦＩＦＯ−Ｉ
モジュール２０からのビデオおよびオーディオビットス
トリームを各々順次的に受け入れる、一列に連結された
Ｎ個（たとえば、３）のＦＩＦＯ−Ｖバッファメモリ６
２，６４および６６とＦＩＦＯ−Ａバッファメモリ８
２，８４および８６とを各々含む。各々のＦＩＦＯ−Ｖ
バッファメモリとＦＩＦＯ−Ａバッファメモリ６２，６
４および６６と８２，８４および８６とは、バッファの
空を示す論理値「ハイ」または論理値「１」の空フラッ
グ信号「ＥＦ」のようなバッファ状態信号を発生する。
各々のＦＩＦＯ−Ｖバッファモジュール６０およびＦＩ
ＦＯ−Ａバッファモジュール８０とから発生したバッフ
ァ状態信号の各々は前記フラッグ状態検知ブロッグ１２
０，１３０へ供給される。
バッファモジュール６０，８０の各々は、ＦＩＦＯ−Ｉ
モジュール２０からのビデオおよびオーディオビットス
トリームを各々順次的に受け入れる、一列に連結された
Ｎ個（たとえば、３）のＦＩＦＯ−Ｖバッファメモリ６
２，６４および６６とＦＩＦＯ−Ａバッファメモリ８
２，８４および８６とを各々含む。各々のＦＩＦＯ−Ｖ
バッファメモリとＦＩＦＯ−Ａバッファメモリ６２，６
４および６６と８２，８４および８６とは、バッファの
空を示す論理値「ハイ」または論理値「１」の空フラッ
グ信号「ＥＦ」のようなバッファ状態信号を発生する。
各々のＦＩＦＯ−Ｖバッファモジュール６０およびＦＩ
ＦＯ−Ａバッファモジュール８０とから発生したバッフ
ァ状態信号の各々は前記フラッグ状態検知ブロッグ１２
０，１３０へ供給される。
【００１４】本発明によれば、ＦＩＦＯバッファモジュ
ール２０，６０，８０内におけるバッファの格納容量
は、入力データビットストリーム中の一つのパケットに
相応するデータを格納するように設けられる。
ール２０，６０，８０内におけるバッファの格納容量
は、入力データビットストリーム中の一つのパケットに
相応するデータを格納するように設けられる。
【００１５】前記フラッグ状態検知ブロック１００は、
ＦＩＦＯ−Ｉバッファモジュール２０，ＦＩＦＯ−Ｖバ
ッファモジュール６０およびＦＩＦＯ−Ａバッファモジ
ュール８０のバッファ状態を各々検知する、三つの同一
のフラッグ状態検知器１１０，１２０および１３０の１
セットからなる。その中の一つとして、たとえば、フラ
ッグ状態検知器１１０のみが、図２に詳細に説明され
る。
ＦＩＦＯ−Ｉバッファモジュール２０，ＦＩＦＯ−Ｖバ
ッファモジュール６０およびＦＩＦＯ−Ａバッファモジ
ュール８０のバッファ状態を各々検知する、三つの同一
のフラッグ状態検知器１１０，１２０および１３０の１
セットからなる。その中の一つとして、たとえば、フラ
ッグ状態検知器１１０のみが、図２に詳細に説明され
る。
【００１６】図２に示したように、フラッグ状態検知器
１１０は、三つのＦＩＦＯ−Ｉバッファ２２，２４およ
び２６の充満フラッグ状態を検知するための四つの論理
部１１２，１１４および１１６を有する論理回路と４−
２符号化器１２５とから成る。 第１論理部１１２は、
三つのＦＩＦＯ−Ｉバッファ２２，２４および２６から
発生されたＦＦ信号を受信するＮＡＮＤゲートＧ１を有
する。この第１論理部１１２は、三つのＦＩＦＯ−Ｉバ
ッファ２２，２４および２６中のなにも充満状態ではな
い条件を検知するに働く。この条件が検知された場合、
ＮＡＮＤゲートＧ１は論理値「ロー」の出力を発生して
符号化器１２５の入力端Ｅ１へ伝送する。 第２論理部
１１４は、三つのＦＩＦＯ−Ｉバッファ２２，２４およ
び２６から発生された、それぞれの二つの出力信号を各
々受信する１セットのＯＲゲートＧ２，Ｇ３およびＧ４
と、このＯＲゲートＧ２，Ｇ３およびＧ４の出力信号を
集めて受信するＡＮＤゲートＧ５とを備える。前記第２
論理部１１４は、三つのＦＩＦＯ−Ｉバッファ２２，２
４および２６中の二つだけが充満状態の条件を検知する
に働く。この条件が検知された場合、ＡＮＤゲートＧ５
は論理値「ロー」出力を符号化器１２５の入力端Ｅ３へ
付与する。
１１０は、三つのＦＩＦＯ−Ｉバッファ２２，２４およ
び２６の充満フラッグ状態を検知するための四つの論理
部１１２，１１４および１１６を有する論理回路と４−
２符号化器１２５とから成る。 第１論理部１１２は、
三つのＦＩＦＯ−Ｉバッファ２２，２４および２６から
発生されたＦＦ信号を受信するＮＡＮＤゲートＧ１を有
する。この第１論理部１１２は、三つのＦＩＦＯ−Ｉバ
ッファ２２，２４および２６中のなにも充満状態ではな
い条件を検知するに働く。この条件が検知された場合、
ＮＡＮＤゲートＧ１は論理値「ロー」の出力を発生して
符号化器１２５の入力端Ｅ１へ伝送する。 第２論理部
１１４は、三つのＦＩＦＯ−Ｉバッファ２２，２４およ
び２６から発生された、それぞれの二つの出力信号を各
々受信する１セットのＯＲゲートＧ２，Ｇ３およびＧ４
と、このＯＲゲートＧ２，Ｇ３およびＧ４の出力信号を
集めて受信するＡＮＤゲートＧ５とを備える。前記第２
論理部１１４は、三つのＦＩＦＯ−Ｉバッファ２２，２
４および２６中の二つだけが充満状態の条件を検知する
に働く。この条件が検知された場合、ＡＮＤゲートＧ５
は論理値「ロー」出力を符号化器１２５の入力端Ｅ３へ
付与する。
【００１７】第３論理部１１６は、三つのＦＩＦＯ−Ｉ
バッファ２２，２４および２６から発生された出力信号
を受信するＯＲゲートＧ７を備えるし、三つのＦＩＦＯ
−Ｉバッファ２２，２４および２６が全て充満状態の条
件を検知するに働く。この条件を満たした場合、ＯＲゲ
ートＧ７は論理値「ロー」出力を符号化器１２５の入力
端Ｅ４へ提供する。
バッファ２２，２４および２６から発生された出力信号
を受信するＯＲゲートＧ７を備えるし、三つのＦＩＦＯ
−Ｉバッファ２２，２４および２６が全て充満状態の条
件を検知するに働く。この条件を満たした場合、ＯＲゲ
ートＧ７は論理値「ロー」出力を符号化器１２５の入力
端Ｅ４へ提供する。
【００１８】最後に、第４論理部１１８は、前記第１，
２および３論理部１１２，１１４および１１６における
ＮＡＮＤゲートＧ１と、ＡＮＤゲートＧ５と、ＯＲゲー
トＧ７との出力信号を各々受信する三つのＩＮＶＥＲＴ
ＥＲゲートＩＮ１，ＩＮ２およびＩＮ３と、その出力を
受信するＯＲゲートＧ６とを有する。この第４論理部１
１８は、三つのＦＩＦＯ−Ｉバッファ２２，２４および
２６中の一つのみが充満状態の条件を検知するに働く。
この条件が検知された場合、ＯＲゲートＧ６は論理値
「ロー」出力を符号化器１２５の入力端Ｅ２へ付与す
る。
２および３論理部１１２，１１４および１１６における
ＮＡＮＤゲートＧ１と、ＡＮＤゲートＧ５と、ＯＲゲー
トＧ７との出力信号を各々受信する三つのＩＮＶＥＲＴ
ＥＲゲートＩＮ１，ＩＮ２およびＩＮ３と、その出力を
受信するＯＲゲートＧ６とを有する。この第４論理部１
１８は、三つのＦＩＦＯ−Ｉバッファ２２，２４および
２６中の一つのみが充満状態の条件を検知するに働く。
この条件が検知された場合、ＯＲゲートＧ６は論理値
「ロー」出力を符号化器１２５の入力端Ｅ２へ付与す
る。
【００１９】符号化器１２５は、前記論理回路から発生
された出力に応答して、４つの入力変数に対する出力と
して、二進コードＣ０，Ｃ１を発生する。すなわち、符
号化器１２５は四つの論理部１１２，１１４，１１６お
よび１１８からの出力に相応する、二進コード００，０
１，１０および１１を発生する。論理回路の出力と符号
化器１２５との関係は下記表１に示されている。表１に
示されたように、右欄に記載された番号はＦＩＦＯ−Ｉ
バッファモジュール２０における充満ブロッグ状態を有
するＦＩＦＯ−Ｉバッファの数を示し、左欄に記載され
た二進コードは符号化器１２５の出力を示す。二進コー
ドの各々は図１に示されたフラッグレジスター５０へ供
給される。
された出力に応答して、４つの入力変数に対する出力と
して、二進コードＣ０，Ｃ１を発生する。すなわち、符
号化器１２５は四つの論理部１１２，１１４，１１６お
よび１１８からの出力に相応する、二進コード００，０
１，１０および１１を発生する。論理回路の出力と符号
化器１２５との関係は下記表１に示されている。表１に
示されたように、右欄に記載された番号はＦＩＦＯ−Ｉ
バッファモジュール２０における充満ブロッグ状態を有
するＦＩＦＯ−Ｉバッファの数を示し、左欄に記載され
た二進コードは符号化器１２５の出力を示す。二進コー
ドの各々は図１に示されたフラッグレジスター５０へ供
給される。
【００２０】
【表１】
【００２１】同様に、ＦＩＦＯ−Ｖバッファモジュール
６０とＦＩＦＯ−Ａバッファモジュール８０とへのフラ
ッグ状態検知器１２０および１３０の各々は、ＦＩＦＯ
−Ｉバッファモジュール２０のフラッグ状態検知器１１
０と同一の構成を有しているが、ただ、フラッグ状態検
知器１２０，１３０への入力がＦＩＦＯ−Ｖバッファ６
２，６４および６６とＦＩＦＯ−Ａバッファ８２，８４
および８６との空状態を示す空フラッグ信号のものと、
フラッグ状態検知器１２０，１３０の第１ないし第４論
理部（図示せず）の出力が充満状態ではない空状態を示
すＦＩＦＯ−ＶおよびＦＩＦＯ−Ａバッファの数である
ものとを除いては同一である。各々のフラッグ状態検知
器１２０，１３０から発生された二進コードＢ０，Ｂ１
およびＡ０，Ａ１の各々はやはりフラッグレジスター５
０へ提供される。
６０とＦＩＦＯ−Ａバッファモジュール８０とへのフラ
ッグ状態検知器１２０および１３０の各々は、ＦＩＦＯ
−Ｉバッファモジュール２０のフラッグ状態検知器１１
０と同一の構成を有しているが、ただ、フラッグ状態検
知器１２０，１３０への入力がＦＩＦＯ−Ｖバッファ６
２，６４および６６とＦＩＦＯ−Ａバッファ８２，８４
および８６との空状態を示す空フラッグ信号のものと、
フラッグ状態検知器１２０，１３０の第１ないし第４論
理部（図示せず）の出力が充満状態ではない空状態を示
すＦＩＦＯ−ＶおよびＦＩＦＯ−Ａバッファの数である
ものとを除いては同一である。各々のフラッグ状態検知
器１２０，１３０から発生された二進コードＢ０，Ｂ１
およびＡ０，Ａ１の各々はやはりフラッグレジスター５
０へ提供される。
【００２２】図３は、フラッグ状態検知ブロック１００
からフラッグレジスター５０へ提供された二進コードＡ
０，Ａ１と、Ｂ０，Ｂ１と、Ｃ０，Ｃ１とのビット割り
当ての例を示す。示されたように、フラツグ状態検知器
１１０，１２０および１３０から発生された二進コード
Ａ０，Ａ１と、Ｂ０，Ｂ１と、Ｃ０，Ｃ１との各々は、
最右側のビット位置から最上位のビット(most signific
ant bit:MSB)位置に順次的に割り当てられている。最左
側のビット位置にある二つのビットは、最下位ビット(l
east significant bit:LSB) として「ドントケア(don’
t care) 」を表す。 また、図１を参照すると、バッフ
ァモジュール制御器３０が、マイクロプロセッサー３６
と、ＲＯＭ（リード・オンリ・メモリ）３２およびＲＡ
Ｍ（ランダム・アクセス・メモリ）３４のようなメモリ
ユニットとを備えるものと示されている。マイクロプロ
セッサー３６は、外部入力装置として見做されるフラッ
グレジスター５０の二進ビットをチェックするために、
割り当てられた一つの入力ポート（図示せず）を有して
いる。マイクロプロセッサー３６は下記記述したよう
に、充満または空状態を表すＦＩＦＯバッファなどの数
に依存して、ＦＩＦＯ−Ｉバッファモジュール２０とＦ
ＩＦＯ−ＶおよびＦＩＦＯ−Ａバッファモジュール６０
および８０との間の通信を制御する。ＲＯＭ３２は図４
に示されたように、マイクロプロセッサー３６によっ
て、実行される命令語およびデータを格納する。ＲＡＭ
３４は、デマルチプレクスされたビデオおよびオーディ
オデータビットストリームの格納および検索のため予約
されたビデオキュー(queue) およびオーディオキューを
有する。このビデオキューおよびオーディオキューはそ
の上端と下端を示す二つのポイントを各々有する。
からフラッグレジスター５０へ提供された二進コードＡ
０，Ａ１と、Ｂ０，Ｂ１と、Ｃ０，Ｃ１とのビット割り
当ての例を示す。示されたように、フラツグ状態検知器
１１０，１２０および１３０から発生された二進コード
Ａ０，Ａ１と、Ｂ０，Ｂ１と、Ｃ０，Ｃ１との各々は、
最右側のビット位置から最上位のビット(most signific
ant bit:MSB)位置に順次的に割り当てられている。最左
側のビット位置にある二つのビットは、最下位ビット(l
east significant bit:LSB) として「ドントケア(don’
t care) 」を表す。 また、図１を参照すると、バッフ
ァモジュール制御器３０が、マイクロプロセッサー３６
と、ＲＯＭ（リード・オンリ・メモリ）３２およびＲＡ
Ｍ（ランダム・アクセス・メモリ）３４のようなメモリ
ユニットとを備えるものと示されている。マイクロプロ
セッサー３６は、外部入力装置として見做されるフラッ
グレジスター５０の二進ビットをチェックするために、
割り当てられた一つの入力ポート（図示せず）を有して
いる。マイクロプロセッサー３６は下記記述したよう
に、充満または空状態を表すＦＩＦＯバッファなどの数
に依存して、ＦＩＦＯ−Ｉバッファモジュール２０とＦ
ＩＦＯ−ＶおよびＦＩＦＯ−Ａバッファモジュール６０
および８０との間の通信を制御する。ＲＯＭ３２は図４
に示されたように、マイクロプロセッサー３６によっ
て、実行される命令語およびデータを格納する。ＲＡＭ
３４は、デマルチプレクスされたビデオおよびオーディ
オデータビットストリームの格納および検索のため予約
されたビデオキュー(queue) およびオーディオキューを
有する。このビデオキューおよびオーディオキューはそ
の上端と下端を示す二つのポイントを各々有する。
【００２３】バッファモジュール制御器３０はフラッグ
レジスター５０のビット状態に基づいて、ＦＩＦＯ−
Ｉ，ＦＩＦＯ−ＶおよびＦＩＦＯ−Ａバッファモジュー
ル２０，６０および８０のオーバーフローまたはアンダ
ーフローの発生を適応的に防止する。詳しくは、バッフ
ァモジュール制御器３０はＦＩＦＯ−Ｉバッファモジュ
ール２０内で充満状態を表すＦＩＦＯ−Ｉバッファ２
２，２４または２６内に詰められているデータパケット
を除去して、ＦＩＦＯ−Ｖバッファモジュール６０およ
びＦＩＦＯ−Ａバッファモジュール８０内で空状態を表
すＦＩＦＯ−Ｖバッファ６２，６４および６６とＦＩＦ
Ｏ−Ａバッファ８２，８４および８６内にビデオおよび
オーディオビットストリームを提供する。このバッファ
モジュール制御器３０は汎用マイクロコンピュータ、た
とえば、モトローラ社(Motora inc.)で製造した６８０
０シリーズで具現される。これに関連して、上述したバ
ッファモジュール制御器３０の詳細な動作は図４および
図５を参照に説明される。
レジスター５０のビット状態に基づいて、ＦＩＦＯ−
Ｉ，ＦＩＦＯ−ＶおよびＦＩＦＯ−Ａバッファモジュー
ル２０，６０および８０のオーバーフローまたはアンダ
ーフローの発生を適応的に防止する。詳しくは、バッフ
ァモジュール制御器３０はＦＩＦＯ−Ｉバッファモジュ
ール２０内で充満状態を表すＦＩＦＯ−Ｉバッファ２
２，２４または２６内に詰められているデータパケット
を除去して、ＦＩＦＯ−Ｖバッファモジュール６０およ
びＦＩＦＯ−Ａバッファモジュール８０内で空状態を表
すＦＩＦＯ−Ｖバッファ６２，６４および６６とＦＩＦ
Ｏ−Ａバッファ８２，８４および８６内にビデオおよび
オーディオビットストリームを提供する。このバッファ
モジュール制御器３０は汎用マイクロコンピュータ、た
とえば、モトローラ社(Motora inc.)で製造した６８０
０シリーズで具現される。これに関連して、上述したバ
ッファモジュール制御器３０の詳細な動作は図４および
図５を参照に説明される。
【００２４】図４および図５において、マイクロプロセ
ッサーの動作は、ブロック２０１にて、フラッグレジス
ター５０から二進コードをチェックまたは読み取りの処
理から開始する。
ッサーの動作は、ブロック２０１にて、フラッグレジス
ター５０から二進コードをチェックまたは読み取りの処
理から開始する。
【００２５】ブロック２０２にて、最初、フラッグレジ
スター５０の二進コードＣ０，Ｃ１を判読することによ
って、ＦＩＦＯ−Ｉバッファモジュール２０が充満バッ
ファ状態を表すＦＩＦＯ−Ｉバッファを有しているかを
判別する。もし、二進コードＣ０，Ｃ１が「００」と違
うある特定な値を表すと、バッファ充満状態を表すＦＩ
ＦＯ−Ｉバッファ２２，２４または２６内に詰められて
いるビットストリームをそこからフェッチする。
スター５０の二進コードＣ０，Ｃ１を判読することによ
って、ＦＩＦＯ−Ｉバッファモジュール２０が充満バッ
ファ状態を表すＦＩＦＯ−Ｉバッファを有しているかを
判別する。もし、二進コードＣ０，Ｃ１が「００」と違
うある特定な値を表すと、バッファ充満状態を表すＦＩ
ＦＯ−Ｉバッファ２２，２４または２６内に詰められて
いるビットストリームをそこからフェッチする。
【００２６】しかるのち、ブロック２０３にて、バッフ
ァモジュール制御器３０はフェッチ済みのビットストリ
ームからパケットヘッダーを抽出して、そのパケットヘ
ッダーによって、ビデオおよびオーディオビットストリ
ームにデマルチプレクスする。
ァモジュール制御器３０はフェッチ済みのビットストリ
ームからパケットヘッダーを抽出して、そのパケットヘ
ッダーによって、ビデオおよびオーディオビットストリ
ームにデマルチプレクスする。
【００２７】ブロック２０４にて、デマルチプレクス済
みのビットストリームがビデオデータストリームであっ
たら、ブロック２０５のようにそのビデオデータストリ
ームをＲＡＭ３４内のビデオキューへ伝送し、その後、
タップ「Ａ」を通じてブロック２１２へ進行する。
みのビットストリームがビデオデータストリームであっ
たら、ブロック２０５のようにそのビデオデータストリ
ームをＲＡＭ３４内のビデオキューへ伝送し、その後、
タップ「Ａ」を通じてブロック２１２へ進行する。
【００２８】しかし、ブロック２０６にて、デマルチプ
レクス済みのビットストリームがオーディオデータスト
リームであったら、ブロック２０７でのようにそのオー
ディオデータストリームをＲＡＭ３４内のオーディオキ
ューへ伝送した後、タップ「Ａ」を通じてブロック２１
２へ進行する。
レクス済みのビットストリームがオーディオデータスト
リームであったら、ブロック２０７でのようにそのオー
ディオデータストリームをＲＡＭ３４内のオーディオキ
ューへ伝送した後、タップ「Ａ」を通じてブロック２１
２へ進行する。
【００２９】しかし、ブロック２０８にて、デマルチプ
レクス済みのビットストリームが意味のないパッディン
グデータ(padding data)（または、空白）であったら、
ブロック２０９でのように、そのパッディングデータを
捨ててタップ「Ａ」を通じてブロック２１２へ進行す
る。
レクス済みのビットストリームが意味のないパッディン
グデータ(padding data)（または、空白）であったら、
ブロック２０９でのように、そのパッディングデータを
捨ててタップ「Ａ」を通じてブロック２１２へ進行す
る。
【００３０】ブロック２１０にて、ビットストリームの
パケットが終わったら、ブロック２１１でのように伝送
を完了する。しかし、パケットにおける伝送するデータ
が残っている場合、プロセスはＦＩＦＯ−Ｉバッファ２
２，２４および２６の充満レベルを確認するためにブロ
ック２０１へ戻る。
パケットが終わったら、ブロック２１１でのように伝送
を完了する。しかし、パケットにおける伝送するデータ
が残っている場合、プロセスはＦＩＦＯ−Ｉバッファ２
２，２４および２６の充満レベルを確認するためにブロ
ック２０１へ戻る。
【００３１】ブロック２１２にて、ビデオおよびオーデ
ィオキューが各々データストリームで完全に詰められて
いるかを判別する。その結果、否定判定であったら、プ
ロセスはタップ「Ｂ」を通じてブロック２０３へ進行す
る。しかしながら、肯定判定であったら、ブロック２１
３へさらに進む。
ィオキューが各々データストリームで完全に詰められて
いるかを判別する。その結果、否定判定であったら、プ
ロセスはタップ「Ｂ」を通じてブロック２０３へ進行す
る。しかしながら、肯定判定であったら、ブロック２１
３へさらに進む。
【００３２】ブロック２１３にて、各々のフラッグコー
ドＢ０，Ｂ１およびＡ０，Ａ１をチェックして、ＦＩＦ
Ｏ−ＶおよびＦＩＦＯ−Ａバッファモジュール６０およ
び８０の格納状態を判別する。
ドＢ０，Ｂ１およびＡ０，Ａ１をチェックして、ＦＩＦ
Ｏ−ＶおよびＦＩＦＯ−Ａバッファモジュール６０およ
び８０の格納状態を判別する。
【００３３】その判別の結果として、ブロック２１４に
て、二進コードＢ０，Ｂ１によって示されたように、Ｆ
ＩＦＯ−Ｖバッファモジュール６０が空ＦＩＦＯ−Ｖバ
ッファを有していたら、ブロック２１５でのようにビデ
オキューに格納されているビデオデータストリームを空
ＦＩＦＯ−Ｖへ伝送する。
て、二進コードＢ０，Ｂ１によって示されたように、Ｆ
ＩＦＯ−Ｖバッファモジュール６０が空ＦＩＦＯ−Ｖバ
ッファを有していたら、ブロック２１５でのようにビデ
オキューに格納されているビデオデータストリームを空
ＦＩＦＯ−Ｖへ伝送する。
【００３４】しかし、ブロック２１６にて、二進コード
Ａ０，Ａ１によって示されたように、ＦＩＦＯ−Ａバッ
ファモジュール８０が空ＦＩＦＯ−Ａバッファをいくつ
か有していたら、ブロック２１７でのように、オーディ
オキューに格納されているオーディオデータストリーム
をＦＩＦＯ−Ａバッファモジュール８０へ持って来て空
ＦＩＦＯ−Ａバッファを詰める。
Ａ０，Ａ１によって示されたように、ＦＩＦＯ−Ａバッ
ファモジュール８０が空ＦＩＦＯ−Ａバッファをいくつ
か有していたら、ブロック２１７でのように、オーディ
オキューに格納されているオーディオデータストリーム
をＦＩＦＯ−Ａバッファモジュール８０へ持って来て空
ＦＩＦＯ−Ａバッファを詰める。
【００３５】しかしながら、ブロック２１４および２１
６にて、二進コードＢ０，Ｂ１およびＡ０，Ａ１の各々
がバッファの充満状態を表すと判別すれば、制御プロセ
スはブロック２０１へ戻って上述した動作を繰り返す。
６にて、二進コードＢ０，Ｂ１およびＡ０，Ａ１の各々
がバッファの充満状態を表すと判別すれば、制御プロセ
スはブロック２０１へ戻って上述した動作を繰り返す。
【００３６】本発明の実施例で、ＦＩＦＯ−Ｉ，ＦＩＦ
Ｏ−ＶおよびＦＩＦＯ−Ａバッファモジュールが各々三
つのバッファ有するものと記述されたが、そのバッファ
の数はそれに限られたものではなく、ビットストリーム
内に含まれたビデオおよびオーディオデータの量によっ
て変化する。
Ｏ−ＶおよびＦＩＦＯ−Ａバッファモジュールが各々三
つのバッファ有するものと記述されたが、そのバッファ
の数はそれに限られたものではなく、ビットストリーム
内に含まれたビデオおよびオーディオデータの量によっ
て変化する。
【００３７】上記において、本発明は特定の実施例につ
いて説明しているが、本発明の範囲を逸脱することな
く、当業者は種々の改変をなし得るものである。
いて説明しているが、本発明の範囲を逸脱することな
く、当業者は種々の改変をなし得るものである。
【００３８】
【発明の効果】したがって、本発明によれば、ＭＰＥＧ
システムのビットストリームをデマルチプレクスしてビ
デオおよびオーディオ復号化器へ各々伝送することにお
いて、ビットストリームを一時格納するバツファのオー
バーフローまたはアンダーフローを適応的に制御でき
る。
システムのビットストリームをデマルチプレクスしてビ
デオおよびオーディオ復号化器へ各々伝送することにお
いて、ビットストリームを一時格納するバツファのオー
バーフローまたはアンダーフローを適応的に制御でき
る。
【図１】本発明による復号化システムのブロック図であ
る。
る。
【図２】図１に示したバッファレベル検知器に対する詳
細な論理回路図である。
細な論理回路図である。
【図３】図１に示したフラッグレジスターの二進コード
のビット割当を例示した図である。
のビット割当を例示した図である。
【図４】図１に示した復号化システムによって行った制
御プロセスを説明するフローチャトである。
御プロセスを説明するフローチャトである。
【図５】図１に示した復号化システムによって行った制
御プロセスを説明するフローチャートである。
御プロセスを説明するフローチャートである。
１０ ＤＳＭ（ディジタル格納媒体） ２０，６０，８０ ＦＩＦＯバッファモジュール ３０ バッファモジュール制御器 ５０ フラッグレジスター ７０ ビデオ復号化器 ９０ オーディオ復号化器 １１０，１２０，１３０ フラッグ状態検知器 １２５ 符号化器
Claims (4)
- 【請求項１】 動画像へのビデオデータビットストリー
ムと、音声へのオーディオビットストリームとを表す入
力ビットストリームを復号化して、該動画像とそれに連
関される音声とを生成する復号化器を有する、復号化シ
ステムで用いる前記入力ビットストリームを適応的にデ
マルチプレクシングするためのビットストリームデマル
チプレクシング装置において、 直列に配設され、前記入力ビットストリームを一時格納
する多数の入力ＦＩＦＯバッファメモリを有するもので
あって、前記各々の入力ＦＩＦＯバッファは充満状態ま
たは空状態を各表す充満フラッグまたは空フラッグ信号
を備える格納状態信号を発生する入力ＦＩＦＯバッファ
モジュールと、 直列に配設され、前記ビデオデータビットストリームを
一時格納する多数のビデオＦＩＦＯバッファメモリを有
するものであって、前記各々のビデオＦＩＦＯバッファ
は充満状態または空状態を各々表す充満フラッグまたは
空フラッグ信号を備える格納状態信号を発生するビデオ
ＦＩＦＯバッファモジュールと、 直列に配設されて、前記オーディオデータビットストリ
ームを一時格納する多数のオーディオＦＩＦＯバッファ
メモリを有するものであって、前記各々のオーディオＦ
ＩＦＯバッファは充満状態または空状態を各々表す充満
フラッグまたは空フラッグ信号を備える格納状態信号を
発生するオーディオＦＩＦＯバッファモジュールと、 前記入力、ビデオおよびオーディオＦＩＦＯバッファモ
ジュールから前記充満または空フラッグ信号を受信し
て、充満または空状態にある前記入力、ビデオおよびオ
ーディオＦＩＦＯバッファを検知して、モジュールにお
ける充満または空状態が存在するＦＩＦＯバッファの数
を表すバッファ状態検知信号を発生するフラッグ状態検
知手段と、 前記バッファ状態検知信号に応じて、充満状態を表す入
力ＦＩＦＯバッファから前記入力ビットストリームをフ
ェッチして、フェッチ済みのビットストリームをデマル
チプレクスし、ビデオおよびオーディオデータビットス
トリームを発生して、前記ビデオおよびオーディオデー
タビットストリームを前記空状態を表す前記ビデオおよ
びオーディオＦＩＦＯバッファへ各々提供するバッファ
モジュール制御器とを含むことを特徴とする復号化シス
テム用適応的なビットストリームデマルチプレクシング
装置。 - 【請求項２】 前記フラッグ状態検知手段は、前記入力
バッファモジュール、前記ビデオバッファモジュールお
よび前記オーディオバッファモジュール各々への三つの
フラッグ状態検知器を備えるものであって、 前記各々のフラッグ状態検知器は、前記ある入力バッフ
ァまたは、前記あるビデオおよびオーディオバッファも
充満および空状態のない条件を検知する第１論理部と、 前記入力バッファまたは、前記ビデオおよびオーディオ
バッファの少なくともいずれも一つが、充満または空状
態の条件を検知する第２論理部と、 前記入力バッファまたは、前記ビデオおよびオーディオ
バッファの全てが充満または空状態の条件を検知する第
３論理部と、 前記第１ないし第３論理部からの出力に応答して、前記
バッファ状態信号を発生する符号化器とを備えることを
特徴とする請求項１記載の復号化システム用適応的なビ
ットストリームデマルチプレクシング装置。 - 【請求項３】 前記制御手段は、前記制御手段によって
デマルチプレクス済みの前記ビデオおよびオーディオデ
ータビットストリームの各々を、前記空状態を表す前記
ビデオおよびオーディオバッファの各々へ提供する前に
一時的に各々格納するメモリ手段とをさらに備えること
を特徴とする請求項２記載の復号化システム用適応的な
ビットストリームデマルチプレクシング装置。 - 【請求項４】 前記制御手段は、マイクロコンピュータ
であることを特徴とする請求項１記載の復号化システム
用適応的なビットストリームデマルチプレシング装置。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1994P768 | 1994-01-18 | ||
| KR94000768A KR960008470B1 (en) | 1994-01-18 | 1994-01-18 | Apparatus for transferring bit stream data adaptively in the moving picture |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0844535A true JPH0844535A (ja) | 1996-02-16 |
| JP3694339B2 JP3694339B2 (ja) | 2005-09-14 |
Family
ID=19375786
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP33881394A Expired - Lifetime JP3694339B2 (ja) | 1994-01-18 | 1994-12-28 | 復号化システム用適応的ビットストリームデマルチプレクシング装置 |
Country Status (6)
| Country | Link |
|---|---|
| US (1) | US5521918A (ja) |
| EP (1) | EP0663774B1 (ja) |
| JP (1) | JP3694339B2 (ja) |
| KR (1) | KR960008470B1 (ja) |
| CN (1) | CN1074633C (ja) |
| DE (1) | DE69425040D1 (ja) |
Families Citing this family (75)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8661477B2 (en) | 1994-10-12 | 2014-02-25 | Touchtunes Music Corporation | System for distributing and selecting audio and video information and method implemented by said system |
| US7188352B2 (en) * | 1995-07-11 | 2007-03-06 | Touchtunes Music Corporation | Intelligent digital audiovisual playback system |
| US7424731B1 (en) | 1994-10-12 | 2008-09-09 | Touchtunes Music Corporation | Home digital audiovisual information recording and playback system |
| CA2201909C (fr) | 1994-10-12 | 2006-05-02 | Technical Maintenance Corporation | Systeme de reproduction audiovisuelle numerique intelligent |
| KR100238261B1 (ko) * | 1994-12-31 | 2000-01-15 | 윤종용 | 가변 비트율 복호화장치 |
| DE69631393T2 (de) * | 1995-03-29 | 2004-10-21 | Hitachi Ltd | Dekoder für komprimierte und multiplexierte Bild- und Audiodaten |
| JP2924739B2 (ja) * | 1995-10-30 | 1999-07-26 | 日本電気株式会社 | 動画像データの復号方式 |
| JPH09186966A (ja) * | 1995-12-25 | 1997-07-15 | Texas Instr Inc <Ti> | ビデオ再生方法及び再生システム |
| KR100192504B1 (ko) * | 1996-01-05 | 1999-06-15 | 구자홍 | 엠펙2 트랜스포트 디코더의 데이타 입출력장치 |
| US6404923B1 (en) | 1996-03-29 | 2002-06-11 | Microsoft Corporation | Table-based low-level image classification and compression system |
| US6405255B1 (en) * | 1996-07-01 | 2002-06-11 | Sun Microsystems, Inc. | Mixing and splitting multiple independent audio data streams in kernel space |
| US5856973A (en) * | 1996-09-10 | 1999-01-05 | Thompson; Kenneth M. | Data multiplexing in MPEG server to decoder systems |
| FR2753868A1 (fr) | 1996-09-25 | 1998-03-27 | Technical Maintenance Corp | Procede de selection d'un enregistrement sur un systeme numerique de reproduction audiovisuel et systeme pour mise en oeuvre du procede |
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