JPH08149385A - Ｐｌｌ周波数シンセサイザ選局装置 - Google Patents
Ｐｌｌ周波数シンセサイザ選局装置Info
- Publication number
- JPH08149385A JPH08149385A JP29017494A JP29017494A JPH08149385A JP H08149385 A JPH08149385 A JP H08149385A JP 29017494 A JP29017494 A JP 29017494A JP 29017494 A JP29017494 A JP 29017494A JP H08149385 A JPH08149385 A JP H08149385A
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- JP
- Japan
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- pll
- crystal oscillator
- tuning
- signal processing
- processing circuit
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Abstract
(57)【要約】
【目的】 ＰＬＬチューニング用ＩＣ及びビデオ信号処
理回路用ＩＣとを備えたＰＬＬ周波数シンセサイザ選局
装置において、水晶振動子を削減して低価格化を図るこ
とを目的とする。 【構成】 ビデオ信号処理回路用ＩＣ２に用いられる水
晶振動子Ｘｖの基準信号をバッファアンプ３及び負荷容
量Ｃｔを介してＰＬＬチューニング用ＩＣ１へ導くよう
に構成する。
理回路用ＩＣとを備えたＰＬＬ周波数シンセサイザ選局
装置において、水晶振動子を削減して低価格化を図るこ
とを目的とする。 【構成】 ビデオ信号処理回路用ＩＣ２に用いられる水
晶振動子Ｘｖの基準信号をバッファアンプ３及び負荷容
量Ｃｔを介してＰＬＬチューニング用ＩＣ１へ導くよう
に構成する。
Description
【０００１】
【産業上の利用分野】本発明は、テレビジョン受像機、
ビデオテープレコーダ、ビデオテープレコーダ一体型テ
レビジョン受像機等に使用されるＰＬＬ周波数シンセサ
イザ選局装置に関するものである。
ビデオテープレコーダ、ビデオテープレコーダ一体型テ
レビジョン受像機等に使用されるＰＬＬ周波数シンセサ
イザ選局装置に関するものである。
【０００２】
【従来の技術】一般にテレビジョンチューナ等のＰＬＬ
周波数シンセサイザ選局装置におけるＰＬＬ周波数シン
セサイザ回路は、プリスケーラ、位相検波器、バンドス
イッチドライバ、チャージポンプ、基準信号発生器等で
構成され、最近ではＰＬＬチューニング用ＩＣとして１
つのＩＣに集積化されている。この中で基準信号発生器
は、３〜４ＭＨｚ付近の水晶振動子を利用する発振回路
をＩＣに具備している。
周波数シンセサイザ選局装置におけるＰＬＬ周波数シン
セサイザ回路は、プリスケーラ、位相検波器、バンドス
イッチドライバ、チャージポンプ、基準信号発生器等で
構成され、最近ではＰＬＬチューニング用ＩＣとして１
つのＩＣに集積化されている。この中で基準信号発生器
は、３〜４ＭＨｚ付近の水晶振動子を利用する発振回路
をＩＣに具備している。
【０００３】図３及び図４に従来のテレビジョンチュー
ナのＰＬＬチューニング用ＩＣにおける水晶振動子の接
続回路の構成を示す。図３はＰＬＬチューニング用ＩＣ
における発振回路の構成が不平衡型の場合であり、図４
はＰＬＬチューニング用ＩＣにおける発振回路の構成が
平衡型の場合である。図３及び図４に示すＰＬＬチュー
ニング用ＩＣの場合、ＰＬＬチューニング用ＩＣ１の発
振回路端子（図中ＯＳＣ、ＯＳＣｉｎ、ＯＳＣｏｕｔ）
に４．０ＭＨｚの水晶振動子と負荷容量Ｃｔ’あるいは
負荷容量Ｃｔ”を接続し、ＰＬＬチューニング用ＩＣ１
の基準信号発生器が４．０ＭＨｚで発振する。これを分
周して得られる基準周波数ｆｒと、チューナの局部発振
周波数ｆｏｓｃを分周した比較周波数とが位相検波器
（図示せず）で比較され、同一周波数になった時にルー
プが安定する。この関係を式に表すと次のようになる。
ナのＰＬＬチューニング用ＩＣにおける水晶振動子の接
続回路の構成を示す。図３はＰＬＬチューニング用ＩＣ
における発振回路の構成が不平衡型の場合であり、図４
はＰＬＬチューニング用ＩＣにおける発振回路の構成が
平衡型の場合である。図３及び図４に示すＰＬＬチュー
ニング用ＩＣの場合、ＰＬＬチューニング用ＩＣ１の発
振回路端子（図中ＯＳＣ、ＯＳＣｉｎ、ＯＳＣｏｕｔ）
に４．０ＭＨｚの水晶振動子と負荷容量Ｃｔ’あるいは
負荷容量Ｃｔ”を接続し、ＰＬＬチューニング用ＩＣ１
の基準信号発生器が４．０ＭＨｚで発振する。これを分
周して得られる基準周波数ｆｒと、チューナの局部発振
周波数ｆｏｓｃを分周した比較周波数とが位相検波器
（図示せず）で比較され、同一周波数になった時にルー
プが安定する。この関係を式に表すと次のようになる。
【０００４】
【数１】
【０００５】代表的なＰＬＬチューニング用ＩＣでは下
表の如く、
表の如く、
【０００６】
【表１】
【０００７】となり、前記式（１）より
【０００８】
【数２】
【０００９】が求められ、ＭとＳをＰＬＬチューニング
用ＩＣの所定のビットでデータ送信することにより、チ
ューナの局部発振周波数を制御できる。
用ＩＣの所定のビットでデータ送信することにより、チ
ューナの局部発振周波数を制御できる。
【００１０】
【発明が解決しようとする課題】このように、ＰＬＬ周
波数シンセサイザ回路（ＩＣ）には必ず水晶振動子が必
要であるが、テレビジョン受像機においては、前記ＰＬ
Ｌ周波数シンセサイザ回路以外にもビデオ信号処理回路
があり、該回路（ＩＣ）においても同様に水晶振動子が
必要である。よってテレビジョン受像機においては、少
なくとも２つの水晶振動子を設けねばならず、このこと
がテレビジョンチューナの小型化及び低価格化を阻む要
因の１つとなっている。一方、ビデオテープレコーダや
ビデオテープレコーダ一体型テレビジョン受像機におい
てもやはり同様の問題を有している。
波数シンセサイザ回路（ＩＣ）には必ず水晶振動子が必
要であるが、テレビジョン受像機においては、前記ＰＬ
Ｌ周波数シンセサイザ回路以外にもビデオ信号処理回路
があり、該回路（ＩＣ）においても同様に水晶振動子が
必要である。よってテレビジョン受像機においては、少
なくとも２つの水晶振動子を設けねばならず、このこと
がテレビジョンチューナの小型化及び低価格化を阻む要
因の１つとなっている。一方、ビデオテープレコーダや
ビデオテープレコーダ一体型テレビジョン受像機におい
てもやはり同様の問題を有している。
【００１１】
【課題を解決するための手段】上記の課題を解決するた
め本発明では、ＰＬＬチューニング用ＩＣ及びビデオ信
号処理回路用ＩＣとを備えたＰＬＬ周波数シンセサイザ
選局装置において、前記ビデオ信号処理回路用ＩＣに用
いられる水晶振動子の基準信号を前記ＰＬＬチューニン
グ用ＩＣへ導くように構成したＰＬＬ周波数シンセサイ
ザ選局装置を提供せんとするものである。
め本発明では、ＰＬＬチューニング用ＩＣ及びビデオ信
号処理回路用ＩＣとを備えたＰＬＬ周波数シンセサイザ
選局装置において、前記ビデオ信号処理回路用ＩＣに用
いられる水晶振動子の基準信号を前記ＰＬＬチューニン
グ用ＩＣへ導くように構成したＰＬＬ周波数シンセサイ
ザ選局装置を提供せんとするものである。
【００１２】
【作用】上記の如く構成したので、ＰＬＬチューニング
用ＩＣには専用の水晶振動子を使用する必要がなく、Ｐ
ＬＬチューニング用ＩＣにはビデオ信号処理回路用ＩＣ
に用いられる水晶振動子の基準信号が供給される。
用ＩＣには専用の水晶振動子を使用する必要がなく、Ｐ
ＬＬチューニング用ＩＣにはビデオ信号処理回路用ＩＣ
に用いられる水晶振動子の基準信号が供給される。
【００１３】
【実施例】以下、図面を参照しつつ本発明の一実施例に
つき詳述する。
つき詳述する。
【００１４】本発明が適用されるテレビジョンチューナ
の構成を図１及び図２に示す。図１はＰＬＬチューニン
グ用ＩＣの発振回路の構成が不平衡型の場合、図２はＰ
ＬＬチューニング用ＩＣの発振回路の構成が平衡型の場
合である。
の構成を図１及び図２に示す。図１はＰＬＬチューニン
グ用ＩＣの発振回路の構成が不平衡型の場合、図２はＰ
ＬＬチューニング用ＩＣの発振回路の構成が平衡型の場
合である。
【００１５】本発明のＰＬＬ周波数シンセサイザ選局装
置の特徴は、ＰＬＬチューニング用ＩＣ１には従来の如
き専用の水晶振動子を具備せず、ビデオ信号処理回路Ｉ
Ｃ２の発振回路にある水晶振動子３を利用している点に
ある。即ち、ビデオ信号処理回路ＩＣ２のＯＳＣｏｕｔ
端子から、バッファアンプ３及び負荷容量Ｃｔを介し
て、ＰＬＬチューニング用ＩＣ１のＯＳＣ端子（図１参
照）またはＯＳＣｉｎ端子（図２参照）へ接続する。図
２の場合、ＰＬＬチューニング用ＩＣ１のＯＳＣｏｕｔ
端子は無接続（ＮＣ）とする。
置の特徴は、ＰＬＬチューニング用ＩＣ１には従来の如
き専用の水晶振動子を具備せず、ビデオ信号処理回路Ｉ
Ｃ２の発振回路にある水晶振動子３を利用している点に
ある。即ち、ビデオ信号処理回路ＩＣ２のＯＳＣｏｕｔ
端子から、バッファアンプ３及び負荷容量Ｃｔを介し
て、ＰＬＬチューニング用ＩＣ１のＯＳＣ端子（図１参
照）またはＯＳＣｉｎ端子（図２参照）へ接続する。図
２の場合、ＰＬＬチューニング用ＩＣ１のＯＳＣｏｕｔ
端子は無接続（ＮＣ）とする。
【００１６】ところで、従来のＰＬＬチューニング用Ｉ
Ｃ（図３及び図４参照）に使用されている水晶振動子Ｘ
ｐは４．０ＭＨｚであるのに対し、ビデオ信号処理回路
ＩＣに使用される水晶振動子ＸｖはＮＴＳＣ方式の場
合、色副搬送波周波数３．５７９５４５ＭＨｚである。
従って前述の（１）式において、
Ｃ（図３及び図４参照）に使用されている水晶振動子Ｘ
ｐは４．０ＭＨｚであるのに対し、ビデオ信号処理回路
ＩＣに使用される水晶振動子ＸｖはＮＴＳＣ方式の場
合、色副搬送波周波数３．５７９５４５ＭＨｚである。
従って前述の（１）式において、
【００１７】
【数３】
【００１８】となるので、従来の４．０ＭＨｚの水晶を
使用した時と同じ局部発振周波数に設定するには、
（１）式における（ｍＭ＋Ｓ）を４／３．５７９５４５
倍することで可能となる。
使用した時と同じ局部発振周波数に設定するには、
（１）式における（ｍＭ＋Ｓ）を４／３．５７９５４５
倍することで可能となる。
【００１９】即ち、代表的な例として、前記（２）式に
おいて、例えば日本国内の１０チャンネルを受信する局
部発振周波数を設定する場合では、Ｍ（メインカウンタ
・プリセット値）とＳ（スロワーカウンタ・プリセット
値）のビットデータは次のようになる。
おいて、例えば日本国内の１０チャンネルを受信する局
部発振周波数を設定する場合では、Ｍ（メインカウンタ
・プリセット値）とＳ（スロワーカウンタ・プリセット
値）のビットデータは次のようになる。
【００２０】１０チャンネル（２０５．２５ＭＨｚ）の
局部発振周波数は２６４．０ＭＨｚであるから、式
（２）より従来においては、
局部発振周波数は２６４．０ＭＨｚであるから、式
（２）より従来においては、
【００２１】
【数４】
【００２２】であったのに対し、本発明の場合は、
【００２３】
【数５】
【００２４】とすることで局部発振周波数を設定するこ
とが可能となる。
とが可能となる。
【００２５】尚、このＭとＳはマイクロコンピュータか
ら出力するデータであるから、ソフトウェアの変更をす
るだけで簡単に本発明を実施ことできる。また、前記バ
ッファアンプ３はＰＬＬチューニング用ＩＣと映像信号
処理回路ＩＣとの相互干渉を防止する目的で設定してい
るが、相互の干渉が問題とならない範囲で抵抗器に置き
換えても良く、或いは省略することも可能である。
ら出力するデータであるから、ソフトウェアの変更をす
るだけで簡単に本発明を実施ことできる。また、前記バ
ッファアンプ３はＰＬＬチューニング用ＩＣと映像信号
処理回路ＩＣとの相互干渉を防止する目的で設定してい
るが、相互の干渉が問題とならない範囲で抵抗器に置き
換えても良く、或いは省略することも可能である。
【００２６】
【発明の効果】以上、詳述した如く本発明に依れば、Ｐ
ＬＬチューニング用ＩＣ及びビデオ信号処理回路用ＩＣ
とを備えたＰＬＬ周波数シンセサイザ選局装置におい
て、前記ビデオ信号処理回路用ＩＣに用いられる水晶振
動子の基準信号を前記ＰＬＬチューニング用ＩＣへ導く
ように構成したので、従来ＰＬＬチューニング用ＩＣに
必要だった専用の水晶振動子が不要となり、小型で安価
なＰＬＬ周波数シンセサイザ選局装置を提供できる。ま
た、１つの映像機器の中に複数個のＰＬＬ周波数シンセ
サイザ選局装置（チューナ装置）が存在する場合、例え
ばビデオテープレコーダ一体型テレビジョン受像機のよ
うに２個のチューナ装置を備える場合や、地上波チュー
ナ（ＵＨＦ・ＶＨＦチューナ等）と衛星放送チューナ
（ＢＳチューナやＣＳチューナ等）とを備える場合にも
同様にして水晶振動子の削減が可能であり、映像機器の
低価格化に寄与することができる。
ＬＬチューニング用ＩＣ及びビデオ信号処理回路用ＩＣ
とを備えたＰＬＬ周波数シンセサイザ選局装置におい
て、前記ビデオ信号処理回路用ＩＣに用いられる水晶振
動子の基準信号を前記ＰＬＬチューニング用ＩＣへ導く
ように構成したので、従来ＰＬＬチューニング用ＩＣに
必要だった専用の水晶振動子が不要となり、小型で安価
なＰＬＬ周波数シンセサイザ選局装置を提供できる。ま
た、１つの映像機器の中に複数個のＰＬＬ周波数シンセ
サイザ選局装置（チューナ装置）が存在する場合、例え
ばビデオテープレコーダ一体型テレビジョン受像機のよ
うに２個のチューナ装置を備える場合や、地上波チュー
ナ（ＵＨＦ・ＶＨＦチューナ等）と衛星放送チューナ
（ＢＳチューナやＣＳチューナ等）とを備える場合にも
同様にして水晶振動子の削減が可能であり、映像機器の
低価格化に寄与することができる。
【図１】本発明のＰＬＬ周波数シンセサイザ選局装置の
構成を示す回路ブロック図。
構成を示す回路ブロック図。
【図２】本発明の他の実施例を示す回路ブロック図。
【図３】従来のＰＬＬ周波数シンセサイザ選局装置の構
成を示す回路ブロック図。
成を示す回路ブロック図。
【図４】従来の他のＰＬＬ周波数シンセサイザ選局装置
の構成を示す回路ブロック図。
の構成を示す回路ブロック図。
１ ＰＬＬチューニング用ＩＣ ２ ビデオ信号処理回路用ＩＣ ３ バッファアンプ Ｃｔ 負荷容量 Ｃｔ’ 負荷容量 Ｃｔ” 負荷容量 Ｃｖ 負荷容量 Ｘｐ 水晶振動子（４．０ＭＨｚ） Ｘｖ 水晶振動子（３．５７９５４５ＭＨｚ）
Claims (1)
- 【請求項１】 ＰＬＬチューニング用ＩＣ及びビデオ信
号処理回路用ＩＣとを備えたＰＬＬ周波数シンセサイザ
選局装置において、前記ビデオ信号処理回路用ＩＣに用
いられる水晶振動子の基準信号を前記ＰＬＬチューニン
グ用ＩＣへ導くように構成したことを特徴とするＰＬＬ
周波数シンセサイザ選局装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29017494A JP3192892B2 (ja) | 1994-11-24 | 1994-11-24 | Ｐｌｌ周波数シンセサイザ選局装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29017494A JP3192892B2 (ja) | 1994-11-24 | 1994-11-24 | Ｐｌｌ周波数シンセサイザ選局装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH08149385A true JPH08149385A (ja) | 1996-06-07 |
| JP3192892B2 JP3192892B2 (ja) | 2001-07-30 |
Family
ID=17752713
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP29017494A Expired - Lifetime JP3192892B2 (ja) | 1994-11-24 | 1994-11-24 | Ｐｌｌ周波数シンセサイザ選局装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3192892B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6753924B1 (en) | 1999-10-08 | 2004-06-22 | Funai Electric Co., Ltd. | Oscillation signal processing apparatus, television apparatus and oscillation signal processing control method |
-
1994
- 1994-11-24 JP JP29017494A patent/JP3192892B2/ja not_active Expired - Lifetime
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6753924B1 (en) | 1999-10-08 | 2004-06-22 | Funai Electric Co., Ltd. | Oscillation signal processing apparatus, television apparatus and oscillation signal processing control method |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3192892B2 (ja) | 2001-07-30 |
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