JPH0799905B2 - 電圧補償装置 - Google Patents
電圧補償装置Info
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- JPH0799905B2 JPH0799905B2 JP63086700A JP8670088A JPH0799905B2 JP H0799905 B2 JPH0799905 B2 JP H0799905B2 JP 63086700 A JP63086700 A JP 63086700A JP 8670088 A JP8670088 A JP 8670088A JP H0799905 B2 JPH0799905 B2 JP H0799905B2
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- Supply And Distribution Of Alternating Current (AREA)
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Description
来の電圧補償装置を示す回路図であり、図において
(1)は交流電源、(2)は電源側インピーダンス、
(3)は負荷、(4)はリアクトル、(5)はリアクト
ルに流れる無効電力を制御するサイリスタスイツチ、
(6)はコンデンサ、(7)は(4)〜(6)で構成さ
れている電圧補償装置である。
つている場合を考える。但し、PLは負荷に流れる有効電
力、QLは負荷に流れる無効電力を示す。電圧補償装置
(7)では固定の進相コンデンサ(6)によりjQFCなる
一定の無効電力を出力し、一方ではリアクトル(4)に
流入する無効電力jQLの大きさをサイリスタスイツチ
(5)により連続的に制御するようにしている。この結
果、電圧補償装置(7)の出力の無効電力jQCは jQC=j(QFC−QR) ……(1) で表わされ、QRの大きさをサイリスタスイツチ(5)で
調整することにより、jQCが連続的に制御できるように
構成している。
電源側インピーダンス(2)をxで表わすと ΔV=x・QS=x・(QL−QC) ……(3) として表現できるためQL=QCになるように電圧補償装置
(7)を制御することによりA点の電圧変動を零にする
ことができる。
無効電力だけしか補償できないため交流電源側の電圧が
瞬時停電や瞬時電圧低下などの変動が生じた場合には負
荷接続点(A点)の電圧が維持できないという課題があ
つた。
もので、交流電源側の瞬時停電や瞬時電圧低下に対して
も負荷接続点の電圧を維持できる電圧補償装置を得るこ
とを目的とする。
加される系統電圧を一定に制御するために、直流側にコ
ンデンサが接続され且つ交流側が系統電圧の制御用接続
点側に接続されたインバータと、系統電圧に基づいてイ
ンバータを制御するためのフィードバックループを構成
する制御回路とを有し、系統電圧の定常的な電圧変動に
対しては、インバータからの無効電力出力により系統電
圧を一定に制御し、系統電圧の過渡的な電圧変革に対し
ては、コンデンサの電荷を従放電することにより、負荷
に有効電力を供給して系統電圧を一定に制御するもので
ある。
には、制御回路のフィードバック制御によるインバータ
からの無効電力制御によって系統電圧を一定に制御し、
系統電圧の電圧変化が大きい場合には、インバータの直
流側のコンデンサの電荷を充放電しつつ負荷に有効電力
を供給して系統電圧を一定に制御することにより負荷端
の電圧を維持する。
図において、(8)は負荷(3)に印加される系統電圧
を制御するための接続点Aに接続された変圧器、(9)
は変圧器(8)の二次側に接続され自励形インバータ装
置(以下、単にインバータという)、(10)はインバー
タ(9)の直流側に接続されたコンデンサ、(11)は変
圧器(8)の一時側に設置されて電源系統側の出力電流
Ia〜Icを検出するための電流変成器、(12)は変圧器
(8)の一次側に接続されて電源系統側の出力電圧Va〜
Vcを検出するための電圧変成器、(13)は検出された出
力電流Ia〜Ic及び出力電圧Va〜Vcに基づいてインバータ
(9)をフィードバック制御するための制御回路、(1
4)は接続点Aと変圧器(8)、電流変成器(11)及び
電圧変成器(12)とを接続する出力端子、(15)は変成
器(8)〜出力端子(14)から構成されて接続点Aにお
ける系統電圧を一定制御するための電圧補償装置であ
る。
回路図である。第2図において(16a)〜(16f)はトラ
ンジスタスイツチ、(17)はコンデンサ電圧検出器、
(18a)〜(18c)は電圧基準信号作成回路、(19a)〜
(19c)は演算回路、(20a)〜(20c)は電圧制御回
路、(21a)〜(21c)は演算回路、(22a)〜(22c)は
電流制御回路、(23)はPWM制御回路、(24)は演算回
路、(25)はコンデンサ電圧制御回路、(26a)〜(26
c)は演算回路、(27a)〜(27c)は演算回路である。
第1図の電圧補償装置(15)の出力端子(14)の電圧は
電圧変成器(12)により検出され、その電圧検出信号
Va,Vb,Vcは制御回路(13)へ入力される。制御回路(1
3)では上記電圧検出信号は第2図に示すように電圧基
準信号発生回路(18a)〜(18c)に入力される。この電
圧基準発生回路は出力端子(14)の電圧に同期してかつ
電圧変動のない正弦波信号VRa,VRb,VRcを出力する。こ
の正弦波信号の出力は第3図に示すようにPLL(Phase L
ocked Loop)回路(28)を用いて正弦波信号を記憶した
ROM(Read Only Memory)(29)のデータを順次読み出
し、このデータをD/A変換器(30)によりアナログ信号
に変換することにより実現できる。
準信号として作用し、演算回路(19a),(19b),(19
c)において電圧基準信号のVRa,VRb,VRcと電圧検出信号
Va,Vb,Vcとの偏差ΔVa,ΔVb,ΔVcがそれぞれ演算され
る。
a),(20b),(20c)において増巾された後IRa,IRb,I
Rcとして以降の電流制御回路の電流基準信号として作用
する。
a),(11b),(11c)により検出され、その検出信号
はIa,Ib,Icとして演算回路(21a),(21b),(21c)
において上述の電流基準信号IRa,IRb,IRcと減算され、
電流偏差信号ΔIa,ΔIb,ΔIcが求められる。このΔIa,
ΔIb,ΔIcは電流制御回路(22a),(22b),(22c)に
入力されゲインK倍だけ増巾され、出力K・ΔIa,K・Δ
Ib,K・ΔIcを出力する。
(17)で検出されその検出信号Vdcは演算回路(24)に
おいてコンデンサ電圧基準信号Vrefと減算され電圧偏差
信号ΔVcが求められる。
力され、コンデンサに流れる電流を制御するための電圧
シフト信号Vca,Vcb,Vccを出力する。
電源電圧信号Va,Vb,Vcと90度の位相差を有する余弦波信
号となつており、次段の演算回路(26a),(26b),
(26c)において上記のVca,Vcb,VccとVa,Vb,Vcをそれぞ
れ加算することにより、コンデンサ(10)の電圧がコン
デンサ電圧基準信号Vrefより低い場合には第7図(C)
に示すようにVca,Vcb,VccはVa,Vb,Vcの位相をそれぞれ
遅らせるように作用し、またコンデンサ電圧がVrefより
高い場合には第8図(C)に示すようにVca,Vcb,VccはV
a,Vb,Vcの位相を進ませるように作用する。
演算した出力にはEa,Eb,Ecの記号で第2図に表示してい
るが、次段の演算回路(27a),(27b),(27c)へフ
イードフオワード信号として入力される。このEa,Eb,Ec
は前述のようにコンデンサ電圧<Vrefの場合にはVa,Vb,
Vcより位相が遅れるため、インバータの出力電圧はそれ
に応じて電源電圧より位相が遅れ有効電力を系統側から
インバータ側に流し込みコンデンサ(10)の電圧を上昇
させるように作用する。また、コンデンサ電圧>Vrefの
場合にはEa,Eb,EcはVa,Vb,Vcより位相が進むことによ
り、インバータ側から系統側へ有効電力を供給するた
め、コンデンサ電圧は低下する。このようにEa,Eb,Ecは
コンデンサ電圧を一定にするように作用することにな
る。
御回路(22a),(22b),(22c)の出力信号K・ΔIa,
K・ΔIb,K・ΔIcと加算された後、信号Ma,Mb,McとしてP
WM制御回路(23)へ入力される。PWM制御回路(23)で
は入力信号Ma,Mb,Mcに応じてPWM波形整形を行いインバ
ータ(9)を構成するトランジスタスイツチ(16a)〜
(16f)にON/OFF信号を与える。
出力端子(14a),(14b),(14c)の電圧は一定にす
ることができる。また、コンデンサ(10)の電圧はコン
デンサ電圧制御回路(25)により一定電圧のVrefになる
ように制御されるので定常的にインバータ(9)に流れ
る有効電流は0になり、無効電流のみが流れることにな
る。従つて定常状態では電圧補償装置(15)の出力端子
(14a),(14b),(14c)の電圧はインバータ(9)
に流れる無効電流により一定に保たれることになる。
電圧低下を生じた場合を考えると、出力端子電圧を一定
に保つように制御回路が瞬時に動作する結果、コンデン
サ(10)に蓄積されている電荷が放電し、インバータか
ら有効電力を出力し、負荷(3)に供給することができ
るため、瞬時電圧低下時にも出力電圧を一定に保つこと
が可能となる。この場合、コンデンサ(10)の電圧は電
荷の放電に伴つて低下してくるが、電圧低下が回復した
後、コンデンサ電圧制御回路(25)により自動的に元の
電圧VREFまで電源(1)から充電され、次の電圧低下に
備え待機することになる。更に、電圧基準信号VRa,VRb,
VRcからの偏差分はすべてインバータ(9)により補償
できるので第1図の負荷接続点A点の電圧歪も補償する
ことができる。
(9)からの無効電力により接続点Aの系統電圧を一定
制御するが、系統電圧が過渡的に急変したときには、コ
ンデンサ(10)の充放電により一時的に有効電力を出力
することにより接続点Aの系統電圧を一定制御すること
ができ、電圧補償効果は著しく向上する。
ータ(9)より有効電力を出力した場合、その1部が電
源(1)側に流出するため必要なコンデンサ容量が大き
くなるという問題がある。これを解決するためには第4
図に示すような第2の実施例を適用することができる。
第4図では電圧補償装置(15)の接続点Aより電源側に
直列にサイリスタスイツチ(31)を設けると共にサイリ
スタスイツチ(31)を制御するための制御回路(32)を
追加している。制御回路(32)はA点の電圧をモニタし
ており、A点の電圧が一定値以上の場合にはサイリスタ
スイツチ(31)をONにしておき、A点の電圧が一定値以
下に低下した場合にサイリスタスイツチ(31)をOFFに
するように動作する。このように構成することにより瞬
時電圧低下時にはサイリスタスイツチ(31)をOFFにす
るためインバータ(9)からの有効電力は全部負荷
(3)へ供給できるため、コンデンサ(10)の容量は負
荷(3)の容量に見合つただけで良いことになり、コン
デンサ容量を低減できる。第5図はこの発明の第3の実
施例を示す回路図である。第5図ではリアクトル(34)
をA点と電源(1)との間に直列に接続し、かつリアク
トル(34)と並列にサイリスタスイツチ(35)を並列に
接続している。また、サイリスタスイツチ(35)を接続
するための制御回路(33)が追加されている。
(31)としてサイリスタを逆並列に接続した回路を示し
たが、特にサイリスタである必要はなく、トランジスタ
等の半導体スイツチでもよく、また半導体以外のスイツ
チング素子でも上記実施例と同様の効果を奏する。
に、制御回路(32)を電圧変成器(12)の二次側に設け
たが、交流電源1の出力ラインに直接設置してもよい。
に接続する場合を示したが、特にリアクトルである必要
はなく誘導性インピーダンスを有する回路要素であれば
何でも良く、上記実施例と同様の効果を奏する。
点の電圧をモニタしており、この電圧が一定値以上であ
るときはサイリスタスイツチ(35)をONにし、リアクト
ル(34)を短絡しておく。又、電源電圧が一定値以下に
低下した場合には制御回路(33)からサイリスタスイツ
チ(35)へOFF信号を出し、サイリスタスイツチをOFFに
することによりリアクトル(34)を回路に挿入する。こ
の結果、インバータ(9)から出力される有効電力と無
効電力が電源(1)側へ流出するのを防止できる。
し、第6図に示すようにリアクトル(34)のみを電源側
に常時直列に接続しておくだけでもよい。
印加される系統電圧を一定に制御するために、直流側に
コンデンサが接続され且つ交流側が系統電圧の制御用接
続点側に接続されたインバータと、系統電圧に基づいて
インバータを制御するためのフィードバックループを構
成する制御回路とを有し、系統電圧の定常的な電圧変動
に対しては、インバータから無効電力出力により系統電
圧を一定に制御し、系統電圧の過渡的な電圧変化に対し
ては、コンデンサの電荷を充放電することにより、負荷
に有効電力を供給して系統電圧を一定に制御する効果が
ある。
示す回路図、第2図はこの発明の詳細回路図、第3図は
電圧基準信号の発生方法を示す回路図、第4図はこの発
明の第2の実施例を示す回路図、第5図はこの発明の第
3の実施例を示す回路図、第6図はこの発明の第4の実
施例を示す回路図、第7図と第8図は電圧位相シフト方
法を示す波形説明図、第9図は従来の電圧補償装置を示
す回路図である。 図において、(1)は交流電源、(2)は電源側インピ
ーダンス、(3)は負荷、(4)はリアクトル、(5)
はサイリスタスイツチ、(6)はコンデンサ、(7)は
(4)〜(6)で構成される従来の電圧補償装置、
(8)は変圧器、(9)は自励形インバータ装置、(1
0)は直流コンデンサ、(11)は電流変成器、(12)は
電圧変成器、(13)は制御回路、(14)は出力端子、
(15)は(8)〜(14)で構成される電圧補償装置、
(16)はトランジスタスイツチ、(17)はコンデンサ電
圧検出回路、(18)は電圧基準信号作成回路、(19)は
演算回路、(20)は電圧制御回路、(21)は演算回路、
(22)は電流制御回路、(23)はPWM制御回路、(24)
は演算回路、(25)はコンデンサ電圧制御回路、(2
6),(27)は演算回路、(28)はPLL回路、(29)はRO
M回路、(30)はD/A変換回路、(31)はサイリスタスイ
ツチ、(32)は制御回路、(33)は制御回路、(34)は
リアクトル、(35)はサイリスタスイツチである。 なお、図中、同一符号は同一、又は相当部分を示す。
Claims (4)
- 【請求項1】交流電源に接続された負荷に対して並列接
続され、前記負荷に印加される系統電圧を一定に制御す
る電圧補償装置であって、 直流側にコンデンサが接続され且つ交流側が前記系統電
圧の制御用接続点側に接続されたインバータと、 前記系統電圧に基づいて前記インバータを制御するため
のフィードバックループを構成する制御回路とを有し、 前記系統電圧の定常的な電圧変動に対しては、前記イン
バータからの無効電力出力により前記系統電圧を一定に
制御し、 前記系統電圧の過渡的な電圧変化に対しては、前記コン
デンサの電荷を充放電することにより、前記負荷に有効
電力を供給して前記系統電圧を一定に制御することを特
徴とする電圧補償装置。 - 【請求項2】前記交流電源と前記制御用接続点との間に
挿入されたスイッチング素子と、 前記系統電圧に応じて前記スイッチング素子を制御する
制御回路とを備え、 前記制御回路は、 前記系統電圧が所定値を越えたときには前記スイッチン
グ素子をONにし、 前記系統電圧が前記所定値以下のときには前記スイッチ
ング素子をOFFにすることを特徴とする特許請求の範囲
第1項記載の電圧補償装置。 - 【請求項3】前記スイッチング素子に並列接続された誘
電性インピーダンスを備えたことを特徴とする特許請求
の範囲第2項記載の電圧補償装置。 - 【請求項4】前記交流電源と前記制御用接続点との間に
挿入された誘導性インピーダンスを備えたことを特徴と
する特許請求の範囲第1項記載の電圧補償装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63086700A JPH0799905B2 (ja) | 1988-04-07 | 1988-04-07 | 電圧補償装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP63086700A JPH0799905B2 (ja) | 1988-04-07 | 1988-04-07 | 電圧補償装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH01259728A JPH01259728A (ja) | 1989-10-17 |
JPH0799905B2 true JPH0799905B2 (ja) | 1995-10-25 |
Family
ID=13894219
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP63086700A Expired - Lifetime JPH0799905B2 (ja) | 1988-04-07 | 1988-04-07 | 電圧補償装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0799905B2 (ja) |
Family Cites Families (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS629414A (ja) * | 1985-07-05 | 1987-01-17 | Res Dev Corp Of Japan | 瞬時無効および有効電力補償装置 |
JPS6223327A (ja) * | 1985-07-19 | 1987-01-31 | 富士電機株式会社 | 高調波補償装置の制御装置 |
JPS62277065A (ja) * | 1986-05-26 | 1987-12-01 | Mitsubishi Electric Corp | アクテイブフイルタ装置 |
-
1988
- 1988-04-07 JP JP63086700A patent/JPH0799905B2/ja not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
JPH01259728A (ja) | 1989-10-17 |
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