JPH07222461A - インバータ回路 - Google Patents
インバータ回路Info
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- JPH07222461A JPH07222461A JP6009717A JP971794A JPH07222461A JP H07222461 A JPH07222461 A JP H07222461A JP 6009717 A JP6009717 A JP 6009717A JP 971794 A JP971794 A JP 971794A JP H07222461 A JPH07222461 A JP H07222461A
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- Japan
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- switch
- switch element
- secondary winding
- gate
- voltage
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- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02B—CLIMATE CHANGE MITIGATION TECHNOLOGIES RELATED TO BUILDINGS, e.g. HOUSING, HOUSE APPLIANCES OR RELATED END-USER APPLICATIONS
- Y02B70/00—Technologies for an efficient end-user side electric power management and consumption
- Y02B70/10—Technologies improving the efficiency by using switched-mode power supplies [SMPS], i.e. efficient power electronics conversion e.g. power factor correction or reduction of losses in power supplies or efficient standby modes
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- Circuit Arrangements For Discharge Lamps (AREA)
- Inverter Devices (AREA)
Abstract
(57)【要約】
【目的】 スイッチ素子３がオフする期間を遅らせるこ
とができるようにしてインバータ回路の自励動作を防止
し得るようにする。 【構成】 共振回路９のチョーク７に、一対の２次巻線
１１，１２が、前記２個のスイッチ素子２，３のゲート
端子に夫々駆動信号を供給するように設けられ、前記２
個のスイッチ素子２，３のうちの他方のスイッチ素子３
のゲート端子側に、該他方のスイッチ素子３をオフさせ
るべくオン動作する制御スイッチ１３が設けられ、この
制御スイッチ１３のオン期間を制御するスイッチ制御回
路１４が設けられたハーフブリッジ型のインバータ回路
において、前記他方のスイッチ素子３のゲート端子と、
チョーク７に設けた２次巻線１２との間に、スイッチ素
子３側がカソード側になるようにダイオード１７が接続
されると共に、該ダイオード１７に抵抗１８が並列接続
されている。
とができるようにしてインバータ回路の自励動作を防止
し得るようにする。 【構成】 共振回路９のチョーク７に、一対の２次巻線
１１，１２が、前記２個のスイッチ素子２，３のゲート
端子に夫々駆動信号を供給するように設けられ、前記２
個のスイッチ素子２，３のうちの他方のスイッチ素子３
のゲート端子側に、該他方のスイッチ素子３をオフさせ
るべくオン動作する制御スイッチ１３が設けられ、この
制御スイッチ１３のオン期間を制御するスイッチ制御回
路１４が設けられたハーフブリッジ型のインバータ回路
において、前記他方のスイッチ素子３のゲート端子と、
チョーク７に設けた２次巻線１２との間に、スイッチ素
子３側がカソード側になるようにダイオード１７が接続
されると共に、該ダイオード１７に抵抗１８が並列接続
されている。
Description
【０００１】
【産業上の利用分野】本発明は、放電灯点灯装置等に使
用されるハーフブリッジ型のインバータ回路に関する。
用されるハーフブリッジ型のインバータ回路に関する。
【０００２】
【従来の技術】図５は放電灯点灯装置に用いた従来のハ
ーフブリッジ型のインバータ回路の回路図である。同図
において、１は直流電源、２，３はスイッチ素子で、直
流電源１に直列接続されている。一方のスイッチ素子２
はトランジスタにより構成され、他方のスイッチ素子３
は金属酸化膜ゲート電界効果形トランジスタ（ＭＯＳＦ
ＥＴ）により構成されている。一方のスイッチ素子２
に、直流カット用のコンデンサ５と共振用コンデンサ６
とチョーク７と負荷である放電灯８とを備える共振回路
９が並列接続され、共振回路９のチョーク７に、一対の
２次巻線１１，１２が、スイッチ素子２，３のゲート端
子に夫々駆動信号を供給するように設けられ、共振回路
９を励振して放電灯８を点灯させるようになっている。
スイッチ素子３のゲート端子側に、該スイッチ素子３を
オフさせるべくオン動作する制御スイッチ１３が設けら
れ、この制御スイッチ１３のオン期間をＰＷＭ制御する
スイッチ制御回路１４が設けられている。
ーフブリッジ型のインバータ回路の回路図である。同図
において、１は直流電源、２，３はスイッチ素子で、直
流電源１に直列接続されている。一方のスイッチ素子２
はトランジスタにより構成され、他方のスイッチ素子３
は金属酸化膜ゲート電界効果形トランジスタ（ＭＯＳＦ
ＥＴ）により構成されている。一方のスイッチ素子２
に、直流カット用のコンデンサ５と共振用コンデンサ６
とチョーク７と負荷である放電灯８とを備える共振回路
９が並列接続され、共振回路９のチョーク７に、一対の
２次巻線１１，１２が、スイッチ素子２，３のゲート端
子に夫々駆動信号を供給するように設けられ、共振回路
９を励振して放電灯８を点灯させるようになっている。
スイッチ素子３のゲート端子側に、該スイッチ素子３を
オフさせるべくオン動作する制御スイッチ１３が設けら
れ、この制御スイッチ１３のオン期間をＰＷＭ制御する
スイッチ制御回路１４が設けられている。
【０００３】この場合、２次巻線１２の巻線電圧は図６
（イ）に示すよう波形であり、またスイッチ素子３のゲ
ート電圧は図６（ロ）に示すよう波形になる。時点Ｂで
スイッチ素子３のゲート端子ＶGS（スレッシュホールド
電圧）以下になり、スイッチ素子３のＶSD（ソースドレ
イン間電圧）が図６（ハ）に示すよう波形になり、スイ
ッチ素子２，３は、チョーク７に設けた２次巻線１１，
１２によりドライブされ、共振回路９の共振に従ってオ
ンオフする。また、２次巻線１２からの駆動信号によっ
てスイッチ制御回路１４を動作させてスイッチ制御回路
１４により所定の周期で制御スイッチ１３をオンさせ、
これにより時点Ｂより前にスイッチ素子３をオフさせ
て、該スイッチ素子３のオン期間を変化できるようにな
っている。
（イ）に示すよう波形であり、またスイッチ素子３のゲ
ート電圧は図６（ロ）に示すよう波形になる。時点Ｂで
スイッチ素子３のゲート端子ＶGS（スレッシュホールド
電圧）以下になり、スイッチ素子３のＶSD（ソースドレ
イン間電圧）が図６（ハ）に示すよう波形になり、スイ
ッチ素子２，３は、チョーク７に設けた２次巻線１１，
１２によりドライブされ、共振回路９の共振に従ってオ
ンオフする。また、２次巻線１２からの駆動信号によっ
てスイッチ制御回路１４を動作させてスイッチ制御回路
１４により所定の周期で制御スイッチ１３をオンさせ、
これにより時点Ｂより前にスイッチ素子３をオフさせ
て、該スイッチ素子３のオン期間を変化できるようにな
っている。
【０００４】
【発明が解決しようとする課題】しかし、従来の場合、
時点Ｂより後にスイッチ素子３をオフさせることはでき
ず、従ってスイッチ素子３のオン期間を短くする制御は
できるが、スイッチ素子３のオン期間を長くするような
制御は不可能であり、このため共振回路９の周波数等の
兼ね合いにより、スイッチ制御回路１４からの信号より
先にスイッチ素子３がオフしてしまう場合には、スイッ
チ制御回路１４によるスイッチ素子３のオン期間の制御
ができなくなり、インバータ回路が自励動作するという
問題があった。
時点Ｂより後にスイッチ素子３をオフさせることはでき
ず、従ってスイッチ素子３のオン期間を短くする制御は
できるが、スイッチ素子３のオン期間を長くするような
制御は不可能であり、このため共振回路９の周波数等の
兼ね合いにより、スイッチ制御回路１４からの信号より
先にスイッチ素子３がオフしてしまう場合には、スイッ
チ制御回路１４によるスイッチ素子３のオン期間の制御
ができなくなり、インバータ回路が自励動作するという
問題があった。
【０００５】本発明は上記問題点に鑑み、スイッチ素子
３がオフする期間を遅らせることができるようにしてイ
ンバータ回路の自励動作を防止し得るようにしたもので
ある。
３がオフする期間を遅らせることができるようにしてイ
ンバータ回路の自励動作を防止し得るようにしたもので
ある。
【０００６】
【課題を解決するための手段】この技術的課題を解決す
る本発明の技術手段は、直流電源１に、２個のスイッチ
素子２，３が直列接続され、この２個のスイッチ素子
２，３のうちの一方のスイッチ素子２に、チョーク７を
備える共振回路９が並列接続され、共振回路９のチョー
ク７に、一対の２次巻線１１，１２が、前記２個のスイ
ッチ素子２，３のゲート端子に夫々駆動信号を供給する
ように設けられ、前記２個のスイッチ素子２，３のうち
の他方のスイッチ素子３のゲート端子側に、該他方のス
イッチ素子３をオフさせるべくオン動作する制御スイッ
チ１３が設けられ、この制御スイッチ１３のオン期間を
制御するスイッチ制御回路１４が設けられたハーフブリ
ッジ型のインバータ回路において、前記他方のスイッチ
素子３のゲート端子と、チョーク７に設けた２次巻線１
２との間に、スイッチ素子３側がカソード側になるよう
にダイオード１７が接続されると共に、該ダイオード１
７に抵抗１８が並列接続されている点にある。
る本発明の技術手段は、直流電源１に、２個のスイッチ
素子２，３が直列接続され、この２個のスイッチ素子
２，３のうちの一方のスイッチ素子２に、チョーク７を
備える共振回路９が並列接続され、共振回路９のチョー
ク７に、一対の２次巻線１１，１２が、前記２個のスイ
ッチ素子２，３のゲート端子に夫々駆動信号を供給する
ように設けられ、前記２個のスイッチ素子２，３のうち
の他方のスイッチ素子３のゲート端子側に、該他方のス
イッチ素子３をオフさせるべくオン動作する制御スイッ
チ１３が設けられ、この制御スイッチ１３のオン期間を
制御するスイッチ制御回路１４が設けられたハーフブリ
ッジ型のインバータ回路において、前記他方のスイッチ
素子３のゲート端子と、チョーク７に設けた２次巻線１
２との間に、スイッチ素子３側がカソード側になるよう
にダイオード１７が接続されると共に、該ダイオード１
７に抵抗１８が並列接続されている点にある。
【０００７】
【作用】スイッチ素子３のゲート電圧は、充電時は２次
巻線１２の巻線電圧により抵抗１９、ダイオード１７の
ループで充電されてその電圧が決定される。その後、２
次巻線１２の巻線電圧がスイッチ素子３のゲート電圧よ
り小になったとき、スイッチ素子３のゲート電荷は抵抗
１８、抵抗１９のループで２次巻線１２に徐々に放電さ
れる。その後制御スイッチ１３がオンすると、スイッチ
素子３のゲート電荷はその後スイッチ制御回路１４の制
御スイッチ１３により急速にぬかれて、スイッチ素子３
はオフする。従って、２次巻線１２よりスイッチ素子３
のゲート端子に電流が流れる場合には、抵抗１９のみが
働き、スイッチ素子３のゲート端子より２次巻線１２に
電流が流れる場合には、抵抗１８，１９の合計の抵抗値
で電流が制限され、これによってスイッチ素子３が、ス
イッチ制御回路１４で動作せずに２次巻線１２の巻線電
圧によってオフすることを防止する。
巻線１２の巻線電圧により抵抗１９、ダイオード１７の
ループで充電されてその電圧が決定される。その後、２
次巻線１２の巻線電圧がスイッチ素子３のゲート電圧よ
り小になったとき、スイッチ素子３のゲート電荷は抵抗
１８、抵抗１９のループで２次巻線１２に徐々に放電さ
れる。その後制御スイッチ１３がオンすると、スイッチ
素子３のゲート電荷はその後スイッチ制御回路１４の制
御スイッチ１３により急速にぬかれて、スイッチ素子３
はオフする。従って、２次巻線１２よりスイッチ素子３
のゲート端子に電流が流れる場合には、抵抗１９のみが
働き、スイッチ素子３のゲート端子より２次巻線１２に
電流が流れる場合には、抵抗１８，１９の合計の抵抗値
で電流が制限され、これによってスイッチ素子３が、ス
イッチ制御回路１４で動作せずに２次巻線１２の巻線電
圧によってオフすることを防止する。
【０００８】
【実施例】以下、本発明の実施例を図面に基づいて説明
する。図１において、スイッチ素子３のゲート端子と２
次巻線１２との間に、スイッチ素子３側がカソード側に
なるようにダイオード１７が接続されると共に、該ダイ
オード１７に抵抗１８が並列接続されている。また、ス
イッチ素子３のゲート端子と２次巻線１２との間に、他
の抵抗１９が前記抵抗１８と直列に接続されている。抵
抗１８の抵抗値は他の抵抗１９の抵抗値に比べて非常に
大きい値とされ、２次巻線１２からみたスイッチ素子３
のゲート端子の入力インピーダンスは出力インピーダン
スより低くなるように設定されている。これにより、２
次巻線１２からの駆動信号が無くなったとしても、スイ
ッチ素子３のゲート端子からみた出力インピーダンスが
大きいため、スイッチ素子３のがオンし続けるようにな
っている。
する。図１において、スイッチ素子３のゲート端子と２
次巻線１２との間に、スイッチ素子３側がカソード側に
なるようにダイオード１７が接続されると共に、該ダイ
オード１７に抵抗１８が並列接続されている。また、ス
イッチ素子３のゲート端子と２次巻線１２との間に、他
の抵抗１９が前記抵抗１８と直列に接続されている。抵
抗１８の抵抗値は他の抵抗１９の抵抗値に比べて非常に
大きい値とされ、２次巻線１２からみたスイッチ素子３
のゲート端子の入力インピーダンスは出力インピーダン
スより低くなるように設定されている。これにより、２
次巻線１２からの駆動信号が無くなったとしても、スイ
ッチ素子３のゲート端子からみた出力インピーダンスが
大きいため、スイッチ素子３のがオンし続けるようにな
っている。
【０００９】スイッチ制御回路１４は、ツェナーダイオ
ード２１とコンデンサ２２とトランジスタ２３と可変抵
抗器２４とコンパレータ２５とを備え、チョーク７に設
けた２次巻線２６からの駆動信号によってトランジスタ
２３がオンオフ動作し、このトランジスタ２３のオンオ
フ動作によりコンデンサ２２を充放電させ、コンデンサ
２２の電圧とツェナーダイオード２１の基準電圧とをコ
ンパレータ２５で比較し、該コンパレータ２５の出力に
よって制御スイッチ１３を所定周期でオンオフさせるよ
うに構成されている。
ード２１とコンデンサ２２とトランジスタ２３と可変抵
抗器２４とコンパレータ２５とを備え、チョーク７に設
けた２次巻線２６からの駆動信号によってトランジスタ
２３がオンオフ動作し、このトランジスタ２３のオンオ
フ動作によりコンデンサ２２を充放電させ、コンデンサ
２２の電圧とツェナーダイオード２１の基準電圧とをコ
ンパレータ２５で比較し、該コンパレータ２５の出力に
よって制御スイッチ１３を所定周期でオンオフさせるよ
うに構成されている。
【００１０】従って、共振回路９の固有周波数がスイッ
チ素子２，３のスイッチング周波数より高いときでも、
ダイオード１７、抵抗１８，１９があるため、スイッチ
制御回路１４で決定する時期より先にスイッチ素子３が
２次巻線１２からの駆動信号によってオフすることを防
止する。この動作をより具体的に説明すると、スイッチ
素子３の駆動電圧（２次巻線１２の巻線電圧）は図２
（イ）に示すような波形であり、共振回路９により決ま
る。スイッチ素子３のゲート電圧は、図２（ロ）に示す
ような波形になり、スイッチ素子３のゲート端子の充電
時は２次巻線１２の巻線電圧により抵抗１９、ダイオー
ド１７のループで充電されてその電圧が決定される。そ
の後、２次巻線１２の巻線電圧がスイッチ素子３のゲー
ト電圧より小になったとき、スイッチ素子３のゲート電
荷は抵抗１８、抵抗１９のループで２次巻線１２に徐々
に放電される。
チ素子２，３のスイッチング周波数より高いときでも、
ダイオード１７、抵抗１８，１９があるため、スイッチ
制御回路１４で決定する時期より先にスイッチ素子３が
２次巻線１２からの駆動信号によってオフすることを防
止する。この動作をより具体的に説明すると、スイッチ
素子３の駆動電圧（２次巻線１２の巻線電圧）は図２
（イ）に示すような波形であり、共振回路９により決ま
る。スイッチ素子３のゲート電圧は、図２（ロ）に示す
ような波形になり、スイッチ素子３のゲート端子の充電
時は２次巻線１２の巻線電圧により抵抗１９、ダイオー
ド１７のループで充電されてその電圧が決定される。そ
の後、２次巻線１２の巻線電圧がスイッチ素子３のゲー
ト電圧より小になったとき、スイッチ素子３のゲート電
荷は抵抗１８、抵抗１９のループで２次巻線１２に徐々
に放電される。
【００１１】その後、制御スイッチ１３がオンすると、
スイッチ素子３のゲート電荷はスイッチ制御回路１４の
制御スイッチ１３により急速にぬかれて、スイッチ素子
３はオフし、スイッチ素子３のＶSD（ソースドレイン間
電圧）が図２（ハ）に示すようになる。ここで、制御ス
イッチ１３のゲート電荷の放電が要望するオン期間以内
にスイッチ素子３のＶGS（スレッシュホールド電圧）以
下に落ちないように抵抗１８の抵抗値を大に設定する。
これによってスイッチ素子３が、スイッチ制御回路１４
で動作せずに２次巻線１２の巻線電圧によってオフする
ことを防止する。また、スイッチ素子３のターンオン時
には抵抗１９とゲート電荷による時定数でゲート電位が
上昇し、スイッチ素子３がＶGSに到達するまでの時間を
決定する。つまり、スイッチ素子３のターンオンは抵抗
１９の抵抗値に依存し、スイッチ素子３のターンオフは
抵抗１８，１９の合計の抵抗値により依存するため、ス
イッチ素子３のターンオンとターンオフとを各々別々に
設定できる。
スイッチ素子３のゲート電荷はスイッチ制御回路１４の
制御スイッチ１３により急速にぬかれて、スイッチ素子
３はオフし、スイッチ素子３のＶSD（ソースドレイン間
電圧）が図２（ハ）に示すようになる。ここで、制御ス
イッチ１３のゲート電荷の放電が要望するオン期間以内
にスイッチ素子３のＶGS（スレッシュホールド電圧）以
下に落ちないように抵抗１８の抵抗値を大に設定する。
これによってスイッチ素子３が、スイッチ制御回路１４
で動作せずに２次巻線１２の巻線電圧によってオフする
ことを防止する。また、スイッチ素子３のターンオン時
には抵抗１９とゲート電荷による時定数でゲート電位が
上昇し、スイッチ素子３がＶGSに到達するまでの時間を
決定する。つまり、スイッチ素子３のターンオンは抵抗
１９の抵抗値に依存し、スイッチ素子３のターンオフは
抵抗１８，１９の合計の抵抗値により依存するため、ス
イッチ素子３のターンオンとターンオフとを各々別々に
設定できる。
【００１２】図３は他の実施例を示し、スイッチ制御回
路１４の基準電圧を、抵抗２９，３０によって共振回路
９のチョーク７の２次巻線２６より得て、基準電圧が共
振回路９の電流に比例した電圧になるようにし、これに
より制御スイッチ１３のオンオフの周期が共振回路９の
共振電流に応じて可変するようにし、これにより共振回
路９の共振電流に応じてスイッチ素子３のパルス巾を可
変させようにしたものである。
路１４の基準電圧を、抵抗２９，３０によって共振回路
９のチョーク７の２次巻線２６より得て、基準電圧が共
振回路９の電流に比例した電圧になるようにし、これに
より制御スイッチ１３のオンオフの周期が共振回路９の
共振電流に応じて可変するようにし、これにより共振回
路９の共振電流に応じてスイッチ素子３のパルス巾を可
変させようにしたものである。
【００１３】また、スイッチ素子３のゲート、ソース間
には、互いに逆向きに接続したツェナーダイオード３
５，３６が並列接続され、更にコンデンサ３７が並列接
続されている。これは、スイッチ素子３のゲート電極の
保護と共に、スイッチ素子３のゲート、ソース間に逆電
圧が印加しているときにツェナーダイオード３５，３６
のツェナー電圧までコンデンサ３７を充電させ、次にス
イッチ素子３のゲート、ソース間に順電圧が印加した時
にゲート電極の充電を遅らせて、スイッチ素子３がオン
するのを若干遅らせ、その結果スイッチ素子２，３が同
時にオンするのを防止すようにしたものである。
には、互いに逆向きに接続したツェナーダイオード３
５，３６が並列接続され、更にコンデンサ３７が並列接
続されている。これは、スイッチ素子３のゲート電極の
保護と共に、スイッチ素子３のゲート、ソース間に逆電
圧が印加しているときにツェナーダイオード３５，３６
のツェナー電圧までコンデンサ３７を充電させ、次にス
イッチ素子３のゲート、ソース間に順電圧が印加した時
にゲート電極の充電を遅らせて、スイッチ素子３がオン
するのを若干遅らせ、その結果スイッチ素子２，３が同
時にオンするのを防止すようにしたものである。
【００１４】そして、スイッチ素子３のゲート電極に接
続した制御スイッチ１３は、スイッチ制御回路１４より
駆動信号を得て、スイッチ素子３のゲート電荷を抜きス
イッチ素子３をオフするようになっている。図４は他の
実施例を示し、スイッチ素子３をＭＯＳＦＥＴに代えて
バイポーラトランジスタにより構成したものである。そ
の他の点は図３の実施例と同様の構成である。
続した制御スイッチ１３は、スイッチ制御回路１４より
駆動信号を得て、スイッチ素子３のゲート電荷を抜きス
イッチ素子３をオフするようになっている。図４は他の
実施例を示し、スイッチ素子３をＭＯＳＦＥＴに代えて
バイポーラトランジスタにより構成したものである。そ
の他の点は図３の実施例と同様の構成である。
【００１５】
【発明の効果】本発明によれば、スイッチ素子３のゲー
ト端子の入出力時の抵抗値を可変して、スイッチ素子３
がオフする期間を遅らせることができ、インバータ回路
の自励動作を防止し得る。
ト端子の入出力時の抵抗値を可変して、スイッチ素子３
がオフする期間を遅らせることができ、インバータ回路
の自励動作を防止し得る。
【図１】本発明の一実施例を示す回路図である。
【図２】本発明の動作説明用の波形図である。
【図３】他の実施例を示す回路図である。
【図４】他の実施例を示す回路図である。
【図５】従来例を示す回路図である。
【図６】動作説明用の波形図である。
１ 直流電源 ２ スイッチ素子 ３ スイッチ素子 ７ チョーク ９ 共振回路 １１ ２次巻線 １２ ２次巻線 １３ 制御スイッチ １４ スイッチ制御回路 １７ ダイオード １８ 抵抗 １９ 抵抗
Claims (4)
- 【請求項１】 直流電源１に、２個のスイッチ素子２，
３が直列接続され、この２個のスイッチ素子２，３のう
ちの一方のスイッチ素子２に、チョーク７を備える共振
回路９が並列接続され、共振回路９のチョーク７に、一
対の２次巻線１１，１２が、前記２個のスイッチ素子
２，３のゲート端子に夫々駆動信号を供給するように設
けられ、前記２個のスイッチ素子２，３のうちの他方の
スイッチ素子３のゲート端子側に、該他方のスイッチ素
子３をオフさせるべくオン動作する制御スイッチ１３が
設けられ、この制御スイッチ１３のオン期間を制御する
スイッチ制御回路１４が設けられたハーフブリッジ型の
インバータ回路において、 前記他方のスイッチ素子３のゲート端子と、チョーク７
に設けた２次巻線１２との間に、スイッチ素子３側がカ
ソード側になるようにダイオード１７が接続されると共
に、該ダイオード１７に抵抗１８が並列接続されている
ことを特徴とするインバータ回路。 - 【請求項２】 直流電源１に、２個のスイッチ素子２，
３が直列接続され、この２個のスイッチ素子２，３のう
ちの一方のスイッチ素子２に、チョーク７を備える共振
回路９が並列接続され、共振回路９のチョーク７に、一
対の２次巻線１１，１２が、前記２個のスイッチ素子
２，３のゲート端子に夫々駆動信号を供給するように設
けられ、前記２個のスイッチ素子２，３のうちの他方の
スイッチ素子３のゲート端子側に、該他方のスイッチ素
子３をオフさせるべくオン動作する制御スイッチ１３が
設けられ、この制御スイッチ１３のオン期間を制御する
スイッチ制御回路１４が設けられたハーフブリッジ型の
インバータ回路において、 前記他方のスイッチ素子３のゲート端子と、チョーク７
に設けた２次巻線１２との間に、スイッチ素子３側がカ
ソード側になるようにダイオード１７が接続されると共
に、該ダイオード１７に抵抗１８が並列接続され、スイ
ッチ素子３のゲート端子と２次巻線１２との間に、抵抗
１９が前記抵抗１８と直列になるように接続されている
ことを特徴とするインバータ回路。 - 【請求項３】 前記２個のスイッチ素子２，３のうちの
一方のスイッチ素子２がトランジスタにより構成される
と共に、他方のスイッチ素子３が金属酸化膜ゲート電界
効果形トランジスタ（ＭＯＳＦＥＴ）により構成されて
いることを特徴とする請求項１に記載のインバータ回
路。 - 【請求項４】 前記２個のスイッチ素子２，３が夫々ト
ランジスタにより構成されていることを特徴とする請求
項１に記載のインバータ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6009717A JPH07222461A (ja) | 1994-01-31 | 1994-01-31 | インバータ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6009717A JPH07222461A (ja) | 1994-01-31 | 1994-01-31 | インバータ回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH07222461A true JPH07222461A (ja) | 1995-08-18 |
Family
ID=11728037
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6009717A Pending JPH07222461A (ja) | 1994-01-31 | 1994-01-31 | インバータ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH07222461A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN100423439C (zh) * | 2006-07-19 | 2008-10-01 | 陈玉明 | 功率场效应管激励电路 |
-
1994
- 1994-01-31 JP JP6009717A patent/JPH07222461A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| CN100423439C (zh) * | 2006-07-19 | 2008-10-01 | 陈玉明 | 功率场效应管激励电路 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20011113 |