JPH0653472A - 固体撮像装置及びその製造方法 - Google Patents
固体撮像装置及びその製造方法Info
- Publication number
- JPH0653472A JPH0653472A JP4206365A JP20636592A JPH0653472A JP H0653472 A JPH0653472 A JP H0653472A JP 4206365 A JP4206365 A JP 4206365A JP 20636592 A JP20636592 A JP 20636592A JP H0653472 A JPH0653472 A JP H0653472A
- Authority
- JP
- Japan
- Prior art keywords
- film
- type semiconductor
- silicon oxide
- mask
- oxide film
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
- 238000004519 manufacturing process Methods 0.000 title claims description 17
- 239000007787 solid Substances 0.000 title 1
- 239000004065 semiconductor Substances 0.000 claims abstract description 75
- 229920002120 photoresistant polymer Polymers 0.000 claims abstract description 45
- 238000000034 method Methods 0.000 claims abstract description 24
- 239000012535 impurity Substances 0.000 claims abstract description 17
- 238000009792 diffusion process Methods 0.000 claims abstract description 13
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 claims description 46
- 229910052814 silicon oxide Inorganic materials 0.000 claims description 46
- 229910052581 Si3N4 Inorganic materials 0.000 claims description 41
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 claims description 41
- 238000005468 ion implantation Methods 0.000 claims description 24
- 238000003384 imaging method Methods 0.000 claims description 15
- 239000000758 substrate Substances 0.000 claims description 15
- 238000006243 chemical reaction Methods 0.000 claims description 8
- 230000003647 oxidation Effects 0.000 claims description 7
- 238000007254 oxidation reaction Methods 0.000 claims description 7
- 229910021420 polycrystalline silicon Inorganic materials 0.000 claims description 7
- 238000000151 deposition Methods 0.000 claims description 4
- 239000000463 material Substances 0.000 claims 1
- 230000004888 barrier function Effects 0.000 abstract description 3
- 238000000206 photolithography Methods 0.000 description 7
- ZOXJGFHDIHLPTG-UHFFFAOYSA-N Boron Chemical compound [B] ZOXJGFHDIHLPTG-UHFFFAOYSA-N 0.000 description 6
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 6
- 229910052796 boron Inorganic materials 0.000 description 6
- 229910052710 silicon Inorganic materials 0.000 description 6
- 239000010703 silicon Substances 0.000 description 6
- 238000001259 photo etching Methods 0.000 description 4
- OAICVXFJPJFONN-UHFFFAOYSA-N Phosphorus Chemical compound [P] OAICVXFJPJFONN-UHFFFAOYSA-N 0.000 description 3
- 229910052785 arsenic Inorganic materials 0.000 description 3
- RQNWIZPPADIBDY-UHFFFAOYSA-N arsenic atom Chemical compound [As] RQNWIZPPADIBDY-UHFFFAOYSA-N 0.000 description 3
- 238000007796 conventional method Methods 0.000 description 3
- 229910052751 metal Inorganic materials 0.000 description 3
- 239000002184 metal Substances 0.000 description 3
- 229910052698 phosphorus Inorganic materials 0.000 description 3
- 239000011574 phosphorus Substances 0.000 description 3
- 238000001039 wet etching Methods 0.000 description 3
- 230000006866 deterioration Effects 0.000 description 1
- 230000005684 electric field Effects 0.000 description 1
- 238000005530 etching Methods 0.000 description 1
- 230000001590 oxidative effect Effects 0.000 description 1
- 238000001020 plasma etching Methods 0.000 description 1
- 238000005036 potential barrier Methods 0.000 description 1
- 238000002360 preparation method Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66075—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
- H01L29/66227—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by the electric current supplied or the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched, e.g. three-terminal devices
- H01L29/66946—Charge transfer devices
- H01L29/66954—Charge transfer devices with an insulated gate
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/027—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34
- H01L21/0271—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising organic layers
- H01L21/0273—Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising organic layers characterised by the treatment of photoresist layers
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/324—Thermal treatment for modifying the properties of semiconductor bodies, e.g. annealing, sintering
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/77—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate
- H01L21/78—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate with subsequent division of the substrate into plural individual devices
- H01L21/82—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate with subsequent division of the substrate into plural individual devices to produce devices, e.g. integrated circuits, each consisting of a plurality of components
- H01L21/822—Manufacture or treatment of devices consisting of a plurality of solid state components or integrated circuits formed in, or on, a common substrate with subsequent division of the substrate into plural individual devices to produce devices, e.g. integrated circuits, each consisting of a plurality of components the substrate being a semiconductor, using silicon technology
- H01L21/8232—Field-effect technology
- H01L21/8234—MIS technology, i.e. integration processes of field effect transistors of the conductor-insulator-semiconductor type
- H01L21/823462—MIS technology, i.e. integration processes of field effect transistors of the conductor-insulator-semiconductor type with a particular manufacturing method of the gate insulating layers, e.g. different gate insulating layer thicknesses, particular gate insulator materials or particular gate insulator implants
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
- H01L27/14—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation
- H01L27/144—Devices controlled by radiation
- H01L27/146—Imager structures
- H01L27/148—Charge coupled imagers
- H01L27/14806—Structural or functional details thereof
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
- H01L27/14—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation
- H01L27/144—Devices controlled by radiation
- H01L27/146—Imager structures
- H01L27/148—Charge coupled imagers
- H01L27/14831—Area CCD imagers
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/66007—Multistep manufacturing processes
- H01L29/66075—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials
- H01L29/66227—Multistep manufacturing processes of devices having semiconductor bodies comprising group 14 or group 13/15 materials the devices being controllable only by the electric current supplied or the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched, e.g. three-terminal devices
- H01L29/66409—Unipolar field-effect transistors
- H01L29/66477—Unipolar field-effect transistors with an insulated gate, i.e. MISFET
- H01L29/66568—Lateral single gate silicon transistors
- H01L29/66575—Lateral single gate silicon transistors where the source and drain or source and drain extensions are self-aligned to the sides of the gate
- H01L29/6659—Lateral single gate silicon transistors where the source and drain or source and drain extensions are self-aligned to the sides of the gate with both lightly doped source and drain extensions and source and drain self-aligned to the sides of the gate, e.g. lightly doped drain [LDD] MOSFET, double diffused drain [DDD] MOSFET
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Physics & Mathematics (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- Manufacturing & Machinery (AREA)
- Ceramic Engineering (AREA)
- Electromagnetism (AREA)
- Solid State Image Pick-Up Elements (AREA)
Abstract
(57)【要約】
【目的】写真食刻法工程における位置合わせ誤差により
垂直転送部と水平転送部の接続部に生じるポテンシャル
井戸や障壁を防止し、垂直転送部から水平転送部への信
号電荷の転送を効率良く行う。 【構成】窒化シリコン膜3とフォトレジスト膜4aをマ
スクにイオン注入法、不純物の熱拡散法にて水平転送部
となる第1のP型ウエル層を形成する。選択酸化によ
り、第1のP型ウエル層上に約400nm程度の酸化シ
リコン膜を成長し、窒化シリコン膜3を除去し、垂直転
送部となる第2のP型ウエル層を酸化シリコン膜をマス
クにイオン注入法及び不純物の熱拡散にて第1のP型ウ
エル層と自己整合的に形成する。垂直転送部となる第1
のN型半導体領域を酸化シリコン膜をマスクにイオン注
入法にて第1のP型ウエル層と自己整合的に第2のP型
ウエル層内に形成する。酸化シリコン膜を除去し、垂直
転送部となる第2のN型半導体領域を写真食刻法を用い
てイオン注入法にて第1及び第2のP型ウエル層内に形
成する。
垂直転送部と水平転送部の接続部に生じるポテンシャル
井戸や障壁を防止し、垂直転送部から水平転送部への信
号電荷の転送を効率良く行う。 【構成】窒化シリコン膜3とフォトレジスト膜4aをマ
スクにイオン注入法、不純物の熱拡散法にて水平転送部
となる第1のP型ウエル層を形成する。選択酸化によ
り、第1のP型ウエル層上に約400nm程度の酸化シ
リコン膜を成長し、窒化シリコン膜3を除去し、垂直転
送部となる第2のP型ウエル層を酸化シリコン膜をマス
クにイオン注入法及び不純物の熱拡散にて第1のP型ウ
エル層と自己整合的に形成する。垂直転送部となる第1
のN型半導体領域を酸化シリコン膜をマスクにイオン注
入法にて第1のP型ウエル層と自己整合的に第2のP型
ウエル層内に形成する。酸化シリコン膜を除去し、垂直
転送部となる第2のN型半導体領域を写真食刻法を用い
てイオン注入法にて第1及び第2のP型ウエル層内に形
成する。
Description
【0001】
【産業上の利用分野】本発明は、垂直転送部と水平転送
部を有するCCD型固体撮像装置及びその製造方法に関
する。
部を有するCCD型固体撮像装置及びその製造方法に関
する。
【0002】
【従来の技術】従来この種の固体撮像装置は、HDTV
システムに対応するための超高画素化及びムービーシス
テムに対応するための高画素化、小型化につれて垂直転
送部の領域が比例的に縮小されるため、例えば埋め込み
チャンネルCCDを用いた固体撮像装置では、垂直転送
部を構成する,P型ウエル層内に形成されるN型半導体
領域の接合の深さを浅くすることにより、単位面積当た
りの電荷転送能力を向上し、その特性を保持し、一方水
平転送部は、高転送速度による転送効率劣化に備え垂直
転送部と逆に水平転送部を構成する,P型ウエル層内に
形成されるN型半導体領域の接合の深さを深く形成する
ことにより、フリンジ電界強度を増し、その特性を保持
してきた。
システムに対応するための超高画素化及びムービーシス
テムに対応するための高画素化、小型化につれて垂直転
送部の領域が比例的に縮小されるため、例えば埋め込み
チャンネルCCDを用いた固体撮像装置では、垂直転送
部を構成する,P型ウエル層内に形成されるN型半導体
領域の接合の深さを浅くすることにより、単位面積当た
りの電荷転送能力を向上し、その特性を保持し、一方水
平転送部は、高転送速度による転送効率劣化に備え垂直
転送部と逆に水平転送部を構成する,P型ウエル層内に
形成されるN型半導体領域の接合の深さを深く形成する
ことにより、フリンジ電界強度を増し、その特性を保持
してきた。
【0003】図9は、従来の固体撮像装置の一例を概略
的に示す平面図である。半導体基板の表面部に2次元的
に配置された光電変換部11にて入射光を光電変換して
えられた信号電荷は、垂直転送部12に読み出され、更
に、水平転送部13を経て出力回路14に転送され、出
力信号として取り出される。
的に示す平面図である。半導体基板の表面部に2次元的
に配置された光電変換部11にて入射光を光電変換して
えられた信号電荷は、垂直転送部12に読み出され、更
に、水平転送部13を経て出力回路14に転送され、出
力信号として取り出される。
【0004】図10〜図13は、従来の固体撮像装置の
垂直転送部と水平転送部の接続部を主な製造工程順に示
す断面図であり、分図(a),(b)はそれぞれ図8の
Y−Y線,X−X線に沿う部分について示したものであ
る。
垂直転送部と水平転送部の接続部を主な製造工程順に示
す断面図であり、分図(a),(b)はそれぞれ図8の
Y−Y線,X−X線に沿う部分について示したものであ
る。
【0005】まず、図10に示すようにN型シリコン基
板1上に厚さ約50nmの第1の酸化シリコン膜2を成
長させ、写真食刻法を用いて形成された厚さ約1.0μ
mの第1のフォトレジスト膜4aをマスクにイオン注入
(例えば入射角0°,100keV,1.0×1012c
m-2のホウ素)を行う。
板1上に厚さ約50nmの第1の酸化シリコン膜2を成
長させ、写真食刻法を用いて形成された厚さ約1.0μ
mの第1のフォトレジスト膜4aをマスクにイオン注入
(例えば入射角0°,100keV,1.0×1012c
m-2のホウ素)を行う。
【0006】次に、第1のフォトレジスト膜4a除去後
不純物の熱拡散(例えば1200℃,5時間程度)に
て、図11に示すように、水平転送部となる第1のP型
ウエル層5を形成し、続いて、写真食刻法を用いて少な
くとも第1のP型ウエル層5を被覆し、厚さ約1.0μ
mの第2のフォトレジスト膜4bをマスクにイオン注入
(例えば入射角0°,60keV,3.0×1012cm
-2のホウ素)を行う。
不純物の熱拡散(例えば1200℃,5時間程度)に
て、図11に示すように、水平転送部となる第1のP型
ウエル層5を形成し、続いて、写真食刻法を用いて少な
くとも第1のP型ウエル層5を被覆し、厚さ約1.0μ
mの第2のフォトレジスト膜4bをマスクにイオン注入
(例えば入射角0°,60keV,3.0×1012cm
-2のホウ素)を行う。
【0007】次に、第2のフォトレジスト膜4b除去後
不純物の熱拡散(例えば1100℃,2時間程度)に
て、図12に示すように垂直転送部となる第2のP型ウ
エル層6を形成し、続いて、写真食刻法を用いて厚さ約
1.0μmの第3のフォトレジスト膜4cをマスクにイ
オン注入(例えば入射角0°,150keV,2.0×
1012cm-2のヒ素)を行い、垂直転送部の一部となる
第1のN型半導体領域7を形成する。
不純物の熱拡散(例えば1100℃,2時間程度)に
て、図12に示すように垂直転送部となる第2のP型ウ
エル層6を形成し、続いて、写真食刻法を用いて厚さ約
1.0μmの第3のフォトレジスト膜4cをマスクにイ
オン注入(例えば入射角0°,150keV,2.0×
1012cm-2のヒ素)を行い、垂直転送部の一部となる
第1のN型半導体領域7を形成する。
【0008】次に、写真食刻法を用いて図13に示すよ
うに、少なくとも第1のN型半導体領域7の一部を被覆
し、厚さ約1.0μmの第4のフォトレジスト膜4dを
マスクにイオン注入(例えば入射角0°,150ke
V,2.0×1012cm-2のリン)を行い、垂直転送部
の一部となる第2のN型半導体領域8を形成する。
うに、少なくとも第1のN型半導体領域7の一部を被覆
し、厚さ約1.0μmの第4のフォトレジスト膜4dを
マスクにイオン注入(例えば入射角0°,150ke
V,2.0×1012cm-2のリン)を行い、垂直転送部
の一部となる第2のN型半導体領域8を形成する。
【0009】以降、慣用の技術を用いて光電変換部、電
荷転送電極、遮光・配線用の金属膜を形成することによ
り、従来の固体撮像装置が得られる。
荷転送電極、遮光・配線用の金属膜を形成することによ
り、従来の固体撮像装置が得られる。
【0010】
【発明が解決しようとする課題】上述した従来の固体撮
像装置では、垂直転送部を構成するP型ウエル層及びN
型半導体領域と水平転送部を構成するP型ウエル層及び
N型半導体領域は、それぞれ別の工程によって形成され
ているので、写真食刻法工程の位置合わせ誤差により、
垂直転送部と水平転送部の接続部を制御良く形成するこ
とが困難であるという欠点があった。
像装置では、垂直転送部を構成するP型ウエル層及びN
型半導体領域と水平転送部を構成するP型ウエル層及び
N型半導体領域は、それぞれ別の工程によって形成され
ているので、写真食刻法工程の位置合わせ誤差により、
垂直転送部と水平転送部の接続部を制御良く形成するこ
とが困難であるという欠点があった。
【0011】例えば、垂直転送部を構成するP型ウエル
層と水平転送部を構成するP型ウエル層の重なり量が少
ないもしくは離れて形成された場合においては、接続部
上の電荷転送電極下に深いポテンシャル井戸が形成さ
れ、また逆に、垂直転送部を構成するP型ウエル層と水
平転送部を構成するP型ウエル層の重なり量が大きくな
った場合においては、電荷転送電極下にポテンシャル障
壁が形成され、いずれの場合においても垂直置転送部か
ら水平転送部への信号電荷のスムーズな転送が阻害され
るという欠点があった。
層と水平転送部を構成するP型ウエル層の重なり量が少
ないもしくは離れて形成された場合においては、接続部
上の電荷転送電極下に深いポテンシャル井戸が形成さ
れ、また逆に、垂直転送部を構成するP型ウエル層と水
平転送部を構成するP型ウエル層の重なり量が大きくな
った場合においては、電荷転送電極下にポテンシャル障
壁が形成され、いずれの場合においても垂直置転送部か
ら水平転送部への信号電荷のスムーズな転送が阻害され
るという欠点があった。
【0012】
【課題を解決するための手段】本発明は、半導体基板の
表面部の第1導電型半導体装置の表面領域内にそれぞれ
形成された複数個の光電変換部、前記光電変換部より転
送されてくる全信号電荷パターンを一水平走査線毎に一
斉に転送する複数本の垂直転送部および前記垂直転送部
より一水平走査線毎に転送されてる信号電荷を信号出力
部に転送する水平転送部から構成される固体撮像装置に
おいて、前記第1導電型半導体層が、前記垂直転送部及
び水平転送部に対してそれぞれ自己整合的に異なる濃度
プロファイルで形成されているというものである。しか
して、前記垂直転送部及び水平転送部を構成する第2導
電型半導体領域が、垂直転送部及び水平転送部に対して
それぞれ自己整合的に異なる濃度プロファイルで形成さ
れている。
表面部の第1導電型半導体装置の表面領域内にそれぞれ
形成された複数個の光電変換部、前記光電変換部より転
送されてくる全信号電荷パターンを一水平走査線毎に一
斉に転送する複数本の垂直転送部および前記垂直転送部
より一水平走査線毎に転送されてる信号電荷を信号出力
部に転送する水平転送部から構成される固体撮像装置に
おいて、前記第1導電型半導体層が、前記垂直転送部及
び水平転送部に対してそれぞれ自己整合的に異なる濃度
プロファイルで形成されているというものである。しか
して、前記垂直転送部及び水平転送部を構成する第2導
電型半導体領域が、垂直転送部及び水平転送部に対して
それぞれ自己整合的に異なる濃度プロファイルで形成さ
れている。
【0013】この固体撮像装置は、半導体基板の一表面
に第1の酸化シリコン膜と窒化シリコン膜を順次に被着
する工程と、前記窒化シリコン膜を第1のフォトレジス
ト膜をマスクとして選択的に除去した後、前記窒化シリ
コン膜と前記第1のフォトレジスト膜をマスクにイオン
注入を行ない前記第1のフォトレジスト膜を除去した後
不純物の熱拡散を行なって水平転送部下の第1の第1導
電型半導体層を形成する工程と、前記窒化シリコン膜を
マスクに選択酸化を施し第2のシリコン酸化膜を成長
し、前記窒化シリコン膜を除去した後、前記第2の酸化
シリコン膜と第2のフォトレジスト膜をマスクにイオン
注入を行ない前記第2のフォトレジスト膜を除去した後
不純物の熱拡散を行なって前記第1の第1導電型半導体
層と自己整合的に垂直転送部の第2の第1導電型半導体
層を形成する工程とにより製造することができる。更
に、前記第2の酸化シリコン膜と第3のフォトレジスト
膜をマスクにイオン注入法にて前記第1の第1導電型半
導体層と自己整合的に前記第2の第1導電型半導体層内
に垂直転送部の第1の第2導電型半導体領域を形成する
工程と、前記第2の酸化シリコン膜を除去した後、第1
及び第2の第1導電型半導体層内に第2の第2導電型半
導体領域を形成する工程とを追加してもよい。
に第1の酸化シリコン膜と窒化シリコン膜を順次に被着
する工程と、前記窒化シリコン膜を第1のフォトレジス
ト膜をマスクとして選択的に除去した後、前記窒化シリ
コン膜と前記第1のフォトレジスト膜をマスクにイオン
注入を行ない前記第1のフォトレジスト膜を除去した後
不純物の熱拡散を行なって水平転送部下の第1の第1導
電型半導体層を形成する工程と、前記窒化シリコン膜を
マスクに選択酸化を施し第2のシリコン酸化膜を成長
し、前記窒化シリコン膜を除去した後、前記第2の酸化
シリコン膜と第2のフォトレジスト膜をマスクにイオン
注入を行ない前記第2のフォトレジスト膜を除去した後
不純物の熱拡散を行なって前記第1の第1導電型半導体
層と自己整合的に垂直転送部の第2の第1導電型半導体
層を形成する工程とにより製造することができる。更
に、前記第2の酸化シリコン膜と第3のフォトレジスト
膜をマスクにイオン注入法にて前記第1の第1導電型半
導体層と自己整合的に前記第2の第1導電型半導体層内
に垂直転送部の第1の第2導電型半導体領域を形成する
工程と、前記第2の酸化シリコン膜を除去した後、第1
及び第2の第1導電型半導体層内に第2の第2導電型半
導体領域を形成する工程とを追加してもよい。
【0014】また、半導体基板の一表面に第1の酸化シ
リコン膜と窒化シリコン膜を順次形成する工程と、前記
窒化シリコン膜を第1のフォトレジスト膜をマスクに選
択的に除去した後、前記窒化シリコン膜と前記第のフォ
トレジスト膜をマスクにイオン注入を行ない前記第1の
フォトレジスト膜を除去した後不純物の熱拡散を行なっ
て水平転送部の第1の第1導電型半導体層を形成する工
程と、前記窒化シリコン膜をマスクに選択酸化を施し酸
化シリコン膜を成長した後、第2のフォトレジスト膜を
マスクとして前記窒化シリコン膜を選択的に除去し、前
記第2のシリコン酸化膜と前記第2のフォトレジスト膜
及び前記窒化シリコン膜をマスクにイオン注入を行ない
前記第2のフォトレジスト膜を除去した後不純物の熱拡
散を行なって前記第1の第1導電型半導体層と自己整合
的に垂直転送部の第2の第1導電型半導体層を形成する
工程とにより製造することができる。更に、前記窒化シ
リコン膜及び前記第2の酸化シリコン膜をマスクにイオ
ン注入を行なって前記第1及び第2の第1導電型半導体
層と自己整合的に前記第2の第1導電型半導体層内に垂
直転送部の第1の第2導電型半導体領域を形成する工程
と、前記第2の酸化シリコン膜を除去した後、前記窒化
シリコン膜をマスクとして前記第1の酸化シリコン膜を
除去したのちイオン注入を行なって前記第1の第2導電
型半導体領域と自己整合的に、前記第1及び第2の第1
導電型半導体層内に第2の第2導電型半導体領域を形成
する工程とを追加してもよい。
リコン膜と窒化シリコン膜を順次形成する工程と、前記
窒化シリコン膜を第1のフォトレジスト膜をマスクに選
択的に除去した後、前記窒化シリコン膜と前記第のフォ
トレジスト膜をマスクにイオン注入を行ない前記第1の
フォトレジスト膜を除去した後不純物の熱拡散を行なっ
て水平転送部の第1の第1導電型半導体層を形成する工
程と、前記窒化シリコン膜をマスクに選択酸化を施し酸
化シリコン膜を成長した後、第2のフォトレジスト膜を
マスクとして前記窒化シリコン膜を選択的に除去し、前
記第2のシリコン酸化膜と前記第2のフォトレジスト膜
及び前記窒化シリコン膜をマスクにイオン注入を行ない
前記第2のフォトレジスト膜を除去した後不純物の熱拡
散を行なって前記第1の第1導電型半導体層と自己整合
的に垂直転送部の第2の第1導電型半導体層を形成する
工程とにより製造することができる。更に、前記窒化シ
リコン膜及び前記第2の酸化シリコン膜をマスクにイオ
ン注入を行なって前記第1及び第2の第1導電型半導体
層と自己整合的に前記第2の第1導電型半導体層内に垂
直転送部の第1の第2導電型半導体領域を形成する工程
と、前記第2の酸化シリコン膜を除去した後、前記窒化
シリコン膜をマスクとして前記第1の酸化シリコン膜を
除去したのちイオン注入を行なって前記第1の第2導電
型半導体領域と自己整合的に、前記第1及び第2の第1
導電型半導体層内に第2の第2導電型半導体領域を形成
する工程とを追加してもよい。
【0015】
【実施例】次に、本発明を図面を参照して説明する。
【0016】図1〜図4は、本発明第1の実施例の固体
撮像装置を主な製造工程に沿って説明するための断面図
で、分図(a),(b)はそれぞれ図8のY−Y線およ
びX−X線に沿う部分について示したものである。
撮像装置を主な製造工程に沿って説明するための断面図
で、分図(a),(b)はそれぞれ図8のY−Y線およ
びX−X線に沿う部分について示したものである。
【0017】まず、図1に示すように、N型シリコン基
板1の表面に約50nmの第1の酸化シリコン膜2aと
約250nmの窒化シリコン膜3を順に成膜し、写真食
刻法及びプラズマエッチング法を用いて約1.0μmの
第1のフォトレジスト膜4a及び窒化シリコン膜3から
なるマスクを形成し、イオン注入(例えば入射角60
°,100keV,1.0×1012cm-2のホウ素)を
行う。
板1の表面に約50nmの第1の酸化シリコン膜2aと
約250nmの窒化シリコン膜3を順に成膜し、写真食
刻法及びプラズマエッチング法を用いて約1.0μmの
第1のフォトレジスト膜4a及び窒化シリコン膜3から
なるマスクを形成し、イオン注入(例えば入射角60
°,100keV,1.0×1012cm-2のホウ素)を
行う。
【0018】次に、第1のフォトレジスト膜4a除去後
不純物の熱拡散(例えば1200℃,5時間程度)に
て、図2に示すように、水平転送部となる第1のP型ウ
エル層5を形成し、続いて、窒化シリコン膜3をマスク
に選択酸化を施し、第1のP型ウエル層5上に約400
nm程度の第2の酸化シリコン膜2bを成長し、ウエッ
トエッチング法を用いて窒化シリコン膜3を除去した
後、垂直転送部となる第2のP型ウエル層を形成するた
め写真食刻法を用いて形成した約1.0μmの第2のフ
ォトレジスト膜4bと第2の酸化シリコン膜2bをマス
クにイオン注入(例えば入射角0°,60keV,3.
0×1012cm-2ホウ素)を行う。
不純物の熱拡散(例えば1200℃,5時間程度)に
て、図2に示すように、水平転送部となる第1のP型ウ
エル層5を形成し、続いて、窒化シリコン膜3をマスク
に選択酸化を施し、第1のP型ウエル層5上に約400
nm程度の第2の酸化シリコン膜2bを成長し、ウエッ
トエッチング法を用いて窒化シリコン膜3を除去した
後、垂直転送部となる第2のP型ウエル層を形成するた
め写真食刻法を用いて形成した約1.0μmの第2のフ
ォトレジスト膜4bと第2の酸化シリコン膜2bをマス
クにイオン注入(例えば入射角0°,60keV,3.
0×1012cm-2ホウ素)を行う。
【0019】次に、第2のフォトレジスト膜4b除去後
不純物の熱拡散(例えば1100℃,2時間程度)に
て、図3に示すように、第1のP型ウエル層5と自己整
合的に第2のP型ウエル層6を形成し、続いて、垂直転
送部となる第1のN型半導体領域7を写真食刻法を用い
て形成した第3のフォトレジスト膜4cと第2の酸化シ
リコン膜2bをマスクにイオン注入(例えば入射角0
°,150keV,2.0×1012cm-2のヒ素)に
て、第1のP型ウエル層5と自己整合的に第2のP型ウ
エル層6内に形成する。
不純物の熱拡散(例えば1100℃,2時間程度)に
て、図3に示すように、第1のP型ウエル層5と自己整
合的に第2のP型ウエル層6を形成し、続いて、垂直転
送部となる第1のN型半導体領域7を写真食刻法を用い
て形成した第3のフォトレジスト膜4cと第2の酸化シ
リコン膜2bをマスクにイオン注入(例えば入射角0
°,150keV,2.0×1012cm-2のヒ素)に
て、第1のP型ウエル層5と自己整合的に第2のP型ウ
エル層6内に形成する。
【0020】次に、第1,第2の酸化シリコン膜2a,
bをウエットエッチング法により除去し、図4に示すよ
うに、再度N型半導体基板1に熱酸化を施し約20nm
の酸化シリコン膜2cを成長した後、垂直転送部となる
第2のN型半導体領域8a,8bをそれぞれ垂直転送部
および水平転送部に、写真食刻法を用いて形成した第4
のフォトレジスト膜4cをマスクにイオン注入(例えば
入射角0°,150keV,2.0×1012cm-2のリ
ン)にて第1及び第2のP型ウエル層5,6内に形成す
る。この場合、垂直転送部のN型半導体領域は、第1の
N型半導体領域7および第2のN型半導体領域8aにて
形成されることになる。
bをウエットエッチング法により除去し、図4に示すよ
うに、再度N型半導体基板1に熱酸化を施し約20nm
の酸化シリコン膜2cを成長した後、垂直転送部となる
第2のN型半導体領域8a,8bをそれぞれ垂直転送部
および水平転送部に、写真食刻法を用いて形成した第4
のフォトレジスト膜4cをマスクにイオン注入(例えば
入射角0°,150keV,2.0×1012cm-2のリ
ン)にて第1及び第2のP型ウエル層5,6内に形成す
る。この場合、垂直転送部のN型半導体領域は、第1の
N型半導体領域7および第2のN型半導体領域8aにて
形成されることになる。
【0021】以降、慣用の技術を用いて光電変換部、電
荷転送電極、遮光・配線用の金属膜を形成することによ
り、第1の実施例の固体撮像装置が得られる。
荷転送電極、遮光・配線用の金属膜を形成することによ
り、第1の実施例の固体撮像装置が得られる。
【0022】垂直転送部と水平転送部との接続部は自己
整合的に形成されるため、マスクの位置合せ誤差により
この接続部に生じるポテンシャル井戸や障壁を防止し、
垂直転送部から水平転送部への信号電荷の転送を効率よ
く行える。
整合的に形成されるため、マスクの位置合せ誤差により
この接続部に生じるポテンシャル井戸や障壁を防止し、
垂直転送部から水平転送部への信号電荷の転送を効率よ
く行える。
【0023】図5,図6は、本発明第2の実施例の固体
撮像装置を主な製造工程に沿って説明するための断面図
であり、分図(a),(b)はそれぞれ図8のY−Y線
およびX−X線に沿う部分について示したものである。
撮像装置を主な製造工程に沿って説明するための断面図
であり、分図(a),(b)はそれぞれ図8のY−Y線
およびX−X線に沿う部分について示したものである。
【0024】まず、図5に示すように、N型シリコン基
板1上に約50nmの第1の酸化シリコン膜2aと約2
50nmの窒化シリコン膜3を順に成長させ、写真食刻
法及びプラズマエッチング法を用いて形成した約1.0
μmの第1のフォトレジスト膜4a及び窒化シリコン膜
3をマスクにイオン注入(例えば入射角60°,100
keV,1.0×1012cm-2のホウ素)を行う。
板1上に約50nmの第1の酸化シリコン膜2aと約2
50nmの窒化シリコン膜3を順に成長させ、写真食刻
法及びプラズマエッチング法を用いて形成した約1.0
μmの第1のフォトレジスト膜4a及び窒化シリコン膜
3をマスクにイオン注入(例えば入射角60°,100
keV,1.0×1012cm-2のホウ素)を行う。
【0025】次に、第1のフォトレジスト4a除去後不
純物の熱拡散(例えば1200℃,5時間程度)にて、
図6に示すように、水平転送部となる第1のP型ウエル
層5を形成し、続いて、窒化シリコン膜3をマスクに選
択酸化を施し、第1のP型ウエル層5上に約400nm
程度の第2の酸化シリコン膜2bを成長し、写真食刻法
を用いて窒化シリコン膜3を選択的に除去した後、垂直
転送部となる第2のP型ウエル層を形成するため約1.
0μmの第2のフォトレジスト膜4b,窒化シリコン膜
3及び第2の酸化シリコン膜2bをマスクにイオン注入
(例えば入射角0°60keV,3.0×1012cm-2
のホウ素)を行う。
純物の熱拡散(例えば1200℃,5時間程度)にて、
図6に示すように、水平転送部となる第1のP型ウエル
層5を形成し、続いて、窒化シリコン膜3をマスクに選
択酸化を施し、第1のP型ウエル層5上に約400nm
程度の第2の酸化シリコン膜2bを成長し、写真食刻法
を用いて窒化シリコン膜3を選択的に除去した後、垂直
転送部となる第2のP型ウエル層を形成するため約1.
0μmの第2のフォトレジスト膜4b,窒化シリコン膜
3及び第2の酸化シリコン膜2bをマスクにイオン注入
(例えば入射角0°60keV,3.0×1012cm-2
のホウ素)を行う。
【0026】第2のフォトレジスト膜4b除去後不純物
の熱拡散(例えば1100℃,2時間程度)にて、図7
に示すように、第1のP型ウエル層5と自己整合的に第
2のP型ウエル層6を形成し、続いて、垂直転送部とな
る第1のN型半導体領域7を窒化シリコン膜3と第2の
酸化シリコン膜2bをマスクにイオン注入(例えば入射
角0°,150keV,2.0×1012cm-2のヒ素)
にて第1及び第2のP型ウエル層5,6と自己整合的に
第2のP型ウエル層6内に形成する。
の熱拡散(例えば1100℃,2時間程度)にて、図7
に示すように、第1のP型ウエル層5と自己整合的に第
2のP型ウエル層6を形成し、続いて、垂直転送部とな
る第1のN型半導体領域7を窒化シリコン膜3と第2の
酸化シリコン膜2bをマスクにイオン注入(例えば入射
角0°,150keV,2.0×1012cm-2のヒ素)
にて第1及び第2のP型ウエル層5,6と自己整合的に
第2のP型ウエル層6内に形成する。
【0027】次に、図8に示すように、窒化シリコン膜
3をマスクに酸化シリコン膜2a,bをウエットエッチ
ング法により除去し、再度N型シリコン基板1に熱酸化
を施し約20nmの第3の酸化シリコン膜2cを成長し
た後、垂直転送部および水平転送部に第2のN型半導体
領域8a,8bを窒化シリコン膜をマスクにイオン注入
(例えば入射角0°,150keV,2.0×1012c
m-2のリン)にて第1のN型半導体領域7と自己整合的
に、第1及び第2のP型ウエル層5,6内に形成する。
この場合、垂直転送部のN型半導体領域は前記第1及び
第2のN型半導体領域7,8aにて形成されることにな
る。
3をマスクに酸化シリコン膜2a,bをウエットエッチ
ング法により除去し、再度N型シリコン基板1に熱酸化
を施し約20nmの第3の酸化シリコン膜2cを成長し
た後、垂直転送部および水平転送部に第2のN型半導体
領域8a,8bを窒化シリコン膜をマスクにイオン注入
(例えば入射角0°,150keV,2.0×1012c
m-2のリン)にて第1のN型半導体領域7と自己整合的
に、第1及び第2のP型ウエル層5,6内に形成する。
この場合、垂直転送部のN型半導体領域は前記第1及び
第2のN型半導体領域7,8aにて形成されることにな
る。
【0028】以降、慣用の技術を用いて光電変換部、電
荷転送電極、遮光・配線用の金属膜を形成することによ
り、第2の実施例の固体撮像装置が得られる。
荷転送電極、遮光・配線用の金属膜を形成することによ
り、第2の実施例の固体撮像装置が得られる。
【0029】本実施例は、垂直転送部と水平転送部との
接続部が自己整合的に形成されるばかりでなく、垂直転
送部と構成する第2のP型ウエル層6とN型半導体領域
7,8aも図9のX−X方向に自己整合的に形成できる
利点がある。
接続部が自己整合的に形成されるばかりでなく、垂直転
送部と構成する第2のP型ウエル層6とN型半導体領域
7,8aも図9のX−X方向に自己整合的に形成できる
利点がある。
【0030】尚、上述した本発明の第1及び第2の実施
例では、約400nm程度の第1の酸化シリコン膜2b
をシリコン基板に形成したのち選択酸化を施してフィー
ルド酸化膜を形成する固体撮像装置の製造方法を示した
が、第1のシリコン酸化膜上に多結晶シリコン膜を堆積
したのちその多結晶シリコン膜を選択酸化するとか、第
1の酸化シリコン膜上に窒化シリコン膜、多結晶シリコ
ン膜および他の酸化シリコン膜を堆積して多結晶シリコ
ン膜選択酸化してもよい。
例では、約400nm程度の第1の酸化シリコン膜2b
をシリコン基板に形成したのち選択酸化を施してフィー
ルド酸化膜を形成する固体撮像装置の製造方法を示した
が、第1のシリコン酸化膜上に多結晶シリコン膜を堆積
したのちその多結晶シリコン膜を選択酸化するとか、第
1の酸化シリコン膜上に窒化シリコン膜、多結晶シリコ
ン膜および他の酸化シリコン膜を堆積して多結晶シリコ
ン膜選択酸化してもよい。
【0031】また、上述した本発明の第1及び第2の実
施例では、電荷転送部として埋め込みチャンネルCCD
を有する固体撮像装置の製造方法を示したが、表面チャ
ンネルCCDを有する固体撮像装置の製造法においても
同様にして適用できる。
施例では、電荷転送部として埋め込みチャンネルCCD
を有する固体撮像装置の製造方法を示したが、表面チャ
ンネルCCDを有する固体撮像装置の製造法においても
同様にして適用できる。
【0032】
【発明の効果】以上説明したように、本発明の固体撮像
装置の製造方法は、垂直転送部。
装置の製造方法は、垂直転送部。
【図面の簡単な説明】
【図1】本発明の第1の実施例を製造工程に沿って説明
するため図8のY−Y線相当部、X−X線相当部を
(a),(b)に分図して示す半導体チップの断面図で
ある。
するため図8のY−Y線相当部、X−X線相当部を
(a),(b)に分図して示す半導体チップの断面図で
ある。
【図2】図1に対応する工程の次工程の説明のため、同
様に(a),(b)に分図して示す半導体チップ断面図
である。
様に(a),(b)に分図して示す半導体チップ断面図
である。
【図3】図2に対応する工程の次工程の説明のため、同
様に(a),(b)に分図して示す断面図である。
様に(a),(b)に分図して示す断面図である。
【図4】図3に対応する工程の次工程の説明のため、同
様に(a),(b)に分図して示す断面図である。
様に(a),(b)に分図して示す断面図である。
【図5】本発明の第2の実施例を製造工程に沿って説明
するため図8のY−Y線相当部、X−X線相当部を
(a),(b)に分図して示す断面図である。
するため図8のY−Y線相当部、X−X線相当部を
(a),(b)に分図して示す断面図である。
【図6】図5に対応する工程の次工程の説明のため、同
様に(a),(b)に分図して示す断面図である。
様に(a),(b)に分図して示す断面図である。
【図7】図6に対応する工程の次工程の説明のため、同
様に(a),(b)に分図して示す断面図である。
様に(a),(b)に分図して示す断面図である。
【図8】図7に対応する工程の次工程の説明のため、同
様に(a),(b)に分図して示す断面図である。
様に(a),(b)に分図して示す断面図である。
【図9】固体撮像装置を概略的に示す平面図である。
【図10】従来例を製造工程に沿って説明するため図8
のY−Y線相当部、X−X線相当部を(a),(b)に
分図して示す断面図である。
のY−Y線相当部、X−X線相当部を(a),(b)に
分図して示す断面図である。
【図11】図10に対応する工程の次工程の説明のた
め、同様に(a),(b)に分図して示す断面図であ
る。
め、同様に(a),(b)に分図して示す断面図であ
る。
【図12】図11に対応する工程の次工程の説明のた
め、同様に(a),(b)に分図して示す断面図であ
る。
め、同様に(a),(b)に分図して示す断面図であ
る。
【図13】図12に対応する工程の次工程の説明のた
め、同様に(a),(b)に分図して示す断面図であ
る。
め、同様に(a),(b)に分図して示す断面図であ
る。
1 P型シリコン基板 2a 第1の酸化シリコン膜 2b 第2の酸化シリコン膜 2c 第3の酸化シリコン膜 3 窒化シリコン膜 4a 第1のフォトレジスト膜 4b 第2のフォトレジスト膜 4c 第3のフォトレジスト膜 4d 第4のフォトレジスト膜 5 第1のP型ウエル層 6 第2のP型ウエル層 7 第1のN型半導体層 8a,8b 第2のN型半導体層
Claims (8)
- 【請求項1】 半導体基板の表面部の第1導電型半導体
層の表面領域内にそれぞれ形成された複数個の光電変換
部、前記光電変換部より転送されてくる全信号電荷パタ
ーンを一水平走査線毎に一斉に転送する複数本の垂直転
送部および前記垂直転送部より一水平走査線毎に転送さ
れてくる信号電荷を信号出力部に転送する水平転送部か
ら構成される固体撮像装置において、前記第1導電型半
導体層が、前記垂直転送部及び水平転送部に対してそれ
ぞれ自己整合的に異なる濃度プロファイルで形成されて
いることを特徴とする固体撮像装置。 - 【請求項2】 前記垂直転送部及び水平転送部を構成す
る第2導電型半導体領域が、垂直転送部及び水平転送部
に対してそれぞれ自己整合的に異なる濃度プロファイル
で形成されている請求項1記載の固体撮像装置。 - 【請求項3】 半導体基板の一表面に第1の酸化シリコ
ン膜と窒化シリコン膜を順次に被着する工程と、前記窒
化シリコン膜を第1のフォトレジスト膜をマスクとして
選択的に除去した後、前記窒化シリコン膜と前記第1の
フォトレジスト膜をマスクにイオン注入を行ない前記第
1のフォトレジスト膜を除去した後不純物の熱拡散を行
なって水平転送部下の第1の第1導電型半導体層を形成
する工程と、前記窒化シリコン膜をマスクに選択酸化を
施し第2のシリコン酸化膜を成長し、前記窒化シリコン
膜を除去した後、前記第2の酸化シリコン膜と第2のフ
ォトレジスト膜をマスクにイオン注入を行ない前記第2
のフォトレジスト膜を除去した後不純物の熱拡散を行な
って前記第1の第1導電型半導体層と自己整合的に垂直
転送部の第2の第1導電型半導体層を形成する工程とを
有することを特徴とする固体撮像装置の製造方法。 - 【請求項4】 前記第2の酸化シリコン膜と第3のフォ
トレジスト膜をマスクにイオン注入法にて前記第1の第
1導電型半導体層と自己整合的に前記第2の第1導電型
半導体層内に垂直転送部の第1の第2導電型半導体領域
を形成する工程と、前記第2の酸化シリコン膜を除去し
た後、第1及び第2の第1導電型半導体層内に第2の第
2導電型半導体領域を形成する工程とを有することを特
徴とする特許請求の範囲第3項記載の固体撮像装置の製
造方法。 - 【請求項5】 半導体基板の一表面に第1の酸化シリコ
ン膜と窒化シリコン膜を順次形成する工程と、前記窒化
シリコン膜を第1のフォトレジスト膜をマスクに選択的
に除去した後、前記窒化シリコン膜と前記第1のフォト
レジスト膜をマスクにイオン注入を行ない前記第1のフ
ォトレジスト膜を除去した後不純物の熱拡散を行なって
水平転送部の第1の第1導電型半導体層を形成する工程
と、前記窒化シリコン膜をマスクに選択酸化を施し酸化
シリコン膜を成長した後、第2のフォトレジスト膜をマ
スクとして前記窒化シリコン膜を選択的に除去し、前記
第2の酸化シリコン膜と前記第2のフォトレジスト膜及
び前記窒化シリコン膜をマスクにイオン注入を行ない前
記第2のフォトレジスト膜を除去した後不純物の熱拡散
を行なって前記第1の第1導電型半導体層と自己整合的
に垂直転送部の第2の第1導電型半導体層を形成する工
程とを有することを特徴とする固体撮像装置の製造方
法。 - 【請求項6】 前記窒化シリコン膜及び前記第2の酸化
シリコン膜をマスクにイオン注入を行なって前記第1及
び第2の第1導電型半導体層と自己整合的に前記第2の
第1導電型半導体層内に垂直転送部の第1の第2導電型
半導体領域を形成する工程と、前記第2の酸化シリコン
膜を除去した後、前記窒化シリコン膜をマスクとして前
記第1の酸化シリコン膜を除去したのちイオン注入を行
なって前記第1の第2導電型半導体領域と自己整合的
に、前記第1及び第2の第1導電型半導体層内に第2の
第2導電型半導体領域を形成する工程を有することを特
徴とする特許請求の範囲第5項記載の固体撮像装置の製
造方法。 - 【請求項7】 前記第1の第1導電型半導体層が、イオ
ン注入の入射角を制御することにより第1のフォトレジ
スト膜、窒化シリコン膜および第1の酸化シリコン膜か
らなるマスク材に対して所望の距離を置いて形成するこ
とを特徴とする請求項3,4,5または6記載の固体撮
像装置の製造方法。 - 【請求項8】 半導体基板の一表面に前記第1のシリコ
ン酸化膜を形成する替りに酸化シリコン膜および多結晶
シリコン膜を堆積するか或いは酸化シリコン膜、窒化シ
リコン膜、多結晶シリコン膜および他の酸化シリコン膜
を堆積する工程を含む請求項3,4,5,6または7記
載の固体撮像装置の製造方法。
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4206365A JP2842066B2 (ja) | 1992-08-03 | 1992-08-03 | 固体撮像装置及びその製造方法 |
US08/101,315 US5441910A (en) | 1992-08-03 | 1993-08-03 | Method for manufacturing CCD type solid image pickup device using self-alignment process |
KR93015020A KR0131188B1 (en) | 1992-08-03 | 1993-08-03 | Method for manufactruing ccd type solid image pick-up device using self alignment process |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP4206365A JP2842066B2 (ja) | 1992-08-03 | 1992-08-03 | 固体撮像装置及びその製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH0653472A true JPH0653472A (ja) | 1994-02-25 |
JP2842066B2 JP2842066B2 (ja) | 1998-12-24 |
Family
ID=16522125
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP4206365A Expired - Fee Related JP2842066B2 (ja) | 1992-08-03 | 1992-08-03 | 固体撮像装置及びその製造方法 |
Country Status (3)
Country | Link |
---|---|
US (1) | US5441910A (ja) |
JP (1) | JP2842066B2 (ja) |
KR (1) | KR0131188B1 (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH09162137A (ja) * | 1995-12-13 | 1997-06-20 | Sony Corp | イオン注入方法 |
Families Citing this family (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6083794A (en) | 1997-07-10 | 2000-07-04 | International Business Machines Corporation | Method to perform selective drain engineering with a non-critical mask |
KR100359767B1 (ko) * | 1998-07-11 | 2002-11-07 | 주식회사 하이닉스반도체 | 고체촬상소자의 제조 방법 |
KR100446319B1 (ko) * | 2002-01-10 | 2004-09-01 | 주식회사 하이닉스반도체 | 이미지센서 및 그 제조 방법 |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0278272A (ja) * | 1988-09-14 | 1990-03-19 | Matsushita Electric Ind Co Ltd | 撮像装置およびその製造方法 |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
IE39611B1 (en) * | 1973-08-14 | 1978-11-22 | Siemens Ag | Improvements in or relating to two-phase charge coupled devices |
US4984047A (en) * | 1988-03-21 | 1991-01-08 | Eastman Kodak Company | Solid-state image sensor |
JP2509706B2 (ja) * | 1989-08-18 | 1996-06-26 | 株式会社東芝 | マスクromの製造方法 |
US5288656A (en) * | 1991-03-15 | 1994-02-22 | Sony Corporation | Method of manufacturing a CCD solid state image sensing device |
US5132241A (en) * | 1991-04-15 | 1992-07-21 | Industrial Technology Research Institute | Method of manufacturing minimum counterdoping in twin well process |
-
1992
- 1992-08-03 JP JP4206365A patent/JP2842066B2/ja not_active Expired - Fee Related
-
1993
- 1993-08-03 US US08/101,315 patent/US5441910A/en not_active Expired - Fee Related
- 1993-08-03 KR KR93015020A patent/KR0131188B1/ko not_active IP Right Cessation
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0278272A (ja) * | 1988-09-14 | 1990-03-19 | Matsushita Electric Ind Co Ltd | 撮像装置およびその製造方法 |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH09162137A (ja) * | 1995-12-13 | 1997-06-20 | Sony Corp | イオン注入方法 |
Also Published As
Publication number | Publication date |
---|---|
JP2842066B2 (ja) | 1998-12-24 |
KR940006290A (ko) | 1994-03-23 |
KR0131188B1 (en) | 1998-04-14 |
US5441910A (en) | 1995-08-15 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JPH04355964A (ja) | 固体撮像装置及びその製造方法 | |
JP3225939B2 (ja) | 固体撮像装置及びその製造方法 | |
JP2797993B2 (ja) | 固体撮像装置およびその製造方法 | |
US5401679A (en) | Method of manufacturing charge transfer device | |
JP2842066B2 (ja) | 固体撮像装置及びその製造方法 | |
JPS6057780A (ja) | 固体撮像装置およびその製造方法 | |
US20080160731A1 (en) | Method for fabricating cmos image sensor | |
US6469329B1 (en) | Solid state image sensing device and method of producing the same | |
JP4542660B2 (ja) | 固体撮像素子およびその製造方法 | |
JP2909158B2 (ja) | 電荷結合装置 | |
JPS59188966A (ja) | 固体撮像装置の製造方法 | |
KR100671140B1 (ko) | 고체 촬상 소자의 제조방법 | |
JP2517045B2 (ja) | 固体撮像素子の製造方法 | |
JP2697554B2 (ja) | 固体撮像素子の製造方法 | |
JP3772920B6 (ja) | 固体撮像素子の受光部製造方法 | |
JP3772920B2 (ja) | 固体撮像素子の受光部製造方法 | |
JP3156779B2 (ja) | 電荷転送素子及びその製造方法 | |
JP2526512B2 (ja) | 固体撮像装置の製造方法 | |
JP2835754B2 (ja) | 半導体撮像装置及びその製造方法 | |
JPH0864796A (ja) | 固体撮像装置の製造方法 | |
JPH04207077A (ja) | 固体撮像素子の製造方法 | |
JPS6197861A (ja) | 固体撮像装置の製造方法 | |
JPH05145056A (ja) | 固体撮像素子 | |
KR0172836B1 (ko) | 씨씨디 영상소자의 제조방법 | |
JPH04364780A (ja) | 固体撮像素子の製造方法 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 19980922 |
|
LAPS | Cancellation because of no payment of annual fees |