JPH0594872A - 表示駆動回路 - Google Patents

表示駆動回路

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JPH0594872A
JPH0594872A JP3282117A JP28211791A JPH0594872A JP H0594872 A JPH0594872 A JP H0594872A JP 3282117 A JP3282117 A JP 3282117A JP 28211791 A JP28211791 A JP 28211791A JP H0594872 A JPH0594872 A JP H0594872A
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clock pulse
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元喜 菰田
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    • Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
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Abstract

(57)【要約】 【目的】 表示駆動回路にインバータを使用せず、小型
軽量とし、かつ耳障りな発振音をなくす。 【構成】 高周波クロックパルスａを、低周波クロック
パルスｂによりゲート回路３でゲートする。このゲー出
力ｃによりトランジスタ４１とインダクタ４２とで高圧
パルスｄを生成する。この高圧パルスｄを３倍圧整流回
路４３で高電圧とすると共に、放電回路５０により低周
波パルスｂでこの高電圧をリセットし、表示駆動信号ｅ
を生成する。 【効果】 高圧発生用に可聴帯域のクロックが不要とな
り、耳障りなノイズがなくなる。高周波パルスで高電圧
を発生し、低周波パルスでこの高電圧をオンオフしてい
るので、インバータが不要となると共に、駆動周波数が
低くなって特にＥＬの長寿命が可能となる。

Description

【発明の詳細な説明】
【０００１】
【技術分野】本発明は表示駆動回路に関し、特に携帯機
器の表示部のバックライトに使用するＥＬ駆動に適した
ＥＬ駆動回路に関するものである。
【０００２】
【従来技術】携帯機器の表示部にＥＬを使用する場合に
は、数１０Ｖ（ボルト）から数100Ｖの電圧で、５０Hz
から１KHz 程度の周波数の交流電圧を、直流電源から発
生する回路が必要となっている。
【０００３】従来のかかるＥＬ駆動回路には、トランジ
スタとトランスとによる発振回路を用いて交流電圧を発
生するいわゆるインバータ回路が使用されている。
【０００４】上述したように従来のＥＬ駆動回路では、
数１０Ｖから100 Ｖ程度の電圧で、５０Hzから１KHz 程
度の周波数の交流電圧を発生せるために、トランジスタ
とトランスによる発振回路を使用しており、インバータ
回路の発振周波数とＥＬの駆動周波数が同一となってい
る。
【０００５】このような構成のＥＬ駆動回路では、発振
周波数を５０Hzから１KHz に低くするとトランスが大き
くしかも重くなるため携帯機器として好ましくない。ま
た逆に、発振周波数を数１０KHz から数100KHz に高く
すれば、トランスは小型軽量化できるが、ＥＬの駆動周
波数を高くすればするほど発光寿命が低下するというＥ
Ｌの特性があるため、ＥＬ駆動回路の小型軽量化とＥＬ
の発光寿命が相反するという問題点がある。
【０００６】また、１KHz 付近でインバータ回路を動作
させると、トランスの振動が耳に聞こえるため、携帯機
器の使用者に不快感を与えるという問題もある。
【０００７】
【発明の目的】本発明の目的は、トランスを用いること
なく小型軽量化を図った表示駆動回路を提供することで
ある。
【０００８】
【発明の構成】本発明による表示駆動回路は、所定周期
の第１のクロックパルスを発生する手段と、前記所定周
期よりも小なる周期の第２のクロックパルスを発生する
手段と、前記第２のクロックパルスの存在時に前記第１
のクロックパルスを通過制御するゲート手段と、前記ゲ
ート手段の出力パルスに同期した高圧パルスを生成する
手段と、この高圧パルスをｎ倍圧整流して高圧出力を生
成するｎ倍圧整流手段と、この倍圧整流手段を前記第２
のクロックパルスのオフ時にリセットする手段とを含
み、前記高圧出力を駆動信号とすることを特徴とする。
【０００９】
【実施例】次に、本発明の実施例について図面を参照し
て説明する。
【００１０】図１は本発明の一実施例の回路図であり、
図２（ａ）〜（ｅ）には回路各部ａ〜ｅにおけるタイミ
ングチャートが夫々対応して示されている。
【００１１】実施例の回路は、クロック発生回路１と、
クロック発生回路２と、ゲート回路３と、昇圧回路４０
及び放電回路５０とから構成されている。
【００１２】このような回路構成の動作を図２のタイミ
ングチャートを用いて説明する。クロック発生回路１は
高電圧を発生させるためのクロック発生回路であり、約
250KHzのクロックパルスａが出力されている。クロック
発生回路２はＥＬを点灯させるためのクロック発生回路
であり、約200Hz のクロックパルスｂが出力されてい
る。
【００１３】ゲート回路３はクロックパルスｂがＨ
（高）レベルのときのみ昇圧回路４０にクロックパルス
ａを供給するためのゲート回路である。昇圧回路４０で
は、ゲート回路３の出力クロックパルスｃがＨレベルの
ときにＮチャンネルMOSFET（以下ＦＥＴと略す）４１が
オンとなりドレインと電源との間に接続されているイン
ダクタ４２に電流が流れ、Ｌ（低）レベルの時に電流が
流れなくなる。
【００１４】インダクタ４２はＦＥＴ４１がオフになっ
た瞬間、逆起電圧を発生するため約100Vの高圧インパル
スｄが発生する。このインパルスｄを３倍（ｎ倍でも良
い）圧整流回路４３により整流し約300 Ｖの直流電圧を
得ている。
【００１５】また、クロックパルスｃがＬレベルのとき
は、放電回路５０のトランジスタ５１がオフになり、次
段のトランジスタ５２がオンになるため、３倍圧整流回
路４３のコンデンサ及びＥＬに蓄積されている電荷が放
電されるため、直ちに出力電圧ｅは０Ｖに低下する。
【００１６】このようにして、ＥＬにはピーク値で約30
0 Ｖ（約100 Ｖrms ）、約200Hz の交流電圧が図２
（ｅ）に示す如く供給されるのである。
【００１７】尚、ＥＬ表示用として説明したが、これに
限定されるものではない。
【００１８】
【発明の効果】本発明によれば、昇圧回路への入力パル
スの周波数を高くし、この昇圧回路の動作周期を低くし
ているので、高圧発生用に可聴帯域のクロックが不要と
なり、耳障りなノイズがなくなると共に、インバータが
不要となって小型軽量化が可能となるという効果があ
る。
【００１９】更に、ＥＬの駆動周波数は、昇圧回路の動
作周期で低くすることができるので、特にＥＬの発光寿
命の低下を防止でき、携帯機器の表示部のバックライト
として最適なものとなる。
【図面の簡単な説明】
【図１】本発明の実施例の回路図である。
【図２】図１の回路の各部信号波形図である。
【符号の説明】
１，２ クロック発生回路 ３ ゲート回路 ４０ 昇圧回路 ４１ ＮチャネルMOSFET ４２ インダクタ ４３ ３倍圧整流回路 ５０ 放電回路

Claims (1)

    【特許請求の範囲】
  1. 【請求項１】 所定周期の第１のクロックパルスを発生
    する手段と、前記所定周期よりも小なる周期の第２のク
    ロックパルスを発生する手段と、前記第２のクロックパ
    ルスの存在時に前記第１のクロックパルスを通過制御す
    るゲート手段と、前記ゲート手段の出力パルスに同期し
    た高圧パルスを生成する手段と、この高圧パルスをｎ倍
    圧整流して高圧出力を生成するｎ倍圧整流手段と、この
    倍圧整流手段を前記第２のクロックパルスのオフ時にリ
    セットする手段とを含み、前記高圧出力を駆動信号とす
    ることを特徴とする表示駆動回路。
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