JPH0591424A - 電荷転送装置の駆動方法 - Google Patents
電荷転送装置の駆動方法Info
- Publication number
- JPH0591424A JPH0591424A JP3252151A JP25215191A JPH0591424A JP H0591424 A JPH0591424 A JP H0591424A JP 3252151 A JP3252151 A JP 3252151A JP 25215191 A JP25215191 A JP 25215191A JP H0591424 A JPH0591424 A JP H0591424A
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- JP
- Japan
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- gate
- signal
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Abstract
(57)【要約】
【目的】 出力信号内へのリセット信号の洩れ込みを生
じることなく電荷転送装置を駆動し得る方法を提供す
る。 【構成】 電荷転送装置のリセットトランジスタのゲー
ト電極にリセットクロック信号を印加してそのトランジ
スタのソースに接続されている電荷検出用容量を所定電
位に充電した後に、電荷検出用容量へもう１つの容量を
介して接続されている接続ゲート下のチャンネルを通し
て電荷転送素子からの信号電荷を転送せしめる駆動方法
であって、リセットクロック信号が反転されたゲートク
ロック信号が出力ゲートに与えられる。
じることなく電荷転送装置を駆動し得る方法を提供す
る。 【構成】 電荷転送装置のリセットトランジスタのゲー
ト電極にリセットクロック信号を印加してそのトランジ
スタのソースに接続されている電荷検出用容量を所定電
位に充電した後に、電荷検出用容量へもう１つの容量を
介して接続されている接続ゲート下のチャンネルを通し
て電荷転送素子からの信号電荷を転送せしめる駆動方法
であって、リセットクロック信号が反転されたゲートク
ロック信号が出力ゲートに与えられる。
Description
【０００１】
【産業上の利用分野】この発明は電荷転送装置の駆動方
法に関し、特に、出力ノイズを低減させ得る駆動方法に
関するものである。
法に関し、特に、出力ノイズを低減させ得る駆動方法に
関するものである。
【０００２】
【従来の技術】図３は従来の電荷転送装置の出力部の一
例を示す回路図であり、いわゆるフローティングディヒ
ュージョンアンプの構成を示している。この電荷転送装
置において、電荷転送素子のチャンネル１上に沿って配
置された複数のクロックゲート２（ただ１つのクロック
ゲートのみが代表的に図示されている）には転送クロッ
ク信号φC が与えられ、チャンネル１の終端上の出力ゲ
ート３には直流電圧ＶGOが印加される。
例を示す回路図であり、いわゆるフローティングディヒ
ュージョンアンプの構成を示している。この電荷転送装
置において、電荷転送素子のチャンネル１上に沿って配
置された複数のクロックゲート２（ただ１つのクロック
ゲートのみが代表的に図示されている）には転送クロッ
ク信号φC が与えられ、チャンネル１の終端上の出力ゲ
ート３には直流電圧ＶGOが印加される。
【０００３】チャンネル１の終端は節点Ａを介して電荷
検出用のフローティングディヒュージョン容量ＣFD４の
第１の電極に接続され、その電荷検出用容量ＣFD４の第
２の電極はアースに接続されている。電荷検出用容量Ｃ
FD４の第１の電極は電界効果型のリセットトランジスタ
５のソースに接続されており、リセットトランジスタ５
のドレインとゲートには、それぞれ、直流電圧ＶＲとリ
セットクロック信号φ R が与えられる。リセットトラン
ジスタ５のゲートと電荷検出用容量ＣFD４の第１電極と
の間には寄生容量ＣC1６が存在する。そして、電荷検出
用容量ＣFD４の第１電極の電位変化は、バッファアンプ
７を介して出力端し８に伝達される。
検出用のフローティングディヒュージョン容量ＣFD４の
第１の電極に接続され、その電荷検出用容量ＣFD４の第
２の電極はアースに接続されている。電荷検出用容量Ｃ
FD４の第１の電極は電界効果型のリセットトランジスタ
５のソースに接続されており、リセットトランジスタ５
のドレインとゲートには、それぞれ、直流電圧ＶＲとリ
セットクロック信号φ R が与えられる。リセットトラン
ジスタ５のゲートと電荷検出用容量ＣFD４の第１電極と
の間には寄生容量ＣC1６が存在する。そして、電荷検出
用容量ＣFD４の第１電極の電位変化は、バッファアンプ
７を介して出力端し８に伝達される。
【０００４】図４を参照して、図３の電荷転送装置の出
力部の動作におけるタイミングチャートが示されてい
る。タイミングｔ1 において、クロックゲート２に与え
られる転送クロック信号φC はハイレベルになってお
り、チャンネル１のクロックゲート２下に信号電荷Ｑ
SIG （図示せず）が転送される。この場合、信号電荷は
電子を考えている。そして、リセットトランジスタ５の
ゲートに与えられるリセットクロック信号φR はハイレ
ベルの電位ＶＨになっており、トランジスタ５は導通状
態にあって電荷検出用容量ＣFD４は電位ＶＲに充電され
る。すなわち、寄生容量ＣC1６は電位ＶＲ−ＶＨに充電
され、図３における節点Ａの電位（すなわち、電荷検出
用容量ＣFD４の第１電極の電位ＶFD）はＶＲになる。
力部の動作におけるタイミングチャートが示されてい
る。タイミングｔ1 において、クロックゲート２に与え
られる転送クロック信号φC はハイレベルになってお
り、チャンネル１のクロックゲート２下に信号電荷Ｑ
SIG （図示せず）が転送される。この場合、信号電荷は
電子を考えている。そして、リセットトランジスタ５の
ゲートに与えられるリセットクロック信号φR はハイレ
ベルの電位ＶＨになっており、トランジスタ５は導通状
態にあって電荷検出用容量ＣFD４は電位ＶＲに充電され
る。すなわち、寄生容量ＣC1６は電位ＶＲ−ＶＨに充電
され、図３における節点Ａの電位（すなわち、電荷検出
用容量ＣFD４の第１電極の電位ＶFD）はＶＲになる。
【０００５】次に、図４のタイミングｔ2 においては、
リセットクロック信号φR はローレベルのＶＬになって
おり、トランジスタ５は非導通状態にある。したがっ
て、電荷検出用容量ＣFD４と寄生容量ＣC1６に蓄えられ
ていた電荷は分配されて、節点Ａの電位ＶFDは次式
（１）のようになる。 ＶFD＝ＶＲ−（ＶＨ−ＶＬ）ＣC1／（ＣFD＋ＣC1） …（１） したがって、節点Ａの電位ＶFDは、タイミングｔ1 のと
きに比べて次式（２）で与えられる電位差△Ｖだけ降下
することになる。 △Ｖ＝（ＶＨ−ＶＬ）ＣC1／（ＣFD＋ＣC1） …（２） この電位差△Ｖは、リセットクロック信号φR が寄生容
量ＣC1６を介して節点Ａに洩れ込んだ結果である。
リセットクロック信号φR はローレベルのＶＬになって
おり、トランジスタ５は非導通状態にある。したがっ
て、電荷検出用容量ＣFD４と寄生容量ＣC1６に蓄えられ
ていた電荷は分配されて、節点Ａの電位ＶFDは次式
（１）のようになる。 ＶFD＝ＶＲ−（ＶＨ−ＶＬ）ＣC1／（ＣFD＋ＣC1） …（１） したがって、節点Ａの電位ＶFDは、タイミングｔ1 のと
きに比べて次式（２）で与えられる電位差△Ｖだけ降下
することになる。 △Ｖ＝（ＶＨ−ＶＬ）ＣC1／（ＣFD＋ＣC1） …（２） この電位差△Ｖは、リセットクロック信号φR が寄生容
量ＣC1６を介して節点Ａに洩れ込んだ結果である。
【０００６】さらに、図４のタイミングｔ3 になれば転
送クロック信号φC はローレベルになっており、チャン
ネル１においてクロックゲート２下に蓄えられていた信
号電荷ＱSIG は出力ゲート３下を通って節点Ａに転送さ
れ、節点Ａの電位ＶFDが下げられる。この電位の降下量
ＶSIG は次式（３）で与えられる。 ＶSIG ＝ＱSIG ／（ＣFD＋ＣC1） …（３） なお、出力ゲート３は、タイミングｔ1 やｔ2 において
信号電荷ＱSIG が節点Ａに転送されないように、電位障
壁を設ける働きをしている。
送クロック信号φC はローレベルになっており、チャン
ネル１においてクロックゲート２下に蓄えられていた信
号電荷ＱSIG は出力ゲート３下を通って節点Ａに転送さ
れ、節点Ａの電位ＶFDが下げられる。この電位の降下量
ＶSIG は次式（３）で与えられる。 ＶSIG ＝ＱSIG ／（ＣFD＋ＣC1） …（３） なお、出力ゲート３は、タイミングｔ1 やｔ2 において
信号電荷ＱSIG が節点Ａに転送されないように、電位障
壁を設ける働きをしている。
【０００７】
【発明が解決しようとする課題】上述のように、電荷転
送装置の出力部の従来の駆動方法では、節点Ａへのリセ
ットクロック信号φR の洩れ込み電圧△Ｖが生じる。こ
の洩れ込み電圧△Ｖも、バッファアンプ７を介して出力
端子８に送られる。しかし、この洩れ電圧△Ｖは、本来
の信号とは関係のないノイズ成分である。したがって、
出力端子８の後段における増幅器（図示せず）によって
洩れ電圧△Ｖも増幅されてノイズの増大となり、Ｓ／Ｎ
比を劣化させる原因となっている。
送装置の出力部の従来の駆動方法では、節点Ａへのリセ
ットクロック信号φR の洩れ込み電圧△Ｖが生じる。こ
の洩れ込み電圧△Ｖも、バッファアンプ７を介して出力
端子８に送られる。しかし、この洩れ電圧△Ｖは、本来
の信号とは関係のないノイズ成分である。したがって、
出力端子８の後段における増幅器（図示せず）によって
洩れ電圧△Ｖも増幅されてノイズの増大となり、Ｓ／Ｎ
比を劣化させる原因となっている。
【０００８】このような先行技術の課題に鑑み、本発明
は、出力信号内へのリセット信号の洩れ込みを生じるこ
となく電荷転送装置を駆動し得る方法を提供することを
目的としている。
は、出力信号内へのリセット信号の洩れ込みを生じるこ
となく電荷転送装置を駆動し得る方法を提供することを
目的としている。
【０００９】
【課題を解決するための手段】本発明による電荷転送装
置の駆動方法は、リセットトランジスタのゲート電極に
リセットクロック信号を印加してそのトランジスタのソ
ースに接続されている電荷検出用容量を所定電位に充電
した後に、電荷検出用容量へもう１つの容量を介して接
続されている出力ゲートの下のチャンネルを通して電荷
転送素子からの信号電荷を転送せしめる駆動方法であっ
て、リセットクロック信号が反転されたゲートクロック
信号が出力ゲートに与えられることを特徴としている。
置の駆動方法は、リセットトランジスタのゲート電極に
リセットクロック信号を印加してそのトランジスタのソ
ースに接続されている電荷検出用容量を所定電位に充電
した後に、電荷検出用容量へもう１つの容量を介して接
続されている出力ゲートの下のチャンネルを通して電荷
転送素子からの信号電荷を転送せしめる駆動方法であっ
て、リセットクロック信号が反転されたゲートクロック
信号が出力ゲートに与えられることを特徴としている。
【００１０】
【作用】本発明による電荷転送装置の駆動方法において
は、リセットトランジスタのゲート電極に与えられるリ
セットクロック信号が反転されたゲートクロック信号が
チャンネル上の出力ゲートに与えられる。したがって、
たとえ寄生容量を介してトランジスタのゲート電極から
電荷検出用容量へリセットクロック信号が洩れ込んで
も、ゲートクロック信号がもう１つの寄生容量または別
途に設けられた容量を介して電荷検出用容量に侵入する
ことができる。これによってリセットクロック信号の洩
れ込みによる電位変動が逆位相のゲートクロック信号に
よって打消され、リセットクロック信号の洩れ込みによ
る電荷検出用容量におけるノイズが低減され得る。
は、リセットトランジスタのゲート電極に与えられるリ
セットクロック信号が反転されたゲートクロック信号が
チャンネル上の出力ゲートに与えられる。したがって、
たとえ寄生容量を介してトランジスタのゲート電極から
電荷検出用容量へリセットクロック信号が洩れ込んで
も、ゲートクロック信号がもう１つの寄生容量または別
途に設けられた容量を介して電荷検出用容量に侵入する
ことができる。これによってリセットクロック信号の洩
れ込みによる電位変動が逆位相のゲートクロック信号に
よって打消され、リセットクロック信号の洩れ込みによ
る電荷検出用容量におけるノイズが低減され得る。
【００１１】
【実施例】図１は、本発明の一実施例による電荷転送装
置の駆動方法に用いられ得る電荷転送装置の出力部を示
す回路図である。図１の装置は図３のものと同一である
が、図１においては出力ゲート３に直流電圧ＶＲではな
くてゲートクロック信号φ GOが与えられる。また、トラ
ンジスタ５のゲート電極と節点Ａとの間の第１の寄生容
量ＣC1６に加えて、出力ゲート３と節点Ａとの間の第２
の寄生容量ＣC2９が考慮されている。
置の駆動方法に用いられ得る電荷転送装置の出力部を示
す回路図である。図１の装置は図３のものと同一である
が、図１においては出力ゲート３に直流電圧ＶＲではな
くてゲートクロック信号φ GOが与えられる。また、トラ
ンジスタ５のゲート電極と節点Ａとの間の第１の寄生容
量ＣC1６に加えて、出力ゲート３と節点Ａとの間の第２
の寄生容量ＣC2９が考慮されている。
【００１２】図２を参照して、図１の電荷転送装置の出
力部の動作におけるタイミングチャートが示されてい
る。ゲートクロック信号φGOは、リセットクロック信号
φR の反転されたものに対応している。すなわち、ゲー
トクロック信号φGOは、リセットクロック信号φR がハ
イレベルの期間に電位差ＶC2だけ負方向に振れ、リセッ
トクロック信号φR がローレベルの間は直流電位ＶGOに
固定される。
力部の動作におけるタイミングチャートが示されてい
る。ゲートクロック信号φGOは、リセットクロック信号
φR の反転されたものに対応している。すなわち、ゲー
トクロック信号φGOは、リセットクロック信号φR がハ
イレベルの期間に電位差ＶC2だけ負方向に振れ、リセッ
トクロック信号φR がローレベルの間は直流電位ＶGOに
固定される。
【００１３】図２のタイミングｔ1 において、リセット
クロック信号φR はハイレベルＶＨになり、ゲートクロ
ック信号φGOはローレベルになっている。このとき、第
１と第２の寄生容量ＣC1６とＣC2９の節点Ａ側の電極に
蓄えられるそれぞれの電荷Ｑ C1とＱC2は、それぞれ次式
（４）と（５）によって表される。 ＱC1＝（ＶＲ−ＶＨ）ＣC1 …（４） ＱC2＝（ＶＲ−ＶGO＋ＶC2）ＣC2 …（５） また、電荷検出用容量ＣFD４に蓄えられる電荷ＱFDは次
式（６）のようになる。 ＱFD＝ＶＲ・ＣFD …（６） なお、節点Ａの電位ＶFDは従来と同じくＶＲである。
クロック信号φR はハイレベルＶＨになり、ゲートクロ
ック信号φGOはローレベルになっている。このとき、第
１と第２の寄生容量ＣC1６とＣC2９の節点Ａ側の電極に
蓄えられるそれぞれの電荷Ｑ C1とＱC2は、それぞれ次式
（４）と（５）によって表される。 ＱC1＝（ＶＲ−ＶＨ）ＣC1 …（４） ＱC2＝（ＶＲ−ＶGO＋ＶC2）ＣC2 …（５） また、電荷検出用容量ＣFD４に蓄えられる電荷ＱFDは次
式（６）のようになる。 ＱFD＝ＶＲ・ＣFD …（６） なお、節点Ａの電位ＶFDは従来と同じくＶＲである。
【００１４】次に、図２のタイミングｔ2 においては、
リセットクロック信号φR はローレベルＶＬとなってお
り、トランジスタ５は非導通状態にある。また、ゲート
クロック信号φGOは電位ＶGOのレベルにある。このとき
の節点Ａの電位ＶFDは、次式（７）の関係から求められ
る。 ＱC1＋ＱC2＋ＱC3＝（ＶFD−ＶGO）ＣC2＋ＶFD・ＣFD＋（ＶFD−ＶＬ）ＣC1 …（７） 式（４）〜（６）を式（７）に代入してＶFDを求めれ
ば、次式（８）で表される。 ＶFD＝ＶR −｛（ＶＨ−ＶＬ）ＣC1−ＶC2・ＣC2｝／（Ｃ1 ＋Ｃ2 ＋ＣFD） …（８） したがって、ＶC2を（ＶＨ−ＶＬ）ＣC1／ＣC2に等しく
なるように調節すればタイミングｔ2 においてもＶFD＝
ＶＲとなり、リセットクロック信号φR の洩れ込みがな
いことになる。
リセットクロック信号φR はローレベルＶＬとなってお
り、トランジスタ５は非導通状態にある。また、ゲート
クロック信号φGOは電位ＶGOのレベルにある。このとき
の節点Ａの電位ＶFDは、次式（７）の関係から求められ
る。 ＱC1＋ＱC2＋ＱC3＝（ＶFD−ＶGO）ＣC2＋ＶFD・ＣFD＋（ＶFD−ＶＬ）ＣC1 …（７） 式（４）〜（６）を式（７）に代入してＶFDを求めれ
ば、次式（８）で表される。 ＶFD＝ＶR −｛（ＶＨ−ＶＬ）ＣC1−ＶC2・ＣC2｝／（Ｃ1 ＋Ｃ2 ＋ＣFD） …（８） したがって、ＶC2を（ＶＨ−ＶＬ）ＣC1／ＣC2に等しく
なるように調節すればタイミングｔ2 においてもＶFD＝
ＶＲとなり、リセットクロック信号φR の洩れ込みがな
いことになる。
【００１５】図２のタイミングｔ3 における動作は図４
のタイミングｔ3 におけるものと同じであるので説明を
省略する。
のタイミングｔ3 におけるものと同じであるので説明を
省略する。
【００１６】なお、出力ゲート３にゲートクロック信号
φGOが印加されるとき、ゲートクロック信号φGOはタイ
ミングｔ1 において電位が負方向に振れるので、チャン
ネル１においてクロックゲート２下にある信号電荷にと
っては電位障壁を増す方向にあり、信号電荷が電気検出
用容量ＣFDに転送されるタイミングｔ3 においては、φ
GOのレベルは従来と同じ電位ＶGOとなるので、信号電荷
の転送に対して何らの悪影響をも及ぼさない。
φGOが印加されるとき、ゲートクロック信号φGOはタイ
ミングｔ1 において電位が負方向に振れるので、チャン
ネル１においてクロックゲート２下にある信号電荷にと
っては電位障壁を増す方向にあり、信号電荷が電気検出
用容量ＣFDに転送されるタイミングｔ3 においては、φ
GOのレベルは従来と同じ電位ＶGOとなるので、信号電荷
の転送に対して何らの悪影響をも及ぼさない。
【００１７】ところで、以上の実施例ではＶC2＝（ＶＨ
−ＶＬ）ＣC1／ＣC2に設定される場合について説明され
たが、本発明の目的はリセットクロック信号φR の洩れ
を減少させることにあるので、ＶC2の値は出力端子８の
後段に接続される増幅器の特性や要求されるＳ／Ｎ比の
値を考慮して調節すればよい。すなわち、ＶC2≠（ＶＨ
−ＶＬ）ＣC1／ＣC2の場合であっても、従来の方法に比
べてリセットクロック信号φR の洩れを減少させること
ができるので、本発明の目的を達成し得る。
−ＶＬ）ＣC1／ＣC2に設定される場合について説明され
たが、本発明の目的はリセットクロック信号φR の洩れ
を減少させることにあるので、ＶC2の値は出力端子８の
後段に接続される増幅器の特性や要求されるＳ／Ｎ比の
値を考慮して調節すればよい。すなわち、ＶC2≠（ＶＨ
−ＶＬ）ＣC1／ＣC2の場合であっても、従来の方法に比
べてリセットクロック信号φR の洩れを減少させること
ができるので、本発明の目的を達成し得る。
【００１８】また、ゲートクロック信号φGOとリセット
クロック信号φR との関係においては、それらの論理信
号が反転するタイミングはまったく同一でなくてもよ
い。すなわち、それらの信号のクロック幅、立上り、お
よび立下りなどの特性は、リセットクロック信号φR の
洩れが少なくなる所望の値に調節すればよい。
クロック信号φR との関係においては、それらの論理信
号が反転するタイミングはまったく同一でなくてもよ
い。すなわち、それらの信号のクロック幅、立上り、お
よび立下りなどの特性は、リセットクロック信号φR の
洩れが少なくなる所望の値に調節すればよい。
【００１９】さらに、以上の実施例では信号電荷として
電子を考えたが、正孔であってもよい。この場合、電圧
の極性をすべて反転したものにすればよい。
電子を考えたが、正孔であってもよい。この場合、電圧
の極性をすべて反転したものにすればよい。
【００２０】またさらに、以上の実施例では第２の寄生
容量が考慮されたが、この寄生容量の代わりに、意図的
な独立の容量を設けてもよい。
容量が考慮されたが、この寄生容量の代わりに、意図的
な独立の容量を設けてもよい。
【００２１】
【発明の効果】以上のように、本発明によれば、出力信
号内へのリセットクロック信号の洩れ込みを生じること
なく電荷転送装置を駆動し得る方法を提供することがで
きる。
号内へのリセットクロック信号の洩れ込みを生じること
なく電荷転送装置を駆動し得る方法を提供することがで
きる。
【図１】本発明の一実施例による電荷転送装置の駆動方
法において用いられ得る電荷転送装置の出力部を示す回
路図である。
法において用いられ得る電荷転送装置の出力部を示す回
路図である。
【図２】図１の電荷転送装置の動作におけるタイミング
チャートを示す図である。
チャートを示す図である。
【図３】従来の電荷転送装置の駆動方法に用いられる電
荷転送装置の出力部の回路図である。
荷転送装置の出力部の回路図である。
【図４】図２の電荷転送装置の動作におけるタイミング
チャートを示す図である。
チャートを示す図である。
１ 電荷転送装置のチャンネル ２ クロックゲート ３ 出力ゲート ４ 電荷検出用容量 ５ リセットトランジスタ ６ 第１の寄生容量 ７ バッファアンプ ８ 出力端子 ９ 第２の寄生容量 Ａ 節点 φC 転送クロック信号 φGO ゲートクロック信号 φR リセットクロック信号
Claims (1)
- 【請求項１】 電荷転送装置のリセットトランジスタの
ゲート電極にリセットクロック信号を印加して前記トラ
ンジスタのソースに接続されている電荷検出用容量を所
定電位に充電した後に、前記電荷検出用容量へもう１つ
の容量を介して接続されている出力ゲートの下のチャネ
ルを通して電荷転送素子から信号電荷を転送せしめる駆
動方法であって、 前記リセットクロック信号が反転されたゲートクロック
信号が前記出力ゲートに与えられることを特徴とする電
荷転送装置の駆動方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3252151A JPH0591424A (ja) | 1991-09-30 | 1991-09-30 | 電荷転送装置の駆動方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3252151A JPH0591424A (ja) | 1991-09-30 | 1991-09-30 | 電荷転送装置の駆動方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0591424A true JPH0591424A (ja) | 1993-04-09 |
Family
ID=17233192
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3252151A Withdrawn JPH0591424A (ja) | 1991-09-30 | 1991-09-30 | 電荷転送装置の駆動方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0591424A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008511255A (ja) * | 2004-08-25 | 2008-04-10 | マイクロン テクノロジー インコーポレイテッド | 画素リセット電圧昇圧用画素 |
-
1991
- 1991-09-30 JP JP3252151A patent/JPH0591424A/ja not_active Withdrawn
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008511255A (ja) * | 2004-08-25 | 2008-04-10 | マイクロン テクノロジー インコーポレイテッド | 画素リセット電圧昇圧用画素 |
| US8026969B2 (en) | 2004-08-25 | 2011-09-27 | Aptina Imaging Corporation | Pixel for boosting pixel reset voltage |
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