JPH0585912B2 - - Google Patents
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- JPH0585912B2 JPH0585912B2 JP63184777A JP18477788A JPH0585912B2 JP H0585912 B2 JPH0585912 B2 JP H0585912B2 JP 63184777 A JP63184777 A JP 63184777A JP 18477788 A JP18477788 A JP 18477788A JP H0585912 B2 JPH0585912 B2 JP H0585912B2
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- Japan
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- synchronization signal
- signal
- horizontal
- vertical synchronization
- input
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- 238000001514 detection method Methods 0.000 claims description 13
- 238000000926 separation method Methods 0.000 claims description 7
- 239000002131 composite material Substances 0.000 description 8
- 238000010586 diagram Methods 0.000 description 5
- 239000003990 capacitor Substances 0.000 description 3
- 230000001360 synchronised effect Effects 0.000 description 3
- 230000000694 effects Effects 0.000 description 2
- 238000000034 method Methods 0.000 description 1
- 230000002093 peripheral effect Effects 0.000 description 1
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
- G06F1/04—Generating or distributing clock signals or signals derived directly therefrom
- G06F1/12—Synchronisation of different clock signals provided by a plurality of clock generators
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/04—Synchronising
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N25/00—Circuitry of solid-state image sensors [SSIS]; Control thereof
- H04N25/70—SSIS architectures; Circuits associated therewith
- H04N25/71—Charge-coupled device [CCD] sensors; Charge-transfer registers specially adapted for CCD sensors
- H04N25/715—Charge-coupled device [CCD] sensors; Charge-transfer registers specially adapted for CCD sensors using frame interline transfer [FIT]
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Synchronizing For Television (AREA)
- Controls And Circuits For Display Device (AREA)
- Processing Of Color Television Signals (AREA)
- Television Systems (AREA)
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、コンピユーターの周辺機器として用
いられるモニターに多様な同期信号が入力される
場合、その多様な同期信号の中で一つを選択し得
るようにした同期信号選択回路に係るもので、詳
しくは、モニターに合成映像信号と同期信号とが
同時に入力される場合に、同期信号を優先的に選
択し得るようにした同期信号自動選択回路に関す
るものである。
いられるモニターに多様な同期信号が入力される
場合、その多様な同期信号の中で一つを選択し得
るようにした同期信号選択回路に係るもので、詳
しくは、モニターに合成映像信号と同期信号とが
同時に入力される場合に、同期信号を優先的に選
択し得るようにした同期信号自動選択回路に関す
るものである。
一般に、従来の同期信号選択回路は第5図に示
したように、スイツチング素子SW1,SW2の選択
により一つの同期信号を選択するようになつてい
た。すなわち、スイツチング素子SW1,SW2をそ
の一方側固定端子a1,a2側に短絡した状態に於い
ては、色信号入力端子Gに入力されて同期信号分
離回路2から同期分離された水平及び垂直同期信
号は、それらスイツチング素子SW1,SW2を通つ
て水平同期信号処理回路3と垂直同期信号処理回
路4とにそれぞれ入力される。且つ、スイツチン
グ素子SW1,SW2をその中間固定端子b1,b2側に
短絡した状態に於いては、同期信号入力端子H,
Vに入力された水平及び垂直同期信号は、そのス
イツチング素子SW1,SW2を通つて水平同期信号
処理回路3と垂直同期信号処理回路4とにそれぞ
れ入力される。更に、スイツチング素子SW1,
SW2を他方側固定端子C1,C2側に短絡した状態
に於いては、水平及び垂直同期信号入力端子H,
Vに入力されて同期信号分離回路5から同期分離
された水平及び垂直同期信号は、そのスイツチン
グ素子SW1,SW2を通つて水平同期信号処理回路
3と垂直同期信号処理回路4とにそれぞれ入力さ
れるようになつていた。従つて、従来の回路に於
いては、使用者がいちいちそのスイツチング素子
SW1,SW2を切り替えて同期信号を選択しなけれ
ばならない不便な欠点があつた。それで、本発明
は、このような問題点を解決するため研究を重ね
た結果、従来のようにスイツチング素子を切り替
えることなく、自動的に同期信号を選択し得る同
期信号選択回路を提供しようとするものである。
したように、スイツチング素子SW1,SW2の選択
により一つの同期信号を選択するようになつてい
た。すなわち、スイツチング素子SW1,SW2をそ
の一方側固定端子a1,a2側に短絡した状態に於い
ては、色信号入力端子Gに入力されて同期信号分
離回路2から同期分離された水平及び垂直同期信
号は、それらスイツチング素子SW1,SW2を通つ
て水平同期信号処理回路3と垂直同期信号処理回
路4とにそれぞれ入力される。且つ、スイツチン
グ素子SW1,SW2をその中間固定端子b1,b2側に
短絡した状態に於いては、同期信号入力端子H,
Vに入力された水平及び垂直同期信号は、そのス
イツチング素子SW1,SW2を通つて水平同期信号
処理回路3と垂直同期信号処理回路4とにそれぞ
れ入力される。更に、スイツチング素子SW1,
SW2を他方側固定端子C1,C2側に短絡した状態
に於いては、水平及び垂直同期信号入力端子H,
Vに入力されて同期信号分離回路5から同期分離
された水平及び垂直同期信号は、そのスイツチン
グ素子SW1,SW2を通つて水平同期信号処理回路
3と垂直同期信号処理回路4とにそれぞれ入力さ
れるようになつていた。従つて、従来の回路に於
いては、使用者がいちいちそのスイツチング素子
SW1,SW2を切り替えて同期信号を選択しなけれ
ばならない不便な欠点があつた。それで、本発明
は、このような問題点を解決するため研究を重ね
た結果、従来のようにスイツチング素子を切り替
えることなく、自動的に同期信号を選択し得る同
期信号選択回路を提供しようとするものである。
すなわち、本発明によれば、水平及び垂直同期
信号が入力されずに合成映像信号が入力される場
合には、その合成映像信号から同期分離された同
期信号を再び水平及び垂直同期信号に区分して水
平及び垂直同期信号処理回路にそれぞれ印加し、
水平及び垂直同期信号と合成映像信号とが同時に
入力される場合には、その合成映像信号から同期
分離された同期信号を遮断すると共に、その水平
及び垂直同期信号を水平及び垂直同期信号処理回
路にそれぞれ印加することにより、自動的に同期
信号を選択し得るように回路が構成されている。
信号が入力されずに合成映像信号が入力される場
合には、その合成映像信号から同期分離された同
期信号を再び水平及び垂直同期信号に区分して水
平及び垂直同期信号処理回路にそれぞれ印加し、
水平及び垂直同期信号と合成映像信号とが同時に
入力される場合には、その合成映像信号から同期
分離された同期信号を遮断すると共に、その水平
及び垂直同期信号を水平及び垂直同期信号処理回
路にそれぞれ印加することにより、自動的に同期
信号を選択し得るように回路が構成されている。
以下、本発明による実施例について、図面を用
いて詳細に説明するが、本発明は特許請求の範囲
に規定された構成をはずれない限り、本実施例に
限定されるものでないことは勿論である。
いて詳細に説明するが、本発明は特許請求の範囲
に規定された構成をはずれない限り、本実施例に
限定されるものでないことは勿論である。
第1図は、本発明による同期信号自動選択回路
図で、図面に示したように、色信号入力端子Gに
接続した同期信号分離回路2の出力側を排他的
ExclusiveオアゲートEXOR1及び抵抗R1により
構成された信号反転器6と抵抗R2を通してトラ
ンジスターTR1のベースに接続し、水平及び水
平/垂直同期信号入力端子HHVをコンデンサー
C3,C4、ダイオードD1,D2、抵抗R8,R9及びト
ランジスターTR3により構成された同期信号検出
部8を通して前記信号反転器6の出力側及び抵抗
R2の接続点に接続し、かつ、前記水平及び水
平/垂直同期信号入力端子HHVを排他的オアゲ
ートEXOR3の一方側入力端子に接続すると共に
極性検出回路9を通してその排他的オアゲート
EXOR3の他方側入力端子に接続する。該排他的
オアゲートEXOR3の出力端子を抵抗R11を通して
前記トランジスターTR1のベースに接続し、該ト
ランジスターTR1のコレクターを電源端子VCC
に接続された抵抗R3と水平同期信号処理回路3
の入力端子に接続すると共に抵抗R4,R5及びコ
ンデンサーC1,C2により構成された垂直同期信
号分離器7を通してトランジスターTR2のベース
に接続する。
図で、図面に示したように、色信号入力端子Gに
接続した同期信号分離回路2の出力側を排他的
ExclusiveオアゲートEXOR1及び抵抗R1により
構成された信号反転器6と抵抗R2を通してトラ
ンジスターTR1のベースに接続し、水平及び水
平/垂直同期信号入力端子HHVをコンデンサー
C3,C4、ダイオードD1,D2、抵抗R8,R9及びト
ランジスターTR3により構成された同期信号検出
部8を通して前記信号反転器6の出力側及び抵抗
R2の接続点に接続し、かつ、前記水平及び水
平/垂直同期信号入力端子HHVを排他的オアゲ
ートEXOR3の一方側入力端子に接続すると共に
極性検出回路9を通してその排他的オアゲート
EXOR3の他方側入力端子に接続する。該排他的
オアゲートEXOR3の出力端子を抵抗R11を通して
前記トランジスターTR1のベースに接続し、該ト
ランジスターTR1のコレクターを電源端子VCC
に接続された抵抗R3と水平同期信号処理回路3
の入力端子に接続すると共に抵抗R4,R5及びコ
ンデンサーC1,C2により構成された垂直同期信
号分離器7を通してトランジスターTR2のベース
に接続する。
次いで、該トランジスターTR2のコレクターを
電源端子VCCに接続された抵抗R6と排他的オア
ゲートEXOR2の他方側入力端子に接続すると共
に、垂直同期信号入力端子Vをその排他的オアゲ
ートEXOR2の一方側入力端子に接続し、該排他
的オアゲートEXOR2の出力端子を電源端子VCC
に接続された抵抗R7と垂直同期信号処理回路4
の入力端子とに接続させることにより本発明によ
る同期信号自動選択回路が構成される。図中、未
説明符号R,Bは色信号入力端子を示し、符号1
は映像処理回路を示す。
電源端子VCCに接続された抵抗R6と排他的オア
ゲートEXOR2の他方側入力端子に接続すると共
に、垂直同期信号入力端子Vをその排他的オアゲ
ートEXOR2の一方側入力端子に接続し、該排他
的オアゲートEXOR2の出力端子を電源端子VCC
に接続された抵抗R7と垂直同期信号処理回路4
の入力端子とに接続させることにより本発明によ
る同期信号自動選択回路が構成される。図中、未
説明符号R,Bは色信号入力端子を示し、符号1
は映像処理回路を示す。
このように構成された本発明による同期信号自
動選択回路の作用効果を第2図乃至第4図の波形
図を用いて詳細に説明すると次のようである。
動選択回路の作用効果を第2図乃至第4図の波形
図を用いて詳細に説明すると次のようである。
電源端子VCCに電源を印加し、色信号入力端
子R,B,Gに合成映像信号の色信号が入力する
と、該色信号は映像処理回路1に入力して処理さ
れる。又、この場合、色信号入力端子Gに入力し
た色信号は同期信号分離回路2に入力されてその
色信号中の同期信号が第2図のAに示したように
出力される。このように出力された同期信号は第
2図のBに示したように、信号反転器6から反転
して出力される。
子R,B,Gに合成映像信号の色信号が入力する
と、該色信号は映像処理回路1に入力して処理さ
れる。又、この場合、色信号入力端子Gに入力し
た色信号は同期信号分離回路2に入力されてその
色信号中の同期信号が第2図のAに示したように
出力される。このように出力された同期信号は第
2図のBに示したように、信号反転器6から反転
して出力される。
そして、この場合、水平及び水平/垂直同期信
号入力端子HHVに同期信号が入力されなくなる
と、同期信号検出部8のトランジスターTR3がオ
フされてそのコレクターに高電位信号が出力され
る。かつ、極性検出回路9から同期信号極性が検
出されず、その出力端子に低電位信号が出力され
るので排他的オアゲートEXOR3の出力端子には
低電位信号が継続出力するようになる。従つて、
この場合、前記信号反転器6から出力された同期
信号は抵抗R2を通つてトランジスターTR1のベ
ースに印加されるため、その同期信号は第2図の
Cに示したように反転してそのコレクターに出力
される。
号入力端子HHVに同期信号が入力されなくなる
と、同期信号検出部8のトランジスターTR3がオ
フされてそのコレクターに高電位信号が出力され
る。かつ、極性検出回路9から同期信号極性が検
出されず、その出力端子に低電位信号が出力され
るので排他的オアゲートEXOR3の出力端子には
低電位信号が継続出力するようになる。従つて、
この場合、前記信号反転器6から出力された同期
信号は抵抗R2を通つてトランジスターTR1のベ
ースに印加されるため、その同期信号は第2図の
Cに示したように反転してそのコレクターに出力
される。
このように、トランジスターTR1のコレクター
に入力された同期信号は水平同期信号処理回路3
に印加して処理され、且つ、その同期信号は垂直
同期信号分離器7に印加されるので、第2図のD
に示したように、垂直同期信号が分離されてトラ
ンジスターTR2のベースに印加される。これによ
つて、該トランジスターTR2のベースに印加され
る同期信号は第2図のEに示したように反転され
てそのコレクターに出力され、排他的オアゲート
EXOR2の他方側入力端子に印加される。
に入力された同期信号は水平同期信号処理回路3
に印加して処理され、且つ、その同期信号は垂直
同期信号分離器7に印加されるので、第2図のD
に示したように、垂直同期信号が分離されてトラ
ンジスターTR2のベースに印加される。これによ
つて、該トランジスターTR2のベースに印加され
る同期信号は第2図のEに示したように反転され
てそのコレクターに出力され、排他的オアゲート
EXOR2の他方側入力端子に印加される。
更に、この場合、垂直同期信号入力端子Vに垂
直同期信号が入力しなくなると、排他的オアゲー
トEXOR2の一方側入力端子には第2図のFに示
したように低電子信号が印加されるので、その排
他的オアゲートEXOR2の他方側入力端子に印加
される垂直同期信号が第2図のGに示したように
出力され、該垂直同期信号は垂直同期信号処理回
路4に印加して処理される。
直同期信号が入力しなくなると、排他的オアゲー
トEXOR2の一方側入力端子には第2図のFに示
したように低電子信号が印加されるので、その排
他的オアゲートEXOR2の他方側入力端子に印加
される垂直同期信号が第2図のGに示したように
出力され、該垂直同期信号は垂直同期信号処理回
路4に印加して処理される。
一方、第3図のA,Bに示したように、分離さ
れた垂直同期信号及び水平同期信号が垂直同期信
号入力端子Vと、水平及び水平/垂直同期信号入
力端子HHVにそれぞれ入力されると、その入力
された水平同期信号は同期信号検出部8のコンデ
ンサーC3,C4、及びダイオードD1,D2から倍電
圧整流されてトランジスターTR3のベースに印加
されるので該トランジスターTR3は導電(オン)
される。従つて、この場合、前記信号反転器6か
ら出力される同期信号はトランジスターTR3を通
つて接地に流れるようになる。かつ、前記水平同
期信号は排他的オアゲートEXOR3の一方側入力
端子に印加されると共にその水平同期信号の極性
が極性検出回路9から検出されて、その排他的オ
アゲートEXOR3の他方側入力端子には第3図の
Cに示したように高電位信号が印加される。よつ
て、その排他的オアゲートEXOR3の出力端子に
はその一方側入力端子に印加される水平同期信号
が第3図のDに示したように反転して出力され、
該出力信号は抵抗R11を通つてトランジスター
TR1のベースに印加されるので、そのコレクター
には第3図のEに示したように水平同期信号が出
力される。
れた垂直同期信号及び水平同期信号が垂直同期信
号入力端子Vと、水平及び水平/垂直同期信号入
力端子HHVにそれぞれ入力されると、その入力
された水平同期信号は同期信号検出部8のコンデ
ンサーC3,C4、及びダイオードD1,D2から倍電
圧整流されてトランジスターTR3のベースに印加
されるので該トランジスターTR3は導電(オン)
される。従つて、この場合、前記信号反転器6か
ら出力される同期信号はトランジスターTR3を通
つて接地に流れるようになる。かつ、前記水平同
期信号は排他的オアゲートEXOR3の一方側入力
端子に印加されると共にその水平同期信号の極性
が極性検出回路9から検出されて、その排他的オ
アゲートEXOR3の他方側入力端子には第3図の
Cに示したように高電位信号が印加される。よつ
て、その排他的オアゲートEXOR3の出力端子に
はその一方側入力端子に印加される水平同期信号
が第3図のDに示したように反転して出力され、
該出力信号は抵抗R11を通つてトランジスター
TR1のベースに印加されるので、そのコレクター
には第3図のEに示したように水平同期信号が出
力される。
このように出力された水平同期信号は水平同期
信号処理回路3に印加して処理され、且つ、その
水平同期信号は垂直同期信号分離器7に印加され
る。しかし、この場合、その水平同期信号中には
垂直同期信号が包含されていないため、垂直同期
信号分離器7の出力側には第3図のFに示したよ
うに低電位信号が出力され、よつて、トランジス
ターTR2がオフされて排他的オアゲートEXOR2
の他方側入力端子には第3図のGに示したように
高電位信号が印加される。
信号処理回路3に印加して処理され、且つ、その
水平同期信号は垂直同期信号分離器7に印加され
る。しかし、この場合、その水平同期信号中には
垂直同期信号が包含されていないため、垂直同期
信号分離器7の出力側には第3図のFに示したよ
うに低電位信号が出力され、よつて、トランジス
ターTR2がオフされて排他的オアゲートEXOR2
の他方側入力端子には第3図のGに示したように
高電位信号が印加される。
従つて、この場合、垂直同期信号入力端子Vに
入力される垂直同期信号は排他的オアゲート
EXOR2から第3図のHに示したように反転して
垂直同期信号処理回路4に印加される。
入力される垂直同期信号は排他的オアゲート
EXOR2から第3図のHに示したように反転して
垂直同期信号処理回路4に印加される。
一方、第4図のAに示したように、水平及び垂
直同期信号の合成された同期信号が水平及び水
平/垂直同期信号入力端子HHVに入力すると、
前記のように、その同期信号は同期信号検出部8
から検出されてトランジスターTR3がオンにな
り、前記信号反転器6の出力信号は接地に流れ
る。且つ、極性検出回路9から第4図のBに示し
たように高電位信号が出力されて排他的オアゲー
トEXOR3の他方側入力端子に印加される。
直同期信号の合成された同期信号が水平及び水
平/垂直同期信号入力端子HHVに入力すると、
前記のように、その同期信号は同期信号検出部8
から検出されてトランジスターTR3がオンにな
り、前記信号反転器6の出力信号は接地に流れ
る。且つ、極性検出回路9から第4図のBに示し
たように高電位信号が出力されて排他的オアゲー
トEXOR3の他方側入力端子に印加される。
従つて、この場合、水平及び水平/垂直同期信
号入力端子HHVに入力される同期信号は排他的
オアゲートEXOR3から第4図のCに示したよう
に反転され、トランジスターTR1から第4図のD
に示したように再び反転されて水平同期信号処理
回路3に印加される。且つ、トランジスターTR1
のコレクターに出力された同期信号中の垂直同期
信号は垂直同期信号分離器7から第4図のEに示
したように分離されてトランジスターTR2のベー
スに印加され、よつて、該トランジスターTR2の
コレクターには、第4図のFに示したように、垂
直同期信号が出力されて排他的オアゲート
EXOR2の他方側入力端子に印加される。そして、
この場合、垂直同期信号入力端子Vに垂直同期信
号が入力されずにその排他的オアゲートEXOR2
の一方側入力端子に第4図のGに示したように低
電位信号が印加されるので、その排他的オアゲー
トEXOR2からその他方側入力端子に印加される
垂直同期信号が第4図のHに示したように垂直同
期信号処理回路4に印加される。
号入力端子HHVに入力される同期信号は排他的
オアゲートEXOR3から第4図のCに示したよう
に反転され、トランジスターTR1から第4図のD
に示したように再び反転されて水平同期信号処理
回路3に印加される。且つ、トランジスターTR1
のコレクターに出力された同期信号中の垂直同期
信号は垂直同期信号分離器7から第4図のEに示
したように分離されてトランジスターTR2のベー
スに印加され、よつて、該トランジスターTR2の
コレクターには、第4図のFに示したように、垂
直同期信号が出力されて排他的オアゲート
EXOR2の他方側入力端子に印加される。そして、
この場合、垂直同期信号入力端子Vに垂直同期信
号が入力されずにその排他的オアゲートEXOR2
の一方側入力端子に第4図のGに示したように低
電位信号が印加されるので、その排他的オアゲー
トEXOR2からその他方側入力端子に印加される
垂直同期信号が第4図のHに示したように垂直同
期信号処理回路4に印加される。
以上詳しく説明したように、本発明の同期信号
自動選択回路によれば、いちいち使用者がスイツ
チング素子を切り替えることなく、自動的に同期
信号を選択し得るようになつているため、極めて
便利である。
自動選択回路によれば、いちいち使用者がスイツ
チング素子を切り替えることなく、自動的に同期
信号を選択し得るようになつているため、極めて
便利である。
又、合成映像信号と同期信号とが同時に入力さ
れる場合には、合成映像信号の同期信号を遮断
し、別途に入力される同期信号を選択し得る効果
がある。
れる場合には、合成映像信号の同期信号を遮断
し、別途に入力される同期信号を選択し得る効果
がある。
第1図は、本発明による同期信号自動選択回路
図、第2図乃至第4図は、第1図各部の波形図、
第5図は、従来の同期信号選択回路図を示す。 図中、1……映像処理回路、2……同期信号分
離回路、3……水平同期信号処理回路、4……垂
直同期信号処理回路、6……信号反転器、7……
垂直同期信号分離器、8……同期信号検出部、9
……極性検出回路、EXOR1−EXOR3……排他的
(Exclusive)オアゲート、TR1−TR3……トラン
ジスター。
図、第2図乃至第4図は、第1図各部の波形図、
第5図は、従来の同期信号選択回路図を示す。 図中、1……映像処理回路、2……同期信号分
離回路、3……水平同期信号処理回路、4……垂
直同期信号処理回路、6……信号反転器、7……
垂直同期信号分離器、8……同期信号検出部、9
……極性検出回路、EXOR1−EXOR3……排他的
(Exclusive)オアゲート、TR1−TR3……トラン
ジスター。
Claims (1)
- 1 色信号入力端子Gの色信号から同期信号を分
離する同期信号分離回路2と、該同期信号分離回
路2から出力される同期信号を反転させる信号反
転器6と、水平及び水平/垂直同期信号入力端子
HHVに同期信号が入力される場合に該同期信号
を検出して前記信号反転器6の出力信号を接地さ
せる同期信号検出部8と、前記水平及び水平/垂
直同期信号入力端子HHVの同期信号極性を検出
する極性検出回路9と、該極性検出回路9の出力
信号と前記水平及び水平/垂直同期信号入力端子
HHVの同期信号とを入力する排他的オアゲート
EXOR3と、該排他的オアゲートEXOR3の出力信
号又は前記信号反転器6の出力信号を反転して水
平同期信号処理回路3に印加するトランジスター
TR1と、該トランジスターTR1の出力信号から垂
直同期信号を分離する垂直同期信号分離器7と、
該垂直同期信号分離器7の出力信号を反転させる
トランジスターTR2と、該トランジスターTR2の
出力信号と垂直同期信号入力端子Vの垂直同期信
号とを入力して垂直同期信号処理回路4に印加す
る排他的オアゲートEXOR2とに依り構成される
ことを特徴とする同期信号自動選択回路。
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019870008367A KR900002792B1 (ko) | 1987-07-30 | 1987-07-30 | 동기신호 자동 선택회로 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS6444986A JPS6444986A (en) | 1989-02-17 |
JPH0585912B2 true JPH0585912B2 (ja) | 1993-12-09 |
Family
ID=19263446
Family Applications (1)
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