JPH057632Y2 - - Google Patents
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- JPH057632Y2 JPH057632Y2 JP14746485U JP14746485U JPH057632Y2 JP H057632 Y2 JPH057632 Y2 JP H057632Y2 JP 14746485 U JP14746485 U JP 14746485U JP 14746485 U JP14746485 U JP 14746485U JP H057632 Y2 JPH057632 Y2 JP H057632Y2
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- terminal
- signal
- terminal device
- host
- signal transmission
- Prior art date
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- 230000008054 signal transmission Effects 0.000 claims description 19
- 238000001514 detection method Methods 0.000 claims description 4
- 240000007320 Pinus strobus Species 0.000 description 4
- 238000010586 diagram Methods 0.000 description 3
- 230000005540 biological transmission Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
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- Power Sources (AREA)
Description
【考案の詳細な説明】
〈産業上の利用分野〉
本考案は信号伝送装置に係り、特に端末装置の
電源オン状態を確認してホスト装置から該端末装
置に信号を伝送する信号伝送装置に関する。
電源オン状態を確認してホスト装置から該端末装
置に信号を伝送する信号伝送装置に関する。
〈従来技術〉
オフコンなどのホスト装置と、プリンタ、紙テ
ープリーダ、パンチヤ、コンソール、CRTなど
の端末装置との間では、ホスト装置は端末装置の
電源オン状態を確認してストローブ信号や各種コ
マンド信号を端末装置へ伝送するようになつてい
る。
ープリーダ、パンチヤ、コンソール、CRTなど
の端末装置との間では、ホスト装置は端末装置の
電源オン状態を確認してストローブ信号や各種コ
マンド信号を端末装置へ伝送するようになつてい
る。
この場合、従来は第２図に示すようにホスト装
置１０側に電源電圧入力用端子１２、信号出力端
子１４、アース端子１６が設けられ、端末装置４
０側には電源電圧出力端子１８、信号入力端子２
０、アース端子２２が設けられている。
置１０側に電源電圧入力用端子１２、信号出力端
子１４、アース端子１６が設けられ、端末装置４
０側には電源電圧出力端子１８、信号入力端子２
０、アース端子２２が設けられている。
信号出力端子１４にはTTL構成のインバータ
２４の出力側が接続されており信号入力端子２０
は信号入力回路２６の入力側と接続されている。
端子１４，２０間は信号伝送用のケーブル２８で
接続されており、ストローブ、コマンド信号等を
ホスト装置１０から端末装置４０へ伝送できるよ
うになつている。
２４の出力側が接続されており信号入力端子２０
は信号入力回路２６の入力側と接続されている。
端子１４，２０間は信号伝送用のケーブル２８で
接続されており、ストローブ、コマンド信号等を
ホスト装置１０から端末装置４０へ伝送できるよ
うになつている。
電源電圧出力端子１８は端末装置側で抵抗３０
を介して電源Ｅと接続されている。一方、電源電
圧入力端子１２はコンパレータ３２の一方の入力
端子と接続されている。このコンパレータ３２の
他方の入力端子には基準電圧EREFが入力されてい
る。
を介して電源Ｅと接続されている。一方、電源電
圧入力端子１２はコンパレータ３２の一方の入力
端子と接続されている。このコンパレータ３２の
他方の入力端子には基準電圧EREFが入力されてい
る。
そして、端子１２，１８間は電圧伝送用のケー
ブル３４で接続されている。尚、端末装置４０の
電源電圧Ｖは電源オン状態で例えば＋５ボルト、
オフ状態で０ボルトであるとする。従つて、EREF
を例えば2.5ボルトに設定すると、Ｖ＞EREFのと
きハイレベル“Ｈ”、Ｖ＜EREFのときローレベル
“Ｌ”をコンパレータ３２が出力するので、この
出力信号からホスト装置１０は端末装置４０の電
源投入状態を検知することができる。
ブル３４で接続されている。尚、端末装置４０の
電源電圧Ｖは電源オン状態で例えば＋５ボルト、
オフ状態で０ボルトであるとする。従つて、EREF
を例えば2.5ボルトに設定すると、Ｖ＞EREFのと
きハイレベル“Ｈ”、Ｖ＜EREFのときローレベル
“Ｌ”をコンパレータ３２が出力するので、この
出力信号からホスト装置１０は端末装置４０の電
源投入状態を検知することができる。
アース端子１６，２２はケーブル３６で接続さ
れている。
れている。
〈考案が解決しようとする問題点〉
ところが、上記従来技術ではストローブ信号や
コマンド信号を伝送するケーブル２８のほかに電
源電圧を伝送するケーブル３４が別個に必要にな
るため、ホスト装置と端末装置の距離が離れてい
る場合にはそれに応じてケーブルも長くせざるを
得ずコスト高を招来し、また多線化による耐ノイ
ズ特性の悪化が避けられないという問題があつ
た。
コマンド信号を伝送するケーブル２８のほかに電
源電圧を伝送するケーブル３４が別個に必要にな
るため、ホスト装置と端末装置の距離が離れてい
る場合にはそれに応じてケーブルも長くせざるを
得ずコスト高を招来し、また多線化による耐ノイ
ズ特性の悪化が避けられないという問題があつ
た。
以上から本考案の目的はコストが安く耐ノイズ
性の良好な信号伝送装置を提供することである。
性の良好な信号伝送装置を提供することである。
〈問題点を解決するための手段〉
第１図は本考案の実施例にかかる信号伝送装置
のブロツク図である。
のブロツク図である。
５０はホスト装置、５１はホスト本体、６０は
信号伝送装置、７０は端末装置、７１は端末例本
体である。
信号伝送装置、７０は端末装置、７１は端末例本
体である。
信号伝送装置６０において、５２はケーブル、
５４はTTL構成のオープンコレクタ回路、５６
は基準電圧EREFとケーブル電圧を比較するコンパ
レータ、５８は端末装置側電源Ｅとケーブル５２
を結すぶ抵抗、７８は信号入力回路である。
５４はTTL構成のオープンコレクタ回路、５６
は基準電圧EREFとケーブル電圧を比較するコンパ
レータ、５８は端末装置側電源Ｅとケーブル５２
を結すぶ抵抗、７８は信号入力回路である。
オープンコレクタ回路５４は出力段にオープン
コレクタトランジスタ６０を有している。
コレクタトランジスタ６０を有している。
〈作用〉
オープンコレクタ回路５４にホスト本体５１よ
りローレベル信号を印加すると該オープンコレク
タ回路５４の出力段のトランジスタ６０が非導通
（オフ）となる。このとき、トランジスタ６０の
コレクタ側にはケーブル５２、抵抗５８を介して
端末装置７０の電源電圧VCCがかかる。
りローレベル信号を印加すると該オープンコレク
タ回路５４の出力段のトランジスタ６０が非導通
（オフ）となる。このとき、トランジスタ６０の
コレクタ側にはケーブル５２、抵抗５８を介して
端末装置７０の電源電圧VCCがかかる。
このVCCはコンパレータ５６で、電源オン時の
VCC（＝５ボルト）より小さく設定された基準電
圧EREFと比較され、VCC＞EREFのときコンパレー
タ５６からハイレベル“Ｈ”の電源オン信号がホ
スト本体５１に出力される。
VCC（＝５ボルト）より小さく設定された基準電
圧EREFと比較され、VCC＞EREFのときコンパレー
タ５６からハイレベル“Ｈ”の電源オン信号がホ
スト本体５１に出力される。
一方、逆にVCC＜EREFのときにはコンパレータ
５６からローレベル“Ｌ”の電源オフ信号が出力
される。
５６からローレベル“Ｌ”の電源オフ信号が出力
される。
従つて、オープンコレクタ回路５４にローレベ
ル“L2”を印加すればコンパレータ５６の出力
で端末装置７０の電源オン／オフ状態を確認する
ことができる。
ル“L2”を印加すればコンパレータ５６の出力
で端末装置７０の電源オン／オフ状態を確認する
ことができる。
端末装置７０側の電源がオン状態のとき、オー
プンコレクタ回路５４に“Ｈ”，“Ｌ”の組み合わ
せから成る信号を印加すると、“Ｈ”が入力され
たときトランジスタ６０が導通（オン）してコレ
クタ側が“Ｌ”になり、逆に“Ｌ”が入力された
ときトランジスタ６０がオフになつてコレクタ側
がハイレベルになる。このため、ケーブル５２を
介して端末装置に論理が反転された状態で信号伝
達されることになる。
プンコレクタ回路５４に“Ｈ”，“Ｌ”の組み合わ
せから成る信号を印加すると、“Ｈ”が入力され
たときトランジスタ６０が導通（オン）してコレ
クタ側が“Ｌ”になり、逆に“Ｌ”が入力された
ときトランジスタ６０がオフになつてコレクタ側
がハイレベルになる。このため、ケーブル５２を
介して端末装置に論理が反転された状態で信号伝
達されることになる。
〈実施例〉
次に本考案の一実施例を第１図に従つて説明す
る。
る。
第１図はオフコンなどのホスト本体５１とプリ
ンタなどの端末側本体７１間に本考案にかかる信
号伝送装置６０を設けた場合の例である。
ンタなどの端末側本体７１間に本考案にかかる信
号伝送装置６０を設けた場合の例である。
信号伝送装置６０のホスト側は信号出力端子６
２とアース端子６４を有している。又、信号伝送
装置６０の端末装置側は信号入力端子７２とアー
ス端子７４を有している。端子６２と端子７２間
及び端子６４と端子７４間はそれぞれケーブル５
２，７６によつて接続されている。
２とアース端子６４を有している。又、信号伝送
装置６０の端末装置側は信号入力端子７２とアー
ス端子７４を有している。端子６２と端子７２間
及び端子６４と端子７４間はそれぞれケーブル５
２，７６によつて接続されている。
ホスト側においては、信号出力用のオープンコ
レクタ回路５４の出力端子が端子６２と接続され
ている。このオープンコレクタ回路５４はTTL
構成のIC回路より形成され、その出力段のトラ
ンジスタ６０のコレクタ側が電源オープンになつ
ている。このトランジスタ６０のエミツタ側はア
ース接続されている。オープンコレクタ回路５４
は、ホスト本体５１からデジタル信号を入力する
と該信号の論理を反転してケーブル５２を介して
端末装置７０へ信号伝送を行う。また、オープン
コレクタ回路５４はローレベル“Ｌ”の入力状態
のときトランジスタ６０をオフし、ケーブル５２
を介して端末装置７０側の電源電圧を入力可能と
する機能も有している。
レクタ回路５４の出力端子が端子６２と接続され
ている。このオープンコレクタ回路５４はTTL
構成のIC回路より形成され、その出力段のトラ
ンジスタ６０のコレクタ側が電源オープンになつ
ている。このトランジスタ６０のエミツタ側はア
ース接続されている。オープンコレクタ回路５４
は、ホスト本体５１からデジタル信号を入力する
と該信号の論理を反転してケーブル５２を介して
端末装置７０へ信号伝送を行う。また、オープン
コレクタ回路５４はローレベル“Ｌ”の入力状態
のときトランジスタ６０をオフし、ケーブル５２
を介して端末装置７０側の電源電圧を入力可能と
する機能も有している。
オープンコレクタ回路５４の出力側はコンパレ
ータ５６の一方の入力端子と接続されている。こ
のコンパレータ５６の他方の入力端子には所定の
基準電圧EREFが入力されている。例えば端末装置
７０側の電源電圧VCCが電源オンのとき＋5V、オ
フのとき0Vとなる場合、EREFは例えば2.5Vに設
定されている。
ータ５６の一方の入力端子と接続されている。こ
のコンパレータ５６の他方の入力端子には所定の
基準電圧EREFが入力されている。例えば端末装置
７０側の電源電圧VCCが電源オンのとき＋5V、オ
フのとき0Vとなる場合、EREFは例えば2.5Vに設
定されている。
コンパレータ５６はVCC＞EREFのとき“Ｈ”、
VCC＜EREFのとき“Ｌ”を出力する。このコンパ
レータ５６は端末装置７０の電源投入の有無を検
出するためのものである。
VCC＜EREFのとき“Ｌ”を出力する。このコンパ
レータ５６は端末装置７０の電源投入の有無を検
出するためのものである。
一方、端末装置７０側では端子７２が信号入力
回路７８の入力側と接続されている。この信号入
力回路７８は、ホスト装置５０からケーブル５２
を介して送られる反転論理の信号を元の論理に戻
す機能を有している。
回路７８の入力側と接続されている。この信号入
力回路７８は、ホスト装置５０からケーブル５２
を介して送られる反転論理の信号を元の論理に戻
す機能を有している。
又、信号入力回路７８の入力側は抵抗５８を介
して端末装置側の電源Ｅと接続されている。
して端末装置側の電源Ｅと接続されている。
次に上記実施例の全体的な作用を説明する。
ホスト本体５１が端末装置７０をコントロール
しようとする場合、はじめに端末装置の電源オ
ン／オフ状態の確認を行う。
しようとする場合、はじめに端末装置の電源オ
ン／オフ状態の確認を行う。
このためホスト本体５１はオープンコレクタ回
路５４にローレベル“Ｌ”を印加する。これによ
りオープンコレクタ回路５４の出力段のトランジ
スタ６０がオフする。このとき、トランジスタ６
０のコレクタ側にはケーブル５２、抵抗５８を介
して端末装置７０の電源電圧VCCがかかる。
路５４にローレベル“Ｌ”を印加する。これによ
りオープンコレクタ回路５４の出力段のトランジ
スタ６０がオフする。このとき、トランジスタ６
０のコレクタ側にはケーブル５２、抵抗５８を介
して端末装置７０の電源電圧VCCがかかる。
このVCCはコンパレータ５６で、電源オン時の
VCC（＝5V）より低く設定されたEREFと比較され、
VCC＞EREFのときコンパレータ５６からハイレベ
ル“Ｈ”の電源オン信号が出力される。
VCC（＝5V）より低く設定されたEREFと比較され、
VCC＞EREFのときコンパレータ５６からハイレベ
ル“Ｈ”の電源オン信号が出力される。
この電源オン信号を受けてホスト本体５１は次
にストローブ信号あるいは各種コマンド信号の信
号伝送処理に移る。
にストローブ信号あるいは各種コマンド信号の信
号伝送処理に移る。
逆に、VCC＜EREFで、コンパレータ５６から電
源オフ信号が入力された場合にはホスト本体５１
は端末装置７０に信号を伝送しない。
源オフ信号が入力された場合にはホスト本体５１
は端末装置７０に信号を伝送しない。
さて、端末装置７０側の電源がオン状態のと
き、ホスト本体５１がオープンコレクタ回路５４
に“Ｈ”，“Ｌ”の組み合わせから成る信号を印加
すると、“Ｈ”入力されたときトランジスタ６０
がオンしてコレクタ側がローレベルになり、逆に
“Ｌ”が入力されたときトランジスタ６０がオフ
になつてコレクタ側がハイレベルになる。このた
め、ケーブル５２を介して端末装置に論理が反転
された形で信号伝送が行われる。
き、ホスト本体５１がオープンコレクタ回路５４
に“Ｈ”，“Ｌ”の組み合わせから成る信号を印加
すると、“Ｈ”入力されたときトランジスタ６０
がオンしてコレクタ側がローレベルになり、逆に
“Ｌ”が入力されたときトランジスタ６０がオフ
になつてコレクタ側がハイレベルになる。このた
め、ケーブル５２を介して端末装置に論理が反転
された形で信号伝送が行われる。
この信号は信号入力回路７８で元の論理状態に
戻され端末側本体７１に導かれて所定の制御動作
等を行わせる。
戻され端末側本体７１に導かれて所定の制御動作
等を行わせる。
尚、上記実施例ではホスト装置５０にオープン
コレクタ回路を設けた場合について説明したが本
考案は何らこれに限るものではなくFET構成の
オープンドレイン回路を用いて構成してもよいこ
とは勿論である。
コレクタ回路を設けた場合について説明したが本
考案は何らこれに限るものではなくFET構成の
オープンドレイン回路を用いて構成してもよいこ
とは勿論である。
〈考案の効果〉
以上説明したように本考案によれば信号伝送用
のケーブルを用いて端末装置の電源電圧を送るよ
うにしたので電源検知用のケーブルを不要とする
ことができ、ホスト装置と端末装置間が離れてい
る場合でもケーブルコストを安くすることができ
又、ケーブル本数を減らして耐ノイズ性の向上を
図ることができる。
のケーブルを用いて端末装置の電源電圧を送るよ
うにしたので電源検知用のケーブルを不要とする
ことができ、ホスト装置と端末装置間が離れてい
る場合でもケーブルコストを安くすることができ
又、ケーブル本数を減らして耐ノイズ性の向上を
図ることができる。
又、低価格の端末装置など電源検知用端子を有
しない場合でも端末装置側に若干手を加えるだけ
で電源オン／オフ検知が可能になる。
しない場合でも端末装置側に若干手を加えるだけ
で電源オン／オフ検知が可能になる。
第１図は本考案にかかる信号伝送装置のブロツ
ク図、第２図は従来例を示す回路ブロツク図であ
る。 ５０……ホスト装置、５１……ホスト本体、５
２……ケーブル、５４……オープンコレクタ回
路、５６……コンパレータ、６０……信号伝送装
置、７０……端末装置、７１……端末側本体、７
８……信号入力回路。
ク図、第２図は従来例を示す回路ブロツク図であ
る。 ５０……ホスト装置、５１……ホスト本体、５
２……ケーブル、５４……オープンコレクタ回
路、５６……コンパレータ、６０……信号伝送装
置、７０……端末装置、７１……端末側本体、７
８……信号入力回路。
Claims (1)
- 【実用新案登録請求の範囲】 (1) ホスト装置と端末装置間を信号伝送線で接続
して信号の授受を行う信号伝送装置において、 ホスト本体からの信号に応じてオン／オフす
る出力素子を有する信号出力回路をホスト側に
設け、 該出力素子の出力端子を信号伝送線を介して
端末装置側に設けた信号入力回路に接続すると
共に、該出力素子を端末装置側に設けた抵抗を
介して端末装置の電源に接続し、 更に該出力端子をホスト側に設けた電圧検出
回路に接続してなることを特徴とする信号伝送
装置。 (2) 前記出力素子はオープンコレクタトランジス
タであることを特徴とする実用新案登録請求の
範囲第(1)項記載の信号伝送装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14746485U JPH057632Y2 (ja) | 1985-09-27 | 1985-09-27 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14746485U JPH057632Y2 (ja) | 1985-09-27 | 1985-09-27 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6257842U JPS6257842U (ja) | 1987-04-10 |
| JPH057632Y2 true JPH057632Y2 (ja) | 1993-02-25 |
Family
ID=31060848
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14746485U Expired - Lifetime JPH057632Y2 (ja) | 1985-09-27 | 1985-09-27 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH057632Y2 (ja) |
-
1985
- 1985-09-27 JP JP14746485U patent/JPH057632Y2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6257842U (ja) | 1987-04-10 |
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