JPH0553541A - 表示装置 - Google Patents
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- JPH0553541A JPH0553541A JP3240257A JP24025791A JPH0553541A JP H0553541 A JPH0553541 A JP H0553541A JP 3240257 A JP3240257 A JP 3240257A JP 24025791 A JP24025791 A JP 24025791A JP H0553541 A JPH0553541 A JP H0553541A
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- Measuring Pulse, Heart Rate, Blood Pressure Or Blood Flow (AREA)
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Abstract
(57)【要約】
【目的】 大画面、高精細な液晶表示装置の消費電力を
より低くする。 【構成】 走査信号電極と情報信号電極が互いにマトリ
クス状に配置され、その間にメモリ性を有する液晶が挟
持されて構成された表示パネル１８と、走査信号電極に
走査信号を印加し、情報信号電極に情報信号を印加する
駆動手段１５，１７と、前記表示パネルで表示すべき画
像情報を記憶する画像情報記憶手段９と、前記画像情報
記憶手段への画像情報に変更が行なわれたことを検出す
る手段７と、前記画像情報に変更が行なわれたことを検
出する期間の時間を決定する手段７と、前記検出結果に
応じて前記駆動手段を制御する駆動制御手段１２とを有
する。
より低くする。 【構成】 走査信号電極と情報信号電極が互いにマトリ
クス状に配置され、その間にメモリ性を有する液晶が挟
持されて構成された表示パネル１８と、走査信号電極に
走査信号を印加し、情報信号電極に情報信号を印加する
駆動手段１５，１７と、前記表示パネルで表示すべき画
像情報を記憶する画像情報記憶手段９と、前記画像情報
記憶手段への画像情報に変更が行なわれたことを検出す
る手段７と、前記画像情報に変更が行なわれたことを検
出する期間の時間を決定する手段７と、前記検出結果に
応じて前記駆動手段を制御する駆動制御手段１２とを有
する。
Description
【０００１】
【産業上の利用分野】本発明は、表示装置の制御方法に
関し、特に走査信号線と情報信号線をマトリクス状に配
し、走査信号および情報信号を各々印加して駆動する液
晶表示装置において、該液晶がメモリ性を有している表
示装置を用いて映像情報を表示する際に好適な制御方法
に関するものである。
関し、特に走査信号線と情報信号線をマトリクス状に配
し、走査信号および情報信号を各々印加して駆動する液
晶表示装置において、該液晶がメモリ性を有している表
示装置を用いて映像情報を表示する際に好適な制御方法
に関するものである。
【０００２】
【従来の技術】従来よりコンピュータ端末表示装置とし
ては、リフレッシュスキャン型ＣＲＴが主に使用されて
おり、フリッカ（画面のちらつき）防止の点から６０Ｈ
ｚ以上のフレーム周波数が採用され、また画面内情報の
移動表示（マウス、アイコン等の移動）の視認性を良く
する上でノン・インターレース方式が採用されている。
このため、表示分解能が高くなればなるほど高パワーを
要し、駆動制御部も大型化してコスト高となっている。
なお、参考までに述べると、ＴＶでは動画表示と駆動制
御システムの簡便化の点からインターレース方式で、フ
ィールド周波数６０Ｈｚ、フレーム周波数３０Ｈｚとな
っている。
ては、リフレッシュスキャン型ＣＲＴが主に使用されて
おり、フリッカ（画面のちらつき）防止の点から６０Ｈ
ｚ以上のフレーム周波数が採用され、また画面内情報の
移動表示（マウス、アイコン等の移動）の視認性を良く
する上でノン・インターレース方式が採用されている。
このため、表示分解能が高くなればなるほど高パワーを
要し、駆動制御部も大型化してコスト高となっている。
なお、参考までに述べると、ＴＶでは動画表示と駆動制
御システムの簡便化の点からインターレース方式で、フ
ィールド周波数６０Ｈｚ、フレーム周波数３０Ｈｚとな
っている。
【０００３】近年、コンピュータ端末表示装置として
は、前記したＣＲＴの大型・高パワー化に対する不便さ
から、フラットパネルディスプレイに注目が集まってい
る。
は、前記したＣＲＴの大型・高パワー化に対する不便さ
から、フラットパネルディスプレイに注目が集まってい
る。
【０００４】現在、フラットパネルディスプレイとして
は、ツイストネマチック液晶の高時分割方式（ＳＴ
Ｎ）、その変形である白黒表示を狙った方式（ＮＴ
Ｎ）、またはプラズマ表示方式などいくつかの方式があ
る。しかし、これらの各方式のフラットパネルディスプ
レイは、いずれもＣＲＴと同一の画像データ転送方式を
採り、その画面更新方式もフレーム周波数を６０Ｈｚ以
上としたノン・インターレース方式を採る。この理由
は、これらの表示パネルが表示原理上、メモリ性を持っ
ていないため、フリッカ防止の点からスレーム周波数６
０Ｈｚ以上のリフレッシュサイクルが必要であることに
よる。また、ツイストネマチック液晶の各画素にスイッ
チングトランジスタもしくは非線形素子を作り込む方式
（ＴＦＴ、ＭＩＭ、ＴＦＤなど）においても、画像情報
を保持しておけるのは、最大でも１フレーム以内である
ため、上記各方式同様に、６０Ｈｚ以上のリフレッシュ
サイクルを必要とする。
は、ツイストネマチック液晶の高時分割方式（ＳＴ
Ｎ）、その変形である白黒表示を狙った方式（ＮＴ
Ｎ）、またはプラズマ表示方式などいくつかの方式があ
る。しかし、これらの各方式のフラットパネルディスプ
レイは、いずれもＣＲＴと同一の画像データ転送方式を
採り、その画面更新方式もフレーム周波数を６０Ｈｚ以
上としたノン・インターレース方式を採る。この理由
は、これらの表示パネルが表示原理上、メモリ性を持っ
ていないため、フリッカ防止の点からスレーム周波数６
０Ｈｚ以上のリフレッシュサイクルが必要であることに
よる。また、ツイストネマチック液晶の各画素にスイッ
チングトランジスタもしくは非線形素子を作り込む方式
（ＴＦＴ、ＭＩＭ、ＴＦＤなど）においても、画像情報
を保持しておけるのは、最大でも１フレーム以内である
ため、上記各方式同様に、６０Ｈｚ以上のリフレッシュ
サイクルを必要とする。
【０００５】一方、強誘電性液晶表示装置は、一度表示
した画像情報を保持できる（メモリ性）という特徴を有
しているため、上述の各種表示装置をはるかにしのぐ大
画面かつ高精細な表示が可能である。しかし、駆動し得
るフレーム周波数が低いため、マン・マシンインターフ
ェイスの表示装置に対応するためには、メモリ性を活か
した部分書き換え走査（画像情報の変化した走査線のみ
を走査（駆動）する）方式が必要である。この部分書換
走査方式に関しては、例えば神辺らの米国特許第４，６
６５，５６１号公報などで提案された方式を基に、本発
明者らが特開昭６３−２８５１４１号公報、あるいは特
開昭６３−６５４９４号公報等に提案した、メモリ性を
持った表示装置において高解像度表示を行なうための
「低フレーム周波数駆動（マルチインターレース走査）
＋部分書換走査」なる方法が実現している。
した画像情報を保持できる（メモリ性）という特徴を有
しているため、上述の各種表示装置をはるかにしのぐ大
画面かつ高精細な表示が可能である。しかし、駆動し得
るフレーム周波数が低いため、マン・マシンインターフ
ェイスの表示装置に対応するためには、メモリ性を活か
した部分書き換え走査（画像情報の変化した走査線のみ
を走査（駆動）する）方式が必要である。この部分書換
走査方式に関しては、例えば神辺らの米国特許第４，６
６５，５６１号公報などで提案された方式を基に、本発
明者らが特開昭６３−２８５１４１号公報、あるいは特
開昭６３−６５４９４号公報等に提案した、メモリ性を
持った表示装置において高解像度表示を行なうための
「低フレーム周波数駆動（マルチインターレース走査）
＋部分書換走査」なる方法が実現している。
【０００６】
【発明が解決しようとする課題】ところで、これまでの
強誘電性液晶表示素子の制御方法においては、画像情報
に変更があったとき部分書き換え走査を行ない、変更の
ないときにはマルチインターレース等による全画面リフ
レッシュ走査を行なっている。このため、例えばオペレ
ータが席を立ったりして長時間の間キー入力やマウスの
操作が行なわれないような状態であっても、表示パネル
は、マルチインターレース等によるリフレッシュ走査を
連続して行なっていることになる。
強誘電性液晶表示素子の制御方法においては、画像情報
に変更があったとき部分書き換え走査を行ない、変更の
ないときにはマルチインターレース等による全画面リフ
レッシュ走査を行なっている。このため、例えばオペレ
ータが席を立ったりして長時間の間キー入力やマウスの
操作が行なわれないような状態であっても、表示パネル
は、マルチインターレース等によるリフレッシュ走査を
連続して行なっていることになる。
【０００７】前述のように、強誘電性液晶表示装置は、
その大きな特徴の１つとしてメモリ性を有しており、基
本的に画像情報に変更がない場合には、リフレッシュ走
査（駆動）を行なわなくても表示状態を保持することが
できる。しかしながら、従来の駆動制御方法では、長時
間の間キー入力やマウスの操作が行なわれないような状
態であっても、表示パネルの走査（駆動）を止めるこ
と、すなわちメモリ状態にすることによって、表示内容
を保持しておくような制御はできなかった。
その大きな特徴の１つとしてメモリ性を有しており、基
本的に画像情報に変更がない場合には、リフレッシュ走
査（駆動）を行なわなくても表示状態を保持することが
できる。しかしながら、従来の駆動制御方法では、長時
間の間キー入力やマウスの操作が行なわれないような状
態であっても、表示パネルの走査（駆動）を止めるこ
と、すなわちメモリ状態にすることによって、表示内容
を保持しておくような制御はできなかった。
【０００８】本発明は、上述の従来例における問題点に
鑑みてなされたもので、大画面、高精細で、消費電力の
より低く、より信頼性の高い液晶表示装置を提供するこ
とを目的とする。
鑑みてなされたもので、大画面、高精細で、消費電力の
より低く、より信頼性の高い液晶表示装置を提供するこ
とを目的とする。
【０００９】
【課題を解決するための手段】上記の目的を達成するた
め、本発明の表示装置は、走査信号電極と情報信号電極
が互いにマトリクス状に配置され、その間にメモリ性を
有する液晶が挟持されて構成された表示パネルと、走査
信号電極に走査信号を印加し、情報信号電極に情報信号
を印加する駆動手段と、前記表示パネルで表示すべき画
像情報を記憶する画像情報記憶手段と、前記画像情報記
憶手段への画像情報に変更が行なわれたことを検出する
手段と、前記画像情報に変更が行なわれたことを検出す
る期間の時間を決定する手段と、前記検出結果に応じて
前記駆動手段を制御する駆動制御手段とを有することを
特徴とする。
め、本発明の表示装置は、走査信号電極と情報信号電極
が互いにマトリクス状に配置され、その間にメモリ性を
有する液晶が挟持されて構成された表示パネルと、走査
信号電極に走査信号を印加し、情報信号電極に情報信号
を印加する駆動手段と、前記表示パネルで表示すべき画
像情報を記憶する画像情報記憶手段と、前記画像情報記
憶手段への画像情報に変更が行なわれたことを検出する
手段と、前記画像情報に変更が行なわれたことを検出す
る期間の時間を決定する手段と、前記検出結果に応じて
前記駆動手段を制御する駆動制御手段とを有することを
特徴とする。
【００１０】前記駆動制御手段は、前記検出期間の間前
記画像情報に変更がない場合、例えば前記走査電極およ
び情報電極への印加電圧を等電位に制御することにより
前記表示パネルの走査を停止するか、あるいは前記走査
電極および情報電極をハイ・インピーダンス状態に制御
することにより前記表示パネルの駆動を停止するよう
に、前記駆動手段を制御する。
記画像情報に変更がない場合、例えば前記走査電極およ
び情報電極への印加電圧を等電位に制御することにより
前記表示パネルの走査を停止するか、あるいは前記走査
電極および情報電極をハイ・インピーダンス状態に制御
することにより前記表示パネルの駆動を停止するよう
に、前記駆動手段を制御する。
【００１１】また、メモリ性を有する液晶としては、強
誘電性液晶（ＦＬＣ）を例示することができる。
誘電性液晶（ＦＬＣ）を例示することができる。
【００１２】
【作用】本発明においては、メモリ性を有する液晶表示
パネルを用いて映像情報を表示するため、基本的には前
記の「低フレーム周波数駆動（マルチインターレース走
査）＋部分書換走査」なる駆動方法を採用するととも
に、所定の期間画像情報に変更がないときは表示パネル
のリフレシュを停止するように駆動手段を制御してい
る。このため、リフレシュのための電力が不要となり省
電力化を図ることができる。
パネルを用いて映像情報を表示するため、基本的には前
記の「低フレーム周波数駆動（マルチインターレース走
査）＋部分書換走査」なる駆動方法を採用するととも
に、所定の期間画像情報に変更がないときは表示パネル
のリフレシュを停止するように駆動手段を制御してい
る。このため、リフレシュのための電力が不要となり省
電力化を図ることができる。
【００１３】
【実施例】図１は本発明の一実施例を示すブロック図で
ある。同図において、１はシステムバス、４０はＦＬＣ
ディスプレイ制御回路、５０はＦＬＣディスプレイユニ
ットである。
ある。同図において、１はシステムバス、４０はＦＬＣ
ディスプレイ制御回路、５０はＦＬＣディスプレイユニ
ットである。
【００１４】ＦＬＣディスプレイ制御回路４０におい
て、２はアドレスやアクセスの要求信号および応答信号
等のドライバ、３はデータバッファ、４はホストＣＰＵ
と制御回路内のプロセッサとのインターフェイス回路で
あるところのホストインターフェイス、５はＶＧＡ（Ｖ
ｉｄｅｏ Ｇｒａｐｈｉｃｓ Ａｒｒａｙ）のレジスタ
等をサポートする専用ＬＳＩであるＶＧＡサポートチッ
プ、６は描画やデータ転送を行なうグラフィックスプロ
セッサ、１０はグラフィックスプロセッサ用のプログラ
ムを記憶するダイナミックＲＡＭ等により構成されるプ
ログラムメモリ、９はビデオメモリ、７はビデオメモリ
９へのアクセス信号によりリセットされるアクセスサン
プリングカウンタ、８は表示情報を記憶するビデメモリ
９への制御信号を発生するメモリコントローラ、１１は
ＦＬＣディスプレイユニット５０との間で、ビデオデー
タや同期信号等のやり取りを行なうビデオインターフェ
イスである。２０はアドレスやアクセスの要求信号およ
び応答信号等であり、２１はＶＧＡサポートチップ５や
グラフィックスプロセッサ６へのアクセス信号、２３は
グラフィックスプロセッサ６とプログラムメモリ１０間
のデータ、２２はデータバッファ３とＶＧＡサポートチ
ップ５やグラフィックスプロセッサ６およびビデオメモ
リ９間のデータ、２４はＶＧＡサポートチップ５からメ
モリコントローラ８に対するビデオメモリ９へのアクセ
ス要求、２５はグラフィックスプロセッサ６からメモリ
コントローラ８に対するビデオメモリ９へのアクセス要
求、２６はビデオメモリ９への制御信号、２７はビデオ
メモリ９から読み出された表示データ、２８はＦＬＣデ
ィスプレイユニットへ送出するデータ、２９はＦＬＣデ
ィスプレイユニット５０との間の同期信号や制御信号、
３０は同期信号や制御信号、３１はアクセスサンプリン
グカウンタ７に入力される同期信号、３２はビデオメモ
リ９に対して一定時間以上アクセスがなかったことの通
知信号である。
て、２はアドレスやアクセスの要求信号および応答信号
等のドライバ、３はデータバッファ、４はホストＣＰＵ
と制御回路内のプロセッサとのインターフェイス回路で
あるところのホストインターフェイス、５はＶＧＡ（Ｖ
ｉｄｅｏ Ｇｒａｐｈｉｃｓ Ａｒｒａｙ）のレジスタ
等をサポートする専用ＬＳＩであるＶＧＡサポートチッ
プ、６は描画やデータ転送を行なうグラフィックスプロ
セッサ、１０はグラフィックスプロセッサ用のプログラ
ムを記憶するダイナミックＲＡＭ等により構成されるプ
ログラムメモリ、９はビデオメモリ、７はビデオメモリ
９へのアクセス信号によりリセットされるアクセスサン
プリングカウンタ、８は表示情報を記憶するビデメモリ
９への制御信号を発生するメモリコントローラ、１１は
ＦＬＣディスプレイユニット５０との間で、ビデオデー
タや同期信号等のやり取りを行なうビデオインターフェ
イスである。２０はアドレスやアクセスの要求信号およ
び応答信号等であり、２１はＶＧＡサポートチップ５や
グラフィックスプロセッサ６へのアクセス信号、２３は
グラフィックスプロセッサ６とプログラムメモリ１０間
のデータ、２２はデータバッファ３とＶＧＡサポートチ
ップ５やグラフィックスプロセッサ６およびビデオメモ
リ９間のデータ、２４はＶＧＡサポートチップ５からメ
モリコントローラ８に対するビデオメモリ９へのアクセ
ス要求、２５はグラフィックスプロセッサ６からメモリ
コントローラ８に対するビデオメモリ９へのアクセス要
求、２６はビデオメモリ９への制御信号、２７はビデオ
メモリ９から読み出された表示データ、２８はＦＬＣデ
ィスプレイユニットへ送出するデータ、２９はＦＬＣデ
ィスプレイユニット５０との間の同期信号や制御信号、
３０は同期信号や制御信号、３１はアクセスサンプリン
グカウンタ７に入力される同期信号、３２はビデオメモ
リ９に対して一定時間以上アクセスがなかったことの通
知信号である。
【００１５】ＦＬＣディスプレイユニット５０におい
て、１２はＦＬＣディスプレイ制御回路４０とのインタ
ーフェイスや、セグメントおよびコモンの両ドライバの
コントロール等、ディスプレイユニット５０全体の制御
を行なうディスプレイコントローラ、１３はディスプレ
イコントローラ１２からのビデオデータを１ライン分転
送するシフトレジスタ、１４は１ライン分のビデオデー
タを記憶するラインメモリ、１５はラインメモリにある
ビデオデータに従って表示パネル１８の情報電極に所定
のタイミングで所定の駆動波形を出力するセグメントド
ライバ、１８は強誘電性液晶（ＦＬＣ）を用いた表示パ
ネル、１６はディスプレイコントローラ１２からの走査
線アドレスデータに従って１本の走査線を選択するライ
ンアドレスデコーダ、１７は選択された走査線（走査電
極）に所定のタイミングで所定の駆動波形を出力するコ
モンドライバ、３４はビデオデータ、３５は走査線アド
レスデータ、３３および３６は、それぞれセグメントお
よびコモンの各ドライバ１５，１７への制御線である。
て、１２はＦＬＣディスプレイ制御回路４０とのインタ
ーフェイスや、セグメントおよびコモンの両ドライバの
コントロール等、ディスプレイユニット５０全体の制御
を行なうディスプレイコントローラ、１３はディスプレ
イコントローラ１２からのビデオデータを１ライン分転
送するシフトレジスタ、１４は１ライン分のビデオデー
タを記憶するラインメモリ、１５はラインメモリにある
ビデオデータに従って表示パネル１８の情報電極に所定
のタイミングで所定の駆動波形を出力するセグメントド
ライバ、１８は強誘電性液晶（ＦＬＣ）を用いた表示パ
ネル、１６はディスプレイコントローラ１２からの走査
線アドレスデータに従って１本の走査線を選択するライ
ンアドレスデコーダ、１７は選択された走査線（走査電
極）に所定のタイミングで所定の駆動波形を出力するコ
モンドライバ、３４はビデオデータ、３５は走査線アド
レスデータ、３３および３６は、それぞれセグメントお
よびコモンの各ドライバ１５，１７への制御線である。
【００１６】次に、図１に基づいて、本発明の実施例に
おける画面表示の基本動作について説明する。
おける画面表示の基本動作について説明する。
【００１７】 ホストＣＰＵが表示画面の更新を行な
う場合（オペレータが通常の操作を行なっている場合） 一般のＣＲＴ制御回路ではホストＣＰＵがビデオメモリ
を直接ランダムアクセスできるのに対し、本発明の実施
例におけるＦＬＣディスプレイ制御回路においてはホス
トＣＰＵが直接ビデオメモリをランダムアクセスでき
ず、グラフィックスプロセッサ６を介して表示データの
書換等を行なう。例えば直線を表示するようなケースで
は、ホストＣＰＵはグラフィックスプロセッサ６に対し
て直線描画コマンドを発行し始点終点等の必要な情報を
与える。グラフィックスプロセッサ６は与えられた情報
に従ってアクセスアドレス等を決定し、ビデオメモリ９
をアクセスする。また、他の図形や文字等の表示や、Ｖ
ＧＡ関連のコマンドも同様にホストＣＰＵからの命令に
よって（ＶＧＡの場合は、ＢＩＯＳコマンドとして）、
それぞれグラフィックスプロセッサ６やＶＧＡサポート
チップ５がビデオメモリ９をアクセスすることによって
実行される。
う場合（オペレータが通常の操作を行なっている場合） 一般のＣＲＴ制御回路ではホストＣＰＵがビデオメモリ
を直接ランダムアクセスできるのに対し、本発明の実施
例におけるＦＬＣディスプレイ制御回路においてはホス
トＣＰＵが直接ビデオメモリをランダムアクセスでき
ず、グラフィックスプロセッサ６を介して表示データの
書換等を行なう。例えば直線を表示するようなケースで
は、ホストＣＰＵはグラフィックスプロセッサ６に対し
て直線描画コマンドを発行し始点終点等の必要な情報を
与える。グラフィックスプロセッサ６は与えられた情報
に従ってアクセスアドレス等を決定し、ビデオメモリ９
をアクセスする。また、他の図形や文字等の表示や、Ｖ
ＧＡ関連のコマンドも同様にホストＣＰＵからの命令に
よって（ＶＧＡの場合は、ＢＩＯＳコマンドとして）、
それぞれグラフィックスプロセッサ６やＶＧＡサポート
チップ５がビデオメモリ９をアクセスすることによって
実行される。
【００１８】アクセスサンプリングカウンタ７はビデオ
メモリ９へのアクセス状態を監視し、ある定められた時
間以上ビデオメモリ９へにアクセス（書き込み）が行な
われないとき、その通知信号３２をＦＬＣディスプレイ
ユニット５０に出力する。グラフィックスプロセッサ６
やＶＧＡサポートチップ５がビデオメモリ９に対してア
クセスするとアクセスサンプリングカウンタ７はリセッ
トされ、また最初から計数を始める。の場合（オペレ
ータが通常の操作を行なっている場合）は、ビデオメモ
リ９に対するアクセスが連続して行なわれているため、
アクセスサンプリングカウンタ７から通知信号３２が出
力されることはない。
メモリ９へのアクセス状態を監視し、ある定められた時
間以上ビデオメモリ９へにアクセス（書き込み）が行な
われないとき、その通知信号３２をＦＬＣディスプレイ
ユニット５０に出力する。グラフィックスプロセッサ６
やＶＧＡサポートチップ５がビデオメモリ９に対してア
クセスするとアクセスサンプリングカウンタ７はリセッ
トされ、また最初から計数を始める。の場合（オペレ
ータが通常の操作を行なっている場合）は、ビデオメモ
リ９に対するアクセスが連続して行なわれているため、
アクセスサンプリングカウンタ７から通知信号３２が出
力されることはない。
【００１９】ビデオメモリ９内の表示データはグラフィ
ックスプロセッサ６からの指示によって１ラインずつビ
デオメモリ９から読み出され、走査線アドレスデータ
（図１の制御回路側には図示せず）と共にビデオインタ
ーフェイス１１を介してＦＬＣディスプレイユニット５
０に出力される。このとき、グラフィックスプロセッサ
６が与えられた描画コマンドから応答性の要求されるデ
ータすなわち部分書換の必要な画像情報かどうかの判断
を行なうか、もしくはホストＣＰＵがグラフィックスプ
ロセッサ６に対して部分書換の必要なデータかどうかの
識別情報を与えるかのどちらかの方法によって描画事象
の判断を行ない、ＦＬＣディスプレイにとって表示の応
答性が要求される表示データを優先的に転送する。ＦＬ
Ｃディスプレイユニット５０内のディスプレイコントロ
ーラ１２はＦＬＣディスプレイ制御回路４０からの走査
線アドレスデータと表示データ（ビデオデータ）を受け
取り、走査線アドレスデータ３５は走査電極駆動回路
（１３〜１５）のラインアドレスデコーダ１６に、ビデ
オデータ３４は情報電極駆動回路（１６〜１７）のシフ
トレジスタ１３にそれぞれ転送する。走査電極駆動回路
のラインアドレスデコーダ１６は走査線アドレスデータ
３５に基づいてある１本の走査線を選択する。コモンド
ライバ１７は選択された走査線（走査電極）に予め定め
られた駆動波形を選択期間の間（１水平走査期間）出力
する。一方、情報電極駆動回路のシフトレジスタ１３は
１ライン分のビデオデータのシフトを終了すると、その
ビデオデータをラインメモリ１４に転送し、１水平走査
期間の間保持する。セグメントドライバ１５はラインメ
モリ１４のビデオデータに応じた駆動波形をコモンドラ
イバ１７の選択期間と同期して出力する。このように、
通常操作時の表示パネルへの書き込み動作は一般的に広
く知られている線順次走査によって、カーソル移動、文
字入力、画面スクロール等、マン・マシンインターフェ
イスとして特に応答性を要求される描画情報に関しては
部分書き換え走査が行なわれ、それ以外の描画情報はマ
ルチインターフェイス等による全画面リフレッシュ走査
が行なわれる。
ックスプロセッサ６からの指示によって１ラインずつビ
デオメモリ９から読み出され、走査線アドレスデータ
（図１の制御回路側には図示せず）と共にビデオインタ
ーフェイス１１を介してＦＬＣディスプレイユニット５
０に出力される。このとき、グラフィックスプロセッサ
６が与えられた描画コマンドから応答性の要求されるデ
ータすなわち部分書換の必要な画像情報かどうかの判断
を行なうか、もしくはホストＣＰＵがグラフィックスプ
ロセッサ６に対して部分書換の必要なデータかどうかの
識別情報を与えるかのどちらかの方法によって描画事象
の判断を行ない、ＦＬＣディスプレイにとって表示の応
答性が要求される表示データを優先的に転送する。ＦＬ
Ｃディスプレイユニット５０内のディスプレイコントロ
ーラ１２はＦＬＣディスプレイ制御回路４０からの走査
線アドレスデータと表示データ（ビデオデータ）を受け
取り、走査線アドレスデータ３５は走査電極駆動回路
（１３〜１５）のラインアドレスデコーダ１６に、ビデ
オデータ３４は情報電極駆動回路（１６〜１７）のシフ
トレジスタ１３にそれぞれ転送する。走査電極駆動回路
のラインアドレスデコーダ１６は走査線アドレスデータ
３５に基づいてある１本の走査線を選択する。コモンド
ライバ１７は選択された走査線（走査電極）に予め定め
られた駆動波形を選択期間の間（１水平走査期間）出力
する。一方、情報電極駆動回路のシフトレジスタ１３は
１ライン分のビデオデータのシフトを終了すると、その
ビデオデータをラインメモリ１４に転送し、１水平走査
期間の間保持する。セグメントドライバ１５はラインメ
モリ１４のビデオデータに応じた駆動波形をコモンドラ
イバ１７の選択期間と同期して出力する。このように、
通常操作時の表示パネルへの書き込み動作は一般的に広
く知られている線順次走査によって、カーソル移動、文
字入力、画面スクロール等、マン・マシンインターフェ
イスとして特に応答性を要求される描画情報に関しては
部分書き換え走査が行なわれ、それ以外の描画情報はマ
ルチインターフェイス等による全画面リフレッシュ走査
が行なわれる。
【００２０】 ホストＣＰＵが一定時間以上表示画面
の更新を行なわない場合 この場合は、アクセスサンプリングカウンタ７からの通
知信号３２によってＦＬＣディスプレイパネルをメモリ
状態に制御する。アクセスサンプリングカウンタ７はビ
デオメモリ９へのアクセス（書き込み）信号をリセット
（もしくはプリセット）信号とし、ＦＬＣディスプレイ
ユニット５０からの同期信号３１（例えば、水平同期信
号）をクロックとするカウンタであり、本カウンタのオ
ーバーフロー（キャリー）信号をビデオメモリ９に対し
て一定時間以上アクセスのなかったことの通知信号３２
としている。実際には同期信号３１（水平同期信号）か
ら１フレーム時間（例えば、走査線数を１０２４本とす
ると水平同期信号×１０２４）を計数し、その６４分周
したものをクロックとして８ビットカウンタ（アクセス
サンプリングカウンタ）に入力している。ＦＬＣディス
プレイユニット５０の標準的な水平走査時間を仮に１０
０μｓとするとクロックの周期は約６．５秒（１００μ
ｓ×１０２４×６４）となり、検出時間は、カウンタの
プリセットの値（１〜２５６）によって約６秒から約２
７分まで設定可能となる。この設定された検出時間の間
ビデオメモリへのアクセスが発生しなかったとき、アク
セスサンプリングカウンタ７は通知信号３２をアサート
（イネーブル状態）し、ディスプレイコントローラ１２
にビデオメモリ９へのアクセスが停止していること（画
面表示に変更がないこと）を知らせる。なお、この通知
信号３２は表示パネル１８の駆動とは非同期に出力され
る。ディスプレイコントローラ１２は通知信号３２がア
サートされたことを認識すると現在走査中の走査電極の
駆動が終わるのを待って（非同期で受け取るため）、セ
グメントおよびコモン両ドライバに対し駆動波形出力停
止信号（３３および３６内に含まれている）を送る。セ
グメントドライバおよびコモンドライバは駆動波形出力
停止信号がアサートされている間、ＦＬＣディスプレイ
パネルへの出力端子を共に等電位に保ち、パネルを非走
査状態（電圧は加えているが、走査していない状態）に
制御する。また、セグメントドライバ１５およびコモン
ドライバ１７はそれぞれ出力端子をハイ・インピーダン
ス（電気的に切り離された）状態に制御する機能を有し
ている。このためＦＬＣディスプレイパネルをメモリ状
態に導く方法として、情報電極および走査電極を等電位
に保つ方法以外に、完全な非駆動状態（あえて前記“非
走査状態”と区別してこう呼ぶ）であるハイ・インピー
ダンス状態に制御することも可能である。なお、どちら
かの方法によって表示パネルをメモリ状態に制御するか
は、ディスプレイコントローラ１２からの制御によって
選択可能である。
の更新を行なわない場合 この場合は、アクセスサンプリングカウンタ７からの通
知信号３２によってＦＬＣディスプレイパネルをメモリ
状態に制御する。アクセスサンプリングカウンタ７はビ
デオメモリ９へのアクセス（書き込み）信号をリセット
（もしくはプリセット）信号とし、ＦＬＣディスプレイ
ユニット５０からの同期信号３１（例えば、水平同期信
号）をクロックとするカウンタであり、本カウンタのオ
ーバーフロー（キャリー）信号をビデオメモリ９に対し
て一定時間以上アクセスのなかったことの通知信号３２
としている。実際には同期信号３１（水平同期信号）か
ら１フレーム時間（例えば、走査線数を１０２４本とす
ると水平同期信号×１０２４）を計数し、その６４分周
したものをクロックとして８ビットカウンタ（アクセス
サンプリングカウンタ）に入力している。ＦＬＣディス
プレイユニット５０の標準的な水平走査時間を仮に１０
０μｓとするとクロックの周期は約６．５秒（１００μ
ｓ×１０２４×６４）となり、検出時間は、カウンタの
プリセットの値（１〜２５６）によって約６秒から約２
７分まで設定可能となる。この設定された検出時間の間
ビデオメモリへのアクセスが発生しなかったとき、アク
セスサンプリングカウンタ７は通知信号３２をアサート
（イネーブル状態）し、ディスプレイコントローラ１２
にビデオメモリ９へのアクセスが停止していること（画
面表示に変更がないこと）を知らせる。なお、この通知
信号３２は表示パネル１８の駆動とは非同期に出力され
る。ディスプレイコントローラ１２は通知信号３２がア
サートされたことを認識すると現在走査中の走査電極の
駆動が終わるのを待って（非同期で受け取るため）、セ
グメントおよびコモン両ドライバに対し駆動波形出力停
止信号（３３および３６内に含まれている）を送る。セ
グメントドライバおよびコモンドライバは駆動波形出力
停止信号がアサートされている間、ＦＬＣディスプレイ
パネルへの出力端子を共に等電位に保ち、パネルを非走
査状態（電圧は加えているが、走査していない状態）に
制御する。また、セグメントドライバ１５およびコモン
ドライバ１７はそれぞれ出力端子をハイ・インピーダン
ス（電気的に切り離された）状態に制御する機能を有し
ている。このためＦＬＣディスプレイパネルをメモリ状
態に導く方法として、情報電極および走査電極を等電位
に保つ方法以外に、完全な非駆動状態（あえて前記“非
走査状態”と区別してこう呼ぶ）であるハイ・インピー
ダンス状態に制御することも可能である。なお、どちら
かの方法によって表示パネルをメモリ状態に制御するか
は、ディスプレイコントローラ１２からの制御によって
選択可能である。
【００２１】次にメモリ状態から通常駆動状態へ復帰す
るときの動作を説明する。アクセスサンプリングカウン
タ７はビデオメモリ９へのアクセスが一度でも行なわれ
ると即座に通知信号３２をネゲート（ディスエーブル状
態）し、ディスプレイコントローラ１２に対してビデオ
メモリ９へのアクセス（書き込み要求）があったことを
知らせる。この通知信号３２はアサート時と同様、表示
パネル１８の駆動（走査）とは非同期に出力されるた
め、ディスプレイコントローラ１２は現在走査中の走査
電極の駆動が終わるのを待って（表示パネルの走査と同
期をとって）セグメントおよびコモン両ドライバへの駆
動波形出力停止信号（３３および３６）をネゲートする
ことによって、通常駆動状態（で説明した「部分書き
換え走査＋全画面リフレッシュ走査」状態）に復帰させ
る。
るときの動作を説明する。アクセスサンプリングカウン
タ７はビデオメモリ９へのアクセスが一度でも行なわれ
ると即座に通知信号３２をネゲート（ディスエーブル状
態）し、ディスプレイコントローラ１２に対してビデオ
メモリ９へのアクセス（書き込み要求）があったことを
知らせる。この通知信号３２はアサート時と同様、表示
パネル１８の駆動（走査）とは非同期に出力されるた
め、ディスプレイコントローラ１２は現在走査中の走査
電極の駆動が終わるのを待って（表示パネルの走査と同
期をとって）セグメントおよびコモン両ドライバへの駆
動波形出力停止信号（３３および３６）をネゲートする
ことによって、通常駆動状態（で説明した「部分書き
換え走査＋全画面リフレッシュ走査」状態）に復帰させ
る。
【００２２】図２は、表示パネルが通常状態からメモリ
状態に移行する時、およびメモリ状態から通常状態へ復
帰する時、走査電極群に印加される走査信号（駆動波
形）と情報電極群に印加される情報信号（駆動波形）を
示したものである。コモンドライバ１７から出力される
走査電極駆動波形は、正電界側（電圧レベル：Ｖ１）の
消去パルスで１度全ライン（１本の走査ライン）を消去
した後、負電圧側（電圧レベル：Ｖ２）の書き込みパネ
ルで書き込みを行なう。ここで書き込みパルスはセグメ
ントドライバ１５から出力される情報電極駆動波形（電
圧レベル：Ｖ３、Ｖ４）と同期しており、それらの合成
波形が書き込みしきい値を越えると消去状態からもう一
方の状態に転移し、しきい値を越えない場合には、消去
状態が保持される。このようにして選択期間（水平走査
期間）内に２つの状態を書き分けこれを全走査ラインに
対して繰り返すことにより、所望の描画を得る。図２に
おいてアクセスサンプリングカウンタ７からの通知信号
３２がアサート（Ｈｉレベル）されている間、ディスプ
レイコントローラ１２はセグメント、コモン両ドライバ
の出力を等電位（ここでは電圧レベル：ＶＣ）もしくは
ハイ・インピイーダンス状態（図２ではＺと表示）に制
御し、表示パネルをメモリ状態に保持する。
状態に移行する時、およびメモリ状態から通常状態へ復
帰する時、走査電極群に印加される走査信号（駆動波
形）と情報電極群に印加される情報信号（駆動波形）を
示したものである。コモンドライバ１７から出力される
走査電極駆動波形は、正電界側（電圧レベル：Ｖ１）の
消去パルスで１度全ライン（１本の走査ライン）を消去
した後、負電圧側（電圧レベル：Ｖ２）の書き込みパネ
ルで書き込みを行なう。ここで書き込みパルスはセグメ
ントドライバ１５から出力される情報電極駆動波形（電
圧レベル：Ｖ３、Ｖ４）と同期しており、それらの合成
波形が書き込みしきい値を越えると消去状態からもう一
方の状態に転移し、しきい値を越えない場合には、消去
状態が保持される。このようにして選択期間（水平走査
期間）内に２つの状態を書き分けこれを全走査ラインに
対して繰り返すことにより、所望の描画を得る。図２に
おいてアクセスサンプリングカウンタ７からの通知信号
３２がアサート（Ｈｉレベル）されている間、ディスプ
レイコントローラ１２はセグメント、コモン両ドライバ
の出力を等電位（ここでは電圧レベル：ＶＣ）もしくは
ハイ・インピイーダンス状態（図２ではＺと表示）に制
御し、表示パネルをメモリ状態に保持する。
【００２３】なお、これらＦＬＣディスプレイパネルを
“メモリ状態に制御する”あるいは“メモリ状態から通
常走査状態に復帰する”のに要する時間は、最大でも表
示パネルの１水平走査時間（およそ１００μｓ）以内に
行なわれるため、このような表示パネルの制御（走査状
態⇔メモリ状態切り替え）がオペレータにとって違和感
を生じさせるようなことは全くない。
“メモリ状態に制御する”あるいは“メモリ状態から通
常走査状態に復帰する”のに要する時間は、最大でも表
示パネルの１水平走査時間（およそ１００μｓ）以内に
行なわれるため、このような表示パネルの制御（走査状
態⇔メモリ状態切り替え）がオペレータにとって違和感
を生じさせるようなことは全くない。
【００２４】以上説明したように、メモリ性を有してい
る液晶表示パネルを用いて映像情報を表示するための制
御方法として、本実施例のような構成をとることによ
り、カーソル移動、文字入力、画面スクロール等、マン
・マシンインターフェイスとして特に応答性を要求され
る描画情報に関しては、それらの表示に対応するライン
を優先的にＦＬＣディスプレイの方へ転送し選択的に描
画（駆動）することができる、と同時に一定時間以上ビ
デオメモリへのアクセス（書き込み）動作が発生しない
ときには表示パネルの走査（駆動）を止めシステム全体
の低パワー化を図ることが可能となる。
る液晶表示パネルを用いて映像情報を表示するための制
御方法として、本実施例のような構成をとることによ
り、カーソル移動、文字入力、画面スクロール等、マン
・マシンインターフェイスとして特に応答性を要求され
る描画情報に関しては、それらの表示に対応するライン
を優先的にＦＬＣディスプレイの方へ転送し選択的に描
画（駆動）することができる、と同時に一定時間以上ビ
デオメモリへのアクセス（書き込み）動作が発生しない
ときには表示パネルの走査（駆動）を止めシステム全体
の低パワー化を図ることが可能となる。
【００２５】
【発明の効果】以上説明したように、本発明によれば、
所定の検出期間内に画像情報の変更が行なわれなかった
ときは、液晶表示のリフレシュを停止するようにしたた
め、表示装置全体の低電力化を図ることができた。
所定の検出期間内に画像情報の変更が行なわれなかった
ときは、液晶表示のリフレシュを停止するようにしたた
め、表示装置全体の低電力化を図ることができた。
【００２６】また、リフレッシュを停止することで、液
晶素子に駆動電圧が印加される累積時間が大幅に減少
し、電気部品や接合部の劣化あるいは液晶素子の画質の
劣化（画像の焼付き現象や液晶の最適駆動条件変動等）
が抑制され、液晶素子の信頼性の向上を図ることができ
た。
晶素子に駆動電圧が印加される累積時間が大幅に減少
し、電気部品や接合部の劣化あるいは液晶素子の画質の
劣化（画像の焼付き現象や液晶の最適駆動条件変動等）
が抑制され、液晶素子の信頼性の向上を図ることができ
た。
【図１】 本発明の一実施例に係る表示装置のブロック
図である。
図である。
【図２】 図１における表示パネルをメモリ状態に制御
するときのタイミングチャートである。
するときのタイミングチャートである。
５：ＶＧＡサポートチップ、６：グラフィックスプロセ
ッサ、７：アクセスサンプリングカウンタ、８：メモリ
コントローラ、９：ビデオメモリ、１２：ディスプレイ
コントローラ、１４：ラインメモリ、１５：セグメント
ドライバ、１６：ラインアドレスデコーダ、１７：コモ
ンドライバ、１８：強誘電性液晶表示パネル、４０：Ｆ
ＬＣディスプレイ制御回路、５０：ＦＬＣディスプレイ
ユニット。
ッサ、７：アクセスサンプリングカウンタ、８：メモリ
コントローラ、９：ビデオメモリ、１２：ディスプレイ
コントローラ、１４：ラインメモリ、１５：セグメント
ドライバ、１６：ラインアドレスデコーダ、１７：コモ
ンドライバ、１８：強誘電性液晶表示パネル、４０：Ｆ
ＬＣディスプレイ制御回路、５０：ＦＬＣディスプレイ
ユニット。
Claims (7)
- 【請求項１】 走査信号電極と情報信号電極が互いにマ
トリクス状に配置され、その間にメモリ性を有する液晶
が挟持されて構成された表示パネルと、 走査信号電極に走査信号を印加し、情報信号電極に情報
信号を印加する駆動手段と、 前記表示パネルで表示すべき画像情報を記憶する画像情
報記憶手段と、 前記画像情報記憶手段への画像情報に変更が行なわれた
ことを検出する手段と、 前記画像情報に変更が行なわれたことを検出する期間の
時間を決定する手段と、 前記検出結果に応じて前記駆動手段を制御する駆動制御
手段とを有することを特徴とする表示装置。 - 【請求項２】 前記画像情報に変更が行なわれたことを
検出する期間の時間を決定する手段は、該決定を前記表
示装置の同期信号の単位で行なうことを特徴とする請求
項１に記載の表示装置。 - 【請求項３】 前記駆動制御手段は、前記検出期間の間
前記画像情報に変更がない場合、前記表示パネルの走査
を停止するように前記駆動手段を制御することを特徴と
する請求項１に記載の表示装置。 - 【請求項４】 前記駆動制御手段は、前記検出期間の間
前記画像情報に変更がない場合、前記表示パネルの駆動
を停止するように前記駆動手段を制御することを特徴と
する請求項１に記載の表示装置。 - 【請求項５】 前記液晶が強誘電性液晶である請求項１
に記載の表示装置。 - 【請求項６】 前記表示パネルの走査の停止は、前記走
査電極および情報電極への印加電圧を等電位に制御する
ことにより実現することを特徴とする請求項３に記載の
表示装置。 - 【請求項７】 前記表示パネルの駆動の停止は、前記走
査電極および情報電極をハイ・インピーダンス状態に制
御することにより実現することを特徴とする請求項４に
記載の表示装置。
Priority Applications (6)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03240257A JP3133107B2 (ja) | 1991-08-28 | 1991-08-28 | 表示装置 |
| DE69216174T DE69216174T2 (de) | 1991-08-28 | 1992-08-26 | Anzeigevorrichtung |
| AT92307760T ATE146892T1 (de) | 1991-08-28 | 1992-08-26 | Anzeigevorrichtung |
| ES92307760T ES2095414T3 (es) | 1991-08-28 | 1992-08-26 | Aparato de visualizacion. |
| EP92307760A EP0530005B1 (en) | 1991-08-28 | 1992-08-26 | Display apparatus |
| US08/270,307 US5894297A (en) | 1991-08-28 | 1994-07-05 | Display apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP03240257A JP3133107B2 (ja) | 1991-08-28 | 1991-08-28 | 表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0553541A true JPH0553541A (ja) | 1993-03-05 |
| JP3133107B2 JP3133107B2 (ja) | 2001-02-05 |
Family
ID=17056803
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP03240257A Expired - Fee Related JP3133107B2 (ja) | 1991-08-28 | 1991-08-28 | 表示装置 |
Country Status (6)
| Country | Link |
|---|---|
| US (1) | US5894297A (ja) |
| EP (1) | EP0530005B1 (ja) |
| JP (1) | JP3133107B2 (ja) |
| AT (1) | ATE146892T1 (ja) |
| DE (1) | DE69216174T2 (ja) |
| ES (1) | ES2095414T3 (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2006055431A (ja) * | 2004-08-20 | 2006-03-02 | Olympus Corp | 受信装置および被検体内導入システム |
| US7023496B2 (en) | 2001-03-09 | 2006-04-04 | Matsushita Electric Industrial Co., Ltd. | Moving picture decoding display apparatus and method for controlling a video signal's contrast and brightness when a video signal update is detected |
| US7639223B2 (en) | 2005-03-23 | 2009-12-29 | Sharp Kabushiki Kaisha | Liquid crystal display apparatus detecting a freeze state |
Families Citing this family (10)
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|---|---|---|---|---|
| GB2282307A (en) * | 1993-09-24 | 1995-03-29 | Ibm | Disabling display unit when image is unchanged |
| JPH08163472A (ja) * | 1994-10-05 | 1996-06-21 | Nippondenso Co Ltd | マトリクス型液晶表示装置 |
| JPH10105085A (ja) * | 1996-09-30 | 1998-04-24 | Toshiba Corp | 液晶表示装置及びその駆動方法 |
| JP3347678B2 (ja) | 1998-06-18 | 2002-11-20 | キヤノン株式会社 | 液晶素子とその駆動方法 |
| US6353426B1 (en) * | 1998-10-27 | 2002-03-05 | Nec Corporation | Liquid crystal display control system controllable of connection between a driver circuit and each of common lines |
| US6670937B1 (en) | 1999-03-01 | 2003-12-30 | Canon Kabushiki Kaisha | Liquid crystal display apparatus |
| JP4212791B2 (ja) * | 2000-08-09 | 2009-01-21 | シャープ株式会社 | 液晶表示装置ならびに携帯電子機器 |
| JP4166448B2 (ja) * | 2000-10-06 | 2008-10-15 | シャープ株式会社 | アクティブマトリクス型液晶表示装置およびその駆動方法 |
| EP2008264B1 (en) * | 2006-04-19 | 2016-11-16 | Ignis Innovation Inc. | Stable driving scheme for active matrix displays |
| JP5098395B2 (ja) * | 2007-03-29 | 2012-12-12 | セイコーエプソン株式会社 | 電気泳動表示パネルの駆動装置、電気泳動表示装置及び電子機器 |
Family Cites Families (17)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5922949B2 (ja) * | 1976-09-03 | 1984-05-30 | シャープ株式会社 | 表示装置の駆動方式 |
| JPS53120158A (en) * | 1977-03-29 | 1978-10-20 | Sharp Corp | Power source control system |
| DE3346285A1 (de) * | 1982-12-21 | 1984-10-11 | Terumo K.K., Tokio/Tokyo | Elektronisches klinisches thermometer und verfahren zur koerpertemperaturmessung |
| US4655561A (en) * | 1983-04-19 | 1987-04-07 | Canon Kabushiki Kaisha | Method of driving optical modulation device using ferroelectric liquid crystal |
| JPS6118929A (ja) * | 1984-07-05 | 1986-01-27 | Seiko Instr & Electronics Ltd | 強誘電性液晶電気光学装置 |
| US4691200A (en) * | 1984-10-01 | 1987-09-01 | Xerox Corporation | Matrix display with a fast cursor |
| US4695838A (en) * | 1985-04-30 | 1987-09-22 | International Business Machines Corporation | Plasma panel display selectively updatable on pel line basis |
| US5642128A (en) * | 1987-10-02 | 1997-06-24 | Canon Kabushiki Kaisha | Display control device |
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