JPH0535669Y2 - - Google Patents
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- JPH0535669Y2 JPH0535669Y2 JP18442286U JP18442286U JPH0535669Y2 JP H0535669 Y2 JPH0535669 Y2 JP H0535669Y2 JP 18442286 U JP18442286 U JP 18442286U JP 18442286 U JP18442286 U JP 18442286U JP H0535669 Y2 JPH0535669 Y2 JP H0535669Y2
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Landscapes
- Television Signal Processing For Recording (AREA)
- Tone Control, Compression And Expansion, Limiting Amplitude (AREA)
- Networks Using Active Elements (AREA)
Description
【考案の詳細な説明】
Ａ 産業上の利用分野
本考案はイコライザ回路に関し、例えば高品位
ビデオテープレコーダ（HD−VTR）において
再生信号の特性補償を行う再生イコライザ回路に
適用して好適なものである。
ビデオテープレコーダ（HD−VTR）において
再生信号の特性補償を行う再生イコライザ回路に
適用して好適なものである。
Ｂ 考案の概要
本考案はイコライザ回路において、第１及び第
２の遅延信号を出力する遅延線と、その遅延線の
入力信号、第１及び第２の遅延信号に基づいて第
１及び第２のコサイン特性を得ると共にその第１
及び第２のコサイン特性を合成する合成回路とを
用いることによつて、簡易な構成で整合調整を容
易になし得るイコライザ回路を実現し得る。
２の遅延信号を出力する遅延線と、その遅延線の
入力信号、第１及び第２の遅延信号に基づいて第
１及び第２のコサイン特性を得ると共にその第１
及び第２のコサイン特性を合成する合成回路とを
用いることによつて、簡易な構成で整合調整を容
易になし得るイコライザ回路を実現し得る。
Ｃ 従来の技術
従来高品位ビデオテープレコーダ（HD−
VTR）においては、ビデオ信号を中心周波数が
約25〔ＭHz〕の搬送波信号を用いて周波数変調
（FM変調）し、このFM信号を磁気テープ上に記
録するようになされている。なお、このとき磁気
テープ上の記録情報の劣化を防止するため、FM
信号の搬送波（キヤリア）の上及び下側に含まれ
る両側帯波（サブキヤリア）の振幅のレベルを持
ち上げるようになされている。
VTR）においては、ビデオ信号を中心周波数が
約25〔ＭHz〕の搬送波信号を用いて周波数変調
（FM変調）し、このFM信号を磁気テープ上に記
録するようになされている。なお、このとき磁気
テープ上の記録情報の劣化を防止するため、FM
信号の搬送波（キヤリア）の上及び下側に含まれ
る両側帯波（サブキヤリア）の振幅のレベルを持
ち上げるようになされている。
このため磁気テープ上の記録情報を再生する際
には、再生ヘツドにおいて得られたFM信号を復
調する前に、このFM信号の位相をずらすことな
くキヤリアの上及び下側に含まれるサブキヤリア
の振幅のレベルを下げるという特性補償を行う必
要がある。
には、再生ヘツドにおいて得られたFM信号を復
調する前に、このFM信号の位相をずらすことな
くキヤリアの上及び下側に含まれるサブキヤリア
の振幅のレベルを下げるという特性補償を行う必
要がある。
またHD−VTRの磁気記録においても、通常
のビデオテープレコーダ（VTR）と同様に、上
側のサブキヤリアの振幅のレベルが下側のサブキ
ヤリアの振幅のレベルより大きなレベルとなつて
再生ヘツド出力に表れる。このため上述と同様に
FM信号の位相をずらすことなく、キヤリアの上
及び下側に含まれるサブキヤリアの振幅のレベル
を、キヤリアを中心として同じレベルになるよう
に特性補償を行う必要がある。
のビデオテープレコーダ（VTR）と同様に、上
側のサブキヤリアの振幅のレベルが下側のサブキ
ヤリアの振幅のレベルより大きなレベルとなつて
再生ヘツド出力に表れる。このため上述と同様に
FM信号の位相をずらすことなく、キヤリアの上
及び下側に含まれるサブキヤリアの振幅のレベル
を、キヤリアを中心として同じレベルになるよう
に特性補償を行う必要がある。
このような特性補償を行うため従来は、第３図
に示すように位相歪を生ずることなく振幅特性を
補償し得るコサインイコライザを２段使用した再
生イコライザ回路１が提案されている。
に示すように位相歪を生ずることなく振幅特性を
補償し得るコサインイコライザを２段使用した再
生イコライザ回路１が提案されている。
すなわち、再生イコライザ回路１は、FM信号
のキヤリアを中心にして上及び下側のサブキヤリ
アの振幅のレベルが同じレベルとなるように特性
補償する第１のコサインイコライザ２と、キヤリ
アの振幅のレベルは下げずに上及び下側のサブキ
ヤリアの振幅のレベルを下げるように特性補償す
る第２のコサインイコライザ３とにより構成され
ている。
のキヤリアを中心にして上及び下側のサブキヤリ
アの振幅のレベルが同じレベルとなるように特性
補償する第１のコサインイコライザ２と、キヤリ
アの振幅のレベルは下げずに上及び下側のサブキ
ヤリアの振幅のレベルを下げるように特性補償す
る第２のコサインイコライザ３とにより構成され
ている。
第１のコサインイコライザ２は、磁気ヘツド
（図示せず）より出力されたFM信号でなる入力
信号Ｓ１（第６図）を駆動増幅回路２１に受け、
その出力が半固定抵抗TR１を介して、一端が接
地された半固定コンデンサTC１の他端に入力さ
れ、さらに、第１の遅延線２３の入力端に入力さ
れる。なお、半固定抵抗TR１及び半固定コンデ
ンサTC１は積分回路構成に接続され、入力信号
S1を遅延線２３に入力する際の整合調整を行う
ためのマツチング回路２２となされている。
（図示せず）より出力されたFM信号でなる入力
信号Ｓ１（第６図）を駆動増幅回路２１に受け、
その出力が半固定抵抗TR１を介して、一端が接
地された半固定コンデンサTC１の他端に入力さ
れ、さらに、第１の遅延線２３の入力端に入力さ
れる。なお、半固定抵抗TR１及び半固定コンデ
ンサTC１は積分回路構成に接続され、入力信号
S1を遅延線２３に入力する際の整合調整を行う
ためのマツチング回路２２となされている。
ここで第１の遅延線２３は、例えばコイル及び
コンデンサを含む分布定数型でなり、入力信号を
例えば10〔ns〕遅延させ、この遅延出力を第１の
減算回路２５に与える。
コンデンサを含む分布定数型でなり、入力信号を
例えば10〔ns〕遅延させ、この遅延出力を第１の
減算回路２５に与える。
さらにこれに加えて、第１の遅延線の終端抵抗
が開放されていることにより、第１の遅延線内で
全反射が生ずるようになされ、入力端において
は、入力信号及び29〔ns〕遅延した反射信号を得、
これを第１の増幅回路２４を介して減算回路２５
に与える。
が開放されていることにより、第１の遅延線内で
全反射が生ずるようになされ、入力端において
は、入力信号及び29〔ns〕遅延した反射信号を得、
これを第１の増幅回路２４を介して減算回路２５
に与える。
これにより遅延出力から、入力信号及び反射信
号を減算することにより、第４図に示すようにキ
ヤリアの２倍の周波数50〔ＭHz〕にピークがある
第１のコサイン特性Ｔ１を得るようになされてい
る。
号を減算することにより、第４図に示すようにキ
ヤリアの２倍の周波数50〔ＭHz〕にピークがある
第１のコサイン特性Ｔ１を得るようになされてい
る。
かくして第１の増幅回路２４の増幅率を所定の
値に選定することにより、FM信号でなる入力信
号Ｓ１の位相をずらすことなくキヤリアfC1の振
幅レベルを動かさずに上側サブキヤリアfSCU1の振
幅のレベルを持ち上げると共に下側サブキヤリア
fSCL1の振幅のレベルを持ち下げ、第７図に示すよ
うにキヤリアfC2に対して上及び下側サブキヤリ
アfSCU2及びfSCL2の振幅のレベルが同じFM信号Ｓ
２を得るようになされている。
値に選定することにより、FM信号でなる入力信
号Ｓ１の位相をずらすことなくキヤリアfC1の振
幅レベルを動かさずに上側サブキヤリアfSCU1の振
幅のレベルを持ち上げると共に下側サブキヤリア
fSCL1の振幅のレベルを持ち下げ、第７図に示すよ
うにキヤリアfC2に対して上及び下側サブキヤリ
アfSCU2及びfSCL2の振幅のレベルが同じFM信号Ｓ
２を得るようになされている。
第２図のコサインイコライザ３は、第１のコサ
インイコライザ２と同様に構成されてなり、第２
の遅延線の遅延時間が20〔ns〕に選定されること
により第５図に示すようにキヤリアの周波数25
〔ＭHz〕にピークがある第２のコサイン特性Ｔ２
を得るようになされている。
インイコライザ２と同様に構成されてなり、第２
の遅延線の遅延時間が20〔ns〕に選定されること
により第５図に示すようにキヤリアの周波数25
〔ＭHz〕にピークがある第２のコサイン特性Ｔ２
を得るようになされている。
かくして第２の増幅回路３４の増幅率を所定の
値に選定することにより第１のコサインイコライ
ザ２の出力信号Ｓ２の位相をずらすことなくキヤ
リアfC2の振幅のレベルを動かさずに、上及び下
側サブキヤリアfSCU2及びfSCL2の振幅を持ち下げ、
これにより良好にFM復調をなし得る出力信号Ｓ
３（第８図）を得るようになされている。
値に選定することにより第１のコサインイコライ
ザ２の出力信号Ｓ２の位相をずらすことなくキヤ
リアfC2の振幅のレベルを動かさずに、上及び下
側サブキヤリアfSCU2及びfSCL2の振幅を持ち下げ、
これにより良好にFM復調をなし得る出力信号Ｓ
３（第８図）を得るようになされている。
Ｄ 考案が解決しようとする問題点
ところがこのような構成の再生イコライザ回路
１においては、遅延線２３及び３３を用いたコサ
インイコライザ２段より構成されているため、各
コサインイコライザ２，３を駆動する駆動増幅回
路２１，３１及び整合調整を行うマツチング回路
２２、３２を各別に設ける必要があり回路構成の
大型化及び煩雑化を避け得ない。
１においては、遅延線２３及び３３を用いたコサ
インイコライザ２段より構成されているため、各
コサインイコライザ２，３を駆動する駆動増幅回
路２１，３１及び整合調整を行うマツチング回路
２２、３２を各別に設ける必要があり回路構成の
大型化及び煩雑化を避け得ない。
さらにこれに加えて各コサインイコライザ２，
３ごとにマツチング回路２２，３２の半固定抵抗
TR１，TR２及び半固定コンデンサTC１，TC
２を用いて整合調整を行う必要があり、また再生
イコライザ回路全体として遅延時間が30〔ns〕と
長いため完全な整合調整を行うことが困難である
という問題がある。
３ごとにマツチング回路２２，３２の半固定抵抗
TR１，TR２及び半固定コンデンサTC１，TC
２を用いて整合調整を行う必要があり、また再生
イコライザ回路全体として遅延時間が30〔ns〕と
長いため完全な整合調整を行うことが困難である
という問題がある。
このために整合がとれていない場合には、出力
信号の振幅特性や、群遅延特性にリツプルが生じ
結局再生画像において画質の劣化を生ずるおそれ
があつた。
信号の振幅特性や、群遅延特性にリツプルが生じ
結局再生画像において画質の劣化を生ずるおそれ
があつた。
本考案は以上の問題点を考慮してなされたもの
で、従来のイコライザ回路の問題を一挙に解決し
て簡易な構成で容易に整合調整をなし得るイコラ
イザ回路を提案しようとするものである。
で、従来のイコライザ回路の問題を一挙に解決し
て簡易な構成で容易に整合調整をなし得るイコラ
イザ回路を提案しようとするものである。
Ｅ 問題点を解決するための手段
かかる問題点を解決するため本考案において
は、入力信号Ｓ１１に対して第１の遅延時間だけ
遅延した第１の遅延信号Ｓ１２及びその第１の遅
延時間より短い第２の遅延時間だけ遅延した第２
の遅延信号Ｓ１３を出力し、終端抵抗が開放され
た遅延線１３と、その第１及び第２の遅延信号Ｓ
１２，Ｓ１３に基づいて第１の周波数にピークを
有する第１のコサイン特性Ｔ１１を得、入力信号
Ｓ１１及び第１の遅延信号Ｓ１２に基づいて第１
の周波数より低い第２の周波数にピークを有する
第２のコサイン特性Ｔ１２を得、第１及び第２の
コサイン特性Ｔ１１及びＴ１２を合成する合成回
路１８とを具えるようにする。
は、入力信号Ｓ１１に対して第１の遅延時間だけ
遅延した第１の遅延信号Ｓ１２及びその第１の遅
延時間より短い第２の遅延時間だけ遅延した第２
の遅延信号Ｓ１３を出力し、終端抵抗が開放され
た遅延線１３と、その第１及び第２の遅延信号Ｓ
１２，Ｓ１３に基づいて第１の周波数にピークを
有する第１のコサイン特性Ｔ１１を得、入力信号
Ｓ１１及び第１の遅延信号Ｓ１２に基づいて第１
の周波数より低い第２の周波数にピークを有する
第２のコサイン特性Ｔ１２を得、第１及び第２の
コサイン特性Ｔ１１及びＴ１２を合成する合成回
路１８とを具えるようにする。
Ｆ 作用
遅延線１３の第１及び第２の遅延信号Ｓ１２及
びＳ１３に基づいて得られる第１の周波数にピー
クを有する第１のコサイン特性Ｔ１１と、入力信
号Ｓ１１及び第１の遅延信号Ｓ１２に基づいて得
られる第１の周波数より低い第２の周波数にピー
クを有する第２のコサイン特性Ｔ１２とを合成す
れば、第１の遅延時間でなる遅延線１３を用いた
コサインイコライザと、第１の遅延時間より第２
の遅延時間を減算した遅延時間でなる遅延線１３
Ｂを用いたコサインイコライザとを２段用いたイ
コライザ回路の補償特性と等しく、かつ簡易な構
成で整合調整の容易なイコライザ回路を実現し得
る。Ｇ 実施例 以下図面について、本考案の一実施例を詳述す
る。
びＳ１３に基づいて得られる第１の周波数にピー
クを有する第１のコサイン特性Ｔ１１と、入力信
号Ｓ１１及び第１の遅延信号Ｓ１２に基づいて得
られる第１の周波数より低い第２の周波数にピー
クを有する第２のコサイン特性Ｔ１２とを合成す
れば、第１の遅延時間でなる遅延線１３を用いた
コサインイコライザと、第１の遅延時間より第２
の遅延時間を減算した遅延時間でなる遅延線１３
Ｂを用いたコサインイコライザとを２段用いたイ
コライザ回路の補償特性と等しく、かつ簡易な構
成で整合調整の容易なイコライザ回路を実現し得
る。Ｇ 実施例 以下図面について、本考案の一実施例を詳述す
る。
第１図において、１０は全体として再生イコラ
イザ回路を示し、遅延線１３を駆動する駆動増幅
回路１１、半固定抵抗TR１０及び半固定コンデ
ンサTC１０を積分回路構成に接続してなる整合
調整用のマツチング回路１２、遅延線１３及び第
１及び第２の増幅回路１５，１６、反転増幅回路
１４及び加算回路１７でなる合成回路１８により
構成されている。
イザ回路を示し、遅延線１３を駆動する駆動増幅
回路１１、半固定抵抗TR１０及び半固定コンデ
ンサTC１０を積分回路構成に接続してなる整合
調整用のマツチング回路１２、遅延線１３及び第
１及び第２の増幅回路１５，１６、反転増幅回路
１４及び加算回路１７でなる合成回路１８により
構成されている。
遅延線１３は、例えば中間タツプ付の遅延線で
なり全体として入力端ａに与えられる入力信号Ｓ
１１に対して20〔ns〕の遅延時間を有する第１の
遅延出力Ｓ１２を第１の出力端ｂに得、かつ入力
信号Ｓ１１に対して10〔ns〕の遅延時間を有する
第２の遅延出力Ｓ１３を中間タツプに設けられた
第２の出力端ｃに得るようになされている。
なり全体として入力端ａに与えられる入力信号Ｓ
１１に対して20〔ns〕の遅延時間を有する第１の
遅延出力Ｓ１２を第１の出力端ｂに得、かつ入力
信号Ｓ１１に対して10〔ns〕の遅延時間を有する
第２の遅延出力Ｓ１３を中間タツプに設けられた
第２の出力端ｃに得るようになされている。
遅延線１３の入力端ａは、磁気ヘツド（図示せ
ず）により再生されたFM信号でなる入力信号Ｓ
１が駆動増幅回路１１及びマツチング回路１２を
介して入力されると共に、第１の増幅回路１５を
介して加算回路１７に接続され、また第１の出力
端ｂは反転増幅回路１４を介して加算回路１７に
接続され、さらに第２の出力端ｃは第２の増幅回
路１６を介して加算回路１７に接続されている。
ず）により再生されたFM信号でなる入力信号Ｓ
１が駆動増幅回路１１及びマツチング回路１２を
介して入力されると共に、第１の増幅回路１５を
介して加算回路１７に接続され、また第１の出力
端ｂは反転増幅回路１４を介して加算回路１７に
接続され、さらに第２の出力端ｃは第２の増幅回
路１６を介して加算回路１７に接続されている。
また遅延線１３の終端抵抗は開放されており、
例えば第１の出力端ｂに得られる第１の遅延信号
Ｓ１２を基準とすれば（すなわち遅延時間を０
〔ns〕と想定する）、遅延線１３内において全反射
が生じ、これにより第２の出力端ｃには第１の遅
延信号Ｓ１２に対して±10〔ns〕の遅延時間を有
する第２の遅延信号Ｓ１３を得、入力端ａにおい
ても同様に第１の遅延信号Ｓ１２に対して±20
〔ns〕の遅延時間を有する入力信号Ｓ１１を得る
ようになされている。
例えば第１の出力端ｂに得られる第１の遅延信号
Ｓ１２を基準とすれば（すなわち遅延時間を０
〔ns〕と想定する）、遅延線１３内において全反射
が生じ、これにより第２の出力端ｃには第１の遅
延信号Ｓ１２に対して±10〔ns〕の遅延時間を有
する第２の遅延信号Ｓ１３を得、入力端ａにおい
ても同様に第１の遅延信号Ｓ１２に対して±20
〔ns〕の遅延時間を有する入力信号Ｓ１１を得る
ようになされている。
かくして、第２の出力端ｃに得られた第２の遅
延信号Ｓ１３を所定の増幅率を有する第２の増幅
回路１６を介して加算回路１７に入力し、第１の
遅延信号Ｓ１２の反転信号と加算することによ
り、FM信号のキヤリアの２倍の周波数50〔ＭHz〕
にピークがある第１のコサイン特性Ｔ１１を有す
るコサインイコライザが構成される。
延信号Ｓ１３を所定の増幅率を有する第２の増幅
回路１６を介して加算回路１７に入力し、第１の
遅延信号Ｓ１２の反転信号と加算することによ
り、FM信号のキヤリアの２倍の周波数50〔ＭHz〕
にピークがある第１のコサイン特性Ｔ１１を有す
るコサインイコライザが構成される。
また入力端ａの入力信号Ｓ１１を所定の増幅率
を有する第１の増幅回路１５を介して加算回路１
７に入力し、第１の遅延信号Ｓ１２の反転信号と
加算することにより、FM信号のキヤリアと同じ
周波数25〔ＭHz〕にピークがある第２のコサイン
特性Ｔ１２を有するコサインイコライザが構成さ
れる。
を有する第１の増幅回路１５を介して加算回路１
７に入力し、第１の遅延信号Ｓ１２の反転信号と
加算することにより、FM信号のキヤリアと同じ
周波数25〔ＭHz〕にピークがある第２のコサイン
特性Ｔ１２を有するコサインイコライザが構成さ
れる。
これにより、合成回路１８の出力には、第１の
コサイン特性Ｔ１１及び第２のコサイン特性Ｔ１
２を合成したイコライズ特性を得るようになされ
ている。
コサイン特性Ｔ１１及び第２のコサイン特性Ｔ１
２を合成したイコライズ特性を得るようになされ
ている。
以上の構成において、再生イコライザ回路１０
に入力される入力信号Ｓ１すなわち磁気ヘルド
（図示せず）より得られる再生FM信号の周波数
スペクトラムは、第６図に示すように下側サブキ
ヤリアfSCL1の振幅のレベルが、上側サブキヤリア
fSCU1の振幅レベルと比較して大きく、かつ上及び
下側サブキヤリアfSCU1及びfSCL1の振幅のレベルが
キヤリアfC1の振幅レベルに比して共に高いレベ
ルを示すようになされている。
に入力される入力信号Ｓ１すなわち磁気ヘルド
（図示せず）より得られる再生FM信号の周波数
スペクトラムは、第６図に示すように下側サブキ
ヤリアfSCL1の振幅のレベルが、上側サブキヤリア
fSCU1の振幅レベルと比較して大きく、かつ上及び
下側サブキヤリアfSCU1及びfSCL1の振幅のレベルが
キヤリアfC1の振幅レベルに比して共に高いレベ
ルを示すようになされている。
この入力信号Ｓ１を、第１及び第２のコサイン
特性Ｔ１１及びＴ１２を合成したイコライズ特性
でなる再生イコライザ回路１０によつて、特性補
償することにより第８図に示すように上及び下側
サブキヤリアfSCU3及びfSCL3の振幅のレベルが等し
く、かつキヤリアfC3の振幅のレベルに対して低
いレベルとなされ、かくして良好にFM復調をな
し得る出力信号Ｓ３を得ることができるようにな
されている。
特性Ｔ１１及びＴ１２を合成したイコライズ特性
でなる再生イコライザ回路１０によつて、特性補
償することにより第８図に示すように上及び下側
サブキヤリアfSCU3及びfSCL3の振幅のレベルが等し
く、かつキヤリアfC3の振幅のレベルに対して低
いレベルとなされ、かくして良好にFM復調をな
し得る出力信号Ｓ３を得ることができるようにな
されている。
以上の構成によれば、遅延線１３の第１及び第
２の遅延信号Ｓ１２及び１３に基づいて得られる
第１の周波数にピークを有する第１のコサイン特
性Ｔ１１と、入力信号Ｓ１１及び第１の遅延信号
Ｓ１２に基づいて得られる第１の周波数より低い
第２の周波数にピークを有する第２のコサイン特
性Ｔ１２とを合成回路１８によつて合成すること
により、第１の遅延時間でなる遅延線１３を用い
たコサインイコライザと、第１の遅延時間より第
２の遅延時間を減算した遅延時間でなる遅延線１
３Ｂを用いたコサインイコライザとを２段用いた
従来のイコライザ回路の補償特性と等しく、かつ
簡易な構成のイコライザ回路を実現し得る。
２の遅延信号Ｓ１２及び１３に基づいて得られる
第１の周波数にピークを有する第１のコサイン特
性Ｔ１１と、入力信号Ｓ１１及び第１の遅延信号
Ｓ１２に基づいて得られる第１の周波数より低い
第２の周波数にピークを有する第２のコサイン特
性Ｔ１２とを合成回路１８によつて合成すること
により、第１の遅延時間でなる遅延線１３を用い
たコサインイコライザと、第１の遅延時間より第
２の遅延時間を減算した遅延時間でなる遅延線１
３Ｂを用いたコサインイコライザとを２段用いた
従来のイコライザ回路の補償特性と等しく、かつ
簡易な構成のイコライザ回路を実現し得る。
さらに遅延線１３を駆動する駆動増幅回路１１
及び整合調整用のマツチング回路１２が各１段で
構成され、かつ全体としての遅延時間が従来と比
較してより短縮し得ることにより、より整合調整
が容易なイコライザ回路１０を実現できる。
及び整合調整用のマツチング回路１２が各１段で
構成され、かつ全体としての遅延時間が従来と比
較してより短縮し得ることにより、より整合調整
が容易なイコライザ回路１０を実現できる。
なお上述の実施例においては、中間タツプ付の
遅延線を用いたが、これに代えて２つの遅延線を
直列に接続し、接続中点より第２の遅延出力を得
るようにしても同様の効果を得ることができる。
遅延線を用いたが、これに代えて２つの遅延線を
直列に接続し、接続中点より第２の遅延出力を得
るようにしても同様の効果を得ることができる。
さらに上述の実施例においては、合成回路とし
て第１及び第２の増幅回路、反転回路及び加算回
路を用いて構成したが、回路の組合せはこれに限
らず、他の回路構成により第１及び第２のコサイ
ン特性を得、これを合成するようにしても同様の
効果を得ることができる。
て第１及び第２の増幅回路、反転回路及び加算回
路を用いて構成したが、回路の組合せはこれに限
らず、他の回路構成により第１及び第２のコサイ
ン特性を得、これを合成するようにしても同様の
効果を得ることができる。
また上述の実施例においては、本考案によるイ
コライザ回路をHD−VTRの再生回路に適用し
た一実施例について述べたが、本考案はこれに限
らず他の電子機器等に広く適用し得るものであ
る。
コライザ回路をHD−VTRの再生回路に適用し
た一実施例について述べたが、本考案はこれに限
らず他の電子機器等に広く適用し得るものであ
る。
Ｈ 考案の効果
以上のように本考案によれば、第１及び第２の
遅延信号を出力する遅延線と、その遅延線の入力
信号、第１及び第２の遅延信号に基づいて第１及
び第２のコサイン特性を得ると共にその第１及び
第２のコサイン特性を合成する合成回路とを用い
ることによつて、全体としての遅延時間を短くし
得、かくして簡易な構成で容易に整合調整をなし
得るイコライザ回路を実現し得る。
遅延信号を出力する遅延線と、その遅延線の入力
信号、第１及び第２の遅延信号に基づいて第１及
び第２のコサイン特性を得ると共にその第１及び
第２のコサイン特性を合成する合成回路とを用い
ることによつて、全体としての遅延時間を短くし
得、かくして簡易な構成で容易に整合調整をなし
得るイコライザ回路を実現し得る。
第１図は本考案による再生イコライザ回路の一
実施例を示す接続図、第２図はそのコサインイコ
ライザ回路の特性を示す特性曲線図、第３図は従
来の再生イコライザ回路を示す接続図、第４図及
び第５図はその第１及び第２のコサインイコライ
ザの特性を示す特性曲線図、第６図〜第８図は再
生イコライザ回路の各信号の周波数スペクトラム
を示す分布図である。 １０……再生イコライザ回路、１１……駆動増
幅回路、１２……マツチング回路、１３……遅延
線、１４……反転増幅回路、１５，１６……増幅
回路、１７……加算回路。
実施例を示す接続図、第２図はそのコサインイコ
ライザ回路の特性を示す特性曲線図、第３図は従
来の再生イコライザ回路を示す接続図、第４図及
び第５図はその第１及び第２のコサインイコライ
ザの特性を示す特性曲線図、第６図〜第８図は再
生イコライザ回路の各信号の周波数スペクトラム
を示す分布図である。 １０……再生イコライザ回路、１１……駆動増
幅回路、１２……マツチング回路、１３……遅延
線、１４……反転増幅回路、１５，１６……増幅
回路、１７……加算回路。
Claims (1)
- 【実用新案登録請求の範囲】 入力信号に対して第１の遅延時間だけ遅延した
第１の遅延信号及び当該第１の遅延時間より短い
第２の遅延時間だけ遅延した第２の遅延信号を出
力し、終端抵抗が開放された遅延線と、 上記第１及び第２の遅延信号に基づいて第１の
周波数にピークを有する第１のコサイン特性を
得、上記入力信号及び上記第１の遅延信号に基づ
いて上記第１の周波数より低い第２の周波数にピ
ークを有する第２のコサイン特性を得、上記第１
及び第２のコサイン特性を合成する合成回路と を具えることを特徴とするイコライザ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18442286U JPH0535669Y2 (ja) | 1986-11-28 | 1986-11-28 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18442286U JPH0535669Y2 (ja) | 1986-11-28 | 1986-11-28 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6390380U JPS6390380U (ja) | 1988-06-11 |
| JPH0535669Y2 true JPH0535669Y2 (ja) | 1993-09-09 |
Family
ID=31132079
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18442286U Expired - Lifetime JPH0535669Y2 (ja) | 1986-11-28 | 1986-11-28 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0535669Y2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2777520B2 (ja) * | 1993-02-23 | 1998-07-16 | グラフテック株式会社 | 記録信号入力装置 |
-
1986
- 1986-11-28 JP JP18442286U patent/JPH0535669Y2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6390380U (ja) | 1988-06-11 |
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