JPH05336171A - 情報送信装置 - Google Patents
情報送信装置Info
- Publication number
- JPH05336171A JPH05336171A JP4144208A JP14420892A JPH05336171A JP H05336171 A JPH05336171 A JP H05336171A JP 4144208 A JP4144208 A JP 4144208A JP 14420892 A JP14420892 A JP 14420892A JP H05336171 A JPH05336171 A JP H05336171A
- Authority
- JP
- Japan
- Prior art keywords
- data
- section
- parallel
- timing control
- information processing
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Communication Control (AREA)
- Maintenance And Management Of Digital Transmission (AREA)
- Mobile Radio Communication Systems (AREA)
Abstract
(57)【要約】
【目的】 送信すべき情報を編集する情報処理部の負荷
を低減させ高速情報送信を可能とし、また、試験データ
送信時には、情報処理部からのデータを並列／直列変換
した信号のみをタイミング制御部で選択させ、伝送誤り
率等を測定することに有用な試験データの送信を可能に
する。 【構成】 情報処理部１は、送信すべき情報を編集し、
タイミング制御部４から要求を受けると、先入先出メモ
リ２に一度にデータを出力する。タイミング制御部４か
らの変換タイミング信号ごとに先入先出メモリ２から入
力されたデータを並列／直列変換部３で変換し、タイミ
ング制御部４へ出力する。タイミング制御部４は、並列
／直列変換部３から入力されるデータ９、同期信号発生
部５から入力された同期信号８、アイドル信号発生部６
から入力されたアイドル信号10のうち一つの信号を選択
し、所定のフォーマットの形式で、送信部７に出力す
る。
を低減させ高速情報送信を可能とし、また、試験データ
送信時には、情報処理部からのデータを並列／直列変換
した信号のみをタイミング制御部で選択させ、伝送誤り
率等を測定することに有用な試験データの送信を可能に
する。 【構成】 情報処理部１は、送信すべき情報を編集し、
タイミング制御部４から要求を受けると、先入先出メモ
リ２に一度にデータを出力する。タイミング制御部４か
らの変換タイミング信号ごとに先入先出メモリ２から入
力されたデータを並列／直列変換部３で変換し、タイミ
ング制御部４へ出力する。タイミング制御部４は、並列
／直列変換部３から入力されるデータ９、同期信号発生
部５から入力された同期信号８、アイドル信号発生部６
から入力されたアイドル信号10のうち一つの信号を選択
し、所定のフォーマットの形式で、送信部７に出力す
る。
Description
【０００１】
【産業上の利用分野】本発明は、道路側等に設置して、
ナビゲーションシステム等の車載装置に位置等の情報を
提供する情報送信装置に関するものである。
ナビゲーションシステム等の車載装置に位置等の情報を
提供する情報送信装置に関するものである。
【０００２】
【従来の技術】図３は従来の情報送信装置の構成を示す
ブロック図であり、図３において、１は情報処理部であ
り、並列／直列変換部３に接続されている。４はタイミ
ング制御部であり、情報処理部１、並列／直列変換部
３、同期信号発生部５、アイドル信号発生部６ととも
に、送信部７に接続されている。
ブロック図であり、図３において、１は情報処理部であ
り、並列／直列変換部３に接続されている。４はタイミ
ング制御部であり、情報処理部１、並列／直列変換部
３、同期信号発生部５、アイドル信号発生部６ととも
に、送信部７に接続されている。
【０００３】図４は、送信情報のフォーマットの一例を
示し、図４において、８は同期信号、９はデータ、10は
アイドル信号である。
示し、図４において、８は同期信号、９はデータ、10は
アイドル信号である。
【０００４】次に上記従来例の動作について説明する。
情報処理部１は、送信すべき情報を編集し、タイミング
制御部４から要求を受けるごとに、並列／直列変換部３
にデータ９を出力する。並列／直列変換部３は、タイミ
ング制御部４からの変換タイミング信号ごとに情報処理
部１から入力されたデータを並列／直列変換し、タイミ
ング制御部４へ出力する。
情報処理部１は、送信すべき情報を編集し、タイミング
制御部４から要求を受けるごとに、並列／直列変換部３
にデータ９を出力する。並列／直列変換部３は、タイミ
ング制御部４からの変換タイミング信号ごとに情報処理
部１から入力されたデータを並列／直列変換し、タイミ
ング制御部４へ出力する。
【０００５】同期信号発生部５は、同期信号８を発生さ
せ、タイミング制御部４へ出力する。アイドル信号発生
部６は、アイドル信号10を発生させ、タイミング制御部
４へ出力する。タイミング制御部４は、並列／直列変換
部３から入力されたデータ９、同期信号発生部５から入
力された同期信号８、アイドル信号発生部６から入力さ
れたアイドル信号10のうち一つの信号を選択し、図４の
フォーマットの形式で、送信部７に出力する。
せ、タイミング制御部４へ出力する。アイドル信号発生
部６は、アイドル信号10を発生させ、タイミング制御部
４へ出力する。タイミング制御部４は、並列／直列変換
部３から入力されたデータ９、同期信号発生部５から入
力された同期信号８、アイドル信号発生部６から入力さ
れたアイドル信号10のうち一つの信号を選択し、図４の
フォーマットの形式で、送信部７に出力する。
【０００６】即ち、同期信号８のタイミングには、同期
信号発生部５から入力された同期信号８を選択し、デー
タ９のタイミングには、並列／直列変換部３から入力さ
れたデータを選択し、アイドル信号10のタイミングに
は、アイドル信号発生部６から入力されたアイドル信号
10を選択する。送信部７は、タイミング制御部４から入
力された上記各信号８，９，10により変調し、送信す
る。
信号発生部５から入力された同期信号８を選択し、デー
タ９のタイミングには、並列／直列変換部３から入力さ
れたデータを選択し、アイドル信号10のタイミングに
は、アイドル信号発生部６から入力されたアイドル信号
10を選択する。送信部７は、タイミング制御部４から入
力された上記各信号８，９，10により変調し、送信す
る。
【０００７】
【発明が解決しようとする課題】しかしながら、上記従
来の構成では、情報処理部１は、送信すべき情報を編集
し、タイミング制御部４から要求を受けるごとに、並列
／直列変換部３にデータ９を出力しなければならないと
いう、処理速度の問題があった。
来の構成では、情報処理部１は、送信すべき情報を編集
し、タイミング制御部４から要求を受けるごとに、並列
／直列変換部３にデータ９を出力しなければならないと
いう、処理速度の問題があった。
【０００８】また、伝送誤り率等を測定する場合には、
511ビット疑似ランダムパターン信号等の試験データ発
生装置を、送信部７へ接続しなければならないという問
題があった。
511ビット疑似ランダムパターン信号等の試験データ発
生装置を、送信部７へ接続しなければならないという問
題があった。
【０００９】本発明は上記従来の情報送信装置の問題点
である情報処理速度の向上及び伝送誤り率を測定するこ
とに有用な試験データの送信も可能とすることを目的と
する
である情報処理速度の向上及び伝送誤り率を測定するこ
とに有用な試験データの送信も可能とすることを目的と
する
【００１０】。
【課題を解決するための手段】本発明は、上記目的を達
成するため、情報処理部からの一定量のデータを蓄積す
るメモリ部と、蓄積された並列データの並列／直列変換
部とを有し、情報処理部の負荷を低減したものである。
成するため、情報処理部からの一定量のデータを蓄積す
るメモリ部と、蓄積された並列データの並列／直列変換
部とを有し、情報処理部の負荷を低減したものである。
【００１１】また、試験データと、試験データ送信の要
求スイッチと、試験データ送信時には情報処理部からの
データを並列／直列変換した信号のみをタイミング制御
部で選択させ、伝送誤り率等を測定することに有用な試
験データの送信も可能としたものである。
求スイッチと、試験データ送信時には情報処理部からの
データを並列／直列変換した信号のみをタイミング制御
部で選択させ、伝送誤り率等を測定することに有用な試
験データの送信も可能としたものである。
【００１２】
【作用】したがって、本発明によれば、情報処理部から
の一定量のデータを蓄積するメモリ部と、蓄積され並列
データの並列／直列変換部とを有しているので、タイミ
ング制御部からの要求ごとにデータを出力するのでな
く、一度にデータを出力することができるので、データ
出力後に次の情報編集ができ、高速情報送信できるとい
う効果を有する。
の一定量のデータを蓄積するメモリ部と、蓄積され並列
データの並列／直列変換部とを有しているので、タイミ
ング制御部からの要求ごとにデータを出力するのでな
く、一度にデータを出力することができるので、データ
出力後に次の情報編集ができ、高速情報送信できるとい
う効果を有する。
【００１３】また、試験データと、その試験データ送信
の要求スイッチと、試験データ送信時には情報処理部か
らのデータを並列／直列変換した信号のみをタイミング
制御部で選択させ、伝送誤り率等を測定することに有用
な試験データの送信もできるという効果を有する。
の要求スイッチと、試験データ送信時には情報処理部か
らのデータを並列／直列変換した信号のみをタイミング
制御部で選択させ、伝送誤り率等を測定することに有用
な試験データの送信もできるという効果を有する。
【００１４】
【実施例】図１は本発明の第１の実施例の構成を示すブ
ロック図である。図１において、２は先入先出(ＦＩＦ
Ｏ：First In First Out)メモリであり、情報処理部１
からの一定量のデータを蓄積する。その他、前記図３の
従来例と同一の構成要素には同じ番号を付し、その説明
を省略する。
ロック図である。図１において、２は先入先出(ＦＩＦ
Ｏ：First In First Out)メモリであり、情報処理部１
からの一定量のデータを蓄積する。その他、前記図３の
従来例と同一の構成要素には同じ番号を付し、その説明
を省略する。
【００１５】次に上記第１の実施例の動作について説明
する。情報処理部１は、送信すべき情報を編集し、タイ
ミング制御部４から要求を受けると、先入先出メモリ２
に一度にデータを出力する。先入先出メモリ２は、タイ
ミング制御部４から要求を受けるごとに、並列／直列変
換部３にデータを出力する。並列／直列変換部３は、タ
イミング制御部４からの変換タイミング信号ごとに先入
先出メモリ２から入力されたデータを並列／直列変換
し、タイミング制御部４へ出力する。
する。情報処理部１は、送信すべき情報を編集し、タイ
ミング制御部４から要求を受けると、先入先出メモリ２
に一度にデータを出力する。先入先出メモリ２は、タイ
ミング制御部４から要求を受けるごとに、並列／直列変
換部３にデータを出力する。並列／直列変換部３は、タ
イミング制御部４からの変換タイミング信号ごとに先入
先出メモリ２から入力されたデータを並列／直列変換
し、タイミング制御部４へ出力する。
【００１６】同期信号発生部５は、同期信号８を発生さ
せ、タイミング制御部４へ出力する。アイドル信号発生
部６は、アイドル信号10を発生させ、タイミング制御部
４へ出力する。タイミング制御部４は、並列／直列変換
部３から入力されたデータ９、同期信号発生部５から入
力された同期信号８、アイドル信号発生部６から入力さ
れたアイドル信号10のうち一つの信号を選択し、前記図
４のフォーマットの形式で、送信部７に出力する。
せ、タイミング制御部４へ出力する。アイドル信号発生
部６は、アイドル信号10を発生させ、タイミング制御部
４へ出力する。タイミング制御部４は、並列／直列変換
部３から入力されたデータ９、同期信号発生部５から入
力された同期信号８、アイドル信号発生部６から入力さ
れたアイドル信号10のうち一つの信号を選択し、前記図
４のフォーマットの形式で、送信部７に出力する。
【００１７】即ち、同期信号８のタイミングには、同期
信号発生部５から入力された同期信号８を選択し、デー
タ９のタイミングには、並列／直列変換部３から入力デ
ータ９を選択し、アイドル信号10のタイミングには、ア
イドル信号発生部６から入力されたアイドル信号10を選
択し、送信部７は、タイミング制御部４から入力された
上記信号８，９，10により変調し、送信する。
信号発生部５から入力された同期信号８を選択し、デー
タ９のタイミングには、並列／直列変換部３から入力デ
ータ９を選択し、アイドル信号10のタイミングには、ア
イドル信号発生部６から入力されたアイドル信号10を選
択し、送信部７は、タイミング制御部４から入力された
上記信号８，９，10により変調し、送信する。
【００１８】このように、上記第１の実施例によれば、
タイミング制御部４からの要求ごとにデータを出力する
のでなく、一度にデータを出力することができ、データ
出力後に次の情報編集ができるので、高速情報送信でき
るという利点を有する。
タイミング制御部４からの要求ごとにデータを出力する
のでなく、一度にデータを出力することができ、データ
出力後に次の情報編集ができるので、高速情報送信でき
るという利点を有する。
【００１９】図２は本発明の第２の実施例の構成を示す
ブロック図である。図２において、11は試験データ要求
スイッチであり、情報処理部１に接続されている。12は
試験用固定データであり、情報処理部１に接続されてい
る。その他の構成要素は前記図１と同様であり、その説
明を省略する。
ブロック図である。図２において、11は試験データ要求
スイッチであり、情報処理部１に接続されている。12は
試験用固定データであり、情報処理部１に接続されてい
る。その他の構成要素は前記図１と同様であり、その説
明を省略する。
【００２０】次に上記第２の実施例の動作について説明
する。情報処理部１は、試験データ要求スイッチ11の内
容を読み取り、要求が無い場合には、送信すべき情報を
編集し、タイミング制御部４から要求を受けると、先入
先出メモリ２に一度にデータを出力する。先入先出メモ
リ２は、タイミング制御部４から要求を受けるごとに、
並列／直列変換部３にデータを出力する。並列／直列変
換部３は、タイミング制御部４からの変換タイミング信
号ごとに先入先出メモリ２から入力されたデータを並列
／直列変換し、タイミング制御部４へ出力する。
する。情報処理部１は、試験データ要求スイッチ11の内
容を読み取り、要求が無い場合には、送信すべき情報を
編集し、タイミング制御部４から要求を受けると、先入
先出メモリ２に一度にデータを出力する。先入先出メモ
リ２は、タイミング制御部４から要求を受けるごとに、
並列／直列変換部３にデータを出力する。並列／直列変
換部３は、タイミング制御部４からの変換タイミング信
号ごとに先入先出メモリ２から入力されたデータを並列
／直列変換し、タイミング制御部４へ出力する。
【００２１】同期信号発生部５は、同期信号８を発生さ
せ、タイミング制御部４へ出力する。アイドル信号発生
部６は、アイドル信号10を発生させ、タイミング制御部
４へ出力する。タイミング制御部４は、並列／直列変換
部３から入力されたデータ９、同期信号発生部５から入
力された同期信号８、アイドル信号発生部６から入力さ
れたアイドル信号10のうち一つの信号を選択し、前記図
４のフォーマットの形式で、送信部７に出力する。
せ、タイミング制御部４へ出力する。アイドル信号発生
部６は、アイドル信号10を発生させ、タイミング制御部
４へ出力する。タイミング制御部４は、並列／直列変換
部３から入力されたデータ９、同期信号発生部５から入
力された同期信号８、アイドル信号発生部６から入力さ
れたアイドル信号10のうち一つの信号を選択し、前記図
４のフォーマットの形式で、送信部７に出力する。
【００２２】即ち、同期信号８のタイミングには、同期
信号発生部５から入力された同期信号８を選択し、デー
タ９のタイミングには、並列／直列変換部３から入力さ
れたデータ９を選択し、アイドル信号10のタイミングに
は、アイドル信号発生部６から入力されたアイドル信号
10を選択し、送信部７は、タイミング制御部４から入力
された上記各信号８，９，10により変調し、送信する。
信号発生部５から入力された同期信号８を選択し、デー
タ９のタイミングには、並列／直列変換部３から入力さ
れたデータ９を選択し、アイドル信号10のタイミングに
は、アイドル信号発生部６から入力されたアイドル信号
10を選択し、送信部７は、タイミング制御部４から入力
された上記各信号８，９，10により変調し、送信する。
【００２３】また、情報処理部１は、試験データ要求ス
イッチ11の内容を読み取り、要求が有る場合には、タイ
ミング制御部４を試験データの送信動作をするよう出力
し、試験用固定データ12を、タイミング制御部４から要
求を受けるごとに順番に、先入先出メモリ２にデータを
出力する。先入先出メモリ２は、タイミング制御部４か
ら要求を受けるごとに、並列／直列変換部３にデータを
出力する。並列／直列変換部３は、タイミング制御部４
からの変換タイミング信号ごとに先入先出メモリ２から
入力されたデータを並列／直列変換し、タイミング制御
部４へ出力する。
イッチ11の内容を読み取り、要求が有る場合には、タイ
ミング制御部４を試験データの送信動作をするよう出力
し、試験用固定データ12を、タイミング制御部４から要
求を受けるごとに順番に、先入先出メモリ２にデータを
出力する。先入先出メモリ２は、タイミング制御部４か
ら要求を受けるごとに、並列／直列変換部３にデータを
出力する。並列／直列変換部３は、タイミング制御部４
からの変換タイミング信号ごとに先入先出メモリ２から
入力されたデータを並列／直列変換し、タイミング制御
部４へ出力する。
【００２４】タイミング制御部４は、並列／直列変換部
３から入力された信号を送信部７に出力する。送信部７
は、タイミング制御部４から入力された信号により変調
し、送信する。
３から入力された信号を送信部７に出力する。送信部７
は、タイミング制御部４から入力された信号により変調
し、送信する。
【００２５】このように、上記第２の実施例によれば、
試験データと、試験データ送信の要求手段と、試験デー
タ送信時には情報処理部からのデータを並列／直列変換
した信号のみをタイミング制御部で選択させる手段とを
有しているので、伝送誤り率等を測定することに有用な
試験データの送信もできるという利点を有する。
試験データと、試験データ送信の要求手段と、試験デー
タ送信時には情報処理部からのデータを並列／直列変換
した信号のみをタイミング制御部で選択させる手段とを
有しているので、伝送誤り率等を測定することに有用な
試験データの送信もできるという利点を有する。
【００２６】
【発明の効果】以上説明したように本発明の情報送信装
置は、情報処理部からの一定量のデータを蓄積するメモ
リを有し、蓄積されたデータを並列／直列変換すること
により、タイミング制御部からの要求ごとにデータを出
力するのではなく、一度にデータを出力することができ
るので、データ出力後に次の情報編集ができ、高速情報
送信できるという効果を有する。
置は、情報処理部からの一定量のデータを蓄積するメモ
リを有し、蓄積されたデータを並列／直列変換すること
により、タイミング制御部からの要求ごとにデータを出
力するのではなく、一度にデータを出力することができ
るので、データ出力後に次の情報編集ができ、高速情報
送信できるという効果を有する。
【００２７】また、試験データと、試験データ送信の要
求スイッチと、試験データ送信時には情報処理部からの
データを並列／直列変換した信号のみをタイミング制御
部で選択させるので、伝送誤り率等を測定することに有
用な試験データの送信もできるという効果を有する。
求スイッチと、試験データ送信時には情報処理部からの
データを並列／直列変換した信号のみをタイミング制御
部で選択させるので、伝送誤り率等を測定することに有
用な試験データの送信もできるという効果を有する。
【図１】本発明の第１の実施例の構成を示すブロック図
である。
である。
【図２】本発明の第２の実施例の構成を示すブロック図
である。
である。
【図３】従来の情報送信装置の構成を示すブロック図で
ある。
ある。
【図４】送信装置のフォーマットの一例を示す図であ
る。
る。
１…情報処理部、 ２…先入先出メモリ、 ３…並列／
直列変換部、 ４…タイミング制御部、 ５…同期信号
発生部、 ６…アイドル信号発生部、 ７…送信部、
８…同期信号、 ９…データ、 10…アイドル信号、
11…試験データ要求スイッチ、 12…試験用固定デー
タ。
直列変換部、 ４…タイミング制御部、 ５…同期信号
発生部、 ６…アイドル信号発生部、 ７…送信部、
８…同期信号、 ９…データ、 10…アイドル信号、
11…試験データ要求スイッチ、 12…試験用固定デー
タ。
───────────────────────────────────────────────────── フロントページの続き (72)発明者 錦木 耕司 神奈川県横浜市港北区綱島東四丁目３番１ 号 松下通信工業株式会社内 (72)発明者 八重樫 賢治 神奈川県横浜市港北区綱島東四丁目３番１ 号 松下通信工業株式会社内
Claims (2)
- 【請求項１】 送信すべき情報を編集する情報処理部
と、前記情報処理部からの一定量のデータを蓄積するメ
モリ部と、蓄積された並列データの並列／直列変換部
と、同期信号発生部と、アイドル信号発生部と、情報・
同期信号・アイドル信号のうち１つを選択するタイミン
グ制御部と、前記タイミング制御部で選択された信号を
送信する送信部とを備え、前記情報処理部からの一定量
のデータを前記メモリ部に蓄積し、前記並列／直列変換
部にて並列／直列変換をすることにより前記情報処理部
の負荷を低減させたことを特徴とする情報送信装置。 - 【請求項２】 試験データ及びこの試験データの送信の
要求スイッチを情報処理部に有し、試験データ送信時に
は、情報処理部からのデータを並列／直列変換した信号
のみをタイミング制御部で選択させ、伝送誤り率等を測
定することに有用な試験データの送信を可能としたこと
を特徴とする請求項１記載の情報送信装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4144208A JPH05336171A (ja) | 1992-06-04 | 1992-06-04 | 情報送信装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4144208A JPH05336171A (ja) | 1992-06-04 | 1992-06-04 | 情報送信装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05336171A true JPH05336171A (ja) | 1993-12-17 |
Family
ID=15356747
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4144208A Pending JPH05336171A (ja) | 1992-06-04 | 1992-06-04 | 情報送信装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05336171A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2010067474A1 (ja) * | 2008-12-08 | 2010-06-17 | 株式会社アドバンテスト | 試験装置および試験方法 |
-
1992
- 1992-06-04 JP JP4144208A patent/JPH05336171A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2010067474A1 (ja) * | 2008-12-08 | 2010-06-17 | 株式会社アドバンテスト | 試験装置および試験方法 |
| TWI402521B (zh) * | 2008-12-08 | 2013-07-21 | Advantest Corp | 測試裝置與測試方法 |
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