JPH05211524A - 信号断検出方法 - Google Patents
信号断検出方法Info
- Publication number
- JPH05211524A JPH05211524A JP4015857A JP1585792A JPH05211524A JP H05211524 A JPH05211524 A JP H05211524A JP 4015857 A JP4015857 A JP 4015857A JP 1585792 A JP1585792 A JP 1585792A JP H05211524 A JPH05211524 A JP H05211524A
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- JP
- Japan
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- circuit
- output
- signal
- input
- data
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- Dc Digital Transmission (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
Abstract
(57)【要約】
【目的】 タンク回路の出力にて信号断を検出する信号
断検出方法に関し、ディジタル微分回路１に入力する雑
音が多くとも、入力信号断を間違いなく検出する信号断
検出方法の提供を目的とする。 【構成】 入力したデータより周波数成分を抽出するデ
ィジタル微分回路１の出力を、タンク回路２に入力し、
タンク回路２の出力を入力する信号断検出回路３にて信
号断を検出するに際し、ディジタル微分回路１の出力
と、ディジタル微分回路１内の１／２周期遅延させたデ
ータが入力するＥＸーＯＲ回路４と、ＥＸーＯＲ回路４
の出力とディジタル微分回路１への入力データが入力す
るＥＸーＯＲ回路５とを設け、ＥＸーＯＲ回路５の出力
をピーク整流し、大小判定手段６にてピーク整流した値
が所定の値よりも大きいかどうかを判定し、大きい時は
タンク回路２より出力が発生しても信号断検出回路３は
信号断と判定する構成とする。
断検出方法に関し、ディジタル微分回路１に入力する雑
音が多くとも、入力信号断を間違いなく検出する信号断
検出方法の提供を目的とする。 【構成】 入力したデータより周波数成分を抽出するデ
ィジタル微分回路１の出力を、タンク回路２に入力し、
タンク回路２の出力を入力する信号断検出回路３にて信
号断を検出するに際し、ディジタル微分回路１の出力
と、ディジタル微分回路１内の１／２周期遅延させたデ
ータが入力するＥＸーＯＲ回路４と、ＥＸーＯＲ回路４
の出力とディジタル微分回路１への入力データが入力す
るＥＸーＯＲ回路５とを設け、ＥＸーＯＲ回路５の出力
をピーク整流し、大小判定手段６にてピーク整流した値
が所定の値よりも大きいかどうかを判定し、大きい時は
タンク回路２より出力が発生しても信号断検出回路３は
信号断と判定する構成とする。
Description
【０００１】
【産業上の利用分野】本発明は、通信システムの中継器
のタイミング検出回路等の、タンク回路の出力を信号断
検出回路にて信号断を検出する信号断検出方法の改良に
関する。
のタイミング検出回路等の、タンク回路の出力を信号断
検出回路にて信号断を検出する信号断検出方法の改良に
関する。
【０００２】
【従来の技術】図４は従来例の中継器のブロック図であ
る。図４では、等化増幅回路７にて信号の線路損失を等
化増幅し、識別回路８に送ると共にディジタル微分回路
１に入力する。
る。図４では、等化増幅回路７にて信号の線路損失を等
化増幅し、識別回路８に送ると共にディジタル微分回路
１に入力する。
【０００３】ディジタル微分回路１では、入力信号と、
入力信号を１／２周期遅延回路１０にて遅延した信号と
の排他的論理和回路（以下ＥＸーＯＲ回路と称す）１１
に入力して排他的論理和をとり、データの周波数成分を
抽出し、データの周波数ｆ0成分のみタンク回路２に入
力し、周波数ｆ0 の信号を出力させリミッタ回路９に送
り、リミッタ回路９にて周波数ｆ0 の成分の振幅を制限
してクロックを作成し識別回路８に送り、識別回路８に
て１，０を判定し、再生した１，０の信号を出力する。
入力信号を１／２周期遅延回路１０にて遅延した信号と
の排他的論理和回路（以下ＥＸーＯＲ回路と称す）１１
に入力して排他的論理和をとり、データの周波数成分を
抽出し、データの周波数ｆ0成分のみタンク回路２に入
力し、周波数ｆ0 の信号を出力させリミッタ回路９に送
り、リミッタ回路９にて周波数ｆ0 の成分の振幅を制限
してクロックを作成し識別回路８に送り、識別回路８に
て１，０を判定し、再生した１，０の信号を出力する。
【０００４】信号断検出回路３’ではリミッタ回路９へ
の入力を監視しタンク回路２の出力が略０になった時中
継器への入力信号断とし信号断信号を出力している。
の入力を監視しタンク回路２の出力が略０になった時中
継器への入力信号断とし信号断信号を出力している。
【０００５】
【発明が解決しようとする課題】しかしながら、ディジ
タル微分回路１に入力する雑音が多い時は、中継器の入
力信号断でも、タンク回路２より周波数ｆ0 の信号が発
生し、信号断検出回路３’では、中継器への入力信号が
断であるに関わらず信号断と判定せず誤動作する問題点
がある。
タル微分回路１に入力する雑音が多い時は、中継器の入
力信号断でも、タンク回路２より周波数ｆ0 の信号が発
生し、信号断検出回路３’では、中継器への入力信号が
断であるに関わらず信号断と判定せず誤動作する問題点
がある。
【０００６】本発明はディジタル微分回路１に入力する
雑音が多くとも、入力信号断の時は間違いなく信号断と
判定する信号断検出方法の提供を目的としている。
雑音が多くとも、入力信号断の時は間違いなく信号断と
判定する信号断検出方法の提供を目的としている。
【０００７】
【課題を解決するための手段】図１は本発明の原理ブロ
ック図である。図１に示す如く、入力したデータと、該
データを１／２周期遅延させたデータとの排他的論理和
をとり、データの周波数成分を抽出するディジタル微分
回路１の出力を、該データ周波数のタンク回路２に入力
し、該タンク回路２の出力を入力する信号断検出回路３
にて信号断を検出するに際し、該ディジタル微分回路１
の出力と、該ディジタル微分回路１内の１／２周期遅延
させたデータが入力する第１のＥＸーＯＲ回路４と、該
第１のＥＸーＯＲ回路４の出力と該ディジタル微分回路
１への入力データが入力する第２のＥＸーＯＲ回路５と
を設け、該第２のＥＸーＯＲ回路５の出力をピーク整流
し、大小判定手段６にてピーク整流した値が所定の値よ
りも大きいかどうかを判定し、大きい時は該タンク回路
２より出力が発生しても該信号断検出回路３は信号断と
判定するようにする。
ック図である。図１に示す如く、入力したデータと、該
データを１／２周期遅延させたデータとの排他的論理和
をとり、データの周波数成分を抽出するディジタル微分
回路１の出力を、該データ周波数のタンク回路２に入力
し、該タンク回路２の出力を入力する信号断検出回路３
にて信号断を検出するに際し、該ディジタル微分回路１
の出力と、該ディジタル微分回路１内の１／２周期遅延
させたデータが入力する第１のＥＸーＯＲ回路４と、該
第１のＥＸーＯＲ回路４の出力と該ディジタル微分回路
１への入力データが入力する第２のＥＸーＯＲ回路５と
を設け、該第２のＥＸーＯＲ回路５の出力をピーク整流
し、大小判定手段６にてピーク整流した値が所定の値よ
りも大きいかどうかを判定し、大きい時は該タンク回路
２より出力が発生しても該信号断検出回路３は信号断と
判定するようにする。
【０００８】
【作用】ディジタル微分回路１に図３（Ａ）に示す如き
ディジタル信号が入力すると、１／２周期遅延させた信
号は図３（Ｂ）に示す如くなり、ディジタル微分回路１
の出力は図３（Ｃ）に示す如くデータの周波数成分を抽
出した信号となり、ＥＸーＯＲ回路４の出力は図３
（Ｄ）に示す如く、図３（Ａ）に示す入力信号と同じに
なり、ＥＸーＯＲ回路５の出力は図３（Ｅ）に示す如く
０レベルとなる。
ディジタル信号が入力すると、１／２周期遅延させた信
号は図３（Ｂ）に示す如くなり、ディジタル微分回路１
の出力は図３（Ｃ）に示す如くデータの周波数成分を抽
出した信号となり、ＥＸーＯＲ回路４の出力は図３
（Ｄ）に示す如く、図３（Ａ）に示す入力信号と同じに
なり、ＥＸーＯＲ回路５の出力は図３（Ｅ）に示す如く
０レベルとなる。
【０００９】即ち、ＥＸーＯＲ回路５の出力は正常な信
号が入力している時及び入力が断の時は０レベルとなる
も、雑音入力の場合はディジタル微分回路１は誤動作
し、ＥＸーＯＲ回路５の出力は０レベルになったり，１
レベルになったり不安定となる。
号が入力している時及び入力が断の時は０レベルとなる
も、雑音入力の場合はディジタル微分回路１は誤動作
し、ＥＸーＯＲ回路５の出力は０レベルになったり，１
レベルになったり不安定となる。
【００１０】本発明は上記の原理を利用したもので、Ｅ
ＸーＯＲ回路５の出力をピーク整流し、大小判定手段６
にてピーク整流した値が所定の値よりも大きいかどうか
を判定し、大きい時は該タンク回路２より出力が発生し
ても該信号断検出回路３は信号断と判定するようにす
る。
ＸーＯＲ回路５の出力をピーク整流し、大小判定手段６
にてピーク整流した値が所定の値よりも大きいかどうか
を判定し、大きい時は該タンク回路２より出力が発生し
ても該信号断検出回路３は信号断と判定するようにす
る。
【００１１】このようにすれば、入力信号が断で入力雑
音が多くとも信号断検出回路３は間違いなく信号断を検
出する。
音が多くとも信号断検出回路３は間違いなく信号断を検
出する。
【００１２】
【実施例】図２は本発明の実施例の中継器のブロック
図、図３は図２の各部のタイムチャートで（Ａ）〜
（Ｅ）は図２のａ〜ｅ点に対応している。
図、図３は図２の各部のタイムチャートで（Ａ）〜
（Ｅ）は図２のａ〜ｅ点に対応している。
【００１３】図２で図４の従来例と異なる点は、ＥＸー
ＯＲ回路４，５、ピーク整流するコンデンサＣ、オペア
ンプ６を設け、オペアンプ６の出力にて信号断検出回路
３を制御するようにした点であるので、この異なる点を
中心に以下説明する。
ＯＲ回路４，５、ピーク整流するコンデンサＣ、オペア
ンプ６を設け、オペアンプ６の出力にて信号断検出回路
３を制御するようにした点であるので、この異なる点を
中心に以下説明する。
【００１４】ディジタル微分回路１に図３（Ａ）に示す
如きディジタル信号が入力すると、Ｔ／２遅延回路１０
（Ｔはディジタル信号の周期）の出力は図３（Ｂ）に示
す如くなり、ＥＸーＯＲ回路１１の出力は図３（Ｃ）に
示す如くデータの周波数成分を抽出した信号となり、Ｅ
ＸーＯＲ回路４の出力は図３（Ｄ）に示す如く、図３
（Ａ）に示す入力信号と同じになり、ＥＸーＯＲ回路５
の出力は図３（Ｅ）に示す如く０レベルとなる。
如きディジタル信号が入力すると、Ｔ／２遅延回路１０
（Ｔはディジタル信号の周期）の出力は図３（Ｂ）に示
す如くなり、ＥＸーＯＲ回路１１の出力は図３（Ｃ）に
示す如くデータの周波数成分を抽出した信号となり、Ｅ
ＸーＯＲ回路４の出力は図３（Ｄ）に示す如く、図３
（Ａ）に示す入力信号と同じになり、ＥＸーＯＲ回路５
の出力は図３（Ｅ）に示す如く０レベルとなる。
【００１５】即ち、ＥＸーＯＲ回路５の出力は正常な信
号が入力している時及び入力が断の時は０レベルとなる
も、雑音入力の場合はディジタル微分回路１は誤動作
し、ＥＸーＯＲ回路５の出力は０レベルになったり，１
レベルになったり不安定となる。
号が入力している時及び入力が断の時は０レベルとなる
も、雑音入力の場合はディジタル微分回路１は誤動作
し、ＥＸーＯＲ回路５の出力は０レベルになったり，１
レベルになったり不安定となる。
【００１６】従って、コンデンサＣにてピーク整流した
信号は、正常な信号が入力している時及び入力が断の時
は０レベル相当の電圧で、雑音のみ入力の場合は０レベ
ル相当の電圧と１レベル相当の電圧の間の電圧となる。
信号は、正常な信号が入力している時及び入力が断の時
は０レベル相当の電圧で、雑音のみ入力の場合は０レベ
ル相当の電圧と１レベル相当の電圧の間の電圧となる。
【００１７】そこで、オペアンプ６にて０レベル相当の
電圧より僅か大きい電圧を参照電圧Ｖref とし、これと
入力電圧と比較し、小さい時は正常な信号が入力してい
るか入力が断の、正常と判定し、大きい時は入力信号断
で雑音が入力している雑音入力と判定し、判定信号を信
号断検出回路３に送り、信号断検出回路３では、正常の
判定信号入力時は、タンク回路２の出力をリミッタ回路
９に送るも出力がない時は信号断の信号を出力し、雑音
入力の判定信号入力時はタンク回路２の出力があっても
リミッタ回路９に送らず、信号断の信号を出力する。
電圧より僅か大きい電圧を参照電圧Ｖref とし、これと
入力電圧と比較し、小さい時は正常な信号が入力してい
るか入力が断の、正常と判定し、大きい時は入力信号断
で雑音が入力している雑音入力と判定し、判定信号を信
号断検出回路３に送り、信号断検出回路３では、正常の
判定信号入力時は、タンク回路２の出力をリミッタ回路
９に送るも出力がない時は信号断の信号を出力し、雑音
入力の判定信号入力時はタンク回路２の出力があっても
リミッタ回路９に送らず、信号断の信号を出力する。
【００１８】即ち、入力信号が断で入力雑音が多くとも
信号断検出回路３は間違いなく信号断を検出する。
信号断検出回路３は間違いなく信号断を検出する。
【００１９】
【発明の効果】以上詳細に説明せる如く本発明によれ
ば、ディジタル微分回路に入力する雑音が多くとも、入
力信号断の時は間違いなく信号断と判定する効果があ
る。
ば、ディジタル微分回路に入力する雑音が多くとも、入
力信号断の時は間違いなく信号断と判定する効果があ
る。
【図１】は本発明の原理ブロック図、
【図２】は本発明の実施例の中継器のブロック図、
【図３】は図２の各部のタイムチャート、
【図４】は従来例の中継器のブロック図である。
１はディジタル微分回路、２はタンク回路、３，３’は
信号断検出回路、４，５，１１は排他的論理和回路、６
はオペアンプ、７は等化増幅回路、８は識別回路、９は
リミッタ回路、１０はＴ／２遅延回路、Ｃはコンデンサ
を示す。
信号断検出回路、４，５，１１は排他的論理和回路、６
はオペアンプ、７は等化増幅回路、８は識別回路、９は
リミッタ回路、１０はＴ／２遅延回路、Ｃはコンデンサ
を示す。
Claims (1)
- 【請求項１】 入力したデータと、該データを１／２周
期遅延させたデータとの排他的論理和をとり、データの
周波数成分を抽出するディジタル微分回路（１）の出力
を、該データ周波数のタンク回路（２）に入力し、該タ
ンク回路（２）の出力を入力する信号断検出回路（３）
にて信号断を検出するに際し、 該ディジタル微分回路（１）の出力と、該ディジタル微
分回路（１）内の１／２周期遅延させたデータが入力す
る第１の排他的論理和回路（４）と、該第１の排他的論
理和回路（４）の出力と該ディジタル微分回路（１）へ
の入力データが入力する第２の排他的論理和回路（５）
とを設け、該第２の排他的論理和回路（５）の出力をピ
ーク整流し、大小判定手段（６）にてピーク整流した値
が所定の値よりも大きいかどうかを判定し、大きい時は
該タンク回路（２）より出力が発生しても該信号断検出
回路（３）は信号断と判定するようにしたことを特徴と
する信号断検出方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4015857A JPH05211524A (ja) | 1992-01-31 | 1992-01-31 | 信号断検出方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4015857A JPH05211524A (ja) | 1992-01-31 | 1992-01-31 | 信号断検出方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05211524A true JPH05211524A (ja) | 1993-08-20 |
Family
ID=11900476
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4015857A Withdrawn JPH05211524A (ja) | 1992-01-31 | 1992-01-31 | 信号断検出方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05211524A (ja) |
-
1992
- 1992-01-31 JP JP4015857A patent/JPH05211524A/ja not_active Withdrawn
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19990408 |