JPH05209738A - 位置変動検出回路 - Google Patents

位置変動検出回路

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JPH05209738A
JPH05209738A JP32583891A JP32583891A JPH05209738A JP H05209738 A JPH05209738 A JP H05209738A JP 32583891 A JP32583891 A JP 32583891A JP 32583891 A JP32583891 A JP 32583891A JP H05209738 A JPH05209738 A JP H05209738A
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JP
Japan
Prior art keywords
pulse
circuit
maximum value
latch
data
Prior art date
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Withdrawn
Application number
JP32583891A
Other languages
English (en)
Inventor
Koji Kawakatsu
浩司 川勝
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NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
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Abstract

(57)【要約】 【目的】位置決め制御における位置変動量を位置検出器
の出力パルスをもとに検出する。 【構成】位置検出器２と検出器２から出力される位置検
出パルス信号ｃをカウントする現在位置カウンタ５と、
パルス信号ｃの遅延パルス信号ｄを生成する遅延パルス
生成回路３と、最大・最小データをラッチする最大値ラ
ッチ回路６、及び最小値ラッチ回路７と、前記データの
ラッチタイミングパルス信号ｈを生成するデータラッチ
パルス生成回路４と、現在位置と最大値を比較する最大
値比較回路８と、現在位置と最小値を比較する最小値比
較回路９と、位置変動検出フラグ信号ｂを出力し、最大
値ｉと最小値を読み込み変動量の演算を行うＣＰＵ１と
から構成される。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】本発明は位置変動検出回路、特
に、位置決め制御の位置変動検出回路に関する。
【０００２】
【従来の技術】従来の位置変動検出回路について図面を
参照して詳細に説明する。図３は、従来の一例を示すブ
ロック図である。
【０００３】図３に示す位置変動検出回路は、位置検出
器２から出力される位置検出パルスｃを現在位置カウン
タ５でカウントし、ＣＰＵ１で現在位置データをサンプ
リングする。前記サンプリングデータをＣＰＵ１で比較
演算を行い位置変動量を求める。
【０００４】
【発明が解決しようとする課題】上述した従来の位置変
動検出回路は、ＣＰＵで現在位置データをサンプリング
しているため、位置変動検出中はＣＰＵが他の処理を行
うことが出来ない、またサンプリング時間が長いと正確
な変動量が得られないという問題点があった。
【０００５】
【課題を解決するための手段】本発明の位置変動検出回
路は、位置検出器と前記位置検出器から出力されるパル
スをカウントする現在位置カウンタと、前記パルスの遅
延パルスを生成する遅延パルス生成回路と、最大・最小
データをラッチする最大値ラッチ回路、及び最小値ラッ
チ回路と、前記データのラッチタイミングパルスを生成
するデータラッチパルス生成回路と、現在位置と最大値
を比較する最大値比較回路と、現在位置と最小値を比較
する最小値比較回路と、位置変動検出を制御し最大値・
最小値を読み込み変動量の演算を行うＣＰＵとを含んで
構成される。
【０００６】
【実施例】次に、本発明について図面を参照して詳細に
説明する。図１は本発明の一実施例を示すブロック図で
ある。
【０００７】図１に示す位置変動検出回路は、位置検出
器２と検出器２から出力される位置検出パルス信号ｃを
カウントする現在位置カウンタ５と、パルス信号ｃの遅
延パルス信号ｄを生成する遅延パルス生成回路３と、最
大・最小データをラッチする最大値ラッチ回路６、及び
最小値ラッチ回路７と、前記データのラッチタイミング
パルス信号ｈを生成するデータラッチパルス生成回路４
と、現在位置と最大値を比較する最大値比較回路８と、
現在位置と最小値を比較する最小値比較回路９と、位置
変動検出フラグ信号ｂを出力し、最大値ｉと最小値を読
み込み変動量の演算を行うＣＰＵ１とから構成される。
【０００８】図２は最大値のラッチタイミングについて
説明するタイムチャートである。ＣＰＵ１から出力され
る検出フラグ信号ｂが立っている間だけ変動量の検出を
行う。最大値比較回路８から出力される現在位置＞最大
値信号ｇが立っている時、位置検出器２から出力される
位置検出パルス信号ｃと遅延パルス生成回路から出力さ
れる遅延パルス信号ｄとからデータラッチパルス生成回
路４で最大値ラッチパルス信号ｈを生成する。最大値ラ
ッチパルス信号ｈで最大値をラッチする。検出フラグ信
号ｂを降ろした後、ＣＰＵ１で最大値・最小値を読み込
み前記データの差分を求め位置変動量を検出する。
【０００９】
【発明の効果】本発明の位置変動検出回路は、位置検出
器の出力パルスである位置検出パルスをもとに変動量デ
ータをサンプリングしているため、位置変動検出中でも
ＣＰＵが他の処理を行うことができ、また正確な変動量
を検出できるという効果がある。
【図面の簡単な説明】
【図１】本発明の一実施例を示すブロック図である。
【図２】最大値のラッチタイミングについて説明するタ
イムチャートである。
【図３】従来の一例を示すブロック図である。
【符号の説明】
１ ＣＰＵ ２ 位置検出器、 ３ 遅延パルス生成回路 ４ データラッチパルス生成回路 ５ 現在位置カウンタ ６ 最大値ラッチ回路 ７ 最小値ラッチ回路 ８ 最大値比較回路 ９ 最小値比較回路 ａ ＣＬＲ信号 ｂ 検出フラグ ｃ 位置検出パルス ｄ 遅延パルス ｅ 初期値ラッチパルス ｇ 現在値＞最大値 ｈ 最大値ラッチパルス ｉ 最大値

Claims (1)

    【特許請求の範囲】
  1. 【請求項１】 位置検出器と前記位置検出器から出力さ
    れるパルスをカウントする現在位置カウンタと、前記パ
    ルスの遅延パルスを生成する遅延パルス生成回路と、最
    大・最小データをラッチする最大値ラッチ回路、及び最
    小値ラッチ回路と、前記データのラッチタイミングパル
    スを生成するデータラッチパルス生成回路と、現在位置
    と最大値を比較する最大値比較回路と、現在位置と最小
    値を比較する最小値比較回路と、位置変動検出を制御し
    最大値・最小値を読み込み変動量の演算を行うＣＰＵと
    を含むことを特徴とする位置変動検出回路。
JP32583891A 1991-12-10 1991-12-10 位置変動検出回路 Withdrawn JPH05209738A (ja)

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JPH05209738A true JPH05209738A (ja) 1993-08-20

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