JPH05189885A - デジタル信号記録媒体再生装置 - Google Patents
デジタル信号記録媒体再生装置Info
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- JPH05189885A JPH05189885A JP224492A JP224492A JPH05189885A JP H05189885 A JPH05189885 A JP H05189885A JP 224492 A JP224492 A JP 224492A JP 224492 A JP224492 A JP 224492A JP H05189885 A JPH05189885 A JP H05189885A
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- memory
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- digital signal
- circuit
- signal
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Abstract
(57)【要約】
【目的】 信号記録媒体の駆動速度偏差に強いデジタル
信号記録媒体再生装置を提供する。 【構成】 デジタル信号を信号処理回路１３により信号
処理して得られる情報データを、クロック再生回路１４
によりデジタル信号から得られるビットクロックに同期
させて前記信号処理回路１３から出力し、その情報デー
タが信号記録媒体１の駆動速度の変化に関係なく必然的
に前記ビットクロックに同期するようにするとともに、
前記信号処理回路１３から出力される情報データのみを
一旦記憶させる第２のメモリ１７を設け、該第２のメモ
リ１７からの情報データの読み出しを、基準発振器１９
から発生される水晶発振精度の基準クロックに同期させ
て行う。
信号記録媒体再生装置を提供する。 【構成】 デジタル信号を信号処理回路１３により信号
処理して得られる情報データを、クロック再生回路１４
によりデジタル信号から得られるビットクロックに同期
させて前記信号処理回路１３から出力し、その情報デー
タが信号記録媒体１の駆動速度の変化に関係なく必然的
に前記ビットクロックに同期するようにするとともに、
前記信号処理回路１３から出力される情報データのみを
一旦記憶させる第２のメモリ１７を設け、該第２のメモ
リ１７からの情報データの読み出しを、基準発振器１９
から発生される水晶発振精度の基準クロックに同期させ
て行う。
Description
【０００１】
【産業上の利用分野】本発明は、音楽情報等の情報デー
タの他に該情報データの誤り検出及び誤り訂正を行う誤
り検出・訂正用データが含まれるデジタル信号が記録さ
れた信号記録媒体の再生を行うデジタル信号記録媒体再
生装置に関する。
タの他に該情報データの誤り検出及び誤り訂正を行う誤
り検出・訂正用データが含まれるデジタル信号が記録さ
れた信号記録媒体の再生を行うデジタル信号記録媒体再
生装置に関する。
【０００２】
【従来の技術】デジタル信号により音楽情報等の情報デ
ータが記録されている信号記録媒体を再生するデジタル
信号記録媒体再生装置においては、代表的なものとして
ＣＤプレーヤが良く知られているが、この様なデジタル
信号を取り扱う再生装置は、再生を行う際に、抽出した
情報データを一旦メモリに記憶させ、該情報データを水
晶発振精度の基準クロックを用いて前記メモリから読み
出すことにより信号記録媒体の駆動速度偏差（例えはデ
ィスクの場合は回転偏差）に起因して生じる情報データ
の時間的なゆらぎ（ジッタ）を吸収することが出来る。
ータが記録されている信号記録媒体を再生するデジタル
信号記録媒体再生装置においては、代表的なものとして
ＣＤプレーヤが良く知られているが、この様なデジタル
信号を取り扱う再生装置は、再生を行う際に、抽出した
情報データを一旦メモリに記憶させ、該情報データを水
晶発振精度の基準クロックを用いて前記メモリから読み
出すことにより信号記録媒体の駆動速度偏差（例えはデ
ィスクの場合は回転偏差）に起因して生じる情報データ
の時間的なゆらぎ（ジッタ）を吸収することが出来る。
【０００３】ところで、ＣＤプレーヤを代表として現在
普及しているデジタル信号記録媒体再生装置としては、
音楽情報を扱うものは高音質を追求したものが多く、ビ
ット数及びサンプリング周波数の関係から現用されてい
る容量のメモリでは、ジッタマージンを大きくすること
が出来ないが、現用のメモリより容量大のメモリを使用
することによりジッタマージンを大きくすることが可能
である。ジッタマージンを大きくすることにより信号記
録媒体を定格速度で駆動する為のサーボ回路の周波数応
答を低速にすることが出来、その結果、前記サーボ回路
の消費電力を軽減させることが出来る。
普及しているデジタル信号記録媒体再生装置としては、
音楽情報を扱うものは高音質を追求したものが多く、ビ
ット数及びサンプリング周波数の関係から現用されてい
る容量のメモリでは、ジッタマージンを大きくすること
が出来ないが、現用のメモリより容量大のメモリを使用
することによりジッタマージンを大きくすることが可能
である。ジッタマージンを大きくすることにより信号記
録媒体を定格速度で駆動する為のサーボ回路の周波数応
答を低速にすることが出来、その結果、前記サーボ回路
の消費電力を軽減させることが出来る。
【０００４】
【発明が解決しようとする課題】ところで、デジタル信
号記録媒体には、一般的に情報データの他に該情報デー
タの誤り検出・訂正を行う為の誤り検出・訂正用データ
（パリティ）が一緒に記録されており、デジタル信号記
録媒体再生装置によりデジタル信号の特性である誤り検
出・訂正が行えるように成されている。その為、前述し
た如く、現用のメモリの容量を大としても該メモリはデ
ジタル信号を信号処理する為に用いられるものであり、
情報データ以外のデータも書き込まれるので、容量を増
やしてもジッタマージンを効率的に増やすことが出来な
いという問題があった。
号記録媒体には、一般的に情報データの他に該情報デー
タの誤り検出・訂正を行う為の誤り検出・訂正用データ
（パリティ）が一緒に記録されており、デジタル信号記
録媒体再生装置によりデジタル信号の特性である誤り検
出・訂正が行えるように成されている。その為、前述し
た如く、現用のメモリの容量を大としても該メモリはデ
ジタル信号を信号処理する為に用いられるものであり、
情報データ以外のデータも書き込まれるので、容量を増
やしてもジッタマージンを効率的に増やすことが出来な
いという問題があった。
【０００５】
【課題を解決するための手段】本発明は、前述の点に鑑
みて成されたデジタル信号記録媒体再生装置を提出せん
とするもので、信号処理回路によりデジタル信号を信号
処理する際に使用するべくデジタルデータを一旦記憶さ
せる第１メモリと、該第１メモリへのデジタルデータの
書き込みを制御する書き込みアドレス及び前記第１メモ
リからのデジタルデータの読み出しを制御する読み出し
アドレスを発生する第１アドレス発生回路と、前記信号
処理回路から出力される情報データを一旦記憶させる第
２メモリと、該第２メモリへの情報データの書き込みを
制御する書き込みアドレス及び前記第２メモリからの情
報データの読み出しを制御する読み出しアドレスを発生
する第２アドレス発生回路と、ディスクから読み取られ
たデジタル信号から該デジタル信号が有するビットに同
期したビットクロックを再生するクロック再生回路と、
水晶振動子を用いて水晶発振精度の基準クロックを発生
する基準発振器とを設け、前記第１メモリへのデジタル
データの書き込み及び該第１メモリからのデジタルデー
タの読み出しを前記クロック再生回路により再生された
ビットクロックに同期させて行い、かつ、前記第２メモ
リへの情報データの書き込みを前記ビットクロックに同
期させて行うとともに、前記第２メモリからの読み出し
を前記基準発振器から発生された基準クロックに同期さ
せて行うようにしている。
みて成されたデジタル信号記録媒体再生装置を提出せん
とするもので、信号処理回路によりデジタル信号を信号
処理する際に使用するべくデジタルデータを一旦記憶さ
せる第１メモリと、該第１メモリへのデジタルデータの
書き込みを制御する書き込みアドレス及び前記第１メモ
リからのデジタルデータの読み出しを制御する読み出し
アドレスを発生する第１アドレス発生回路と、前記信号
処理回路から出力される情報データを一旦記憶させる第
２メモリと、該第２メモリへの情報データの書き込みを
制御する書き込みアドレス及び前記第２メモリからの情
報データの読み出しを制御する読み出しアドレスを発生
する第２アドレス発生回路と、ディスクから読み取られ
たデジタル信号から該デジタル信号が有するビットに同
期したビットクロックを再生するクロック再生回路と、
水晶振動子を用いて水晶発振精度の基準クロックを発生
する基準発振器とを設け、前記第１メモリへのデジタル
データの書き込み及び該第１メモリからのデジタルデー
タの読み出しを前記クロック再生回路により再生された
ビットクロックに同期させて行い、かつ、前記第２メモ
リへの情報データの書き込みを前記ビットクロックに同
期させて行うとともに、前記第２メモリからの読み出し
を前記基準発振器から発生された基準クロックに同期さ
せて行うようにしている。
【０００６】
【作用】本発明は、デジタル信号を信号処理回路により
信号処理して得られる情報データを、デジタル信号から
得られるビットクロックに同期させて前記信号処理回路
から出力し、その情報データが信号記録媒体の駆動速度
の変化に関係なく必然的に前記ビットクロックに同期す
るようにするとともに、前記信号処理回路から出力され
る情報データのみを一旦記憶させる第２のメモリを設
け、該第２のメモリからの情報データの読み出しを、水
晶発振精度の基準クロックに同期させて行い、メモリの
容量をジッタマージンを大とするのに有効に活用出来る
ようにしたものである。
信号処理して得られる情報データを、デジタル信号から
得られるビットクロックに同期させて前記信号処理回路
から出力し、その情報データが信号記録媒体の駆動速度
の変化に関係なく必然的に前記ビットクロックに同期す
るようにするとともに、前記信号処理回路から出力され
る情報データのみを一旦記憶させる第２のメモリを設
け、該第２のメモリからの情報データの読み出しを、水
晶発振精度の基準クロックに同期させて行い、メモリの
容量をジッタマージンを大とするのに有効に活用出来る
ようにしたものである。
【０００７】
【実施例】図１は本発明の一実施例を示し、ＣＤプレー
ヤの回路ブロック図である。
ヤの回路ブロック図である。
【０００８】同図において、１はＣＤ方式のディスク、
２は該ディスク１を回転させるスピンドルモータ、３は
該スピンドルモータ２の回転を制御し、前記ディスク１
を定格の線速度で回転駆動する為のモータサーボ回路、
４はディスク１をトレースする光ビームを出射し、ディ
スク１に記録された信号を読み取る為のピックアップ、
５は該ピックアップ４によりトレースされて得られるデ
ィクス１に記録されたデジタル信号のＲＦ信号（高周波
信号）を増幅し、波形整形するＲＦアンプ、６は該ＲＦ
アンブ５を介して得られるＲＦ信号により前記ピックア
ップ４を駆動し、ディスク１をトレースする光ビームを
ディスク１の信号面に合焦させるフォーカシング制御及
び前記光ビームをディスク１の信号トラックに追従させ
るトラッキング制御を行うとともに、前記ピックアップ
４をディスク１の径方向に送る制御を行うピックアップ
サーボ回路である。
２は該ディスク１を回転させるスピンドルモータ、３は
該スピンドルモータ２の回転を制御し、前記ディスク１
を定格の線速度で回転駆動する為のモータサーボ回路、
４はディスク１をトレースする光ビームを出射し、ディ
スク１に記録された信号を読み取る為のピックアップ、
５は該ピックアップ４によりトレースされて得られるデ
ィクス１に記録されたデジタル信号のＲＦ信号（高周波
信号）を増幅し、波形整形するＲＦアンプ、６は該ＲＦ
アンブ５を介して得られるＲＦ信号により前記ピックア
ップ４を駆動し、ディスク１をトレースする光ビームを
ディスク１の信号面に合焦させるフォーカシング制御及
び前記光ビームをディスク１の信号トラックに追従させ
るトラッキング制御を行うとともに、前記ピックアップ
４をディスク１の径方向に送る制御を行うピックアップ
サーボ回路である。
【０００９】７はＲＦアンプ５により波形整形されてデ
ジタル信号として出力されるディスク１のＥＦＭ変調さ
れた記録信号からフレームの先頭を示すフレーム同期信
号を検出するとともに、ＥＦＭ復調を行う同期検出・Ｅ
ＦＭ復調回路、８は該同期検出・ＥＦＭ復調回路７によ
りＥＦＭ復調されたデジタル信号の中からサブコード信
号を分離し、該サブコード信号に含まれるＱコードを復
調するサブコード分離・Ｑコード復調回路、９はＥＦＭ
復調後のデジタル信号から抽出される情報データの誤り
検出・訂正を行う誤り検出・訂正回路、１０はデジタル
信号の並び替えを行う為、及び情報データの誤り訂正用
バッファとしてデジタル信号データを一旦記憶する第１
ＲＡＭ、１１は該第１ＲＡＭ１０にデジタル信号データ
を書き込むタイミング及びデジタルデータを読み出すタ
イミングをそれぞれ制御する書き込みアドレス及び読み
出しアドレスを発生する第１アドレス発生回路、１２は
前記誤り検出・訂正回路９により誤り訂正が不可能な情
報データをその前後に得られた情報データに応じて補間
する補間回路である。
ジタル信号として出力されるディスク１のＥＦＭ変調さ
れた記録信号からフレームの先頭を示すフレーム同期信
号を検出するとともに、ＥＦＭ復調を行う同期検出・Ｅ
ＦＭ復調回路、８は該同期検出・ＥＦＭ復調回路７によ
りＥＦＭ復調されたデジタル信号の中からサブコード信
号を分離し、該サブコード信号に含まれるＱコードを復
調するサブコード分離・Ｑコード復調回路、９はＥＦＭ
復調後のデジタル信号から抽出される情報データの誤り
検出・訂正を行う誤り検出・訂正回路、１０はデジタル
信号の並び替えを行う為、及び情報データの誤り訂正用
バッファとしてデジタル信号データを一旦記憶する第１
ＲＡＭ、１１は該第１ＲＡＭ１０にデジタル信号データ
を書き込むタイミング及びデジタルデータを読み出すタ
イミングをそれぞれ制御する書き込みアドレス及び読み
出しアドレスを発生する第１アドレス発生回路、１２は
前記誤り検出・訂正回路９により誤り訂正が不可能な情
報データをその前後に得られた情報データに応じて補間
する補間回路である。
【００１０】図中、一点鎖線により囲まれている同期検
出・ＥＦＭ復調回路７、サブコード分離・Ｑコード復調
回路８、誤り検出・訂正回路９、第１アドレス発生回路
１１及び補間回路１２は、ディスク１から読み取られた
デジタル信号をデジタル信号処理して情報データを得る
為の信号処理回路１３を構成している。
出・ＥＦＭ復調回路７、サブコード分離・Ｑコード復調
回路８、誤り検出・訂正回路９、第１アドレス発生回路
１１及び補間回路１２は、ディスク１から読み取られた
デジタル信号をデジタル信号処理して情報データを得る
為の信号処理回路１３を構成している。
【００１１】１４はＰＬＬ回路により構成され、ＲＦア
ンプ５から出力されるデジタル信号から該デジタル信号
が有するビットに同期したビットクロックを再生するク
ロック再生回路である。
ンプ５から出力されるデジタル信号から該デジタル信号
が有するビットに同期したビットクロックを再生するク
ロック再生回路である。
【００１２】ここで、信号処理回路１３を構成する各回
路は、前記クロック再生回路１４により再生されたビッ
トクロックにより各信号処理が行われる。そして、第１
アドレス発生回路１１から発生される書き込みアドレス
及び読み出しアドレスは、前記ビットクロックのタイミ
ングに応じて発生されるので、ディスク１の回転速度が
変化した場合、ジッタを吸収することは出来ないが、第
１ＲＡＭ１０がオーバーフローすることが防止される。
路は、前記クロック再生回路１４により再生されたビッ
トクロックにより各信号処理が行われる。そして、第１
アドレス発生回路１１から発生される書き込みアドレス
及び読み出しアドレスは、前記ビットクロックのタイミ
ングに応じて発生されるので、ディスク１の回転速度が
変化した場合、ジッタを吸収することは出来ないが、第
１ＲＡＭ１０がオーバーフローすることが防止される。
【００１３】１５はディスクの再生方法、各種サーチ方
法及びピックアップ４のフォーカシング導入方法等、基
本的なプログラムが書き込まれており、種々の基本的な
動作制御を行うとともに、表示器（図示せず）を表示す
る制御や操作キー（図示せず）の入力制御を行うマイク
ロコンピュータで構成されたシステム制御回路である。
法及びピックアップ４のフォーカシング導入方法等、基
本的なプログラムが書き込まれており、種々の基本的な
動作制御を行うとともに、表示器（図示せず）を表示す
る制御や操作キー（図示せず）の入力制御を行うマイク
ロコンピュータで構成されたシステム制御回路である。
【００１４】１６は信号処理回路１３により復調された
シリアルデジタル信号の情報データをパラレルデジタル
信号に変換するシリアル・パラレル変換回路、１７は該
シリアル・パラレル変換回路１６から出力される情報デ
ータが一旦記憶される第２ＲＡＭ、１８は該第２ＲＡＭ
１７への情報データの書き込みを制御する書き込みアド
レスを発生するとともに、前記第２ＲＡＭ１７からの情
報データの読み出しアドレスを発生する第２アドレス発
生回路、１９は水晶振動子２０を用いて水晶発振精度の
基準クロックを発生する基準発振器である。
シリアルデジタル信号の情報データをパラレルデジタル
信号に変換するシリアル・パラレル変換回路、１７は該
シリアル・パラレル変換回路１６から出力される情報デ
ータが一旦記憶される第２ＲＡＭ、１８は該第２ＲＡＭ
１７への情報データの書き込みを制御する書き込みアド
レスを発生するとともに、前記第２ＲＡＭ１７からの情
報データの読み出しアドレスを発生する第２アドレス発
生回路、１９は水晶振動子２０を用いて水晶発振精度の
基準クロックを発生する基準発振器である。
【００１５】ここで、第２アドレス発生回路１８から発
生される書き込みアドレスは、クロック再生回路１４か
らのビットクロックに同期して発生され、一方、前記第
２アドレス発生回路１８から発生される読み出しアドレ
スは、基準発振器１９からの基準クロックに同期して発
生されるとともに、ディスク１に情報データを記録する
際のサンプリング周波数に合わせて発生される。
生される書き込みアドレスは、クロック再生回路１４か
らのビットクロックに同期して発生され、一方、前記第
２アドレス発生回路１８から発生される読み出しアドレ
スは、基準発振器１９からの基準クロックに同期して発
生されるとともに、ディスク１に情報データを記録する
際のサンプリング周波数に合わせて発生される。
【００１６】２１は第２ＲＡＭ１７から読み出されるパ
ラレルデジタル信号の情報データをシリアルデジタル信
号に変換するパラレル・シリアル変換回路、２２は該パ
ラレル・シリアル変換回路２１から出力される情報デー
タをアナログ信号に変換するＤ／Ａコンバータである。
ラレルデジタル信号の情報データをシリアルデジタル信
号に変換するパラレル・シリアル変換回路、２２は該パ
ラレル・シリアル変換回路２１から出力される情報デー
タをアナログ信号に変換するＤ／Ａコンバータである。
【００１７】次に動作に付いて説明する。
【００１８】モータサーボ回路３には、ＲＦアンプ５を
介して得られるデジタル信号とクロック再生回路１４か
ら得られるビットクロック及び基準発振器１９から得ら
れる基準クロックとが供給され、前記モータサーボ回路
３はデジタル信号中の最短パルスのパルス幅を検出し
て、そのパルス幅が所定の長さになるようにスピンドル
モータ２を速度制御し、その上でビットクロックと基準
クロックとを各々分周した信号を位相比較して前記スピ
ンドルモータ２に位相サーボをかける。このようにして
ディスク１は、定格の線速度で回転駆動される。
介して得られるデジタル信号とクロック再生回路１４か
ら得られるビットクロック及び基準発振器１９から得ら
れる基準クロックとが供給され、前記モータサーボ回路
３はデジタル信号中の最短パルスのパルス幅を検出し
て、そのパルス幅が所定の長さになるようにスピンドル
モータ２を速度制御し、その上でビットクロックと基準
クロックとを各々分周した信号を位相比較して前記スピ
ンドルモータ２に位相サーボをかける。このようにして
ディスク１は、定格の線速度で回転駆動される。
【００１９】一方、ピックアップ１から投射される光ビ
ームによりディスクがトレースされると、ディスクに記
録された信号は、前記ピックアップ４により読み取ら
れ、ＲＦ信号（高周波信号）としてＲＦアンプ５に供給
される。前記ＲＦ信号は、前記ＲＦアンプ５により増幅
され、波形整形されてデジタル信号として信号処理回路
１３に供給される。前記信号処理回路１３は、前記デジ
タル信号を復調し、該デジタル信号に含まれている種々
のデータを抽出するとともに、抽出された情報データ
（オーディオデータ）は誤り検出及び誤り訂正処理が行
われ、かつ欠落した情報データの補間が行われる。そし
て、前記信号処理回路１３から出力される情報データ
は、シリアル・パラレル変換回路１６によりシリアルの
デジタル信号からパラレルのデジタル信号に変換された
後、第２アドレス発生回路１８からの書き込みアドレス
に応じて第２ＲＡＭ１７に書き込まれる。また、前記第
２ＲＡＭ１７に書き込まれた情報データは、前記第２ア
ドレス発生回路１８からの読み出しアドレスに応じて読
み出され、その情報データは、パラレル・シリアル変換
回路２１によりパラレルのデジタル信号からシリアルの
デジタル信号に変換される。そして、前記パラレル・シ
リアル変換回路２１から出力される情報データは、Ｄ／
Ａコンバータ２２によりアナログ信号に変換されるとと
もに、ステレオの左及び右チャンネル成分に分離され、
それぞれ後段のオーディオ回路（図示せず）に供給され
る。
ームによりディスクがトレースされると、ディスクに記
録された信号は、前記ピックアップ４により読み取ら
れ、ＲＦ信号（高周波信号）としてＲＦアンプ５に供給
される。前記ＲＦ信号は、前記ＲＦアンプ５により増幅
され、波形整形されてデジタル信号として信号処理回路
１３に供給される。前記信号処理回路１３は、前記デジ
タル信号を復調し、該デジタル信号に含まれている種々
のデータを抽出するとともに、抽出された情報データ
（オーディオデータ）は誤り検出及び誤り訂正処理が行
われ、かつ欠落した情報データの補間が行われる。そし
て、前記信号処理回路１３から出力される情報データ
は、シリアル・パラレル変換回路１６によりシリアルの
デジタル信号からパラレルのデジタル信号に変換された
後、第２アドレス発生回路１８からの書き込みアドレス
に応じて第２ＲＡＭ１７に書き込まれる。また、前記第
２ＲＡＭ１７に書き込まれた情報データは、前記第２ア
ドレス発生回路１８からの読み出しアドレスに応じて読
み出され、その情報データは、パラレル・シリアル変換
回路２１によりパラレルのデジタル信号からシリアルの
デジタル信号に変換される。そして、前記パラレル・シ
リアル変換回路２１から出力される情報データは、Ｄ／
Ａコンバータ２２によりアナログ信号に変換されるとと
もに、ステレオの左及び右チャンネル成分に分離され、
それぞれ後段のオーディオ回路（図示せず）に供給され
る。
【００２０】ところで、信号処理回路１３を構成する各
回路は、クロック再生回路１４から発生されるビットク
ロックにより作動されているので、補間回路１２を介し
て出力される情報データは、前記ビットクロックに同期
しており、ディスクの回転変化により生じるジッタ成分
を含んでいる。
回路は、クロック再生回路１４から発生されるビットク
ロックにより作動されているので、補間回路１２を介し
て出力される情報データは、前記ビットクロックに同期
しており、ディスクの回転変化により生じるジッタ成分
を含んでいる。
【００２１】しかしながら、信号処理回路１３から出力
される情報データは、ビットクロックに同期したタイミ
ングで第２ＲＡＭ１７に書き込まれた後に水晶発振精度
の基準クロックに同期したタイミングで前記第２ＲＡＭ
１７から読み出されるので、該第２ＲＡＭ１７によりジ
ッタ成分が吸収されることになり、Ｄ／Ａコンバータ２
２に入力される情報データにはジッタ成分が含まれな
い。
される情報データは、ビットクロックに同期したタイミ
ングで第２ＲＡＭ１７に書き込まれた後に水晶発振精度
の基準クロックに同期したタイミングで前記第２ＲＡＭ
１７から読み出されるので、該第２ＲＡＭ１７によりジ
ッタ成分が吸収されることになり、Ｄ／Ａコンバータ２
２に入力される情報データにはジッタ成分が含まれな
い。
【００２２】また、第１ＲＡＭ１０の書き込みタイミン
グと読み出しタイミングとは、共にビットクロックに同
期した同一周期であるので、信号処理回路１３はディス
クの回転変化に影響されずに信号処理が行われる。その
為、第２ＲＡＭ１７がオーバーフロー及びエンプティに
ならない範囲でディスクの回転速度偏差があっても再生
に差し支えないが、前記第２ＲＡＭ１７には情報データ
のみが書き込まれるので、該第２ＲＡＭ１７の容量が効
率的にジッタマージンに直結し、再生に差し支えないデ
ィスクの回転速度偏差範囲を拡大するのに有利である。
グと読み出しタイミングとは、共にビットクロックに同
期した同一周期であるので、信号処理回路１３はディス
クの回転変化に影響されずに信号処理が行われる。その
為、第２ＲＡＭ１７がオーバーフロー及びエンプティに
ならない範囲でディスクの回転速度偏差があっても再生
に差し支えないが、前記第２ＲＡＭ１７には情報データ
のみが書き込まれるので、該第２ＲＡＭ１７の容量が効
率的にジッタマージンに直結し、再生に差し支えないデ
ィスクの回転速度偏差範囲を拡大するのに有利である。
【００２３】
【発明の効果】以上述べた如く、本発明に依れば、信号
記録媒体の駆動速度偏差に強いデジタル信号記録媒体再
生装置が提供出来、特に、第２メモリに情報データのみ
を書き込むようにしているので、前記第２メモリの容量
分をジッタマージンの拡大に有効に活用することが出来
るという利点が得られる。
記録媒体の駆動速度偏差に強いデジタル信号記録媒体再
生装置が提供出来、特に、第２メモリに情報データのみ
を書き込むようにしているので、前記第２メモリの容量
分をジッタマージンの拡大に有効に活用することが出来
るという利点が得られる。
【図１】本発明の一実施例を示す回路ブロック図であ
る。
る。
２ スピンドルモータ ３ モータサーボ回路 ４ ピックアップ ７ 同期検出・ＥＦＭ復調回路 ９ 誤り検出・訂正回路 １０ 第１ＲＡＭ １１ 第１アドレス発生回路 １３ 信号処理回路 １４ クロック再生回路 １５ システム制御回路 １７ 第２ＲＡＭ １８ 第２アドレス発生回路 １９ 基準発振器
Claims (1)
- 【請求項１】 音楽情報等の情報データの他に該情報デ
ータの誤り検出及び誤り訂正を行う誤り検出・訂正用デ
ータが含まれるデジタル信号が記録された信号記録媒体
の再生を行うデジタル信号記録媒体再生装置において、
信号記録媒体から読み取られたデジタル信号を信号処理
して各種のデジタルデータを抽出するとともに、抽出さ
れた情報データの誤り検出及び誤り訂正を行う信号処理
回路と、該信号処理回路によりデジタル信号を信号処理
する際に使用するべくデジタルデータを一旦記憶させる
第１メモリと、該第１メモリへのデジタルデータの書き
込みを制御する書き込みアドレス及び前記第１メモリか
らのデジタルデータの読み出しを制御する読み出しアド
レスを発生する第１アドレス発生回路と、前記信号処理
回路から出力される情報データを一旦記憶させる第２メ
モリと、該第２メモリへの情報データの書き込みを制御
する書き込みアドレス及び前記第２メモリからの情報デ
ータの読み出しを制御する読み出しアドレスを発生する
第２アドレス発生回路と、ディスクから読み取られたデ
ジタル信号から該デジタル信号が有するビットに同期し
たビットクロックを再生するクロック再生回路と、水晶
振動子を用いて水晶発振精度の基準クロックを発生する
基準発振器とを設け、前記第１メモリへのデジタルデー
タの書き込み及び該第１メモリからのデジタルデータの
読み出しを前記クロック再生回路により再生されたビッ
トクロックに同期させて行い、かつ、前記第２メモリへ
の情報データの書き込みを前記ビットクロックに同期さ
せて行うとともに、前記第２メモリからの読み出しを前
記基準発振器から発生された基準クロックに同期させて
行うようにしたことを特徴とするデジタル信号記録媒体
再生装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP224492A JPH05189885A (ja) | 1992-01-09 | 1992-01-09 | デジタル信号記録媒体再生装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP224492A JPH05189885A (ja) | 1992-01-09 | 1992-01-09 | デジタル信号記録媒体再生装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05189885A true JPH05189885A (ja) | 1993-07-30 |
Family
ID=11523945
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP224492A Pending JPH05189885A (ja) | 1992-01-09 | 1992-01-09 | デジタル信号記録媒体再生装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05189885A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH06176493A (ja) * | 1992-12-08 | 1994-06-24 | Matsushita Electric Ind Co Ltd | 情報再生装置 |
| US5802026A (en) * | 1996-04-03 | 1998-09-01 | Sanyo Electric Co., Ltd. | Disk player for constant angular velocity reproduction of a disk |
| US5822289A (en) * | 1993-08-14 | 1998-10-13 | Kabushiki Kaisha Toshiba | Disc data reproducing apparatus and signal processing circuit |
| KR100358606B1 (ko) * | 1994-06-29 | 2003-01-24 | 소니 가부시끼 가이샤 | 디스크기록재생장치 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0334156A (ja) * | 1989-06-29 | 1991-02-14 | Matsushita Electric Ind Co Ltd | 情報再生装置 |
-
1992
- 1992-01-09 JP JP224492A patent/JPH05189885A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0334156A (ja) * | 1989-06-29 | 1991-02-14 | Matsushita Electric Ind Co Ltd | 情報再生装置 |
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| US5835464A (en) * | 1993-08-14 | 1998-11-10 | Kabushiki Kaisha Toshiba | Disc data reproducing apparatus and signal processing circuit |
| US5856962A (en) * | 1993-08-14 | 1999-01-05 | Kabushiki Kaisha Toshiba | Disc data reproducing apparatus and signal processing circuit |
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