JPH05175200A - 金バンプ形成方法 - Google Patents

金バンプ形成方法

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Publication number
JPH05175200A
JPH05175200A JP3354867A JP35486791A JPH05175200A JP H05175200 A JPH05175200 A JP H05175200A JP 3354867 A JP3354867 A JP 3354867A JP 35486791 A JP35486791 A JP 35486791A JP H05175200 A JPH05175200 A JP H05175200A
Authority
JP
Japan
Prior art keywords
gold bump
etching
gold
barrier metal
bump
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP3354867A
Other languages
English (en)
Inventor
Keiji Murayama
恵二 村山
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Tanaka Kikinzoku Kogyo KK
Original Assignee
Tanaka Kikinzoku Kogyo KK
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Filing date
Publication date
Application filed by Tanaka Kikinzoku Kogyo KK filed Critical Tanaka Kikinzoku Kogyo KK
Priority to JP3354867A priority Critical patent/JPH05175200A/ja
Publication of JPH05175200A publication Critical patent/JPH05175200A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/10Bump connectors; Manufacturing methods related thereto
    • H01L2224/11Manufacturing methods

Landscapes

  • Weting (AREA)

Abstract

(57)【要約】 (修正有) 【目的】 金バンプを保護する感光性レジストを不要に
できて感光性レジストのフォトリソグラフィー工程を省
略できて、金バンプ形成の能率を向上でき、また金バン
プをエッチングせず、不良バンプの発生を大幅に減少で
き、半導体素子実装時の信頼性を向上できる金バンプ形
成方法を提供する。 【構成】 ウェハー上の各チップの外周部の電極パッド
2上にパラジウムをバリヤメタル4,5として金バンプ
7を形成した後、塩酸と硝酸を体積比で5:1000の割合
で混合した混酸よりなるエッチング液を用いて、金バン
プ下側以外のバリヤメタルをエッチングして除去するこ
とを特徴とする金バンプ形成方法。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、半導体素子を実装する
為に、ウェハー上の各チップの外周部に夫々設けられた
多数の電極パッド上に金バンプを形成する方法に係り、
詳しくは電極パッド上にパラジウムをバリヤメタルとし
て金バンプを形成した後、金バンプ下側以外のバリヤメ
タルをエッチングにより除去する方法の改良に関する。
【0002】
【従来の技術】従来、ウェハー上の各チップの外周部に
夫々設けられた多数の電極パッド上に半導体素子を実装
する為の金バンプを形成するには、図3に示すようにチ
ップ1の電極パッド2以外の部分にポリイミド樹脂の回
路保護膜3を形成し、全面にTi1000Åをスパッタリン
グによりコーティングしてバリヤメタル4を形成し、そ
の上からPd3000Åをスパッタリングによりコーティン
グしてバリヤメタル5を形成し、電極パッド2上のバリ
ヤメタル5の位置以外に感光性レジスト6を形成し、次
にめっきにより金バンプ7を形成し、感光性レジスト6
の剥離後この金バンプ7の下側以外のバリヤメタル5、
4をエッチングにより除去するには、図4に示すように
金バンプ7を保護する為の感光性レジスト8を形成した
後、王水(HCl:HNO3 3:1)によってバリヤメ
タル5、4を図5に示すようにエッチングして除去し、
その後感光性レジスト8を図6に示すように剥離してい
た。
【0003】ところで、上記の金バンプ形成方法に於い
ては、感光性レジストのフォトリソグラフィー工程がバ
ンプ形成用の工程とバンプ保護用の工程との2工程とな
り、バンプ形成における所要時間が増加する。また金バ
ンプ7を保護した状態での王水によるエッチングでは感
光性レジスト8のはじき、その他の欠陥により金バンプ
7が露出した場合、その部分がエッチングされてしまう
ことになる。
【0004】
【発明が解決しようとする課題】そこで本発明は、金バ
ンプを保護する為の感光性レジストのフォトリソグラフ
ィー工程を省き、金バンプをエッチングしないでバリヤ
メタルをエッチングすることのできる金バンプ形成方法
を提供しようとするものである。
【0005】
【課題を解決するための手段】上記課題を解決するため
の本発明の金バンプ形成方法は、ウェハー上の各チップ
の外周部の電極パッド上にパラジウムをバリヤメタルと
して金バンプを形成した後、塩酸と硝酸を体積比で5:
1000の割合で混合した混酸よりなるエッチング液を用い
て金バンプ下側以外のバリヤメタルをエッチングして除
去することを特徴とするものである。
【0006】
【作用】上記のように本発明の金バンプ形成方法は、塩
酸と硝酸を体積比で5:1000の割合で混合した混酸より
なるエッチング液を用いてバリヤメタルをエッチングす
るが、このエッチング液は金バンプをエッチングしない
ので、金バンプを保護する感光性レジストは不要であ
り、従って感光性レジストのフォトリソグラフィー工程
が省略できて、金バンプ形成の能率が向上する。また、
金バンプがエッチングされないので、不良バンプの発生
が大幅に減少し、半導体素子実装時の信頼性が向上す
る。
【0007】
【実施例】本発明の金バンプ形成方法の一実施例を図に
よって説明すると、直径5インチのウェハーの図1に示
す各チップ1の 110μm× 110μm、厚さ1μmの電極
パッド2以外の部分にポリイミド樹脂の回路保護膜3を
形成し、全面にTi1000Åをスパッタリングによりコー
ティングしてバリヤメタル4を形成し、その上からPd
3000Åをスパッタリングによりコーティングしてバリヤ
メタル5を形成し、電極パッド2上のバリヤメタル5の
位置以外に感光性レジスト6を形成し、次にめっきによ
り 100μm× 100μm、高さ20μmの金バンプ7を形成
し、感光性レジスト6の剥離後、塩酸6mlと硝酸1200ml
を混合した混酸よりなるエッチング液を充填した塩化ビ
ニール製のエッチング槽にウェハーを10枚浸漬させて、
金バンプ7の下側以外のバリヤメタル4、5を図2に示
すようにエッチングして完全に除去した。このバリヤメ
タル4、5のエッチングによる完全除去には平均45秒か
かったが、金バンプ7は全くエッチングされず、不良チ
ップは発生しなかった。
【0008】一方、従来例を図によって説明すると、直
径5インチのウェハーの図3に示す各チップ1の 110μ
m× 110μm、厚さ1μmの電極パッド2以外の部分に
ポリイミド樹脂の回路保護膜3を形成し、全面にTi10
00Åをスパッタリングによりコーティングしてバリヤメ
タル4を形成し、その上からPd3000Åをスパッタリン
グによりコーティングしてバリヤメタル5を形成し、電
極パッド2上のバリヤメタル5の位置以外に感光性レジ
スト6を形成し、次にめっきにより 100μm×100μ
m、高さ20μmの金バンプ7を形成し、感光性レジスト
6の剥離後、この金バンプ7を保護するために図4に示
すように感光性レジスト8を形成した後、王水(塩酸 9
00ml、硝酸300ml)を充填した塩化ビニール製のエッチン
グ槽にウェハーを10枚浸漬させて、金バンプ7の下側以
外のバリヤメタル5、4を図5に示すようにエッチング
して除去し、その後感光性レジスト8を図6に示すよう
に剥離した。この従来例において、バリヤメタル4、5
のエッチングによる除去には平均30秒かかったが、感光
性レジストの欠損により金バンプ7がエッチングされ、
不良チップが発生した。
【0009】
【発明の効果】以上の説明で判るように本発明の金バン
プ形成方法によれば、金バンプを保護する感光性レジス
トが不要となるので、感光性レジストのフォトリソグラ
フィー工程が省略できて、金バンプ形成の能率が向上す
る。また金バンプがエッチングされないので、不良バン
プの発生が大幅に減少し、半導体素子実装時の信頼性が
向上する。
【図面の簡単な説明】
【図1】ウェハーのチップの電極パッド上に形成した金
バンプを示す要部断面図である。
【図2】図1における金バンプの下側以外のバリヤメタ
ルを本発明の方法によるエッチングにより除去した状態
を示す要部断面図である。
【図3】ウェハーのチップの電極パッド上に形成した金
バンプを示す要部断面図である。
【図4】図3における金バンプの下側以外のバリヤメタ
ルをエッチングにより除去する従来の方法の工程を示す
要部断面図である。
【図5】図3における金バンプの下側以外のバリヤメタ
ルをエッチングにより除去する従来の方法の工程を示す
要部断面図である。
【図6】図3における金バンプの下側以外のバリヤメタ
ルをエッチングにより除去する従来の方法の工程を示す
要部断面図である。
【符号の説明】
1 チップ 2 電極パッド 3 回路保護膜 4,5 バリヤメタル 6 感光性レジスト 7 金バンプ

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】 ウェハー上の各チップの外周部の電極パ
    ッド上にパラジウムをバリヤメタルとして金バンプを形
    成した後、塩酸と硝酸を体積比で5:1000の割合で混合
    した混酸よりなるエッチング液を用いて、金バンプ下側
    以外のバリヤメタルをエッチングして除去することを特
    徴とする金バンプ形成方法。
JP3354867A 1991-12-19 1991-12-19 金バンプ形成方法 Pending JPH05175200A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP3354867A JPH05175200A (ja) 1991-12-19 1991-12-19 金バンプ形成方法

Applications Claiming Priority (1)

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JP3354867A JPH05175200A (ja) 1991-12-19 1991-12-19 金バンプ形成方法

Publications (1)

Publication Number Publication Date
JPH05175200A true JPH05175200A (ja) 1993-07-13

Family

ID=18440446

Family Applications (1)

Application Number Title Priority Date Filing Date
JP3354867A Pending JPH05175200A (ja) 1991-12-19 1991-12-19 金バンプ形成方法

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JP (1) JPH05175200A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2009113486A1 (ja) 2008-03-14 2009-09-17 富士フイルム株式会社 プローブカード

Cited By (1)

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