JPH05143478A - 不揮発性メモリ内容保護装置 - Google Patents
不揮発性メモリ内容保護装置Info
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- JPH05143478A JPH05143478A JP3304627A JP30462791A JPH05143478A JP H05143478 A JPH05143478 A JP H05143478A JP 3304627 A JP3304627 A JP 3304627A JP 30462791 A JP30462791 A JP 30462791A JP H05143478 A JPH05143478 A JP H05143478A
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- JP
- Japan
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- keyword
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- data
- volatile memory
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Abstract
(57)【要約】
【目的】マイクロコンピュータ暴走時に不揮発性メモリ
内容を保護する。 【構成】電源断時などに不揮発性メモリに対してデータ
を退避するデータ退避実行モジュールの前段にキーワー
ド監視モジュールｎ２を配置し、該キーワード監視モジ
ュールｎ２を、所定のキーワードをレジスタ等にセット
するキーワード設定ステップｎ２０と、キーワードとレ
ジスタ等の内容を比較し、不一致の時に終了するキーワ
ード比較ステップｎ２１とを一組として、複数組縦続配
置したもので構成する。
内容を保護する。 【構成】電源断時などに不揮発性メモリに対してデータ
を退避するデータ退避実行モジュールの前段にキーワー
ド監視モジュールｎ２を配置し、該キーワード監視モジ
ュールｎ２を、所定のキーワードをレジスタ等にセット
するキーワード設定ステップｎ２０と、キーワードとレ
ジスタ等の内容を比較し、不一致の時に終了するキーワ
ード比較ステップｎ２１とを一組として、複数組縦続配
置したもので構成する。
Description
【０００１】
【産業上の利用分野】本発明は、電源をオフした時や瞬
時停電時などにマイクロコンピュータで作業中のデータ
をバッテリバックアップメモリ等の不揮発性メモリに退
避するように構成された電子機器において、前記不揮発
性メモリ内のデータを保護する装置に関する。
時停電時などにマイクロコンピュータで作業中のデータ
をバッテリバックアップメモリ等の不揮発性メモリに退
避するように構成された電子機器において、前記不揮発
性メモリ内のデータを保護する装置に関する。
【０００２】
【従来の技術】各種のデータを電源オフ時にも記憶して
おく必要のある電子機器、たとえば電子写真プロセス部
の各種調整値や複写枚数カウンタ係数値等を電源オフ時
にも記憶しておく必要のある電子写真複写機において
は、それらのデータを電源オフ時や瞬時停電時等に退避
させて記憶しておくバッテリバックアップメモリ等の不
揮発性メモリが設けられている。
おく必要のある電子機器、たとえば電子写真プロセス部
の各種調整値や複写枚数カウンタ係数値等を電源オフ時
にも記憶しておく必要のある電子写真複写機において
は、それらのデータを電源オフ時や瞬時停電時等に退避
させて記憶しておくバッテリバックアップメモリ等の不
揮発性メモリが設けられている。
【０００３】
【発明が解決しようとする課題】しかし、このような電
子機器のうち、特に非常に大きなノイズの発生しやすい
機器、たとえばチャージャーのリークが生じた時に大き
なノイズを発生する電子写真複写機では、そのノイズに
よってマイクロコンピュータが暴走してしまい、暴走の
結果不揮発性メモリへのデータ退避実行モジュールのア
ドレスに飛ぶと、不揮発性メモリに対して誤ったデータ
が書き込まれてしまうという問題があった。
子機器のうち、特に非常に大きなノイズの発生しやすい
機器、たとえばチャージャーのリークが生じた時に大き
なノイズを発生する電子写真複写機では、そのノイズに
よってマイクロコンピュータが暴走してしまい、暴走の
結果不揮発性メモリへのデータ退避実行モジュールのア
ドレスに飛ぶと、不揮発性メモリに対して誤ったデータ
が書き込まれてしまうという問題があった。
【０００４】本発明の目的は、マイクロコンピュータが
暴走した時でも不揮発性メモリに対して誤ったデータが
書き込まれるのをできるだけ防ぐことのできる不揮発性
メモリ内容保護装置を提供することにある。
暴走した時でも不揮発性メモリに対して誤ったデータが
書き込まれるのをできるだけ防ぐことのできる不揮発性
メモリ内容保護装置を提供することにある。
【０００５】
【課題を解決するための手段】図１は、本発明の不揮発
性メモリ内容保護装置が適用される電子機器の概略のブ
ロック図を示している。マイクロコンピュータ等に対し
て低電圧電源Ｖc を供給する電源部１には電圧低下検出
回路２が接続され、電源部１から出力される電圧ＶC を
常時監視し、該電圧が一定レベル以下に低下した時にマ
イクロコンピュータ３に対してデータ退避の為の割込信
号を出力する。マイクロコンピュータ３には、前記割込
信号が受入れられた時に退避するデータを格納するバッ
テリバックアップされたＲＡＭ４が接続され、更にマイ
クロコンピュータによって制御されリレー等を含む駆動
回路５とセンサ類を含む入力回路６が接続されている。
性メモリ内容保護装置が適用される電子機器の概略のブ
ロック図を示している。マイクロコンピュータ等に対し
て低電圧電源Ｖc を供給する電源部１には電圧低下検出
回路２が接続され、電源部１から出力される電圧ＶC を
常時監視し、該電圧が一定レベル以下に低下した時にマ
イクロコンピュータ３に対してデータ退避の為の割込信
号を出力する。マイクロコンピュータ３には、前記割込
信号が受入れられた時に退避するデータを格納するバッ
テリバックアップされたＲＡＭ４が接続され、更にマイ
クロコンピュータによって制御されリレー等を含む駆動
回路５とセンサ類を含む入力回路６が接続されている。
【０００６】図２は、前記マイクロコンピュータ３のＲ
ＯＭに記憶されているプログラムモジュールの概略構成
を示している。電源がオンされるとメインコントロール
モジュールｎ１が実行され、入力回路６からの入力情報
に基づいて駆動回路５を制御する。電圧低下検出回路２
から割込信号を受けると、メインコントロールモジュー
ルｎ１から割込モジュールに移り、データ退避処理を行
う。この割込モジュールは、データ退避実行モジュール
ｎ３と、その前段に配置されるキーワード監視モジール
ｎ２とで構成される。キーワード監視モジュールｎ２
は、所定のキーワードｋｅｙ（ｎ）をレジスタ等Ａにセ
ットするキーワード設定ステップｎ２０と、前記キーワ
ードｋｅｙ（ｎ）とレジスタ等Ａの内容を比較し、不一
致の時終了するキーワード比較ステップｎ２１とを一組
として、この組を複数組縦続配置したもので構成されて
いる。
ＯＭに記憶されているプログラムモジュールの概略構成
を示している。電源がオンされるとメインコントロール
モジュールｎ１が実行され、入力回路６からの入力情報
に基づいて駆動回路５を制御する。電圧低下検出回路２
から割込信号を受けると、メインコントロールモジュー
ルｎ１から割込モジュールに移り、データ退避処理を行
う。この割込モジュールは、データ退避実行モジュール
ｎ３と、その前段に配置されるキーワード監視モジール
ｎ２とで構成される。キーワード監視モジュールｎ２
は、所定のキーワードｋｅｙ（ｎ）をレジスタ等Ａにセ
ットするキーワード設定ステップｎ２０と、前記キーワ
ードｋｅｙ（ｎ）とレジスタ等Ａの内容を比較し、不一
致の時終了するキーワード比較ステップｎ２１とを一組
として、この組を複数組縦続配置したもので構成されて
いる。
【０００７】
【作用】電源がオフされたり瞬時停電が発生すると、電
圧低下検出回路２からマイクロコンピュータ３に対して
割込信号が出力され、マイクロコンピュータ３はこの割
込信号を受けて図２に示す割込モジュールの実行に移
る。最初に、キーワード監視モジュールｎ２を実行し、
このモジュールがうまくいった時に初めてデータ退避実
行モジュールｎ３に移る。キーワード監視モジュールｎ
２は、上記したように、レジスタ等Ａにキーワードｋｅ
ｙ（ｎ）をまずセットし、次にキーワード比較ステップ
においてレジスタ等の内容と上記キーワードｋｅｙ
（ｎ）を比較し、不一致なら終了する。この２つのステ
ップの組み合わせを一組として複数組連続して実行し、
全てのキーワード比較ステップが一致した場合のみデー
タ退避実行モジュールｎ３の実行に移る。
圧低下検出回路２からマイクロコンピュータ３に対して
割込信号が出力され、マイクロコンピュータ３はこの割
込信号を受けて図２に示す割込モジュールの実行に移
る。最初に、キーワード監視モジュールｎ２を実行し、
このモジュールがうまくいった時に初めてデータ退避実
行モジュールｎ３に移る。キーワード監視モジュールｎ
２は、上記したように、レジスタ等Ａにキーワードｋｅ
ｙ（ｎ）をまずセットし、次にキーワード比較ステップ
においてレジスタ等の内容と上記キーワードｋｅｙ
（ｎ）を比較し、不一致なら終了する。この２つのステ
ップの組み合わせを一組として複数組連続して実行し、
全てのキーワード比較ステップが一致した場合のみデー
タ退避実行モジュールｎ３の実行に移る。
【０００８】したがって、正常状態、つまり電源オフ等
を原因としてマイクロコンピュータ３に割込がかかった
場合はキーワード監視モジュールｎ２を問題なく通過し
てデータ退避実行モジュールｎ３に移るが、暴走時、つ
まりメインコントロールモジュールｎ１を実行中に、外
部ノイズによってマイクロコンピュータ３が暴走した場
合は、キーワード監視モジュールｎ２の存在の為にデー
タ退避実行モジュールｎ３が実行される確率をかなり減
少させることができる。すなわち、マイクロコンピュー
タの暴走の結果アドレスが図のＰの位置から走ろうとす
ると、キーワード比較ステップｎ２１において不一致と
なってプログラムが終了してしまう。キーワード監視モ
ジュールｎ２は、ｎ２０とｎ２１との組み合わせステッ
プが複数組縦続に配置されているために、暴走が生じて
もキーワード監視モジュールｎ２の段階でプログラムが
終了してしまう確率が高くなる。なお、この場合、キー
ワード監視モジュールｎ２を、複数のサブルーチンモジ
ュールステップで構成し、各ステップをｎ２１に示すキ
ーワード比較ステップ（ｋｅｙ（ｎ）の比較ステップ）
とｎ＋１のキーワード設定ステップ（ｋｅｙ（ｎ＋１）
の設定）で構成すると、暴走時にはより低いレベルのサ
ブルーチンのアドレスセットの可能性がより高いレベル
のサブルーチンのアドレスセットの可能性より小さいた
め、キーワード監視モジュール内でプログラムが終了す
る確率を更に高くすることができる。
を原因としてマイクロコンピュータ３に割込がかかった
場合はキーワード監視モジュールｎ２を問題なく通過し
てデータ退避実行モジュールｎ３に移るが、暴走時、つ
まりメインコントロールモジュールｎ１を実行中に、外
部ノイズによってマイクロコンピュータ３が暴走した場
合は、キーワード監視モジュールｎ２の存在の為にデー
タ退避実行モジュールｎ３が実行される確率をかなり減
少させることができる。すなわち、マイクロコンピュー
タの暴走の結果アドレスが図のＰの位置から走ろうとす
ると、キーワード比較ステップｎ２１において不一致と
なってプログラムが終了してしまう。キーワード監視モ
ジュールｎ２は、ｎ２０とｎ２１との組み合わせステッ
プが複数組縦続に配置されているために、暴走が生じて
もキーワード監視モジュールｎ２の段階でプログラムが
終了してしまう確率が高くなる。なお、この場合、キー
ワード監視モジュールｎ２を、複数のサブルーチンモジ
ュールステップで構成し、各ステップをｎ２１に示すキ
ーワード比較ステップ（ｋｅｙ（ｎ）の比較ステップ）
とｎ＋１のキーワード設定ステップ（ｋｅｙ（ｎ＋１）
の設定）で構成すると、暴走時にはより低いレベルのサ
ブルーチンのアドレスセットの可能性がより高いレベル
のサブルーチンのアドレスセットの可能性より小さいた
め、キーワード監視モジュール内でプログラムが終了す
る確率を更に高くすることができる。
【０００９】すなわち、暴走時にはキーワード監視モジ
ュール内のサブルーチンモジュールステップのアドレス
から走る確率が同ステップ内のより低いレベルのアドレ
スから走る確率よりも相対的に高いために，あるサブル
ーチンモジュールステップを実行すると、最初にｋｅｙ
（ｎ）のキーワード比較ステップが来ることになって、
ほとんどがプログラム終了となる（但し、最初は、ｎ２
０のように或るキーワードをセットする必要があ
る。）。
ュール内のサブルーチンモジュールステップのアドレス
から走る確率が同ステップ内のより低いレベルのアドレ
スから走る確率よりも相対的に高いために，あるサブル
ーチンモジュールステップを実行すると、最初にｋｅｙ
（ｎ）のキーワード比較ステップが来ることになって、
ほとんどがプログラム終了となる（但し、最初は、ｎ２
０のように或るキーワードをセットする必要があ
る。）。
【００１０】
【実施例】図３は、本発明の実施例のフローチャートを
示している。
示している。
【００１１】本実施例では、図２に示すキーワード監視
モジュールｎ２がｎ４〜ｎ６およびｎ７（サブルーチン
モジュールステップ）の最初のステップで構成され、デ
ータ退避実行モジュールｎ３はｎ７のサブルーチンモジ
ュールステップの最初のステップを除いた他のステップ
で構成されている。ｎ４においては第１のキーワードで
あるＣＯＤＥ ＡがアキュムレータＡにセットされる。
次のｎ５はＷＲＩＴＥＡのサブルーチンモジュールをコ
ールするステップである。同様に、ｎ６は、ＷＲＩＴＥ
Ｂのサブルーチンモジュールをコールするステップで
ある。ｎ５では、最初にｎ５０においてアキュムレータ
Ａの内容と所定のキーワードＣＯＤＥＡとを比較する。
両者が不一致であれば終了処理を行い、一致すれば、第
２のキーワードであるＣＯＤＥ ＢをアキュムレータＡ
にセットしてリターンする。
モジュールｎ２がｎ４〜ｎ６およびｎ７（サブルーチン
モジュールステップ）の最初のステップで構成され、デ
ータ退避実行モジュールｎ３はｎ７のサブルーチンモジ
ュールステップの最初のステップを除いた他のステップ
で構成されている。ｎ４においては第１のキーワードで
あるＣＯＤＥ ＡがアキュムレータＡにセットされる。
次のｎ５はＷＲＩＴＥＡのサブルーチンモジュールをコ
ールするステップである。同様に、ｎ６は、ＷＲＩＴＥ
Ｂのサブルーチンモジュールをコールするステップで
ある。ｎ５では、最初にｎ５０においてアキュムレータ
Ａの内容と所定のキーワードＣＯＤＥＡとを比較する。
両者が不一致であれば終了処理を行い、一致すれば、第
２のキーワードであるＣＯＤＥ ＢをアキュムレータＡ
にセットしてリターンする。
【００１２】次のサブルーチンモジュールステップｎ６
においては最初にアキュムレータＡの内容と第２のキー
ワードＣＯＤＥ Ｂとを比較し、不一致なら終了し、一
致すればアキュムレータＡに第３のキーワードＣＯＤＥ
Ｃをセットしてリターンする。以上のステップを全て
通過すると、次にサブルーチンモジュールステップｎ７
に進み、最初にｎ７０でアキュムレータＡの内容と第３
のキーワードＣＯＤＥＣとを比較し、不一致であれば終
了し、一致した場合にのみデータ退避実行ルーチンであ
るメモリライトシーケンスを行う。
においては最初にアキュムレータＡの内容と第２のキー
ワードＣＯＤＥ Ｂとを比較し、不一致なら終了し、一
致すればアキュムレータＡに第３のキーワードＣＯＤＥ
Ｃをセットしてリターンする。以上のステップを全て
通過すると、次にサブルーチンモジュールステップｎ７
に進み、最初にｎ７０でアキュムレータＡの内容と第３
のキーワードＣＯＤＥＣとを比較し、不一致であれば終
了し、一致した場合にのみデータ退避実行ルーチンであ
るメモリライトシーケンスを行う。
【００１３】上記において、ノイズによってマイクロコ
ンピュータ３が暴走して、実行アドレスがＰ１，Ｐ２，
Ｐ３に飛んだ場合、いずれもｎ５〜ｎ７の各サブルーチ
ンモジュールの最初のキーワード比較ステップによって
不一致を検出し、プログラム終了にいたる。本実施例で
は、各サブルーチンを最初にキーワード（ｎ）の比較ス
テップ、次にキーワード（ｎ＋１）の設定ステップを配
置するように構成しているために、暴走時にはキーワー
ド監視モジュールにおいてプログラム終了する確率を高
くすることができる。すなわち、暴走が発生した時に、
アドレスが、サブルーチンモジュール内のより低いレベ
ルのステップ（ｎ５０やｎ５１等）に飛ぶのに比較し
て、ｎ４，ｎ５，ｎ６，ｎ７に飛ぶ確率の方が高い。し
たがって、各サブルーチンモジュールステップの構成
を、最初にキーワード（ｎ）の設定ステップ、次にキー
ワード（ｎ）の比較ステップを配置する構造とするのに
比較して、暴走時にプログラム終了する確率を高くする
ことができる。
ンピュータ３が暴走して、実行アドレスがＰ１，Ｐ２，
Ｐ３に飛んだ場合、いずれもｎ５〜ｎ７の各サブルーチ
ンモジュールの最初のキーワード比較ステップによって
不一致を検出し、プログラム終了にいたる。本実施例で
は、各サブルーチンを最初にキーワード（ｎ）の比較ス
テップ、次にキーワード（ｎ＋１）の設定ステップを配
置するように構成しているために、暴走時にはキーワー
ド監視モジュールにおいてプログラム終了する確率を高
くすることができる。すなわち、暴走が発生した時に、
アドレスが、サブルーチンモジュール内のより低いレベ
ルのステップ（ｎ５０やｎ５１等）に飛ぶのに比較し
て、ｎ４，ｎ５，ｎ６，ｎ７に飛ぶ確率の方が高い。し
たがって、各サブルーチンモジュールステップの構成
を、最初にキーワード（ｎ）の設定ステップ、次にキー
ワード（ｎ）の比較ステップを配置する構造とするのに
比較して、暴走時にプログラム終了する確率を高くする
ことができる。
【００１４】
【発明の効果】キーワード監視モジュールをデータ退避
実行モジュールの前段に配置するだけで、ノイズ等に起
因してマイクロコンピュータが暴走した場合でも不揮発
性メモリに対してデータが書き込まれるのを出来るだけ
防ぐことができる。
実行モジュールの前段に配置するだけで、ノイズ等に起
因してマイクロコンピュータが暴走した場合でも不揮発
性メモリに対してデータが書き込まれるのを出来るだけ
防ぐことができる。
【図１】本発明が実施される電子機器の概略構成図
【図２】本発明の構成を示す図
【図３】本発明の実施例を示す図
ｎ２−キーワード監視モジュール ｎ３−データ退避実行モジュール ２−電圧低下検出回路 ４−バッテリバックアップされたＲＡＭ
Claims (1)
- 【請求項１】電源部から出力される電圧を監視し、該電
圧の低下時にマイクロコンピュータに対してデータ退避
の為の割込信号を出力する電圧低下検出回路と、前記割
込信号が受け入れられた時に退避するデータを格納する
不揮発性メモリとを備える電子機器に設けられ、 データ退避実行モジュールの前段にキーワード監視モジ
ュールを配置し、 該キーワード監視モジュールは、所定のキーワードをレ
ジスタ等にセットするキーワード設定ステップと、前記
キーワードと前記レジスタ等の内容を比較し、不一致の
時終了するキーワード比較ステップと、を一組として複
数組縦続配置したもので構成されることを特徴とする、
不揮発性メモリ内容保護装置
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3304627A JPH05143478A (ja) | 1991-11-20 | 1991-11-20 | 不揮発性メモリ内容保護装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3304627A JPH05143478A (ja) | 1991-11-20 | 1991-11-20 | 不揮発性メモリ内容保護装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05143478A true JPH05143478A (ja) | 1993-06-11 |
Family
ID=17935310
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3304627A Pending JPH05143478A (ja) | 1991-11-20 | 1991-11-20 | 不揮発性メモリ内容保護装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05143478A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH11338963A (ja) * | 1998-05-29 | 1999-12-10 | Toshiba Tec Corp | シンボル読取装置 |
| WO2007091492A1 (ja) * | 2006-02-06 | 2007-08-16 | Matsushita Electric Industrial Co., Ltd. | セキュア処理装置、方法、プログラム |
Citations (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57135500A (en) * | 1981-02-16 | 1982-08-21 | Nec Corp | Data memory protecting circuit |
| JPS62245353A (ja) * | 1986-04-18 | 1987-10-26 | Hitachi Ltd | Ｅｅｐｒｏｍのデ−タ書換え防止回路 |
| JPS63221446A (ja) * | 1987-02-06 | 1988-09-14 | テクトロニックス・インコーポレイテッド | 不揮発性メモリ保護装置及び方法 |
| JPH01195559A (ja) * | 1988-01-29 | 1989-08-07 | Matsushita Electric Ind Co Ltd | 電気機器のバックアップ記憶装置 |
| JPH0325544A (ja) * | 1989-06-22 | 1991-02-04 | Matsushita Electric Ind Co Ltd | メモリ制御回路 |
-
1991
- 1991-11-20 JP JP3304627A patent/JPH05143478A/ja active Pending
Patent Citations (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57135500A (en) * | 1981-02-16 | 1982-08-21 | Nec Corp | Data memory protecting circuit |
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| JPH01195559A (ja) * | 1988-01-29 | 1989-08-07 | Matsushita Electric Ind Co Ltd | 電気機器のバックアップ記憶装置 |
| JPH0325544A (ja) * | 1989-06-22 | 1991-02-04 | Matsushita Electric Ind Co Ltd | メモリ制御回路 |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH11338963A (ja) * | 1998-05-29 | 1999-12-10 | Toshiba Tec Corp | シンボル読取装置 |
| WO2007091492A1 (ja) * | 2006-02-06 | 2007-08-16 | Matsushita Electric Industrial Co., Ltd. | セキュア処理装置、方法、プログラム |
| US7650515B2 (en) | 2006-02-06 | 2010-01-19 | Panasonic Corporation | Secure processing device, method and program |
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