JPH0514086A - 光・電気変換回路の利得制御回路 - Google Patents
光・電気変換回路の利得制御回路Info
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- JPH0514086A JPH0514086A JP18694291A JP18694291A JPH0514086A JP H0514086 A JPH0514086 A JP H0514086A JP 18694291 A JP18694291 A JP 18694291A JP 18694291 A JP18694291 A JP 18694291A JP H0514086 A JPH0514086 A JP H0514086A
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- JP
- Japan
- Prior art keywords
- output
- control circuit
- apd
- optical input
- multiplication factor
- Prior art date
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- Control Of Amplification And Gain Control (AREA)
Abstract
(57)【要約】
【目的】 ＡＰＤ３の帰還ループと自動利得増幅器６の
帰還ループを別々に設け、光入力１０が上限と下限のと
き、ＡＰＤ３のバイアス電圧を最適値に設定する。 【構成】 電源１の出力とフォトカプラ２のＬＥＤ２Ａ
とＡＰＤ３を直列に接続し、ＡＰＤ３に光入力１０を加
え、フォトカプラ２の出力を増倍率制御回路４に加え、
光入力１０の大小により増倍率制御回路４の出力を制御
し、増倍率制御回路４の出力を電源１の入力に帰還し、
ＡＰＤ３の信号出力を自動利得制御増幅器６に加え、自
動利得制御増幅器６の出力を利得制御回路９から自動利
得制御増幅器６に帰還させる。
帰還ループを別々に設け、光入力１０が上限と下限のと
き、ＡＰＤ３のバイアス電圧を最適値に設定する。 【構成】 電源１の出力とフォトカプラ２のＬＥＤ２Ａ
とＡＰＤ３を直列に接続し、ＡＰＤ３に光入力１０を加
え、フォトカプラ２の出力を増倍率制御回路４に加え、
光入力１０の大小により増倍率制御回路４の出力を制御
し、増倍率制御回路４の出力を電源１の入力に帰還し、
ＡＰＤ３の信号出力を自動利得制御増幅器６に加え、自
動利得制御増幅器６の出力を利得制御回路９から自動利
得制御増幅器６に帰還させる。
Description
【０００１】
【産業上の利用分野】この発明は、アバランシェフォト
ダイオード（以下、ＡＰＤという。）を使用する光・電
気変換回路の利得制御回路についてのものである。
ダイオード（以下、ＡＰＤという。）を使用する光・電
気変換回路の利得制御回路についてのものである。
【０００２】
【従来の技術】次に、従来技術による光・電気変換回路
の利得制御回路を図４により説明する。図４の３はＡＰ
Ｄ、５は前段増幅器、６は自動利得増幅器、７は後段増
幅器、８は検出器、１０は光入力、１１は電源、１２は
利得制御回路である。電源１１はＤＣーＤＣコンバータ
で構成されており、入力電圧が変わると出力電圧が変わ
る。電源１１はＡＰＤ３にバイアスを供給する。光入力
１０がＡＰＤ３に加えられると、ＡＰＤ３の信号出力が
前段増幅器５に供給される。前段増幅器５の出力は自動
利得増幅器６に加えられ、自動利得増幅器６の出力は後
段増幅器７に供給される。後段増幅器７の出力は信号出
力として取り出されるとともに、一部は検出器８から利
得制御回路１２に導かれる。
の利得制御回路を図４により説明する。図４の３はＡＰ
Ｄ、５は前段増幅器、６は自動利得増幅器、７は後段増
幅器、８は検出器、１０は光入力、１１は電源、１２は
利得制御回路である。電源１１はＤＣーＤＣコンバータ
で構成されており、入力電圧が変わると出力電圧が変わ
る。電源１１はＡＰＤ３にバイアスを供給する。光入力
１０がＡＰＤ３に加えられると、ＡＰＤ３の信号出力が
前段増幅器５に供給される。前段増幅器５の出力は自動
利得増幅器６に加えられ、自動利得増幅器６の出力は後
段増幅器７に供給される。後段増幅器７の出力は信号出
力として取り出されるとともに、一部は検出器８から利
得制御回路１２に導かれる。
【０００３】次に、利得制御回路１２の回路を図５によ
り説明する。図４の検出器８の出力は端子１２Ａに加え
られ、増幅器１２Ｂで増幅された後、増幅器１２Ｃと増
幅器１２Ｄに分岐される。増幅器１２Ｃの出力は電源１
１の入力に帰還され、増幅器１２Ｄの出力は、自動利得
増幅器６に帰還される。端子１２Ｅには電源１１に対す
るオフセット電圧を加えるための基準電圧が加えられ、
端子１２Ｆには自動利得増幅器６にオフセット電圧を加
えるための基準電圧が加えられる。
り説明する。図４の検出器８の出力は端子１２Ａに加え
られ、増幅器１２Ｂで増幅された後、増幅器１２Ｃと増
幅器１２Ｄに分岐される。増幅器１２Ｃの出力は電源１
１の入力に帰還され、増幅器１２Ｄの出力は、自動利得
増幅器６に帰還される。端子１２Ｅには電源１１に対す
るオフセット電圧を加えるための基準電圧が加えられ、
端子１２Ｆには自動利得増幅器６にオフセット電圧を加
えるための基準電圧が加えられる。
【０００４】次に、ＡＰＤ３に対する光入力と増倍度の
関係を図６により説明する。図６の横軸はＡＰＤ３に加
えられる光入力１０であり、縦軸はＡＰＤ３の増倍度で
ある。ＡＰＤ３には素子感度とアバランシェ効果によ
り、その感度を増倍する増幅度がある。すなわち、光入
力１０のレベルＬ１を加えたとき、ＡＰＤ３に流れる電
流を「１」とすると、光入力１０をレベル２に下げたと
き、ＡＰＤ３の増倍度は増える方向にある。いいかえる
と、レベルＬ１よりレベルＬ２の方が増倍率が大きいの
で、光入力１０の下げ幅より増倍度の上げ幅の方が大き
ければ、逆にＡＰＤ３の電流は増えるようになる。そう
なったとき、ヒステリシスがなかった場合、ＡＰＤ３の
増倍度を下げるように動く。
関係を図６により説明する。図６の横軸はＡＰＤ３に加
えられる光入力１０であり、縦軸はＡＰＤ３の増倍度で
ある。ＡＰＤ３には素子感度とアバランシェ効果によ
り、その感度を増倍する増幅度がある。すなわち、光入
力１０のレベルＬ１を加えたとき、ＡＰＤ３に流れる電
流を「１」とすると、光入力１０をレベル２に下げたと
き、ＡＰＤ３の増倍度は増える方向にある。いいかえる
と、レベルＬ１よりレベルＬ２の方が増倍率が大きいの
で、光入力１０の下げ幅より増倍度の上げ幅の方が大き
ければ、逆にＡＰＤ３の電流は増えるようになる。そう
なったとき、ヒステリシスがなかった場合、ＡＰＤ３の
増倍度を下げるように動く。
【０００５】次に、ＡＰＤ３に対するバイアスと増倍度
の関係を図７により説明する。図７の横軸はＡＰＤ３に
供給されるバイアス電圧であり、縦軸はＡＰＤ３の増倍
度である。曲線Ｐは温度０°Ｃのときの特性であり、曲
線Ｑは温度50°Ｃのときの特性である。増倍度を補正す
るには、自動利得増幅器６の利得を固定し、光入力１０
の入力レベルに応じて増倍率が一定になるように検出器
８の検出信号により制御する。
の関係を図７により説明する。図７の横軸はＡＰＤ３に
供給されるバイアス電圧であり、縦軸はＡＰＤ３の増倍
度である。曲線Ｐは温度０°Ｃのときの特性であり、曲
線Ｑは温度50°Ｃのときの特性である。増倍度を補正す
るには、自動利得増幅器６の利得を固定し、光入力１０
の入力レベルに応じて増倍率が一定になるように検出器
８の検出信号により制御する。
【０００６】次に、図４のＡＰＤ３と自動利得増幅器６
の特性を図８により説明する。図８の曲線ＡがＡＰＤ３
の増倍率であり、曲線Ｂが自動利得増幅器６の利得であ
る。図８の横軸は光入力１０の入力レベルを表し、曲線
Ａは光入力１０が小でＰａの付近では直線で下降し、光
入力１０が大でＰｂの付近では低い増倍率で飽和する。
例えば、Ｐは−30ｄＢｍであり、Ｐｂは−８ｄＢｍ程度
である。曲線Ｂは光入力１０がＰａの付近では高い利得
で飽和し、光入力１０がＰｂの付近では直線で下降す
る。図８のような特性にするのは、光入力１０がＰａの
付近ではＡＰＤ３の増倍率が最適値でＳＮがよくなるよ
うにし、光入力がＰｂの付近ではＡＰＤ３の増倍率が最
適値になるようにするためである。なお、ＡＰＤ３の増
倍率と自動利得増幅器６の利得を調節する技術は、例え
ば1991年電子情報通信学会春季全国大会講演論文集のＢ
ー９４６にも記載されている。
の特性を図８により説明する。図８の曲線ＡがＡＰＤ３
の増倍率であり、曲線Ｂが自動利得増幅器６の利得であ
る。図８の横軸は光入力１０の入力レベルを表し、曲線
Ａは光入力１０が小でＰａの付近では直線で下降し、光
入力１０が大でＰｂの付近では低い増倍率で飽和する。
例えば、Ｐは−30ｄＢｍであり、Ｐｂは−８ｄＢｍ程度
である。曲線Ｂは光入力１０がＰａの付近では高い利得
で飽和し、光入力１０がＰｂの付近では直線で下降す
る。図８のような特性にするのは、光入力１０がＰａの
付近ではＡＰＤ３の増倍率が最適値でＳＮがよくなるよ
うにし、光入力がＰｂの付近ではＡＰＤ３の増倍率が最
適値になるようにするためである。なお、ＡＰＤ３の増
倍率と自動利得増幅器６の利得を調節する技術は、例え
ば1991年電子情報通信学会春季全国大会講演論文集のＢ
ー９４６にも記載されている。
【０００７】
【発明が解決しようとする課題】図４の構成では、ＡＰ
Ｄ３の利得制御回路を自動利得増幅器６のループと共用
にしているので、最適値の設定が困難である。図８の光
入力１０がＰａ付近ではＡＰＤ３の増倍率の温度変動を
吸収させるため、自動利得増幅器６の利得を飽和させ、
ＡＰＤ３の増倍率を変えて総合の利得を調整している
が、ＡＰＤ３への光入力１０の信号速度が早くなるにつ
れ、ＳＮ比の影響でＡＰＤ３の最適増倍率の範囲が狭ま
くなり、自動利得増幅器６の利得変動などを吸収するこ
とができなくなる。このため、光受信回路のダイナミッ
クレンジを広くする妨げになっている。この発明は、Ａ
ＰＤ３の帰還ループと自動利得増幅器６の帰還ループを
別々に設け、光入力１０が上限と下限のとき、ＡＰＤ３
のバイアス電圧を最適値に設定することができる光・電
気変換回路の利得制御回路の提供を目的とする。
Ｄ３の利得制御回路を自動利得増幅器６のループと共用
にしているので、最適値の設定が困難である。図８の光
入力１０がＰａ付近ではＡＰＤ３の増倍率の温度変動を
吸収させるため、自動利得増幅器６の利得を飽和させ、
ＡＰＤ３の増倍率を変えて総合の利得を調整している
が、ＡＰＤ３への光入力１０の信号速度が早くなるにつ
れ、ＳＮ比の影響でＡＰＤ３の最適増倍率の範囲が狭ま
くなり、自動利得増幅器６の利得変動などを吸収するこ
とができなくなる。このため、光受信回路のダイナミッ
クレンジを広くする妨げになっている。この発明は、Ａ
ＰＤ３の帰還ループと自動利得増幅器６の帰還ループを
別々に設け、光入力１０が上限と下限のとき、ＡＰＤ３
のバイアス電圧を最適値に設定することができる光・電
気変換回路の利得制御回路の提供を目的とする。
【０００８】
【課題を解決するための手段】この目的を達成するた
め、この発明では、ＤＣーＤＣコンバータで構成される
電源１の出力とフォトカプラ２のＬＥＤ２ＡとＡＰＤ３
を直列に接続し、ＡＰＤ３に光入力１０を加え、ＡＰＤ
３に流れる平均電流でフォトカプラ２のＬＥＤ２Ａを発
光させ、フォトカプラ２のフォトトランジスタ２Ｂの出
力を増倍率制御回路４に加え、光入力１０の大小により
増倍率制御回路４の出力を制御し、増倍率制御回路４の
出力を電源１の入力に帰還し、電源１の出力電圧を上限
電圧Ｖａと下限電圧Ｖｂの間で変え、ＡＰＤ３の増倍率
を上限電圧Ｖａに対応する光入力の低いＰａ付近では高
い増倍率で飽和させ、下限電圧Ｖｂに対応する光入力の
高いＰｂ付近では低い増倍率で飽和させ、ＡＰＤ３に光
入力１０を加え、ＡＰＤ３の信号出力を自動利得制御増
幅器６に加え、自動利得制御増幅器６の出力を利得制御
回路９から自動利得制御増幅器６に帰還させ、自動利得
制御増幅器６の利得をＰａ付近からＰｂ付近にかけて信
号出力が一定の特性にする。
め、この発明では、ＤＣーＤＣコンバータで構成される
電源１の出力とフォトカプラ２のＬＥＤ２ＡとＡＰＤ３
を直列に接続し、ＡＰＤ３に光入力１０を加え、ＡＰＤ
３に流れる平均電流でフォトカプラ２のＬＥＤ２Ａを発
光させ、フォトカプラ２のフォトトランジスタ２Ｂの出
力を増倍率制御回路４に加え、光入力１０の大小により
増倍率制御回路４の出力を制御し、増倍率制御回路４の
出力を電源１の入力に帰還し、電源１の出力電圧を上限
電圧Ｖａと下限電圧Ｖｂの間で変え、ＡＰＤ３の増倍率
を上限電圧Ｖａに対応する光入力の低いＰａ付近では高
い増倍率で飽和させ、下限電圧Ｖｂに対応する光入力の
高いＰｂ付近では低い増倍率で飽和させ、ＡＰＤ３に光
入力１０を加え、ＡＰＤ３の信号出力を自動利得制御増
幅器６に加え、自動利得制御増幅器６の出力を利得制御
回路９から自動利得制御増幅器６に帰還させ、自動利得
制御増幅器６の利得をＰａ付近からＰｂ付近にかけて信
号出力が一定の特性にする。
【０００９】
【作用】次に、この発明による光・電気変換回路の利得
制御回路の構成を図１により説明する。図１の１は電
源、２はフォトカプラ、４は増倍率制御回路、９は利得
制御回路であり、その他は図４と同じものである。すな
わち、図１は図４の電源１１と利得制御回路１２の代わ
りに、電源１、フォトカプラ２、増倍率制御回路４及び
利得制御回路９を採用し、ＡＰＤ３の利得制御回路を自
動利得増幅器６の利得制御回路から分離したものであ
る。
制御回路の構成を図１により説明する。図１の１は電
源、２はフォトカプラ、４は増倍率制御回路、９は利得
制御回路であり、その他は図４と同じものである。すな
わち、図１は図４の電源１１と利得制御回路１２の代わ
りに、電源１、フォトカプラ２、増倍率制御回路４及び
利得制御回路９を採用し、ＡＰＤ３の利得制御回路を自
動利得増幅器６の利得制御回路から分離したものであ
る。
【００１０】次に、図１の電源１、フォトカプラ２、Ａ
ＰＤ３、増倍率制御回路４の回路図を図２により説明す
る。増倍率制御回路４は増幅器４Ａと増幅器４Ｂで構成
される。電源１の出力とフォトカプラ２のＬＥＤ２Ａと
ＡＰＤ３は直列に接続される。ＡＰＤ３に光入力１０を
加えると、光入力１０に応じたＡＰＤ３の平均電流でフ
ォトカプラ２のＬＥＤ２Ａが発光する。ＬＥＤ２Ａの発
光はフォトトランジスタ２Ｂの出力に変換され、増倍率
制御回路４に供給される。増倍率制御回路４の出力は電
源１の入力に帰還される。増幅器４Ｂは、入力電圧がオ
フセット電圧４Ｃより大きい場合は出力が０Ｖ方向に下
がり、入力電圧がオフセット電圧４Ｃより小さい場合は
出力が電源電圧方向に上がる。
ＰＤ３、増倍率制御回路４の回路図を図２により説明す
る。増倍率制御回路４は増幅器４Ａと増幅器４Ｂで構成
される。電源１の出力とフォトカプラ２のＬＥＤ２Ａと
ＡＰＤ３は直列に接続される。ＡＰＤ３に光入力１０を
加えると、光入力１０に応じたＡＰＤ３の平均電流でフ
ォトカプラ２のＬＥＤ２Ａが発光する。ＬＥＤ２Ａの発
光はフォトトランジスタ２Ｂの出力に変換され、増倍率
制御回路４に供給される。増倍率制御回路４の出力は電
源１の入力に帰還される。増幅器４Ｂは、入力電圧がオ
フセット電圧４Ｃより大きい場合は出力が０Ｖ方向に下
がり、入力電圧がオフセット電圧４Ｃより小さい場合は
出力が電源電圧方向に上がる。
【００１１】電源１は、増倍率制御回路４の出力により
ＡＰＤ３のバイアス電圧を変えるが、光入力１０が小さ
い場合はＳＮ比のよい最適値になるようにし、光入力１
０が大きい場合は周波数特性が劣化せず、かつ増倍率が
最小となるように調整される。
ＡＰＤ３のバイアス電圧を変えるが、光入力１０が小さ
い場合はＳＮ比のよい最適値になるようにし、光入力１
０が大きい場合は周波数特性が劣化せず、かつ増倍率が
最小となるように調整される。
【００１２】次に、図１によるＡＰＤ３の増倍率と自動
利得増幅器６の特性を図３により説明する。図３の横軸
と縦軸の関係は図８と同じである。曲線ＡはＡＰＤ３の
増倍率の特性であり、曲線Ｂは自動利得増幅器６の特性
である。図３では、光入力１０の大小に応じて増倍率制
御回路４の出力を制御し、ＡＰＤ３の増倍率を上限電圧
Ｖａに対応する光入力の低いＰａ付近では飽和させ、下
限電圧Ｖｂに対応する光入力１０の高いＰｂ付近では飽
和させる。光入力１０の中央部分に対しては、曲線Ａは
両側の飽和部分を結び信号出力が一定の特性になるよう
な線にする。電源１はＤＣーＤＣコンバータで構成され
ており、入力電圧を増減することにより上限電圧Ｖａと
下限電圧Ｖｂの間で出力電圧を変える。例えば、上限電
圧Ｖａ＝50Ｖ、下限電圧Ｖｂ＝30Ｖにする。曲線Ｂは図
１の利得制御回路９で制御され、ＰａとＰｂの部分を信
号出力が一定の特性になるような線にする。利得制御回
路９は図５の増幅器１２Ｃを取り除いたものである。
利得増幅器６の特性を図３により説明する。図３の横軸
と縦軸の関係は図８と同じである。曲線ＡはＡＰＤ３の
増倍率の特性であり、曲線Ｂは自動利得増幅器６の特性
である。図３では、光入力１０の大小に応じて増倍率制
御回路４の出力を制御し、ＡＰＤ３の増倍率を上限電圧
Ｖａに対応する光入力の低いＰａ付近では飽和させ、下
限電圧Ｖｂに対応する光入力１０の高いＰｂ付近では飽
和させる。光入力１０の中央部分に対しては、曲線Ａは
両側の飽和部分を結び信号出力が一定の特性になるよう
な線にする。電源１はＤＣーＤＣコンバータで構成され
ており、入力電圧を増減することにより上限電圧Ｖａと
下限電圧Ｖｂの間で出力電圧を変える。例えば、上限電
圧Ｖａ＝50Ｖ、下限電圧Ｖｂ＝30Ｖにする。曲線Ｂは図
１の利得制御回路９で制御され、ＰａとＰｂの部分を信
号出力が一定の特性になるような線にする。利得制御回
路９は図５の増幅器１２Ｃを取り除いたものである。
【００１３】次に、図１の数値例を示す。電源１の出力
電圧が30〜50Ｖであり、光入力１０が−10〜−30ｄＢｍ
の範囲で変化する場合、光入力１０が−20ｄＢｍのと
き、電源１の出力が40Ｖになるように、増幅器４Ｂのオ
フセット電圧を調整する。例えば、光入力１０が−20ｄ
Ｂｍのとき、ＬＥＤ２Ａには0.05ｍＡの電流が流れる。
フォトカプラ２の効率を30％とすると、フォトトランジ
スタ２Ｂの出力電流は、0.015ｍＡとなる。このときの
増幅器４Ａの出力が１Ｖになるように、増幅器４Ａの利
得を調整する。増幅器４Ｂの利得を10とすると、入力が
−１Ｖのときの出力が４Ｖになるように、オフセット電
圧４Ｃを調整する。これにより、光入力１０が−20ｄＢ
ｍ以下のときは増幅器４Ｂの出力が上り、電源１の出力
が増え、最大で50Ｖになる。光入力１０が−20ｄＢｍ以
上のときは増幅器４Ｂの出力が下がり、電源１の出力が
低くなり、最小で30Ｖになる。
電圧が30〜50Ｖであり、光入力１０が−10〜−30ｄＢｍ
の範囲で変化する場合、光入力１０が−20ｄＢｍのと
き、電源１の出力が40Ｖになるように、増幅器４Ｂのオ
フセット電圧を調整する。例えば、光入力１０が−20ｄ
Ｂｍのとき、ＬＥＤ２Ａには0.05ｍＡの電流が流れる。
フォトカプラ２の効率を30％とすると、フォトトランジ
スタ２Ｂの出力電流は、0.015ｍＡとなる。このときの
増幅器４Ａの出力が１Ｖになるように、増幅器４Ａの利
得を調整する。増幅器４Ｂの利得を10とすると、入力が
−１Ｖのときの出力が４Ｖになるように、オフセット電
圧４Ｃを調整する。これにより、光入力１０が−20ｄＢ
ｍ以下のときは増幅器４Ｂの出力が上り、電源１の出力
が増え、最大で50Ｖになる。光入力１０が−20ｄＢｍ以
上のときは増幅器４Ｂの出力が下がり、電源１の出力が
低くなり、最小で30Ｖになる。
【００１４】
【発明の効果】この発明によれば、ＡＰＤの帰還ループ
と自動利得増幅器の帰還ループを別々に設けているの
で、光入力が上限と下限のとき、ＡＰＤのバイアス電圧
を最適値に設定することができる。これにより、従来技
術による光入力のダイナミックレンジが−10〜29ｄＢｍ
程度に対し、−８〜−30ｄＢｍ程度することができる。
と自動利得増幅器の帰還ループを別々に設けているの
で、光入力が上限と下限のとき、ＡＰＤのバイアス電圧
を最適値に設定することができる。これにより、従来技
術による光入力のダイナミックレンジが−10〜29ｄＢｍ
程度に対し、−８〜−30ｄＢｍ程度することができる。
【図１】この発明による光・電気変換回路の利得制御回
路の構成図である。
路の構成図である。
【図２】図１の部分回路図でる。
【図３】図１によるＡＰＤ３の増倍率と自動利得増幅器
６の特性図である。
６の特性図である。
【図４】従来技術による光・電気変換回路の利得制御回
路図である。
路図である。
【図５】利得制御回路１２の回路図である。
【図６】ＡＰＤ３に対する光入力と増倍度の関係図であ
る。
る。
【図７】ＡＰＤ３に対するバイアスと増倍度の関係図で
ある。
ある。
【図８】図４のＡＰＤ３と自動利得増幅器６の特性図で
ある。
ある。
１ 電源 ２ フォトカプラ ２Ａ ＬＥＤ ２Ｂ フォトトランジスタ ３ ＡＰＤ（アバランシェフォトダイオード） ４ 増倍率制御回路 ６ 自動利得増幅器 ９ 利得制御回路 １０ 光入力
Claims (1)
- 【特許請求の範囲】 【請求項１】 ＤＣーＤＣコンバータで構成される電源
(1) の出力とフォトカプラ(2) のＬＥＤ(2A)とアバラン
シェフォトダイオード(3) を直列に接続し、 アバランシェフォトダイオード(3) に光入力(10)を加
え、アバランシェフォトダイオード(3) に流れる平均電
流でフォトカプラ(2) のＬＥＤ(2A)を発光させ、フォト
カプラ(2) のフォトトランジスタ(2B)の出力を増倍率制
御回路(4) に加え、光入力(10)の大小により増倍率制御
回路(4) の出力を制御し、増倍率制御回路(4) の出力を
電源(1) の入力に帰還し、電源(1) の出力電圧を上限電
圧Ｖａと下限電圧Ｖｂの間で変え、アバランシェフォト
ダイオード(3) の増倍率を上限電圧Ｖａに対応する光入
力の低いＰａ付近では高い増倍率で飽和させ、下限電圧
Ｖｂに対応する光入力の高いＰｂ付近では低い増倍率で
飽和させ、 アバランシェフォトダイオード(3) に光入力(10)を加
え、アバランシェフォトダイオード(3) の信号出力を自
動利得制御増幅器(6) に加え、自動利得制御増幅器(6)
の出力を利得制御回路(9)から自動利得制御増幅器(6)
に帰還させ、自動利得制御増幅器(6) の利得をＰａ付近
からＰｂ付近にかけて信号出力が一定の特性にすること
を特徴とする光・電気変換回路の利得制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18694291A JPH0514086A (ja) | 1991-07-02 | 1991-07-02 | 光・電気変換回路の利得制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18694291A JPH0514086A (ja) | 1991-07-02 | 1991-07-02 | 光・電気変換回路の利得制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0514086A true JPH0514086A (ja) | 1993-01-22 |
Family
ID=16197422
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18694291A Pending JPH0514086A (ja) | 1991-07-02 | 1991-07-02 | 光・電気変換回路の利得制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0514086A (ja) |
-
1991
- 1991-07-02 JP JP18694291A patent/JPH0514086A/ja active Pending
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