JPH0486941U - - Google Patents

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JPH0486941U
JPH0486941U JP12836290U JP12836290U JPH0486941U JP H0486941 U JPH0486941 U JP H0486941U JP 12836290 U JP12836290 U JP 12836290U JP 12836290 U JP12836290 U JP 12836290U JP H0486941 U JPH0486941 U JP H0486941U
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JP
Japan
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output
memory
registered
circuit
computer
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JP12836290U
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【図面の簡単な説明】
第1図及び第2図はこの考案の一実施例を示す
図であり、第1図は出力パターンメモリと緊急処
理メモリの構成図、第2図は登録パターンの状態
を示す図、第3図は従来の出力制御回路を示す図
である。 1は計算機、2はデータバス、3はアドレスバ
ス、4は書き込み信号、5aは出力回路、6はア
ドレスデコーダ、8は出力保護回路、11は出力
パターンメモリ、12は書き込み制御信号、13
はゲート回路、14は出力セレクト信号、15は
主メモリ、17は緊急処理メモリ、18は切換回
路である。なお、図中、同一符号は同一、又は相
当部分を示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. プログラムの実行手順に従つて演算を実行する
    計算機、プログラムを格納する主メモリ、複数の
    制御装置を組合わせて使用するための論理演算結
    果を外部の制御装置に出力する出力回路、出力で
    きる組合わせ論理データを予め登録し、出力され
    た組合わせ論理データが登録されたデータか否か
    を判定する出力パターンメモリ、出力回路と出力
    パターンメモリを計算機から出力されたアドレス
    情報に従つて選択するアドレスデコーダ、計算機
    から出力された組合わせ論理データが出力パター
    ンメモリによつて判定され、登録されている時は
    アドレスデコーダからのセレクト信号を出力回路
    に転送し、もし未登録の時はセレクト信号を禁止
    するゲート回路、出力パターンメモリの判定結果
    が未登録を示した場合に計算機に緊急処理プログ
    ラムを出力する緊急処理メモリ、出力パターンメ
    モリの判定結果が未登録を示した場合に計算機か
    らのプログラム読み出し信号の行き先を主メモリ
    から緊急処理メモリに切り換える切換回路より構
    成され、計算機から出力回路へ組合わせ論理デー
    タの書き込みが行われた場合、先ず出力パターン
    メモリで登録パターンか否かをチエツクし、登録
    パターンである場合は出力パターンメモリよりゲ
    ート回路に出力可の信号を出力して出力回路にセ
    レクト信号を転送し、もし登録パターンでなかつ
    た場合は出力パターンメモリよりゲート回路にセ
    レクト信号の禁止を出力すると共に計算機へのプ
    ログラム転送を主メモリから緊急処理メモリに切
    り換えることを特徴とする出力制御回路。
JP12836290U 1990-11-30 1990-11-30 Pending JPH0486941U (ja)

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JPH0486941U true JPH0486941U (ja) 1992-07-28

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