JPH0447277B2 - - Google Patents
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- JPH0447277B2 JPH0447277B2 JP57087120A JP8712082A JPH0447277B2 JP H0447277 B2 JPH0447277 B2 JP H0447277B2 JP 57087120 A JP57087120 A JP 57087120A JP 8712082 A JP8712082 A JP 8712082A JP H0447277 B2 JPH0447277 B2 JP H0447277B2
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- JP
- Japan
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- signal
- operating clock
- minute
- time
- hour
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
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- 230000000737 periodic effect Effects 0.000 claims description 33
- 230000001960 triggered effect Effects 0.000 description 7
- 238000000034 method Methods 0.000 description 6
- 230000010355 oscillation Effects 0.000 description 3
- 230000000630 rising effect Effects 0.000 description 3
- 230000003111 delayed effect Effects 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
Classifications
-
- G—PHYSICS
- G04—HOROLOGY
- G04C—ELECTROMECHANICAL CLOCKS OR WATCHES
- G04C3/00—Electromechanical clocks or watches independent of other time-pieces and in which the movement is maintained by electric means
- G04C3/14—Electromechanical clocks or watches independent of other time-pieces and in which the movement is maintained by electric means incorporating a stepping motor
- G04C3/146—Electromechanical clocks or watches independent of other time-pieces and in which the movement is maintained by electric means incorporating a stepping motor incorporating two or more stepping motors or rotors
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- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Electromechanical Clocks (AREA)
- Control Of Stepping Motors (AREA)
Description
【発明の詳細な説明】
本発明は、指針表示時計に係り、特に、複数の
ステツプモータを駆動する駆動方式に関するもの
である。
ステツプモータを駆動する駆動方式に関するもの
である。
本発明の目的は、複数のステツプモータを有す
る指針表示時計において、電源への負荷を軽く
し、安定な駆動が可能なステツプモータ駆動回路
を供給し、製品化の問題点を解決する事にある。
る指針表示時計において、電源への負荷を軽く
し、安定な駆動が可能なステツプモータ駆動回路
を供給し、製品化の問題点を解決する事にある。
従来、複数のステツプモータを駆動する場合に
は、同時に駆動すると、１個の電源では、負荷が
加わりすぎて、電圧が下がつてしまい安定な動作
が望めなかつた。例えば、電源の内部インピーダ
ンス200Ωとして、ステツプモータを４個同時に
動作すると、電源1.5Vに於いて、ステツプモー
タには、約1.1Vしか加わらない事になつてしま
う。特に腕時計等では、電源として、電池を使用
しており、低温時には、ステツプモータが停止し
てしまう危険性が高かつた。
は、同時に駆動すると、１個の電源では、負荷が
加わりすぎて、電圧が下がつてしまい安定な動作
が望めなかつた。例えば、電源の内部インピーダ
ンス200Ωとして、ステツプモータを４個同時に
動作すると、電源1.5Vに於いて、ステツプモー
タには、約1.1Vしか加わらない事になつてしま
う。特に腕時計等では、電源として、電池を使用
しており、低温時には、ステツプモータが停止し
てしまう危険性が高かつた。
これを改良する方式として、ステツプモータの
駆動信号の位相を順次ずらしておく方式が考えら
れる。しかしこの方式では、複数のステツプモー
タの内、１つが動作する場合でも、他のモータ駆
動に対して位相差が設けられているために、指針
の指示遅れがでてしまう。つまり、５個のステツ
プモータを駆動する場合、各々のステツプモータ
の駆動信号のずれを、60msecとすると、５個目
のステツプモータは、最初のステツプモータに対
して300msec時間的に遅れる事になる。この方式
でゆけば、５個のステツプモータのみ動作させる
場合でも、指示が300msec位遅れる事になる。例
えば、スイツチ操作によつてステツプモータを動
かした場合には、スイツチ操作から、モータが実
際に動くまでの間に遅れが出てしまい、操作感覚
が非常に悪くなつてしまう。
駆動信号の位相を順次ずらしておく方式が考えら
れる。しかしこの方式では、複数のステツプモー
タの内、１つが動作する場合でも、他のモータ駆
動に対して位相差が設けられているために、指針
の指示遅れがでてしまう。つまり、５個のステツ
プモータを駆動する場合、各々のステツプモータ
の駆動信号のずれを、60msecとすると、５個目
のステツプモータは、最初のステツプモータに対
して300msec時間的に遅れる事になる。この方式
でゆけば、５個のステツプモータのみ動作させる
場合でも、指示が300msec位遅れる事になる。例
えば、スイツチ操作によつてステツプモータを動
かした場合には、スイツチ操作から、モータが実
際に動くまでの間に遅れが出てしまい、操作感覚
が非常に悪くなつてしまう。
本発明は、これらの点に鑑みて、複数のモータ
が同時に動作する時は、大きなずれを作つても、
少数のモータ或いは単独でモータが動作する時に
は、そのずれを少なくする方式を提供する。
が同時に動作する時は、大きなずれを作つても、
少数のモータ或いは単独でモータが動作する時に
は、そのずれを少なくする方式を提供する。
以下に図面を用いて、詳細に説明する。
第１図に示すのは、本発明による指針表示時計
の回路図の一実施例である。
の回路図の一実施例である。
第１図に示す実施例では、ステツプモータを３
個使用し、時刻の時・分・秒を各々のステツプモ
ータを使用して指針表示した例である。
個使用し、時刻の時・分・秒を各々のステツプモ
ータを使用して指針表示した例である。
１は発振回路で、時間標準となる比較的高い周
波数信号を出力する。２は分周回路で、発振回路
１からの時間標準信号を分周し、必要な低周波信
号に分周する（クロツク信号φ、φM及び１秒周
期信号）。３は秒カウンターで、分周回路２で分
周された１秒周期信号を計数して１分周期信号を
出力する。又、操作スイツチ（図示せず）から分
を指定する信号に基づいて基づいて任意に１分信
号を秒カウンターから出力する。
波数信号を出力する。２は分周回路で、発振回路
１からの時間標準信号を分周し、必要な低周波信
号に分周する（クロツク信号φ、φM及び１秒周
期信号）。３は秒カウンターで、分周回路２で分
周された１秒周期信号を計数して１分周期信号を
出力する。又、操作スイツチ（図示せず）から分
を指定する信号に基づいて基づいて任意に１分信
号を秒カウンターから出力する。
４は分カウンターで、秒カウンター３からの１
分周期信号を計数して１時間周期信号を出力す
る。又、操作スイツチ（図示せず）から時刻を指
定する信号に基づいて任意に１時間信号を分カウ
ンター３から出力する。５は時刻カウンターで、
分カウンター４からの１時間周期信号を計数す
る。
分周期信号を計数して１時間周期信号を出力す
る。又、操作スイツチ（図示せず）から時刻を指
定する信号に基づいて任意に１時間信号を分カウ
ンター３から出力する。５は時刻カウンターで、
分カウンター４からの１時間周期信号を計数す
る。
６はＤタイプ・フリツプフロツプで、出力と
Ｄ入力とが接続され、分周回路２から１秒周期信
号又は１秒信号の立ち上がりをトリガにして記憶
保持する。７はＤタイプ・フリツプフロツプで、
Ｑ出力とＤ入力とが接続され、秒カウンター３か
らの１分周期信号又は１分信号の立ち下がりをト
リガにして記憶保持する。８はＤタイプ・フリツ
プフロツプで、出力とＤ入力とが接続され、分
カウンター４からの１時間周期信号又は１時間信
号の立ち下がりをトリガにして記憶保持する。
Ｄ入力とが接続され、分周回路２から１秒周期信
号又は１秒信号の立ち上がりをトリガにして記憶
保持する。７はＤタイプ・フリツプフロツプで、
Ｑ出力とＤ入力とが接続され、秒カウンター３か
らの１分周期信号又は１分信号の立ち下がりをト
リガにして記憶保持する。８はＤタイプ・フリツ
プフロツプで、出力とＤ入力とが接続され、分
カウンター４からの１時間周期信号又は１時間信
号の立ち下がりをトリガにして記憶保持する。
９はＤタイプ・フリツプフロツプで、分周回路
２で分周されたクロツク信号φがインバータ２６
で反転され、その反転されたクロツク信号φの立
ち下がりをトリガにしてＤタイプ・フリツプフロ
ツプ６からのＱ出力をＤ入力で入力して記憶保持
する。１０はＤタイプ・フリツプフロツプで、分
周回路２で分周され、NANDゲート１９を介し
たクロツク信号φの立ち下がりをトリガにしてＤ
タイプ・フリツプフロツプ７からのＱ出力をＤ入
力で入力して記憶保持する。
２で分周されたクロツク信号φがインバータ２６
で反転され、その反転されたクロツク信号φの立
ち下がりをトリガにしてＤタイプ・フリツプフロ
ツプ６からのＱ出力をＤ入力で入力して記憶保持
する。１０はＤタイプ・フリツプフロツプで、分
周回路２で分周され、NANDゲート１９を介し
たクロツク信号φの立ち下がりをトリガにしてＤ
タイプ・フリツプフロツプ７からのＱ出力をＤ入
力で入力して記憶保持する。
１１はＤタイプ・フリツプフロツプで、
NANDゲート１９を介したクロツク信号φがイ
ンバータ２７で反転され、その反転されたクロツ
ク信号がNANDゲート２０を介したそのクロツ
ク信号の立ち下がりをトリガにしてＤタイプ・フ
リツプフロツプ８からのＱ出力をＤ入力で入力し
て記憶保持する。
NANDゲート１９を介したクロツク信号φがイ
ンバータ２７で反転され、その反転されたクロツ
ク信号がNANDゲート２０を介したそのクロツ
ク信号の立ち下がりをトリガにしてＤタイプ・フ
リツプフロツプ８からのＱ出力をＤ入力で入力し
て記憶保持する。
１４，２１，２２はＤタイプ・フリツプフロツ
プ９のＱ出力に基づいてステツプモータ１７を駆
動するモータ駆動信号形成回路１である。又、１
３，２３，２６はＤタイプ・フリツプフロツプ１
０のＱ出力に基づいてステツプモータ１７を駆動
するモータ駆動信号形成回路２である。更に、１
２，２４，２５はＤタイプ・フリツプフロツプ１
１のＱ出力に基づいてステツプモータ１７を駆動
するモータ駆動信号形成回路３である。
プ９のＱ出力に基づいてステツプモータ１７を駆
動するモータ駆動信号形成回路１である。又、１
３，２３，２６はＤタイプ・フリツプフロツプ１
０のＱ出力に基づいてステツプモータ１７を駆動
するモータ駆動信号形成回路２である。更に、１
２，２４，２５はＤタイプ・フリツプフロツプ１
１のＱ出力に基づいてステツプモータ１７を駆動
するモータ駆動信号形成回路３である。
１５はＤタイプ・フリツプフロツプで、VCC
電源がＤ入力に常に入力されていると共に、分周
回路２からの１秒周期信号又は１秒信号がリセツ
ト入力に入力されリセツトされる。そして、分周
回路２からのクロツク信号φの立ち下がりをトリ
ガにして記憶保持され、そのＱ出力をNANDゲ
ート１９の一方の入力側に入力している。１６は
Ｄタイプ・フリツプフロツプで、VCC電源がＤ
入力に常に入力されていると共に、秒カウンター
３からの１分周期信号又は１分信号がリセツト入
力に入力されリセツトされる。そして、インバー
タ２７で反転されたクロツク信号の立ち下がりを
トリガにして記憶保持され、そのＱ出力を
NANDゲート２０の一方の入力側に入力してい
る。ＡはＤタイプ・フリツプフロツプ６，７，
８，９，１０，１１，１５，１６、NANDゲー
ト１９，２０及びインバータ２６，２７から構成
された優先順序回路である。尚、Ｄタイプ・フリ
ツプフロツプ６、インバータ２６及びＤタイプ・
フリツプフロツプ９を秒針制御部、Ｄタイプ・フ
リツプフロツプ１５及びNANDゲート１９を第
１の動作クロツク供給制御部、Ｄタイプ・フリツ
プフロツプ７及びＤタイプ・フリツプフロツプ１
０を分針制御部、インバータ２７、Ｄタイプ・フ
リツプフロツプ１６及びNANDゲート２０を第
２の動作クロツク供給制御部及びＤタイプ・フリ
ツプフロツプ８及びＤタイプ・フリツプフロツプ
１１を時針制御部とする。
電源がＤ入力に常に入力されていると共に、分周
回路２からの１秒周期信号又は１秒信号がリセツ
ト入力に入力されリセツトされる。そして、分周
回路２からのクロツク信号φの立ち下がりをトリ
ガにして記憶保持され、そのＱ出力をNANDゲ
ート１９の一方の入力側に入力している。１６は
Ｄタイプ・フリツプフロツプで、VCC電源がＤ
入力に常に入力されていると共に、秒カウンター
３からの１分周期信号又は１分信号がリセツト入
力に入力されリセツトされる。そして、インバー
タ２７で反転されたクロツク信号の立ち下がりを
トリガにして記憶保持され、そのＱ出力を
NANDゲート２０の一方の入力側に入力してい
る。ＡはＤタイプ・フリツプフロツプ６，７，
８，９，１０，１１，１５，１６、NANDゲー
ト１９，２０及びインバータ２６，２７から構成
された優先順序回路である。尚、Ｄタイプ・フリ
ツプフロツプ６、インバータ２６及びＤタイプ・
フリツプフロツプ９を秒針制御部、Ｄタイプ・フ
リツプフロツプ１５及びNANDゲート１９を第
１の動作クロツク供給制御部、Ｄタイプ・フリツ
プフロツプ７及びＤタイプ・フリツプフロツプ１
０を分針制御部、インバータ２７、Ｄタイプ・フ
リツプフロツプ１６及びNANDゲート２０を第
２の動作クロツク供給制御部及びＤタイプ・フリ
ツプフロツプ８及びＤタイプ・フリツプフロツプ
１１を時針制御部とする。
本発明の指針表示時計は上記のように構成され
ており、第２図は第１図の動作を示すタイミング
チヤートであり、その動作を説明する。
ており、第２図は第１図の動作を示すタイミング
チヤートであり、その動作を説明する。
先ず、発振回路１から時間標準となる基本クロ
ツク信号（時間標準信号）が分周回路２に出力さ
れ、分周回路２はその基本クロツク信号を分周し
てクロツク信号φM、クロツク信号φ及び１秒周
期信号を出力する。そして、分周された１秒周期
信号を秒カウンター３で計数され、秒カウンター
３から１分周期信号が出力される。更に、その１
分周期信号を分カウンター４で計数され、分カウ
ンター４から１時間周期信号が出力される。そし
て、これらの周期信号が重なる場合、第２図に示
すようにＤタイプ・フリツプフロツプ６，７，８
は１秒周期信号、１分周期信号及び１時間周期信
号の立ち下がりをトリガにしてそれらの時間を記
憶保持してＱ出力をＨレベルに立ち上げる。
ツク信号（時間標準信号）が分周回路２に出力さ
れ、分周回路２はその基本クロツク信号を分周し
てクロツク信号φM、クロツク信号φ及び１秒周
期信号を出力する。そして、分周された１秒周期
信号を秒カウンター３で計数され、秒カウンター
３から１分周期信号が出力される。更に、その１
分周期信号を分カウンター４で計数され、分カウ
ンター４から１時間周期信号が出力される。そし
て、これらの周期信号が重なる場合、第２図に示
すようにＤタイプ・フリツプフロツプ６，７，８
は１秒周期信号、１分周期信号及び１時間周期信
号の立ち下がりをトリガにしてそれらの時間を記
憶保持してＱ出力をＨレベルに立ち上げる。
一方、Ｄタイプ・フリツプフロツプ１５のリセ
ツト入力には１秒周期信号が、又、Ｄタイプ・フ
リツプフロツプ１６のリセツト入力には１分周期
信号が入力されており。Ｄタイプ・フリツプフロ
ツプ１５及びＤタイプ・フリツプフロツプ１６を
一時的にリセツトして、それぞれのＱ出力からは
Ｌレベルの信号が出力される。そのため、
NANDゲート１９，２０の一方の入力側がＬレ
ベルになるためそれらのゲートが閉じられ、分周
回路２からのクロツク信号φがNANDゲート１
９，２０を介して出力されず、それらのゲートの
出力が一時的にＨレベルになる。そして、１秒周
期信号、１分周期信号及び１時間周期信号がそれ
ぞれＨレベルからＬレベルに立ち下がると、Ｄタ
イプ・フリツプフロツプ６，７，８はその立ち下
がりの信号をトリガにしてそれぞれの時間を記憶
保持し、それらのＱ出力からはＨレベルの信号が
出力される。すると、初めに、Ｄタイプ・フリツ
プフロツプ９はインバータ２６で反転されたクロ
ツク信号φの立ち下がりをトリガにしてＤタイ
プ・フリツプフロツプ６のＱ出力（Ｈレベル）を
入力して記憶保持し、Ｑ出力からはＨレベルの信
号がモータ駆動信号形成回路１に出力され。モー
タ駆動信号形成回路１はその立ち上がりの信号に
基づいてステツプモータ１７を駆動する。
ツト入力には１秒周期信号が、又、Ｄタイプ・フ
リツプフロツプ１６のリセツト入力には１分周期
信号が入力されており。Ｄタイプ・フリツプフロ
ツプ１５及びＤタイプ・フリツプフロツプ１６を
一時的にリセツトして、それぞれのＱ出力からは
Ｌレベルの信号が出力される。そのため、
NANDゲート１９，２０の一方の入力側がＬレ
ベルになるためそれらのゲートが閉じられ、分周
回路２からのクロツク信号φがNANDゲート１
９，２０を介して出力されず、それらのゲートの
出力が一時的にＨレベルになる。そして、１秒周
期信号、１分周期信号及び１時間周期信号がそれ
ぞれＨレベルからＬレベルに立ち下がると、Ｄタ
イプ・フリツプフロツプ６，７，８はその立ち下
がりの信号をトリガにしてそれぞれの時間を記憶
保持し、それらのＱ出力からはＨレベルの信号が
出力される。すると、初めに、Ｄタイプ・フリツ
プフロツプ９はインバータ２６で反転されたクロ
ツク信号φの立ち下がりをトリガにしてＤタイ
プ・フリツプフロツプ６のＱ出力（Ｈレベル）を
入力して記憶保持し、Ｑ出力からはＨレベルの信
号がモータ駆動信号形成回路１に出力され。モー
タ駆動信号形成回路１はその立ち上がりの信号に
基づいてステツプモータ１７を駆動する。
又、１秒周期信号がＨレベルからＬレベルにな
ると、Ｄタイプ・フリツプフロツプ１５のリセツ
トが解除され、分周回路２からのクロツク信号φ
の立ち下がりをトリガにしてＤタイプ・フリツプ
フロツプ１５のＱ出力がＨレベルになると
NANDゲート１９が開かれ、分周回路２からの
クロツク信号φがNANDゲート１９を介して反
転してＤタイプ・フリツプフロツプ１０に入力さ
れ、Ｄタイプ・フリツプフロツプ１０はそのクロ
ツク信号の立ち下がりをトリガにしてＤタイプ・
フリツプフロツプ７のＱ出力（Ｈレベル）を記憶
保持し、Ｑ出力からＨレベルの信号をモータ駆動
信号形成回路２に出力する。モータ駆動信号形成
回路２はその立ち下がりの信号に基づいてステツ
プモータ１７′を駆動する。
ると、Ｄタイプ・フリツプフロツプ１５のリセツ
トが解除され、分周回路２からのクロツク信号φ
の立ち下がりをトリガにしてＤタイプ・フリツプ
フロツプ１５のＱ出力がＨレベルになると
NANDゲート１９が開かれ、分周回路２からの
クロツク信号φがNANDゲート１９を介して反
転してＤタイプ・フリツプフロツプ１０に入力さ
れ、Ｄタイプ・フリツプフロツプ１０はそのクロ
ツク信号の立ち下がりをトリガにしてＤタイプ・
フリツプフロツプ７のＱ出力（Ｈレベル）を記憶
保持し、Ｑ出力からＨレベルの信号をモータ駆動
信号形成回路２に出力する。モータ駆動信号形成
回路２はその立ち下がりの信号に基づいてステツ
プモータ１７′を駆動する。
更に、１分周期信号がＨレベルからＬレベルに
なると、Ｄタイプ・フリツプフロツプ１６のリセ
ツトが解除され、上記NANDゲート１９からの
クロツク信号がインバータ２７で反転され、その
反転されたクロツク信号の立ち下がりをトリガに
してＤタイプ・フリツプフロツプ１６のＱ出力が
ＨレベルになるとNANDゲート２０が開かれ、
インバータ２７からのクロツク信号がNANDゲ
ート２０を介して反転してＤタイプ・フリツプフ
ロツプ１１に入力され、Ｄタイプフリツプフロツ
プ１１はそのクロツク信号の立ち下がりをトリガ
にしてＤタイプ・フリツプフロツプ８のＱ出力
（Ｈレベル）を記憶保持し、Ｑ出力からＨレベル
の信号をモータ駆動信号形成回路３に出力する。
そして、モータ駆動信号形成回路３はその立ち上
がりの信号に基づいてステツプモータ１７″を駆
動する。
なると、Ｄタイプ・フリツプフロツプ１６のリセ
ツトが解除され、上記NANDゲート１９からの
クロツク信号がインバータ２７で反転され、その
反転されたクロツク信号の立ち下がりをトリガに
してＤタイプ・フリツプフロツプ１６のＱ出力が
ＨレベルになるとNANDゲート２０が開かれ、
インバータ２７からのクロツク信号がNANDゲ
ート２０を介して反転してＤタイプ・フリツプフ
ロツプ１１に入力され、Ｄタイプフリツプフロツ
プ１１はそのクロツク信号の立ち下がりをトリガ
にしてＤタイプ・フリツプフロツプ８のＱ出力
（Ｈレベル）を記憶保持し、Ｑ出力からＨレベル
の信号をモータ駆動信号形成回路３に出力する。
そして、モータ駆動信号形成回路３はその立ち上
がりの信号に基づいてステツプモータ１７″を駆
動する。
この様に、１秒周期信号、１分周期信号及び時
間周期信号が重なる場合、優先順序回路Ａにより
時系列にそれぞれのステツプモータを駆動するこ
とができ、初めのステツプモータの駆動時から最
後のステツプモータの駆動時まで位相差が図に示
すようにａになり、又、周期信号が出力されてか
ら最後のステツプモータが駆動する時間幅はｂに
なり遅延することがない。
間周期信号が重なる場合、優先順序回路Ａにより
時系列にそれぞれのステツプモータを駆動するこ
とができ、初めのステツプモータの駆動時から最
後のステツプモータの駆動時まで位相差が図に示
すようにａになり、又、周期信号が出力されてか
ら最後のステツプモータが駆動する時間幅はｂに
なり遅延することがない。
次に、１秒周期信号と１時間周期信号とが重な
る場合の動作を説明する。先ず、分周回路２から
１秒周期信号が出力されると共に、分カウンター
４から１時間周期信号が出力されると、Ｄタイ
プ・フリツプフロツプ６は１秒周期信号の立ち下
がりをトリガにしてＱ出力を立ち上げる（保持状
態のＤ入力がＨレベルの場合）と共に、Ｄタイ
プ・フリツプフロツプ８は１時間周期信号の立ち
下がりをトリガにしてＱ出力を立ち下げる（保持
状態のＤ入力がＬレベルの場合）、又、Ｄタイ
プ・フリツプフロツプ８は１分周期信号が秒カウ
ンター３から出力されていないのでＱ出力はＨレ
ベルのまま保持される。
る場合の動作を説明する。先ず、分周回路２から
１秒周期信号が出力されると共に、分カウンター
４から１時間周期信号が出力されると、Ｄタイ
プ・フリツプフロツプ６は１秒周期信号の立ち下
がりをトリガにしてＱ出力を立ち上げる（保持状
態のＤ入力がＨレベルの場合）と共に、Ｄタイ
プ・フリツプフロツプ８は１時間周期信号の立ち
下がりをトリガにしてＱ出力を立ち下げる（保持
状態のＤ入力がＬレベルの場合）、又、Ｄタイ
プ・フリツプフロツプ８は１分周期信号が秒カウ
ンター３から出力されていないのでＱ出力はＨレ
ベルのまま保持される。
一方、Ｄタイプ・フリツプフロツプ１５のリセ
ツト入力には１秒周期信号が入力されており、Ｄ
タイプ・フリツプフロツプ１５を一時的にリセツ
トしてそのＱ出力からはＬレベルの信号が出力さ
れる。そのため、NANDゲート１９の一方の入
力側がＬレベルになるためゲートが閉じられ、分
周回路２からのクロツク信号φがNANDゲート
１９を介して出力されず、NANDケート１９の
出力は一時的にＨレベルになる。そして、１秒周
期信号及び１時間周期信号がそれぞれＨレベルか
らＬレベルに立ち下がると、Ｄタイプ・フリツプ
フロツプ６，８はその立ち下がりの信号をトリガ
にしてそれぞれの時間を記憶保持し、それらのＱ
出力からはＨレベルの信号が出力される。する
と、初めに、Ｄタイプ・フリツプフロツプ９はイ
ンバータ２６で反転されたクロツク信号φの立ち
下がりをトリガにしてＤタイプ・フリツプフロツ
プ６のＱ出力（Ｈレベル）を入力して記憶保持
し、Ｑ出力からはＨレベルの信号がモータ駆動信
号形成回路１に出力され、モータ駆動信号形成回
路１はその立ち下がりの信号に基づいてステツプ
モータ１７を駆動する。
ツト入力には１秒周期信号が入力されており、Ｄ
タイプ・フリツプフロツプ１５を一時的にリセツ
トしてそのＱ出力からはＬレベルの信号が出力さ
れる。そのため、NANDゲート１９の一方の入
力側がＬレベルになるためゲートが閉じられ、分
周回路２からのクロツク信号φがNANDゲート
１９を介して出力されず、NANDケート１９の
出力は一時的にＨレベルになる。そして、１秒周
期信号及び１時間周期信号がそれぞれＨレベルか
らＬレベルに立ち下がると、Ｄタイプ・フリツプ
フロツプ６，８はその立ち下がりの信号をトリガ
にしてそれぞれの時間を記憶保持し、それらのＱ
出力からはＨレベルの信号が出力される。する
と、初めに、Ｄタイプ・フリツプフロツプ９はイ
ンバータ２６で反転されたクロツク信号φの立ち
下がりをトリガにしてＤタイプ・フリツプフロツ
プ６のＱ出力（Ｈレベル）を入力して記憶保持
し、Ｑ出力からはＨレベルの信号がモータ駆動信
号形成回路１に出力され、モータ駆動信号形成回
路１はその立ち下がりの信号に基づいてステツプ
モータ１７を駆動する。
又、１秒周期信号がＨレベルからＬレベルにな
ると、Ｄタイプ・フリツプフロツプ１５のリセツ
トが解除され、分周回路２からのクロツク信号φ
の立ち下がりをトリガにしてＤタイプ・フリツプ
フロツプ１５のＱ出力をＨレベルにすると
NANDゲート１９が開かれ、そのクロツク信号
φがNANDゲート１９及びインバータ２７を介
してＤタイプフリツプフロツプ１６に入力され、
Ｄタイプ・フリツプフロツプ１６はそのクロツク
信号の立ち下がりをトリガにしてＱ出力をＨレベ
ルにしてNANDゲート２０の一方の入力側に入
力してゲートを開ける。
ると、Ｄタイプ・フリツプフロツプ１５のリセツ
トが解除され、分周回路２からのクロツク信号φ
の立ち下がりをトリガにしてＤタイプ・フリツプ
フロツプ１５のＱ出力をＨレベルにすると
NANDゲート１９が開かれ、そのクロツク信号
φがNANDゲート１９及びインバータ２７を介
してＤタイプフリツプフロツプ１６に入力され、
Ｄタイプ・フリツプフロツプ１６はそのクロツク
信号の立ち下がりをトリガにしてＱ出力をＨレベ
ルにしてNANDゲート２０の一方の入力側に入
力してゲートを開ける。
すると、NANDゲート２０のインバータ２７
からのクロツク信号を反転し、その反転されたク
ロツク信号をＤタイプ・フリツプフロツプ１１に
入力する。Ｄタイプ・フリツプフロツプ１１はそ
のクロツク信号の立ち下がりをトリガにしてＤタ
イプ・フリツプフロツプ８からのＱ出力（Ｌレベ
ル）を記憶保持し、Ｑ出力からＬレベルの信号を
モータ駆動信号形成回路３に出力する。モータ駆
動信号形成回路３はその立ち下がりの信号に基づ
いてステツプモータ１７を駆動する。
からのクロツク信号を反転し、その反転されたク
ロツク信号をＤタイプ・フリツプフロツプ１１に
入力する。Ｄタイプ・フリツプフロツプ１１はそ
のクロツク信号の立ち下がりをトリガにしてＤタ
イプ・フリツプフロツプ８からのＱ出力（Ｌレベ
ル）を記憶保持し、Ｑ出力からＬレベルの信号を
モータ駆動信号形成回路３に出力する。モータ駆
動信号形成回路３はその立ち下がりの信号に基づ
いてステツプモータ１７を駆動する。
この様に、１秒周期信号及び１時間周期信号が
重なる場合、優先順序回路Ａにより時系列にそれ
ぞれのステツプモータを駆動することができ、初
めステツプモータの駆動時から最後のステツプモ
ータの駆動時までの位相差が図に示すようにa′に
なり、１秒周期信号、１分周期信号及び１時間周
期信号が重なる場合の位相差ａより短くなり、各
ステツプモータを順次に駆動することができる。
且つ、周期信号が出力されてから最後のステツプ
モータが駆動する時間幅が短くなり、図に示すよ
うにb′になり遅延することがない。
重なる場合、優先順序回路Ａにより時系列にそれ
ぞれのステツプモータを駆動することができ、初
めステツプモータの駆動時から最後のステツプモ
ータの駆動時までの位相差が図に示すようにa′に
なり、１秒周期信号、１分周期信号及び１時間周
期信号が重なる場合の位相差ａより短くなり、各
ステツプモータを順次に駆動することができる。
且つ、周期信号が出力されてから最後のステツプ
モータが駆動する時間幅が短くなり、図に示すよ
うにb′になり遅延することがない。
又、１秒周期信号が単独で出力される場合、優
先順序回路Ａにより１秒周期信号が出力されてス
テツプモータ１７の駆動する時間幅が更に短縮さ
れ、図に示すようにb″になり遅延することがな
い。
先順序回路Ａにより１秒周期信号が出力されてス
テツプモータ１７の駆動する時間幅が更に短縮さ
れ、図に示すようにb″になり遅延することがな
い。
更に、操作スイツチにより時刻を調整する場
合、例えば、単独に分カウンター４から１時間信
号を出力してモータ駆動信号形成回路３でステツ
プモータ１７″を動作させても、図に示すように
ステツプモータ１７″が駆動するまでの時間幅が
b″になり遅延することがない。
合、例えば、単独に分カウンター４から１時間信
号を出力してモータ駆動信号形成回路３でステツ
プモータ１７″を動作させても、図に示すように
ステツプモータ１７″が駆動するまでの時間幅が
b″になり遅延することがない。
以上、述べたように、本発明を採用すれば、複
数のモータを採用しても、同時にモータが駆動さ
れる事はなく、電池に対しては、従来の指針表示
時計と同じ、負荷として考える事ができる。しか
も優先順序回路があるために、複数のモータが同
時に駆動されない時には、遅延する事なくモータ
を直ぐに駆動する事ができ指示遅れがなくなる。
更に、スイツチ等を操作して、指針を動作させよ
うとする場合等は、スイツチを操作すると、直ぐ
にモータが駆動されるために、スイツチ操作の違
和感がなくなる。
数のモータを採用しても、同時にモータが駆動さ
れる事はなく、電池に対しては、従来の指針表示
時計と同じ、負荷として考える事ができる。しか
も優先順序回路があるために、複数のモータが同
時に駆動されない時には、遅延する事なくモータ
を直ぐに駆動する事ができ指示遅れがなくなる。
更に、スイツチ等を操作して、指針を動作させよ
うとする場合等は、スイツチを操作すると、直ぐ
にモータが駆動されるために、スイツチ操作の違
和感がなくなる。
特に本発明は、指針表示の多機能時計を考えた
場合には、非常に有効な方式を提供するものであ
る。
場合には、非常に有効な方式を提供するものであ
る。
第１図……本発明による指針表示時計の電子回
路図。第２図……第１図の動作を示すタイミング
チヤート。 １……発振回路、２……分周回路、３……秒カ
ウンタ、４……分カウンタ、５……時刻カウン
タ、６，７，８，９，１０，１１，１５，１６…
…Ｄタイプ・フリツプフロツプ、１２，１３，１
４……ラツチ回路、１７，１７′，１７″……ステ
ツプモータ、１９，２０，２１……NANDゲー
ト、２６，２７……インバータ。
路図。第２図……第１図の動作を示すタイミング
チヤート。 １……発振回路、２……分周回路、３……秒カ
ウンタ、４……分カウンタ、５……時刻カウン
タ、６，７，８，９，１０，１１，１５，１６…
…Ｄタイプ・フリツプフロツプ、１２，１３，１
４……ラツチ回路、１７，１７′，１７″……ステ
ツプモータ、１９，２０，２１……NANDゲー
ト、２６，２７……インバータ。
Claims (1)
- 【特許請求の範囲】 １ 秒針、分針及び時針に対応する各ステツプモ
ータの駆動によつて指針表示される指針表示時計
に於いて、 分周回路で分周された時間標準クロツクを計数
してそれぞれ動作クロツク信号、１秒周期信号、
１分周期信号及び１時間周期信号を出力する計数
手段と、 該計数手段から１秒周期信号を入力する度に所
定時間記憶保持し、その記憶保持された１秒周期
信号と前記分周回路からの動作クロツク信号とに
基づいてその１秒周期信号に対応したステツプモ
ータを制御する秒針制御部、定常的には前記分周
回路からの動作クロツク信号を出力し、前記１秒
周期信号が入力すると所定の期間においてその動
作クロツク信号の供給を停止する第１の動作クロ
ツク供給制御部、前記計数手段から１分周期信号
を入力する度に所定時間記憶保持し、その記憶保
持された１分周期信号と前記第１の動作クロツク
供給制御部からの動作クロツク信号とに基づいて
その１分周期信号に対応したステツプモータを制
御する分針制御部、定常的には前記第１の動作ク
ロツク供給制御部からの動作クロツク信号を出力
し、前記１分周期信号が入力すると所定の期間に
おいてその動作クロツク信号の供給を停止する第
２の動作クロツク供給制御部及び前記計数手段か
ら１時間周期信号を入力する度に所定時間記憶保
持し、その記憶保持された１時間周期信号と前記
第２の動作クロツク供給制御部からの動作クロツ
ク信号とに基づいてその１時間周期信号に対応し
たステツプモータを制御する時針制御部からなる
優先順序手段と を有することを特徴とする指針表示時計。 ２ 前記計数手段が操作スイツチからの時刻を修
正する信号に基づいて前記１秒周期信号、前記１
分周期信号及び前記１時間周期信号の代わりに疑
似的に１秒信号、１分信号及び時間信号を出力す
る特許請求の範囲第１項記載の指針表示時計。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8712082A JPS58202887A (ja) | 1982-05-21 | 1982-05-21 | 指針表示時計 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8712082A JPS58202887A (ja) | 1982-05-21 | 1982-05-21 | 指針表示時計 |
Related Child Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP30146491A Division JPH0740072B2 (ja) | 1991-11-18 | 1991-11-18 | 指針表示時計 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58202887A JPS58202887A (ja) | 1983-11-26 |
| JPH0447277B2 true JPH0447277B2 (ja) | 1992-08-03 |
Family
ID=13906091
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8712082A Granted JPS58202887A (ja) | 1982-05-21 | 1982-05-21 | 指針表示時計 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58202887A (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP5906727B2 (ja) * | 2011-12-27 | 2016-04-20 | カシオ計算機株式会社 | アナログ電子時計 |
| JP5845920B2 (ja) * | 2012-01-24 | 2016-01-20 | カシオ計算機株式会社 | アナログ電子時計 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5612578A (en) * | 1979-07-13 | 1981-02-06 | Rhythm Watch Co Ltd | Analog electronic clock |
| JPS5726776A (en) * | 1980-07-25 | 1982-02-12 | Citizen Watch Co Ltd | Analog timepiece having plural converters |
-
1982
- 1982-05-21 JP JP8712082A patent/JPS58202887A/ja active Granted
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5612578A (en) * | 1979-07-13 | 1981-02-06 | Rhythm Watch Co Ltd | Analog electronic clock |
| JPS5726776A (en) * | 1980-07-25 | 1982-02-12 | Citizen Watch Co Ltd | Analog timepiece having plural converters |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS58202887A (ja) | 1983-11-26 |
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