JPH0445483A - 液晶表示装置 - Google Patents
液晶表示装置Info
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- JPH0445483A JPH0445483A JP15257090A JP15257090A JPH0445483A JP H0445483 A JPH0445483 A JP H0445483A JP 15257090 A JP15257090 A JP 15257090A JP 15257090 A JP15257090 A JP 15257090A JP H0445483 A JPH0445483 A JP H0445483A
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- signal
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- 239000007788 liquid Substances 0.000 title 1
- 230000015654 memory Effects 0.000 abstract description 20
- 239000004973 liquid crystal related substance Substances 0.000 description 29
- 238000010586 diagram Methods 0.000 description 8
- 230000000694 effects Effects 0.000 description 2
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- Liquid Crystal (AREA)
- Liquid Crystal Display Device Control (AREA)
- Transforming Electric Information Into Light Information (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
本発明は、たとえば液晶テレビジョン受像機等に用いら
れる液晶を駆動する液晶駆動装置に関する。
れる液晶を駆動する液晶駆動装置に関する。
［従来の技術］
液晶を駆動する際、駆動のフレーム周波数を上げるとコ
ントラストが向上することが知られている。
ントラストが向上することが知られている。
第５図は、従来の液晶駆動において、表示のコントラス
トを良好にするために駆動のフレーム周波数を高めた液
晶駆動装置を示し、第６図は第５図の液晶駆動装置の動
作状態を示すタイミングチャートである。
トを良好にするために駆動のフレーム周波数を高めた液
晶駆動装置を示し、第６図は第５図の液晶駆動装置の動
作状態を示すタイミングチャートである。
ます、受信回路１では受信されたテレビ信号から映像信
号Ｓｖ、水平同期信号φＨ１垂直同期信号φＶが取り出
され、映像信号ＳｖはＡ／Ｄ変換器３へ、水平同期信号
φＨと垂直同期信号φＶは制御回路２へそれぞれ送られ
る。制御回路２は入力された水平同期信号φＨと垂直同
期信号φ■からスタート信号ＳＴ、クロック信号φｓ１
ラッチ信号φｎ、反転信号φＦ、切換え信号ＳＥＬ、ア
ドレス指定信号ＡＤＩ、ＡＤ２、読み出し書き込み信号
Ｒ／Ｗなど各種タイミング信号を発生し、シフトレジス
タ５１ ８． ９、駆動回路６，１０゜１１、切換え回
路４、メモリＡ、Ｂ等に出力する他、複数の種類の液晶
駆動電圧ＶＬＣを発生し駆動回路６，１０．１１に出力
する。
号Ｓｖ、水平同期信号φＨ１垂直同期信号φＶが取り出
され、映像信号ＳｖはＡ／Ｄ変換器３へ、水平同期信号
φＨと垂直同期信号φＶは制御回路２へそれぞれ送られ
る。制御回路２は入力された水平同期信号φＨと垂直同
期信号φ■からスタート信号ＳＴ、クロック信号φｓ１
ラッチ信号φｎ、反転信号φＦ、切換え信号ＳＥＬ、ア
ドレス指定信号ＡＤＩ、ＡＤ２、読み出し書き込み信号
Ｒ／Ｗなど各種タイミング信号を発生し、シフトレジス
タ５１ ８． ９、駆動回路６，１０゜１１、切換え回
路４、メモリＡ、Ｂ等に出力する他、複数の種類の液晶
駆動電圧ＶＬＣを発生し駆動回路６，１０．１１に出力
する。
一方、Ａ／Ｄ変換器３は入力された映像信号Ｓｖをにビ
ットのディジタル映像データＥに変換するとともに、メ
モリＡ、Ｈに出力し、メモリＡ、Ｂは、前記制御回路２
からのアドレス指定信号ＡＤＩ、ＡＤ２および読み出し
書き込み信号Ｒ／Ｗにより映像データＥの偶数フィール
ド（ｎ 、 ｎ ＋ ２ 、 ｎ ＋ ４ 、−− ）
をメモリＡが、奇数フィールド（ｎ＋１．ｎ＋３．・・
・・・・）をメモリＢが読み込む。
ットのディジタル映像データＥに変換するとともに、メ
モリＡ、Ｈに出力し、メモリＡ、Ｂは、前記制御回路２
からのアドレス指定信号ＡＤＩ、ＡＤ２および読み出し
書き込み信号Ｒ／Ｗにより映像データＥの偶数フィール
ド（ｎ 、 ｎ ＋ ２ 、 ｎ ＋ ４ 、−− ）
をメモリＡが、奇数フィールド（ｎ＋１．ｎ＋３．・・
・・・・）をメモリＢが読み込む。
つぎに、メモリＡに読み込まれたｎフィールドの映像デ
ータはｎ＋１フィールドで、書き込み時の速度の２倍、
すなわち通常の映像データの２倍の速さで２度にわたっ
て読み出されて、出力信号ＥＡとして切換え回路４に出
力され、同様に、メモリＢに読み込まれたｎ＋１フィー
ルドの映像データはｎ＋２フィールドで、書き込み時の
速度の２倍、すなわち通常の映像データの２倍の速さで
２度にわたって読み出されて、出力信号ＥＢとして切換
え回路４に出力される。切換え回路４に入力された出力
信号ＥＡ、ＥＢは、制御回路２からの切換え信号ＳＥＬ
で１フイ一ルド時間毎に切換えられ、データＤＡＢとな
りシフトレジスタ５に出力されて制御回路２のクロック
信号φＳに同期してシフトレジスタ５に蓄えられる。こ
のシフトレジスタ５に蓄えられたデータＤＡＢは、セグ
メント駆動回路６において制御回路２からのラッチ信号
φｎによって１／２Ｈ（水平走査期間）毎にラッチされ
るとともに、反転信号φＦによって交流駆動を行なうよ
うに極性反転する液晶駆動電圧ＶＬＣにレベルシフトさ
れ液晶表示パネル７のセグメント電極を駆動する。
ータはｎ＋１フィールドで、書き込み時の速度の２倍、
すなわち通常の映像データの２倍の速さで２度にわたっ
て読み出されて、出力信号ＥＡとして切換え回路４に出
力され、同様に、メモリＢに読み込まれたｎ＋１フィー
ルドの映像データはｎ＋２フィールドで、書き込み時の
速度の２倍、すなわち通常の映像データの２倍の速さで
２度にわたって読み出されて、出力信号ＥＢとして切換
え回路４に出力される。切換え回路４に入力された出力
信号ＥＡ、ＥＢは、制御回路２からの切換え信号ＳＥＬ
で１フイ一ルド時間毎に切換えられ、データＤＡＢとな
りシフトレジスタ５に出力されて制御回路２のクロック
信号φＳに同期してシフトレジスタ５に蓄えられる。こ
のシフトレジスタ５に蓄えられたデータＤＡＢは、セグ
メント駆動回路６において制御回路２からのラッチ信号
φｎによって１／２Ｈ（水平走査期間）毎にラッチされ
るとともに、反転信号φＦによって交流駆動を行なうよ
うに極性反転する液晶駆動電圧ＶＬＣにレベルシフトさ
れ液晶表示パネル７のセグメント電極を駆動する。
さらに、液晶表示パネル７のコモン側は、制御回路２か
らのＩＨ（水平走査期間）のスタート信号ＳＴがシフト
レジスタ８，９に入力されクロック信号φｎによって１
／２Ｈ（水平走査期間）毎に順次シフトレジスタ内をシ
フトされるのて、シフトレジスタ８，９からの各出力信
号Ｘ １〜Ｘ’１２０ Ｘ’１２１〜Ｘ’２４０はそ
れぞれ２本ずつコモン電極を駆動するように対応したコ
モン電極駆動回路１０．１１に加えられる。このコモン
電極駆動回路１屹 １１は各出力信号Ｘ′１〜Ｘ１２０
、 Ｘ’ １２１〜Ｘ’２４０に対応して、反転信号
φＦによって交流駆動を行なうように極性反転する液晶
駆動電圧ＶＬＣにレベルシフトされ液晶表示パネル７の
コモン電極に印加されコモン電極は２本ずつ駆動される
。
らのＩＨ（水平走査期間）のスタート信号ＳＴがシフト
レジスタ８，９に入力されクロック信号φｎによって１
／２Ｈ（水平走査期間）毎に順次シフトレジスタ内をシ
フトされるのて、シフトレジスタ８，９からの各出力信
号Ｘ １〜Ｘ’１２０ Ｘ’１２１〜Ｘ’２４０はそ
れぞれ２本ずつコモン電極を駆動するように対応したコ
モン電極駆動回路１０．１１に加えられる。このコモン
電極駆動回路１屹 １１は各出力信号Ｘ′１〜Ｘ１２０
、 Ｘ’ １２１〜Ｘ’２４０に対応して、反転信号
φＦによって交流駆動を行なうように極性反転する液晶
駆動電圧ＶＬＣにレベルシフトされ液晶表示パネル７の
コモン電極に印加されコモン電極は２本ずつ駆動される
。
［発明が解決しようとする課題］
以上によって、液晶表示パネルのコモン電極の１回の選
択時間は１／２、選択周波数は２倍となりコントラスト
は向上する。しかしながら、この従来の液晶駆動装置で
は、シフトレジスタの転送速度を２倍にしなければなら
ない上、メモリ容量は２フイ一ルド分か必要となり、い
ずれもコストの上昇を招く要因となっていた。
択時間は１／２、選択周波数は２倍となりコントラスト
は向上する。しかしながら、この従来の液晶駆動装置で
は、シフトレジスタの転送速度を２倍にしなければなら
ない上、メモリ容量は２フイ一ルド分か必要となり、い
ずれもコストの上昇を招く要因となっていた。
そこで、本発明は、上記の事情に鑑みてなされたもので
、使用するメモリをできるたけ少なくし得、且つセグメ
ント電極駆動手段へのデータ転送速度を速くすることな
く液晶駆動のフレーム周波数を高くし得、しかも正しい
階調表示をし得る液晶駆動装置を提供することを目的と
する。
、使用するメモリをできるたけ少なくし得、且つセグメ
ント電極駆動手段へのデータ転送速度を速くすることな
く液晶駆動のフレーム周波数を高くし得、しかも正しい
階調表示をし得る液晶駆動装置を提供することを目的と
する。
［課題を解決するための手段および作用コ一連の映像デ
ータの少なくとも最上位ビットの映像データが記憶され
る記憶手段と、この記憶手段から１水平走査期間おきに
出力された少なくとも最上位ビットの映像データと前記
記憶手段を介さない映像データのビットを所定の順序に
並びかえた映像データとを１水平走査期間毎に交互に出
力する切換え手段と、この切換え手段からのデータに応
してセグメント電極を駆動するセグメント電極駆動手段
と、前記切換え手段から出力される映像データに対応し
たコモン電極を複数本づつ駆動するコモン電極駆動手段
とを具備するもので、１／２フイールド×１ビツト数の
容量のメモリに記憶された映像データの最上位ビットの
映像データと、メモリを介さない生の映像データのビッ
トを正しい階調表示ができるように並びかえた映像デー
タとを１水平走査期間毎に交互に出力するようにして、
セグメント電極を駆動するとともに、その映像データに
対応したコモン電極を２本づつ駆動するものである。
ータの少なくとも最上位ビットの映像データが記憶され
る記憶手段と、この記憶手段から１水平走査期間おきに
出力された少なくとも最上位ビットの映像データと前記
記憶手段を介さない映像データのビットを所定の順序に
並びかえた映像データとを１水平走査期間毎に交互に出
力する切換え手段と、この切換え手段からのデータに応
してセグメント電極を駆動するセグメント電極駆動手段
と、前記切換え手段から出力される映像データに対応し
たコモン電極を複数本づつ駆動するコモン電極駆動手段
とを具備するもので、１／２フイールド×１ビツト数の
容量のメモリに記憶された映像データの最上位ビットの
映像データと、メモリを介さない生の映像データのビッ
トを正しい階調表示ができるように並びかえた映像デー
タとを１水平走査期間毎に交互に出力するようにして、
セグメント電極を駆動するとともに、その映像データに
対応したコモン電極を２本づつ駆動するものである。
［実施例コ
以下図面を参照して本発明の実施例を詳細に説明する。
第１図は、本発明の実施例の液晶駆動装置を示し、第２
図は第１図の液晶駆動装置の動作状態とデータ内容を示
すタイミングチャートである。
図は第１図の液晶駆動装置の動作状態とデータ内容を示
すタイミングチャートである。
まず、受信回路１では受信されたテレビ信号から映像信
号Ｓｖ、水平同期信号φＨ１垂直同期信号φＶが取り出
され、映像信号ＳｖはＡ／Ｄ変換器３へ、水平同期信号
φＨと垂直同期信号φＶは制御回路１２へそれぞれ送ら
れる。制御回路１２は入力された水平同期信号φＨと垂
直同期信号φＶからスタート信号ＳＴ、クロック信号φ
Ｓ、ラッチ信号φ０１反転信号φＦ、出力禁止信号ＩＮ
ＨＩ、２、切換え信号ＳＥＬ、アドレス指定信号ＡＤ、
読み出し書き込み信号Ｒ／Ｗなど各種タイミング信号を
発生し、シフトレジスタ１５゜１８．１９、駆動回路１
６，２０．２１、切換え回路１４、メモリＭ、出力制御
回路２２．２３等に出力する他、複数の種類の液晶駆動
電圧ＶＬＣを発生し駆動回路１６，２０．２１に出力す
る。
号Ｓｖ、水平同期信号φＨ１垂直同期信号φＶが取り出
され、映像信号ＳｖはＡ／Ｄ変換器３へ、水平同期信号
φＨと垂直同期信号φＶは制御回路１２へそれぞれ送ら
れる。制御回路１２は入力された水平同期信号φＨと垂
直同期信号φＶからスタート信号ＳＴ、クロック信号φ
Ｓ、ラッチ信号φ０１反転信号φＦ、出力禁止信号ＩＮ
ＨＩ、２、切換え信号ＳＥＬ、アドレス指定信号ＡＤ、
読み出し書き込み信号Ｒ／Ｗなど各種タイミング信号を
発生し、シフトレジスタ１５゜１８．１９、駆動回路１
６，２０．２１、切換え回路１４、メモリＭ、出力制御
回路２２．２３等に出力する他、複数の種類の液晶駆動
電圧ＶＬＣを発生し駆動回路１６，２０．２１に出力す
る。
一方、Ａ／Ｄ変換器３は入力された映像信号Ｓｖをにビ
ット例えば第４図に示すよ・５な３ビツト（上位よりＤ
３ 、Ｄ２ 、Ｄ、）の映像データＥ、に変換するとと
もに、メモリＭに出力し、メモリＭは、制御回路１２か
らのアドレス指定信号ＡＤおよび読み出し書き込み信号
Ｒ／Ｗに従って映像データＥ。の最上位ビットＤ３のデ
ータＥｏ −ＭＳＢを読み込む。
ット例えば第４図に示すよ・５な３ビツト（上位よりＤ
３ 、Ｄ２ 、Ｄ、）の映像データＥ、に変換するとと
もに、メモリＭに出力し、メモリＭは、制御回路１２か
らのアドレス指定信号ＡＤおよび読み出し書き込み信号
Ｒ／Ｗに従って映像データＥ。の最上位ビットＤ３のデ
ータＥｏ −ＭＳＢを読み込む。
つぎに、メモリＭに読み込まれた１／２フイ一ルド分の
データは１／２フイールド後に、制御回路１２からのア
ドレス指定信号ＡＤおよび読み出し書き込み信号Ｒ／Ｗ
に従って、ＩＨ（水平走査期間）おきに読み出されて、
第４図に示すような最上位ビットよりなる３ビツト（上
位よりＤ３゜Ｄ３．Ｄ３）の映像データＥＢとして切換
え回路１４に出力される。
データは１／２フイールド後に、制御回路１２からのア
ドレス指定信号ＡＤおよび読み出し書き込み信号Ｒ／Ｗ
に従って、ＩＨ（水平走査期間）おきに読み出されて、
第４図に示すような最上位ビットよりなる３ビツト（上
位よりＤ３゜Ｄ３．Ｄ３）の映像データＥＢとして切換
え回路１４に出力される。
また、Ａ／Ｄ変換器３で変換された３ビツト（上位より
Ｄ３ 、Ｄ２ 、Ｄ＋ ）の映像データＥ。
Ｄ３ 、Ｄ２ 、Ｄ＋ ）の映像データＥ。
はビットを正しい階調表示ができるように並びかえた第
４図に示すような３ビツト（上位よりＤ２ＤＩ、Ｄ３）
の映像データＥＡとして切換え回路１４に出力される。
４図に示すような３ビツト（上位よりＤ２ＤＩ、Ｄ３）
の映像データＥＡとして切換え回路１４に出力される。
切換え回路１４に入力されたＡ／Ｄ変換器３からの映像
データＥＡとメモリＭからの映像データＥＢは、この切
換え回路１４て制御回路１２からの切換え信号ＳＥＬに
従ってＩＨ（水平走査期間）毎に交互に出力されデータ
ＤＡＢとなって、シフトレジスタ１５に入力される。そ
してこのデータＤＡＢは制御回路１２のクロック信号φ
Ｓに同期してシフトレジスタ１５に蓄えられる。このシ
フトレジスタ１５に蓄えられたデータＤＡＢは、セグメ
ント駆動回路１６において制御回路１２からのラッチ信
号φｎによってＩＨ（水平走査期間）毎にラッチされる
とともに、反転信号φＦによって交流駆動を行なうよう
に極性反転する液晶駆動電圧ＶＬＣにレベルシフトされ
液晶表示パネル７のセグメント電極が駆動される。
データＥＡとメモリＭからの映像データＥＢは、この切
換え回路１４て制御回路１２からの切換え信号ＳＥＬに
従ってＩＨ（水平走査期間）毎に交互に出力されデータ
ＤＡＢとなって、シフトレジスタ１５に入力される。そ
してこのデータＤＡＢは制御回路１２のクロック信号φ
Ｓに同期してシフトレジスタ１５に蓄えられる。このシ
フトレジスタ１５に蓄えられたデータＤＡＢは、セグメ
ント駆動回路１６において制御回路１２からのラッチ信
号φｎによってＩＨ（水平走査期間）毎にラッチされる
とともに、反転信号φＦによって交流駆動を行なうよう
に極性反転する液晶駆動電圧ＶＬＣにレベルシフトされ
液晶表示パネル７のセグメント電極が駆動される。
さらに、液晶表示パネル７のコモン側は、制御回路１２
からの２Ｈ（水平走査期間）のスタート信号ＳＴかシフ
トレジスタ１８．１９に入力されクロック信号φｎによ
ってＩＨ（水平走査期間）毎に順次シフトレジスタ内を
シフトされる。そのためシフトレジスタ１８．１９から
の各出力信号は、コモン電極駆動回路２０．２１がコモ
ン電極をそれぞれ２本づつ駆動するように、常時、出力
制御回路２２．２３に出力されるが出力制御回路２２．
２３は、水平同期信号φＨに同期してＩＨ（水平走査期
間）毎に反転する出力禁止信号ＩＮＨＩ、２に従ってＩ
Ｈ（水平走査期間）毎に交互に、シフトレジスタ１８．
１９からの出力信号Ｘ’ ｌ〜Ｘ’ １２０ 、 Ｘ’
１２１〜Ｘ’２４０をそれぞれ対応したコモン電極駆
動回路２０．２１に加える。このコモン電極駆動回路２
０．２１は各出力信号Ｘ’ １〜Ｘ’ １２０ 、 Ｘ
’ １２１〜Ｘ’ ２４０ ニ対応して、反転信号φＦ
によって交流駆動を行なうように極性反転する液晶駆動
電圧ＹＬＣにレベルシフトされ液晶表示パネル７のコモ
ン電極に印加され、コモン電極を２本づつ駆動する。
からの２Ｈ（水平走査期間）のスタート信号ＳＴかシフ
トレジスタ１８．１９に入力されクロック信号φｎによ
ってＩＨ（水平走査期間）毎に順次シフトレジスタ内を
シフトされる。そのためシフトレジスタ１８．１９から
の各出力信号は、コモン電極駆動回路２０．２１がコモ
ン電極をそれぞれ２本づつ駆動するように、常時、出力
制御回路２２．２３に出力されるが出力制御回路２２．
２３は、水平同期信号φＨに同期してＩＨ（水平走査期
間）毎に反転する出力禁止信号ＩＮＨＩ、２に従ってＩ
Ｈ（水平走査期間）毎に交互に、シフトレジスタ１８．
１９からの出力信号Ｘ’ ｌ〜Ｘ’ １２０ 、 Ｘ’
１２１〜Ｘ’２４０をそれぞれ対応したコモン電極駆
動回路２０．２１に加える。このコモン電極駆動回路２
０．２１は各出力信号Ｘ’ １〜Ｘ’ １２０ 、 Ｘ
’ １２１〜Ｘ’ ２４０ ニ対応して、反転信号φＦ
によって交流駆動を行なうように極性反転する液晶駆動
電圧ＹＬＣにレベルシフトされ液晶表示パネル７のコモ
ン電極に印加され、コモン電極を２本づつ駆動する。
即ち、液晶表示パネル７に、Ｍ４図に示すようなデータ
ＥＡ （上位よりＤ２ 、Ｄｌ、Ｄｌ ）とデータＥ
Ｂ （上位よりり、、Ｄ、、Ｄ、）が交互に表示される
ことにより、表示階調（ＥＡ＋ＥＢ）／２は正しい階調
表示となる。
ＥＡ （上位よりＤ２ 、Ｄｌ、Ｄｌ ）とデータＥ
Ｂ （上位よりり、、Ｄ、、Ｄ、）が交互に表示される
ことにより、表示階調（ＥＡ＋ＥＢ）／２は正しい階調
表示となる。
第３図は前記切換回路１４の一例を示し、アンド回路３
１〜３６．オア回路３７〜３９．及びインバータ４０よ
り構成される。即ち、第４図に示すようなデータＥＡ
（上位よりＤ２．ＤＩ、Ｄｌ）はアンド回路３１〜３３
の一方の入力端にそれぞれ対応して加えられ、データＥ
Ｂ （最上位ビットＤＢ）はアンド回路３４〜３６の
一方の入力端に加えられる。このアンド回路３４〜３６
の他方の入力端には切換信号ＳＥＬが加えられ、前記ア
ンド回路３１〜３３の他方の入力端には切換信号ＳＥＬ
がインバータ４０を介して加えられる。
１〜３６．オア回路３７〜３９．及びインバータ４０よ
り構成される。即ち、第４図に示すようなデータＥＡ
（上位よりＤ２．ＤＩ、Ｄｌ）はアンド回路３１〜３３
の一方の入力端にそれぞれ対応して加えられ、データＥ
Ｂ （最上位ビットＤＢ）はアンド回路３４〜３６の
一方の入力端に加えられる。このアンド回路３４〜３６
の他方の入力端には切換信号ＳＥＬが加えられ、前記ア
ンド回路３１〜３３の他方の入力端には切換信号ＳＥＬ
がインバータ４０を介して加えられる。
前記アンド回路３１．３４の出力はオア回路３７の入力
端に、前記アンド回路３２．３５の出力はオア回路３８
の入力端に、前記アンド回路３３゜３６の出力はオア回
路３９の入力端にそれぞれ加えられる。この結果、オア
回路３７〜３９の出力端には上位よりＤｓ （ＭＳ
Ｂ） 、 Ｄ２ 、 Ｉ）＋（Ｌ Ｓ Ｂ）のデータ
ＤＡＢが出力されシフトレジスタ１５に加えられる。
端に、前記アンド回路３２．３５の出力はオア回路３８
の入力端に、前記アンド回路３３゜３６の出力はオア回
路３９の入力端にそれぞれ加えられる。この結果、オア
回路３７〜３９の出力端には上位よりＤｓ （ＭＳ
Ｂ） 、 Ｄ２ 、 Ｉ）＋（Ｌ Ｓ Ｂ）のデータ
ＤＡＢが出力されシフトレジスタ１５に加えられる。
［発明の効果コ
以上述べたように、本発明によれば、１／４フイールド
×１ビツト数の容量のメモリに１水平走査期間おきに記
憶された最上位ビットの映像データと、メモリを介さな
い生の映像データのビットを並びかえた映像データとを
１水平走査期間毎に交互に出力するようにして、セグメ
ント電極を駆動するとともに、その映像データに対応し
たコモン電極を２本ずつ駆動するものであるので、従来
に比べて少ない容量のメモリを用いて、且つ、セグメン
ト電極駆動回路のデータ転送速度を速くせずに駆動周波
数を２倍にし、しかも正しい階調表示ができる液晶表示
装置を提供できる。
×１ビツト数の容量のメモリに１水平走査期間おきに記
憶された最上位ビットの映像データと、メモリを介さな
い生の映像データのビットを並びかえた映像データとを
１水平走査期間毎に交互に出力するようにして、セグメ
ント電極を駆動するとともに、その映像データに対応し
たコモン電極を２本ずつ駆動するものであるので、従来
に比べて少ない容量のメモリを用いて、且つ、セグメン
ト電極駆動回路のデータ転送速度を速くせずに駆動周波
数を２倍にし、しかも正しい階調表示ができる液晶表示
装置を提供できる。
第１図〜第４図は本発明の一実施例を示すもので、第１
図は液晶駆動装置の回路構成を示すブロック図、第２図
は第１図の各部の波形及びデータの内容を示す説明図、
第３図は第１図の切換え回路の一例を示す回路構成図、
第４図は第１図の各データの内容を示す説明図、第５図
は従来の液晶駆動装置の一例を示す構成説明図、第６図
は第５図の各部の波形及びデータの内容を示す説明図で
ある。 Ｍ・・・メモリ、１・・・受信回路、３・・・Ａ／Ｄ変
換器、７・・・液晶表示パネル、１２・・・制御回路、
１４・・・切換え回路、１５，１８．１９・・・シフト
レジスタ、１６・・・セグメント駆動回路、２０．２１
・・・コモン電極駆動回路、２２．２３・・・出力制御
回路。 出願人代理人 弁理士 鈴江武彦 第 図 ＤＡＢ 第 図 ＋１丈、＜％テ゛−９ ｈ：？、ｎ＊舅 ０＋０ Ｏ 第４ 図 第 図
図は液晶駆動装置の回路構成を示すブロック図、第２図
は第１図の各部の波形及びデータの内容を示す説明図、
第３図は第１図の切換え回路の一例を示す回路構成図、
第４図は第１図の各データの内容を示す説明図、第５図
は従来の液晶駆動装置の一例を示す構成説明図、第６図
は第５図の各部の波形及びデータの内容を示す説明図で
ある。 Ｍ・・・メモリ、１・・・受信回路、３・・・Ａ／Ｄ変
換器、７・・・液晶表示パネル、１２・・・制御回路、
１４・・・切換え回路、１５，１８．１９・・・シフト
レジスタ、１６・・・セグメント駆動回路、２０．２１
・・・コモン電極駆動回路、２２．２３・・・出力制御
回路。 出願人代理人 弁理士 鈴江武彦 第 図 ＤＡＢ 第 図 ＋１丈、＜％テ゛−９ ｈ：？、ｎ＊舅 ０＋０ Ｏ 第４ 図 第 図
Claims (1)
- 【特許請求の範囲】 一連の映像データの少なくとも最上位ビットの映像デー
タが記憶される記憶手段と、 この記憶手段から１水平走査期間おきに出力された少な
くとも最上位ビットの映像データと前記記憶手段を介さ
ない映像データのビットを所定の順序に並びかえた映像
データとを１水平走査期間毎に交互に出力する切換え手
段と、 この切換え手段からのデータに応じてセグメント電極を
駆動するセグメント電極駆動手段と、前記切換え手段か
ら出力される映像データに対応したコモン電極を複数本
づつ駆動するコモン電極駆動手段と を具備することを特徴とする液晶表示装置。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15257090A JPH0445483A (ja) | 1990-06-13 | 1990-06-13 | 液晶表示装置 |
| US07/702,777 US5376944A (en) | 1990-05-25 | 1991-05-17 | Liquid crystal display device with scanning electrode selection means |
| EP91108441A EP0458349B1 (en) | 1990-05-25 | 1991-05-24 | Liquid crystal display device |
| DE69121138T DE69121138T2 (de) | 1990-05-25 | 1991-05-24 | Flüssigkristallanzeigeeinrichtung |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15257090A JPH0445483A (ja) | 1990-06-13 | 1990-06-13 | 液晶表示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0445483A true JPH0445483A (ja) | 1992-02-14 |
Family
ID=15543368
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15257090A Pending JPH0445483A (ja) | 1990-05-25 | 1990-06-13 | 液晶表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0445483A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2003067317A1 (en) * | 2002-02-08 | 2003-08-14 | Samsung Electronics Co., Ltd. | Liquid crystal display and driving method thereof and frame memory |
| KR100446378B1 (ko) * | 2000-12-30 | 2004-09-01 | 비오이 하이디스 테크놀로지 주식회사 | 액정표시소자 및 그 구동방법 |
-
1990
- 1990-06-13 JP JP15257090A patent/JPH0445483A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100446378B1 (ko) * | 2000-12-30 | 2004-09-01 | 비오이 하이디스 테크놀로지 주식회사 | 액정표시소자 및 그 구동방법 |
| WO2003067317A1 (en) * | 2002-02-08 | 2003-08-14 | Samsung Electronics Co., Ltd. | Liquid crystal display and driving method thereof and frame memory |
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