JPH04346286A - 半導体装置 - Google Patents

半導体装置

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JPH04346286A
JPH04346286A JP3147805A JP14780591A JPH04346286A JP H04346286 A JPH04346286 A JP H04346286A JP 3147805 A JP3147805 A JP 3147805A JP 14780591 A JP14780591 A JP 14780591A JP H04346286 A JPH04346286 A JP H04346286A
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JP
Japan
Prior art keywords
semiconductor chip
semiconductor device
wire bonding
pads
circuit board
Prior art date
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Pending
Application number
JP3147805A
Other languages
English (en)
Inventor
Masashi Yanoda
政司 八野田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP3147805A priority Critical patent/JPH04346286A/ja
Publication of JPH04346286A publication Critical patent/JPH04346286A/ja
Pending legal-status Critical Current

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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/26Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
    • H01L2224/31Structure, shape, material or disposition of the layer connectors after the connecting process
    • H01L2224/32Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
    • H01L2224/321Disposition
    • H01L2224/32135Disposition the layer connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip
    • H01L2224/32145Disposition the layer connector connecting between different semiconductor or solid-state bodies, i.e. chip-to-chip the bodies being stacked
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48225Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
    • H01L2224/48227Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/30Assembling printed circuits with electric components, e.g. with resistor
    • H05K3/32Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits
    • H05K3/328Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits by welding
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/36Assembling printed circuits with other printed circuits
    • H05K3/368Assembling printed circuits with other printed circuits parallel to each other

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  • Structures For Mounting Electric Components On Printed Circuit Boards (AREA)
  • Wire Bonding (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】
【0001】
【技術分野】本発明は半導体装置の構造に関するもので
ある。
【0002】
【従来技術】従来の半導体装置は、半導体チップを樹脂
で封入し、この樹脂封入部分からリード端子を導出して
印刷配線板上の配線パッドに半田付けを行うようになっ
ている。
【0003】かかる従来の半導体装置では、入出力ピン
数が大幅に増加した場合、リード端子の間隔が極めて狭
くなり、実装精度やリード端子強度等の問題があり、実
装上問題がある。また、半導体チップを直接印刷配線板
上に実装する場合、印刷配線板の反り等の要因により半
導体チップの割れ等の問題がある。
【0004】
【発明の目的】本発明の目的は、多ピンの半導体チップ
の実装精度やリード端子強度の問題をなくすことが可能
な半導体装置を提供することである。
【0005】
【発明の構成】本発明による半導体装置は、半導体チッ
プと、前記半導体チップを一主面上に搭載したキャリア
基板と、前記キャリア基板の一主面上に設けられた配線
パッドと、前記配線パッドと前記半導体チップの入出力
部とを接続するワイヤボンディング配線部材と、前記半
導体チップ,前記ワイヤボンディング配線部材及びその
接続部を封入する樹脂部材とを含み、前記配線パッドの
一部が露出されていることを特徴とする。
【0006】
【実施例】以下に図面を参照して本発明の実施例を詳細
に説明する。
【0007】図1は本発明の実施例の断面図であり、図
2は本発明の実施例の平面図であり、図2のA−A線に
沿う断面図が図1である。
【0008】キャリア基板2の一主面上には半導体チッ
プ1が取付けられ固定されている。このキャリア基板2
の一主面上の周辺部には半導体チップ1の入出力部に夫
々対応した配線パッド7が予め設けられている。この配
線パット7と対応する半導体チップ1の入出力部とが互
いにワイヤボンディング部材(ワイヤ)4により接続さ
れている。
【0009】半導体チップ1,ワイヤ4,このワイヤ4
によるワイヤボンディング部が樹脂3によりモールドさ
れて覆われている。但し、パッド7の一部は露出されて
いる。この配線パッド7の露出部分において、印刷配線
板5上のパッド8と接続ワイヤ6により接続される。
【0010】
【発明の効果】以上述べた如く、本発明によれば、半導
体チップを搭載したキャリア基板に配線パッドを設けて
おき、そのパットとチップの入出力部とをワイヤボンデ
ィング接続して、配線パッドの一部を除いて全体を樹脂
によりモールドし、配線パッドの露出部分で印刷配線板
の所定部分と接続するようにしたので、半田付けの精度
やリード端子の変形、更には半導体チップの割れ等の問
題がなくなり、半導体装置を直接印刷線板に取付けるこ
とができるという効果がある。
【図面の簡単な説明】
【図1】本発明の実施例の断面図である。
【図2】本発明の実施例の平面図である。
【符号の説明】
1  半導体チップ 2  キャリア基板 3  樹脂 4  ボンディングワイヤ 5  印刷配線板 6  接続ワイヤ 7  配線パッド

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】  半導体チップと、前記半導体チップを
    一主面上に搭載したキャリア基板と、前記キャリア基板
    の一主面上に設けられた配線パッドと、前記配線パッド
    と前記半導体チップの入出力部とを接続するワイヤボン
    ディング配線部材と、前記半導体チップ,前記ワイヤボ
    ンディング配線部材及びその接続部を封入する樹脂部材
    とを含み、前記配線パッドの一部が露出されていること
    を特徴とする半導体装置。
JP3147805A 1991-05-23 1991-05-23 半導体装置 Pending JPH04346286A (ja)

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JP3147805A JPH04346286A (ja) 1991-05-23 1991-05-23 半導体装置

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JP3147805A JPH04346286A (ja) 1991-05-23 1991-05-23 半導体装置

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