JPH0433525Y2 - - Google Patents
Info
- Publication number
- JPH0433525Y2 JPH0433525Y2 JP16173883U JP16173883U JPH0433525Y2 JP H0433525 Y2 JPH0433525 Y2 JP H0433525Y2 JP 16173883 U JP16173883 U JP 16173883U JP 16173883 U JP16173883 U JP 16173883U JP H0433525 Y2 JPH0433525 Y2 JP H0433525Y2
- Authority
- JP
- Japan
- Prior art keywords
- current
- magnetic head
- circuit
- transistor
- write
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 238000004804 winding Methods 0.000 claims description 5
- 239000003990 capacitor Substances 0.000 description 4
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Digital Magnetic Recording (AREA)
Description
【考案の詳細な説明】
本考案は磁気カードリーダ等で使用されるデー
タ書込回路に関する。
タ書込回路に関する。
従来のデータ書込回路では高抗磁力媒体にデー
タ書込を行うには磁気ヘツドに大電流を流すか、
又は磁気ヘツドの巻数を大きく上げるかしなけれ
ばならなかつた。しかし磁気ヘツドに大電流を流
すと、回路全体の消費電力が多くなりすぎ、且つ
磁気ヘツドやその駆動部のパワートランジスタ、
抵抗等が過熱して危険であり故障しやすい。また
磁気ヘツドの巻数を大きく上げると、そのインピ
ーダンスが上がり書込波形の立上りがなまつてし
まつて（特に高速書込時）正常なデータ書込がで
きない。
タ書込を行うには磁気ヘツドに大電流を流すか、
又は磁気ヘツドの巻数を大きく上げるかしなけれ
ばならなかつた。しかし磁気ヘツドに大電流を流
すと、回路全体の消費電力が多くなりすぎ、且つ
磁気ヘツドやその駆動部のパワートランジスタ、
抵抗等が過熱して危険であり故障しやすい。また
磁気ヘツドの巻数を大きく上げると、そのインピ
ーダンスが上がり書込波形の立上りがなまつてし
まつて（特に高速書込時）正常なデータ書込がで
きない。
本考案は上記欠点を解消するために磁気ヘツド
の巻線に生ずる逆起電力を利用して電力効率を上
げるようにしたデータ書込回路を提供することを
目的とする。
の巻線に生ずる逆起電力を利用して電力効率を上
げるようにしたデータ書込回路を提供することを
目的とする。
以下図面を参照しながら本考案について例をあ
げて説明する。
げて説明する。
第１図は本考案の一例を示す。図中１１は磁気
カード等の媒体にデータを書込むための磁気ヘツ
ド、１２はデータ書込信号Ａに基づき磁気ヘツド
１１に書込電流を流す電流回路であつてトランジ
スタTR１〜TR３及び抵抗Ｒ１〜Ｒ３により構
成される。１３は上記書込電流を所定レベルで検
出して電流回路１２のオン，オフを行なうことに
よつて書込電流を所定レベル以下に制限する電流
制御回路であり、演算増幅器IC１、コンデンサ
Ｃ１、トランジスタTR４及び抵抗Ｒ４〜Ｒ１１
により構成される。Ｄ１はデータ書込信号Ａが入
力されていて（高レベルであつて）電流回路１２
がオフの時磁気ヘツド１１の巻線に生ずる逆起電
力によつて磁気ヘツド１１に電流を流す回路を構
成するフライホイールダイオードである。
カード等の媒体にデータを書込むための磁気ヘツ
ド、１２はデータ書込信号Ａに基づき磁気ヘツド
１１に書込電流を流す電流回路であつてトランジ
スタTR１〜TR３及び抵抗Ｒ１〜Ｒ３により構
成される。１３は上記書込電流を所定レベルで検
出して電流回路１２のオン，オフを行なうことに
よつて書込電流を所定レベル以下に制限する電流
制御回路であり、演算増幅器IC１、コンデンサ
Ｃ１、トランジスタTR４及び抵抗Ｒ４〜Ｒ１１
により構成される。Ｄ１はデータ書込信号Ａが入
力されていて（高レベルであつて）電流回路１２
がオフの時磁気ヘツド１１の巻線に生ずる逆起電
力によつて磁気ヘツド１１に電流を流す回路を構
成するフライホイールダイオードである。
次にこのデータ書込回路の動作を説明する。デ
ータ書込信号Ａが入力されて（高レベルになつ
て）トランジスタTR２がオンすると、トランジ
スタTR１，TR３がオンして磁気ヘツド１１に
電流が流れる。この電流は抵抗Ｒ５により検出さ
れ、この抵抗Ｒ５の両端に一定値以上の電位差が
生ずると、増幅器IC１の出力が高レベルから低
レベルに反転してトランジスタTR４がオンす
る。よつてトランジスタTR１がオフし、磁気ヘ
ツド１１に対する電流制限がかかる。この電流制
限で抵抗Ｒ５の両端電位差が上記一定値より小さ
くなると、増幅器IC１の出力が高レベルに復帰
してトランジスタTR４がオフし、トランジスタ
TR１がオンして電流制限がはずれる。この動作
がくり返されることにより磁気ヘツド１１には一
定の電流が流れる。また電流制限がかかつてトラ
ンジスタTR１がオフした時には磁気ヘツド１１
の巻線に生ずる逆起電力によつてフライホイール
ダイオードＤ１、磁気ヘツド１１、トランジスタ
TR３を介して電流が流れ、磁気ヘツド１１の電
流の落ち込みを防いでいる。即ち第３図において
磁気ヘツド１１の電流Ｂは平均化して示したもの
であり、実際にはＣに示すようにトランジスタ
TR１オンで電源より電流が供給される期間Ｔ１
と、トランジスタTR１オフで磁気ヘツド１１の
逆起電力により電流が流れる期間Ｔ２とが交互に
くり返され、電流制限レベルILを中心として定
められたヒステリシス幅の範囲で変動する。フラ
イホイールダイオードＤ１が無い場合には磁気ヘ
ツド１１の巻線に生ずる逆起電力による電流が流
れないので、磁気ヘツド１１の電流は第４図に示
すように電流制限で急激に減少し、直ちに電流制
限がはずれて電源から電流が供給され、電源から
の電流がオフになつている時間がほとんど無い。
このため磁気ヘツド１１に同じ書込電流（平均
値）を流すのに必要な電源を供給電力はこの第１
図の例の方がダイオードＤ１が無いものに比べて
少なくてすむ。データ書込信号Ａが低レベルの時
にはトランジスタTR２がオフになつてトランジ
スタTR１，TR３がオフになり、磁気ヘツド１
１には電流が流れない。
ータ書込信号Ａが入力されて（高レベルになつ
て）トランジスタTR２がオンすると、トランジ
スタTR１，TR３がオンして磁気ヘツド１１に
電流が流れる。この電流は抵抗Ｒ５により検出さ
れ、この抵抗Ｒ５の両端に一定値以上の電位差が
生ずると、増幅器IC１の出力が高レベルから低
レベルに反転してトランジスタTR４がオンす
る。よつてトランジスタTR１がオフし、磁気ヘ
ツド１１に対する電流制限がかかる。この電流制
限で抵抗Ｒ５の両端電位差が上記一定値より小さ
くなると、増幅器IC１の出力が高レベルに復帰
してトランジスタTR４がオフし、トランジスタ
TR１がオンして電流制限がはずれる。この動作
がくり返されることにより磁気ヘツド１１には一
定の電流が流れる。また電流制限がかかつてトラ
ンジスタTR１がオフした時には磁気ヘツド１１
の巻線に生ずる逆起電力によつてフライホイール
ダイオードＤ１、磁気ヘツド１１、トランジスタ
TR３を介して電流が流れ、磁気ヘツド１１の電
流の落ち込みを防いでいる。即ち第３図において
磁気ヘツド１１の電流Ｂは平均化して示したもの
であり、実際にはＣに示すようにトランジスタ
TR１オンで電源より電流が供給される期間Ｔ１
と、トランジスタTR１オフで磁気ヘツド１１の
逆起電力により電流が流れる期間Ｔ２とが交互に
くり返され、電流制限レベルILを中心として定
められたヒステリシス幅の範囲で変動する。フラ
イホイールダイオードＤ１が無い場合には磁気ヘ
ツド１１の巻線に生ずる逆起電力による電流が流
れないので、磁気ヘツド１１の電流は第４図に示
すように電流制限で急激に減少し、直ちに電流制
限がはずれて電源から電流が供給され、電源から
の電流がオフになつている時間がほとんど無い。
このため磁気ヘツド１１に同じ書込電流（平均
値）を流すのに必要な電源を供給電力はこの第１
図の例の方がダイオードＤ１が無いものに比べて
少なくてすむ。データ書込信号Ａが低レベルの時
にはトランジスタTR２がオフになつてトランジ
スタTR１，TR３がオフになり、磁気ヘツド１
１には電流が流れない。
第２図は本考案の一実施例を示す。第１図の例
では磁気ヘツド１１に第３図Ｂのような一方向の
電流しか流れないが、この実施例は第１図の例を
２つ組み合わせて磁気ヘツドに第５図に示すよう
な双方向の電流を流すようにしたものである。す
なわち、１２１，１３１，Ｄ１１は一組の電流回
路、電流制御回路及びフライホイールダイオード
であり、データ書込信号Ａが高レベルになつた時
に磁気ヘツド１１に第１図の例と同様に電流を流
す。１２２，１３２，Ｄ１２は他の一組の電流回
路、電流制御回路及びフライホイールダイオード
であり、データ書込信号Ａがインバータで反転さ
れた信号が高レベルになつた時に磁気ヘツド１
１に逆方向の電流を同様に流す。電流回路１２１
は第１図のものと同様にトランジスタTR１１〜
TR３１及び抵抗Ｒ１１〜Ｒ３１により構成さ
れ、電流回路１２２もトランジスタTR１２〜
TR３２及び抵抗Ｒ１２〜Ｒ３２により構成され
ている。電流制御回路１３１は演算増幅器IC１
１、コンデンサＣ１１，Ｃ２１、トランジスタ
TR４１及び抵抗Ｒ４１〜Ｒ１１１により構成さ
れていて第１図のものよりコンデンサＣ２１が多
く、電流制御回路１３２も演算増幅器IC１２、
コンデンサＣ１２，Ｃ２２、トランジスタTR４
２及び抵抗Ｒ４２〜Ｒ１１２により構成されてい
る。
では磁気ヘツド１１に第３図Ｂのような一方向の
電流しか流れないが、この実施例は第１図の例を
２つ組み合わせて磁気ヘツドに第５図に示すよう
な双方向の電流を流すようにしたものである。す
なわち、１２１，１３１，Ｄ１１は一組の電流回
路、電流制御回路及びフライホイールダイオード
であり、データ書込信号Ａが高レベルになつた時
に磁気ヘツド１１に第１図の例と同様に電流を流
す。１２２，１３２，Ｄ１２は他の一組の電流回
路、電流制御回路及びフライホイールダイオード
であり、データ書込信号Ａがインバータで反転さ
れた信号が高レベルになつた時に磁気ヘツド１
１に逆方向の電流を同様に流す。電流回路１２１
は第１図のものと同様にトランジスタTR１１〜
TR３１及び抵抗Ｒ１１〜Ｒ３１により構成さ
れ、電流回路１２２もトランジスタTR１２〜
TR３２及び抵抗Ｒ１２〜Ｒ３２により構成され
ている。電流制御回路１３１は演算増幅器IC１
１、コンデンサＣ１１，Ｃ２１、トランジスタ
TR４１及び抵抗Ｒ４１〜Ｒ１１１により構成さ
れていて第１図のものよりコンデンサＣ２１が多
く、電流制御回路１３２も演算増幅器IC１２、
コンデンサＣ１２，Ｃ２２、トランジスタTR４
２及び抵抗Ｒ４２〜Ｒ１１２により構成されてい
る。
以上のように本考案によれば磁気ヘツドに電源
より流す電流を電流制御回路で制御するため無駄
な電力がいらない。また上記電流がオフになつて
も磁気ヘツドの巻線に生ずる逆起電力により磁気
ヘツドに電流が流れるようにしたので、電力効率
が良くなる。したがつて高抗磁力媒体へのデータ
書込を行う場合磁気ヘツドに大電流を流す必要が
なく、磁気ヘツドの巻数を大きく上げる必要もな
くなる。
より流す電流を電流制御回路で制御するため無駄
な電力がいらない。また上記電流がオフになつて
も磁気ヘツドの巻線に生ずる逆起電力により磁気
ヘツドに電流が流れるようにしたので、電力効率
が良くなる。したがつて高抗磁力媒体へのデータ
書込を行う場合磁気ヘツドに大電流を流す必要が
なく、磁気ヘツドの巻数を大きく上げる必要もな
くなる。
第１図は本考案の一例を示す回路図、第２図は
本考案の一実施例を示す回路図、第３図〜第５図
は本考案を説明するための波形図である。 １１……磁気ヘツド、１２，１２１，１２２…
…電流回路、１３，１３１，１３２……電流制御
回路、Ｄ１，Ｄ１１，Ｄ１２……ダイオード。
本考案の一実施例を示す回路図、第３図〜第５図
は本考案を説明するための波形図である。 １１……磁気ヘツド、１２，１２１，１２２…
…電流回路、１３，１３１，１３２……電流制御
回路、Ｄ１，Ｄ１１，Ｄ１２……ダイオード。
Claims (1)
- データ書込信号に基づき磁気ヘツドに書込電流
を流す電流回路と、上記書込電流を所定レベルで
検出して上記電流回路のオン，オフを行なう電流
制御回路とを有し、上記電流回路がオフのとき上
記磁気ヘツドの巻線に生ずる逆起電力によつて上
記磁気ヘツドに電流を流す回路をダイオードを用
いて構成したことを特徴とするデータ書込回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16173883U JPS6070910U (ja) | 1983-10-19 | 1983-10-19 | デ−タ書込回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16173883U JPS6070910U (ja) | 1983-10-19 | 1983-10-19 | デ−タ書込回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6070910U JPS6070910U (ja) | 1985-05-20 |
| JPH0433525Y2 true JPH0433525Y2 (ja) | 1992-08-11 |
Family
ID=30355361
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16173883U Granted JPS6070910U (ja) | 1983-10-19 | 1983-10-19 | デ−タ書込回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6070910U (ja) |
-
1983
- 1983-10-19 JP JP16173883U patent/JPS6070910U/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6070910U (ja) | 1985-05-20 |
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