JPH04303250A - 局所メモリ拡張能力を有するコンピュータ・システム - Google Patents
局所メモリ拡張能力を有するコンピュータ・システムInfo
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- JPH04303250A JPH04303250A JP3344108A JP34410891A JPH04303250A JP H04303250 A JPH04303250 A JP H04303250A JP 3344108 A JP3344108 A JP 3344108A JP 34410891 A JP34410891 A JP 34410891A JP H04303250 A JPH04303250 A JP H04303250A
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Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/38—Information transfer, e.g. on bus
- G06F13/40—Bus structure
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F12/00—Accessing, addressing or allocating within memory systems or architectures
- G06F12/02—Addressing or allocation; Relocation
- G06F12/06—Addressing a physical block of locations, e.g. base addressing, module addressing, memory dedication
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
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- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- Microcomputers (AREA)
- Multi Processors (AREA)
- Techniques For Improving Reliability Of Storages (AREA)
- Memory System (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明はパーソナルコンピュータ
、特にマイクロプロセッサ局所バスで使用可能なメモリ
容量を容易に変更できる機能を有するパーソナルコンピ
ュータに関する。
、特にマイクロプロセッサ局所バスで使用可能なメモリ
容量を容易に変更できる機能を有するパーソナルコンピ
ュータに関する。
【０００２】
【従来の技術】一般にパーソナルコンピュータ・システ
ム及び特にＩＢＭ社のパーソナルコンピュータは広範に
使用され現代社会の多くの分野にコンピュータ能力を提
供している。通常、パーソナルコンピュータ・システム
は、主システム・プロセッサ及び関連した揮発性メモリ
及び不揮発性メモリを有するシステム装置、表示モニタ
、キーボード、１以上のディスケット駆動機構、固定デ
ィスク記憶装置及びオプションの印刷装置から成るデス
ク・トップ、床上設置又はポータブルのマイクロコンピ
ュータと定義することができる。これらのシステムの顕
著な特性の１つはこれらの構成装置を電気的に互いに接
続するマザーボード即ちシステム・プレーナを使用する
ことである。これらのシステムは主に単一のユーザに独
立した計算能力を与えるように設計され且つ個人又は小
規模の事業が購入できるよう価格が安く設定される。 前記パーソナルコンピュータ・システムの例はＩＢＭ社
のパーソナルコンピュータ ＡＴ及びＩＢＭ社のパーソ
ナルシステム／２ モデル２５、３０、５０、６０、７
０、８０、９０及び９５である。
ム及び特にＩＢＭ社のパーソナルコンピュータは広範に
使用され現代社会の多くの分野にコンピュータ能力を提
供している。通常、パーソナルコンピュータ・システム
は、主システム・プロセッサ及び関連した揮発性メモリ
及び不揮発性メモリを有するシステム装置、表示モニタ
、キーボード、１以上のディスケット駆動機構、固定デ
ィスク記憶装置及びオプションの印刷装置から成るデス
ク・トップ、床上設置又はポータブルのマイクロコンピ
ュータと定義することができる。これらのシステムの顕
著な特性の１つはこれらの構成装置を電気的に互いに接
続するマザーボード即ちシステム・プレーナを使用する
ことである。これらのシステムは主に単一のユーザに独
立した計算能力を与えるように設計され且つ個人又は小
規模の事業が購入できるよう価格が安く設定される。 前記パーソナルコンピュータ・システムの例はＩＢＭ社
のパーソナルコンピュータ ＡＴ及びＩＢＭ社のパーソ
ナルシステム／２ モデル２５、３０、５０、６０、７
０、８０、９０及び９５である。
【０００３】これらのシステムは大別して２つのファミ
リーに分類することができる。一般にファミリー Ｉ
モデルと呼ばれる第１のファミリーは、ＩＢＭ社のパー
ソナルコンピュータ ＡＴ 及び他の ”ＩＢＭ互換”
マシーンで例示されるバス構成を用いる。ファミリー
ＩＩ モデルと呼ばれる第２のファミリーは、ＩＢＭ
社のパーソナルシステム／２ モデル ５０ 乃至 ９
５で例示されるＩＢＭ社のマイクロチャネル・バス構成
を用いる。一般に、ファミリー Ｉ モデルは主プロセ
ッサとして人気のあるインテル社の８０８６、８０６６
又は８０２８６マイクロプロセッサを使用している。こ
れらのプロセッサは１メガバイトのメモリをアドレス指
定する能力を有する。一般に、ファミリー ＩＩ モデ
ルはインテル社の高速な８０２８６、８０３８６及び８
０４８６マイクロプロセッサを使用する。これらは速度
の遅いインテル社の８０８６マイクロプロセッサをエミ
ュレートするように実時間モードで動作するか又はモデ
ルによっては１メガバイトから４ギガバイトまでアドレ
ス指定範囲を拡張する保護モードで動作することができ
る。要するに、８０２８６、８０３８６及び８０４８６
プロセッサの実時間モード特性は８０８６及び８０８８
マイクロプロセッサ用に記述されたソフトウェアとのハ
ードウェア互換性を与える。
リーに分類することができる。一般にファミリー Ｉ
モデルと呼ばれる第１のファミリーは、ＩＢＭ社のパー
ソナルコンピュータ ＡＴ 及び他の ”ＩＢＭ互換”
マシーンで例示されるバス構成を用いる。ファミリー
ＩＩ モデルと呼ばれる第２のファミリーは、ＩＢＭ
社のパーソナルシステム／２ モデル ５０ 乃至 ９
５で例示されるＩＢＭ社のマイクロチャネル・バス構成
を用いる。一般に、ファミリー Ｉ モデルは主プロセ
ッサとして人気のあるインテル社の８０８６、８０６６
又は８０２８６マイクロプロセッサを使用している。こ
れらのプロセッサは１メガバイトのメモリをアドレス指
定する能力を有する。一般に、ファミリー ＩＩ モデ
ルはインテル社の高速な８０２８６、８０３８６及び８
０４８６マイクロプロセッサを使用する。これらは速度
の遅いインテル社の８０８６マイクロプロセッサをエミ
ュレートするように実時間モードで動作するか又はモデ
ルによっては１メガバイトから４ギガバイトまでアドレ
ス指定範囲を拡張する保護モードで動作することができ
る。要するに、８０２８６、８０３８６及び８０４８６
プロセッサの実時間モード特性は８０８６及び８０８８
マイクロプロセッサ用に記述されたソフトウェアとのハ
ードウェア互換性を与える。
【０００４】その後、パーソナルコンピュータで用いる
インテル社のマイクロプロセッサに組込まれた技術は、
更に進んだコンピュータ環境、例えば緊密結合又は柔軟
結合された並列即ち複数の処理アレイでの利用が提案さ
れた。より高速のマイクロプロセッサ技術が前記アレイ
に使用されると、本明細書に示すようなパーソナルコン
ピュータ技術でこれまでに生じた問題が前記環境で生じ
ることが予想される。
インテル社のマイクロプロセッサに組込まれた技術は、
更に進んだコンピュータ環境、例えば緊密結合又は柔軟
結合された並列即ち複数の処理アレイでの利用が提案さ
れた。より高速のマイクロプロセッサ技術が前記アレイ
に使用されると、本明細書に示すようなパーソナルコン
ピュータ技術でこれまでに生じた問題が前記環境で生じ
ることが予想される。
【０００５】より高速のマイクロプロセッサの、より大
きいメモリ・アドレス指定能力を部分的に用いるように
設計された、より新しいオペレーティング・システムの
出現により、メモリをより高い範囲に拡張する機能の提
供が必要になった。前記拡張は、メモリ容量変更能力を
有するメモリ・モジュールから構成されるシングル・イ
ンライン・メモリ・モジュール、即ちＳＩＭＭとして知
られた装置を用いて達成されている。前記拡張は（部分
的に後で詳細に説明する方式を用いて）達成されている
が、より高速のマイクロプロセッサの使用はメモリ・ア
クセスで交換される信号の質及び移行時間をより決定的
なものにする。 ”移行時間” は物理メモリと主プロ
セッサの間で交換されるデータ、アドレス又は他の制御
信号のような信号を交換するのに必要な時間を意味する
。
きいメモリ・アドレス指定能力を部分的に用いるように
設計された、より新しいオペレーティング・システムの
出現により、メモリをより高い範囲に拡張する機能の提
供が必要になった。前記拡張は、メモリ容量変更能力を
有するメモリ・モジュールから構成されるシングル・イ
ンライン・メモリ・モジュール、即ちＳＩＭＭとして知
られた装置を用いて達成されている。前記拡張は（部分
的に後で詳細に説明する方式を用いて）達成されている
が、より高速のマイクロプロセッサの使用はメモリ・ア
クセスで交換される信号の質及び移行時間をより決定的
なものにする。 ”移行時間” は物理メモリと主プロ
セッサの間で交換されるデータ、アドレス又は他の制御
信号のような信号を交換するのに必要な時間を意味する
。
【０００６】メモリの拡張は、それ自体は既存のパーソ
ナルコンピュータを技術の進歩に適応させるのに望まし
いかもしれないが、前記要求に適応させるためにＳＩＭ
Ｍを使用するときに問題が起きる。特に、１、２、４又
は８メガバイトのように容量を変えるとともに種々のメ
モリ・モジュールの組合せを用いるＳＩＭＭを局所メモ
リ・バスに挿入することがあるが、前記ＳＩＭＭの物理
的な保持に必要なソケットの数及びそれらの間の変動は
インピーダンスの不整合をもたらす。前記インピーダン
スの不整合を解決する方法は可能であるが、バッファリ
ングの増加（メモリ・アクセス又は移行時間を低速にす
る）又はより進歩した半導体技術（費用を増加させる）
を必要とする。
ナルコンピュータを技術の進歩に適応させるのに望まし
いかもしれないが、前記要求に適応させるためにＳＩＭ
Ｍを使用するときに問題が起きる。特に、１、２、４又
は８メガバイトのように容量を変えるとともに種々のメ
モリ・モジュールの組合せを用いるＳＩＭＭを局所メモ
リ・バスに挿入することがあるが、前記ＳＩＭＭの物理
的な保持に必要なソケットの数及びそれらの間の変動は
インピーダンスの不整合をもたらす。前記インピーダン
スの不整合を解決する方法は可能であるが、バッファリ
ングの増加（メモリ・アクセス又は移行時間を低速にす
る）又はより進歩した半導体技術（費用を増加させる）
を必要とする。
【０００７】計算環境によってはＳＩＭＭの代りにＳＩ
ＰＰ（シングル・インライン・ピン・パッケージ）メモ
リ・モジュールが用いられる。ＳＩＭＭとＳＩＰＰの相
違は使用されるコネクタの形式（ＳＩＭＭはカード・エ
ッジ・コネクタをもちいるが、ＳＩＰＰはヘッダー・ピ
ンを用いる）から生じる。前記２つの形式はコンピュー
タ・システム環境への取付けに関しては互換性がないが
、ＳＩＭＭによるメモリ拡張を用いるシステム及びＳＩ
ＰＰを用いるシステムに類似のタイプの問題が生じる。
ＰＰ（シングル・インライン・ピン・パッケージ）メモ
リ・モジュールが用いられる。ＳＩＭＭとＳＩＰＰの相
違は使用されるコネクタの形式（ＳＩＭＭはカード・エ
ッジ・コネクタをもちいるが、ＳＩＰＰはヘッダー・ピ
ンを用いる）から生じる。前記２つの形式はコンピュー
タ・システム環境への取付けに関しては互換性がないが
、ＳＩＭＭによるメモリ拡張を用いるシステム及びＳＩ
ＰＰを用いるシステムに類似のタイプの問題が生じる。
【０００８】代替のアプローチは、例えば前述の進んだ
パーソナルコンピュータでマイクロチャネル・バスとし
て知られているようなオプション・カード又はボードを
取付けるために設けられたバス構成の部分によりアクセ
スされるメモリ拡張カード又はボードの使用である。こ
のようなアプローチは実行可能であるが、オプション・
カードの取付けによる追加のメモリ容量の取付けは少な
い資源（前記バス上のスロット）を使い果たして前記追
加メモリのアクセスを遅くする。更に、前記追加は高価
なデータ・ドライバを必要とする。これは、電磁適合エ
ミッションを増す可能性があるので予防措置の実施に通
じ、従って信号のアンダーシュート及びオーバーシュー
ト並びにタイミング・スキュー（ゆがみ）の問題を生じ
る。
パーソナルコンピュータでマイクロチャネル・バスとし
て知られているようなオプション・カード又はボードを
取付けるために設けられたバス構成の部分によりアクセ
スされるメモリ拡張カード又はボードの使用である。こ
のようなアプローチは実行可能であるが、オプション・
カードの取付けによる追加のメモリ容量の取付けは少な
い資源（前記バス上のスロット）を使い果たして前記追
加メモリのアクセスを遅くする。更に、前記追加は高価
なデータ・ドライバを必要とする。これは、電磁適合エ
ミッションを増す可能性があるので予防措置の実施に通
じ、従って信号のアンダーシュート及びオーバーシュー
ト並びにタイミング・スキュー（ゆがみ）の問題を生じ
る。
【０００９】
【発明が解決しようとする課題】この発明の第一の目的
は前述の通常のタイプのコンピュータでマイクロプロセ
ッサの局所バスに使用可能なメモリの容量を容易に変更
できる能力を提供することにある。
は前述の通常のタイプのコンピュータでマイクロプロセ
ッサの局所バスに使用可能なメモリの容量を容易に変更
できる能力を提供することにある。
【００１０】この発明の第二の目的は、メモリ・モジュ
ールと交換される信号の望ましい品質及び移行時間を保
持すると同時にメモリ容量の拡張を可能にすることにあ
る。
ールと交換される信号の望ましい品質及び移行時間を保
持すると同時にメモリ容量の拡張を可能にすることにあ
る。
【００１１】この発明の第三の目的は、メモリの拡張又
は（たぶん）縮小を可能にするように物理的な取付け又
は取外しが容易にできる拡張カードを提供することにあ
る。
は（たぶん）縮小を可能にするように物理的な取付け又
は取外しが容易にできる拡張カードを提供することにあ
る。
【００１２】
【課題を解決するための手段】第一の課題を解決するた
めに本発明では、主マイクロプロセッサによりアクセス
される（所望の又は必要な）１以上の局所メモリ拡張カ
ードが取付けられる。
めに本発明では、主マイクロプロセッサによりアクセス
される（所望の又は必要な）１以上の局所メモリ拡張カ
ードが取付けられる。
【００１３】第二の課題を解決するために本発明におい
て、メモリ・モジュールは、システム・バス、プレーナ
入出力（Ｉ／Ｏ）バス、又はアダプタ・カード（例えば
マイクロチャネル）バスとは異なるマイクロプロセッサ
局所バスに結合される。更に、メモリ・モジュールの結
合は、追加メモリ・モジュールを物理的に挿入するか除
去するかに関係なく、前記バスに対する共有インタフェ
ースを示す制御装置を用いて行われる。
て、メモリ・モジュールは、システム・バス、プレーナ
入出力（Ｉ／Ｏ）バス、又はアダプタ・カード（例えば
マイクロチャネル）バスとは異なるマイクロプロセッサ
局所バスに結合される。更に、メモリ・モジュールの結
合は、追加メモリ・モジュールを物理的に挿入するか除
去するかに関係なく、前記バスに対する共有インタフェ
ースを示す制御装置を用いて行われる。
【００１４】本発明により第三の課題を解決することに
より、本発明に従って構築されたパーソナルコンピュー
タのユーザは、最初の要求にふさわしい最小のメモリ容
量しか持たないコンピュータで先ず開始し、後に容易に
拡張する、即ち変化する要求を満たすようにメモリ容量
を調整することができる。更に、前記調整はコンピュー
タの使用場所でダウンタイム、即ち当該コンピュータを
サービスから除外する時間を最小にして容易に達成する
ことができる。
より、本発明に従って構築されたパーソナルコンピュー
タのユーザは、最初の要求にふさわしい最小のメモリ容
量しか持たないコンピュータで先ず開始し、後に容易に
拡張する、即ち変化する要求を満たすようにメモリ容量
を調整することができる。更に、前記調整はコンピュー
タの使用場所でダウンタイム、即ち当該コンピュータを
サービスから除外する時間を最小にして容易に達成する
ことができる。
【００１５】
【実施例】本発明の良好な実施例を示す添付図面に関連
して、本発明は以下に詳細に記述されるが、以下の説明
の初めに、ここに記述された発明を、本発明の良好な結
果を達成しつつ、当業者が変更できることが理解される
べきである。従って、本明細書の以下の記述は本発明に
限定されずに幅広く当業者に開示されるものであること
が理解されるべきである。本発明は特にパーソナルコン
ピュータに関連して以下に記述されるが、メインフレー
ム及び中型即ちミニコンピュータを含む既知の広範囲の
サイズ及びタイプにわたるコンピュータに適用できるこ
とが、特にコンピュータ設計・使用分野の当業者に認識
されるであろう。
して、本発明は以下に詳細に記述されるが、以下の説明
の初めに、ここに記述された発明を、本発明の良好な結
果を達成しつつ、当業者が変更できることが理解される
べきである。従って、本明細書の以下の記述は本発明に
限定されずに幅広く当業者に開示されるものであること
が理解されるべきである。本発明は特にパーソナルコン
ピュータに関連して以下に記述されるが、メインフレー
ム及び中型即ちミニコンピュータを含む既知の広範囲の
サイズ及びタイプにわたるコンピュータに適用できるこ
とが、特にコンピュータ設計・使用分野の当業者に認識
されるであろう。
【００１６】本発明を実施するマイクロコンピュータ１
０が図１に示されている。前述のように、マイクロコン
ピュータ１０は関連したモニタ１１、キーボード１２及
び印刷装置又はプロッタ１４を備えているであろう。マ
イクロコンピュータ１０は、図２に示すようにディジタ
ル・データを処理し記憶するために電源を供給されたデ
ータ処理及び記憶コンポーネントを支持するために囲わ
れシールドされる容積をシャーシ１９と共同して決める
内側のシールド部材１８及び装飾された外側の部材１６
で形成されたカバー１５を有する。これらのコンポーネ
ントのうちの少なくとも幾つかは多重層プレーナ２０即
ちマザーボードに取付けられる。マザーボードはシャー
シ１９に取付けられ且つ前述の識別されたものを含むマ
イクロコンピュータ１０のコンポーネントとフロッピー
・ディスク装置、種々の形式の直接アクセス記憶装置、
アクセサリ・カード又はボード等のような他の関連した
エレメントとを電気的に相互接続する手段を提供する。
０が図１に示されている。前述のように、マイクロコン
ピュータ１０は関連したモニタ１１、キーボード１２及
び印刷装置又はプロッタ１４を備えているであろう。マ
イクロコンピュータ１０は、図２に示すようにディジタ
ル・データを処理し記憶するために電源を供給されたデ
ータ処理及び記憶コンポーネントを支持するために囲わ
れシールドされる容積をシャーシ１９と共同して決める
内側のシールド部材１８及び装飾された外側の部材１６
で形成されたカバー１５を有する。これらのコンポーネ
ントのうちの少なくとも幾つかは多重層プレーナ２０即
ちマザーボードに取付けられる。マザーボードはシャー
シ１９に取付けられ且つ前述の識別されたものを含むマ
イクロコンピュータ１０のコンポーネントとフロッピー
・ディスク装置、種々の形式の直接アクセス記憶装置、
アクセサリ・カード又はボード等のような他の関連した
エレメントとを電気的に相互接続する手段を提供する。
【００１７】シャーシ１９は２２に示すベース、２４に
示す前部パネル及び２５に示す後部パネルを有する（図
２）。前部パネル２４は、磁気又は光学ディスクのため
のディスク装置、補助テープ装置等のようなデータ記憶
装置を支持するための少なくとも１つの開放ベイ（及び
図示の形式の４つのベイ）を定める。図示の形式では、
一対の上部ベイ２６、２８及び一対の下部ベイ２９、３
０が設けられている。一方の上部ベイ２６は（３．５イ
ンチ（８．８９ｃｍ）型の駆動機構のような） 最初の
サイズの周辺装置を支持するのに適合するが、他方の上
部ベイ２８は（３．５インチ型及び５．２５インチ（１
３．３３５ｃｍ）型のような） ２つのサイズのうちの
選択された１つの駆動機構を支持するのに適合する。そ
して下部ベイはただ１つのサイズ（３．５インチ型）
の装置を支持するのに適合する。
示す前部パネル及び２５に示す後部パネルを有する（図
２）。前部パネル２４は、磁気又は光学ディスクのため
のディスク装置、補助テープ装置等のようなデータ記憶
装置を支持するための少なくとも１つの開放ベイ（及び
図示の形式の４つのベイ）を定める。図示の形式では、
一対の上部ベイ２６、２８及び一対の下部ベイ２９、３
０が設けられている。一方の上部ベイ２６は（３．５イ
ンチ（８．８９ｃｍ）型の駆動機構のような） 最初の
サイズの周辺装置を支持するのに適合するが、他方の上
部ベイ２８は（３．５インチ型及び５．２５インチ（１
３．３３５ｃｍ）型のような） ２つのサイズのうちの
選択された１つの駆動機構を支持するのに適合する。そ
して下部ベイはただ１つのサイズ（３．５インチ型）
の装置を支持するのに適合する。
【００１８】前記構造を本発明に関連づける前に、本発
明以前に構成された一般的なパーソナルコンピュータ・
システムの通常の動作の概要は再検討に値するであろう
。図３に示されているパーソナルコンピュータ・システ
ムのブロック図はこのようなコンピュータ・システムの
種々のコンポーネント（前記プレーナに取付けられたコ
ンポーネント及び前記プレーナとＩ／Ｏスロット及び前
記パーソナルコンピュータ・システムの他のハードウェ
アとの接続を含む）を示す。前記プレーナに接続される
のは、高速ＣＰＵ局所バス３４によりバス制御タイミン
グ装置３５を介してメモリ制御装置３６に接続され更に
揮発性ランダム・アクセス・メモリ（ＲＡＭモジュール
３８）に接続されるマイクロプロセッサ３２から成る主
プロセッサである。マイクロプロセッサは適切なものな
らどれも使用できるが、１つの適切なマイクロプロセッ
サはインテル社から市販されている８０３８６である。
明以前に構成された一般的なパーソナルコンピュータ・
システムの通常の動作の概要は再検討に値するであろう
。図３に示されているパーソナルコンピュータ・システ
ムのブロック図はこのようなコンピュータ・システムの
種々のコンポーネント（前記プレーナに取付けられたコ
ンポーネント及び前記プレーナとＩ／Ｏスロット及び前
記パーソナルコンピュータ・システムの他のハードウェ
アとの接続を含む）を示す。前記プレーナに接続される
のは、高速ＣＰＵ局所バス３４によりバス制御タイミン
グ装置３５を介してメモリ制御装置３６に接続され更に
揮発性ランダム・アクセス・メモリ（ＲＡＭモジュール
３８）に接続されるマイクロプロセッサ３２から成る主
プロセッサである。マイクロプロセッサは適切なものな
らどれも使用できるが、１つの適切なマイクロプロセッ
サはインテル社から市販されている８０３８６である。
【００１９】本発明は後に図４のシステム・ブロック図
において詳細に記述されるが、以下の図３の説明の初め
に理解されるべきことは、本発明による装置及び方法は
他のハードウェア構成のプレーナ・ボードとともに使用
できるように企図されていることである。例えば、シス
テム・プロセッサはインテル社の８０２８６又は８０４
８６マイクロプロセッサかもしれない。更に、システム
は、ある適切なアレイに配列された複数のプロセッサを
用いるシステムであるかもしれない。
において詳細に記述されるが、以下の図３の説明の初め
に理解されるべきことは、本発明による装置及び方法は
他のハードウェア構成のプレーナ・ボードとともに使用
できるように企図されていることである。例えば、シス
テム・プロセッサはインテル社の８０２８６又は８０４
８６マイクロプロセッサかもしれない。更に、システム
は、ある適切なアレイに配列された複数のプロセッサを
用いるシステムであるかもしれない。
【００２０】図３で、（データ、アドレス及び制御コン
ポーネントを含む）ＣＰＵ局所バス３４はマイクロプロ
セッサ３２、数学コプロセッサ３９、キャッシュ制御装
置４０及びキャッシュ・メモリ４１の接続を可能にする
。ＣＰＵ局所バス３４にはバッファ４２も結合される。 バッファ４２自体は（ＣＰＵ局所バス３４よりも）低速
のシステム・バス４４（アドレス、データ及び制御コン
ポーネントを含む）に接続される。システム・バス４４
もアドレス、データ及び制御コンポーネントを含む。シ
ステム・バス４４はバッファ４２とバッファ６８の間に
も接続される。システム・バス４４は更にバス制御タイ
ミング装置３５及びＤＭＡ装置４８に接続される。ＤＭ
Ａ装置４８は中央アービトレーション装置４９及びＤＭ
Ａ制御装置５０から成る。バッファ５１はシステム・バ
ス４４とマイクロチャネル・バス５２のようなオプショ
ンのバスとの間にインタフェースを設ける。マイクロチ
ャネル・アダプタ・カードを支持する複数のＩ／Ｏスロ
ット５４がバス５２に接続される。前記マイクロチャネ
ル・アダプタ・カードは更にＩ／Ｏ装置又はメモリに接
続することができる。
ポーネントを含む）ＣＰＵ局所バス３４はマイクロプロ
セッサ３２、数学コプロセッサ３９、キャッシュ制御装
置４０及びキャッシュ・メモリ４１の接続を可能にする
。ＣＰＵ局所バス３４にはバッファ４２も結合される。 バッファ４２自体は（ＣＰＵ局所バス３４よりも）低速
のシステム・バス４４（アドレス、データ及び制御コン
ポーネントを含む）に接続される。システム・バス４４
もアドレス、データ及び制御コンポーネントを含む。シ
ステム・バス４４はバッファ４２とバッファ６８の間に
も接続される。システム・バス４４は更にバス制御タイ
ミング装置３５及びＤＭＡ装置４８に接続される。ＤＭ
Ａ装置４８は中央アービトレーション装置４９及びＤＭ
Ａ制御装置５０から成る。バッファ５１はシステム・バ
ス４４とマイクロチャネル・バス５２のようなオプショ
ンのバスとの間にインタフェースを設ける。マイクロチ
ャネル・アダプタ・カードを支持する複数のＩ／Ｏスロ
ット５４がバス５２に接続される。前記マイクロチャネ
ル・アダプタ・カードは更にＩ／Ｏ装置又はメモリに接
続することができる。
【００２１】アービトレーション制御バス５５はＤＭＡ
制御装置５０及び中央アービトレーション装置４９をＩ
／Ｏスロット５４及びディスケット・アダプタ５６に結
合する。メモリ制御装置５９、アドレス多重記憶制御装
置６０及びデータ・バッファ６１から成るメモリ制御装
置３６も、システム・バス４４に接続される。更に、メ
モリ制御装置３６はＲＡＭモジュール３８で表わされた
ランダム・アクセス・メモリに接続される。メモリ制御
装置３６はマイクロプロセッサ３２へ（から）のアドレ
スをＲＡＭモジュール３８の特定の領域に写像するロジ
ックを含む。このロジックはＢＩＯＳが前に占有したＲ
ＡＭを回収するために用いる。ＲＯＭ６４を使用可能又
は使用禁止にするのに用いるＲＯＭ選択信号（ＲＯＭＳ
ＥＬ）もメモリ制御装置３６により生成される。
制御装置５０及び中央アービトレーション装置４９をＩ
／Ｏスロット５４及びディスケット・アダプタ５６に結
合する。メモリ制御装置５９、アドレス多重記憶制御装
置６０及びデータ・バッファ６１から成るメモリ制御装
置３６も、システム・バス４４に接続される。更に、メ
モリ制御装置３６はＲＡＭモジュール３８で表わされた
ランダム・アクセス・メモリに接続される。メモリ制御
装置３６はマイクロプロセッサ３２へ（から）のアドレ
スをＲＡＭモジュール３８の特定の領域に写像するロジ
ックを含む。このロジックはＢＩＯＳが前に占有したＲ
ＡＭを回収するために用いる。ＲＯＭ６４を使用可能又
は使用禁止にするのに用いるＲＯＭ選択信号（ＲＯＭＳ
ＥＬ）もメモリ制御装置３６により生成される。
【００２２】図３のマイクロコンピュータ・システムは
基本１メガバイトＲＡＭモジュールとともに示されるが
、オプションのメモリ・モジュール６５〜６７で示すよ
うに追加のメモリを相互接続することができる。
基本１メガバイトＲＡＭモジュールとともに示されるが
、オプションのメモリ・モジュール６５〜６７で示すよ
うに追加のメモリを相互接続することができる。
【００２３】システム・バス４４とプレーナＩ／Ｏバス
６９の間にラッチ・バッファ６８が結合される。プレー
ナＩ／Ｏバス６９はアドレス、データ及び制御コンポー
ネントをそれぞれ含む。プレーナＩ／Ｏバス６９に沿っ
て結合されるのは、種々のＩ／Ｏアダプタ及びその他の
コンポーネント、例えば（モニタ１１を駆動するのに用
いる）表示アダプタ７０、ＣＭＯＳクロック７２、不揮
発性ＣＭＯＳ ＲＡＭ７４（以下、ＮＶＲＡＭと呼ぶ）
、ＲＳ２３２アダプタ７６、並列アダプタ７８、複数の
タイマ８０、ディスケット・アダプタ５６、割込み制御
装置８４及び読取専用メモリ（ＲＯＭ）６４である。Ｒ
ＯＭ６４はマイクロプロセッサ３２のＩ／Ｏ装置とオペ
レーティング・システムの間をインタフェースするため
に用いるＢＩＯＳを含む。ＲＯＭ６４に記憶されたＢＩ
ＯＳはＲＡＭ３８に複写してＢＩＯＳの実行時間を減ら
すことができる。更に、ＲＯＭ６４は（ＲＯＭＳＥＬ信
号を介して）メモリ制御装置３６に応答する。もしＲＯ
Ｍ６４がメモリ制御装置３６により使用可能になれば、
ＢＩＯＳはＲＯＭから実行される。もしＲＯＭ６４がメ
モリ制御装置により使用禁止になれば、ＲＯＭはマイク
ロプロセッサ３２からのアドレス問合せに応答しない（
即ちＢＩＯＳはＲＡＭから実行される）。
６９の間にラッチ・バッファ６８が結合される。プレー
ナＩ／Ｏバス６９はアドレス、データ及び制御コンポー
ネントをそれぞれ含む。プレーナＩ／Ｏバス６９に沿っ
て結合されるのは、種々のＩ／Ｏアダプタ及びその他の
コンポーネント、例えば（モニタ１１を駆動するのに用
いる）表示アダプタ７０、ＣＭＯＳクロック７２、不揮
発性ＣＭＯＳ ＲＡＭ７４（以下、ＮＶＲＡＭと呼ぶ）
、ＲＳ２３２アダプタ７６、並列アダプタ７８、複数の
タイマ８０、ディスケット・アダプタ５６、割込み制御
装置８４及び読取専用メモリ（ＲＯＭ）６４である。Ｒ
ＯＭ６４はマイクロプロセッサ３２のＩ／Ｏ装置とオペ
レーティング・システムの間をインタフェースするため
に用いるＢＩＯＳを含む。ＲＯＭ６４に記憶されたＢＩ
ＯＳはＲＡＭ３８に複写してＢＩＯＳの実行時間を減ら
すことができる。更に、ＲＯＭ６４は（ＲＯＭＳＥＬ信
号を介して）メモリ制御装置３６に応答する。もしＲＯ
Ｍ６４がメモリ制御装置３６により使用可能になれば、
ＢＩＯＳはＲＯＭから実行される。もしＲＯＭ６４がメ
モリ制御装置により使用禁止になれば、ＲＯＭはマイク
ロプロセッサ３２からのアドレス問合せに応答しない（
即ちＢＩＯＳはＲＡＭから実行される）。
【００２４】クロック７２は日時の計算に用いられＮＶ
ＲＡＭはシステム構成データの記憶に用いられる。即ち
、ＮＶＲＡＭは現在のシステム構成を記述する値を含む
。例えば、ＮＶＲＡＭは固定ディスク又はディスケット
の容量、表示のタイプ、メモリの量、時間、データ等を
記述する情報を含む。特に重要なのは、ＮＶＲＡＭはメ
モリ制御装置３６で用いられＢＩＯＳがＲＯＭからラン
されるかＲＡＭからランされるかを判定し且つＢＩＯＳ
ＲＡＭ で用いるように企図されたＲＡＭを回収すべ
きかどうかを判定するデータ（１ビットのこともありう
る）を含む。更に、特別な構成プログラム、例えばＳＥ
Ｔ（セット）構成が実行されるときは必ず、これらのデ
ータはＮＶＲＡＭに記憶される。ＳＥＴ構成プログラム
の目的はシステムの構成を特徴づける値をＮＶＲＡＭに
記憶することである。
ＲＡＭはシステム構成データの記憶に用いられる。即ち
、ＮＶＲＡＭは現在のシステム構成を記述する値を含む
。例えば、ＮＶＲＡＭは固定ディスク又はディスケット
の容量、表示のタイプ、メモリの量、時間、データ等を
記述する情報を含む。特に重要なのは、ＮＶＲＡＭはメ
モリ制御装置３６で用いられＢＩＯＳがＲＯＭからラン
されるかＲＡＭからランされるかを判定し且つＢＩＯＳ
ＲＡＭ で用いるように企図されたＲＡＭを回収すべ
きかどうかを判定するデータ（１ビットのこともありう
る）を含む。更に、特別な構成プログラム、例えばＳＥ
Ｔ（セット）構成が実行されるときは必ず、これらのデ
ータはＮＶＲＡＭに記憶される。ＳＥＴ構成プログラム
の目的はシステムの構成を特徴づける値をＮＶＲＡＭに
記憶することである。
【００２５】さて、図４及び図５で、本発明の顕著な特
徴に注目されたい。本発明を実施するパーソナルコンピ
ュータの動作コンポーネントの多くは前述の従来の構成
のコンピュータのものと同一であるので、説明が重複し
ないように前記コンポーネントに関する詳細な説明は行
わない。代りに、図４では、同じコンポーネントを１０
０代の参照番号を用いて表示する。
徴に注目されたい。本発明を実施するパーソナルコンピ
ュータの動作コンポーネントの多くは前述の従来の構成
のコンピュータのものと同一であるので、説明が重複し
ないように前記コンポーネントに関する詳細な説明は行
わない。代りに、図４では、同じコンポーネントを１０
０代の参照番号を用いて表示する。
【００２６】詳細に説明すれば、本発明のパーソナルコ
ンピュータはＣＰＵ局所バス１３４に結合され且つ前記
バスから物理的に分離できる少なくとも１つの局所バス
・メモリ機能が設けられる。本発明に従って、このよう
な機能は、できれば基板印刷回路のカード又はボード１
９０の形式の、コンポーネントを取付け前記取付けられ
たコンポーネント間の接続を結合する基板を含むことが
望ましい。ＤＲＡＭ集積回路チップのような複数のメモ
リ・モジュール１９２を有するＳＩＭＭ１９１として示
すような、少なくとも１つの揮発性メモリ・コンポーネ
ントがカード又はボード１９０の基板に取付けられる。 カード又はボード１９０は、揮発性メモリ・コンポーネ
ント１９１及びＣＰＵ局所バス１３４に結合されるメモ
リ制御装置１９４も取付ける。メモリ制御装置１９４を
取付けたカードは、揮発性メモリ・コンポーネント１９
１とマイクロプロセッサ１３２の間の通信を制御する。
ンピュータはＣＰＵ局所バス１３４に結合され且つ前記
バスから物理的に分離できる少なくとも１つの局所バス
・メモリ機能が設けられる。本発明に従って、このよう
な機能は、できれば基板印刷回路のカード又はボード１
９０の形式の、コンポーネントを取付け前記取付けられ
たコンポーネント間の接続を結合する基板を含むことが
望ましい。ＤＲＡＭ集積回路チップのような複数のメモ
リ・モジュール１９２を有するＳＩＭＭ１９１として示
すような、少なくとも１つの揮発性メモリ・コンポーネ
ントがカード又はボード１９０の基板に取付けられる。 カード又はボード１９０は、揮発性メモリ・コンポーネ
ント１９１及びＣＰＵ局所バス１３４に結合されるメモ
リ制御装置１９４も取付ける。メモリ制御装置１９４を
取付けたカードは、揮発性メモリ・コンポーネント１９
１とマイクロプロセッサ１３２の間の通信を制御する。
【００２７】図５に示すように、本発明に従ってパーソ
ナルコンピュータは複数のソケット１９５がシステム・
プレーナに取付けられ且つプレーナ経路によりＣＰＵ局
所バス１３４に接続されることが望ましい。従って、複
数のメモリ拡張カード１９０を手作業で挿入又は除去で
きるようにする。各々のメモリ拡張カード１９０はそれ
に複数のＳＩＭＭソケット１９６が取付けられ、常駐す
るメモリ制御装置１９４及びデータ・バッファ１９８（
インピーダンス整合バッファリングを提供する）にカー
ド１９０上の経路を介して接続されるが、危機的な使用
によっては、バッファリソグによる遅延はＥＣＬ ＴＴ
Ｌ のような非常に高速なロジック技術の使用で補うこ
とができる。データ・バッファ１９８の使用は、本発明
によるメモリ拡張カードとＣＰＵ局所バス１３４の間の
インタフェースが分離中に完全に指定できるように企図
される。
ナルコンピュータは複数のソケット１９５がシステム・
プレーナに取付けられ且つプレーナ経路によりＣＰＵ局
所バス１３４に接続されることが望ましい。従って、複
数のメモリ拡張カード１９０を手作業で挿入又は除去で
きるようにする。各々のメモリ拡張カード１９０はそれ
に複数のＳＩＭＭソケット１９６が取付けられ、常駐す
るメモリ制御装置１９４及びデータ・バッファ１９８（
インピーダンス整合バッファリングを提供する）にカー
ド１９０上の経路を介して接続されるが、危機的な使用
によっては、バッファリソグによる遅延はＥＣＬ ＴＴ
Ｌ のような非常に高速なロジック技術の使用で補うこ
とができる。データ・バッファ１９８の使用は、本発明
によるメモリ拡張カードとＣＰＵ局所バス１３４の間の
インタフェースが分離中に完全に指定できるように企図
される。
【００２８】図３と図４の構成では揮発性メモリの位置
が異なる。即ち、揮発性メモリは、図３ではシステム・
バス４４に結合されるが、図４ではＣＰＵ局所バス１３
４に結合される。本発明の構成もシステム・バス１４４
（図４）を有するが、前記メモリ結合の処理は異なる。 常駐するメモリ制御装置１９４を複数の拡張カードの各
々に設けて本発明の目的であるメモリ機能の変更を容易
にすることができることは、後者の特性の一部である。
が異なる。即ち、揮発性メモリは、図３ではシステム・
バス４４に結合されるが、図４ではＣＰＵ局所バス１３
４に結合される。本発明の構成もシステム・バス１４４
（図４）を有するが、前記メモリ結合の処理は異なる。 常駐するメモリ制御装置１９４を複数の拡張カードの各
々に設けて本発明の目的であるメモリ機能の変更を容易
にすることができることは、後者の特性の一部である。
【００２９】カード１９０のような局所バス・メモリ拡
張カードの使用は、メモリ拡張の可能性を維持しながら
最小のメモリ容量が取付けられたパーソナルコンピュー
タを消費者が購入するであろうから、ロー・エンド・ユ
ーザの経費低減を可能にする。（図３に示すような）従
来の構成はこのような可能性が開かれているかも知れな
いが、所要のメモリ制御装置及びバス構成間の配置はよ
り高価な制御装置を必要とし且つメモリとプロセッサの
間のアクセス時間を遅くする。
張カードの使用は、メモリ拡張の可能性を維持しながら
最小のメモリ容量が取付けられたパーソナルコンピュー
タを消費者が購入するであろうから、ロー・エンド・ユ
ーザの経費低減を可能にする。（図３に示すような）従
来の構成はこのような可能性が開かれているかも知れな
いが、所要のメモリ制御装置及びバス構成間の配置はよ
り高価な制御装置を必要とし且つメモリとプロセッサの
間のアクセス時間を遅くする。
【００３０】最大の拡張性を意図した製品を購入するハ
イ・エンド・ユーザ即ち”パワー”ユーザの場合は、メ
モリを拡張するオプション・カード・バスの使用はシス
テム・パフォーマンスをかなり落とすであろう。これに
対して、ＣＰＵ局所バス・メモリ拡張を使うと、任意の
使用可能なＳＩＭＭ構成の使用による拡張に適応しなが
らメモリ・アクセス信号の移行時間を短縮する。
イ・エンド・ユーザ即ち”パワー”ユーザの場合は、メ
モリを拡張するオプション・カード・バスの使用はシス
テム・パフォーマンスをかなり落とすであろう。これに
対して、ＣＰＵ局所バス・メモリ拡張を使うと、任意の
使用可能なＳＩＭＭ構成の使用による拡張に適応しなが
らメモリ・アクセス信号の移行時間を短縮する。
【００３１】揮発性メモリのアクセス及び拡張のための
ＣＰＵ局所バス並びに本発明以前に用いられたＳＩＭＭ
メモリ・インタフェースに類似した共通の指定されたイ
ンタフェースの使用は、前述のように交換可能なカード
１９０の利用を可能にする。更に、カード１９０は、広
範囲のメモリ・モジュールを本発明の時点で知られてい
るものも将来開発されるものも含めてどれも、オンボー
ド・メモリ制御装置の使用により利用することができる
。システムの構成又は再構成中はアドレスをオフセット
することによってカード又はそれに取付けられたＳＩＭ
Ｍ全体を分離することができるので、サービス及びダウ
ン・タイムは最小化される。
ＣＰＵ局所バス並びに本発明以前に用いられたＳＩＭＭ
メモリ・インタフェースに類似した共通の指定されたイ
ンタフェースの使用は、前述のように交換可能なカード
１９０の利用を可能にする。更に、カード１９０は、広
範囲のメモリ・モジュールを本発明の時点で知られてい
るものも将来開発されるものも含めてどれも、オンボー
ド・メモリ制御装置の使用により利用することができる
。システムの構成又は再構成中はアドレスをオフセット
することによってカード又はそれに取付けられたＳＩＭ
Ｍ全体を分離することができるので、サービス及びダウ
ン・タイムは最小化される。
【００３２】任意の所与の１枚のカード１９０で保持さ
れる全メモリ量はメモリ・テストにより又はセンス・ビ
ットから決定することができる。制御信号は、バス制御
タイミング装置１３５に結合されたバス・インタフェー
ス装置（ＢＩＵ）により処理される。
れる全メモリ量はメモリ・テストにより又はセンス・ビ
ットから決定することができる。制御信号は、バス制御
タイミング装置１３５に結合されたバス・インタフェー
ス装置（ＢＩＵ）により処理される。
【００３３】図示のように（図５）、カード１９０はシ
ステム・プレーナ１２０に直角に取付けられることが望
ましい。カード１９０に取付けられたＳＩＭＭ１９１は
、対応するカードに取付けできるメモリを最大化すると
同時に、換気できる角度に傾けられる。カード１９０は
両側（図５では裏側は見えない）にメモリを配列し、各
カードにかなりの範囲のメモリ容量を提供できる。メモ
リ技術が８メガバイト／ＳＩＭＭまでの密度を可能にす
る場合、１枚のカードに全体として非常に大容量のメモ
リを配置することができる。
ステム・プレーナ１２０に直角に取付けられることが望
ましい。カード１９０に取付けられたＳＩＭＭ１９１は
、対応するカードに取付けできるメモリを最大化すると
同時に、換気できる角度に傾けられる。カード１９０は
両側（図５では裏側は見えない）にメモリを配列し、各
カードにかなりの範囲のメモリ容量を提供できる。メモ
リ技術が８メガバイト／ＳＩＭＭまでの密度を可能にす
る場合、１枚のカードに全体として非常に大容量のメモ
リを配置することができる。
【００３４】
【発明の効果】この発明によれば、通常のタイプのコン
ピュータでマイクロプロセッサの局所バスに使用可能な
メモリ容量を容易に変更できる能力が提供される。
ピュータでマイクロプロセッサの局所バスに使用可能な
メモリ容量を容易に変更できる能力が提供される。
【図１】本発明を実施するパーソナルコンピュータの透
視図である。
視図である。
【図２】図１のパーソナルコンピュータの、シャシー、
カバー及びプレーナ・ボードを含む、一定のエレメント
及びこれらのエレメントの間の一定の関係を示す分解透
視図である。
カバー及びプレーナ・ボードを含む、一定のエレメント
及びこれらのエレメントの間の一定の関係を示す分解透
視図である。
【図３】本発明以前の一般的な慣習に従って配列された
パーソナルコンピュータの一定の構成要素の概要図であ
る。
パーソナルコンピュータの一定の構成要素の概要図であ
る。
【図４】本発明に従って図１及び図２のパーソナルコン
ピュータの一定の構成要素を図３に似たように配列した
図である。
ピュータの一定の構成要素を図３に似たように配列した
図である。
【図５】図１、２及び４のパーソナルコンピュータの拡
大、透視部分図である。
大、透視部分図である。
１０ マイクロコンピュータ
１１ モニタ
１２ キーボード
１４ 印刷装置／プロッタ
１５ カバー
１６ 部材
１８ シールド部材
１９ シャーシ
２２ ベース
２４ 前部パネル
２５ 後部パネル
２６ 上部ベイ
２８ 上部ベイ
２９ 下部ベイ
３０ 下部ベイ
３２ マイクロプロセッサ
３４ ＣＰＵ局所バス
３５ バス制御タイミング装置
３６ メモリ制御装置
３８ ＲＡＭモジュール
３９ 数学コプロセッサ
４０ キャッシュ制御装置
４１ キャッシュ・メモリ
４２ バッファ
４４ システム・バス
４８ ＤＭＡ装置
４９ 中央アービトレーション装置５０
ＤＭＡ制御装置 ５１ バッファ ５２ マイクロチャネル・バス ５４ Ｉ／Ｏスロット ５５ アービトレーション制御バス５６
ディスケット・アダプタ ６８ バッファ ５９ メモリ制御装置 ６０ アドレス多重記憶制御装置６１ デ
ータ・バッファ ６４ ＲＯＭ ６５ メモリ・モジュール ６６ メモリ・モジュール ６７ メモリ・モジュール ６８ ラッチ・バッファ ６９ プレーナＩ／Ｏバス ７０ 表示アダプタ ７２ ＣＭＯＳクロック ７４ ＣＭＯＳ ＲＡＭ ７６ ＲＳ２３２アダプタ ７８ 並列アダプタ ８０ タイマ ８４ 割込み制御装置 １２０ システム・プレーナ １３２ マイクロプロセッサ １３４ ＣＰＵ局所バス １３５ バス制御タイミング装置 １４４ システム・バス １９０ カード又はボード １９１ ＳＩＭＭ／揮発性メモリ・コンポーネント１
９２ メモリ・モジュール １９４ メモリ制御装置 １９５ ソケット １９６ ＳＩＭＭソケット １９８ データ・バッファ
ＤＭＡ制御装置 ５１ バッファ ５２ マイクロチャネル・バス ５４ Ｉ／Ｏスロット ５５ アービトレーション制御バス５６
ディスケット・アダプタ ６８ バッファ ５９ メモリ制御装置 ６０ アドレス多重記憶制御装置６１ デ
ータ・バッファ ６４ ＲＯＭ ６５ メモリ・モジュール ６６ メモリ・モジュール ６７ メモリ・モジュール ６８ ラッチ・バッファ ６９ プレーナＩ／Ｏバス ７０ 表示アダプタ ７２ ＣＭＯＳクロック ７４ ＣＭＯＳ ＲＡＭ ７６ ＲＳ２３２アダプタ ７８ 並列アダプタ ８０ タイマ ８４ 割込み制御装置 １２０ システム・プレーナ １３２ マイクロプロセッサ １３４ ＣＰＵ局所バス １３５ バス制御タイミング装置 １４４ システム・バス １９０ カード又はボード １９１ ＳＩＭＭ／揮発性メモリ・コンポーネント１
９２ メモリ・モジュール １９４ メモリ制御装置 １９５ ソケット １９６ ＳＩＭＭソケット １９８ データ・バッファ
Claims (14)
- 【請求項１】マイクロプロセッサ、前記マイクロプロセ
ッサに結合された高速局所バス、及び前記局所バスに結
合し且つ前記局所バスから物理的に分離できる局所バス
・メモリ機能を含むコンピュータ・システムであって、
前記機能はコンポーネントを取付け前記取付けられたコ
ンポーネントの間の接続を結合する基板、前記基板に取
付けられた少なくとも１つの揮発性メモリ・コンポーネ
ント、及び前記基板に取付けられ且つ前記揮発性メモリ
・コンポーネントと前記局所バスに結合された、前記揮
発性メモリ・コンポーネントと前記マイクロプロセッサ
の間の通信を制御するメモリ制御装置を含むコンピュー
タ・システム。 - 【請求項２】マイクロプロセッサ、前記マイクロプロセ
ッサに結合された高速局所バス、システム・バス、前記
局所バスと前記システム・バスに結合され前記局所バス
と前記システム・バスの間の通信を提供するバス制御装
置、及び前記局所バスに結合し且つ前記局所バスから物
理的に分離できる局所バス・メモリ機能を含むコンピュ
ータ・システムであって、前記機能はコンポーネントを
取付け前記取付けられたコンポーネントの間の接続を結
合する基板、前記基板に取付けられた少なくとも１つの
揮発性メモリ・コンポーネント、及び前記基板に取付け
られ且つ前記揮発性メモリ・コンポーネントと前記局所
バスと前記バス制御装置に結合された、前記揮発性メモ
リ・コンポーネントと前記マイクロプロセッサの間の通
信を制御するメモリ制御装置を含むコンピュータ・シス
テム。 - 【請求項３】前記マイクロプロセッサを取付けるシステ
ム・プレーナを更に包含して前記マイクロプロセッサと
前記局所バスと前記システム・バスと前記バス制御装置
の間の通信を提供し、取外しできるように基板を支持す
ることにより前記揮発性メモリ・コンポーネントと前記
支持された基板のメモリ制御装置と前記マイクロプロセ
ッサ、局所バス、システム・バス及びバス制御装置との
間の通信を確立するために前記システム・プレーナに取
付けられたソケットを更に含む請求項２のコンピュータ
・システム。 - 【請求項４】前記基板を支持するソケットは前記プレー
ナに直角になるように、そこに挿入された基板を取付け
る請求項２のコンピュータ・システム。 - 【請求項５】前記基板は印刷回路基板であり且つ前記回
路基板の各々に取付けられた複数のメモリ・コンポーネ
ント・ソケットを更に含み、対応する複数のメモリ・コ
ンポーネントを取外しできるように支持する請求項３の
コンピュータ・システム。 - 【請求項６】前記基板は１メガバイトから６４メガバイ
トまでの範囲にあるメモリ容量を有する請求項２、３、
４又は５のコンピュータ・システム。 - 【請求項７】マイクロプロセッサ、前記マイクロプロセ
ッサに結合された高速局所バス、及び前記局所バスに結
合され且つ前記局所バスから物理的に分離できる局所バ
ス・メモリ機能を含むパーソナルコンピュータ・システ
ムであって、前記機能は各々がコンポーネントを取付け
前記取付けられたコンポーネントの間の接続を結合する
複数の基板を含み、前記基板の各々はそれに取付けられ
た少なくとも１つの揮発性メモリ・コンポーネント、及
びそれに取付けられ且つ前記揮発性メモリ・コンポーネ
ントと前記局所バスに結合された、前記揮発性メモリ・
コンポーネントと前記マイクロプロセッサの間の通信を
制御するメモリ制御装置を有するパーソナルコンピュー
タ・システム。 - 【請求項８】マイクロプロセッサ、前記マイクロプロセ
ッサに結合された高速局所バス、システム・バス、前記
局所バスと前記システム・バスに結合され前記局所バス
と前記システム・バスの間の通信を提供するバス制御装
置、及び前記局所バスに結合しかつ前記局所バスから物
理的に分離できる局所バス・メモリ機能を含み、前記機
能は各々がコンポーネントを取付け前記取付けられたコ
ンポーネントの間の接続を結合する複数の基板を含み、
前記基板の各々はそれに取付けられた少なくとも１つの
揮発性メモリ・コンポーネント、及びそれに取付けられ
且つ前記揮発性メモリ・コンポーネントと前記局所バス
と前記バス制御装置に結合された、前記揮発性メモリ・
コンポーネントと前記マイクロプロセッサの間の通信を
制御するメモリ制御装置を有するパーソナルコンピュー
タ・システム。 - 【請求項９】マイクロプロセッサ、前記マイクロプロセ
ッサに結合された高速局所バス、システム・バス、前記
局所バスと前記システム・バスに結合され前記局所バス
と前記システム・バスの間の通信を提供するバス制御装
置、及び前記局所バスに結合され前記局所バスから物理
的に分離できる局所バス・メモリ機能を含み、前記機能
は各々が動作コンポーネントを取付け前記取付けられた
コンポーネント間の接続を結合する複数の基板を含み、
前記基板の各々は前記局所バスから物理的に分離でき且
つそれに取付けられ且つそこから物理的に分離できる少
なくとも１つの揮発性メモリ・コンポーネント、及びそ
れに取付けられ且つ前記揮発性メモリ・コンポーネント
と前記局所バスと前記バス制御装置に結合された、前記
揮発性メモリ・コンポーネントと前記マイクロプロセッ
サの間の通信を制御するメモリ制御装置を有するパーソ
ナルコンピュータ・システム。 - 【請求項１０】前記マイクロプロセッサを取付けるシス
テム・プレーナを更に含み前記マイクロプロセッサと前
記局所バスと前記システム・バスと前記バス制御装置の
間の通信を提供し、各々が基板を取外しできるように支
持しそれによって前記揮発性メモリ・コンポーネントと
前記支持された基板のメモリ制御装置と前記マイクロプ
ロセッサと局所バスとシステム・バスとバス制御装置の
間の通信を確立するために前記システム・プレーナに取
付けられた複数のソケットを更に含む請求項８又は請求
項９のパーソナルコンピュータ・システム。 - 【請求項１１】前記基板支持ソケットの各々はそれに挿
入された基板を前記プレーナに直角になるように取付け
る請求項１０のパーソナルコンピュータ・システム。 - 【請求項１２】前記基板の各々は印刷回路基板であり対
応する複数のメモリ・コンポーネントを取外しできるよ
うに支持するために前記回路基板の各々に取付けられた
複数のメモリ・コンポーネント・ソケットを含む請求項
１０のパーソナルコンピュータ・システム。 - 【請求項１３】前記メモリ・コンポーネントの各々は少
なくとも１メガバイトのメモリ容量を有するＳＩＭＭを
含む請求項２、請求項３、請求項４、請求項５又は請求
項８のパーソナルコンピュータ・システム。 - 【請求項１４】前記メモリ・コンポーネントの各々は１
メガバイト、２メガバイト、４メガバイト及び８メガバ
イトのメモリ容量を有するＳＩＭＭから成るクラスの間
から選択されたＳＩＭＭを含む請求項２、請求項３、請
求項４、請求項５、請求項８又は請求項９のパーソナル
コンピュータ・システム。
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|---|---|---|---|---|
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| CA2067599A1 (en) * | 1991-06-10 | 1992-12-11 | Bruce Alan Smith | Personal computer with riser connector for alternate master |
| CA2080210C (en) * | 1992-01-02 | 1998-10-27 | Nader Amini | Bidirectional data storage facility for bus interface unit |
| JPH07122865B2 (ja) * | 1992-01-02 | 1995-12-25 | インターナショナル・ビジネス・マシーンズ・コーポレイション | バス動作の動作速度を制御するようにしたバス・インターフェースを有するコンピュータ・システム |
| US5471585A (en) * | 1992-09-17 | 1995-11-28 | International Business Machines Corp. | Personal computer system with input/output controller having serial/parallel ports and a feedback line indicating readiness of the ports |
| US5835926A (en) * | 1992-12-15 | 1998-11-10 | Siemens Business Communication Systems, Inc. | Multiple memory addressing using adjustable chip select |
| US5604875A (en) * | 1994-12-19 | 1997-02-18 | Intel Corporation | Method and apparatus for removably connecting either asynchronous or burst cache SRAM to a computer system |
| US5835733A (en) * | 1994-12-22 | 1998-11-10 | Texas Instruments Incorporated | Method and apparatus for implementing a single DMA controller to perform DMA operations for devices on multiple buses in docking stations, notebook and desktop computer system |
| US5692165A (en) * | 1995-09-12 | 1997-11-25 | Micron Electronics Inc. | Memory controller with low skew control signal |
| JPH09147545A (ja) * | 1995-09-19 | 1997-06-06 | Ricoh Co Ltd | メモリカードおよび情報処理装置 |
| US6587896B1 (en) * | 1998-02-27 | 2003-07-01 | Micron Technology, Inc. | Impedance matching device for high speed memory bus |
| US6357023B1 (en) * | 1998-04-08 | 2002-03-12 | Kingston Technology Co. | Connector assembly for testing memory modules from the solder-side of a PC motherboard with forced hot air |
| US6351827B1 (en) * | 1998-04-08 | 2002-02-26 | Kingston Technology Co. | Voltage and clock margin testing of memory-modules using an adapter board mounted to a PC motherboard |
| US6178526B1 (en) * | 1998-04-08 | 2001-01-23 | Kingston Technology Company | Testing memory modules with a PC motherboard attached to a memory-module handler by a solder-side adaptor board |
| US8135795B2 (en) * | 2003-04-03 | 2012-03-13 | International Business Machines Corporation | Method to provide on-demand resource access |
| RU173334U1 (ru) * | 2017-01-27 | 2017-08-22 | Акционерное общество "МЦСТ" | Блок процессорный унифицированный с микропроцессором с микроархитектурой Эльбрус шестого поколения |
| CN110765049B (zh) * | 2018-07-25 | 2024-09-06 | 聪泰科技开发股份有限公司 | 可扩充式接口结构的配置方法 |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01298457A (ja) * | 1988-04-05 | 1989-12-01 | Philips Gloeilampenfab:Nv | コンピュータシステム |
| JPH0290256A (ja) * | 1988-09-27 | 1990-03-29 | Meidensha Corp | メモリバス切換え方式 |
| JPH0293841A (ja) * | 1988-09-30 | 1990-04-04 | Toshiba Corp | メモリ制御方式 |
Family Cites Families (15)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4575792A (en) * | 1982-03-31 | 1986-03-11 | Honeywell Information Systems Inc. | Shared interface apparatus for testing the memory sections of a cache unit |
| JPS6075903A (ja) * | 1983-09-30 | 1985-04-30 | Matsushita Electric Works Ltd | シ−ケンス制御装置 |
| US4870704A (en) * | 1984-10-31 | 1989-09-26 | Flexible Computer Corporation | Multicomputer digital processing system |
| US4916603A (en) * | 1985-03-18 | 1990-04-10 | Wang Labortatories, Inc. | Distributed reference and change table for a virtual memory system |
| GB2175421B (en) * | 1985-05-13 | 1989-11-29 | Singer Link Miles Ltd | Computing system |
| US4837739A (en) * | 1986-07-25 | 1989-06-06 | Ford Aerospace & Communications Corporation | Telemetry data processor |
| CA1330596C (en) * | 1986-11-19 | 1994-07-05 | Yoshiaki Nakanishi | Memory cartridge and data processing apparatus |
| US4980850A (en) * | 1987-05-14 | 1990-12-25 | Digital Equipment Corporation | Automatic sizing memory system with multiplexed configuration signals at memory modules |
| US4933845A (en) * | 1987-09-04 | 1990-06-12 | Digital Equipment Corporation | Reconfigurable bus |
| US5218684A (en) * | 1987-09-04 | 1993-06-08 | Digital Equipment Corporation | Memory configuration system |
| US5091850A (en) * | 1987-09-28 | 1992-02-25 | Compaq Computer Corporation | System for fast selection of non-cacheable address ranges using programmed array logic |
| US4888773A (en) * | 1988-06-15 | 1989-12-19 | International Business Machines Corporation | Smart memory card architecture and interface |
| US5095428A (en) * | 1989-01-04 | 1992-03-10 | Compaq Computer Corporation | Cache flush request circuit flushes the cache if input/output space write operation and circuit board response are occurring concurrently |
| AU628547B2 (en) * | 1989-05-19 | 1992-09-17 | Compaq Computer Corporation | Modular computer memory circuit board |
| US5199033A (en) * | 1990-05-10 | 1993-03-30 | Quantum Corporation | Solid state memory array using address block bit substitution to compensate for non-functional storage cells |
-
1990
- 1990-12-31 US US07/636,175 patent/US5301343A/en not_active Expired - Fee Related
-
1991
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Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01298457A (ja) * | 1988-04-05 | 1989-12-01 | Philips Gloeilampenfab:Nv | コンピュータシステム |
| JPH0290256A (ja) * | 1988-09-27 | 1990-03-29 | Meidensha Corp | メモリバス切換え方式 |
| JPH0293841A (ja) * | 1988-09-30 | 1990-04-04 | Toshiba Corp | メモリ制御方式 |
Also Published As
| Publication number | Publication date |
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