JPH0429249B2 - - Google Patents
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- JPH0429249B2 JPH0429249B2 JP57054996A JP5499682A JPH0429249B2 JP H0429249 B2 JPH0429249 B2 JP H0429249B2 JP 57054996 A JP57054996 A JP 57054996A JP 5499682 A JP5499682 A JP 5499682A JP H0429249 B2 JPH0429249 B2 JP H0429249B2
- Authority
- JP
- Japan
- Prior art keywords
- key
- event
- signal
- chattering
- single note
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
- 244000145845 chattering Species 0.000 claims description 21
- 238000000034 method Methods 0.000 claims description 12
- 239000011159 matrix material Substances 0.000 claims description 5
- 230000002238 attenuated effect Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 7
- 238000005070 sampling Methods 0.000 description 6
- 230000007257 malfunction Effects 0.000 description 2
- 210000000056 organ Anatomy 0.000 description 2
- 238000001514 detection method Methods 0.000 description 1
- 230000002265 prevention Effects 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
- H03K5/125—Discriminating pulses
- H03K5/1252—Suppression or limitation of noise or interference
Landscapes
- Physics & Mathematics (AREA)
- Nonlinear Science (AREA)
- Electrophonic Musical Instruments (AREA)
- Manipulation Of Pulses (AREA)
Description
(1) 発明の技術分野
本発明は電子楽器のキースイツチのオンオフ時
にチヤタリングが発生しても出力信号には表われ
ないようにした電子楽器のチヤタリング除去方法
に関するものである。 (2) 従来技術と問題点 従来、鍵盤等に用いるスイツチにはチヤタリン
グがつきものであるが、これを防止する回路とし
てたとえば第１図の構成が用いられる。第２図ａ
〜ｈはその動作波形図である。 第１図において、スイツチ（SW）１でオンオ
フされたスイツチ信号は、サンプリングクロツク
CK１とともに４段のシリアルインパラレルアウ
ト形のシフトレジスタ２1〜２4に入力し、入力を
Ｓ０，それぞれの出力をＳ１〜Ｓ４とする。これ
らの出力をAND回路３で論理積をとつた出力を
Ｓ５、OR回路４で論理和をとつた出力がＳ６と
する。すなわち、Ｓ５は４回のサンプリングに続
けて“１”が検出された時“１”を出力し、Ｓ６
は４回のサンプリングに１回でも“１”が検出さ
れた時“１”を出力する。この例は時分割多重さ
れないスイツチ信号に関してであるが、時分割多
重されていても同じ論理が適用できる。なお、こ
こで用いられる制御回路（CPU）は電子楽器と
共用される。 この場合の動作波形を示すと、第２図ａの入力
Ｓ０のキーオン、キーオフ時のチヤタリングに対
し、同図ｂのクロツクCK１に対応し、同図ａ〜
ｆの各シフトレジスタ２1〜２4の出力Ｓ１〜Ｓ４
は図示のように動作するが、同図ｇのＳ５では波
形イが、同図ｈのＳ６では波形ロが残り、誤動作
の原因となる。 すなわち、シフトレジスタの段数とサンプリン
グ周期とを掛け合せた時間以上の長さでチヤタリ
ングが発生した場合には、サンプリング周期の幅
でチヤタリング防止回路の出力にまたチヤタリン
グが発生してしまうことになる。 (3) 発明の目的 本発明の目的は電子楽器のキースイツチのオン
オフ時にチヤタリングが発生しても出力信号には
全く表われないようにした電子楽器のチヤタリン
グ除去方法を提供することである。 (4) 発明の構成 前記目的を達成するため、本発明の電子楽器の
チヤタリング除去方法は、マトリツクス状に配置
された複数のキースイツチをスキヤンして操作さ
れたキーを検出し、単音を発音するようにキーオ
ンまたはキーオフ信号を出力する電子楽器のチヤ
タリング除去方式において、 前記複数のキースイツチを順次走査するキー走
査手段と、 前記キー走査の結果に基づき単音の発音開始と
発音終了を指示する割当て手段〜と、 計数値を記憶する計数メモリＮと、 前記計数メモリの内容を周期的に計数する計数
手段とを具え、 前記割当て手段は、前記単音が発音されていな
いときに新たなキーオンイベントを検出すると
該新たなキーオンを前記単音に割当てると共に対
応するキーオン信号を出力する第１手段と、 前記単音に割当てられている楽音のキーオフイ
ベントを検出すると、まず前記計数値を初期化
し、その後キーオンイベントがくるまでに前記
計数値が所定値に達したときに対応するキーオ
フ信号を出力する第２手段と、 前記単音に割当てられている楽音がリリース中
のときに新たなキーオンイベントを検出すると
発音中のエンベロープを高速で減衰させるように
制御する第３手段と、 からなることを特徴とするものである。なお、括
弧内の番号は後述の流れ図との対応を示す。 (5) 発明の実施例 本発明の実施例として、簡単のために、キース
イツチのスキヤンによつて得られた情報から、先
押優先とし、１音でけ発音するものとする。 第３図は本発明の実施例をブロツク化して示し
た構成図である。 キースイツチマトリツクス１０は後述の表に示
されるような構成のキースイツチ群である。 CPU２０は第４図の流れ図に示すように前記
キースイツチマトリツクスのスキヤンしてキース
イツチが操作されたのを検出し、チヤタリングを
除去して単音の情報を楽音発生回路５０に出力す
る。 ROM３０はCPU２０が動作するためのプログ
ラムを記憶する。 RAM４０はCPU２０の処理過程で生じる一時
的な情報、後述のキーメモリの内容、さらにはカ
ウンタの値Ｎを記憶する。 楽音発生回路５０は楽音を単音で電子的に発生
する装置である。 第４図は、第３図に示す電子オルガンのキース
イツチマトリツクス１０に前述と同様のスイツチ
信号検出方式を適用した例の流れ図である。第５
図ａ〜ｇはその動作波形図を示す。第４図におい
て、流れを１周する時間を１サイクルとする。い
ま、流れの中でキースイツチの変化、すなわちイ
ベントを検出するために、第３図のRAM４０内
にキーメモリの領域をもつており、下表に示す時
分割多重チヤンネルアドレスＳ０〜Ｓ１１で読出
す。
にチヤタリングが発生しても出力信号には表われ
ないようにした電子楽器のチヤタリング除去方法
に関するものである。 (2) 従来技術と問題点 従来、鍵盤等に用いるスイツチにはチヤタリン
グがつきものであるが、これを防止する回路とし
てたとえば第１図の構成が用いられる。第２図ａ
〜ｈはその動作波形図である。 第１図において、スイツチ（SW）１でオンオ
フされたスイツチ信号は、サンプリングクロツク
CK１とともに４段のシリアルインパラレルアウ
ト形のシフトレジスタ２1〜２4に入力し、入力を
Ｓ０，それぞれの出力をＳ１〜Ｓ４とする。これ
らの出力をAND回路３で論理積をとつた出力を
Ｓ５、OR回路４で論理和をとつた出力がＳ６と
する。すなわち、Ｓ５は４回のサンプリングに続
けて“１”が検出された時“１”を出力し、Ｓ６
は４回のサンプリングに１回でも“１”が検出さ
れた時“１”を出力する。この例は時分割多重さ
れないスイツチ信号に関してであるが、時分割多
重されていても同じ論理が適用できる。なお、こ
こで用いられる制御回路（CPU）は電子楽器と
共用される。 この場合の動作波形を示すと、第２図ａの入力
Ｓ０のキーオン、キーオフ時のチヤタリングに対
し、同図ｂのクロツクCK１に対応し、同図ａ〜
ｆの各シフトレジスタ２1〜２4の出力Ｓ１〜Ｓ４
は図示のように動作するが、同図ｇのＳ５では波
形イが、同図ｈのＳ６では波形ロが残り、誤動作
の原因となる。 すなわち、シフトレジスタの段数とサンプリン
グ周期とを掛け合せた時間以上の長さでチヤタリ
ングが発生した場合には、サンプリング周期の幅
でチヤタリング防止回路の出力にまたチヤタリン
グが発生してしまうことになる。 (3) 発明の目的 本発明の目的は電子楽器のキースイツチのオン
オフ時にチヤタリングが発生しても出力信号には
全く表われないようにした電子楽器のチヤタリン
グ除去方法を提供することである。 (4) 発明の構成 前記目的を達成するため、本発明の電子楽器の
チヤタリング除去方法は、マトリツクス状に配置
された複数のキースイツチをスキヤンして操作さ
れたキーを検出し、単音を発音するようにキーオ
ンまたはキーオフ信号を出力する電子楽器のチヤ
タリング除去方式において、 前記複数のキースイツチを順次走査するキー走
査手段と、 前記キー走査の結果に基づき単音の発音開始と
発音終了を指示する割当て手段〜と、 計数値を記憶する計数メモリＮと、 前記計数メモリの内容を周期的に計数する計数
手段とを具え、 前記割当て手段は、前記単音が発音されていな
いときに新たなキーオンイベントを検出すると
該新たなキーオンを前記単音に割当てると共に対
応するキーオン信号を出力する第１手段と、 前記単音に割当てられている楽音のキーオフイ
ベントを検出すると、まず前記計数値を初期化
し、その後キーオンイベントがくるまでに前記
計数値が所定値に達したときに対応するキーオ
フ信号を出力する第２手段と、 前記単音に割当てられている楽音がリリース中
のときに新たなキーオンイベントを検出すると
発音中のエンベロープを高速で減衰させるように
制御する第３手段と、 からなることを特徴とするものである。なお、括
弧内の番号は後述の流れ図との対応を示す。 (5) 発明の実施例 本発明の実施例として、簡単のために、キース
イツチのスキヤンによつて得られた情報から、先
押優先とし、１音でけ発音するものとする。 第３図は本発明の実施例をブロツク化して示し
た構成図である。 キースイツチマトリツクス１０は後述の表に示
されるような構成のキースイツチ群である。 CPU２０は第４図の流れ図に示すように前記
キースイツチマトリツクスのスキヤンしてキース
イツチが操作されたのを検出し、チヤタリングを
除去して単音の情報を楽音発生回路５０に出力す
る。 ROM３０はCPU２０が動作するためのプログ
ラムを記憶する。 RAM４０はCPU２０の処理過程で生じる一時
的な情報、後述のキーメモリの内容、さらにはカ
ウンタの値Ｎを記憶する。 楽音発生回路５０は楽音を単音で電子的に発生
する装置である。 第４図は、第３図に示す電子オルガンのキース
イツチマトリツクス１０に前述と同様のスイツチ
信号検出方式を適用した例の流れ図である。第５
図ａ〜ｇはその動作波形図を示す。第４図におい
て、流れを１周する時間を１サイクルとする。い
ま、流れの中でキースイツチの変化、すなわちイ
ベントを検出するために、第３図のRAM４０内
にキーメモリの領域をもつており、下表に示す時
分割多重チヤンネルアドレスＳ０〜Ｓ１１で読出
す。
【表】
このキーメモリには現在発音されているキース
イツチに関してだけ“１”がたつ。従つて、この
場合は発音チヤンネルを１チヤンネルと限定して
いるから、１個所しか“１”はたたない。Ｎはカ
ウンタの値を示している。 以上動作の流れを説明すると、でキースキヤ
ンアドレスを出力する。時分割多重だから表に示
すようにＳ０〜Ｓ１１まであり、そのアドレスの
中でも何ビツト目のスイツチ情報かを選ぶ。次に
でＮ（カウンタの値）が４以上であるか否かを
調べ、そうでないとき（Ｎ＝０，１，２，３）は
へ行きＮの値を＋１してからへ行く。Ｎが４
以上のときは直接へジヤンプする。では今回
スキヤンしたアドレスに対応する情報を受取り、
キーオンかどうかを調べる。キーオンの時はへ
行き発音チヤンネルが現在使用中（USE＝１）
か否かを調べ、使用中でなかつたならばへ行
き、キーメモリの内容と現在スキヤンしたキース
イツチ情報との間に変化があるかを調べる。つま
り、前回このキースイツチをスキヤンした時はキ
ーオフであつたかを調べる。変化があつた場合
は、へ行き、キーメモリの内容を新しくすると
同時に、Ｎの値を“０”（ゼロ）とし、発音チヤ
ンネルを通してキー出力信号をオン状態“１”で
出力しへ行き、最初に戻る。 の調べでキーオフである時はへ行き、同一
キーの情報が発音チヤンネルの中に書込まれてい
るか否かを調べ、書込まれている時はへ行き、
キーメモリの内容と現在スキヤンされたキースイ
ツチ情報との間に変化（キーイベント）があるか
否かを調べる。変化があつた場合はへ行き、キ
ーメモリをオフにすると同時にＮの値を“０”
（ゼロ）としへ行く。の調べでキーイベント
がなかつた場合はへ行き、Ｎが４以上かどうか
を調べ、そうであればへ行き発音チヤンネルを
通してキー出力信号をオフ状態“０”で出力し
へ行く。 キーオンの時での調べから発音チヤンネルが
使用中（USE＝１）であるとへ行き、同一キ
ーの情報が発音チヤンネルの中に書込まれている
か否かを調べ、書込まれている時はへ行くが、
そうでない時はへ行き、発音チヤンネルがリリ
ース状態かどうかを調べる。リリース状態でない
場合はすでに発音されていることになるから処理
しないでへ行く。一方リリース状態のときは
へ行き、演奏者のキー選択をなるべく忠実に表現
するため、現在キーオフでもリリース状態として
発音している音も高速リリースするように発音チ
ヤンネルを通してエンベロープ発生装置に要求す
る。 第５図ａ〜ｇは本発明を電子オルガンのキース
イツチに適用した場合の動作波形を示す。 同図ａ，ｂ，ｃはキーオンオフ時にチヤタリン
グを有するキースイツチ信号に対し、サンプリン
グクロツクによりサンプリングされた信号を得る
手順を示す。次にこの信号をキーメモリに格納し
同図ｄの波形を得、これと同図ｃのサンプリング
された信号との間の変化より同図ｅのキーイベン
トを検出する。このキーイベントがチヤタリング
のオンオフに対応するから、これに本発明のカウ
ンタに一定値Ｎ＝４を与える方式を適用する。す
なわち、同図fNとｇキーオンオフ波形に示すよ
うに、キーオフ時はカウンタはＮ＝４を繰返し、
キーオンの時のチヤタリングの立上りのキーイベ
ントオンで“０”からカウンタし、オフで“０”
にリセツトされる。 そしてＮ＝０，１，２，３の範囲ではキーオン
状態を保持し、完全なオン状態ではＮ＝４を繰返
す。次にキーオフ時のチヤタリングも同様にキー
オン状態を保持し、その終了後Ｎ＝４でキーオフ
状態となる。 この場合、Ｎの値、キーイベント、キーメモリ
の状態の関連において最終的なキーオフとキーオ
ンに至る手順が第４図に示されるとおりである。 (6) 発明の効果 以上説明したように、本発明によれば、キース
イツチのオンオフ時にチヤタリングが発生しても
カウンタが一定値に達しないうちに終れば無視し
てしまい出力信号には表われないようにすること
により、出力信号による処理における誤動作を完
全に防止することが可能となるものである。
イツチに関してだけ“１”がたつ。従つて、この
場合は発音チヤンネルを１チヤンネルと限定して
いるから、１個所しか“１”はたたない。Ｎはカ
ウンタの値を示している。 以上動作の流れを説明すると、でキースキヤ
ンアドレスを出力する。時分割多重だから表に示
すようにＳ０〜Ｓ１１まであり、そのアドレスの
中でも何ビツト目のスイツチ情報かを選ぶ。次に
でＮ（カウンタの値）が４以上であるか否かを
調べ、そうでないとき（Ｎ＝０，１，２，３）は
へ行きＮの値を＋１してからへ行く。Ｎが４
以上のときは直接へジヤンプする。では今回
スキヤンしたアドレスに対応する情報を受取り、
キーオンかどうかを調べる。キーオンの時はへ
行き発音チヤンネルが現在使用中（USE＝１）
か否かを調べ、使用中でなかつたならばへ行
き、キーメモリの内容と現在スキヤンしたキース
イツチ情報との間に変化があるかを調べる。つま
り、前回このキースイツチをスキヤンした時はキ
ーオフであつたかを調べる。変化があつた場合
は、へ行き、キーメモリの内容を新しくすると
同時に、Ｎの値を“０”（ゼロ）とし、発音チヤ
ンネルを通してキー出力信号をオン状態“１”で
出力しへ行き、最初に戻る。 の調べでキーオフである時はへ行き、同一
キーの情報が発音チヤンネルの中に書込まれてい
るか否かを調べ、書込まれている時はへ行き、
キーメモリの内容と現在スキヤンされたキースイ
ツチ情報との間に変化（キーイベント）があるか
否かを調べる。変化があつた場合はへ行き、キ
ーメモリをオフにすると同時にＮの値を“０”
（ゼロ）としへ行く。の調べでキーイベント
がなかつた場合はへ行き、Ｎが４以上かどうか
を調べ、そうであればへ行き発音チヤンネルを
通してキー出力信号をオフ状態“０”で出力し
へ行く。 キーオンの時での調べから発音チヤンネルが
使用中（USE＝１）であるとへ行き、同一キ
ーの情報が発音チヤンネルの中に書込まれている
か否かを調べ、書込まれている時はへ行くが、
そうでない時はへ行き、発音チヤンネルがリリ
ース状態かどうかを調べる。リリース状態でない
場合はすでに発音されていることになるから処理
しないでへ行く。一方リリース状態のときは
へ行き、演奏者のキー選択をなるべく忠実に表現
するため、現在キーオフでもリリース状態として
発音している音も高速リリースするように発音チ
ヤンネルを通してエンベロープ発生装置に要求す
る。 第５図ａ〜ｇは本発明を電子オルガンのキース
イツチに適用した場合の動作波形を示す。 同図ａ，ｂ，ｃはキーオンオフ時にチヤタリン
グを有するキースイツチ信号に対し、サンプリン
グクロツクによりサンプリングされた信号を得る
手順を示す。次にこの信号をキーメモリに格納し
同図ｄの波形を得、これと同図ｃのサンプリング
された信号との間の変化より同図ｅのキーイベン
トを検出する。このキーイベントがチヤタリング
のオンオフに対応するから、これに本発明のカウ
ンタに一定値Ｎ＝４を与える方式を適用する。す
なわち、同図fNとｇキーオンオフ波形に示すよ
うに、キーオフ時はカウンタはＮ＝４を繰返し、
キーオンの時のチヤタリングの立上りのキーイベ
ントオンで“０”からカウンタし、オフで“０”
にリセツトされる。 そしてＮ＝０，１，２，３の範囲ではキーオン
状態を保持し、完全なオン状態ではＮ＝４を繰返
す。次にキーオフ時のチヤタリングも同様にキー
オン状態を保持し、その終了後Ｎ＝４でキーオフ
状態となる。 この場合、Ｎの値、キーイベント、キーメモリ
の状態の関連において最終的なキーオフとキーオ
ンに至る手順が第４図に示されるとおりである。 (6) 発明の効果 以上説明したように、本発明によれば、キース
イツチのオンオフ時にチヤタリングが発生しても
カウンタが一定値に達しないうちに終れば無視し
てしまい出力信号には表われないようにすること
により、出力信号による処理における誤動作を完
全に防止することが可能となるものである。
第１図は従来例の説明図、第２図ａ〜ｈはその
動作波形図、第３図は本発明の実施例の構成図、
第４図は本発明の実施例の流れ図、第５図ａ〜ｇ
はその動作波形図を示し、図中、１はスイツチ、
１１は３段カウンタ、１２はANDゲートを示す。
動作波形図、第３図は本発明の実施例の構成図、
第４図は本発明の実施例の流れ図、第５図ａ〜ｇ
はその動作波形図を示し、図中、１はスイツチ、
１１は３段カウンタ、１２はANDゲートを示す。
Claims (1)
- 【特許請求の範囲】 １ マトリツクス状に配置された複数のキースイ
ツチをスキヤンして操作されたキーを検出し、単
音を発音するようにキーオンまたはキーオフ信号
を出力する電子楽器のチヤタリング除去方式にお
いて、 前記複数のキースイツチを順次走査するキー走
査手段と、 前記キー走査の結果に基づき単音の発音開始と
発音終了を指示する割当て手段と、 計数値を記憶する計数メモリと、 前記計数メモリの内容を周期的に計数する計数
手段とを具え、 前記割当て手段は、前記単音が発音されてない
ときに新たなキーオンイベントを検出すると該新
たなキーオンを前記単音に割当てると共に対応す
るキーオン信号を出力する第１手段と、 前記単音に割当てられている楽音のキーオフイ
ベントを検出すると、まず前記計数値を初期化
し、その後キーオンイベントがくるまでに前記計
数値が所定値に達したときに対応するキーオフ信
号を出力する第２手段と、 前記単音に割当てられている楽音がリリース中
のときに新たなキーオンイベントを検出すると発
音中のエンベロープを高速で減衰させるように制
御する第３の手段と、 からなることを特徴とする電子楽器のチヤタリン
グ除去方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57054996A JPS58172016A (ja) | 1982-04-02 | 1982-04-02 | スイツチ信号検出方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57054996A JPS58172016A (ja) | 1982-04-02 | 1982-04-02 | スイツチ信号検出方式 |
Related Child Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5056414A Division JPH07107635B2 (ja) | 1993-02-22 | 1993-02-22 | 電子楽器のチャタリング除去方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58172016A JPS58172016A (ja) | 1983-10-08 |
| JPH0429249B2 true JPH0429249B2 (ja) | 1992-05-18 |
Family
ID=12986262
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57054996A Granted JPS58172016A (ja) | 1982-04-02 | 1982-04-02 | スイツチ信号検出方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58172016A (ja) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0656552B2 (ja) * | 1984-09-07 | 1994-07-27 | カシオ計算機株式会社 | 自動演奏装置 |
| JPH02202729A (ja) * | 1989-01-31 | 1990-08-10 | Sumitomo Electric Ind Ltd | 指向性ダイバーシチアンテナ切替方式 |
| KR100483033B1 (ko) * | 1997-12-29 | 2005-08-17 | 주식회사 하이닉스반도체 | 멀티비트업-다운카운터 |
| DE602005012410D1 (de) * | 2004-09-08 | 2009-03-05 | Panasonic Corp | Anti chatter, antiklapper Zeitgeber für Anwendungs-Eingaben in einem DVD Wiedergabegerät. |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS514941A (ja) * | 1974-07-01 | 1976-01-16 | Matsushita Electric Ind Co Ltd |
-
1982
- 1982-04-02 JP JP57054996A patent/JPS58172016A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS514941A (ja) * | 1974-07-01 | 1976-01-16 | Matsushita Electric Ind Co Ltd |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS58172016A (ja) | 1983-10-08 |
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