JPH04263344A - カード識別番号分配装置 - Google Patents
カード識別番号分配装置Info
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- JPH04263344A JPH04263344A JP3023626A JP2362691A JPH04263344A JP H04263344 A JPH04263344 A JP H04263344A JP 3023626 A JP3023626 A JP 3023626A JP 2362691 A JP2362691 A JP 2362691A JP H04263344 A JPH04263344 A JP H04263344A
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- 230000005540 biological transmission Effects 0.000 claims abstract description 13
- 230000003213 activating effect Effects 0.000 claims description 4
- 238000010586 diagram Methods 0.000 description 7
- 238000000034 method Methods 0.000 description 6
- 102100023044 Cytosolic acyl coenzyme A thioester hydrolase Human genes 0.000 description 3
- 101710152190 Cytosolic acyl coenzyme A thioester hydrolase Proteins 0.000 description 3
- 230000004913 activation Effects 0.000 description 1
- 238000005315 distribution function Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】この発明は計算機制御装置のシス
テムリセット中に、共通バスに実装されているカード（
プリント回路装置）にその識別番号を分配する装置に関
する。なお以下各図において同一の符号は同一もしくは
相当部分を示す。
テムリセット中に、共通バスに実装されているカード（
プリント回路装置）にその識別番号を分配する装置に関
する。なお以下各図において同一の符号は同一もしくは
相当部分を示す。
【０００２】
【従来の技術】従来、計算機制御装置の共通バスに実装
されているカードを排他的にアクセスするための識別番
号を当該のカードに分配する方式としては、カード上の
設定スイッチで識別番号を設定したり、共通バスに実装
された分配機能を持つ共通バス制御カードにより識別番
号を分配する方式がある。後者の方式の場合、カード識
別番号を各カードに固有に分配するため、各カードの実
装位置（スロット位置）でカードの識別番号（スロット
ｉＤともいう）を決める方法がとられる。この識別番号
は共通バスに実装されている共通バス制御カードによっ
てシステムリセット中に分配される。
されているカードを排他的にアクセスするための識別番
号を当該のカードに分配する方式としては、カード上の
設定スイッチで識別番号を設定したり、共通バスに実装
された分配機能を持つ共通バス制御カードにより識別番
号を分配する方式がある。後者の方式の場合、カード識
別番号を各カードに固有に分配するため、各カードの実
装位置（スロット位置）でカードの識別番号（スロット
ｉＤともいう）を決める方法がとられる。この識別番号
は共通バスに実装されている共通バス制御カードによっ
てシステムリセット中に分配される。
【０００３】図４は従来の共通バス制御カード０１の構
成例を示すブロック回路図、図５はこの制御カード０１
によるスロットｉＤ分配（割当）シーケンスを示すタイ
ムチャート、図６は共通バスのスロット部分の信号線の
構成例を示す。図６において＊ＲＳＴは共通バスを構成
するリセット信号線、＊ＡＲＢ４〜＊ＡＲＢ０はスロッ
トｉＤ等を送信する調停ｉＤ信号線、＊ＡＤ０〜＊ＡＤ
１９はアドレスやデータを送信するアドレス／データバ
ス信号線（Ａ／Ｄバス信号線とも略記する）である。ま
た＊ＬＡＣＨ０〜＊ＬＡＣＨ１９は夫々この例では２０
個の各スロット（スロット０〜スロット１９）別に設け
られ、かつ夫々Ａ／Ｄ信号線＊ＡＤ０〜＊ＡＤ１９に接
続され、当該スロットにカードが実装されたとき、当該
スロットのピンＰＮを介し当該カードのｉＤラッチ端子
に接続されて有効になるｉＤラッチ信号線で、カードｉ
Ｄを夫々当該カードにラッチさせるタイミングを与える
ために用いられる。なおこの場合、スロット０には共通
バス制御カードが実装されるものとし、従って該制御カ
ードによるスロットｉＤの分配はスロット１〜スロット
１９に実装されたカードに対して行われるものとする。 また以下調停ｉＤ信号線，Ａ／Ｄバス信号線，ｉＤラッ
チ信号線を一般的に呼ぶときは＊ＡＲＢ，＊ＡＤ，＊Ｌ
ＡＣＨの符号を用いるものとする。
成例を示すブロック回路図、図５はこの制御カード０１
によるスロットｉＤ分配（割当）シーケンスを示すタイ
ムチャート、図６は共通バスのスロット部分の信号線の
構成例を示す。図６において＊ＲＳＴは共通バスを構成
するリセット信号線、＊ＡＲＢ４〜＊ＡＲＢ０はスロッ
トｉＤ等を送信する調停ｉＤ信号線、＊ＡＤ０〜＊ＡＤ
１９はアドレスやデータを送信するアドレス／データバ
ス信号線（Ａ／Ｄバス信号線とも略記する）である。ま
た＊ＬＡＣＨ０〜＊ＬＡＣＨ１９は夫々この例では２０
個の各スロット（スロット０〜スロット１９）別に設け
られ、かつ夫々Ａ／Ｄ信号線＊ＡＤ０〜＊ＡＤ１９に接
続され、当該スロットにカードが実装されたとき、当該
スロットのピンＰＮを介し当該カードのｉＤラッチ端子
に接続されて有効になるｉＤラッチ信号線で、カードｉ
Ｄを夫々当該カードにラッチさせるタイミングを与える
ために用いられる。なおこの場合、スロット０には共通
バス制御カードが実装されるものとし、従って該制御カ
ードによるスロットｉＤの分配はスロット１〜スロット
１９に実装されたカードに対して行われるものとする。 また以下調停ｉＤ信号線，Ａ／Ｄバス信号線，ｉＤラッ
チ信号線を一般的に呼ぶときは＊ＡＲＢ，＊ＡＤ，＊Ｌ
ＡＣＨの符号を用いるものとする。
【０００４】次に図４の共通バス制御カード０１におい
て、０２はこのカード０１内に設けられ、このカード０
１を制御するＣＰＵ、２はＣＰＵ０２によってｉＤが設
定されるスロットｉＤ設定レジスタ、１はこのスロット
ｉＤ設定レジスタ２の設定値（スロットｉＤ）を調停ｉ
Ｄ信号線＊ＡＲＢ４〜＊ＡＲＢ０に出力するための＊Ａ
ＲＢラインドライバ、４はスロット１〜スロット１９（
従ってｉＤラッチ信号線＊ＬＡＣＨ１〜＊ＬＡＣＨ１９
）を個別に指定するためのＬＡＣＨｎ設定レジスタ、３
はこのＬＡＣＨｎ設定レジスタ４の設定値をＡ／Ｄバス
信号線＊ＡＤ０〜＊ＡＤ１９に入力するためのＡ／Ｄバ
スラインドライバ、６はリセット解除時の通常のデータ
転送時に使用される共通バスインタフェース、５はシス
テムリセット時にリセット信号＊ＲＳＴによって＊ＡＲ
Ｂラインドライバ１，Ａ／Ｄバスラインドライバ３を有
効化し、共通バスインタフェース６を無効化するインバ
ータである。また＊ＲＤＹ，＊ＡＣＫは夫々共通バスを
構成するデータレディ信号線，（肯定）応答信号線であ
る。
て、０２はこのカード０１内に設けられ、このカード０
１を制御するＣＰＵ、２はＣＰＵ０２によってｉＤが設
定されるスロットｉＤ設定レジスタ、１はこのスロット
ｉＤ設定レジスタ２の設定値（スロットｉＤ）を調停ｉ
Ｄ信号線＊ＡＲＢ４〜＊ＡＲＢ０に出力するための＊Ａ
ＲＢラインドライバ、４はスロット１〜スロット１９（
従ってｉＤラッチ信号線＊ＬＡＣＨ１〜＊ＬＡＣＨ１９
）を個別に指定するためのＬＡＣＨｎ設定レジスタ、３
はこのＬＡＣＨｎ設定レジスタ４の設定値をＡ／Ｄバス
信号線＊ＡＤ０〜＊ＡＤ１９に入力するためのＡ／Ｄバ
スラインドライバ、６はリセット解除時の通常のデータ
転送時に使用される共通バスインタフェース、５はシス
テムリセット時にリセット信号＊ＲＳＴによって＊ＡＲ
Ｂラインドライバ１，Ａ／Ｄバスラインドライバ３を有
効化し、共通バスインタフェース６を無効化するインバ
ータである。また＊ＲＤＹ，＊ＡＣＫは夫々共通バスを
構成するデータレディ信号線，（肯定）応答信号線であ
る。
【０００５】次に図６を参照しつつ、図５に基づいて図
４の共通バス制御カード０１のＣＰＵ０２によるスロッ
トｉＤ分配動作を説明する。通常システムリセット中は
各カードはリセット状態にあり、通常のデータ転送は行
えない、そのためこの方式では共通バス制御カード０１
が、共通バス上の調停ｉＤ信号線（＊ＡＲＢ４〜＊ＡＲ
Ｂ０），Ａ／Ｄバス信号線（＊ＡＤ１９〜＊ＡＤ０），
ｉＤラッチ信号線（＊ＬＡＣＨ１９〜＊ＬＡＣＨ１），
およびリセット信号線＊ＲＳＴを使用して、次の手順で
スロットｉＤを分配する。
４の共通バス制御カード０１のＣＰＵ０２によるスロッ
トｉＤ分配動作を説明する。通常システムリセット中は
各カードはリセット状態にあり、通常のデータ転送は行
えない、そのためこの方式では共通バス制御カード０１
が、共通バス上の調停ｉＤ信号線（＊ＡＲＢ４〜＊ＡＲ
Ｂ０），Ａ／Ｄバス信号線（＊ＡＤ１９〜＊ＡＤ０），
ｉＤラッチ信号線（＊ＬＡＣＨ１９〜＊ＬＡＣＨ１），
およびリセット信号線＊ＲＳＴを使用して、次の手順で
スロットｉＤを分配する。
【０００６】（１）図外の手段によってリセット信号線
＊ＲＳＴがアクティブ（Ｌレベル）にされる。これによ
り共通バスインタフェース６は無効化され、＊ＡＲＢラ
インドライバ１，Ａ／Ｄバスラインドライバ３が有効化
される。 （２）次にＣＰＵ０２はＬＡＣＨｎ設定レジスタ４，Ａ
／Ｄバスラインドライバ３を介し、Ａ／Ｄバス信号線を
＊ＡＤ１から＊ＡＤ１９まで順にアクティブにしていく
。これによりｎ番のスロットｎにカードが実装されてい
るとすれば、Ａ／Ｄバス信号線＊ＡＤｎがアクティブに
なると、これに対応するｉＤラッチ信号線＊ＬＡＣＨｎ
がアクティブになる。 （３）ＣＰＵ０２はＡ／Ｄバス信号線＊ＡＤをアクティ
ブにすると同時に、このＡ／Ｄバス信号線＊ＡＤ（従っ
てｉＤラッチ信号線＊ＬＡＣＨ）で指定されるカードス
ロットに対応するスロットｉＤをスロットｉＤ設定レジ
スタ２，＊ＡＲＢラインドライバ１を介し調停ｉＤ信号
線＊ＡＲＢ４〜＊ＡＲＢ０にのせる。 （４）各カードは自身に対応するｉＤラッチ信号線＊Ｌ
ＡＣＨがアクティブとなった時点で、調停ｉＤ信号線＊
ＡＲＢ４〜＊ＡＲＢ０上のスロットｉＤを内部にラッチ
する。
＊ＲＳＴがアクティブ（Ｌレベル）にされる。これによ
り共通バスインタフェース６は無効化され、＊ＡＲＢラ
インドライバ１，Ａ／Ｄバスラインドライバ３が有効化
される。 （２）次にＣＰＵ０２はＬＡＣＨｎ設定レジスタ４，Ａ
／Ｄバスラインドライバ３を介し、Ａ／Ｄバス信号線を
＊ＡＤ１から＊ＡＤ１９まで順にアクティブにしていく
。これによりｎ番のスロットｎにカードが実装されてい
るとすれば、Ａ／Ｄバス信号線＊ＡＤｎがアクティブに
なると、これに対応するｉＤラッチ信号線＊ＬＡＣＨｎ
がアクティブになる。 （３）ＣＰＵ０２はＡ／Ｄバス信号線＊ＡＤをアクティ
ブにすると同時に、このＡ／Ｄバス信号線＊ＡＤ（従っ
てｉＤラッチ信号線＊ＬＡＣＨ）で指定されるカードス
ロットに対応するスロットｉＤをスロットｉＤ設定レジ
スタ２，＊ＡＲＢラインドライバ１を介し調停ｉＤ信号
線＊ＡＲＢ４〜＊ＡＲＢ０にのせる。 （４）各カードは自身に対応するｉＤラッチ信号線＊Ｌ
ＡＣＨがアクティブとなった時点で、調停ｉＤ信号線＊
ＡＲＢ４〜＊ＡＲＢ０上のスロットｉＤを内部にラッチ
する。
【０００７】
【発明が解決しようとする課題】以上の説明からわかる
ように従来の共通バス制御カードにはスロットｉＤを分
配するための専用回路と、共通バスインタフェース回路
との独立した二種類の機能が必要だったため、回路が膨
大になるという問題があった。そこで本発明はこの問題
を解消できるカード識別番号分配装置を提供することを
課題とする。
ように従来の共通バス制御カードにはスロットｉＤを分
配するための専用回路と、共通バスインタフェース回路
との独立した二種類の機能が必要だったため、回路が膨
大になるという問題があった。そこで本発明はこの問題
を解消できるカード識別番号分配装置を提供することを
課題とする。
【０００８】
【課題を解決するための手段】前記の課題を解決するた
めに、請求項１のカード識別番号分配装置は、『共通バ
スインタフェース（６など）を備え、システムの稼働時
のデータ転送の際は、（ＣＰＵ０２などの制御により）
この共通バスインタフェースを介し、共通バスのアドレ
スバス（Ａ／Ｄバス信号線＊ＡＤなど）に送信先アドレ
スを送出したのち、前記共通バス（のＡ／Ｄバス信号線
＊ＡＤなど）に送信データを送出し、かつこの送出と同
時に前記共通バスのデータレディ信号線（＊ＲＤＹなど
）をアクティブとして前記送信データが有効である旨を
知らせ、こののち前記共通バスの応答信号線（＊ＡＣＫ
など）がアクティブとなったことを判別して当該送信デ
ータの送出を終わり、また前記システムのリセット時に
（インバータ５などを介して有効化され）前記共通バス
で結合される各カードに夫々その実装されるスロット別
の個別の識別番号（スロットｉＤなど）を（ＣＰＵ０２
などから設定されて）前記共通バスの調停ｉＤ信号線（
＊ＡＲＢなど）に順次送出する識別番号送出手段（スロ
ットｉＤ設定レジスタ２，＊ＡＲＢラインドライバ１な
ど）を備え、この個別の識別番号の送出のつど、前記共
通バスのアドレスバス中の、各当該のスロットに対応し
て予め定められたアドレス線をアクティブにして、各当
該のカードに当該の個別の識別番号を設定するカード識
別番号分配装置において、前記個別の識別番号の送出の
つど、前記共通バスインタフェースを介し、前記のよう
にアドレス線をアクティブとするアドレスを前記アドレ
スバスに送出したのち、前記データレディ信号線をアク
ティブにする手段と、このアクティブとなった前記デー
タレディ信号線を介し起動され前記応答信号線をアクテ
ィブとする応答信号作成手段とを備え、前記共通バスイ
ンタフェースを介しこの応答信号線がアクティブとなっ
たことを判別して、前記識別番号送出手段からの当該の
個別の識別番号の送出を終わらせるように』するものと
し、また
めに、請求項１のカード識別番号分配装置は、『共通バ
スインタフェース（６など）を備え、システムの稼働時
のデータ転送の際は、（ＣＰＵ０２などの制御により）
この共通バスインタフェースを介し、共通バスのアドレ
スバス（Ａ／Ｄバス信号線＊ＡＤなど）に送信先アドレ
スを送出したのち、前記共通バス（のＡ／Ｄバス信号線
＊ＡＤなど）に送信データを送出し、かつこの送出と同
時に前記共通バスのデータレディ信号線（＊ＲＤＹなど
）をアクティブとして前記送信データが有効である旨を
知らせ、こののち前記共通バスの応答信号線（＊ＡＣＫ
など）がアクティブとなったことを判別して当該送信デ
ータの送出を終わり、また前記システムのリセット時に
（インバータ５などを介して有効化され）前記共通バス
で結合される各カードに夫々その実装されるスロット別
の個別の識別番号（スロットｉＤなど）を（ＣＰＵ０２
などから設定されて）前記共通バスの調停ｉＤ信号線（
＊ＡＲＢなど）に順次送出する識別番号送出手段（スロ
ットｉＤ設定レジスタ２，＊ＡＲＢラインドライバ１な
ど）を備え、この個別の識別番号の送出のつど、前記共
通バスのアドレスバス中の、各当該のスロットに対応し
て予め定められたアドレス線をアクティブにして、各当
該のカードに当該の個別の識別番号を設定するカード識
別番号分配装置において、前記個別の識別番号の送出の
つど、前記共通バスインタフェースを介し、前記のよう
にアドレス線をアクティブとするアドレスを前記アドレ
スバスに送出したのち、前記データレディ信号線をアク
ティブにする手段と、このアクティブとなった前記デー
タレディ信号線を介し起動され前記応答信号線をアクテ
ィブとする応答信号作成手段とを備え、前記共通バスイ
ンタフェースを介しこの応答信号線がアクティブとなっ
たことを判別して、前記識別番号送出手段からの当該の
個別の識別番号の送出を終わらせるように』するものと
し、また
【０００９】請求項２のカード識別番号分配装置では、
『前記応答信号作成手段は前記データレディ信号線がア
クティブとなったことを記憶するフリップフロップ（１
１など）と、システムリセット信号によって（インバー
タ５などを介し）有効化され前記フリップフロップの出
力信号を前記応答信号線に入力するゲート回路（データ
ＡＣＫドライバ１０など）とを備えた』ものとする。
『前記応答信号作成手段は前記データレディ信号線がア
クティブとなったことを記憶するフリップフロップ（１
１など）と、システムリセット信号によって（インバー
タ５などを介し）有効化され前記フリップフロップの出
力信号を前記応答信号線に入力するゲート回路（データ
ＡＣＫドライバ１０など）とを備えた』ものとする。
【００１０】
【作 用】共通バスシステムにおいて、共通バス制御
カードがシステムリセット中に共通バスインタフェース
をも利用しながら通常のデータ転送と類似のデータ転送
を行って、そのデータ転送における応答信号を自ら出力
することにして、データ転送を終結させ、共通バス上に
実装された各カードに対して個別の識別番号を分配する
ものである。
カードがシステムリセット中に共通バスインタフェース
をも利用しながら通常のデータ転送と類似のデータ転送
を行って、そのデータ転送における応答信号を自ら出力
することにして、データ転送を終結させ、共通バス上に
実装された各カードに対して個別の識別番号を分配する
ものである。
【００１１】
【実施例】以下図１ないし図３に基づいて本発明の実施
例を説明する。図３は共通バスシステムにおけるリセッ
ト解除後の通常データ転送のシーケンスを示す。ここで
は送信側はバスの所有権を保持しているものとすると、
次の手順で送信側は受信側に対してデータの転送を行う
。 （１）送信側は、Ａ／Ｄバス信号線＊ＡＤ（＊ＡＤ１９
〜＊ＡＤ０）に対して受信側のアドレスを出力し、受信
カードの指定を行う。 （２）送信側は、Ａ／Ｄバス信号線＊ＡＤに対して送信
データを出力し、かつデータレディ信号点＊ＲＤＹをア
クティブにし、受信側にデータが有効であることを通知
する。 （３）受信側は、データレディ信号＊ＲＤＹを確認後、
Ａ／Ｄバス信号線＊ＡＤ上のデータをカード内に取り込
み、応答信号線＊ＡＣＫをアクティブにして、データの
受信が完了したことを送信側に通知する。 （４）送信側は応答信号＊ＡＣＫを確認後、送信データ
の出力を終了し、かつデータレディ信号線＊ＲＤＹを非
アクティブにして送信を完了する。 （５）受信側は、データレディ信号線＊ＲＤＹが非アク
ティブになったのを確認後、応答信号線＊ＡＣＫを非ア
クティブにして受信を完了する。
例を説明する。図３は共通バスシステムにおけるリセッ
ト解除後の通常データ転送のシーケンスを示す。ここで
は送信側はバスの所有権を保持しているものとすると、
次の手順で送信側は受信側に対してデータの転送を行う
。 （１）送信側は、Ａ／Ｄバス信号線＊ＡＤ（＊ＡＤ１９
〜＊ＡＤ０）に対して受信側のアドレスを出力し、受信
カードの指定を行う。 （２）送信側は、Ａ／Ｄバス信号線＊ＡＤに対して送信
データを出力し、かつデータレディ信号点＊ＲＤＹをア
クティブにし、受信側にデータが有効であることを通知
する。 （３）受信側は、データレディ信号＊ＲＤＹを確認後、
Ａ／Ｄバス信号線＊ＡＤ上のデータをカード内に取り込
み、応答信号線＊ＡＣＫをアクティブにして、データの
受信が完了したことを送信側に通知する。 （４）送信側は応答信号＊ＡＣＫを確認後、送信データ
の出力を終了し、かつデータレディ信号線＊ＲＤＹを非
アクティブにして送信を完了する。 （５）受信側は、データレディ信号線＊ＲＤＹが非アク
ティブになったのを確認後、応答信号線＊ＡＣＫを非ア
クティブにして受信を完了する。
【００１２】本発明では以上と類似のデータ転送を共通
バスインタフェース６をも利用して新たな共通バス制御
カードがシステムリセット中に行う。そこでこのために
本発明の共通バス制御カードは、データレディ信号＊Ｒ
ＤＹを用いて自ら応答信号＊ＡＣＫを作成する回路と、
スロットｉＤの分配のために調停ｉＤ信号線＊ＡＲＢ４
〜＊ＡＲＢ０をドライブする回路を備え、システムリセ
ット中でも通常のデータ転送類似動作でカード識別番号
を分配することを可能としている。
バスインタフェース６をも利用して新たな共通バス制御
カードがシステムリセット中に行う。そこでこのために
本発明の共通バス制御カードは、データレディ信号＊Ｒ
ＤＹを用いて自ら応答信号＊ＡＣＫを作成する回路と、
スロットｉＤの分配のために調停ｉＤ信号線＊ＡＲＢ４
〜＊ＡＲＢ０をドライブする回路を備え、システムリセ
ット中でも通常のデータ転送類似動作でカード識別番号
を分配することを可能としている。
【００１３】図１はこの発明の共通バス制御カードの実
施例を示すブロック図であり、この新たな共通バス制御
カード０１Ａは従来（図４）と同様にＣＰＵ０２，＊Ａ
ＲＢラインドライバ１、スロットｉＤ設定レジスタ２、
共通バスインタフェース６を備えるほかに応答信号＊Ａ
ＣＫを作成するためのデータＡＣＫドライバ１０および
フリップフロップ１１、システムリセット中のみデータ
ＡＣＫドライバ１０，＊ＡＲＢラインドライバ１を有効
にするためのインバータ５を備えている。なおデータＡ
ＣＫドライバ１０はこの例では３入力のＮＡＮＤゲート
からなる。
施例を示すブロック図であり、この新たな共通バス制御
カード０１Ａは従来（図４）と同様にＣＰＵ０２，＊Ａ
ＲＢラインドライバ１、スロットｉＤ設定レジスタ２、
共通バスインタフェース６を備えるほかに応答信号＊Ａ
ＣＫを作成するためのデータＡＣＫドライバ１０および
フリップフロップ１１、システムリセット中のみデータ
ＡＣＫドライバ１０，＊ＡＲＢラインドライバ１を有効
にするためのインバータ５を備えている。なおデータＡ
ＣＫドライバ１０はこの例では３入力のＮＡＮＤゲート
からなる。
【００１４】図２はこの共通バス制御カード０１ＡのＣ
ＰＵ０２が共通バス上でプログラムによって行うスロッ
トｉＤ分配のタインミングシーケンスを示す。次に図１
を参照しつつ図２を説明する。まず図外の手段によって
リセット信号線＊ＲＳＴがアクティブ（Ｌ）になると、
＊ＡＲＢラインドライバ１，データＡＣＫドライバ１０
が有効化される。但し本発明ではこのリセットによって
共通バスインタフェース６が従来のように無効化される
ことはない。次にＣＰＵ０２はスロットｉＤ設定レジス
タ２にスロット１のｉＤを書き込む。これにより＊ＡＲ
Ｂラインドライバ１を介して共通バスの調停ｉＤ信号線
＊ＡＲＢ４〜＊ＡＲＢ０上にこのスロット１のスロット
ｉＤが送出される。またこれと並行してＣＰＵ０２は共
通バスインタフェース６を介して通常データ転送と同様
のアクセスによりＡ／Ｄバス信号線＊ＡＤ１のみをアク
ティブとするデータ００００２Ｈを共通バス上のＡ／Ｄ
バス信号線＊ＡＤ上に出力すると同時に、同じく共通バ
スインタフェース６を介しアクティブのデータレディ信
号＊ＲＤＹを共通バス上に出力する。この時データが０
０００２Ｈなのでスロット１に対応するｉＤラッチ信号
線＊ＬＡＣＨ１が有効となっている。従ってスロット１
に実装されているカードは調停ｉＤ信号線＊ＡＲＢ４〜
＊ＡＲＢ０上のスロットｉＤをラッチし自己の識別番号
とする。
ＰＵ０２が共通バス上でプログラムによって行うスロッ
トｉＤ分配のタインミングシーケンスを示す。次に図１
を参照しつつ図２を説明する。まず図外の手段によって
リセット信号線＊ＲＳＴがアクティブ（Ｌ）になると、
＊ＡＲＢラインドライバ１，データＡＣＫドライバ１０
が有効化される。但し本発明ではこのリセットによって
共通バスインタフェース６が従来のように無効化される
ことはない。次にＣＰＵ０２はスロットｉＤ設定レジス
タ２にスロット１のｉＤを書き込む。これにより＊ＡＲ
Ｂラインドライバ１を介して共通バスの調停ｉＤ信号線
＊ＡＲＢ４〜＊ＡＲＢ０上にこのスロット１のスロット
ｉＤが送出される。またこれと並行してＣＰＵ０２は共
通バスインタフェース６を介して通常データ転送と同様
のアクセスによりＡ／Ｄバス信号線＊ＡＤ１のみをアク
ティブとするデータ００００２Ｈを共通バス上のＡ／Ｄ
バス信号線＊ＡＤ上に出力すると同時に、同じく共通バ
スインタフェース６を介しアクティブのデータレディ信
号＊ＲＤＹを共通バス上に出力する。この時データが０
０００２Ｈなのでスロット１に対応するｉＤラッチ信号
線＊ＬＡＣＨ１が有効となっている。従ってスロット１
に実装されているカードは調停ｉＤ信号線＊ＡＲＢ４〜
＊ＡＲＢ０上のスロットｉＤをラッチし自己の識別番号
とする。
【００１５】ここでフリップフロップ１１はデータレデ
ィ信号＊ＲＤＹを取り込み、これによりデータＡＣＫド
ライバ１０は次のクロックのタイミングでアクティブの
応答信号＊ＡＣＫを共通バス上に出力する。ＣＰＵ０２
は共通バスインタフェース６を介しこの応答信号＊ＡＣ
Ｋを入力することにより、データ転送が終了したと判別
し、これでスロットｉＤ設定レジスタ２の当該のスロッ
トｉＤの設定を終り、スロット１に対するスロットｉＤ
の分配が完了する。次にＣＰＵ０２はスロットｉＤ設定
レジスタ２にスロット２のカードに対するスロットｉＤ
の書込み、共通バスインタフェース６を介し共通バス上
にＡ／Ｄバス信号線＊ＡＤ２のみを有効とするアドレス
データ００００４Ｈを出力すると共に前記と同様な動作
でスロット２に対するスロットｉＤの分配を完了する以
上の動作を順次繰り返すことによりスロット１９までの
スロットｉＤの分配を行うことができる。
ィ信号＊ＲＤＹを取り込み、これによりデータＡＣＫド
ライバ１０は次のクロックのタイミングでアクティブの
応答信号＊ＡＣＫを共通バス上に出力する。ＣＰＵ０２
は共通バスインタフェース６を介しこの応答信号＊ＡＣ
Ｋを入力することにより、データ転送が終了したと判別
し、これでスロットｉＤ設定レジスタ２の当該のスロッ
トｉＤの設定を終り、スロット１に対するスロットｉＤ
の分配が完了する。次にＣＰＵ０２はスロットｉＤ設定
レジスタ２にスロット２のカードに対するスロットｉＤ
の書込み、共通バスインタフェース６を介し共通バス上
にＡ／Ｄバス信号線＊ＡＤ２のみを有効とするアドレス
データ００００４Ｈを出力すると共に前記と同様な動作
でスロット２に対するスロットｉＤの分配を完了する以
上の動作を順次繰り返すことによりスロット１９までの
スロットｉＤの分配を行うことができる。
【００１６】
【発明の効果】本発明によれば、共通バスインタフェー
ス６を備え、システムの稼働時のデータ転送の際は、Ｃ
ＰＵ０２の制御によりこの共通バスインタフェース６を
介し、共通バスのＡ／Ｄバス信号線＊ＡＤに送信先アド
レスを送出したのち、前記共通バスのＡ／Ｄバス信号線
＊ＡＤに送信データを送出し、かつこの送出と同時に前
記共通バスのデータレディ信号線＊ＲＤＹをアクティブ
として前記送信データが有効である旨を知らせ、このう
ち前記共通バスの応答信号線＊ＡＣＫがアクティブとな
ったことを判別して当該送信データの送出を終わり、ま
た前記システムのリセット時にインバータ５を介して有
効化され前記共通バスで結合される各カードに夫々その
実装されるスロット別の個別の識別番号（スロットｉＤ
）ＣＰＵ０２から設定されて前記共通バスの調停ｉＤ信
号線＊ＡＲＢに順次送出する識別番号送出手段としての
スロットｉＤ設定レジスタ２，＊ＡＲＢラインドライバ
１などを備え、この個別の識別番号の送出のつど、前記
共通バスのＡ／Ｄバス信号線＊ＡＤ中の、各当該のスロ
ットに対応して予め定められたアドレス線をアクティブ
にして、各当該のカードに当該の個別の識別番号を設定
するカード識別番号分配装置において、
ス６を備え、システムの稼働時のデータ転送の際は、Ｃ
ＰＵ０２の制御によりこの共通バスインタフェース６を
介し、共通バスのＡ／Ｄバス信号線＊ＡＤに送信先アド
レスを送出したのち、前記共通バスのＡ／Ｄバス信号線
＊ＡＤに送信データを送出し、かつこの送出と同時に前
記共通バスのデータレディ信号線＊ＲＤＹをアクティブ
として前記送信データが有効である旨を知らせ、このう
ち前記共通バスの応答信号線＊ＡＣＫがアクティブとな
ったことを判別して当該送信データの送出を終わり、ま
た前記システムのリセット時にインバータ５を介して有
効化され前記共通バスで結合される各カードに夫々その
実装されるスロット別の個別の識別番号（スロットｉＤ
）ＣＰＵ０２から設定されて前記共通バスの調停ｉＤ信
号線＊ＡＲＢに順次送出する識別番号送出手段としての
スロットｉＤ設定レジスタ２，＊ＡＲＢラインドライバ
１などを備え、この個別の識別番号の送出のつど、前記
共通バスのＡ／Ｄバス信号線＊ＡＤ中の、各当該のスロ
ットに対応して予め定められたアドレス線をアクティブ
にして、各当該のカードに当該の個別の識別番号を設定
するカード識別番号分配装置において、
【００１７】前
記個別の識別番号の送出のつど、前記共通バスインタフ
ェース６を介し、前記のようにアドレス線をアクティブ
とするアドレスを前記Ａ／Ｄバス信号線＊ＡＤに送出し
たのち、前記データレディ信号線＊ＲＤＹをアクティブ
にする手段と、このアクティブとなった前記データレデ
ィ信号線＊ＲＤＹを介し起動され前記応答信号線＊ＡＣ
Ｋをアクティブとする応答信号作成手段としてのフリッ
プフロップ１１，データＡＣＫドライバ１０などとを備
え、前記共通バスインタフェース６を介しこの応答信号
線＊ＡＣＫがアクティブとなったことを判別して、前記
識別番号送出手段からの当該の個別識別番号の送出を終
わらせるようにしたので、
記個別の識別番号の送出のつど、前記共通バスインタフ
ェース６を介し、前記のようにアドレス線をアクティブ
とするアドレスを前記Ａ／Ｄバス信号線＊ＡＤに送出し
たのち、前記データレディ信号線＊ＲＤＹをアクティブ
にする手段と、このアクティブとなった前記データレデ
ィ信号線＊ＲＤＹを介し起動され前記応答信号線＊ＡＣ
Ｋをアクティブとする応答信号作成手段としてのフリッ
プフロップ１１，データＡＣＫドライバ１０などとを備
え、前記共通バスインタフェース６を介しこの応答信号
線＊ＡＣＫがアクティブとなったことを判別して、前記
識別番号送出手段からの当該の個別識別番号の送出を終
わらせるようにしたので、
【００１８】カード識別番号
分配に関する回路を最小限にし、コスト低減を計ること
が可能で、さらに部品点数が少なくなるため、共通バス
制御カードの信頼性を向上することができる。
分配に関する回路を最小限にし、コスト低減を計ること
が可能で、さらに部品点数が少なくなるため、共通バス
制御カードの信頼性を向上することができる。
【図１】本発明の一実施例としての構成を示すブロック
回路図
回路図
【図２】図１の要部動作を示すタイムシーケンス図
【図
３】通常データ転送のタイムシーケンス図
３】通常データ転送のタイムシーケンス図
【図４】図１
に対応する従来のブロック回路図
に対応する従来のブロック回路図
【図５】図４の要部動
作を示すタイムシーケンス図
作を示すタイムシーケンス図
【図６】スロット部の共通
バス信号線の構成を示す図
バス信号線の構成を示す図
０１Ａ 共通バス制御カード
０２ ＣＰＵ
１ ＊ＡＲＢラインドライバ
２ スロットｉＤ設定レジスタ
５ インバータ
６ 共通バスインタフェース
１０ データＡＣＫドライバ
１１ フリップフロップ
＊ＲＳＴ リセット信号（線）
＊ＡＲＢ（＊ＡＲＢ４〜＊ＡＲＢ０） 調停ｉＤ信号
（線） ＊ＡＤ（＊ＡＤ１９〜＊ＡＤ０） Ａ／Ｄバス信号（
線） ＊ＲＤＹ データレディ信号（線）＊ＡＣＫ
応答信号（線）
（線） ＊ＡＤ（＊ＡＤ１９〜＊ＡＤ０） Ａ／Ｄバス信号（
線） ＊ＲＤＹ データレディ信号（線）＊ＡＣＫ
応答信号（線）
Claims (2)
- 【請求項１】共通バスインタフェースを備え、システム
の稼動時のデータ転送の際は、この共通バスインタフェ
ースを介し、共通バスのアドレスバスに送信先アドレス
を送出したのち、前記共通バスに送信データを送出し、
かつこの送出と同時に前記共通バスのデータレディ信号
線をアクティブとして前記送信データが有効である旨を
知らせ、このうち前記共通バスの応答信号線がアクティ
ブとなったことを判別して当該送信データの送出を終わ
り、また前記システムのリセット時に前記共通バスで結
合される各カードに夫々その実装されるスロット別の個
別の識別番号を前記共通バスの調停ＩＤ信号線に順次送
出する識別番号送出手段を備え、この個別の識別番号の
送出のつど、前記共通バスのアドレスバス中の、各当該
のスロットに対応して予め定められたアドレス線をアク
ティブにして、各当該のカードに当該の個別の識別番号
を設定するカード識別番号分配装置において、前記個別
の識別番号の送出のつど、前記共通バスインタフェース
を介し、前記のようにアドレス線をアクティブとするア
ドレスを前記アドレスバスに送出したのち、前記データ
レディ信号線をアクティブにする手段と、このアクティ
ブとなった前記データレディ信号線を介し起動され前記
応答信号線をアクティブとする応答信号作成手段とを備
え、前記共通バスインタフェースを介しこの応答信号線
がアクティブとなったことを判別して、前記識別番号送
出手段からの当該の個別の識別番号の送出を終わらせる
ようにしたことを特徴とするカード識別番号分配装置。 - 【請求項２】前記応答信号作成手段は前記データレディ
信号線がアクティブとなったことを記憶するフリップフ
ロップと、システムリセット信号によって有効化され前
記フリップフロップの出力信号を前記応答信号線に入力
するゲート回路とを備えたことを特徴とするカード識別
番号分配装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3023626A JP2859746B2 (ja) | 1991-02-19 | 1991-02-19 | カード識別番号分配装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3023626A JP2859746B2 (ja) | 1991-02-19 | 1991-02-19 | カード識別番号分配装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04263344A true JPH04263344A (ja) | 1992-09-18 |
| JP2859746B2 JP2859746B2 (ja) | 1999-02-24 |
Family
ID=12115806
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3023626A Expired - Fee Related JP2859746B2 (ja) | 1991-02-19 | 1991-02-19 | カード識別番号分配装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2859746B2 (ja) |
-
1991
- 1991-02-19 JP JP3023626A patent/JP2859746B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JP2859746B2 (ja) | 1999-02-24 |
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