JPH0420147A - シリアルデータ伝送装置 - Google Patents
シリアルデータ伝送装置Info
- Publication number
- JPH0420147A JPH0420147A JP2124575A JP12457590A JPH0420147A JP H0420147 A JPH0420147 A JP H0420147A JP 2124575 A JP2124575 A JP 2124575A JP 12457590 A JP12457590 A JP 12457590A JP H0420147 A JPH0420147 A JP H0420147A
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- serial data
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- clock
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- 230000005540 biological transmission Effects 0.000 claims abstract description 18
- 238000010586 diagram Methods 0.000 description 4
- 230000002159 abnormal effect Effects 0.000 description 2
- 238000005259 measurement Methods 0.000 description 2
- 230000003287 optical effect Effects 0.000 description 2
- 230000005856 abnormality Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〈産業上の利用分野〉
本発明は、シーリアルデータ伝送装置に関するものであ
り、詳しくは、送信装置と受信装置間の配線数の削減に
関するものである。
り、詳しくは、送信装置と受信装置間の配線数の削減に
関するものである。
〈従来の技術〉
例えばレコーダを用いた測定にあたって、測定値と警報
設定値との大小関係に応じて、レコーダから離れた場所
の外部回路（例えばＡＣ２５０Ｖ／ＩＡ、ＤＣ３０Ｖ／
２Ａ）をオンオフさせタイ場合がある。
設定値との大小関係に応じて、レコーダから離れた場所
の外部回路（例えばＡＣ２５０Ｖ／ＩＡ、ＤＣ３０Ｖ／
２Ａ）をオンオフさせタイ場合がある。
測定チャンネルが少ない場合には、レコーダ内部に所定
の電流容量を持った複数のリレーを設けておき、外部回
路をレコーダ内部に取り込んで接続することができるが
、測定チャンネル数が多くなる（例えば３０チヤンネル
）と、レコーダの内部スペース面などから実現は困難に
なる。
の電流容量を持った複数のリレーを設けておき、外部回
路をレコーダ内部に取り込んで接続することができるが
、測定チャンネル数が多くなる（例えば３０チヤンネル
）と、レコーダの内部スペース面などから実現は困難に
なる。
そこで、従来から、レコーダの警報出力信号に従って開
閉駆動され接点が外部回路の一部に接続される複数のリ
レーを収納したリレー箱が用いられている。
閉駆動され接点が外部回路の一部に接続される複数のリ
レーを収納したリレー箱が用いられている。
第３図は従来のこのような構成のデータ伝送部分の一例
を示すブロック図であり、第４図は第３図の動作を説明
するタイミングチャートである。
を示すブロック図であり、第４図は第３図の動作を説明
するタイミングチャートである。
レコーダはシリアルデータ送信装置１として機能するも
のであり、ＣＰＵ２．クロック発生回路３およびシフト
レジスタ４が設けられている。リレー箱はシリアルデー
タ受信装置５として機能するものであり、シフトレジス
タ６が設けられている。
のであり、ＣＰＵ２．クロック発生回路３およびシフト
レジスタ４が設けられている。リレー箱はシリアルデー
タ受信装置５として機能するものであり、シフトレジス
タ６が設けられている。
このような構成において、送信装置１のＣＰＵ２はクロ
ック発生回路３およびシフトレジスタ４を制御する。ク
ロック発生回路３はシフトレジスタ４に第４図（ａ＞に
示すようなクロック信号ＣＬＫを出力するとともに、ク
ロック線を介して受信装置５のシフトレジスタ６にもク
ロック信号ＣＬＫを出力する。シフトレジスタ４にはレ
コーダ１の図示しない部分で生成される警報出力信号が
クロック信号ＣＬＫに従って逐次格納され、格納された
警報出力信号は第４図（ｂ）に示すようなシリアルデー
タＤＡＴＡとしてデータ線８を介して受信装置５のシフ
トレジスタ６に出力される。
ック発生回路３およびシフトレジスタ４を制御する。ク
ロック発生回路３はシフトレジスタ４に第４図（ａ＞に
示すようなクロック信号ＣＬＫを出力するとともに、ク
ロック線を介して受信装置５のシフトレジスタ６にもク
ロック信号ＣＬＫを出力する。シフトレジスタ４にはレ
コーダ１の図示しない部分で生成される警報出力信号が
クロック信号ＣＬＫに従って逐次格納され、格納された
警報出力信号は第４図（ｂ）に示すようなシリアルデー
タＤＡＴＡとしてデータ線８を介して受信装置５のシフ
トレジスタ６に出力される。
また、ＣＰＵ２は一連のデータの送信が終了する毎にス
トローブ［９を介してシフトレジスタ６に第４図（ｂ）
に示すようなストローブ５ＴＲＢを出力する。シフトレ
ジスタ６はクロックＣＬＫに従って逐次格納されるデー
タＤＡＴＡをストローブ信号５ＴＲＢに従ってラッチす
る。このようにしてシフトレジスタ６にラッチされたデ
ータＤＡＴＡは、図示しないリレーの駆動信号として用
いられる。
トローブ［９を介してシフトレジスタ６に第４図（ｂ）
に示すようなストローブ５ＴＲＢを出力する。シフトレ
ジスタ６はクロックＣＬＫに従って逐次格納されるデー
タＤＡＴＡをストローブ信号５ＴＲＢに従ってラッチす
る。このようにしてシフトレジスタ６にラッチされたデ
ータＤＡＴＡは、図示しないリレーの駆動信号として用
いられる。
〈発明が解決しようとする課題〉
しかし、このような従来の構成によれば、送信装置１と
受信装置５の間に３本の信号線７，８゜９が必要であり
、配線コストが高くなってしまうという問題がある。
受信装置５の間に３本の信号線７，８゜９が必要であり
、配線コストが高くなってしまうという問題がある。
本発明は、このような点に着目したものであり、その目
的は、データ伝送の信頼性を低下させることなく信号線
を削減できるシリアルデータ伝送装置を提供することに
ある。
的は、データ伝送の信頼性を低下させることなく信号線
を削減できるシリアルデータ伝送装置を提供することに
ある。
く課題を解決するための手段〉
本発明のシリアルデータ伝送装置は、
シリアルデータ送信装置とシリアルデータ受信装置がデ
ータ線およびクロック線で接続され、前記シリアルデー
タ受信装置は、 データ線を介して伝送されるデータがクロック線を介し
て伝送されるクロック信号に従って逐次格納されるシフ
トレジスタと、 クロック線を介して伝送されるクロック信号を常に監視
し、クロック信号が一定時間伝送されないことを検出す
ることによりシフトレジスタにデータをラッチするスト
ローブ信号を出力するウォッチドッグタイマ、 とで構成されたことを特徴とする。
ータ線およびクロック線で接続され、前記シリアルデー
タ受信装置は、 データ線を介して伝送されるデータがクロック線を介し
て伝送されるクロック信号に従って逐次格納されるシフ
トレジスタと、 クロック線を介して伝送されるクロック信号を常に監視
し、クロック信号が一定時間伝送されないことを検出す
ることによりシフトレジスタにデータをラッチするスト
ローブ信号を出力するウォッチドッグタイマ、 とで構成されたことを特徴とする。
く作用〉
シリアルデータ受信装置のウォッチドッグタイマはシリ
アルデータ送信装置からクロック信号が一定時間入力さ
れないことを検出して一連のデータ転送の終了と判断し
、ストローブ信号を発生して内部のシフトレジスタに出
力する。
アルデータ送信装置からクロック信号が一定時間入力さ
れないことを検出して一連のデータ転送の終了と判断し
、ストローブ信号を発生して内部のシフトレジスタに出
力する。
これにより、クロック信号に従ってシリアルデータ受信
装置の内〜部のシフトレジスタに逐次格納されるデータ
はラッチされることになる。
装置の内〜部のシフトレジスタに逐次格納されるデータ
はラッチされることになる。
〈実施例〉
以下、図面を用いて本発明の実施例を詳紹に説明する。
第１図は本発明の一実施例を示すブロック図であり、第
３図と同一部分には同一符号を付けている０図において
、受信装置５にはシフトレジスタ６の他に、クロック線
７を介して伝送されるクロック信号ＣＬＫを常に監視す
るウォッチドッグタイマ１０が設けられている。このウ
ォッチドッグタイマ１０は、クロック信号ＣＬＫが一定
時間伝送されないことを検出することによりシフトレジ
スタ６にデータＤＡＴＡをラッチするストローブ信号５
ＴＲＢを出力する。なお、本実施例におけるクロック線
７およびデータ線８としては例えば光信号線を用いる。
３図と同一部分には同一符号を付けている０図において
、受信装置５にはシフトレジスタ６の他に、クロック線
７を介して伝送されるクロック信号ＣＬＫを常に監視す
るウォッチドッグタイマ１０が設けられている。このウ
ォッチドッグタイマ１０は、クロック信号ＣＬＫが一定
時間伝送されないことを検出することによりシフトレジ
スタ６にデータＤＡＴＡをラッチするストローブ信号５
ＴＲＢを出力する。なお、本実施例におけるクロック線
７およびデータ線８としては例えば光信号線を用いる。
第２図は第１図の動作を説明するタイミングチャートで
ある。
ある。
■通常の動作
始めに、送信装置１は（ａ＞に示すデータＤＡＴＡと（
ｂ）に示すクロック信号ＣＬＫを受信装置５に伝送する
。受信装置５のシフトレジスタ６は、伝送されたデータ
ＤＡＴＡをクロック信号ＣＬＫに従って順次格納する。
ｂ）に示すクロック信号ＣＬＫを受信装置５に伝送する
。受信装置５のシフトレジスタ６は、伝送されたデータ
ＤＡＴＡをクロック信号ＣＬＫに従って順次格納する。
一方、クロック信号ＣＬＫは一連のデータＤＡＴＡの伝
送が終了すると次の一連のデータ伝送開始まで受信装置
５には伝送されない、ウォッチドッグタイマ１０は常に
クロック信号ＣＬＫを監視していて、クロック信号ＣＬ
Ｋが予め設定された一定時間Ｔの間クロック信号ＣＬＫ
が到来しないことを検出することにより一連のデータ伝
送が終了したものと判断して（ｃ）に示すストローブ信
号５ＴＲＢを発生し、シフトレジスタ６に出力する。こ
れにより、シフトレジスタ６は格納している一連のデー
タＤＡＴＡをラッチすることになる。なお、時間Ｔはク
ロック信号ＣＬＫの周期よりも多少長く設定しておけば
よい。
送が終了すると次の一連のデータ伝送開始まで受信装置
５には伝送されない、ウォッチドッグタイマ１０は常に
クロック信号ＣＬＫを監視していて、クロック信号ＣＬ
Ｋが予め設定された一定時間Ｔの間クロック信号ＣＬＫ
が到来しないことを検出することにより一連のデータ伝
送が終了したものと判断して（ｃ）に示すストローブ信
号５ＴＲＢを発生し、シフトレジスタ６に出力する。こ
れにより、シフトレジスタ６は格納している一連のデー
タＤＡＴＡをラッチすることになる。なお、時間Ｔはク
ロック信号ＣＬＫの周期よりも多少長く設定しておけば
よい。
■異常時の動作
送信装置１の電源が先に投入されていて送信装ｆ１がデ
ータＤＡＴＡを伝送している最中に、受信装置５の電源
が投入された場合を考える。
ータＤＡＴＡを伝送している最中に、受信装置５の電源
が投入された場合を考える。
この場合、受信装置５が最初に受信したデータＤＡＴＡ
は異常データになるが、２回目以降に受信するデータＤ
ＡＴＡは正常なデータになる。
は異常データになるが、２回目以降に受信するデータＤ
ＡＴＡは正常なデータになる。
次に、クロック線７に突発的なノイズ成分が飛び込んだ
場合を考える。
場合を考える。
この場合もノイズが飛び込んだ時点のデータはデータＤ
ＡＴＡとクロック信号ＣＬＫの同期がずれていることか
ら受信データは異常なものになるが、２回目以降に受信
するデータＤＡＴＡは正常なデータになる。
ＡＴＡとクロック信号ＣＬＫの同期がずれていることか
ら受信データは異常なものになるが、２回目以降に受信
するデータＤＡＴＡは正常なデータになる。
なお、上記実施例ではクロック線７およびブタ線８とし
て光信号線を用いる例を示したが、電気信号線であって
もよい。ただし、電気信号線を用いる場合にはアース線
が必要になることから、従来の構成では合計４本の信号
線が必要になるが本発明では３本に削減できることにな
る。
て光信号線を用いる例を示したが、電気信号線であって
もよい。ただし、電気信号線を用いる場合にはアース線
が必要になることから、従来の構成では合計４本の信号
線が必要になるが本発明では３本に削減できることにな
る。
また、上記実施例ではレコーダとリレー箱間のシリアル
データ伝送の例を説明したが、その他の同様な簡易シリ
アルデータ伝送を用いるシステムてにも有効である。
データ伝送の例を説明したが、その他の同様な簡易シリ
アルデータ伝送を用いるシステムてにも有効である。
〈発明の効果〉
以上説明したように、本発明によれば、データ伝送の信
顆性を低下させることなく信号線を削減できるシリアル
データ伝送装置が実現できる。
顆性を低下させることなく信号線を削減できるシリアル
データ伝送装置が実現できる。
第１図は本発明の一実施例を示すブロック図、第２図は
第１図の動作を説明するタイミングチャート、第３図は
従来の装置のデータ伝送部分の一例を示すブロック図、
第４図は第３図の動作を説明するタイミングチャートで
ある。 １・・・シリアルデータ送信装置（レコーダ）、２・・
・ＣＰＵ、３・・・クロック発生回路、４．６・・・シ
フトレジスタ、５・・・シリアルデータ受信装置、７・
・・クロック信号線、８・・・データ線、１ｏ・・・ウ
ォッチドッグタイマ。
第１図の動作を説明するタイミングチャート、第３図は
従来の装置のデータ伝送部分の一例を示すブロック図、
第４図は第３図の動作を説明するタイミングチャートで
ある。 １・・・シリアルデータ送信装置（レコーダ）、２・・
・ＣＰＵ、３・・・クロック発生回路、４．６・・・シ
フトレジスタ、５・・・シリアルデータ受信装置、７・
・・クロック信号線、８・・・データ線、１ｏ・・・ウ
ォッチドッグタイマ。
Claims (1)
- 【特許請求の範囲】 シリアルデータ送信装置とシリアルデータ受信装置が
データ線およびクロック線で接続され、前記シリアルデ
ータ受信装置は、 データ線を介して伝送されるデータがクロック線を介し
て伝送されるクロック信号に従って逐次格納されるシフ
トレジスタと、 クロック線を介して伝送されるクロック信号を常に監視
し、クロック信号が一定時間伝送されないことを検出す
ることによりシフトレジスタにデータをラッチするスト
ローブ信号を出力するウォッチドッグタイマ、 とで構成されたことを特徴とするシリアルデータ伝送装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2124575A JP2811911B2 (ja) | 1990-05-15 | 1990-05-15 | シリアルデータ伝送装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2124575A JP2811911B2 (ja) | 1990-05-15 | 1990-05-15 | シリアルデータ伝送装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0420147A true JPH0420147A (ja) | 1992-01-23 |
| JP2811911B2 JP2811911B2 (ja) | 1998-10-15 |
Family
ID=14888869
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2124575A Expired - Fee Related JP2811911B2 (ja) | 1990-05-15 | 1990-05-15 | シリアルデータ伝送装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2811911B2 (ja) |
Cited By (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100826551B1 (ko) * | 2006-10-09 | 2008-04-30 | 심플렉스 인터넷 주식회사 | 수험 시간관리 시계 및 이를 이용한 수험 시간관리 시스템 |
| KR100861237B1 (ko) * | 2006-10-26 | 2008-10-02 | 한태환 | 시험용 시간 관리 시계 |
| JP2011206166A (ja) * | 2010-03-29 | 2011-10-20 | Taiyo Elec Co Ltd | 遊技機 |
| JP2011206165A (ja) * | 2010-03-29 | 2011-10-20 | Taiyo Elec Co Ltd | 遊技機 |
| JP2011206164A (ja) * | 2010-03-29 | 2011-10-20 | Taiyo Elec Co Ltd | 遊技機 |
| JP2013066755A (ja) * | 2012-12-13 | 2013-04-18 | Taiyo Elec Co Ltd | 遊技機 |
| JP2013066754A (ja) * | 2012-12-13 | 2013-04-18 | Taiyo Elec Co Ltd | 遊技機 |
| JP2013078604A (ja) * | 2012-12-13 | 2013-05-02 | Taiyo Elec Co Ltd | 遊技機 |
-
1990
- 1990-05-15 JP JP2124575A patent/JP2811911B2/ja not_active Expired - Fee Related
Cited By (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100826551B1 (ko) * | 2006-10-09 | 2008-04-30 | 심플렉스 인터넷 주식회사 | 수험 시간관리 시계 및 이를 이용한 수험 시간관리 시스템 |
| KR100861237B1 (ko) * | 2006-10-26 | 2008-10-02 | 한태환 | 시험용 시간 관리 시계 |
| JP2011206166A (ja) * | 2010-03-29 | 2011-10-20 | Taiyo Elec Co Ltd | 遊技機 |
| JP2011206165A (ja) * | 2010-03-29 | 2011-10-20 | Taiyo Elec Co Ltd | 遊技機 |
| JP2011206164A (ja) * | 2010-03-29 | 2011-10-20 | Taiyo Elec Co Ltd | 遊技機 |
| JP2013066755A (ja) * | 2012-12-13 | 2013-04-18 | Taiyo Elec Co Ltd | 遊技機 |
| JP2013066754A (ja) * | 2012-12-13 | 2013-04-18 | Taiyo Elec Co Ltd | 遊技機 |
| JP2013078604A (ja) * | 2012-12-13 | 2013-05-02 | Taiyo Elec Co Ltd | 遊技機 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2811911B2 (ja) | 1998-10-15 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |