JPH04160948A - インタフェース制御回路 - Google Patents
インタフェース制御回路Info
- Publication number
- JPH04160948A JPH04160948A JP28886990A JP28886990A JPH04160948A JP H04160948 A JPH04160948 A JP H04160948A JP 28886990 A JP28886990 A JP 28886990A JP 28886990 A JP28886990 A JP 28886990A JP H04160948 A JPH04160948 A JP H04160948A
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- JP
- Japan
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- control circuit
- slave station
- slave
- bus
- station
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- Pending
Links
- 230000008054 signal transmission Effects 0.000 claims description 10
- 238000004891 communication Methods 0.000 abstract description 2
- 238000010586 diagram Methods 0.000 description 2
- 238000005516 engineering process Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 238000000034 method Methods 0.000 description 1
Landscapes
- Small-Scale Networks (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はインタフェース制御回路、特に、主局側のポー
ト選択信号により各種のインタフェースバスを切り換え
ることにより、複数の従局をディジーチェイン接続する
ことが出来るインタフェー大制御回路に関するものであ
る。
ト選択信号により各種のインタフェースバスを切り換え
ることにより、複数の従局をディジーチェイン接続する
ことが出来るインタフェー大制御回路に関するものであ
る。
従来、この種のデータ転送技術は、各種の従局のインタ
フェースバスが異なれば、主局はそれに対応したインタ
フェース接続部を個別に有する専用インタフェースが必
要となっていた。
フェースバスが異なれば、主局はそれに対応したインタ
フェース接続部を個別に有する専用インタフェースが必
要となっていた。
上述した従来のインタフェース制御回路は、従局側が異
なるインタフェースを保有すれば、主局側は同一のイン
タフェース毎に専用インタフェース接続部を保有する構
造となっているので、データ情報の交換の際には専用の
インタフェースを必要とし、ハードウェア量が増加する
という欠点がある。
なるインタフェースを保有すれば、主局側は同一のイン
タフェース毎に専用インタフェース接続部を保有する構
造となっているので、データ情報の交換の際には専用の
インタフェースを必要とし、ハードウェア量が増加する
という欠点がある。
本発明のインタフェース制御回路は、主局と複数の従局
の間をディジーチェイン接続する外部インタフェースバ
スと、複数の従局を中央処理装置の指示により制御する
ための複数の従局制御回路と、複数の従局のうちどの従
局を選択するか、また複数の従局制御回路のうちどの従
局制御回路を選択するかを中央処理装置の指示により選
択するポート選択制御回路と、選択された従局制御回路
のインタフェース信号をディジーチェイン接続された外
部インタフェースバスへ送受信するためのバス信号送受
信制御回路とを含んで構成される。
の間をディジーチェイン接続する外部インタフェースバ
スと、複数の従局を中央処理装置の指示により制御する
ための複数の従局制御回路と、複数の従局のうちどの従
局を選択するか、また複数の従局制御回路のうちどの従
局制御回路を選択するかを中央処理装置の指示により選
択するポート選択制御回路と、選択された従局制御回路
のインタフェース信号をディジーチェイン接続された外
部インタフェースバスへ送受信するためのバス信号送受
信制御回路とを含んで構成される。
次に、本発明について図面を参照して説明する。
第１図は本発明の一実施例を示すブロック図である。
第１図に示すインタフェース制御回路は、中央処理装置
１．内部バス２．ポート選択制御回路３、従局制御回路
（１）４．従局制御回路（２）５゜・・・、従局制御回
路（ｎ）８．バス信号送受制御回路７、外部インタフェ
ースバス８． 従局（１）９． 従局（２）１０．・・
・、従局（ｎ）１１により構成されている。従局（１）
９．従局（２） １０． ・、従局（ｎ）１１はバス信
号送受制御回路７にディジーチェイン接続される。
１．内部バス２．ポート選択制御回路３、従局制御回路
（１）４．従局制御回路（２）５゜・・・、従局制御回
路（ｎ）８．バス信号送受制御回路７、外部インタフェ
ースバス８． 従局（１）９． 従局（２）１０．・・
・、従局（ｎ）１１により構成されている。従局（１）
９．従局（２） １０． ・、従局（ｎ）１１はバス信
号送受制御回路７にディジーチェイン接続される。
中央処理装置１は、ポート選択制御回路３に各種の従局
（１）９．従局（２） １０．−、従局（ｎ）１１の内
、どの従局とデータ通信を行なうのかの指示を与える。
（１）９．従局（２） １０．−、従局（ｎ）１１の内
、どの従局とデータ通信を行なうのかの指示を与える。
指示を受けたポート選択制御回路３は、各種の従局（１
）９．従局（２） １０．−、従局（ｎ）ｆｌに対応し
たポート選択信号を発生し、従局（１）９の制御を行な
う為の従局制御回路（１） ４ 、 従局（２）１０
の制御を行なう為の従局制御回路（２）５゜・・・、従
局（ｎ）１１の制御を行なう為の従局制御回路（ｎ）６
と、外部インタフェースバス８を制御する為のバス信号
送受制御回路７にポート選択信号を供給する。
）９．従局（２） １０．−、従局（ｎ）ｆｌに対応し
たポート選択信号を発生し、従局（１）９の制御を行な
う為の従局制御回路（１） ４ 、 従局（２）１０
の制御を行なう為の従局制御回路（２）５゜・・・、従
局（ｎ）１１の制御を行なう為の従局制御回路（ｎ）６
と、外部インタフェースバス８を制御する為のバス信号
送受制御回路７にポート選択信号を供給する。
バス信号送受制御回路７は、ポート選択制御回路３から
送られてくるポート選択信号を自制側回路内でのポート
選択信号として使用すると同時に、外部インタフェース
バス８を介して従局（１）９、従局（２）１０．・・・
、従局（ｎ）１１にポート選択信号を分配する。
送られてくるポート選択信号を自制側回路内でのポート
選択信号として使用すると同時に、外部インタフェース
バス８を介して従局（１）９、従局（２）１０．・・・
、従局（ｎ）１１にポート選択信号を分配する。
従局制御回路（■）４は従局（１）９を制御する為、ポ
ート選択制御回路３からのポート選択信号を受けて自局
が選択されたことを把握し、中央処理袋ｒＩ！、１から
の従局（１）９に対する送信データは内部バス２を介し
て従局制御回路（１）４に与えられ、バス信号送受制御
回路７．外部インタフェースバス８を介して従局（１）
９に与えられる。
ート選択制御回路３からのポート選択信号を受けて自局
が選択されたことを把握し、中央処理袋ｒＩ！、１から
の従局（１）９に対する送信データは内部バス２を介し
て従局制御回路（１）４に与えられ、バス信号送受制御
回路７．外部インタフェースバス８を介して従局（１）
９に与えられる。
また、従局（１）９から中央処理装置１への受信データ
は、従局（１）９から外部インタフェースバス８を介し
てバス信号送受制御回路７に送られ、バス信号送受制御
回路７はポート選択制御回路３からのポート選択信号の
指示に従い、受信データを従局制御回路（１）４に送る
。従局制御回路（１）４は受信データを内部バス２を介
して中央処理装置ｔ１に引き渡す。
は、従局（１）９から外部インタフェースバス８を介し
てバス信号送受制御回路７に送られ、バス信号送受制御
回路７はポート選択制御回路３からのポート選択信号の
指示に従い、受信データを従局制御回路（１）４に送る
。従局制御回路（１）４は受信データを内部バス２を介
して中央処理装置ｔ１に引き渡す。
同様に、従局制御回路（２）５．・・・、従局制御回路
（ｎ）６はそれぞれ対応した従局（２）、・・・、従局
（ｎ）に対してポート選択制御回路３からのポート選択
信号の指示に従い、上記の動作を行なう。
（ｎ）６はそれぞれ対応した従局（２）、・・・、従局
（ｎ）に対してポート選択制御回路３からのポート選択
信号の指示に従い、上記の動作を行なう。
〔発明の効果〕
以上説明したように本発明は、中央処理装置からの指示
によるボート選択信号により選択された従局および従局
制御回路を選択し、外部インタフェースバス制御回路を
切り換えることにより、専用インタフェース接続部を保
有する必要がなく、ハードウェア量を削減出来て、かつ
インタフェース接続部を１個にすることが出来る効果が
ある。
によるボート選択信号により選択された従局および従局
制御回路を選択し、外部インタフェースバス制御回路を
切り換えることにより、専用インタフェース接続部を保
有する必要がなく、ハードウェア量を削減出来て、かつ
インタフェース接続部を１個にすることが出来る効果が
ある。
第１図は本発明の一実施例を示すブロック図である。
１・・・中央処理装置、２・・・内部バス、３・・・ボ
ート選択制御回路、４・・・従局制御回路（＋） 、５
・・・従局制御回路（２） 、６・・・従局制御回路（
ｎ） 、７・・・バス信号送受制御回路、８・・・外部
インタフェースバス、９・・・従局（１）、１０・・・
従局（２） 、１１・・・従局（ｎ）。
ート選択制御回路、４・・・従局制御回路（＋） 、５
・・・従局制御回路（２） 、６・・・従局制御回路（
ｎ） 、７・・・バス信号送受制御回路、８・・・外部
インタフェースバス、９・・・従局（１）、１０・・・
従局（２） 、１１・・・従局（ｎ）。
Claims (1)
- 各種の外部装置を制御する複数の従局と、前記複数の従
局を中央処理装置の指示により制御する主局との間の外
部インタフェースバスを介してのデータ転送のインタフ
ェース制御回路において、前記複数の従局のうちどの従
局を選択するか、また前記複数の従局を制御する為の複
数の従局制御回路のうちどの従局制御回路を選択するか
、また、各従局に対応するように外部インタフェースバ
スのデータ信号線を切り換える為のポート選択信号を前
記中央処理装置の指示により発生するポート選択制御回
路と、前記複数の従局に対し、前記ポート選択制御回路
によってデータ転送する従局を選択する為のポート選択
信号が与えられた時、前記中央処理装置の指示により従
局とデータ転送を制御する従局制御回路と、前記複数の
従局に対し、どの従局を選択しているかを示し、選択し
た従局だけ外部インタフェースへ接続指示する為の前記
複数の従局に対して共通のポート選択信号線とデータ転
送を行なう為のデータ線を有する前記主局と前記複数の
従局との間をディジーチェイン接続する外部インタフェ
ースバスと、前記ポート選択信号により選択された従局
制御回路の対応する従局に対して前記外部インタフェー
スバスのデータ信号線をポート選択信号により切り換え
たり、データ転送信号を送受信するバス信号送受制御回
路とを含むことを特徴とするインタフェース制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP28886990A JPH04160948A (ja) | 1990-10-25 | 1990-10-25 | インタフェース制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP28886990A JPH04160948A (ja) | 1990-10-25 | 1990-10-25 | インタフェース制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04160948A true JPH04160948A (ja) | 1992-06-04 |
Family
ID=17735813
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP28886990A Pending JPH04160948A (ja) | 1990-10-25 | 1990-10-25 | インタフェース制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04160948A (ja) |
-
1990
- 1990-10-25 JP JP28886990A patent/JPH04160948A/ja active Pending
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