JPH04138532A - 暴走検出回路 - Google Patents
暴走検出回路Info
- Publication number
- JPH04138532A JPH04138532A JP2261619A JP26161990A JPH04138532A JP H04138532 A JPH04138532 A JP H04138532A JP 2261619 A JP2261619 A JP 2261619A JP 26161990 A JP26161990 A JP 26161990A JP H04138532 A JPH04138532 A JP H04138532A
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- 238000001514 detection method Methods 0.000 claims description 2
- 238000011084 recovery Methods 0.000 description 8
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 238000000034 method Methods 0.000 description 2
- 230000007547 defect Effects 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 230000006870 function Effects 0.000 description 1
- 230000003252 repetitive effect Effects 0.000 description 1
Landscapes
- Detection And Correction Of Errors (AREA)
- Hardware Redundancy (AREA)
- Debugging And Monitoring (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は冗長構成を有するデータ処理システムに於ける
暴走検出回路に関する。
暴走検出回路に関する。
従来、信号処理装置、制御データ処理装置等の複数のデ
ータ処理装置を有し、各データ処理装置が同一のプログ
ラムを実行する冗長構成を有するデータ処理システムで
は、各データ処理装置の処理結果データを比較すること
により、誤りを検出するようにしている。また、データ
処理装置が３台以上ある場合は、多数決をとることによ
り、誤りを排除するようにしている。
ータ処理装置を有し、各データ処理装置が同一のプログ
ラムを実行する冗長構成を有するデータ処理システムで
は、各データ処理装置の処理結果データを比較すること
により、誤りを検出するようにしている。また、データ
処理装置が３台以上ある場合は、多数決をとることによ
り、誤りを排除するようにしている。
上述したように、従来は、各データ処理装置の処理結果
データを比較することにより、誤りを検出するようにし
ているため、その発生原因がデータのソフトエラー等に
よる一時的な誤りにあるのか、プログラムの欠陥による
処理シーケンスの乱れ（暴走）にあるのかを区別するこ
とができない。
データを比較することにより、誤りを検出するようにし
ているため、その発生原因がデータのソフトエラー等に
よる一時的な誤りにあるのか、プログラムの欠陥による
処理シーケンスの乱れ（暴走）にあるのかを区別するこ
とができない。
このため、従来は、誤り検出後にデータ処理システムを
正常状態に復帰させる際、最悪の場合を考慮してメモリ
やＩ１０バッファ中のデータのみならず、プログラムそ
のものも新たに書き直さなければならず、プログラムの
規模が大きい場合は復帰処理に多くの時間が費やされる
という問題があった。
正常状態に復帰させる際、最悪の場合を考慮してメモリ
やＩ１０バッファ中のデータのみならず、プログラムそ
のものも新たに書き直さなければならず、プログラムの
規模が大きい場合は復帰処理に多くの時間が費やされる
という問題があった。
本発明の目的は誤りの発生原因を認識できるようにする
ことにより、誤り発生原因に応じた適切な復帰処理を行
なえるようにすることにある。
ことにより、誤り発生原因に応じた適切な復帰処理を行
なえるようにすることにある。
本発明は上記目的を達成するため、
複数のデータ処理装置を有し、各データ処理装置が同一
のプログラムを実行する冗長構成を有するデータ処理シ
ステムに於いて、 前記各データ処理装置のアドレスバスにのるアドレスの
サムを算出するアドレスサム算出手段と、該アドレスサ
ム算出手段で算出した前記各データ処理装置のアドレス
サムを比較するアドレスサム比較手段と、 前記各データ処理装置の処理結果データを比較するデー
タ比較手段とを設けたものである。
のプログラムを実行する冗長構成を有するデータ処理シ
ステムに於いて、 前記各データ処理装置のアドレスバスにのるアドレスの
サムを算出するアドレスサム算出手段と、該アドレスサ
ム算出手段で算出した前記各データ処理装置のアドレス
サムを比較するアドレスサム比較手段と、 前記各データ処理装置の処理結果データを比較するデー
タ比較手段とを設けたものである。
［作 用〕
データの一時的な誤りが発生した場合或いは処理シーケ
ンスの乱れにより誤りが発生した場合はデータ比較手段
により誤りが検出され、処理ンーケンスの乱れにより誤
りが発生した場合はアドレスサム比較手段により誤りが
検出される。従って、データ比較手段のみで誤りが検出
された場合は誤り発生原因がデータの一時的な誤りにあ
ると判断することができ、アドレスサム比較手段で誤り
が検出された場合は誤り発生原因が処理ソーケンスの乱
れにあると判断することができるので、誤りの発生原因
に応じた復帰処理（例えば、誤り発生原因がデータの一
時的な誤りにある場合はデータの書き換えを、処理シー
ケンスの乱れにある場合はデータ及びプログラムの書き
換えを行なう）を行なうことが可能となる。
ンスの乱れにより誤りが発生した場合はデータ比較手段
により誤りが検出され、処理ンーケンスの乱れにより誤
りが発生した場合はアドレスサム比較手段により誤りが
検出される。従って、データ比較手段のみで誤りが検出
された場合は誤り発生原因がデータの一時的な誤りにあ
ると判断することができ、アドレスサム比較手段で誤り
が検出された場合は誤り発生原因が処理ソーケンスの乱
れにあると判断することができるので、誤りの発生原因
に応じた復帰処理（例えば、誤り発生原因がデータの一
時的な誤りにある場合はデータの書き換えを、処理シー
ケンスの乱れにある場合はデータ及びプログラムの書き
換えを行なう）を行なうことが可能となる。
次に本発明の実施例について図面を参照して詳細に説明
する。
する。
第１図は本発明の実施例のブロック図であり、２重冗長
構成を有するデータ処理システムに本発明を適用した場
合についてのものである。
構成を有するデータ処理システムに本発明を適用した場
合についてのものである。
同図に示すように、本実施例のデータ処理システムは同
一プログラムを実行する信号処理装置制御データ処理装
置等のデータ処理装置１，２と、データ処理装置１．２
の処理結果データｃ、ｆを比較するデータ比較器３と、
データ処理装置１２のアドレスサムｅ１ｇを比較するア
ドレスサム比較器４とから構成されている。そして、デ
ータ処理装置１は処理部１１と、メモリ１２と、入出力
装置（Ｉｌｏ）１３と、アドレスバス１７にのるアドレ
スｂのサムを算出するアドレス加算器１４と、アドレス
加算器１４が算出したアドレスサムが設定されるアドレ
スサムレジスタ１５とから構成されている。また、デー
タ処理装置２もデータ処理装置１と同様の構成を有して
いる。
一プログラムを実行する信号処理装置制御データ処理装
置等のデータ処理装置１，２と、データ処理装置１．２
の処理結果データｃ、ｆを比較するデータ比較器３と、
データ処理装置１２のアドレスサムｅ１ｇを比較するア
ドレスサム比較器４とから構成されている。そして、デ
ータ処理装置１は処理部１１と、メモリ１２と、入出力
装置（Ｉｌｏ）１３と、アドレスバス１７にのるアドレ
スｂのサムを算出するアドレス加算器１４と、アドレス
加算器１４が算出したアドレスサムが設定されるアドレ
スサムレジスタ１５とから構成されている。また、デー
タ処理装置２もデータ処理装置１と同様の構成を有して
いる。
データ処理装置１内の処理部１１はメモリ１２内に格納
されているプログラムに基づいてデータ処理、信号処理
を実施し、処理結果データａをデータバス１６を介して
メモリ１２に書き込んだり、成る繰り返しサイクル単位
毎（一定時間毎）または成る処理単位毎に入出力装置１
３を介して外部に出力する。データ比較器３はデータ処
理装置１゜２から処理結果データＣ４ｒが出力される毎
に両者を比較し、比較不一致の場合、誤りが発生したと
してデータエラー信号りを出力する。即ち、データ比較
器３は成る繰り返しサイクル単位毎または成る処理単位
毎に処理結果データｃ、ｒを比較することになる。
されているプログラムに基づいてデータ処理、信号処理
を実施し、処理結果データａをデータバス１６を介して
メモリ１２に書き込んだり、成る繰り返しサイクル単位
毎（一定時間毎）または成る処理単位毎に入出力装置１
３を介して外部に出力する。データ比較器３はデータ処
理装置１゜２から処理結果データＣ４ｒが出力される毎
に両者を比較し、比較不一致の場合、誤りが発生したと
してデータエラー信号りを出力する。即ち、データ比較
器３は成る繰り返しサイクル単位毎または成る処理単位
毎に処理結果データｃ、ｒを比較することになる。
また、データ処理装置Ｉ内のアドレス加算器１４は処理
部１１からアドレスバス１７にアドレスが出力される毎
にアドレスサムを求め、処理部１１から成る処理単位の
処理が終了する毎に出力される信号ｊが加えられること
により、求めたアドレスサムをアドレスサムレジスタエ
５にセットする。アドレスサム比較器４はデータ処理装
置工。
部１１からアドレスバス１７にアドレスが出力される毎
にアドレスサムを求め、処理部１１から成る処理単位の
処理が終了する毎に出力される信号ｊが加えられること
により、求めたアドレスサムをアドレスサムレジスタエ
５にセットする。アドレスサム比較器４はデータ処理装
置工。
２からアドレスサムｅ５ｇが出力される毎に（アドレス
サムレジスタにアドレスサムがセ・ノドされる毎に）両
者を比較し、比較不一致の場合、処理ンーケンスに乱れ
が発生したとしてアドレスサムエラー信号ｉを出力する
。即ち、アドレスサム比較器４は成る処理単位毎にアド
レスサムを比較することになる。また、成る繰り返しサ
イクル毎にアドレスサム比較器４でデータ処理装置１．
２のアドレスサムを比較する場合は、一定時間毎にタ
イムアウト信号を出力するタイマ（図示せず）をデータ
処理装置１，２内に設け、タイマからタイムアウト信号
が出力される毎にアドレスサムレジスタ１５及びデータ
処理袋Ｗ２内のアドレスサムレジスタ（図示せず）にア
ドレスサムをセットするようにすれば良い。
サムレジスタにアドレスサムがセ・ノドされる毎に）両
者を比較し、比較不一致の場合、処理ンーケンスに乱れ
が発生したとしてアドレスサムエラー信号ｉを出力する
。即ち、アドレスサム比較器４は成る処理単位毎にアド
レスサムを比較することになる。また、成る繰り返しサ
イクル毎にアドレスサム比較器４でデータ処理装置１．
２のアドレスサムを比較する場合は、一定時間毎にタ
イムアウト信号を出力するタイマ（図示せず）をデータ
処理装置１，２内に設け、タイマからタイムアウト信号
が出力される毎にアドレスサムレジスタ１５及びデータ
処理袋Ｗ２内のアドレスサムレジスタ（図示せず）にア
ドレスサムをセットするようにすれば良い。
従って、誤りの発生原因がデータのソフトエラー等によ
る一時的な誤りである場合はデータエラー信号りのみが
出力され、処理シーケンスの乱れである場合はアドレス
サム信号ｉが出力される。
る一時的な誤りである場合はデータエラー信号りのみが
出力され、処理シーケンスの乱れである場合はアドレス
サム信号ｉが出力される。
この結果、誤り発注原因に応じた復旧処理を行なうこと
が可能となる。即ち、データエラー信号りのみが出力さ
れた場合は、復旧装置（図示せず）により、データの書
き換えのみを行ない、アドレスサムエラー信号１が出力
された場合はデータ及びプログラムそのものの書き換え
を行ない、その後、処理を再開させる等の誤り原因に応
した復旧処理を行なうことが可能になる。
が可能となる。即ち、データエラー信号りのみが出力さ
れた場合は、復旧装置（図示せず）により、データの書
き換えのみを行ない、アドレスサムエラー信号１が出力
された場合はデータ及びプログラムそのものの書き換え
を行ない、その後、処理を再開させる等の誤り原因に応
した復旧処理を行なうことが可能になる。
以上説明したように、本発明は、各データ処理装置の処
理結果データを比較するデータ比較手段と、各データ処
理装置のアドレスサムを比較するアドレスサム比較手段
とを設けたものであるので、誤りの発生原因がデータの
ソフトエラー等による一時的な誤りにあるのか、処理シ
ーケンスの乱れにあるのかを区別することが可能になる
効果がある。従って、本発明によれば、誤り原因がデー
タの一時的な誤りにある場合はメモリ、バッファ上のデ
ータのみを書き換え、処理シーケンスの乱れにある場合
はメモリ５バツフア上のデータ及びプログラムを書き換
える等、誤り原因に応じた復旧処理を行なうことが可能
となるので、全体として復旧処理の迅速化を図ることが
できる。
理結果データを比較するデータ比較手段と、各データ処
理装置のアドレスサムを比較するアドレスサム比較手段
とを設けたものであるので、誤りの発生原因がデータの
ソフトエラー等による一時的な誤りにあるのか、処理シ
ーケンスの乱れにあるのかを区別することが可能になる
効果がある。従って、本発明によれば、誤り原因がデー
タの一時的な誤りにある場合はメモリ、バッファ上のデ
ータのみを書き換え、処理シーケンスの乱れにある場合
はメモリ５バツフア上のデータ及びプログラムを書き換
える等、誤り原因に応じた復旧処理を行なうことが可能
となるので、全体として復旧処理の迅速化を図ることが
できる。
第１図は本発明の実施例のブロック図である。
図に於いて、１．２・・・データ処理装置、３・・・デ
ータ比較器、４・・・アドレスサム比較器、１１・・・
処理部、１２・・・メモリ、１３・・・入出力装置、１
４・・・アドレス加算器、 ５・・・アドレスサムレジスタ、 ６・・・データバス、 １７・・・アドレスバス。
ータ比較器、４・・・アドレスサム比較器、１１・・・
処理部、１２・・・メモリ、１３・・・入出力装置、１
４・・・アドレス加算器、 ５・・・アドレスサムレジスタ、 ６・・・データバス、 １７・・・アドレスバス。
Claims (1)
- 【特許請求の範囲】 複数のデータ処理装置を有し、各データ処理装置が同一
のプログラムを実行する冗長構成を有するデータ処理シ
ステムに於いて、 前記各データ処理装置のアドレスバスにのるアドレスの
サムを算出するアドレスサム算出手段と、該アドレスサ
ム算出手段で算出した前記各データ処理装置のアドレス
サムを比較するアドレスサム比較手段と、 前記各データ処理装置の処理結果データを比較するデー
タ比較手段とを備えたことを特徴とする暴走検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2261619A JPH04138532A (ja) | 1990-09-28 | 1990-09-28 | 暴走検出回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2261619A JPH04138532A (ja) | 1990-09-28 | 1990-09-28 | 暴走検出回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04138532A true JPH04138532A (ja) | 1992-05-13 |
Family
ID=17364414
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2261619A Pending JPH04138532A (ja) | 1990-09-28 | 1990-09-28 | 暴走検出回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04138532A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2012144043A1 (ja) * | 2011-04-21 | 2012-10-26 | ルネサスエレクトロニクス株式会社 | 半導体集積回路とその動作方法 |
-
1990
- 1990-09-28 JP JP2261619A patent/JPH04138532A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2012144043A1 (ja) * | 2011-04-21 | 2012-10-26 | ルネサスエレクトロニクス株式会社 | 半導体集積回路とその動作方法 |
| JP5693712B2 (ja) * | 2011-04-21 | 2015-04-01 | ルネサスエレクトロニクス株式会社 | 半導体集積回路 |
| US9367438B2 (en) | 2011-04-21 | 2016-06-14 | Renesas Electronics Corporation | Semiconductor integrated circuit and method for operating same |
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