JPH04124710A - 電源装置 - Google Patents
電源装置Info
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- JPH04124710A JPH04124710A JP2243919A JP24391990A JPH04124710A JP H04124710 A JPH04124710 A JP H04124710A JP 2243919 A JP2243919 A JP 2243919A JP 24391990 A JP24391990 A JP 24391990A JP H04124710 A JPH04124710 A JP H04124710A
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- Japan
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- terminal
- transformer
- transistor
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Links
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Landscapes
- Electrostatic Charge, Transfer And Separation In Electrography (AREA)
- Control Or Security For Electrophotography (AREA)
- Control Of Voltage And Current In General (AREA)
- Dc-Dc Converters (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、電子写真方式の複写機、プリンタ等に用いる
高圧発生間の電源装置に関するものである。
高圧発生間の電源装置に関するものである。
従来、電子写真装置において、ＤＣバイアスにＡＣバイ
アスを重畳させた電圧を、静電画像の形成に用いる帯電
や現像に用いていた。そしてその電圧を生成する電源は
、第２図に示す様に、ＤＣバイアスとＡＣバイアスを別
々のトランスにより生成していた。
アスを重畳させた電圧を、静電画像の形成に用いる帯電
や現像に用いていた。そしてその電圧を生成する電源は
、第２図に示す様に、ＤＣバイアスとＡＣバイアスを別
々のトランスにより生成していた。
第２図１おいて、Ｐ Ｗ Ｍ （ｐｕｌｓｅ ｗｉｄｔ
ｈ ｍｏｄｕｌａ−ｔｉｏｎ）回路２０３の出力により
スイッチングするトランジスタＱ２０１は、トランスＴ
２Ｏ２を駆動する。トランスＴ２Ｏ２は、突入電流防止
抵抗Ｒ２０２，平滑コンデンサＣ２０２を介し、不図示
の直流電源に接続される。トランスＴ２Ｏ２の２次巻線
に発生した電圧は、整流ダイオードＤ２０２．コンデン
サＣ２０′３により整流平滑される。その出力電圧は抵
抗Ｒ２Ｏ３，Ｒ２Ｏ５により分圧され抵抗Ｒ２０４によ
りプルアップさオて検出される。検出電圧はＰＷＭ回路
２０３にフィードバックされる。これにより、ＰＷＭ回
属２０３は、 トランスＴ２Ｏ２に発生する出力を気室
圧制御することが可能となる。又出力はトラシスＴ２Ｏ
１の２次巻線の一端に入力される。トランスＴ２Ｏ１は
、発振回路２０１により発生した周波数でトライバ２０
２及びコンデンサＣ２０１を介し駆動される。これによ
りトランスＴ２Ｏ２を含む回路で発生したＤＣバイアス
はトランスＴ２Ｏ１によりＡＣバイアスを重畳し、抵抗
２０１を介し、不図示の負荷へ供給される。
ｈ ｍｏｄｕｌａ−ｔｉｏｎ）回路２０３の出力により
スイッチングするトランジスタＱ２０１は、トランスＴ
２Ｏ２を駆動する。トランスＴ２Ｏ２は、突入電流防止
抵抗Ｒ２０２，平滑コンデンサＣ２０２を介し、不図示
の直流電源に接続される。トランスＴ２Ｏ２の２次巻線
に発生した電圧は、整流ダイオードＤ２０２．コンデン
サＣ２０′３により整流平滑される。その出力電圧は抵
抗Ｒ２Ｏ３，Ｒ２Ｏ５により分圧され抵抗Ｒ２０４によ
りプルアップさオて検出される。検出電圧はＰＷＭ回路
２０３にフィードバックされる。これにより、ＰＷＭ回
属２０３は、 トランスＴ２Ｏ２に発生する出力を気室
圧制御することが可能となる。又出力はトラシスＴ２Ｏ
１の２次巻線の一端に入力される。トランスＴ２Ｏ１は
、発振回路２０１により発生した周波数でトライバ２０
２及びコンデンサＣ２０１を介し駆動される。これによ
りトランスＴ２Ｏ２を含む回路で発生したＤＣバイアス
はトランスＴ２Ｏ１によりＡＣバイアスを重畳し、抵抗
２０１を介し、不図示の負荷へ供給される。
しかしなから、前記従来例では、ＤＣバイアスとＡＣバ
イアスに別々のトランスを用いるため小型化には限界が
あり、又ＡＣバイアスの周波数を下げるとトランスは逆
に大型化になるという問題があった。
イアスに別々のトランスを用いるため小型化には限界が
あり、又ＡＣバイアスの周波数を下げるとトランスは逆
に大型化になるという問題があった。
特に近年、オゾンレス、装置の小型化、高速化を目的と
して、帯電、転写などにコロナ放電を用いずに、ローラ
又はプレートなどによる直接帯電、転写を行う様になっ
た。これらには、ＤＣバイアス、ＡＣバイアスの重畳や
ＤＣで両極性必要な装置もあるので、電源としては、そ
れぞれの出力にトランスを用いたのてはトランスの数が
多くなり、電源ユニットとしては、大型化をまねいてい
た。
して、帯電、転写などにコロナ放電を用いずに、ローラ
又はプレートなどによる直接帯電、転写を行う様になっ
た。これらには、ＤＣバイアス、ＡＣバイアスの重畳や
ＤＣで両極性必要な装置もあるので、電源としては、そ
れぞれの出力にトランスを用いたのてはトランスの数が
多くなり、電源ユニットとしては、大型化をまねいてい
た。
本発明は、このような問題に鑑みてなされたもので、１
個のトランスで、ＤＣで両極性の出力やＤＣとＡＣの重
畳出力を得ることのできる電源装置を提供することを目
的とするものである。
個のトランスで、ＤＣで両極性の出力やＤＣとＡＣの重
畳出力を得ることのできる電源装置を提供することを目
的とするものである。
（課題を解決するための手段）
本発明は、前記目的を達成するため、電源装置をつぎの
（１）、（２）、（３）のとおりに構成するものである
。
（１）、（２）、（３）のとおりに構成するものである
。
（１）トランスと、該トランスの２次巻線の一端と直流
電源の一端に接続される端子との間に接続された制御可
能な第１の整流手段と、前記２次巻線の一端と前記直流
電源の他端に接続される端子との間に接続された、第１
の整流手段とは逆極性の、制御可能な第２の整流手段と
を備えた電源装置。
電源の一端に接続される端子との間に接続された制御可
能な第１の整流手段と、前記２次巻線の一端と前記直流
電源の他端に接続される端子との間に接続された、第１
の整流手段とは逆極性の、制御可能な第２の整流手段と
を備えた電源装置。
（２）前記（１）において、第１の整流手段と第２の整
流手段とを周期的にかつ連動して制御する制御手段を備
えた電源装置。
流手段とを周期的にかつ連動して制御する制御手段を備
えた電源装置。
（３）前記（１）、（２）において、複数の２次巻線と
、該複数の２次巻線の夫々に接続された菓１の整流手段
と、第２の整流手段とを備えた電源装置。
、該複数の２次巻線の夫々に接続された菓１の整流手段
と、第２の整流手段とを備えた電源装置。
前記（１）、（２）、（３）の構成により、両極性の直
流出力が得られ、（２）の構成によれば、更にＤＣとＡ
Ｃを重畳した出力が得られ、（３）の構成によれば、更
に両極性の直流出力及びＤＣとＡＣを重畳した出力、又
は両極性の複数の直流出力かＤＣとＡＣを重畳した複数
の出力が得られる。
流出力が得られ、（２）の構成によれば、更にＤＣとＡ
Ｃを重畳した出力が得られ、（３）の構成によれば、更
に両極性の直流出力及びＤＣとＡＣを重畳した出力、又
は両極性の複数の直流出力かＤＣとＡＣを重畳した複数
の出力が得られる。
以下本発明を実施例により詳しく説明する。
第１図は本発明の第１実施例である、“電源装置”の回
路図である。本実施例は、電圧共振型のスイッチングレ
ギュレータを構成している。フライバックトランスＴ１
０１の１次巻線の一端は、突入電流防止抵抗Ｒ１０１，
平滑コンデンサＣ】０１を介し、不図示の直流電源の一
端即ち正極側に接続されている。又他端は、並列接続さ
れたトランジスタＱ１０３．コンデンサＣｌＯ２゜ダイ
オードＤ１０１を介し接地即ち直流電源の他端に接続さ
れている。トランジスタＱ１０３は、ＰＷＭ回路１０１
の出力によりスイッチングし、トランスＴ１０１を駆動
する。トランスＴｌ０ＩはコンデンサＣｌＯ２と共振し
、効率良く電圧変換を行う。トランスＴ１０１の２次巻
線の一端は、抵抗１０２．ダイオードＤ１０２を介し、
ＮＰＮトランジスタＱ１０４のコレクタに接続され、又
抵抗Ｒ１０３，ダイオードＤ１０３を介し、ＰＮＰ）ラ
ンジスタＱ１０５のコレクタにも接続されている。トラ
ンジスタＱ１０４のエミッタは接地即ち直流電源の他端
に接続され、トランジスタＱ１０５のエミッタは直流電
源の一端にそれぞわ接続されている。ここで、ダイオー
ドＤ１０２．）−ランジスタＱｌ ０４とダイオードＤ
１０３． トランジスタＱ１０５は、夫々制御可能な
整流手段を構成している。
路図である。本実施例は、電圧共振型のスイッチングレ
ギュレータを構成している。フライバックトランスＴ１
０１の１次巻線の一端は、突入電流防止抵抗Ｒ１０１，
平滑コンデンサＣ】０１を介し、不図示の直流電源の一
端即ち正極側に接続されている。又他端は、並列接続さ
れたトランジスタＱ１０３．コンデンサＣｌＯ２゜ダイ
オードＤ１０１を介し接地即ち直流電源の他端に接続さ
れている。トランジスタＱ１０３は、ＰＷＭ回路１０１
の出力によりスイッチングし、トランスＴ１０１を駆動
する。トランスＴｌ０ＩはコンデンサＣｌＯ２と共振し
、効率良く電圧変換を行う。トランスＴ１０１の２次巻
線の一端は、抵抗１０２．ダイオードＤ１０２を介し、
ＮＰＮトランジスタＱ１０４のコレクタに接続され、又
抵抗Ｒ１０３，ダイオードＤ１０３を介し、ＰＮＰ）ラ
ンジスタＱ１０５のコレクタにも接続されている。トラ
ンジスタＱ１０４のエミッタは接地即ち直流電源の他端
に接続され、トランジスタＱ１０５のエミッタは直流電
源の一端にそれぞわ接続されている。ここで、ダイオー
ドＤ１０２．）−ランジスタＱｌ ０４とダイオードＤ
１０３． トランジスタＱ１０５は、夫々制御可能な
整流手段を構成している。
トランスＴ１０１の２次巻線の他端は、コンデンサＣｌ
Ｏ３により平滑され、ショート時の保護のための抵抗Ｒ
１１１，出力端子１００を介し、不図示の負荷に接続さ
れる。ここで、トランジスタＱ１０４かオン、トランジ
スタＱ１０５がオフの場合、出力端子１００には負極性
のバイアスが出力される。この出力を抵抗Ｒ１０９，Ｒ
１１０により分圧し抵抗Ｒ１０８でプルアップした検出
電圧を抵抗Ｒ１０６を介しオペアンプＱ１０１の非反転
入力端へ入力し、オペアンプＱ１０１の出力をトランジ
スタＱ１０４のベースに供給する。
Ｏ３により平滑され、ショート時の保護のための抵抗Ｒ
１１１，出力端子１００を介し、不図示の負荷に接続さ
れる。ここで、トランジスタＱ１０４かオン、トランジ
スタＱ１０５がオフの場合、出力端子１００には負極性
のバイアスが出力される。この出力を抵抗Ｒ１０９，Ｒ
１１０により分圧し抵抗Ｒ１０８でプルアップした検出
電圧を抵抗Ｒ１０６を介しオペアンプＱ１０１の非反転
入力端へ入力し、オペアンプＱ１０１の出力をトランジ
スタＱ１０４のベースに供給する。
これにより、オペアンプＱＩＯＩの反転入力端へ印加さ
れる制御電圧と検出電圧が同じになる様に、トランジス
タＱ１０４はトランスＴ１０１の負極性の出力を制御す
ることが可能となる。
れる制御電圧と検出電圧が同じになる様に、トランジス
タＱ１０４はトランスＴ１０１の負極性の出力を制御す
ることが可能となる。
同様に、トランジスタＱ１０４がオフで、トランジスタ
Ｑ１０５がオンした場合、オペアンプＱ１０２の反転入
力端へ入力される制御電圧によって、トランスＴ１０１
の正極性の出力を制御することが可能となる。これらに
より、トランスＴ１０１の１つの出力端子１００より、
正、負両極性の出力を発生でき、その電圧の制御か可能
となる。このとき、出力の制御範囲は、負極性側はフラ
イバック出力、正極性側はフォワード出力となる。この
ため、負極性側が正極性側より制御範囲が広くなるが、
重畳するＤＣバイアスは片棒性たけなので十分制御範囲
をカバーすることかできる。
Ｑ１０５がオンした場合、オペアンプＱ１０２の反転入
力端へ入力される制御電圧によって、トランスＴ１０１
の正極性の出力を制御することが可能となる。これらに
より、トランスＴ１０１の１つの出力端子１００より、
正、負両極性の出力を発生でき、その電圧の制御か可能
となる。このとき、出力の制御範囲は、負極性側はフラ
イバック出力、正極性側はフォワード出力となる。この
ため、負極性側が正極性側より制御範囲が広くなるが、
重畳するＤＣバイアスは片棒性たけなので十分制御範囲
をカバーすることかできる。
次に、矩形波発振器１０２の出力端は、バイアス抵抗内
蔵トランジスタＱ１０７．Ｑ１０９のへ一スにそわぞれ
接続される。トランジスタＱ１０７のエミッタは接地さ
れ、コレクタはトランジスタＱ１０６のベースに接続さ
れる。トランジスタＱ１０６のエミッタは直流電源の一
端に接続され、コレクタはオペアンプＱ１０１の反転入
力端に接続される。又トランジスタＱ１０９のエミッタ
は接地され、コレクタは抵抗Ｒ１１２に接続されてプル
アップされ、又トランジスタＱ１０８のベースにも接続
される。トランジスタＱ１０８のエミッタは接地され、
コレクタはオペアンプＱ１０２の反転入力端に接続され
る。
蔵トランジスタＱ１０７．Ｑ１０９のへ一スにそわぞれ
接続される。トランジスタＱ１０７のエミッタは接地さ
れ、コレクタはトランジスタＱ１０６のベースに接続さ
れる。トランジスタＱ１０６のエミッタは直流電源の一
端に接続され、コレクタはオペアンプＱ１０１の反転入
力端に接続される。又トランジスタＱ１０９のエミッタ
は接地され、コレクタは抵抗Ｒ１１２に接続されてプル
アップされ、又トランジスタＱ１０８のベースにも接続
される。トランジスタＱ１０８のエミッタは接地され、
コレクタはオペアンプＱ１０２の反転入力端に接続され
る。
ここて、発振器１０２の出力がローレベルの場合、トラ
ンジスタＱｌ ０９はオフするためトランジスタＱ１０
８かオンし、オペアンプＱ１０２の反転入力がＯｖとな
るためオペアンプＱ１０２の出力はハイレベルとなり、
トランジスタＱ１０５はオフし、一方トランジスタＱ１
０７はオフするためトランジスタＱ１０６もオフし、可
変抵抗ＶＲ１０１からの制御人力はそのままオペアンプ
Ｑ１０１の反転入力端に入力され、出力端子１００には
負極性出力が発生する。
ンジスタＱｌ ０９はオフするためトランジスタＱ１０
８かオンし、オペアンプＱ１０２の反転入力がＯｖとな
るためオペアンプＱ１０２の出力はハイレベルとなり、
トランジスタＱ１０５はオフし、一方トランジスタＱ１
０７はオフするためトランジスタＱ１０６もオフし、可
変抵抗ＶＲ１０１からの制御人力はそのままオペアンプ
Ｑ１０１の反転入力端に入力され、出力端子１００には
負極性出力が発生する。
次に、発振器１０２の出力がハイレベルの場合、トラン
ジスタＱ１０７はオンし、トランジスタＱｌ ０６もオ
ンするため、オペアンプＱ１０１の反転入か鴻にはハイ
レベルが入力され、オペアンプＱ１０１の出力はローレ
ベルとなりトランジスタＱ１０４はオフし、一方、トラ
ンジスタＱ１０９はオンするためトランジスタＱ１０８
はオフし、オペアンプＱ１０２の反転入力端には可変抵
抗ＶＲ１０２からの制御入力がそのまま入力され、出力
端子１００には正極性の出力か発生する。
ジスタＱ１０７はオンし、トランジスタＱｌ ０６もオ
ンするため、オペアンプＱ１０１の反転入か鴻にはハイ
レベルが入力され、オペアンプＱ１０１の出力はローレ
ベルとなりトランジスタＱ１０４はオフし、一方、トラ
ンジスタＱ１０９はオンするためトランジスタＱ１０８
はオフし、オペアンプＱ１０２の反転入力端には可変抵
抗ＶＲ１０２からの制御入力がそのまま入力され、出力
端子１００には正極性の出力か発生する。
以上により、発振器１０２の出力により、出力端子１０
０の出力極性が反転するため、発振器１０２か、ＰＷＭ
回路１０１の周波数より十分小さな周波数で発振するこ
とにより、出力端子１００にはＡＣが出力される。この
とき、正のピーク値はオペアンプＱ１０２の反転入力端
へ入力される電圧により制御できるため可変抵抗ＶＲ１
０２により制御電圧を入力し、負のピーク値はオペアン
プＱ１０１の反転入力端へ入力される電圧により制御で
きるため可変抵抗ＶＲＩ Ｏ１により制御電圧を入力し
、これらの可変抵抗ＶＲＩＯＩ、ＶＲ１０２を連動させ
ることにより、あたかもＤＣバイアス分だけ変化してい
る様な制御が可能となる。
０の出力極性が反転するため、発振器１０２か、ＰＷＭ
回路１０１の周波数より十分小さな周波数で発振するこ
とにより、出力端子１００にはＡＣが出力される。この
とき、正のピーク値はオペアンプＱ１０２の反転入力端
へ入力される電圧により制御できるため可変抵抗ＶＲ１
０２により制御電圧を入力し、負のピーク値はオペアン
プＱ１０１の反転入力端へ入力される電圧により制御で
きるため可変抵抗ＶＲＩ Ｏ１により制御電圧を入力し
、これらの可変抵抗ＶＲＩＯＩ、ＶＲ１０２を連動させ
ることにより、あたかもＤＣバイアス分だけ変化してい
る様な制御が可能となる。
このようにして、ＤＣバイアスとＡＣバイアスを重畳し
た出力を発生でき、その電圧の制御が可能となる。
た出力を発生でき、その電圧の制御が可能となる。
第３図は本発明の第２実施例である“電源装置“の回路
図である。本実施例は、本発明を電子写真式の複写機の
電源に適用した例である。第３図において、フライバッ
クトランスＴ３０１は、複数の２次巻線ｎ２〜ｎ６を持
ち、それぞれの負荷に出力を供給する。トランスＴ３０
１の１次巻［１１の一端には、ライン入力をブリッジダ
イオードＤ３０３．コンデンサＣ３０１により整流平滑
した直流電源が供給される６ １次巻線ｎ、の他端は、
パワーＭＯ５ＦＥＴ Ｑ３０５．コンデンサ３０２．
ダイオード３０４を介しコンデンサ３０１の一端に接続
される。ＦＥＴ Ｑ３０５は、ＰＷＭ回路３０１によ
り駆動され、ＰＷＭ回路３０］は、２次＠ｍｎ ２の出
力をダイオード３０５、コンデンサＣ３０３により整流
平滑した出力により電源が供給される。トランスＴ３０
１の２水呑ｍｎｏの出力は、ダイオード’ Ｄ ３０７
。
図である。本実施例は、本発明を電子写真式の複写機の
電源に適用した例である。第３図において、フライバッ
クトランスＴ３０１は、複数の２次巻線ｎ２〜ｎ６を持
ち、それぞれの負荷に出力を供給する。トランスＴ３０
１の１次巻［１１の一端には、ライン入力をブリッジダ
イオードＤ３０３．コンデンサＣ３０１により整流平滑
した直流電源が供給される６ １次巻線ｎ、の他端は、
パワーＭＯ５ＦＥＴ Ｑ３０５．コンデンサ３０２．
ダイオード３０４を介しコンデンサ３０１の一端に接続
される。ＦＥＴ Ｑ３０５は、ＰＷＭ回路３０１によ
り駆動され、ＰＷＭ回路３０］は、２次＠ｍｎ ２の出
力をダイオード３０５、コンデンサＣ３０３により整流
平滑した出力により電源が供給される。トランスＴ３０
１の２水呑ｍｎｏの出力は、ダイオード’ Ｄ ３０７
。
コンデンサＣ３０６により整流平滑され、２４Ｖの出力
となる。この出力を抵抗Ｒ３１０゜Ｒ３１１により分圧
し、その検出電圧をシャントレギュレータＱ３０８のリ
ファレンス入力に接続する。シャントレギュレータＱ３
０８のアノード端子は接地し、カソード端子はフォトカ
ブラＱ３０７の発光ダイオードのカソード端子に接続す
る。フォトカブラＱ３０７の出力はＰＷＭ回路３０１に
入力される。これにより・ ＰＷＭ回路３０１は、抵抗
Ｒ３１０，Ｒ３１１による検出電圧がシャントレギュレ
ータＱ３０８のリファレンス電圧と一致する様にトラン
スＴ３０１の出力を制御する。よって抵抗Ｒ３１０，Ｒ
３１１の所定の分圧比により、２４Ｖ出力が定電圧制御
される。２次巻線ｎ７の出力は、ダイオードＤ３０６、
コンデンサＣ３０４により整流平滑され、５ｖレギユレ
ータ３０３・に入力する。５ｖレギユレータ３０３の出
力は、コンデンサＣ３０５により平滑され、ＣＰＵ３０
２に入力され、ＣＰＵ３０２の電源となる。２次巻線ｎ
８の一端は、原稿露光用のけい光灯ＦＬの一方のフィラ
メントの一端に接続され、このフィラメントの他端は、
ブリッジダイオードＤ３０８の一方の交流端子に接続さ
れる。ブリッジダイオードＤ ３０ Ｂの他方の交流端
子は、ＦＬの他方のフィラメント一端に接続され、同フ
ィラメントの他端はインダクタＬ３０１を介し、２次巻
線ｎ６の他端に接続される。ブリッジダイオードＤ３０
８の十嶋子は、トランジスタＱ３０６のコレクタに接続
され、エミッタ及びブリッジダイオードＤ３０８の一端
子は接地される。トランジスタＱ３０６のベースはＣＰ
Ｕ３０２に接続され制御される。トランジスタＱ３０６
がオンのときは、けい光灯ＦＬのフィラメントに電流が
流れ予熱され、トランジスタＱ３０６がオフすると、け
い光灯ＦＬは放電し点灯する。
となる。この出力を抵抗Ｒ３１０゜Ｒ３１１により分圧
し、その検出電圧をシャントレギュレータＱ３０８のリ
ファレンス入力に接続する。シャントレギュレータＱ３
０８のアノード端子は接地し、カソード端子はフォトカ
ブラＱ３０７の発光ダイオードのカソード端子に接続す
る。フォトカブラＱ３０７の出力はＰＷＭ回路３０１に
入力される。これにより・ ＰＷＭ回路３０１は、抵抗
Ｒ３１０，Ｒ３１１による検出電圧がシャントレギュレ
ータＱ３０８のリファレンス電圧と一致する様にトラン
スＴ３０１の出力を制御する。よって抵抗Ｒ３１０，Ｒ
３１１の所定の分圧比により、２４Ｖ出力が定電圧制御
される。２次巻線ｎ７の出力は、ダイオードＤ３０６、
コンデンサＣ３０４により整流平滑され、５ｖレギユレ
ータ３０３・に入力する。５ｖレギユレータ３０３の出
力は、コンデンサＣ３０５により平滑され、ＣＰＵ３０
２に入力され、ＣＰＵ３０２の電源となる。２次巻線ｎ
８の一端は、原稿露光用のけい光灯ＦＬの一方のフィラ
メントの一端に接続され、このフィラメントの他端は、
ブリッジダイオードＤ３０８の一方の交流端子に接続さ
れる。ブリッジダイオードＤ ３０ Ｂの他方の交流端
子は、ＦＬの他方のフィラメント一端に接続され、同フ
ィラメントの他端はインダクタＬ３０１を介し、２次巻
線ｎ６の他端に接続される。ブリッジダイオードＤ３０
８の十嶋子は、トランジスタＱ３０６のコレクタに接続
され、エミッタ及びブリッジダイオードＤ３０８の一端
子は接地される。トランジスタＱ３０６のベースはＣＰ
Ｕ３０２に接続され制御される。トランジスタＱ３０６
がオンのときは、けい光灯ＦＬのフィラメントに電流が
流れ予熱され、トランジスタＱ３０６がオフすると、け
い光灯ＦＬは放電し点灯する。
トランスＴ３０１の２次巻線ｎ３の出力は、現像バイア
スとなり、制御ブロック３０４により制御される一制御
ブロック３０４の内部構成は、第１実施例と同様であり
、オペアンプＱ３０１゜Ｑ３０２のそれぞれの反転入力
端は、ＣＰＵ３０２に接続され制御される。トランスＴ
３０１の２次巻線ｎ４の出力は、−次帯電出力となり、
制御ブロック３０４と同様の回路である制御ブロック３
０５により制御される。同様に２次巻線ｎｓの出力は、
転写出力となり制御ブロック３０６により制御される。
スとなり、制御ブロック３０４により制御される一制御
ブロック３０４の内部構成は、第１実施例と同様であり
、オペアンプＱ３０１゜Ｑ３０２のそれぞれの反転入力
端は、ＣＰＵ３０２に接続され制御される。トランスＴ
３０１の２次巻線ｎ４の出力は、−次帯電出力となり、
制御ブロック３０４と同様の回路である制御ブロック３
０５により制御される。同様に２次巻線ｎｓの出力は、
転写出力となり制御ブロック３０６により制御される。
現像バイアスは、ＤＣバイアスに矩形波ＡＣバイアスを
重畳したバイアスであるため、バイアスの十の制御値は
オペアンプＱ３０１の反転入力端へ、また−の制御値は
オペアンプＱ３０２の反転入力端へ夫々ＣＰＵ３０２よ
り制御電圧を入力する。又オペアンプＱ３０１．Ｑ３０
２へ交互にオフ信号をＣＰＵ３０２から人力させること
によりＤＣバイアスにＡＣバイアスを重畳した現像バイ
アスとなる。
重畳したバイアスであるため、バイアスの十の制御値は
オペアンプＱ３０１の反転入力端へ、また−の制御値は
オペアンプＱ３０２の反転入力端へ夫々ＣＰＵ３０２よ
り制御電圧を入力する。又オペアンプＱ３０１．Ｑ３０
２へ交互にオフ信号をＣＰＵ３０２から人力させること
によりＤＣバイアスにＡＣバイアスを重畳した現像バイ
アスとなる。
一次帯電は、ＤＣバイアスに、正弦波ＡＣバイアスを重
畳したバイアスである。よって、制御入力は、出力が正
弦波となる様に順次正弦波で変化する制御信号をＣＰＵ
３０２から入力する必要がある。
畳したバイアスである。よって、制御入力は、出力が正
弦波となる様に順次正弦波で変化する制御信号をＣＰＵ
３０２から入力する必要がある。
転写出力は、転写時の負極性出力とクリーニング時の正
極性出力の両極性の出力が必要となる。
極性出力の両極性の出力が必要となる。
よって、それぞわのシーケンス上でＣＰＵ３０２より制
御を行う。
御を行う。
なお１以上の各実施例では、フライバックトランスを用
いているか、本発明はこれに限定されるものではなく、
通常のトランスを用いてもよい。
いているか、本発明はこれに限定されるものではなく、
通常のトランスを用いてもよい。
又、制御可能な整流手段として、ダイオードとトランジ
スタの組合せを用いているが、他の適宜の素子を用いる
ことができる。
スタの組合せを用いているが、他の適宜の素子を用いる
ことができる。
（発明の効果）
以上説明したように、本発明によれば、１個のトランス
を含む回路により、ＤＣで両極性の出力や、ＤＣ，ＡＣ
重畳の出力を得ることができ、又、複数の２次巻線を有
する１個のトランスを含む回路により更に、両極性の直
流出力及びＤＣとＡＣを重畳した出力、又は両極性の複
数の出力かＤＣとＡＣを重畳した複数の出力が得られる
ので、装置を小型化、ローコスト化することができる。
を含む回路により、ＤＣで両極性の出力や、ＤＣ，ＡＣ
重畳の出力を得ることができ、又、複数の２次巻線を有
する１個のトランスを含む回路により更に、両極性の直
流出力及びＤＣとＡＣを重畳した出力、又は両極性の複
数の出力かＤＣとＡＣを重畳した複数の出力が得られる
ので、装置を小型化、ローコスト化することができる。
第１図は本発明の第１実施例の回路図、第２図は従来例
の回路図、第３図は本発明の第２実施例の回路図である
。 Ｔ １０１−・・・−・トランス Ｄ１０２．Ｄ１０３−−・ダイオード
の回路図、第３図は本発明の第２実施例の回路図である
。 Ｔ １０１−・・・−・トランス Ｄ１０２．Ｄ１０３−−・ダイオード
Claims (3)
- （１）トランスと、該トランスの２次巻線の一端と直流
電源の一端に接続される端子との間に接続された制御可
能な第１の整流手段と、前記２次巻線の一端と前記直流
電源の他端に接続される端子との間に接続された、第１
の整流手段とは逆極性の、制御可能な第２の整流手段と
を備えたことを特徴とする電源装置。 - （２）第１の整流手段と第２の整流手段とを周期的にか
つ連動して制御する制御手段を備えたことを特徴とする
請求項１記載の電源装置。 - （３）複数の２次巻線と、該複数の２次巻線の夫々に接
続された第１の整流手段、第２の整流手段とを備えたこ
とを特徴とする請求項１又は請求項２記載の電源装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2243919A JPH04124710A (ja) | 1990-09-17 | 1990-09-17 | 電源装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2243919A JPH04124710A (ja) | 1990-09-17 | 1990-09-17 | 電源装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04124710A true JPH04124710A (ja) | 1992-04-24 |
Family
ID=17110969
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2243919A Pending JPH04124710A (ja) | 1990-09-17 | 1990-09-17 | 電源装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04124710A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE19542392A1 (de) * | 1994-11-18 | 1996-05-30 | Sharp Kk | Hochspannungs-Netzteil |
-
1990
- 1990-09-17 JP JP2243919A patent/JPH04124710A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE19542392A1 (de) * | 1994-11-18 | 1996-05-30 | Sharp Kk | Hochspannungs-Netzteil |
| US5715149A (en) * | 1994-11-18 | 1998-02-03 | Sharp Kabushiki Kaisha | High-voltage power pack |
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