JPH04103224A - 符号誤り検出回路 - Google Patents
符号誤り検出回路Info
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- JPH04103224A JPH04103224A JP2220515A JP22051590A JPH04103224A JP H04103224 A JPH04103224 A JP H04103224A JP 2220515 A JP2220515 A JP 2220515A JP 22051590 A JP22051590 A JP 22051590A JP H04103224 A JPH04103224 A JP H04103224A
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- JP
- Japan
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- signal
- code
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- timing pulse
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- 238000001514 detection method Methods 0.000 claims description 30
- 208000011580 syndromic disease Diseases 0.000 claims description 13
- 230000035945 sensitivity Effects 0.000 abstract description 4
- 238000010586 diagram Methods 0.000 description 6
- 230000000694 effects Effects 0.000 description 2
- 230000005540 biological transmission Effects 0.000 description 1
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L1/00—Arrangements for detecting or preventing errors in the information received
- H04L1/20—Arrangements for detecting or preventing errors in the information received using signal quality detector
Landscapes
- Engineering & Computer Science (AREA)
- Quality & Reliability (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Error Detection And Correction (AREA)
- Detection And Prevention Of Errors In Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
技術分野
本発明は符号誤り検出回路に関し、特にディジタル通信
における誤り訂正符号による符号誤りの検出をなすため
の符号誤り検出回路に関する。
における誤り訂正符号による符号誤りの検出をなすため
の符号誤り検出回路に関する。
従来技術
この種の符号誤り検出回路では、受信データの各１ブロ
ック毎に符号誤りの有無を検出して、予め定められたＭ
ブロック（Ｍは２以上の整数）毎に、符号誤り有りのブ
ロック数をカウントし、このブロック数をＭブロックに
より除算することにより、符号誤り率を算出するように
なっている。
ック毎に符号誤りの有無を検出して、予め定められたＭ
ブロック（Ｍは２以上の整数）毎に、符号誤り有りのブ
ロック数をカウントし、このブロック数をＭブロックに
より除算することにより、符号誤り率を算出するように
なっている。
第４図はこの様な従来の符号誤り検出回路の概略ブロッ
ク図である。送信側では、符号化器１が送信すべきデー
タを入力としてこの送信データの周波数をｆＯからｆｌ
に変換し、冗長ビットを付加することにより誤り訂正符
号化を行って符号化データとして出力する。
ク図である。送信側では、符号化器１が送信すべきデー
タを入力としてこの送信データの周波数をｆＯからｆｌ
に変換し、冗長ビットを付加することにより誤り訂正符
号化を行って符号化データとして出力する。
受信側では、復号化器２が受信された符号化データに対
して誤り訂正演算を行い、訂正後のデータを周波数ｆ１
からｆＯに再変換して元の送信データに復号する。その
ために、この復号化器２は、符号化データを入力として
誤り訂正演算を行ってシンドローム信号１０１と訂正デ
ータとを発生する誤り訂正演算回路２１と、この訂正デ
ータを入力とし、データ周波数をｆｌからｆＯに再変換
して訂正データから冗長ビットを削除することにより復
号化データを発生する速度変換器２２とからなる。
して誤り訂正演算を行い、訂正後のデータを周波数ｆ１
からｆＯに再変換して元の送信データに復号する。その
ために、この復号化器２は、符号化データを入力として
誤り訂正演算を行ってシンドローム信号１０１と訂正デ
ータとを発生する誤り訂正演算回路２１と、この訂正デ
ータを入力とし、データ周波数をｆｌからｆＯに再変換
して訂正データから冗長ビットを削除することにより復
号化データを発生する速度変換器２２とからなる。
誤り訂正演算回路２１からのシンドローム信号１０１は
誤り検出回路４に人力される。この誤り検出回路４はシ
ンドローム信号１０１によりデータの各１ブロック毎に
おける符号誤りの有無を検出して、符号誤りの有無を示
すエラーパルス信号１０６を出力する。
誤り検出回路４に人力される。この誤り検出回路４はシ
ンドローム信号１０１によりデータの各１ブロック毎に
おける符号誤りの有無を検出して、符号誤りの有無を示
すエラーパルス信号１０６を出力する。
すなわち、この誤り検出回路４は１ブロック中に符号誤
りがあれば、エラーパルス信号１０６をオンとし、無け
ればオフとするものである。
りがあれば、エラーパルス信号１０６をオンとし、無け
ればオフとするものである。
誤り率検出回路５は、このエラーパルス信号１０Ｂのオ
ン発生回数を所定ブロック数Ｍだけ計数し、この計数値
をＭにより除算することによって、このデータの符号誤
り率を算出するようになっている。
ン発生回数を所定ブロック数Ｍだけ計数し、この計数値
をＭにより除算することによって、このデータの符号誤
り率を算出するようになっている。
この様な従来の符号誤り検出回路では、エラーパルス信
号ｌＯ６は１ブロック（Ｎビット）中の符号誤りの有無
を示すシンドローム信号１０１により生成されているの
で、ブロック長Ｎが大きくなるに従い、シンドローム発
生確率は大きくなり、その結果エラーパルスの発生確率
も同じ様に大となる。
号ｌＯ６は１ブロック（Ｎビット）中の符号誤りの有無
を示すシンドローム信号１０１により生成されているの
で、ブロック長Ｎが大きくなるに従い、シンドローム発
生確率は大きくなり、その結果エラーパルスの発生確率
も同じ様に大となる。
一方、エラーパルス１０６の発生確率は符号誤り率が良
好な（小さい）領域から悪い（大きい）領域へ移行する
につれて大きくなり、最終的には１００％に収束する。
好な（小さい）領域から悪い（大きい）領域へ移行する
につれて大きくなり、最終的には１００％に収束する。
すなわち、シンドローム発生に関与するブロック長Ｎが
大きい程、より良好な符号誤り率でエラーパルス発生確
率が１００％に達してしまうことになる。従って、エラ
ーパルス信号１０６を用いて符号誤り率を検出する場合
、ブロック長Ｎが大きいと、符号誤り率の悪い領域が検
出できず、検出感度が低下するという欠点がある。
大きい程、より良好な符号誤り率でエラーパルス発生確
率が１００％に達してしまうことになる。従って、エラ
ーパルス信号１０６を用いて符号誤り率を検出する場合
、ブロック長Ｎが大きいと、符号誤り率の悪い領域が検
出できず、検出感度が低下するという欠点がある。
発明の目的
本発明の目的は、符号誤り検出感度を向上可能な符号誤
り検出回路を提供することである。
り検出回路を提供することである。
発明の構成
本発明による符号誤り検出回路は、誤り訂正符号化処理
が施されて送信されたデータを受信して誤り訂正処理を
行ってシンドローム信号を発生する誤り訂正手段と、前
記シンドローム信号から符号誤りが発生した符号位置を
示すエラーロケーション信号を発生する手段と、前記デ
ータの各１ブロック中における符号誤り検出領域を特定
するためのタイミングパルスを発生する手段と、前記タ
イミングパルスの発生期間中における前記エラーロケー
ション信号の発生を検出してエラー発生を示すエラー信
号を発生する手段と、所定ブロック中における前記エラ
ー信号の数に応じて誤り率を算出する手段とを含むこと
を特徴としている。
が施されて送信されたデータを受信して誤り訂正処理を
行ってシンドローム信号を発生する誤り訂正手段と、前
記シンドローム信号から符号誤りが発生した符号位置を
示すエラーロケーション信号を発生する手段と、前記デ
ータの各１ブロック中における符号誤り検出領域を特定
するためのタイミングパルスを発生する手段と、前記タ
イミングパルスの発生期間中における前記エラーロケー
ション信号の発生を検出してエラー発生を示すエラー信
号を発生する手段と、所定ブロック中における前記エラ
ー信号の数に応じて誤り率を算出する手段とを含むこと
を特徴としている。
実施例
以下、図面を参照しつつ本発明の実施例を詳細に説明す
る。
る。
第１図は本発明の実施例の概略ブロック図であり、第４
図と同等部分は同一符号により示している。第４図の従
来例と異なる部分について述べると、タイミングパルス
発生器３が設けられており、このタイミングパルス発生
器３からのタイミングパルス１０２は、データの１ブロ
ック中における符号誤り検出領域を特定するためのパル
スである。
図と同等部分は同一符号により示している。第４図の従
来例と異なる部分について述べると、タイミングパルス
発生器３が設けられており、このタイミングパルス発生
器３からのタイミングパルス１０２は、データの１ブロ
ック中における符号誤り検出領域を特定するためのパル
スである。
誤り検出回路４は、誤り訂正演算回路２１がら発生され
るシンドローム信号１０１により、１ブロック中におい
て誤りが発生した符号位置を示すエラーロケーション信
号（第２．３図の１（１４参照）を発生すると共に、こ
のエラーロケーション信号がタイミングパルス１０２の
存在期間中にアクティブとなっているとき、当該１ブロ
ック中にエラー発生が有ることを表わすエラーパルス１
０３を発生するものである。
るシンドローム信号１０１により、１ブロック中におい
て誤りが発生した符号位置を示すエラーロケーション信
号（第２．３図の１（１４参照）を発生すると共に、こ
のエラーロケーション信号がタイミングパルス１０２の
存在期間中にアクティブとなっているとき、当該１ブロ
ック中にエラー発生が有ることを表わすエラーパルス１
０３を発生するものである。
尚、タイミングパルス１０２の存在期間中にエラーロケ
ーション信号が非アクティブであれば、当該１ブロック
中にエラー発生が無いとみなして、エラーパルス１０３
は発生されないようになっている。
ーション信号が非アクティブであれば、当該１ブロック
中にエラー発生が無いとみなして、エラーパルス１０３
は発生されないようになっている。
第２図は当該誤り検出回路４の具体例を示すブロック図
である。エラーロケーション信号発生回路４１はシンド
ローム信号１０１を受けて、１ブロック中の符号誤り位
置を示すエラーロケーション信号１０４を発生する。
である。エラーロケーション信号発生回路４１はシンド
ローム信号１０１を受けて、１ブロック中の符号誤り位
置を示すエラーロケーション信号１０４を発生する。
２人カアンド回路４２はこのエラーロケーション信号１
０４とタイミングパルス発生器３からのタイミングパル
ス１０２とを入力とし、タイミングパルス１０２の存在
期間中にエラーロケーション信号１０４がアクティブと
なれば、この信号１０４をそのままエラー検出信号１０
５として出力するものである。
０４とタイミングパルス発生器３からのタイミングパル
ス１０２とを入力とし、タイミングパルス１０２の存在
期間中にエラーロケーション信号１０４がアクティブと
なれば、この信号１０４をそのままエラー検出信号１０
５として出力するものである。
ラッチ回路４３はこのエラー検出信号１０５を当該１ブ
ロックの間保持し、当該ブロック中に符号誤りの発生の
有無を示すエラーパルス１０３として導出するものであ
る。
ロックの間保持し、当該ブロック中に符号誤りの発生の
有無を示すエラーパルス１０３として導出するものであ
る。
第３図は第２図の誤り検出回路４の各線信号のタイムチ
ャートを示している。タイミングパルス１０２としては
、１ブロック中のある特定期間だけハイレベルとなるパ
ルスであり、先述した如く、各ブロック中における符号
誤り検出領域を特定するために用いられる。
ャートを示している。タイミングパルス１０２としては
、１ブロック中のある特定期間だけハイレベルとなるパ
ルスであり、先述した如く、各ブロック中における符号
誤り検出領域を特定するために用いられる。
例えば、エラーロケーション信号１０４が第３図に示す
位置に夫々発生されたとすると、図の第１番目のブロッ
クではタイミングパルス１０２の存在期間中にエラーが
発生しており、第２番目のブロックではその期間にはエ
ラーが発生していない。
位置に夫々発生されたとすると、図の第１番目のブロッ
クではタイミングパルス１０２の存在期間中にエラーが
発生しており、第２番目のブロックではその期間にはエ
ラーが発生していない。
そこで、アンドゲート４２の出力であるエラー検出信号
１０５は第３図の如く、第１番目のブロックのみに出現
する。
１０５は第３図の如く、第１番目のブロックのみに出現
する。
ラッチ回路４２はこれをラッチしてそのブロック期間中
保持するので、第１番目のブロックでは、エラーパルス
１０３はハイレベルとなり、エラーの発生を示す状態と
なる。第２番目のブロックでは、エラーパルス１０３は
ローレベルとなり、エラーの発生は無いとみなされる。
保持するので、第１番目のブロックでは、エラーパルス
１０３はハイレベルとなり、エラーの発生を示す状態と
なる。第２番目のブロックでは、エラーパルス１０３は
ローレベルとなり、エラーの発生は無いとみなされる。
誤り率検出回路５では、エラーパルスｒｉ号１０３のハ
イレベルとなった個数をＭブロック毎に計数し、この計
数値をＭで割って符号誤り率を算出するのである。
イレベルとなった個数をＭブロック毎に計数し、この計
数値をＭで割って符号誤り率を算出するのである。
発明の効果
叙上の如く、本発明によれば、符号誤り検出領域を１ブ
ロック長全てではなく、１ブロック長より小なるｎビッ
ト（ｎ＜Ｎ）に限定することにより、エラーパルスの発
生確率が１００％に達する符号誤り率をより悪い位置に
スライドさせることが可能となり、よって符号誤り率が
例えばｌＸ１０−２程度の悪い領域でも、符号誤り率を
検出できるという効果がある。
ロック長全てではなく、１ブロック長より小なるｎビッ
ト（ｎ＜Ｎ）に限定することにより、エラーパルスの発
生確率が１００％に達する符号誤り率をより悪い位置に
スライドさせることが可能となり、よって符号誤り率が
例えばｌＸ１０−２程度の悪い領域でも、符号誤り率を
検出できるという効果がある。
第１図は本発明の実施例のブロック図、第２図は第１図
の誤り検出回路の具体例を示す図、第３図は誤り検出回
路の動作を示すタイムチャート、第４図は従来の誤り検
出回路のブロック図である。 主要部分の符号の説明
の誤り検出回路の具体例を示す図、第３図は誤り検出回
路の動作を示すタイムチャート、第４図は従来の誤り検
出回路のブロック図である。 主要部分の符号の説明
Claims (1)
- （１）誤り訂正符号化処理が施されて送信されたデータ
を受信して誤り訂正処理を行ってシンドローム信号を発
生する誤り訂正手段と、前記シンドローム信号から符号
誤りが発生した符号位置を示すエラーロケーション信号
を発生する手段と、前記データの各１ブロック中におけ
る符号誤り検出領域を特定するためのタイミングパルス
を発生する手段と、前記タイミングパルスの発生期間中
における前記エラーロケーション信号の発生を検出して
エラー発生を示すエラー信号を発生する手段と、所定ブ
ロック中における前記エラー信号の数に応じて誤り率を
算出する手段とを含むことを特徴とする符号誤り検出回
路。
Priority Applications (6)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2220515A JP2621614B2 (ja) | 1990-08-22 | 1990-08-22 | 符号誤り検出回路 |
| EP91113985A EP0472175B1 (en) | 1990-08-22 | 1991-08-21 | Bit error ratio detector |
| DE69128057T DE69128057T2 (de) | 1990-08-22 | 1991-08-21 | Erkennungsgerät für Bitfehlerrate |
| AU82673/91A AU646484B2 (en) | 1990-08-22 | 1991-08-21 | Bit error ratio detector |
| CA002049619A CA2049619C (en) | 1990-08-22 | 1991-08-21 | Bit error ratio detector |
| US07/748,682 US5301197A (en) | 1990-08-22 | 1991-08-22 | Bit error ratio detector |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2220515A JP2621614B2 (ja) | 1990-08-22 | 1990-08-22 | 符号誤り検出回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04103224A true JPH04103224A (ja) | 1992-04-06 |
| JP2621614B2 JP2621614B2 (ja) | 1997-06-18 |
Family
ID=16752230
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2220515A Expired - Lifetime JP2621614B2 (ja) | 1990-08-22 | 1990-08-22 | 符号誤り検出回路 |
Country Status (6)
| Country | Link |
|---|---|
| US (1) | US5301197A (ja) |
| EP (1) | EP0472175B1 (ja) |
| JP (1) | JP2621614B2 (ja) |
| AU (1) | AU646484B2 (ja) |
| CA (1) | CA2049619C (ja) |
| DE (1) | DE69128057T2 (ja) |
Families Citing this family (22)
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| JPH06216655A (ja) * | 1993-01-13 | 1994-08-05 | Nec Corp | 復調回路 |
| FR2700650B1 (fr) * | 1993-01-15 | 1995-02-24 | Sat | Procédé de secours d'une liaison de réseau de télécommunications. |
| US5497383A (en) * | 1993-01-22 | 1996-03-05 | Motorola, Inc. | Error detector circuit for receiver operative to receive discretely-encoded signals |
| US5430743A (en) * | 1993-06-29 | 1995-07-04 | Motorola, Inc. | Method and apparatus for recovering data in a radio communication system |
| FI94810C (fi) * | 1993-10-11 | 1995-10-25 | Nokia Mobile Phones Ltd | Menetelmä huonon GSM-puhekehyksen tunnistamiseksi |
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| JPH08335909A (ja) * | 1995-06-08 | 1996-12-17 | Advantest Corp | 高速光パルス列の信号誤り率測定装置 |
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| KR100234504B1 (ko) * | 1995-09-18 | 1999-12-15 | 포만 제프리 엘 | 선택된 고장에 대한 고장정보를 포착하는 집적회로의 테스트 방법 및 내장된 자기 테스트 장치 |
| US5936972A (en) * | 1997-06-18 | 1999-08-10 | Motorola, Inc. | Syndrome-based channel quality or message structure determiner |
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- 1990-08-22 JP JP2220515A patent/JP2621614B2/ja not_active Expired - Lifetime
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- 1991-08-22 US US07/748,682 patent/US5301197A/en not_active Expired - Lifetime
Patent Citations (1)
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