JPH0362989A - 厚膜回路基板及びその製造方法 - Google Patents

厚膜回路基板及びその製造方法

Info

Publication number
JPH0362989A
JPH0362989A JP19884389A JP19884389A JPH0362989A JP H0362989 A JPH0362989 A JP H0362989A JP 19884389 A JP19884389 A JP 19884389A JP 19884389 A JP19884389 A JP 19884389A JP H0362989 A JPH0362989 A JP H0362989A
Authority
JP
Japan
Prior art keywords
resin
soldering
soldering land
solder resist
land
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP19884389A
Other languages
English (en)
Inventor
Yoshiyuki Tsumita
積田 義之
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Taiyo Yuden Co Ltd
Original Assignee
Taiyo Yuden Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Taiyo Yuden Co Ltd filed Critical Taiyo Yuden Co Ltd
Priority to JP19884389A priority Critical patent/JPH0362989A/ja
Publication of JPH0362989A publication Critical patent/JPH0362989A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/30Assembling printed circuits with electric components, e.g. with resistor
    • H05K3/32Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits
    • H05K3/34Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits by soldering
    • H05K3/3452Solder masks

Landscapes

  • Non-Metallic Protective Coatings For Printed Circuits (AREA)
  • Electric Connection Of Electric Components To Printed Circuits (AREA)
  • Manufacturing Of Printed Wiring (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 3、発明の詳細な説明 [IB、梁上の利用分野] 本発明は、導電ペーストを用いて導体パターンが形成さ
れた厚膜回路基板及びその製造方法に関する。
[従来の技術] アルミナ等の絶縁性セラミックで形成された基板の上に
厚膜法により導体パターンや抵抗膜等を形成して構成さ
れる厚膜回路基板にあっては、比較的低温で焼成される
導電ペーストを用いて導体パターンが形成されたものが
提供されている。例えばこのような導電ペーストとして
は、導体材料として銅を主体としたものが多く使用され
ており、この導電ペーストは、絶縁基板の上にスクリー
ン印刷法で印刷された後、6o o ’c面前後温度で
非酸化雰囲気中で焼付けられる。
このような厚膜回路基板の例が第3図に示されており、
この構成を絶縁基板1の上に厚膜を形成する工程に従っ
て説明する。すなわち、絶縁基板lの上に形成される導
体パターンのうち、゛まず絶縁基板lの上で導体パター
ンが交差する部分で下側となる導体パターン、すなわち
クロス導体層2が印刷、焼付けされる。次に、このクロ
ス導体層2の上に絶縁層であるところのクロスガラス層
4.5が順次印刷、焼付けされ、これと前後して酸化ル
テニウム(RLI02)のペーストにより、抵抗膜6が
印刷、焼付けされる。ここで、クロスガラス層4.5や
抵抗j摸6は、空気中で850℃前後の温度で焼付けら
れるため、その前に印刷、焼付けされるクロス導体rr
!J2は、それらの焼付けの際に影響を受けないように
、それらと同等の条件で焼付けられるAg−Pdペース
トにより形成される。さらに、Cuペーストを用いて半
田付ランド3を含む残りの導体パターン9が印刷、焼付
けされる。最後に、絶縁基板lの上に形成された半田付
ランド3の部分を除いて、紫外線硬化樹脂等により、回
路パターンを覆うように半田レジストアが印刷され、硬
化される。
[発明が解決しようとする課題] しかしながら、銅ペースト等の低温焼成用の導電ペース
トを用いて形成された導体膜は、多孔質であるため、こ
れを覆うように樹脂を塗布し、硬化させて半田レジスト
7を形成するとき、半田レジストアを形成する樹脂成分
が半田付ランド7の中に浸透し、その表面への半田の付
着性が悪くなる。このため、この半田付ランド7の上に
電子部品を搭載して半田付けするときの半田付性が悪く
、半田付不良等のトラブルを生じるといった欠点があっ
た。
本発明は、上記従来の厚膜回路基板とその製造方法にお
ける課題を解消することを目的とする。
[課題を解決するための手段] すなわち、上記目的を達成するため、本発明において採
用した手段の要旨は、絶縁基板lの上に形成された半田
付ランド3を含む回路パターンと、上記半田付ランド3
の部分を除いて回路パターンを覆うように形成された半
田レジスト7とを有するB膜回路基板において、上記半
田付ランド3の上の半田レジスト7寄りに樹脂含有金属
8の層が形成された厚膜回路基板である。
さらに、絶縁基板1の上に半田付ランド3を含む回路パ
ターンを形成する工程と、上記半田付ランド3の部分を
除いて回路パターンを覆うように半田レジスト7を形成
する工程とを打する厚膜回路基板の製造方法において、
上記半田付ランド3の上の半田レジスト7が形成される
位置に寄せて樹脂含有金属8を塗布し、硬化させた後、
上記半田レジスト7を形成する厚膜回路基板の製造方法
である。
[作   用コ 上記厚膜回路基板とその製造方法によれば、田付ランド
3の上の半田レジスト7寄りに樹脂含有金属8が塗布さ
れ、硬化されるため、樹脂含有金属8に含まれる樹脂成
分が半田付ランド3の中に浸透し、その細かい気孔を理
める。このため、導体パターン9の上ζこ半田レジス(
・7を形成するための樹脂を塗布したとき、樹脂成分の
半田付ランド3への浸透が既に半田付ランド3の中に浸
透した上記樹脂により阻止され、その先に浸透しない。
これにより、半田付ランド3の半田付性が維持される。
[実 施 例コ 次に、本発明の実施例についで、具体的に説明する。
第1図と第2図は、アルミナ基板等の絶縁基板lの上に
導電ペーストの印刷、焼付により半田付ランド3を含む
導体パターン9を形成した状態を示している。
ここで本発明では、後で述べる半田レジスト7が形成さ
れる位置に寄せて半田付ランド3の上に、溶解した樹脂
に金属粉末を混合した金属ペーストを塗布し、上記樹脂
成分を硬化させて樹脂含有金属8の層を形成する。この
樹脂含有金属8は、半田レジスト7の縁が導体パターン
9をQJる線と概ね平行に少なくともその全長に亙って
細長く少量塗布し、硬化させるのが望ましい。これは、
塗布される樹脂含有金f18の量が多いと、半田付ラン
ド3に浸透する樹脂の量もそれだけ多くなり、半田付ラ
ンド3の先の方まで樹脂が浸透してしまうおそれがある
からである。また、半田レジスト7の縁が導体パターン
9を切る線と平行にその全長に亙って樹脂含有金属8の
層が形成されることにより、半田レジスト7に含まれる
樹脂の浸透を効果的に阻止できる。
次に、上記半田付ランド3を除いて導体パターン9を覆
うように樹脂を塗布し、これを硬化させて半田レジスト
7を形成する。図示の実施例の場合、半田レジスト7は
、その縁が導体パターン9の先端をその幅方向に切るよ
う形成されており、樹脂含有金B8の層は、上記半田レ
ジスト7の縁と平行に半田付ランド3の半田レジスト7
寄りの縁に沿ってそのほぼ全幅に形成されている。
次に、本発明の具体的な実施例について説明する。
アルミナ基板lの上に銅ペーストを印刷し、焼付けて、
1.5X1.5mmの半田付ランド3と、この−辺の中
央に一体に連続する幅0゜5mmのライン状の導体パタ
ーン9を有する導体膜を形成した。これら導体パターン
の膜厚は15μmであった。次に、上記半田付ランド3
の導体パターン9が連続した一辺に沿って銅ペーストを
塗布し、これを150°Cの温度で10分間加熱し、幅
約0. 1mmt  膜厚15μmの樹脂含有銅8の層
を形成した。
次に、上記半田付ランド3を除いて導体パターン9を覆
うように紫外線硬化性樹脂ペーストを塗布し、これに紫
外線を照射させることにより硬化させ、V厚20μmの
半田レジスト7を形成した。
そして、上記半田付ランド3の上にロジン系フラックス
を塗布し、Sn、!−Pbが6:4の半田を230 ’
Cで溶廂させた半田槽に浸漬し、半田濡性を調べた。そ
の結果、半田付ランド3の全面積に対する半田濡部の面
積が90%に達しないものは、半田付ランド500個所
中3個所であった。
また、これと比較するため、樹脂含有銅8を形成しない
こと以外は、上記と同様に厚膜回路基板を作り、これに
ついても上記と同様に半田濡試験を行なった。その結果
、半田付ランド3の全面fi′tに対する半田濡部の面
積が90%に達しないものは、半田付ランド500個所
中55個所あった。
[発明の効果コ 以上説明した通り、本発明によれば、絶縁基板上に形成
された半田付ランド3.3の半田付性の良い厚膜回路基
板が捉供することができ、半田付不良の低減が図れると
いう効果が得られる。
【図面の簡単な説明】
第1図は、本発明の実施例を示す厚膜回路基板の要部斜
視図、第2図は同厚膜回路基板の要部断面図、第3図は
、厚膜回路基板の従来例を示す要部斜視図である。 ■・・・絶縁基板 3・・・半田付ランド 7・・・半
田レジスト 8・・・樹脂含有金属

Claims (2)

    【特許請求の範囲】
  1. (1)絶縁基板1の上に形成された半田付ランド3を含
    む回路パターンと、上記半田付ランド3の部分を除いて
    回路パターンを覆うように形成された半田レジスト7と
    を有する厚膜回路基板において、上記半田付ランド3の
    上の半田レジスト7寄りに樹脂含有金属8の層が形成さ
    れたことを特徴とする厚膜回路基板。
  2. (2)絶縁基板1の上に半田付ランド3を含む回路パタ
    ーンを形成する工程と、上記半田付ランド3の部分を除
    いて回路パターンを覆うように半田レジスト7を形成す
    る工程とを有する厚膜回路基板の製造方法において、上
    記半田付ランド3の上の半田レジスト7が形成される位
    置に寄せて樹脂含有金属8を塗布し、硬化させた後、上
    記半田レジスト7を形成することを特徴とする厚膜回路
    基板の製造方法。
JP19884389A 1989-07-31 1989-07-31 厚膜回路基板及びその製造方法 Pending JPH0362989A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP19884389A JPH0362989A (ja) 1989-07-31 1989-07-31 厚膜回路基板及びその製造方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP19884389A JPH0362989A (ja) 1989-07-31 1989-07-31 厚膜回路基板及びその製造方法

Publications (1)

Publication Number Publication Date
JPH0362989A true JPH0362989A (ja) 1991-03-19

Family

ID=16397841

Family Applications (1)

Application Number Title Priority Date Filing Date
JP19884389A Pending JPH0362989A (ja) 1989-07-31 1989-07-31 厚膜回路基板及びその製造方法

Country Status (1)

Country Link
JP (1) JPH0362989A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2011124324A (ja) * 2009-12-09 2011-06-23 Mitsubishi Electric Corp プリント配線板、電子回路装置および電子回路装置の製造方法
JP2019080063A (ja) * 2017-10-24 2019-05-23 啓耀光電股▲分▼有限公司 電子装置及びその製造方法

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2011124324A (ja) * 2009-12-09 2011-06-23 Mitsubishi Electric Corp プリント配線板、電子回路装置および電子回路装置の製造方法
JP2019080063A (ja) * 2017-10-24 2019-05-23 啓耀光電股▲分▼有限公司 電子装置及びその製造方法

Similar Documents

Publication Publication Date Title
JP3780386B2 (ja) セラミック回路基板及びその製造方法
US6023217A (en) Resistor and its manufacturing method
EP0016925B1 (de) Verfahren zum Aufbringen von Metall auf Metallmuster auf dielektrischen Substraten
JPH0362989A (ja) 厚膜回路基板及びその製造方法
JPH0553284B2 (ja)
DE3328342C3 (de) Verfahren zum Einlöten von Chipbauelementen auf Leiterplatten
US4694568A (en) Method of manufacturing chip resistors with edge around terminations
JPH01109702A (ja) チップ抵抗器とその製造方法
JPH08236325A (ja) チップ抵抗器の製造方法
JPH07326835A (ja) 低温焼成セラミック回路基板
JPS58190013A (ja) チツプ部品およびチツプ部品のはんだ付け方法
JP2886945B2 (ja) 配線基板
JPH03274791A (ja) 印刷厚膜多層回路基板
JP3905355B2 (ja) チップ部品の実装方法
JP2775718B2 (ja) チップ抵抗器とその製造方法
JPH01140695A (ja) 電子回路部品の製造方法
JPS58130590A (ja) セラミツク配線基板および該セラミツク配線基板を用いた厚膜ハイブリツドic
JP2866808B2 (ja) チップ抵抗器の製造方法
JP3323156B2 (ja) チップ抵抗器
JPH07211504A (ja) 表面実装型電子部品の端子電極とその製造方法
JPH05243073A (ja) チップ状電子部品及びその端子電極形成方法
DE2518969B1 (de) Leiterbahn und kontaktflaeche fuer duennschichtschaltungen
JPH02265201A (ja) チップ部品
JPH0434992A (ja) プリント配線板の製造方法
JPS59161896A (ja) セラミツク基板