JPH0354330U - - Google Patents

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JPH0354330U
JPH0354330U JP11602789U JP11602789U JPH0354330U JP H0354330 U JPH0354330 U JP H0354330U JP 11602789 U JP11602789 U JP 11602789U JP 11602789 U JP11602789 U JP 11602789U JP H0354330 U JPH0354330 U JP H0354330U
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【図面の簡単な説明】
第１図は本考案の一実施例の回路図、第２図は
従来の一例の回路図、第３図は本考案の一実施例
及び従来の一例の動作を説明するための波形図で
ある。 １…集積回路（ＩＣ）、Ｒ１…保護・分圧用抵
抗、Ｒ２…分圧・放電用抵抗、Ｒ３…充・放電用
抵抗、Ｃ１…時定数用コンデンサ、Ｄ１…電圧ク
リツプ用ダイオード、Ｄ２…レベルシフト用ダイ
オード、ＺＤ１…低レベル入力キヤンセル用ツエ
ナーダイオード。

Claims (1)

  1. 【実用新案登録請求の範囲】 入力パルス信号のレベルを電源の電圧によつて
    入力可能な上限レベルが決まる回路に該上限レベ
    ル内になるように変換して入力するパルス入力回
    路において、 前記入力パルス信号の供給ラインに直列に接続
    され、前記入力パルス信号のレベルに応じてオン
    ・オフし、前記入力パルス信号のレベルが前記上
    限レベル以下の一定レベル以下となつたときにオ
    フとなり前記入力パルス信号の供給を停止する第
    １のスイツチング素子と、 前記入力パルス信号の供給ラインと前記電源と
    の間に設けられ前記電源電圧によりバイアスされ
    、前記入力パルス信号のレベルに応じてオン・オ
    フし、前記入力パルス信号のレベルが前記電源の
    電圧以上となつたときにオンとなり前記入力パル
    ス信号の供給ラインと前記電源とを接続して前記
    入力パルス信号のレベルを前記電源の電圧以下に
    制限することにより前記回路に入力可能な上限レ
    ベル以下に制限する第２のスイツチング素子とを
    具備し、前記第１及び第２のスイツチング素子に
    より前記入力パルス信号を前記入力パルス信号が
    供給される回路の入力範囲に適応させる構成とし
    てなるパルス入力回路。
JP11602789U 1989-10-02 1989-10-02 パルス入力回路 Expired - Fee Related JPH0729710Y2 (ja)

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WO2001052644A1 (fr) * 2000-01-20 2001-07-26 Kantaro Yamamoto Oeil de tete de mouche flottant

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