JPH0352396A - 通話路試験方式 - Google Patents
通話路試験方式Info
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- JPH0352396A JPH0352396A JP18775089A JP18775089A JPH0352396A JP H0352396 A JPH0352396 A JP H0352396A JP 18775089 A JP18775089 A JP 18775089A JP 18775089 A JP18775089 A JP 18775089A JP H0352396 A JPH0352396 A JP H0352396A
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- Japan
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- circuit
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- 238000004891 communication Methods 0.000 claims description 11
- 238000010998 test method Methods 0.000 claims description 8
- 238000003780 insertion Methods 0.000 abstract description 6
- 230000037431 insertion Effects 0.000 abstract description 6
- 230000005540 biological transmission Effects 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 238000006243 chemical reaction Methods 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
Landscapes
- Monitoring And Testing Of Exchanges (AREA)
- Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はディジタル時分割スイッチ網に加入者回路及び
トランク回路を収容する自動交換機内の通話路の正常性
を検証する通話路試験方式に関する。
トランク回路を収容する自動交換機内の通話路の正常性
を検証する通話路試験方式に関する。
従来、この種の通話路試験方式は、第２図に示すように
、通話試験回路ｌＯと、試験データを通話路に入力する
データ挿入回路６０と、通話路から試験データを取υ出
すデータ分岐回路７ｏとを設け、通話試験回路１０から
出力しデータ挿入回路６０を介してディジタル時分割ス
イッチ網３ｏの受信端に入力される試験データと、ディ
ジタル時分割スイッチ網３０の送信端から出力されデー
タ分岐回ｗ１７ ０ｔ−介して通話試験回略１０に入力
される試験データとを比較し、試験対象通話路の正常性
を検証する構成であった。
、通話試験回路ｌＯと、試験データを通話路に入力する
データ挿入回路６０と、通話路から試験データを取υ出
すデータ分岐回路７ｏとを設け、通話試験回路１０から
出力しデータ挿入回路６０を介してディジタル時分割ス
イッチ網３ｏの受信端に入力される試験データと、ディ
ジタル時分割スイッチ網３０の送信端から出力されデー
タ分岐回ｗ１７ ０ｔ−介して通話試験回略１０に入力
される試験データとを比較し、試験対象通話路の正常性
を検証する構成であった。
上述した従来の通話路試験方式は各加入者回路毎に試験
データを入力するデータ挿入回路と、試験データを取り
出すデータ分岐回路と、通話試験回路とデータ挿入回路
及びデータ分岐回路とを接続する信号線を設ける構成と
なっているので、構成が複雑となり、信号線を多数配線
しなければならないという欠点がある。
データを入力するデータ挿入回路と、試験データを取り
出すデータ分岐回路と、通話試験回路とデータ挿入回路
及びデータ分岐回路とを接続する信号線を設ける構成と
なっているので、構成が複雑となり、信号線を多数配線
しなければならないという欠点がある。
本発明の通話路試験方式はディジタル時分割スイッチ網
に加入者回路及びトランク回路を収容する自動交換機に
かいて、前記ディジタル時分割スイッチ網の受信端に試
験データを出力し送信端から入力される試験データと比
較して前記加入者回路又は前記トランク回路との間で設
定される試験対象通話路の正常性を検証する通話試験回
路と、前記加入者回路及び前記トランク回路内に設けら
れ前記ディジタル時分割スイッチ網の送信端から入力さ
れるデータを折り返して受信端に出力するルーブバ，ク
回路とを備える。
に加入者回路及びトランク回路を収容する自動交換機に
かいて、前記ディジタル時分割スイッチ網の受信端に試
験データを出力し送信端から入力される試験データと比
較して前記加入者回路又は前記トランク回路との間で設
定される試験対象通話路の正常性を検証する通話試験回
路と、前記加入者回路及び前記トランク回路内に設けら
れ前記ディジタル時分割スイッチ網の送信端から入力さ
れるデータを折り返して受信端に出力するルーブバ，ク
回路とを備える。
次に、本発明について図面を参照して説明する。
本発明の一実施例を示す第１図を参照すると、通話試験
回路１０はハイウェイ３３ ．３４を介してディジタル
時分割スイッチ網３０に収容され、ディジタル時分割ス
イノチ網３０に対して試験データを送出し、ディジタル
時分割スイッチ網３０からのデータを受信して送出試験
データと受信データとを比較する。加入者回路２０はノ
・イウェイ３１．３２を介してディジタル時分割スイッ
チ網３０に収容され、端末５０とディジタル時分割スイ
ッチ網３０とをインターフェースする。また、加入者回
路２０内のループバック回路２２はディジタル時分割ス
イッチ網３０からのデータを折り返し、ディジタル時分
割スイッチ網３０に出力する。ディジタル時分割スイッ
チ網３０ｒｔ各加入者回路相互又は加入者回路と通話試
験回路ｌＯとの間の通話路を形成する。試験状態にかい
て、制御回路（ＣＰＵ）４０ばＣＰＵバス４１を介して
ディジタル時分割スイッチ網３０を制御し、試験対象加
入者回路２０と通話試験回路ｌＯとの間の通話路（ハイ
ウェイ３ｌと３４との間の通話路及びハイウェイ３３と
３２との間の通話Ｍ）を形成する。更に、ＣＰＵ４ ０
はＣＰＵバス４ｌを介して試験対象加入者回路２０内の
ループバ，ク回路２２を制御し、ハイウェイ３２からハ
イウェイ３ｌへ折り返す通話路を形或する。通話試験回
路１０は試験データを試験データ送信部ｌ１から／％イ
ウエイ３３に送出する。送出された試験データはＣＰＵ
４０の制御により形成された通話路を通ってノ１イウェ
イ３４に出力され、試験データ受信部１２で受信される
。通話試験回路ｌＯは試験データ送信部１ｌから送出す
る試験データと、試験データ受信部ｌ２で受信するデー
タとをデータ比較部ｌ３で比較し、試験対象通話路の正
常性を検証する。
回路１０はハイウェイ３３ ．３４を介してディジタル
時分割スイッチ網３０に収容され、ディジタル時分割ス
イノチ網３０に対して試験データを送出し、ディジタル
時分割スイッチ網３０からのデータを受信して送出試験
データと受信データとを比較する。加入者回路２０はノ
・イウェイ３１．３２を介してディジタル時分割スイッ
チ網３０に収容され、端末５０とディジタル時分割スイ
ッチ網３０とをインターフェースする。また、加入者回
路２０内のループバック回路２２はディジタル時分割ス
イッチ網３０からのデータを折り返し、ディジタル時分
割スイッチ網３０に出力する。ディジタル時分割スイッ
チ網３０ｒｔ各加入者回路相互又は加入者回路と通話試
験回路ｌＯとの間の通話路を形成する。試験状態にかい
て、制御回路（ＣＰＵ）４０ばＣＰＵバス４１を介して
ディジタル時分割スイッチ網３０を制御し、試験対象加
入者回路２０と通話試験回路ｌＯとの間の通話路（ハイ
ウェイ３ｌと３４との間の通話路及びハイウェイ３３と
３２との間の通話Ｍ）を形成する。更に、ＣＰＵ４ ０
はＣＰＵバス４ｌを介して試験対象加入者回路２０内の
ループバ，ク回路２２を制御し、ハイウェイ３２からハ
イウェイ３ｌへ折り返す通話路を形或する。通話試験回
路１０は試験データを試験データ送信部ｌ１から／％イ
ウエイ３３に送出する。送出された試験データはＣＰＵ
４０の制御により形成された通話路を通ってノ１イウェ
イ３４に出力され、試験データ受信部１２で受信される
。通話試験回路ｌＯは試験データ送信部１ｌから送出す
る試験データと、試験データ受信部ｌ２で受信するデー
タとをデータ比較部ｌ３で比較し、試験対象通話路の正
常性を検証する。
以上説明したように本発明によれば、ディジタル時分割
スイッチ網に加入者回路及びトランク回路を収容する自
動交換機にかいて、ディジタル時分割スイッチ網の受信
端に試験データを出力し送信端から入力される試験デー
タと比較して加入者回路又はトランク回路との間で設定
される試験対象通話路の正常性を検証する通話試験回路
と、加入者回路及びトランク回路内に設けられディジタ
ル時分割スイッチ網の送信端から入力されるデータを折
り返して受信端に出力するループバック回路とを有する
ことにより、従来の通話路試験方式のように各加入者回
路毎に試験データを入力するデータ挿入回路と、試験デ
ータを取り出すデータ分岐回路と、通話試験回路とデー
タ挿入回路及びデータ分岐回路とを接続する信号巌を設
ける必要が無くなり、単純な回路構成で通話路試験を行
なうことができる。
スイッチ網に加入者回路及びトランク回路を収容する自
動交換機にかいて、ディジタル時分割スイッチ網の受信
端に試験データを出力し送信端から入力される試験デー
タと比較して加入者回路又はトランク回路との間で設定
される試験対象通話路の正常性を検証する通話試験回路
と、加入者回路及びトランク回路内に設けられディジタ
ル時分割スイッチ網の送信端から入力されるデータを折
り返して受信端に出力するループバック回路とを有する
ことにより、従来の通話路試験方式のように各加入者回
路毎に試験データを入力するデータ挿入回路と、試験デ
ータを取り出すデータ分岐回路と、通話試験回路とデー
タ挿入回路及びデータ分岐回路とを接続する信号巌を設
ける必要が無くなり、単純な回路構成で通話路試験を行
なうことができる。
第１図は本発明の通話路試験方式の一実施例を示す構成
図、第２図は従来の通話踊試験方式の一例を示す構成図
である。 ｌＯ・・・・・・通話試験回路、１１・・・・・・試験
データ送信部、１２・・・・・・試験データ受信部、ｌ
３・・・・・・データ比較部、２０・・・・・・加入者
回略、２１・・・・・・アナログ・ディジタル（Ａ−Ｄ
）変換回路、２２・・・・・・ループバック回路、３０
・・・・・・ディジタル時分割スイッチ網、３１〜３４
・・・・・・ノ１イウェイ、４０・・・・・・制御回路
、 ４ｌ・・・・・・ＣＰＵバス、 ５０・・・・・・端末、 ５１ ・・・・・・加入者線路。
図、第２図は従来の通話踊試験方式の一例を示す構成図
である。 ｌＯ・・・・・・通話試験回路、１１・・・・・・試験
データ送信部、１２・・・・・・試験データ受信部、ｌ
３・・・・・・データ比較部、２０・・・・・・加入者
回略、２１・・・・・・アナログ・ディジタル（Ａ−Ｄ
）変換回路、２２・・・・・・ループバック回路、３０
・・・・・・ディジタル時分割スイッチ網、３１〜３４
・・・・・・ノ１イウェイ、４０・・・・・・制御回路
、 ４ｌ・・・・・・ＣＰＵバス、 ５０・・・・・・端末、 ５１ ・・・・・・加入者線路。
Claims (1)
- ディジタル時分割スイッチ網に加入者回路及びトランク
回路を収容する自動交換機において、前記ディジタル時
分割スイッチ網の受信端に試験データを出力し送信端か
ら入力される試験データと比較して前記加入者回路又は
前記トランク回路との間で設定される試験対象通話路の
正常性を検証する通話試験回路と、前記加入者回路及び
前記トランク回路内に設けられ前記ディジタル時分割ス
イッチ網の送信端から入力されるデータを折り返して受
信端に出力するループバック回路とを備えることを特徴
とする通話路試験方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18775089A JPH0352396A (ja) | 1989-07-19 | 1989-07-19 | 通話路試験方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18775089A JPH0352396A (ja) | 1989-07-19 | 1989-07-19 | 通話路試験方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0352396A true JPH0352396A (ja) | 1991-03-06 |
Family
ID=16211547
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18775089A Pending JPH0352396A (ja) | 1989-07-19 | 1989-07-19 | 通話路試験方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0352396A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5712856A (en) * | 1995-04-10 | 1998-01-27 | International Business Machines Corporation | Method and apparatus for testing links between network switches |
| JP2007138716A (ja) * | 2005-11-14 | 2007-06-07 | Ebara Corp | ポンプおよびその軸封装置 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4826405A (ja) * | 1971-08-11 | 1973-04-07 | ||
| JPS63263871A (ja) * | 1987-04-21 | 1988-10-31 | Nec Corp | ハイウエイ導通試験方式 |
-
1989
- 1989-07-19 JP JP18775089A patent/JPH0352396A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4826405A (ja) * | 1971-08-11 | 1973-04-07 | ||
| JPS63263871A (ja) * | 1987-04-21 | 1988-10-31 | Nec Corp | ハイウエイ導通試験方式 |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5712856A (en) * | 1995-04-10 | 1998-01-27 | International Business Machines Corporation | Method and apparatus for testing links between network switches |
| JP2007138716A (ja) * | 2005-11-14 | 2007-06-07 | Ebara Corp | ポンプおよびその軸封装置 |
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