JPH0341848A - 通信制御装置 - Google Patents

通信制御装置

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Publication number
JPH0341848A
JPH0341848A JP1175561A JP17556189A JPH0341848A JP H0341848 A JPH0341848 A JP H0341848A JP 1175561 A JP1175561 A JP 1175561A JP 17556189 A JP17556189 A JP 17556189A JP H0341848 A JPH0341848 A JP H0341848A
Authority
JP
Japan
Prior art keywords
frame
transmission
communication
memory
lan
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP1175561A
Other languages
English (en)
Inventor
Makoto Maeda
真 前田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Toshiba Corp
Original Assignee
Toshiba Corp
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Filing date
Publication date
Application filed by Toshiba Corp filed Critical Toshiba Corp
Priority to JP1175561A priority Critical patent/JPH0341848A/ja
Publication of JPH0341848A publication Critical patent/JPH0341848A/ja
Pending legal-status Critical Current

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  • Detection And Prevention Of Errors In Transmission (AREA)
  • Maintenance And Management Of Digital Transmission (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [発明の目的] (産業上の利用分野) この発明は、LAN (ローカル■リアネットワーク〉
等の通信網相互間のデータ通信を制!iIlする通信制
御装置に関し、特に通信制御装置内においてエラーが発
生した場合、通信網上への通信データの送信を中断する
よう制御する通信制御装置に関する。
〈従来の技#1) 任意のり、 A N上に接続されているノードから他の
LAN上に接続されているノードへデータを送信する場
合には、これらのLANの間に設けられたブリッジ(通
信制tII装N)を介して行っている。
このブリッジは、LSIされたインタフェース部やコン
トロール部、メモリ、及びこれらを接続するローカルバ
スから構成されている。
第2図は、従来のブリッジの構成例を示すブロック図で
ある。
LAN1.2にはそれぞれインタフェース部3゜5、及
びコントロール部7.9が接続されている。
さらに、コントロール部7.9には、ローカルバス11
を介してメモリ13が接続されている。
LANI上に接続されているノードからLAN2上に接
続されているノードへデータを送信する場合には、まず
、インタフェース部3がL A N 1より情報の転送
単位となるフレームを取り込み、コントロール部7ヘフ
レームを転送する。フレームを受信したコントロール部
7は、このフレーム中の通信データのみをローカルバス
11を介しくメモリ13へ1き込む。
次に、コントロール部9tよ、メモリ13に書き込まれ
たデータを送信データと認識し、[1−カルパス11を
介して読み込む。さらに、コントロール部9は、読み込
んだデータにCRC(冗長麿符号チエツク)を行うため
の情報を付加しく以後、CRCを生成という・。)、再
びフレームを生成してインタフェース部5へ転送してい
る。生成されたフレームを受信したインタフェース部5
は、このフレームをLAN2上へ送信する。この結果、
LAN2上に接続されているノードは、このフレームに
CRCが生成されているため正常フレームとして受信す
る。
(発明が解決しようとする課題〉 しかしながら、このような従来のブリッジにおいては、
メモリ13においてエラーが発生した場合で5データを
読み込んだコントロール部9ば。
エラーを含んだデータに対して通常どおり、CRCを生
成してしまう。このため、このフレームがLAN2上へ
送信されると、LAN21に接続されているノードは、
エラーデータを含んでいるフレームを千常ル−ムと誤認
して受信してしまう。
そこで、この発明は、従来の事情に鑑みてなされたもの
であり、その目的とするところは、エラーデータを含ん
だフレームのLAN上への送信を中断し、異常フレーム
とすることによってノードにJ5けるJ aしlこ受信
を防ぐことができる通信モ11′gB装置を提供するこ
とにある。
[発明の構成1 (課題を解決するための手段) この目的を解決するために、この発明は、通信制御装閤
内で発生するエラーを検出してエラ発生信号を出力する
検出手段と、この検出手段より出力されたエラー発生信
号を受信し、他の通信網上への通信データの送信を中断
する中断手段とから構成されている。
(作用) 上記構成において、この発明は、通信制御iIl装置内
で発生するエラーを検出し、さらにこの時、通信網間に
おける通信データの送信が実行中であればこの送信を中
断する。これにより、異常フレームとして通信網上へ送
信するようにしている。
(実施例) 以下、図面を用いてこの発明の詳細な説明する。
第1図はこの発明の一実施例に係るブリッジ(通信f!
ill 1111装置〉の構成を示すブロック図である
同図におけるブリッジ1は、第2図に示す従来のブリッ
ジの構成に加え、メモリエラー検出部15及び送信コン
トロール部17を付加して構成されている。
このブリッジ1は、メモリ13より発生したエラーをメ
モリエラー検出部15によって検出し、送信コントロー
ル部17によってフレームの1AN1あるいはLAN2
七への送信を中断するようインタフェース部3あるいは
5へ指示するようになされている。
インタフェース部3,5は、IANI、2Fを伝送する
ル−ムを取り込んでコントロール部7゜9へ転送したり
、あるいは、コン[・ロール部7゜9より転送されるフ
レームを受信してり、 A N 1 。
2上l\送信するものである。
また、インタフェース部3.5は、l−A N ’I 
2上へのフレームの送信を継続あるいは中止する送信イ
ネーブル/ディセーブル機能を備えている。
コントロール部7.9は、インタフェース部3゜5より
転送されるフレームを受信し、このフレーム中の通信デ
ータのみをローカルバス11を介しでメ七り13へ調き
込む。あるいは、メモリ13に;Llき込まれているデ
ータを読み込み、CRCの生成を行ないフレームを生成
してインタフェース部3,5へ転送するものである。
メモリ13は、コントロール部7,9によって困き込ま
れたデータや送受信が完了したことを示づ情報等を格納
するところである。
メモリエラー検出部15は、メモリ13の状態を監視し
、メモリ13がエラーを発生するとこのエラーを検出す
るものである。また、メモリ1ラ一検出部15は、メモ
リ13がエラーを発生するとこれを検出し、メモリエラ
ー発生信号101を送信コントロール部17へ出力する
送信コントロール部17は、メモリエラー検出部15よ
り出ツノされるメモリエラー発生信号101と、ローカ
ルバス11上に伝送されるコントロール部7,9の状態
を示すステータス信号103とを取り込む。そして、送
信コントロール部17は、ステータス信号103及びメ
モリエラー発生信号101の内容によってインタフェー
ス部3゜5からLAN1.2上へのフレームの送信を中
断するか否かの判定を行うところである。
さらに、送信:」ント「]−ル部17は、フレームの送
信を中断ずべきであると判定すると、インタフェース部
3.5に対し、送信を中断するよう送信ディセーブル信
号105,107を出力する。
このように、この発明の一実施例は構成されており、次
に、この実施例において、L A N l上に接続され
ているノードからLAN 2上に接続されているノード
へデータを送信する場合の作用を説明する。
L A N l上に接続されているノードよりl−A 
N1」ニヘフレームが送出されると、このフレームはイ
ンタフェース部3によって取り込まれる。さらに、この
フレームはインタフェース部3によってコントロール部
7へ転送される。フレームを受信したコントロール部7
は、このフレーム中の通信データのみをローカルバス1
1を介してメモリ13へ訳き込む。
通信データがメモリ13へよき込まれ、格納されると、
次に、コントロール部9によってこのデータは送信デー
タと認識され、ローカルバス11を介して読み込まれる
これにより、ローカルバス11」二には、コントロール
部7と9の間で送信が実行中であるという旨のステータ
ス信号103が伝送される。
コントロール部9に読み込まれたデータは、コントロー
ル部9によってCRCの生成が行われ、フレームが生成
される。さらに、CRCが生成されたフレームは、イン
タフェース部5へ転送され、インタフェース部5よりL
 A N 2上へ送信される。
方、メモリ13においてエラーが発生すると、このエラ
ーがメモリエラー検出部15によって検出される。エラ
ーを検出したメモリエラー検出部15からは、メモリエ
ラー発生信号101が送信コントロール部17へ出力さ
れる。
またこの時、ローカルバス11上に伝送されているコン
トロール部7と9の間が送信中である旨のステータス信
号103が送信コントロール部17によって取り込まれ
る。
メモリエラー検出部15より出力されるメモリエラー発
生信号101と、ローカルバス11上を伝送されるステ
ータス信号103とを取り込んだ送信コントロール部1
7でG、!、フレームのし−AN2上への送信を中断す
べきであると判定される。
この判定の結果、送信コントロール部17より送信ディ
セーブル信号107がインタフェース部5へ出力される
そして、送信ディセーブル信号107を受信したインタ
フェース部5により、LAN2上へのフレームの送信が
中断される。
また、LAN2上へ1部送信されたフレームには、正常
なCRCが生成されていない。このため、L A N 
2上に接続されているノードは、このフレームを異常フ
レームと見なして受信を行わない。
このように、メモリ13において発生したエラーを含む
フレームを、従来のように正常フレームと誤認してノー
ドが受信することを防ぐことかできる。
なお、この発明は、ブリッジに限ることなく、ルータ、
ゲートウェイ等規格の異なる複数のLANの間に設けら
れて通信を制t2IIする通信制御装胃にも応用が可能
なものである。
[発明の効果1 以」ニ説明したように、この発明によれば、通信制御¥
4暇内で発生するエラーを検出し、フレームの送信を中
断するようにしたので、通信網上に接続されているノー
ドにおいて、異常フレームを正常フレームと誤認して受
信するのを防ぐことができる。
【図面の簡単な説明】
第1図はこの発明に係る一実施例のブリッジの構成を示
すブロック図、第2図は従来のブリッジの構成を示すブ
ロック図である。 15・・・メモリエラー検出部 17・・・送信コントロール部

Claims (1)

  1. 【特許請求の範囲】 通信網上を伝送する通信データを受信し、この通信デー
    タを他の通信網上へ送信する通信制御装置において、 この通信制御装置内で発生するエラーを検出してエラー
    発生信号を出力する検出手段と、この検出手段より出力
    されたエラー発生信号を受信し、前記他の通信網上への
    前記通信データの送信を中断する中断手段とを有したこ
    とを特徴とする通信制御装置。
JP1175561A 1989-07-10 1989-07-10 通信制御装置 Pending JPH0341848A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP1175561A JPH0341848A (ja) 1989-07-10 1989-07-10 通信制御装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP1175561A JPH0341848A (ja) 1989-07-10 1989-07-10 通信制御装置

Publications (1)

Publication Number Publication Date
JPH0341848A true JPH0341848A (ja) 1991-02-22

Family

ID=15998235

Family Applications (1)

Application Number Title Priority Date Filing Date
JP1175561A Pending JPH0341848A (ja) 1989-07-10 1989-07-10 通信制御装置

Country Status (1)

Country Link
JP (1) JPH0341848A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
USRE38095E1 (en) 1998-10-19 2003-04-29 Mario Fabris Sizing roll stand for a steel mill

Cited By (1)

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