JPH0332244B2 - - Google Patents
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- Publication number
- JPH0332244B2 JPH0332244B2 JP62087576A JP8757687A JPH0332244B2 JP H0332244 B2 JPH0332244 B2 JP H0332244B2 JP 62087576 A JP62087576 A JP 62087576A JP 8757687 A JP8757687 A JP 8757687A JP H0332244 B2 JPH0332244 B2 JP H0332244B2
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- JP
- Japan
- Prior art keywords
- voltage
- offset
- buffer amplifier
- input terminal
- transistor
- Prior art date
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- Expired - Lifetime
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- 230000009977 dual effect Effects 0.000 claims description 16
- 230000007423 decrease Effects 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 230000005669 field effect Effects 0.000 description 1
Landscapes
- Amplifiers (AREA)
Description
【発明の詳細な説明】
産業上の利用分野
本発明はデユアルFETから成るバツフアアン
プのオフセツト調整に関する。
プのオフセツト調整に関する。
従来の技術
従来、デユアルFET（電界効果トランジスタ）
から成るバツフアアンプとして、第２図に示すも
のが一般的に使用されている。これらのFETQ1，
Q2は特性を一致させてあり、抵抗R1，R2を介し
て電源±Vcc待に直列に接続している。FETQ1
はソースホロワとして、FETXQ2は定電流源と
して動作する。このため、外部入力端子Piに加え
た入力電圧eiとほぼ等しい電圧epが外部出力端子
Ppに現われる。その際、デユアルFETQ1，Q2は
全く特性が等しいわけではないので、抵抗R2を
可変とすることによりその電圧降下を変え、オフ
セツトを調整する。なお、オフセツト電圧とは入
力電圧がゼロの時、出力側に現われる電圧がゼロ
でないことであり、調整によりゼロとすることが
好ましいものである。このようなバツフアアンプ
は入力インピダンスが非常に大きく広帯域での使
用も可能である。
から成るバツフアアンプとして、第２図に示すも
のが一般的に使用されている。これらのFETQ1，
Q2は特性を一致させてあり、抵抗R1，R2を介し
て電源±Vcc待に直列に接続している。FETQ1
はソースホロワとして、FETXQ2は定電流源と
して動作する。このため、外部入力端子Piに加え
た入力電圧eiとほぼ等しい電圧epが外部出力端子
Ppに現われる。その際、デユアルFETQ1，Q2は
全く特性が等しいわけではないので、抵抗R2を
可変とすることによりその電圧降下を変え、オフ
セツトを調整する。なお、オフセツト電圧とは入
力電圧がゼロの時、出力側に現われる電圧がゼロ
でないことであり、調整によりゼロとすることが
好ましいものである。このようなバツフアアンプ
は入力インピダンスが非常に大きく広帯域での使
用も可能である。
発明が解決しようとする問題点
しかしながら、抵抗R1，R2及びFETQ1，Q2は
それらの温度係数を小さくしないと、温度ドリフ
トが大きくなるし、個々のFETQ1，Q2毎に、オ
フセツトが相違するという問題もある。なお、ド
リフトとはオフセツト電圧の変動のことである。
それらの温度係数を小さくしないと、温度ドリフ
トが大きくなるし、個々のFETQ1，Q2毎に、オ
フセツトが相違するという問題もある。なお、ド
リフトとはオフセツト電圧の変動のことである。
本発明はこのような従来の問題点に着目してな
されたものであり、デユアルFETから成るバツ
フアアンプのオフセツト更にはドリフトを自動的
に調整して解消することのできるオフセツト調整
付バツフアアンプを提供することを目的とする。
されたものであり、デユアルFETから成るバツ
フアアンプのオフセツト更にはドリフトを自動的
に調整して解消することのできるオフセツト調整
付バツフアアンプを提供することを目的とする。
問題点を解決するための手段
上記目的を達成するための手段を、以下実施例
に対応する第１図を用いて説明する。
に対応する第１図を用いて説明する。
このオフセツト調整付バツフアアンプはデユア
ルFET１０，１２から成るバツフアアンプにそ
のオフセツトを調整する回路を付加したものであ
る。このため、デユアルFET１０，１２から成
るバツフアアンプの電源ラインにトランジスタ２
２を介在し、更にそれを制御するオペアンプ２４
を備える。そして、オペアンプ２４の非反転入力
端子は外部入力端子１８に、反転入力端子は外部
出力端子２０に、出力端子はトランジスタ２２の
ベース端子にそれぞれ接続する。
ルFET１０，１２から成るバツフアアンプにそ
のオフセツトを調整する回路を付加したものであ
る。このため、デユアルFET１０，１２から成
るバツフアアンプの電源ラインにトランジスタ２
２を介在し、更にそれを制御するオペアンプ２４
を備える。そして、オペアンプ２４の非反転入力
端子は外部入力端子１８に、反転入力端子は外部
出力端子２０に、出力端子はトランジスタ２２の
ベース端子にそれぞれ接続する。
作 用
上記手段は次のように作用する。
オペアンプ２４はコンパレータとして動作す
る。即ち入出力電圧を非反転入力端子、反転入力
端子で受け、増幅したその差電圧をトランジスタ
２２のベース端子に与える。このため、デユアル
FET１０，１２から成るバツフアアンプのオフ
セツト更にはドリフトに基づいて入出力電圧が異
なることになつても、そのオフセツト更にはドラ
フトが現われる差電圧によりトランジスタ２２が
制御を受け、入出力電圧を一致させるようにコレ
クターエミツタ間の電圧のVCEが変動する。従
つて、デユアルFET１０，１２から成るバツフ
アアンプのオフセツト更にはドリフトは自動的に
調整されて解消する。
る。即ち入出力電圧を非反転入力端子、反転入力
端子で受け、増幅したその差電圧をトランジスタ
２２のベース端子に与える。このため、デユアル
FET１０，１２から成るバツフアアンプのオフ
セツト更にはドリフトに基づいて入出力電圧が異
なることになつても、そのオフセツト更にはドラ
フトが現われる差電圧によりトランジスタ２２が
制御を受け、入出力電圧を一致させるようにコレ
クターエミツタ間の電圧のVCEが変動する。従
つて、デユアルFET１０，１２から成るバツフ
アアンプのオフセツト更にはドリフトは自動的に
調整されて解消する。
実施例
以下、添付図面に基づいて、本発明の実施例を
説明する。
説明する。
第１図は本発明の一実施例によるオフセツト調
整付バツフアアンプである。図中、１０，１２は
特性を一致させたデユアルFET（接合形）であ
り、抵抗１４，１６を介して電源＋Ｖ、−Vcc間
に直列に接続されている。FET１０はソースホ
ロワとして、FET１２は定電流源として動作す
る。このため、外部入力端子１８に加えた入力電
圧Eiとほぼ等しい電圧Epが外部出力端子２０に現
われる。このようなデユアルFET１０，１２か
ら成るバツフアアンプの負側電源ラインに、その
オフセツトを調節する回路としてトランジスタ２
２を介し、更にそれを制御するオペアンプ２４を
備える。そこで、オペアンプ２４の非反転入力端
子（＋）は外部入力端子１８に、反転入力端子
（−）は外部入力端子２０に、出力端子はトラン
ジスタ２２のベース端子にそれぞれ接続する。な
お、オペアンプ２４の電源電圧は±Vccであり、
バツフアアンプの負側電源電圧は−Vccである
が、後者の正側電源電圧＋Ｖはトランジスタ２２
の飽和電圧等を考慮してある程度小さな値にす
る。即ち、｜＋Ｖ｜＜｜Vcc｜にする必要がある。
整付バツフアアンプである。図中、１０，１２は
特性を一致させたデユアルFET（接合形）であ
り、抵抗１４，１６を介して電源＋Ｖ、−Vcc間
に直列に接続されている。FET１０はソースホ
ロワとして、FET１２は定電流源として動作す
る。このため、外部入力端子１８に加えた入力電
圧Eiとほぼ等しい電圧Epが外部出力端子２０に現
われる。このようなデユアルFET１０，１２か
ら成るバツフアアンプの負側電源ラインに、その
オフセツトを調節する回路としてトランジスタ２
２を介し、更にそれを制御するオペアンプ２４を
備える。そこで、オペアンプ２４の非反転入力端
子（＋）は外部入力端子１８に、反転入力端子
（−）は外部入力端子２０に、出力端子はトラン
ジスタ２２のベース端子にそれぞれ接続する。な
お、オペアンプ２４の電源電圧は±Vccであり、
バツフアアンプの負側電源電圧は−Vccである
が、後者の正側電源電圧＋Ｖはトランジスタ２２
の飽和電圧等を考慮してある程度小さな値にす
る。即ち、｜＋Ｖ｜＜｜Vcc｜にする必要がある。
そのようにして、デユアルFET１０，１２か
ら成るバツフアアンプに、そのオフセツトを調整
する回路を付加すると、負側の電源ラインの電位
を制御することによつて、バツフアアンプのオフ
セツト更にはドリフトを自動的に調節して解消す
ることが可能となる。その際、オペアンプ２４は
コンパレータとして動作し、入出力電圧Ei、Epを
非反転入力端子、反転入力端子で受け、増幅した
その差電圧をトランジスタ２２のベース端子に与
える。このため、デユアルFET１０，１２から
成るバツフアアンプのオフセツト更にはドリフト
に基づいて入出力電圧Ei、Epが異なることになつ
ても、オフセツト更にはドリフトが現われる差電
圧により、トランジスタ２２が制御を受け、入出
力電圧Ei，Epを一致させるようにコレクターエミ
ツタ間の電圧VCEが変動する。例えばオペアン
プ２４の出力電圧がオフセツト更にはドリフトに
より高くなる（Ep＞Ei）と、トランジスタ２２の
ベース電圧が低くなり、VCEは小さくなる。そ
こで、トランジスタ２２のエミツタ電位が低くな
り、FET１２の出力電圧Epを低くする。
ら成るバツフアアンプに、そのオフセツトを調整
する回路を付加すると、負側の電源ラインの電位
を制御することによつて、バツフアアンプのオフ
セツト更にはドリフトを自動的に調節して解消す
ることが可能となる。その際、オペアンプ２４は
コンパレータとして動作し、入出力電圧Ei、Epを
非反転入力端子、反転入力端子で受け、増幅した
その差電圧をトランジスタ２２のベース端子に与
える。このため、デユアルFET１０，１２から
成るバツフアアンプのオフセツト更にはドリフト
に基づいて入出力電圧Ei、Epが異なることになつ
ても、オフセツト更にはドリフトが現われる差電
圧により、トランジスタ２２が制御を受け、入出
力電圧Ei，Epを一致させるようにコレクターエミ
ツタ間の電圧VCEが変動する。例えばオペアン
プ２４の出力電圧がオフセツト更にはドリフトに
より高くなる（Ep＞Ei）と、トランジスタ２２の
ベース電圧が低くなり、VCEは小さくなる。そ
こで、トランジスタ２２のエミツタ電位が低くな
り、FET１２の出力電圧Epを低くする。
発明の効果
以上説明した本発明によれば、デユアルFET
から成るバツフアアンプのオフセツト更にはドリ
フトを自動的に調整して解消することができる。
から成るバツフアアンプのオフセツト更にはドリ
フトを自動的に調整して解消することができる。
第１図は本発明の一実施例によるオフセツト調
整付バツフアアンプを示す回路図である。第２図
は従来のデユアルFETから成るバツフアアンプ
を示す回路図である。 １０，１２……デユアルFET、１４，１６…
…抵抗、１８，２０……外部入出力端子、２２…
…トランジスタ、２４……オペアンプ。
整付バツフアアンプを示す回路図である。第２図
は従来のデユアルFETから成るバツフアアンプ
を示す回路図である。 １０，１２……デユアルFET、１４，１６…
…抵抗、１８，２０……外部入出力端子、２２…
…トランジスタ、２４……オペアンプ。
Claims (1)
- １ デユアルFETから成るバツフアアンプの電
源ラインにトランジスタを介在し、そのベース端
子に、非反転入力端子を外部入力端子に接続し、
反転入力端子を外部出力端子に接続したオペアン
プの出力端子を接続することを特徴とするオフセ
ツト調整付バツフアアンプ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62087576A JPS63253707A (ja) | 1987-04-09 | 1987-04-09 | オフセツト調整付バツフアアンプ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62087576A JPS63253707A (ja) | 1987-04-09 | 1987-04-09 | オフセツト調整付バツフアアンプ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS63253707A JPS63253707A (ja) | 1988-10-20 |
| JPH0332244B2 true JPH0332244B2 (ja) | 1991-05-10 |
Family
ID=13918829
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62087576A Granted JPS63253707A (ja) | 1987-04-09 | 1987-04-09 | オフセツト調整付バツフアアンプ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63253707A (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP4917953B2 (ja) * | 2007-04-20 | 2012-04-18 | パナソニック株式会社 | 撮像装置 |
| JP6253551B2 (ja) * | 2014-08-29 | 2017-12-27 | オリンパス株式会社 | 撮像素子、撮像装置、内視鏡および内視鏡システム |
-
1987
- 1987-04-09 JP JP62087576A patent/JPS63253707A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS63253707A (ja) | 1988-10-20 |
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Legal Events
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