JPH03276716A - 酸化物でマスクされたSi基板上にSiGe層を被着する方法 - Google Patents
酸化物でマスクされたSi基板上にSiGe層を被着する方法Info
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- 239000000758 substrate Substances 0.000 title claims abstract description 51
- 229910000577 Silicon-germanium Inorganic materials 0.000 claims abstract description 52
- 238000000034 method Methods 0.000 claims abstract description 40
- 229910052581 Si3N4 Inorganic materials 0.000 claims abstract description 12
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 claims abstract description 12
- 229910021420 polycrystalline silicon Inorganic materials 0.000 claims abstract description 9
- 238000001312 dry etching Methods 0.000 claims abstract description 5
- 238000000151 deposition Methods 0.000 claims description 63
- 238000005530 etching Methods 0.000 claims description 3
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 abstract description 23
- 230000007547 defect Effects 0.000 abstract description 17
- 235000012239 silicon dioxide Nutrition 0.000 abstract description 11
- 239000000377 silicon dioxide Substances 0.000 abstract description 11
- 229910052681 coesite Inorganic materials 0.000 abstract description 5
- 229910052906 cristobalite Inorganic materials 0.000 abstract description 5
- 229910052682 stishovite Inorganic materials 0.000 abstract description 5
- 229910052905 tridymite Inorganic materials 0.000 abstract description 5
- 239000011248 coating agent Substances 0.000 abstract 1
- 238000000576 coating method Methods 0.000 abstract 1
- 239000010410 layer Substances 0.000 description 76
- 230000008021 deposition Effects 0.000 description 36
- 235000012431 wafers Nutrition 0.000 description 24
- 230000006911 nucleation Effects 0.000 description 13
- 238000010899 nucleation Methods 0.000 description 13
- 239000010409 thin film Substances 0.000 description 13
- 238000002474 experimental method Methods 0.000 description 12
- LIVNPJMFVYWSIS-UHFFFAOYSA-N silicon monoxide Chemical compound [Si-]#[O+] LIVNPJMFVYWSIS-UHFFFAOYSA-N 0.000 description 10
- 150000004767 nitrides Chemical class 0.000 description 8
- 238000005229 chemical vapour deposition Methods 0.000 description 7
- 230000015572 biosynthetic process Effects 0.000 description 6
- 230000000694 effects Effects 0.000 description 6
- 239000013078 crystal Substances 0.000 description 5
- 230000008569 process Effects 0.000 description 5
- 229910052710 silicon Inorganic materials 0.000 description 5
- 229910000078 germane Inorganic materials 0.000 description 4
- 229910052732 germanium Inorganic materials 0.000 description 4
- 230000035755 proliferation Effects 0.000 description 4
- 238000004627 transmission electron microscopy Methods 0.000 description 4
- 238000006243 chemical reaction Methods 0.000 description 3
- 230000001419 dependent effect Effects 0.000 description 3
- MROCJMGDEKINLD-UHFFFAOYSA-N dichlorosilane Chemical compound Cl[SiH2]Cl MROCJMGDEKINLD-UHFFFAOYSA-N 0.000 description 3
- 239000010408 film Substances 0.000 description 3
- 239000007789 gas Substances 0.000 description 3
- 229910052739 hydrogen Inorganic materials 0.000 description 3
- 239000001257 hydrogen Substances 0.000 description 3
- 230000003993 interaction Effects 0.000 description 3
- 230000009467 reduction Effects 0.000 description 3
- UFHFLCQGNIYNRP-UHFFFAOYSA-N Hydrogen Chemical compound [H][H] UFHFLCQGNIYNRP-UHFFFAOYSA-N 0.000 description 2
- 238000004458 analytical method Methods 0.000 description 2
- 239000012159 carrier gas Substances 0.000 description 2
- 230000007423 decrease Effects 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 238000001493 electron microscopy Methods 0.000 description 2
- 238000003384 imaging method Methods 0.000 description 2
- 230000000873 masking effect Effects 0.000 description 2
- 239000000463 material Substances 0.000 description 2
- 230000007246 mechanism Effects 0.000 description 2
- 238000001451 molecular beam epitaxy Methods 0.000 description 2
- 230000008439 repair process Effects 0.000 description 2
- 229910052814 silicon oxide Inorganic materials 0.000 description 2
- KRHYYFGTRYWZRS-UHFFFAOYSA-N Fluorane Chemical compound F KRHYYFGTRYWZRS-UHFFFAOYSA-N 0.000 description 1
- 229910001218 Gallium arsenide Inorganic materials 0.000 description 1
- 229910000530 Gallium indium arsenide Inorganic materials 0.000 description 1
- 238000002441 X-ray diffraction Methods 0.000 description 1
- 238000004854 X-ray topography Methods 0.000 description 1
- 229910045601 alloy Inorganic materials 0.000 description 1
- 239000000956 alloy Substances 0.000 description 1
- 238000013459 approach Methods 0.000 description 1
- 230000005540 biological transmission Effects 0.000 description 1
- 239000006227 byproduct Substances 0.000 description 1
- 238000005136 cathodoluminescence Methods 0.000 description 1
- 238000004140 cleaning Methods 0.000 description 1
- 239000012792 core layer Substances 0.000 description 1
- 239000000428 dust Substances 0.000 description 1
- 238000010894 electron beam technology Methods 0.000 description 1
- 150000002431 hydrogen Chemical class 0.000 description 1
- 229910000040 hydrogen fluoride Inorganic materials 0.000 description 1
- 238000007689 inspection Methods 0.000 description 1
- 210000004185 liver Anatomy 0.000 description 1
- 238000004519 manufacturing process Methods 0.000 description 1
- 238000001000 micrograph Methods 0.000 description 1
- 238000000399 optical microscopy Methods 0.000 description 1
- 239000002245 particle Substances 0.000 description 1
- 238000001020 plasma etching Methods 0.000 description 1
- 239000002244 precipitate Substances 0.000 description 1
- 230000001902 propagating effect Effects 0.000 description 1
- 239000004065 semiconductor Substances 0.000 description 1
- 238000005389 semiconductor device fabrication Methods 0.000 description 1
- 238000000926 separation method Methods 0.000 description 1
- SBEQWOXEGHQIMW-UHFFFAOYSA-N silicon Chemical compound [Si].[Si] SBEQWOXEGHQIMW-UHFFFAOYSA-N 0.000 description 1
- 238000000992 sputter etching Methods 0.000 description 1
- 238000012876 topography Methods 0.000 description 1
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 description 1
- 229910052721 tungsten Inorganic materials 0.000 description 1
- 239000010937 tungsten Substances 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02367—Substrates
- H01L21/0237—Materials
- H01L21/02373—Group 14 semiconducting materials
- H01L21/02381—Silicon, silicon germanium, germanium
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02367—Substrates
- H01L21/0237—Materials
- H01L21/02387—Group 13/15 materials
- H01L21/02395—Arsenides
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02518—Deposited layers
- H01L21/02521—Materials
- H01L21/02524—Group 14 semiconducting materials
- H01L21/02532—Silicon, silicon germanium, germanium
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02612—Formation types
- H01L21/02617—Deposition types
- H01L21/0262—Reduction or decomposition of gaseous compounds, e.g. CVD
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- H—ELECTRICITY
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/02104—Forming layers
- H01L21/02365—Forming inorganic semiconducting materials on a substrate
- H01L21/02612—Formation types
- H01L21/02617—Deposition types
- H01L21/02636—Selective deposition, e.g. simultaneous growth of mono- and non-monocrystalline semiconductor materials
- H01L21/02639—Preparation of substrate for selective deposition
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- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
本発明は、Si基板上へのSiGeの選択的及び非選択
的被着に関するものであり、そしてまたSiGeが、被
着する表面の特性によってどのような影響を受けるかに
関するものである。
的被着に関するものであり、そしてまたSiGeが、被
着する表面の特性によってどのような影響を受けるかに
関するものである。
Si基板に対するSiの選択的及び非選択的被着につい
ては、完全に露出したSi基板に対するSiGe薄膜の
被着として、文献に発表された報告から周知のところで
ある。しかしながら、本発明の実験以前には、SiO□
によって部分的にマスクされたSi基板に対するSiG
eの選択的及び非選択的被着については、はとんど知ら
れていなかった。
ては、完全に露出したSi基板に対するSiGe薄膜の
被着として、文献に発表された報告から周知のところで
ある。しかしながら、本発明の実験以前には、SiO□
によって部分的にマスクされたSi基板に対するSiG
eの選択的及び非選択的被着については、はとんど知ら
れていなかった。
本発明の目的は、SiGe層における欠陥または不適合
な転位を最小限にとどめるように、二酸化ケイ素によっ
て部分的にカバーされたSi基板に対するSiGe層の
被着を行なうためのいくつかの方法を提供することであ
る。
な転位を最小限にとどめるように、二酸化ケイ素によっ
て部分的にカバーされたSi基板に対するSiGe層の
被着を行なうためのいくつかの方法を提供することであ
る。
第1の実施例によれば、まず、窒化ケイ素と多結晶ケイ
素のいずれかでカバーすることによって、二酸化ケイ素
の層を隠蔽し、その後基板の露出したSi及びその隠さ
れた酸化物層に対してS iGeの層を被着させ、Si
Ge層の欠陥を最小限にとどめる方法が得られる。 第2の実施例によれば、やはり、SiGe層の欠陥を最
小限にするための方法が得られる。この方法の場合、S
i基板の表面に第1のSiO□層を成長させ、次に、S
i基板に異方性のドライ・エツチングを施すことにより
、第1のSiO□層に窓を形成し、それによりその窓の
側壁をほぼ垂直にし、また基板のSi表面が露出するよ
うにする。次に、第1のSiO□層上及び基板の露出し
たSi部における窓の底部に対して第2のSiO□層を
被着させることによって、異方性エツチングにおいて損
傷を受けた第1のSiO□層のエツジを修理し、窓の底
部表面から第2のS i O2層に湿式エツチングを施
して、基板のSi表面を露出させる。次に、窓内にSi
Ge層を選択的に被着させる。 第3の実施例も、やはり、SiGe層における欠陥を最
小限にとどめる方法であり、これは、まず、Si基板表
面上にSing層を成長させ、次に、そのSiO□層を
介して窓をリソグラフィ的に開口するためにマスキング
を施す。ここで全ての窓の総面積が基板表面の一部に残
される5to2の総面積に関して最大になるようにする
。該ステップに続いて、そのマスクを利用して、SiO
g層中に窓のエツチングを行ない、これら窓によって基
板の33表面を露出させ、次に、この窓内にSiGe層
を選択的に被着させる。 次に、第4の実施例は、SiGe層における不適合な転
位を最小限にとどめるための方法であり、まず、Si基
板表面上にSiO2層を成長させ、次に、S i Oz
層を介して窓をリソグラフィ的に開口するためにマスキ
ングを施す。ここで全ての窓の総面積が基板表面の一部
に残されるSingの総面積に関して最小になるように
する。次に、マスクを利用して、S i O2層中に窓
のエツチングを行ない、該層によって基板のSi表面を
露出させ、さらに、それら窓内に5iOz層を選択的に
被着させる。 第5の実施例は、第1と第4の実施例を組み合わせて、
SiO□層における欠陥及び不適合な転位の数を最小限
にとどめるものである。
素のいずれかでカバーすることによって、二酸化ケイ素
の層を隠蔽し、その後基板の露出したSi及びその隠さ
れた酸化物層に対してS iGeの層を被着させ、Si
Ge層の欠陥を最小限にとどめる方法が得られる。 第2の実施例によれば、やはり、SiGe層の欠陥を最
小限にするための方法が得られる。この方法の場合、S
i基板の表面に第1のSiO□層を成長させ、次に、S
i基板に異方性のドライ・エツチングを施すことにより
、第1のSiO□層に窓を形成し、それによりその窓の
側壁をほぼ垂直にし、また基板のSi表面が露出するよ
うにする。次に、第1のSiO□層上及び基板の露出し
たSi部における窓の底部に対して第2のSiO□層を
被着させることによって、異方性エツチングにおいて損
傷を受けた第1のSiO□層のエツジを修理し、窓の底
部表面から第2のS i O2層に湿式エツチングを施
して、基板のSi表面を露出させる。次に、窓内にSi
Ge層を選択的に被着させる。 第3の実施例も、やはり、SiGe層における欠陥を最
小限にとどめる方法であり、これは、まず、Si基板表
面上にSing層を成長させ、次に、そのSiO□層を
介して窓をリソグラフィ的に開口するためにマスキング
を施す。ここで全ての窓の総面積が基板表面の一部に残
される5to2の総面積に関して最大になるようにする
。該ステップに続いて、そのマスクを利用して、SiO
g層中に窓のエツチングを行ない、これら窓によって基
板の33表面を露出させ、次に、この窓内にSiGe層
を選択的に被着させる。 次に、第4の実施例は、SiGe層における不適合な転
位を最小限にとどめるための方法であり、まず、Si基
板表面上にSiO2層を成長させ、次に、S i Oz
層を介して窓をリソグラフィ的に開口するためにマスキ
ングを施す。ここで全ての窓の総面積が基板表面の一部
に残されるSingの総面積に関して最小になるように
する。次に、マスクを利用して、S i O2層中に窓
のエツチングを行ない、該層によって基板のSi表面を
露出させ、さらに、それら窓内に5iOz層を選択的に
被着させる。 第5の実施例は、第1と第4の実施例を組み合わせて、
SiO□層における欠陥及び不適合な転位の数を最小限
にとどめるものである。
本発明をもたらした実験について述べる前に、用語につ
いて一般的な説明及び定義をしておく必要がある。選択
的プロセスは、被着膜があるタイプの表面特性に対して
のみ付着されるものである(例えば、露出したSiに対
してだけ)。これに対し、非選択的、または、混合プロ
セスは、全表面にわたって、すなわち、各種表面特性の
全てに対して、被着が行なわれるものである。エピタキ
シャル成長は、エピタキシャル層の結晶構造は、配向が
単一のため単結晶と呼ばれ、多結晶は、核層の結晶構造
が、均一な結晶配向になっていないので、そのように記
述される。Siに関して、適切に選択された被着条件下
で、SiGei膜による実験で明らかになったように、
被着がエピタキシャル層に対して施されると、被着され
た層もエピタキシャルになり、また、多結晶層または非
結晶層、(例えば、酸化ケイ素または窒化ケイ素)に対
しての場合には、被着された層は、多結晶になる。 本発明で行なった実験には、前処理を施された各種Si
ウェーハ:すなわち、部分的に二酸化ケイ素でマスキン
グを施された第1のウェーハ、二酸化ケイ素のマスクが
、その水平面と垂直面の両方について、窒化ケイ素の層
で完全にカバーされた第2のウェーハ及び二酸化ケイ素
のマスクが、その水平面と垂直面の両方について、多結
晶SiO層で完全にカバーされた第3のウェーハに対し
て、SiGe薄膜を選択的及び非選択的に被着させよう
とする試みが含まれている。 これらの実験は、それぞれ、下記のほぼ同じリアクタ条
件で行なわれた: ■)、各ウェーハが、20秒間にわたって、1200’
CのH2雰囲気内で250トルの圧力で標準的な事前洗
浄化を施された(この温度は半導体デバイスの製造には
用いられない非常に高い温度である); 2)、エピタキシャルケイ素(シリコン)の選択的被着
のため、リアクタ内において、約2500人のSiが得
られるように、3分間わたって、6.4トルの圧力及び
1000°Cの温度で、20cc/分のDC3(dic
loroscilene)と5リットル/分のH2の流
れの混合気流で被着された;3)、各基板に対してSi
Ge層を選択的に被着させるため、気流は、原子分率で
Geが21%にあたるSiGeの約200人厚の層が得
られるように、25分間にわたって、圧力を6.4トル
、温度を625°Cにして、水素、それも、5リットル
/分のH2のキャリヤー・ガス内で混合された、40c
c/分のDC5と150cc/分の1%のゲルマン(G
eH4)との混合流で構成された。 第1の実験の場合、主として二酸化ケイ素でマスキング
族されたウェーハをリアクタ内に配置し、露出したSi
に対しSiGeを選択的に被着させる試みがなされた。 該実験の結果、SiGeの被着が生じる通常の温度にお
けるSiGeの被着に相応に適合する条件下において、
露出したSiに対しSiGeの選択的被着が生じた。S
iGeは、露出したSiには被着したが、酸化物には被
着しなかった。しかしながら、問題があった。ウェーハ
の大部分がS i O2によってカバーされる結果とし
て、被着膜と酸化物との間に相互作用が生じるというこ
とが判った。該反応によって、はぼ5ideの厚さ全体
にわたって、すなわち、半導体デバイスの生産に関して
そのタイプの被着を関心のもてないものにしてしまうほ
どの大領域にわたって、被着SiGe層内に多くの欠陥
を生じることになった。 一方、ウェーハが、主として露出したSi とごくわず
かな酸化物からなる場合、SiGe層の厚さ全体に及ぶ
欠陥はほとんどながった。 選択的被着によって、小領域に不適合な転位が形成され
る前に、SiGe層のクリティカルな厚さが変化した。 多くの転位が大領域にわたって観測0 された厚さと、Ge含有量で、小領域に被着されたSi
Ge層には、不適合な転位はほとんど生じなかった。次
の実験は、全ての酸化物をほぼ隠蔽することであった。 そうすることによって、答えを得ようとした疑問点は、
ウェーハが主として露出した酸化物を有する場合に発見
された結晶の欠陥を回避することが可能かということと
、他のタイプの被着が生じるかということである。 上述のように、酸化物をカバーする2つの異なる層が、
さまざまな実験で用いられた。一方では、酸化物は、窒
化ケイ素の層でカバーされ、もう−方では、酸化物は、
多結晶Siでカバーされる。 いくつかの相関関係のある事態が生じた。まず、多結晶
Siの場合、被着は非選択性になり、エピタキシャルS
iGeが基板の露出したSi上に、また、多結晶SiG
eが酸化物に重なった多結晶Si上に形成されることが
予測される。それは、確かに、多結晶Siが用いられた
結果であった。 意外にも、窒化ケイ素の場合、同様の作用が観測された
。該状況の場合、多結晶SiGeが露出した窒化物およ
び基板の露出したSi上のエピタキシャルSiGe上に
被着することになり、酸化物がカバーされていなくても
、SiGeの厚さ全体にわたって欠陥は観測されなかっ
た。 さらに、露出した窒化物上に被着させずに、露出したS
i基板上に選択的にSiを被着させることが可能な状態
(条件)も発見された。従って、引続き、混合式でSi
Geを非選択的に被着させることにより、露出したSi
の第1の層上にエピタキシャルSiGeとしての被着が
、また露出した窒化物上に多結晶材料としての被着が生
じるようにすることができた。 窒化物の層の上にくるSiGe層の部分は、露出したS
i上のSiGe層の部分とほぼ同じ厚さになることが観
測された。さらに、露出したSi層上のSiGe層の部
分は、エピタキシャルになり、窒化物の層の上のSiG
e層の部分は、多結晶となった。 結果得られる被着が選択的になるが、非選択的(混合)
になるかを決める要素は数多く存在する。 2− まず、選択的なSiの被着について検討を加えることに
する。酸化物に対するSiの選択性が、窒化物に対する
選択性よりも強いということは、ある程度周知のところ
である。2つの例として、Siまたはタングステンの被
着を施している最中であれば、酸化物に被着させない方
が、窒化物に被着させないようにするよりも簡単である
。従って、基板の表面特性が、考慮事項の1つである。 気体(ガス)の化学的性質を調整することが、もう1つ
の考慮事項である。すなわち、種を含む01対種を含む
SiまたはGeの比が、重要になる。CIが多くなれば
、被着の選択性がそれだけ強くなる。被着の選択性を弱
めるためには、SiまたはGeを多くしなければならな
い。時間及び温度はそれぞれ・、欠陥の有無に影響する
だけでなく、核生成及びその進行速度を左右することに
なるので、やはり、重要な影響がある。 窒化物が存在する状態で被着する場合、Siの被着温度
は、SiGeに比べて高いので、温度とガスのみの相違
によりSiの被着は選択的になり、3 SiGeの被着は非選択的になる条件が存在する。 例えば、Siは、通常、800℃〜1000℃の間で被
着するが、SiGeは、通常、600°C〜700℃の
間で被着する。SiGeの場合、用いられる温度が低く
なると、SiGeに不適合な転位の形成される可能性も
低くなる。 非選択的状況の場合、主たる相違は、DC3の流量が1
/2に減少するということである。H2の流量が増すと
、ウェーハからより速く副産物藪(バイプロダクト)が
除去されるはずであり、従って、H2の流量が増すこと
によって、選択性の強まるごとが予測される。反応性ガ
スの流量が増すと、より短い期間に、被着材料による同
じ厚さの被着が生じるが、Siについては、選択性を助
長することにもなる。 ゲルマンの流量が増す場合、CLの添加をふやさないで
、被着種が添加されているので、SiGeの被着の選択
性が弱まることになる。従って、選択性の問題を生じる
ことなく、ゲルマンの流量を2〜3倍以上に増すことは
できない。 4− 温度は、他の要素によって制約を受ける。例えば、不適
合な転位の形成は、ブランケット被着の場合におけるよ
うに、温度の上限を決定する可能性があり、また温度の
下限は、選択的被着及び混合被着の両方とも、被着速度
とSiGe層における結晶化度の損失によって決定され
る。 圧力、一般には、低圧力は、選択性を助長する傾向があ
るが、しかしこれは、他の多くの変数と相互作用を生じ
ることになり;5ないし10トルが、適度な圧力範囲で
ある。用いられる圧力が大気圧に近づくと、Siの被着
において、選択性を得るのが難しくなり、酸化物の上に
より被着しやすくなる。 代替案として、HCLを添加して、選択性を強めること
が可能であり、従って、被着種を添加せずに、CL種が
添加される。CLの含有量はプロセスの選択性に関する
主たる要因となる。 こうした実験に対する誘引の1つとなった観測の1つは
、大領域において薄いSiGe層を被着させる場合に生
じるかなりの数の欠陥を伴わずに、■ 小領域において厚いSiGe層を成長させることができ
るか否かの確認であった。それは、その通りであること
が分った。すなわち、所定の欠陥密度が得られるSiG
eの厚さは、SiGe層を大領域に被着させる場合に比
べて、小領域に被着させる場合の方がはるかに厚くなる
。 もう1つの実験で明らかになったことは、Si基板表面
に第1の5iO2N、すなわち、フィールド酸化物層を
成長させ、次に、そのフィールド酸化物に所望の窓を異
方性ドライ・エツチング(例えば、プラズマ・エツチン
グ)で形成し、それら窓の側壁がほぼ垂直になるように
することによって、SiGe層の欠陥を減少させること
ができるということであった。ドライ・エツチングを実
施する場合、その酸化物のエツジが一般的に損傷を受け
る。該エツジを修理するために、5iO7の薄い第2の
層をフィールド酸化物の表面、及び、窓中に被着させ、
次に、これら窓の底部表面に湿式エツチングを施して(
例えば、フッ化水素、肝、エツチング)、Siの表面を
露出させることにな6 る。次に、窓内においてSiGe層を選択的に被着させ
る。 化学蒸着技法による制限された反応処理を用いて、酸化
物でパターン形成された、配向が<100>O3t ウ
ェーハ上の露出したSi領域に、Si1□GeX、及び
、Si層を選択的に成長させた。直径が100〜150
μmの領域を検査できるようにする、大領域のシンニン
グ(薄化)技法と共に、平面透過歩キ電子顕微鏡を用い
て、ヘテロインターフェイスにおける不適合な転位の間
隔が測定された。 転位密度は、酸化物で分離されることによって形成され
る小領域(横方向の寸法:数十ミクロン)の場合、パタ
ーン形成された酸化物によって遮断されない隣接する大
領域(ミリメートル)に比べると、少なくとも1/20
に低くなる。パターン形成されたウェーハ上にSi、、
Ge、を選択的に成長させる能力や、成長した状態の薄
膜における転位密度の領域に依存した低下度は、5it
−、GeXのひずんだ層を利用する将来のデバイスの用
途にとって重要な考慮事項になる可能性がある。 7 最近のFi tzgerald他による分子線エピタキ
シによって成長したInGaAs/GaAsひずみ層の
研究[Journal of Applied Phy
sics、65,2220.1989] において示さ
れるように、薄膜成長時に形成された不適合な転位密度
は、成長領域が小さくなれば、低下する。結果として、
大領域よりも小領域にはるかに大きな厚みをもって、ひ
ずみをもって、薄膜が成長されうる。本発明者が明らか
にしたところによれば、この現象を利用して、ひずみ層
における不適合な転位形成の動力学を洞察することが可
能である。転位密度に関する同様の領域に依存した低下
が、化学蒸着(CVD)技法による制限された反応処理
(LRP)によって成長するS to、 a G eo
、 2/Siひずみ層にも観測された。小領域が、Ga
As基板にトレンチをエツチングして得られたメサに薄
膜を被着させることによって小領域が形成されたFit
zgeral/dの研究に対し、本研究における小領域
は、酸化物によるパターン形成が施されたウェーハの露
出したSi領域にS i * S i+−、GeXを選
択的に被着させることによって形成された。 8 CVD技法の場合、メサの上部だけでなく、その側部に
ついても、被着が予測されるので、メサ構造上への成長
は、おそらく、成長領域を制限する有効な手段ではない
。 本研究におけるSi及びSi、、Ge、は、ウェーハ温
度の急速な変化を利用して薄膜成長を開始させたり、終
了させたりするCVD技法である−[八pplied
Physics Letters、47,721.
1985]LRPによって成長させた。酸化物のパター
ンを有するウェーハは、3000人の熱酸化物でカバー
された、配向が<100>のSi基板から作製された。 Si及び5ideの選択的成長は、パターン形成が施さ
れていないウェーハ上に成長させたブランケット層に関
する本発明者の以前の研究で報告したものと同じ成長手
順を利用して行なわれた(1989年5月30日〜6月
20日に、フランスのストラスフ゛−ルで開催された3
vd Int、、Symoon Si MBEにおけ
る:Alternative Growth Meth
ods]。30秒間にわたる1200°Cでの水素によ
る予備ベーキングの後、ジクロロシランを利用して、厚
さが1000人のバラファ層を1000″Cで選択的に
成長させた。これに続いて、ジクロロシランとゲルマン
を利用し、もとの位置に、厚さがほぼ2000人のS
io、 aGeo、 2層が625°Cで被着させられ
た。両方の層とも、約6.5トルの圧力で水素をキャリ
ヤー・ガスに用いて成長させた。層の厚さと組織は、2
.2Meνの’He+のラザフォード散乱(RBS)
と断面透過電子顕微鏡検査(XTEM)によって測定さ
れた。ジクロロシランとゲルマンを用いた、さまざまな
成長温度及び圧力に関する純Si層と純Ge層の選択的
成長が、これまでに報告されている。本研究における5
ide被着の場合、光学顕微鏡検査では、酸化物上に被
着を認められなかった。さらに、平面透過電子顕微鏡検
査及びオージェ(Augen)電子分光器の利用時にお
けるX線分析においても、サンプルの酸化部分上にGe
の形跡のないことが明らかになった。 1200°Cでの11□による予備ベーキングの結果、
酸化物の側壁にアンダー・カットが生じ、酸化物のエツ
ジには、粗さが生じた。それは、選択的薄膜において不
適合な転位の核生成の役割を果たす可0 能性がある。 にわたる不適合な転位を結像するために陰極線ルミネセ
ンスを用いることはできない。従って、電子ヒーム誘導
電流イメージング(EBIC)、)l)ポグラフィ、ま
たは、平面透過電子顕微鏡検査(TEM)といった、別
の技法を利用することが必要になる。EBICは、これ
らの層には不適格と判定された。何故ならば本件の薄膜
における不適合な転位が、はんのわずかにしか電気的に
活性ではなく、またこの技法を用いたイメージングは極
めて困難であることが分ったためである。X線トポグラ
フィも、関係する成長領域が小さく、また酸化物のパタ
ーンによるひずみが存在するため、不合格になった。従
って、転位密度は、平面TEMを用いて測定されたが、
これは、個々の不適合な転位間における平均間隔である
。パターン形成されたウェーハに関する後述の転位間隔
は、大領域と小領域の間に、はぼ均等に、総視野面積が
約1 200、000μm2のスプリットを備えた、4つのT
EM試験体からの平均値である。電子透過領域(直径1
00〜150 μm )が、Moddemによって解説
された技法(Journal of Electron
Microscopy Tech、。 IL16L1989 )を利用した、機械的薄膜化とA
rイオン・ミリングの組合せによって形成された。 最良のサンプルには、ホールを生じることなく、透明に
なるように慎重な仕上げが施された。上記で示されたの
と同様の領域において得られたTIEM顕微鏡写真のコ
ラ−シュ(callage)が、作成された。この領域
は、直径が約1mmの開放された大領域に隣接する、約
10μmの間隔をあけた位置にある1組の酸化物フィン
ガ(f ingures)の端部に位置している。大領
域における不適合な転位の間隔は、0.25μmから変
動することが分ったが、選択的ウェーへの小領域におけ
る間隔は、2.0μmを超える。パターン形成されてい
ないSi制御ウェーハ(同じバッファ層と厚さが200
0人のSiGe薄膜)で測定した不適合な間隔は、選択
的ウェーハの大領域で測定された間隔0.5〜1.0μ
m2 に近かった。不適合な転位が、大領域から小領域及びフ
ィンガへと伝播するのが確認され、また不適合なセグメ
ントを自由表面に接続するつながった転位が、2つの側
壁の一方または他方にだけ観測された。この観測結果は
、これらの転位が、方の側壁で核生成され、他方の側壁
へ広がってい(という考えと一致する。 小成長領域における不適合な転位密度の低下の原因とな
るメカニズムの説明については、以下に行なう。読者は
、Matthews他の研究[J、Appl。 Phys、41,3800.19701やF it、g
erald他の研究を参照されたい。この分析に関して
、不適合な転位の核生成は、一定の面積的密度を備えた
局所的欠陥として定義することが可能な発生源によって
左右されると仮定する;すなわち、N個の発生源/cm
2で得られる一定の発生源の密度が存在するものと仮定
する。基板からつながった転位、ダストの粒子、析出物
、及び、転位の相互作用が、こうした発生源の例である
。3つの相関要素が、観測された領域効果の原因をなし
ている。第1に:小3 領域の場合、発生源の密度が十分に低ければ、活性の核
生成発生源のほとんどない領域、従って、不適合な転位
のほとんどない領域を備えることが可能である。第2に
ニ一定の転位によって発生する不適合なライン長は、領
域(メサまたは酸化物の側壁)のエツジまで延びて、終
っている。第3に:転位の増殖(Appl、 Phys
、 17,85,1978:lは大領域において生じる
可能性が高い。何故ならば増殖を生じる可能性のある転
位の相互作用は、小領域よりも大領域において生じるも
のが多いからである。 第1a図及び第1b図は、不適合な転位の形成に対する
成長領域の影響について概略を示したものである。概略
図の作成にあたっては、上述の第1と第2の要素だけし
か考慮しなかった;転位の増殖は、領域効果を生じる必
要がない。第1a図には、酸化物の側壁(太線)によっ
て画定される9つの方形成長領域のアレイが示されてい
る。各領域は、サイズがL2であり、総成長領域は、9
L2になる。各小領域には、4つの核生成位置4 (スター)がランダムに配置されており、不適合な転位
セグメントの1つは、各発生源によって核生成される。 各小領域における4つの不適合なセグメントのうちの2
つは、2つの直交する<110 >の方向のそれぞれに
延びている。酸化物の側壁によって、不適合なセグメン
トが隣接する領域内へ広がらないようになっている。線
形の不適合な転位密度Pは、<110 >方向のそれぞ
れにおいて測定された転位間隔Sの逆数である。この理
想化された状況では、9つの領域にわたる平均転位間隔
は、1つの領域における転位間隔と同じである;S=L
/2及びP=1/S=2/L0・第1b図で表わされた
状況は、小領域を分割する酸化物の内部側壁が除去され
ている点を除けば、第1a図について解説した状況と同
じである。この結果、サイズが9L2の大領域の1つが
生じる。 この場合、同じ転位発生源によって、長さが3倍の不適
合なセグメントを生じる可能性がある。第1b図におけ
る平均転位間隔はL/6であり、線形転位密度は、第1
a図に比べてそ3倍に高まっ5 た。Fitzgerald他の詳細な分析に示されるよ
うに(以下参照)、不適合な線形転位密度は、Lに比例
するが、ここで、し、すなわち、平均転移ライン長は、
領域の形状寸法の関数である。転位の増殖を考慮すると
、領域効果はより顕著になることが予測され、そして線
形転位密度はもはやLに比例しなくなる。核生成事象の
領域的密度が、関係する特徴のサイズに比べて低い場合
、上述と同様の方法によって、定義により局所的な欠陥
とは関係のない、均質な核生成のモデリングを行なうこ
とができるはずである。 転位密度の領域に依存した低下は、本件の5i1−XG
eX/Si薄膜において顕著であるが、明らかに目立っ
た核生成源はない。配向が<100 >のSiで基板は
転位がないので、基板からつながった欠陥が、これらの
薄膜における不適合な転位の核生成に影響することはな
い。酸化物の側壁に関連した不適合な転位の均質な核生
成に関する形跡が存在するとしても、パターン形成の施
されていない制御ウェー八が、パターン形成を施され6 たウェーへの大領域において観測されるのと同様の転位
密度を備えているという事実が示唆するように、別の核
生成メカニズムが、支配的である。 同一基準のSio、5Geo、z合金におけるひずみは
、0.9%にしかすぎないので、均質な表面の半ループ
の核生成は、ありそうにない。この値は、こうした事象
の開始に必要と考えられる2〜6%の理論的ひずみ値を
かなり下まわっている。従って、おそらくは、転位増殖
(Hagen−5trunkのメカニズムを介した)と
の組合せといった、これまで確認されていない核生成プ
ロセスが、本件のSi、□Gex薄膜における不適合な
転位形成の原因になっている。さらに、選択的被着と組
み合わせた、酸化物によってパターン形成を施されたさ
まざまな領域サイズ及び幾何学形状を備えるウェーハを
用いた実験で、CVD成長層におけるこれらの現象をさ
らに詳細に研究するための手段を提供することが望まし
い。
いて一般的な説明及び定義をしておく必要がある。選択
的プロセスは、被着膜があるタイプの表面特性に対して
のみ付着されるものである(例えば、露出したSiに対
してだけ)。これに対し、非選択的、または、混合プロ
セスは、全表面にわたって、すなわち、各種表面特性の
全てに対して、被着が行なわれるものである。エピタキ
シャル成長は、エピタキシャル層の結晶構造は、配向が
単一のため単結晶と呼ばれ、多結晶は、核層の結晶構造
が、均一な結晶配向になっていないので、そのように記
述される。Siに関して、適切に選択された被着条件下
で、SiGei膜による実験で明らかになったように、
被着がエピタキシャル層に対して施されると、被着され
た層もエピタキシャルになり、また、多結晶層または非
結晶層、(例えば、酸化ケイ素または窒化ケイ素)に対
しての場合には、被着された層は、多結晶になる。 本発明で行なった実験には、前処理を施された各種Si
ウェーハ:すなわち、部分的に二酸化ケイ素でマスキン
グを施された第1のウェーハ、二酸化ケイ素のマスクが
、その水平面と垂直面の両方について、窒化ケイ素の層
で完全にカバーされた第2のウェーハ及び二酸化ケイ素
のマスクが、その水平面と垂直面の両方について、多結
晶SiO層で完全にカバーされた第3のウェーハに対し
て、SiGe薄膜を選択的及び非選択的に被着させよう
とする試みが含まれている。 これらの実験は、それぞれ、下記のほぼ同じリアクタ条
件で行なわれた: ■)、各ウェーハが、20秒間にわたって、1200’
CのH2雰囲気内で250トルの圧力で標準的な事前洗
浄化を施された(この温度は半導体デバイスの製造には
用いられない非常に高い温度である); 2)、エピタキシャルケイ素(シリコン)の選択的被着
のため、リアクタ内において、約2500人のSiが得
られるように、3分間わたって、6.4トルの圧力及び
1000°Cの温度で、20cc/分のDC3(dic
loroscilene)と5リットル/分のH2の流
れの混合気流で被着された;3)、各基板に対してSi
Ge層を選択的に被着させるため、気流は、原子分率で
Geが21%にあたるSiGeの約200人厚の層が得
られるように、25分間にわたって、圧力を6.4トル
、温度を625°Cにして、水素、それも、5リットル
/分のH2のキャリヤー・ガス内で混合された、40c
c/分のDC5と150cc/分の1%のゲルマン(G
eH4)との混合流で構成された。 第1の実験の場合、主として二酸化ケイ素でマスキング
族されたウェーハをリアクタ内に配置し、露出したSi
に対しSiGeを選択的に被着させる試みがなされた。 該実験の結果、SiGeの被着が生じる通常の温度にお
けるSiGeの被着に相応に適合する条件下において、
露出したSiに対しSiGeの選択的被着が生じた。S
iGeは、露出したSiには被着したが、酸化物には被
着しなかった。しかしながら、問題があった。ウェーハ
の大部分がS i O2によってカバーされる結果とし
て、被着膜と酸化物との間に相互作用が生じるというこ
とが判った。該反応によって、はぼ5ideの厚さ全体
にわたって、すなわち、半導体デバイスの生産に関して
そのタイプの被着を関心のもてないものにしてしまうほ
どの大領域にわたって、被着SiGe層内に多くの欠陥
を生じることになった。 一方、ウェーハが、主として露出したSi とごくわず
かな酸化物からなる場合、SiGe層の厚さ全体に及ぶ
欠陥はほとんどながった。 選択的被着によって、小領域に不適合な転位が形成され
る前に、SiGe層のクリティカルな厚さが変化した。 多くの転位が大領域にわたって観測0 された厚さと、Ge含有量で、小領域に被着されたSi
Ge層には、不適合な転位はほとんど生じなかった。次
の実験は、全ての酸化物をほぼ隠蔽することであった。 そうすることによって、答えを得ようとした疑問点は、
ウェーハが主として露出した酸化物を有する場合に発見
された結晶の欠陥を回避することが可能かということと
、他のタイプの被着が生じるかということである。 上述のように、酸化物をカバーする2つの異なる層が、
さまざまな実験で用いられた。一方では、酸化物は、窒
化ケイ素の層でカバーされ、もう−方では、酸化物は、
多結晶Siでカバーされる。 いくつかの相関関係のある事態が生じた。まず、多結晶
Siの場合、被着は非選択性になり、エピタキシャルS
iGeが基板の露出したSi上に、また、多結晶SiG
eが酸化物に重なった多結晶Si上に形成されることが
予測される。それは、確かに、多結晶Siが用いられた
結果であった。 意外にも、窒化ケイ素の場合、同様の作用が観測された
。該状況の場合、多結晶SiGeが露出した窒化物およ
び基板の露出したSi上のエピタキシャルSiGe上に
被着することになり、酸化物がカバーされていなくても
、SiGeの厚さ全体にわたって欠陥は観測されなかっ
た。 さらに、露出した窒化物上に被着させずに、露出したS
i基板上に選択的にSiを被着させることが可能な状態
(条件)も発見された。従って、引続き、混合式でSi
Geを非選択的に被着させることにより、露出したSi
の第1の層上にエピタキシャルSiGeとしての被着が
、また露出した窒化物上に多結晶材料としての被着が生
じるようにすることができた。 窒化物の層の上にくるSiGe層の部分は、露出したS
i上のSiGe層の部分とほぼ同じ厚さになることが観
測された。さらに、露出したSi層上のSiGe層の部
分は、エピタキシャルになり、窒化物の層の上のSiG
e層の部分は、多結晶となった。 結果得られる被着が選択的になるが、非選択的(混合)
になるかを決める要素は数多く存在する。 2− まず、選択的なSiの被着について検討を加えることに
する。酸化物に対するSiの選択性が、窒化物に対する
選択性よりも強いということは、ある程度周知のところ
である。2つの例として、Siまたはタングステンの被
着を施している最中であれば、酸化物に被着させない方
が、窒化物に被着させないようにするよりも簡単である
。従って、基板の表面特性が、考慮事項の1つである。 気体(ガス)の化学的性質を調整することが、もう1つ
の考慮事項である。すなわち、種を含む01対種を含む
SiまたはGeの比が、重要になる。CIが多くなれば
、被着の選択性がそれだけ強くなる。被着の選択性を弱
めるためには、SiまたはGeを多くしなければならな
い。時間及び温度はそれぞれ・、欠陥の有無に影響する
だけでなく、核生成及びその進行速度を左右することに
なるので、やはり、重要な影響がある。 窒化物が存在する状態で被着する場合、Siの被着温度
は、SiGeに比べて高いので、温度とガスのみの相違
によりSiの被着は選択的になり、3 SiGeの被着は非選択的になる条件が存在する。 例えば、Siは、通常、800℃〜1000℃の間で被
着するが、SiGeは、通常、600°C〜700℃の
間で被着する。SiGeの場合、用いられる温度が低く
なると、SiGeに不適合な転位の形成される可能性も
低くなる。 非選択的状況の場合、主たる相違は、DC3の流量が1
/2に減少するということである。H2の流量が増すと
、ウェーハからより速く副産物藪(バイプロダクト)が
除去されるはずであり、従って、H2の流量が増すこと
によって、選択性の強まるごとが予測される。反応性ガ
スの流量が増すと、より短い期間に、被着材料による同
じ厚さの被着が生じるが、Siについては、選択性を助
長することにもなる。 ゲルマンの流量が増す場合、CLの添加をふやさないで
、被着種が添加されているので、SiGeの被着の選択
性が弱まることになる。従って、選択性の問題を生じる
ことなく、ゲルマンの流量を2〜3倍以上に増すことは
できない。 4− 温度は、他の要素によって制約を受ける。例えば、不適
合な転位の形成は、ブランケット被着の場合におけるよ
うに、温度の上限を決定する可能性があり、また温度の
下限は、選択的被着及び混合被着の両方とも、被着速度
とSiGe層における結晶化度の損失によって決定され
る。 圧力、一般には、低圧力は、選択性を助長する傾向があ
るが、しかしこれは、他の多くの変数と相互作用を生じ
ることになり;5ないし10トルが、適度な圧力範囲で
ある。用いられる圧力が大気圧に近づくと、Siの被着
において、選択性を得るのが難しくなり、酸化物の上に
より被着しやすくなる。 代替案として、HCLを添加して、選択性を強めること
が可能であり、従って、被着種を添加せずに、CL種が
添加される。CLの含有量はプロセスの選択性に関する
主たる要因となる。 こうした実験に対する誘引の1つとなった観測の1つは
、大領域において薄いSiGe層を被着させる場合に生
じるかなりの数の欠陥を伴わずに、■ 小領域において厚いSiGe層を成長させることができ
るか否かの確認であった。それは、その通りであること
が分った。すなわち、所定の欠陥密度が得られるSiG
eの厚さは、SiGe層を大領域に被着させる場合に比
べて、小領域に被着させる場合の方がはるかに厚くなる
。 もう1つの実験で明らかになったことは、Si基板表面
に第1の5iO2N、すなわち、フィールド酸化物層を
成長させ、次に、そのフィールド酸化物に所望の窓を異
方性ドライ・エツチング(例えば、プラズマ・エツチン
グ)で形成し、それら窓の側壁がほぼ垂直になるように
することによって、SiGe層の欠陥を減少させること
ができるということであった。ドライ・エツチングを実
施する場合、その酸化物のエツジが一般的に損傷を受け
る。該エツジを修理するために、5iO7の薄い第2の
層をフィールド酸化物の表面、及び、窓中に被着させ、
次に、これら窓の底部表面に湿式エツチングを施して(
例えば、フッ化水素、肝、エツチング)、Siの表面を
露出させることにな6 る。次に、窓内においてSiGe層を選択的に被着させ
る。 化学蒸着技法による制限された反応処理を用いて、酸化
物でパターン形成された、配向が<100>O3t ウ
ェーハ上の露出したSi領域に、Si1□GeX、及び
、Si層を選択的に成長させた。直径が100〜150
μmの領域を検査できるようにする、大領域のシンニン
グ(薄化)技法と共に、平面透過歩キ電子顕微鏡を用い
て、ヘテロインターフェイスにおける不適合な転位の間
隔が測定された。 転位密度は、酸化物で分離されることによって形成され
る小領域(横方向の寸法:数十ミクロン)の場合、パタ
ーン形成された酸化物によって遮断されない隣接する大
領域(ミリメートル)に比べると、少なくとも1/20
に低くなる。パターン形成されたウェーハ上にSi、、
Ge、を選択的に成長させる能力や、成長した状態の薄
膜における転位密度の領域に依存した低下度は、5it
−、GeXのひずんだ層を利用する将来のデバイスの用
途にとって重要な考慮事項になる可能性がある。 7 最近のFi tzgerald他による分子線エピタキ
シによって成長したInGaAs/GaAsひずみ層の
研究[Journal of Applied Phy
sics、65,2220.1989] において示さ
れるように、薄膜成長時に形成された不適合な転位密度
は、成長領域が小さくなれば、低下する。結果として、
大領域よりも小領域にはるかに大きな厚みをもって、ひ
ずみをもって、薄膜が成長されうる。本発明者が明らか
にしたところによれば、この現象を利用して、ひずみ層
における不適合な転位形成の動力学を洞察することが可
能である。転位密度に関する同様の領域に依存した低下
が、化学蒸着(CVD)技法による制限された反応処理
(LRP)によって成長するS to、 a G eo
、 2/Siひずみ層にも観測された。小領域が、Ga
As基板にトレンチをエツチングして得られたメサに薄
膜を被着させることによって小領域が形成されたFit
zgeral/dの研究に対し、本研究における小領域
は、酸化物によるパターン形成が施されたウェーハの露
出したSi領域にS i * S i+−、GeXを選
択的に被着させることによって形成された。 8 CVD技法の場合、メサの上部だけでなく、その側部に
ついても、被着が予測されるので、メサ構造上への成長
は、おそらく、成長領域を制限する有効な手段ではない
。 本研究におけるSi及びSi、、Ge、は、ウェーハ温
度の急速な変化を利用して薄膜成長を開始させたり、終
了させたりするCVD技法である−[八pplied
Physics Letters、47,721.
1985]LRPによって成長させた。酸化物のパター
ンを有するウェーハは、3000人の熱酸化物でカバー
された、配向が<100>のSi基板から作製された。 Si及び5ideの選択的成長は、パターン形成が施さ
れていないウェーハ上に成長させたブランケット層に関
する本発明者の以前の研究で報告したものと同じ成長手
順を利用して行なわれた(1989年5月30日〜6月
20日に、フランスのストラスフ゛−ルで開催された3
vd Int、、Symoon Si MBEにおけ
る:Alternative Growth Meth
ods]。30秒間にわたる1200°Cでの水素によ
る予備ベーキングの後、ジクロロシランを利用して、厚
さが1000人のバラファ層を1000″Cで選択的に
成長させた。これに続いて、ジクロロシランとゲルマン
を利用し、もとの位置に、厚さがほぼ2000人のS
io、 aGeo、 2層が625°Cで被着させられ
た。両方の層とも、約6.5トルの圧力で水素をキャリ
ヤー・ガスに用いて成長させた。層の厚さと組織は、2
.2Meνの’He+のラザフォード散乱(RBS)
と断面透過電子顕微鏡検査(XTEM)によって測定さ
れた。ジクロロシランとゲルマンを用いた、さまざまな
成長温度及び圧力に関する純Si層と純Ge層の選択的
成長が、これまでに報告されている。本研究における5
ide被着の場合、光学顕微鏡検査では、酸化物上に被
着を認められなかった。さらに、平面透過電子顕微鏡検
査及びオージェ(Augen)電子分光器の利用時にお
けるX線分析においても、サンプルの酸化部分上にGe
の形跡のないことが明らかになった。 1200°Cでの11□による予備ベーキングの結果、
酸化物の側壁にアンダー・カットが生じ、酸化物のエツ
ジには、粗さが生じた。それは、選択的薄膜において不
適合な転位の核生成の役割を果たす可0 能性がある。 にわたる不適合な転位を結像するために陰極線ルミネセ
ンスを用いることはできない。従って、電子ヒーム誘導
電流イメージング(EBIC)、)l)ポグラフィ、ま
たは、平面透過電子顕微鏡検査(TEM)といった、別
の技法を利用することが必要になる。EBICは、これ
らの層には不適格と判定された。何故ならば本件の薄膜
における不適合な転位が、はんのわずかにしか電気的に
活性ではなく、またこの技法を用いたイメージングは極
めて困難であることが分ったためである。X線トポグラ
フィも、関係する成長領域が小さく、また酸化物のパタ
ーンによるひずみが存在するため、不合格になった。従
って、転位密度は、平面TEMを用いて測定されたが、
これは、個々の不適合な転位間における平均間隔である
。パターン形成されたウェーハに関する後述の転位間隔
は、大領域と小領域の間に、はぼ均等に、総視野面積が
約1 200、000μm2のスプリットを備えた、4つのT
EM試験体からの平均値である。電子透過領域(直径1
00〜150 μm )が、Moddemによって解説
された技法(Journal of Electron
Microscopy Tech、。 IL16L1989 )を利用した、機械的薄膜化とA
rイオン・ミリングの組合せによって形成された。 最良のサンプルには、ホールを生じることなく、透明に
なるように慎重な仕上げが施された。上記で示されたの
と同様の領域において得られたTIEM顕微鏡写真のコ
ラ−シュ(callage)が、作成された。この領域
は、直径が約1mmの開放された大領域に隣接する、約
10μmの間隔をあけた位置にある1組の酸化物フィン
ガ(f ingures)の端部に位置している。大領
域における不適合な転位の間隔は、0.25μmから変
動することが分ったが、選択的ウェーへの小領域におけ
る間隔は、2.0μmを超える。パターン形成されてい
ないSi制御ウェーハ(同じバッファ層と厚さが200
0人のSiGe薄膜)で測定した不適合な間隔は、選択
的ウェーハの大領域で測定された間隔0.5〜1.0μ
m2 に近かった。不適合な転位が、大領域から小領域及びフ
ィンガへと伝播するのが確認され、また不適合なセグメ
ントを自由表面に接続するつながった転位が、2つの側
壁の一方または他方にだけ観測された。この観測結果は
、これらの転位が、方の側壁で核生成され、他方の側壁
へ広がってい(という考えと一致する。 小成長領域における不適合な転位密度の低下の原因とな
るメカニズムの説明については、以下に行なう。読者は
、Matthews他の研究[J、Appl。 Phys、41,3800.19701やF it、g
erald他の研究を参照されたい。この分析に関して
、不適合な転位の核生成は、一定の面積的密度を備えた
局所的欠陥として定義することが可能な発生源によって
左右されると仮定する;すなわち、N個の発生源/cm
2で得られる一定の発生源の密度が存在するものと仮定
する。基板からつながった転位、ダストの粒子、析出物
、及び、転位の相互作用が、こうした発生源の例である
。3つの相関要素が、観測された領域効果の原因をなし
ている。第1に:小3 領域の場合、発生源の密度が十分に低ければ、活性の核
生成発生源のほとんどない領域、従って、不適合な転位
のほとんどない領域を備えることが可能である。第2に
ニ一定の転位によって発生する不適合なライン長は、領
域(メサまたは酸化物の側壁)のエツジまで延びて、終
っている。第3に:転位の増殖(Appl、 Phys
、 17,85,1978:lは大領域において生じる
可能性が高い。何故ならば増殖を生じる可能性のある転
位の相互作用は、小領域よりも大領域において生じるも
のが多いからである。 第1a図及び第1b図は、不適合な転位の形成に対する
成長領域の影響について概略を示したものである。概略
図の作成にあたっては、上述の第1と第2の要素だけし
か考慮しなかった;転位の増殖は、領域効果を生じる必
要がない。第1a図には、酸化物の側壁(太線)によっ
て画定される9つの方形成長領域のアレイが示されてい
る。各領域は、サイズがL2であり、総成長領域は、9
L2になる。各小領域には、4つの核生成位置4 (スター)がランダムに配置されており、不適合な転位
セグメントの1つは、各発生源によって核生成される。 各小領域における4つの不適合なセグメントのうちの2
つは、2つの直交する<110 >の方向のそれぞれに
延びている。酸化物の側壁によって、不適合なセグメン
トが隣接する領域内へ広がらないようになっている。線
形の不適合な転位密度Pは、<110 >方向のそれぞ
れにおいて測定された転位間隔Sの逆数である。この理
想化された状況では、9つの領域にわたる平均転位間隔
は、1つの領域における転位間隔と同じである;S=L
/2及びP=1/S=2/L0・第1b図で表わされた
状況は、小領域を分割する酸化物の内部側壁が除去され
ている点を除けば、第1a図について解説した状況と同
じである。この結果、サイズが9L2の大領域の1つが
生じる。 この場合、同じ転位発生源によって、長さが3倍の不適
合なセグメントを生じる可能性がある。第1b図におけ
る平均転位間隔はL/6であり、線形転位密度は、第1
a図に比べてそ3倍に高まっ5 た。Fitzgerald他の詳細な分析に示されるよ
うに(以下参照)、不適合な線形転位密度は、Lに比例
するが、ここで、し、すなわち、平均転移ライン長は、
領域の形状寸法の関数である。転位の増殖を考慮すると
、領域効果はより顕著になることが予測され、そして線
形転位密度はもはやLに比例しなくなる。核生成事象の
領域的密度が、関係する特徴のサイズに比べて低い場合
、上述と同様の方法によって、定義により局所的な欠陥
とは関係のない、均質な核生成のモデリングを行なうこ
とができるはずである。 転位密度の領域に依存した低下は、本件の5i1−XG
eX/Si薄膜において顕著であるが、明らかに目立っ
た核生成源はない。配向が<100 >のSiで基板は
転位がないので、基板からつながった欠陥が、これらの
薄膜における不適合な転位の核生成に影響することはな
い。酸化物の側壁に関連した不適合な転位の均質な核生
成に関する形跡が存在するとしても、パターン形成の施
されていない制御ウェー八が、パターン形成を施され6 たウェーへの大領域において観測されるのと同様の転位
密度を備えているという事実が示唆するように、別の核
生成メカニズムが、支配的である。 同一基準のSio、5Geo、z合金におけるひずみは
、0.9%にしかすぎないので、均質な表面の半ループ
の核生成は、ありそうにない。この値は、こうした事象
の開始に必要と考えられる2〜6%の理論的ひずみ値を
かなり下まわっている。従って、おそらくは、転位増殖
(Hagen−5trunkのメカニズムを介した)と
の組合せといった、これまで確認されていない核生成プ
ロセスが、本件のSi、□Gex薄膜における不適合な
転位形成の原因になっている。さらに、選択的被着と組
み合わせた、酸化物によってパターン形成を施されたさ
まざまな領域サイズ及び幾何学形状を備えるウェーハを
用いた実験で、CVD成長層におけるこれらの現象をさ
らに詳細に研究するための手段を提供することが望まし
い。
LRPを利用した、酸化物によるパターン形成が施され
た配向が<100 >のウェーハ上の露出した5ijJ
域に対するSi層及びS io、 B Ge0.2層の
選択的被着について、論証を行なった。転位密度の低下
は、隣接する大領域と比較すると、成長が酸化物のパタ
ーンによって画定される小領域で生しる場合に、顕著に
なる。これらの結果は、Si/5i1−、Gexデバイ
スを生産する上で実際に重要になる可能性があり、また
、CVDで成長するひずみ層における不適合な転位形成
の研究手段として、学問的に関心をひく可能性がある。
た配向が<100 >のウェーハ上の露出した5ijJ
域に対するSi層及びS io、 B Ge0.2層の
選択的被着について、論証を行なった。転位密度の低下
は、隣接する大領域と比較すると、成長が酸化物のパタ
ーンによって画定される小領域で生しる場合に、顕著に
なる。これらの結果は、Si/5i1−、Gexデバイ
スを生産する上で実際に重要になる可能性があり、また
、CVDで成長するひずみ層における不適合な転位形成
の研究手段として、学問的に関心をひく可能性がある。
第1a図および第1b図はSiGe層中の不適合な転位
形成についての成長領域の影響を説明するための図であ
る。
形成についての成長領域の影響を説明するための図であ
る。
Claims (6)
- (1)酸化物でマスクされたSi基板上にSiGe層を
被着する方法であって、酸化物でマスクされた部分の上
部および側壁部上に窒化ケイ素を被着すること、露出さ
れたSiおよび前記窒化ケイ素上にSiGeを非選択的
に被着することを含む方法。 - (2)酸化物でマスクされたSi基板上にSiGe層を
被着する方法であって、酸化物でマスクされた部分の上
部および側壁部上に多結晶シリコンを被着すること、露
出されたSiおよび前記多結晶シリコン上にSiGeを
非選択的に被着することを含む方法。 - (3)酸化物で部分的にマスクされたSi基板上にSi
Ge層を被着する方法であって、Si基板上に第1Si
O_2層を形成すること、前記第1SiO_2層を介し
て異方性ドライエッチングしてほぼ垂直な壁を有する窓
を形成すると共に基板の表面を露出すること、前記第1
SiO_2層上および前記窓の底部に薄い第2SiO_
2層を被着させることを含む方法。 - (4)酸化物で部分的にマスクされたSi基板上にSi
Ge層を被着する方法であって、Si基板上に第1Si
O_2層を形成すること、前記第1SiO_2層を介し
て異方性ドライエッチングしてほぼ垂直な壁を有する窓
を形成すると共に基板の表面を露出すること、前記第1
SiO_2層上および前記窓の底部に薄い第2SiO_
2層を被着させること、前記窓の底部から前記第2Si
O_2層をエッチング除去して基板のSi表面を露出す
ること、前記窓の内部にSiGe層を選択的に被着する
ことを含む方法。 - (5)酸化物で部分的にマスクされたSi基板上にSi
Ge層を被着する方法であって、Si基板上にSiO_
2層を形成すること、前記SiO層を介して窓用のマス
クを、全窓の全領域が基板表面の一部に残されるSiO
_2の全領域に関して最大化されるように前記SiO_
2層を介して窓用のマスクを形成すること、前記マスク
を利用して前記SiO_2層中に窓をエッチングして前
記窓を介してSi基板表面を露出し、そして前記窓内に
SiGe層を選択的に被着することを含む方法。 - (6)酸化物で部分的にマスクされたSi基板上にSi
Ge層を被着する方法であって、Si基板上にSiO_
2層を形成すること、前記SiO_2層を介して窓用の
マスクを、全窓の全領域が基板表面の一部に残されるS
iO_2の全領域に関して最少化されるように前記Si
O_2層を介して窓用のマスクを形成すること、前記マ
スクを利用して前記SiO_2層中に窓をエッチングし
て前記窓を介してSi基板表面を露出し、そして前記窓
内にSiGe層を選択的に被着することを含む方法。
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JPH03276716A true JPH03276716A (ja) | 1991-12-06 |
JP3218472B2 JP3218472B2 (ja) | 2001-10-15 |
Family
ID=23765007
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Country Status (4)
Country | Link |
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US (1) | US5202284A (ja) |
EP (1) | EP0430280B1 (ja) |
JP (1) | JP3218472B2 (ja) |
DE (1) | DE69034129T2 (ja) |
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DE69034129T2 (de) | 2004-10-07 |
EP0430280A3 (en) | 1991-10-09 |
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DE69034129D1 (de) | 2004-04-01 |
JP3218472B2 (ja) | 2001-10-15 |
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