JPH03237821A - 信号変換装置 - Google Patents
信号変換装置Info
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- JPH03237821A JPH03237821A JP2032401A JP3240190A JPH03237821A JP H03237821 A JPH03237821 A JP H03237821A JP 2032401 A JP2032401 A JP 2032401A JP 3240190 A JP3240190 A JP 3240190A JP H03237821 A JPH03237821 A JP H03237821A
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- Japan
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- 238000006243 chemical reaction Methods 0.000 claims abstract description 52
- 238000013139 quantization Methods 0.000 claims description 2
- 230000010354 integration Effects 0.000 abstract description 2
- 230000003247 decreasing effect Effects 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 5
- 230000006870 function Effects 0.000 description 3
- 230000002093 peripheral effect Effects 0.000 description 3
- 230000000694 effects Effects 0.000 description 2
- 238000000034 method Methods 0.000 description 2
- 239000000470 constituent Substances 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/02—Reversible analogue/digital converters
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/12—Analogue/digital converters
- H03M1/14—Conversion in steps with each step involving the same or a different conversion means and delivering more than one bit
- H03M1/145—Conversion in steps with each step involving the same or a different conversion means and delivering more than one bit the steps being performed sequentially in series-connected stages
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Analogue/Digital Conversion (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、ＤＡ（ディジタル−アナログ）変換器とＡＤ
（アナログ−ディジタル）変換器を備えた信号変換装置
に関するものである。
（アナログ−ディジタル）変換器を備えた信号変換装置
に関するものである。
従来、この種の装置は、様々な公知例が知られているが
、その−例として全固体カメラのシステムで用いる直並
列型ＡＤ変換器を周辺回路と共に第２図に示す。図にお
いて、１はクランプ回路、２はサンプルホールド回路、
３ａは直並列型ＡＤ変換器、４．５ａ、６．７はそれぞ
れ直並列型ＡＤ変換器３ａの構成要素であるところの上
位ａビット並列型ＡＤ変換器、ａビットＤＡ変換器。
、その−例として全固体カメラのシステムで用いる直並
列型ＡＤ変換器を周辺回路と共に第２図に示す。図にお
いて、１はクランプ回路、２はサンプルホールド回路、
３ａは直並列型ＡＤ変換器、４．５ａ、６．７はそれぞ
れ直並列型ＡＤ変換器３ａの構成要素であるところの上
位ａビット並列型ＡＤ変換器、ａビットＤＡ変換器。
差分増幅器、下位ｂビット並列型ＡＤ変換器である。８
はディジタル信号処理回路、９はメモリ回路、１０は（
ａ＋ｂ）ビットＤＡ変換器である。
はディジタル信号処理回路、９はメモリ回路、１０は（
ａ＋ｂ）ビットＤＡ変換器である。
次に、動作について説明する。
入力された映像信号は、クランプ回路１．サンプルホー
ルド回路２により直並列型ＡＤ変換器３ａの入力信号と
して適合した映像信号に処理され、前記直並列型ＡＤ変
換器３ａによりディジタル映像信号に変換される。この
ＡＤ変換器３ａは、２つの並列比較方式のＡＤ変換器４
，７及びａビットＤＡ変換器５ａ、差分増幅器６より構
成されており、一般に知られているところの代表的な直
並列型ＡＤ変換器である。又、ａビットＤＡ変換器５ａ
は、直並列型ＡＤ変換器３ａの精度と関係しているため
、精度としては（ａ＋ｂ）ビット以上要求されることは
言うまでもない。ＡＤ変換されたディジタル映像信号は
、ＤＳＰ回路８により、例えば、画像符合化等のディジ
タル信号処理が行われた後、書き込み制御信号によって
ｆｉＩＩｌｌされメモリ回路９に記憶される。
ルド回路２により直並列型ＡＤ変換器３ａの入力信号と
して適合した映像信号に処理され、前記直並列型ＡＤ変
換器３ａによりディジタル映像信号に変換される。この
ＡＤ変換器３ａは、２つの並列比較方式のＡＤ変換器４
，７及びａビットＤＡ変換器５ａ、差分増幅器６より構
成されており、一般に知られているところの代表的な直
並列型ＡＤ変換器である。又、ａビットＤＡ変換器５ａ
は、直並列型ＡＤ変換器３ａの精度と関係しているため
、精度としては（ａ＋ｂ）ビット以上要求されることは
言うまでもない。ＡＤ変換されたディジタル映像信号は
、ＤＳＰ回路８により、例えば、画像符合化等のディジ
タル信号処理が行われた後、書き込み制御信号によって
ｆｉＩＩｌｌされメモリ回路９に記憶される。
次に、読み出し制御信号に制御されてメモリ回路９より
読み出されたディジタル映像信号は、ＤＳＰ回路８によ
り、前述とは逆の画像復号化等が行われた後、（ａ＋ｂ
）ビットＤＡ変換器１０によりアナログ映像信号に変換
された後出力される。
読み出されたディジタル映像信号は、ＤＳＰ回路８によ
り、前述とは逆の画像復号化等が行われた後、（ａ＋ｂ
）ビットＤＡ変換器１０によりアナログ映像信号に変換
された後出力される。
しかしながら、前述の従来例では、周辺回路を含めて高
精度なりＡ変換器を二つ設ける必要があり、例えば、直
並列型ＡＤ変換器３ａ及びＤＡ変換器１０を複数組集積
化する際には、チップサイズ、消費電力及びコストの面
で不利になるという問題を有していた。
精度なりＡ変換器を二つ設ける必要があり、例えば、直
並列型ＡＤ変換器３ａ及びＤＡ変換器１０を複数組集積
化する際には、チップサイズ、消費電力及びコストの面
で不利になるという問題を有していた。
本発明は、このような問題を解消するためになされたも
ので、周辺回路を含めてのＤＡ変換器の数を減らし、集
積化の際、チップサイズ、消費電力を小さくでき、コス
トを低減することのできる信号変換装置を提供すること
を目的とするものである。
ので、周辺回路を含めてのＤＡ変換器の数を減らし、集
積化の際、チップサイズ、消費電力を小さくでき、コス
トを低減することのできる信号変換装置を提供すること
を目的とするものである。
前記目的を達成するため、本発明では信号変換装置をつ
ぎの（１）、（２）、（３）、（４）のとおりＣ＃成す
る。
ぎの（１）、（２）、（３）、（４）のとおりＣ＃成す
る。
（１）アナログ−デジタル（Ａ／Ｄ）変換部とデジタル
−アナログ（Ｄ／Ａ）変換部とを備えたセミフラッシュ
型ＡＤ変換器を用いた信号変換装置において、ＡＤ変換
動作中は上記ＤＡ変換器の入力を一の上記ＡＤ変換器の
変換出力とし、ＯＡ変換動作中は上記ＤＡ変換器の入力
を外部入力とする入力切換手段を有する信号変換装置。
−アナログ（Ｄ／Ａ）変換部とを備えたセミフラッシュ
型ＡＤ変換器を用いた信号変換装置において、ＡＤ変換
動作中は上記ＤＡ変換器の入力を一の上記ＡＤ変換器の
変換出力とし、ＯＡ変換動作中は上記ＤＡ変換器の入力
を外部入力とする入力切換手段を有する信号変換装置。
（２）ＤＡ変換器及び複数のＡＤ変換器を有し、入力信
号をＡＤ変換又はＤＡ変換して出力する信号変換装置で
あって、上記ＤＡ変換器の入力を所定の上記ＡＤ変換器
の変換出力又は外部入力に選択的に切り換えるとともに
、入力を上記変換出力としたときはＤＡ変換器の変換出
力を残りの上記ＡＤ変換器の入力側に供給し、入力を上
記外部入力としたときはＤＡ変換器の変換出力を出力端
子を介して出力する信号変換装置。
号をＡＤ変換又はＤＡ変換して出力する信号変換装置で
あって、上記ＤＡ変換器の入力を所定の上記ＡＤ変換器
の変換出力又は外部入力に選択的に切り換えるとともに
、入力を上記変換出力としたときはＤＡ変換器の変換出
力を残りの上記ＡＤ変換器の入力側に供給し、入力を上
記外部入力としたときはＤＡ変換器の変換出力を出力端
子を介して出力する信号変換装置。
（３）入力信号の上位ビット及び下位ビットを各々並列
にＡＤ変換するＡＤ変換器と、変換出力を、出力端子又
は一方の上記ＡＤ変換器の入力側に出力するＤＡ変換器
と、このＤＡ変換器の入力を、他方の上記ＡＤ変換器の
変換出力又は外部入力に選択的に切り換える切換手段を
備えた信号変換装置。
にＡＤ変換するＡＤ変換器と、変換出力を、出力端子又
は一方の上記ＡＤ変換器の入力側に出力するＤＡ変換器
と、このＤＡ変換器の入力を、他方の上記ＡＤ変換器の
変換出力又は外部入力に選択的に切り換える切換手段を
備えた信号変換装置。
（４）前記（３）において、ＤＡ変換器の量子化レベル
を、このＤＡ変換器の入力の種類に応じて上位ビットと
下位ビットとの和又はいずれか一方のビットに切り換え
る信号変換装置。
を、このＤＡ変換器の入力の種類に応じて上位ビットと
下位ビットとの和又はいずれか一方のビットに切り換え
る信号変換装置。
前記（１）、（２）、（３）の構成により、信号変換装
置がＡＤ変換装置としても、又、ＤＡ変換装置としても
機能し、独立したＤＡ変換器の数を減らすことができる
。
置がＡＤ変換装置としても、又、ＤＡ変換装置としても
機能し、独立したＤＡ変換器の数を減らすことができる
。
以下本発明を実施例により詳しく説明する。
第１図は、本発明の一実施例の“信号変換装置”を用い
た全固体カメラのシステムブロック図である。図中、３
は信号変換装置であり、５及びＳＷＩ、ＳＷ２は、信号
変換装置３の構成要素である（ａ＋ｂ）ビットＤＡ変換
器及び切り換えスイッチ（切り換え手段）である。その
他の部位に関しては、第２図に示す従来例と同様なので
ここでの説明を省略する。
た全固体カメラのシステムブロック図である。図中、３
は信号変換装置であり、５及びＳＷＩ、ＳＷ２は、信号
変換装置３の構成要素である（ａ＋ｂ）ビットＤＡ変換
器及び切り換えスイッチ（切り換え手段）である。その
他の部位に関しては、第２図に示す従来例と同様なので
ここでの説明を省略する。
次に動作を説明する。
入力された映像信号は、クランプ回路１、サンプルホー
ルド回路２により、信号変換装置ｉ３の入力信号として
適合した映像信号に処理され、前記信号変換装置３に入
力される。
ルド回路２により、信号変換装置ｉ３の入力信号として
適合した映像信号に処理され、前記信号変換装置３に入
力される。
ところで、メモリ９に書き込む際には、信号変換装置３
において切り換えスイッチｓｗｌ及びＳＷ２は、ＳＷＩ
及びＳＷ２を制御するスイッチ切り換え制御信号により
、ａ端子側に切り換えられる。その結果、ＤＡ変換器５
は、下位ビット側端子が接地されて固定されるため、ａ
ビットＤＡ変換器として動作する。この結果、信号変換
装置３は（ａ＋ｂ）ビットの直並列ＡＤ変換器として機
能し、前記映像信号を（ａ＋ｂ）ビットのディジタル映
像信号に変換する。ＡＤ変換されたディジタル映像信号
は、ＤＳＰ回路８により例えば画像符合化等のディジタ
ル信号処理が行われた後、書き込みクロック及び書き込
みアドレス信号等から成る書き込み制御信号によって制
御されメモリ回路９に記憶される。
において切り換えスイッチｓｗｌ及びＳＷ２は、ＳＷＩ
及びＳＷ２を制御するスイッチ切り換え制御信号により
、ａ端子側に切り換えられる。その結果、ＤＡ変換器５
は、下位ビット側端子が接地されて固定されるため、ａ
ビットＤＡ変換器として動作する。この結果、信号変換
装置３は（ａ＋ｂ）ビットの直並列ＡＤ変換器として機
能し、前記映像信号を（ａ＋ｂ）ビットのディジタル映
像信号に変換する。ＡＤ変換されたディジタル映像信号
は、ＤＳＰ回路８により例えば画像符合化等のディジタ
ル信号処理が行われた後、書き込みクロック及び書き込
みアドレス信号等から成る書き込み制御信号によって制
御されメモリ回路９に記憶される。
次に、該読み出しクロック及び読み出しアドレス信号等
から成る読み出し制御信号によって制御され、メモリ回
路９より読み出されたディジタル映像信号は、ＤＳＰ回
路８により前述とは逆の画像復号化等が行われた後、信
号変換装置３に入力される。
から成る読み出し制御信号によって制御され、メモリ回
路９より読み出されたディジタル映像信号は、ＤＳＰ回
路８により前述とは逆の画像復号化等が行われた後、信
号変換装置３に入力される。
ところで、メモリ９を読み出す際には、信号変換装置３
において、切り換えスイッチＳＷ１及びＳＷ２はスイッ
チ切り換え制御信号により、ｂ＠子側に切り換えられる
。その結果、ＤＡ変換器５は（ａ＋ｂ）ビットＤＡ変換
器として動作し、前記ディジタル映像信号は、ＤＡ変換
器５にてアナログ映像信号に変換され出力される。つま
り、このとき信号変換装置３は単に（ａ＋ｂ）ビットの
ＤＡ変換器として機能することになる。
において、切り換えスイッチＳＷ１及びＳＷ２はスイッ
チ切り換え制御信号により、ｂ＠子側に切り換えられる
。その結果、ＤＡ変換器５は（ａ＋ｂ）ビットＤＡ変換
器として動作し、前記ディジタル映像信号は、ＤＡ変換
器５にてアナログ映像信号に変換され出力される。つま
り、このとき信号変換装置３は単に（ａ＋ｂ）ビットの
ＤＡ変換器として機能することになる。
以上のように、直並列型の信号変換装置３において、そ
の構成要素であるＤＡ変換器５の入力信号をＡＤ変換器
４の変換出力とメモリ回路９の読み出し信号とに切り換
える切り換え手段を設け、信号変換装置３をＤＡ変換器
としても利用することにより、独立したＤＡ変換器の数
を減することができる。
の構成要素であるＤＡ変換器５の入力信号をＡＤ変換器
４の変換出力とメモリ回路９の読み出し信号とに切り換
える切り換え手段を設け、信号変換装置３をＤＡ変換器
としても利用することにより、独立したＤＡ変換器の数
を減することができる。
なお実施例は直並列型の信号変換装置であるが、本発明
はこれに限らず、ＡＤ変換器及びＤＡ変換器を備えた各
種信号変換装置で実施することができる。
はこれに限らず、ＡＤ変換器及びＤＡ変換器を備えた各
種信号変換装置で実施することができる。
以上説明したように、本発明によれば、ＤＡ変換器の数
を減することができ、本発明による信号変換装置を集積
化する際、チップサイズ、消費電力を小さくでき、コス
トを低減することができる。
を減することができ、本発明による信号変換装置を集積
化する際、チップサイズ、消費電力を小さくでき、コス
トを低減することができる。
第１図は本発明の一実施例のＡＤ変換装置を用いた全固
体カメラのシステムブロック図、第２図は従来例のＡＤ
変換器を用いた全固体カメラのシステムブロック図であ
る。 ３−−ＡＤ変換装置 ５−−−ＤＡ変換器
体カメラのシステムブロック図、第２図は従来例のＡＤ
変換器を用いた全固体カメラのシステムブロック図であ
る。 ３−−ＡＤ変換装置 ５−−−ＤＡ変換器
Claims (1)
- 【特許請求の範囲】 （１）アナログ−ディジタル（Ａ／Ｄ）変換部とディジ
タル−アナログ（Ｄ／Ａ）変換部とを備えたセミフラッ
シュ型ＡＤ変換器を用いた信号変換装置において、ＡＤ
変換動作中は上記ＤＡ変換器の入力を一の上記ＡＤ変換
器の変換出力とし、ＤＡ変換動作中は上記ＤＡ変換器の
入力を外部入力とする入力切換手段を有することを特徴
とする信号変換装置。（２）ＤＡ変換器及び複数のＡＤ
変換器を有し、入力信号をＡＤ変換又はＤＡ変換して出
力する信号変換装置であって、上記ＤＡ変換器の入力を
、所定の上記ＡＤ変換器の変換出力又は外部入力に選択
的に切り換えるとともに、入力を上記変換出力としたと
きはＤＡ変換器の変換出力を残りの上記ＡＤ変換器の入
力側に供給し、入力を上記外部入力としたときはＤＡ変
換器の変換出力を出力端子を介して出力することを特徴
とする信号変換装置。（３）入力信号の上位ビット及び
下位ビットを各々並列にＡＤ変換するＡＤ変換器と、変
換出力を、出力端子又は一方の上記ＡＤ変換器の入力側
に出力するＤＡ変換器と、このＤＡ変換器の入力を、他
方の上記ＡＤ変換器の変換出力又は外部入力に選択的に
切り換える切換手段を備えたことを特徴とする信号変換
装置。 （４）ＤＡ変換器の量子化レベルを、このＤＡ変換器の
入力の種類に応じて上位ビットと下位ビットとの和又は
いずれか一方のビットに切り換えることを特徴とする請
求項３記載の信号変換装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2032401A JPH03237821A (ja) | 1990-02-15 | 1990-02-15 | 信号変換装置 |
| US08/240,218 US5404141A (en) | 1990-02-15 | 1994-05-09 | Signal converting apparatus utilizing an analog-digital converting section and a digital-analog converting section |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2032401A JPH03237821A (ja) | 1990-02-15 | 1990-02-15 | 信号変換装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03237821A true JPH03237821A (ja) | 1991-10-23 |
Family
ID=12357935
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2032401A Pending JPH03237821A (ja) | 1990-02-15 | 1990-02-15 | 信号変換装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US5404141A (ja) |
| JP (1) | JPH03237821A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0641084A2 (en) * | 1993-08-31 | 1995-03-01 | Advanced Micro Devices, Inc. | Analog-digital-analog converter circuit |
| US7116360B2 (en) | 2002-02-28 | 2006-10-03 | Seiko Epson Corporation | Image signal processing circuit and semiconductor device |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5995033A (en) * | 1998-02-02 | 1999-11-30 | Motorola Inc. | Signal conditioning circuit including a combined ADC/DAC, sensor system, and method therefor |
| JPH11272570A (ja) * | 1998-03-24 | 1999-10-08 | Nec Ic Microcomput Syst Ltd | 半導体集積回路 |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4348768A (en) * | 1977-09-06 | 1982-09-07 | International Telephone And Telegraph Corporation | PCM Codec using common D/A converter for encoding and decoding |
| JP2690905B2 (ja) * | 1987-08-28 | 1997-12-17 | 株式会社日立製作所 | 直並列形ａｄ変換器 |
| US5043821A (en) * | 1988-08-31 | 1991-08-27 | Canon Kabushiki Kaisha | Image pickup device having a frame-size memory |
-
1990
- 1990-02-15 JP JP2032401A patent/JPH03237821A/ja active Pending
-
1994
- 1994-05-09 US US08/240,218 patent/US5404141A/en not_active Expired - Fee Related
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0641084A2 (en) * | 1993-08-31 | 1995-03-01 | Advanced Micro Devices, Inc. | Analog-digital-analog converter circuit |
| US7116360B2 (en) | 2002-02-28 | 2006-10-03 | Seiko Epson Corporation | Image signal processing circuit and semiconductor device |
Also Published As
| Publication number | Publication date |
|---|---|
| US5404141A (en) | 1995-04-04 |
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